JP3057724B2 - Encryption device - Google Patents
Encryption deviceInfo
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- JP3057724B2 JP3057724B2 JP2183009A JP18300990A JP3057724B2 JP 3057724 B2 JP3057724 B2 JP 3057724B2 JP 2183009 A JP2183009 A JP 2183009A JP 18300990 A JP18300990 A JP 18300990A JP 3057724 B2 JP3057724 B2 JP 3057724B2
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Description
【発明の詳細な説明】 〔産業上の利用分野〕 本発明は暗号装置に関し、特に暗号化と復号化の同期
を取る必要がある暗号装置に関する。Description: BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to an encryption device, and more particularly, to an encryption device that needs to synchronize encryption and decryption.
かかる暗号装置の同期方式には、自己同期形の方式
と、初めにIV（Initial Value）をセットし暗号化と復
号化の同期をとる方式がある。後者の同期方式の場合、
途中で暗号化と復号化の同期が外れた場合それ以降の復
号化が正常に行われないため、常に暗号化と復号化の同
期判定を行う必要があり、同期外れの場合、IVの再設定
を行わなければならない。その同期判定のための方式に
は次の２つの方式がある。As the synchronization method of such an encryption device, there are a self-synchronization method and a method in which IV (Initial Value) is first set to synchronize encryption and decryption. In the latter case,
If the synchronization between the encryption and decryption is lost in the middle, the subsequent decryption will not be performed normally, so it is necessary to always determine the synchronization between the encryption and the decryption. Must be done. There are the following two methods for the synchronization determination.
（１）送信信号のなかに同期判定用の専用ビットを設
け、同期情報を相手局へ送信する。(1) A dedicated bit for synchronization determination is provided in the transmission signal, and the synchronization information is transmitted to the partner station.
（２）専用ビットは設けずに、受信側暗号装置では復号
化した信号のフレームフォーマットが正常であるかを判
定することにより、暗号化及び復号化の同期判定をす
る。(2) Without providing a dedicated bit, the receiving-side encryption device determines whether the frame format of the decrypted signal is normal, thereby determining the synchronization between encryption and decryption.
上述した従来の暗号装置における同期判定の方式に
は、それぞれ次の欠点がある。Each of the above-described methods for determining synchronization in the conventional encryption device has the following disadvantages.
（１）専用ビットを設けた場合は伝送信号の拡大が生
じ、伝送効率が悪化する。又、同期情報が生で伝送され
るため、暗号強度が低下する欠点がある。(1) When the dedicated bit is provided, the transmission signal expands, and the transmission efficiency deteriorates. Further, since the synchronization information is transmitted live, there is a disadvantage that the encryption strength is reduced.
（２）復号化した信号のフレームフォーマットを判定す
る場合、被暗号化信号が停止又は異常であった時に暗号
化及び復号化の同期判定も断と判定してしまい、被暗号
化信号の停止又は異常と暗号装置の異常との識別ができ
ない欠点がある。(2) When the frame format of the decrypted signal is determined, when the encrypted signal is stopped or abnormal, the synchronization determination of encryption and decryption is also determined to be discontinued. There is a disadvantage that it is not possible to distinguish between an abnormality and an abnormality of the encryption device.
本発明の暗号装置は、暗号化と復号化の同期をとる必
要がある暗号方式の暗号装置において、送信側に、被暗
号化信号のフレームフォーマット判定を行う第１のフレ
ームフォーマット判定回路と、前記被暗号信号と同じフ
レームフォーマットの擬似信号を発生する擬似信号発生
器と、前記第１のフレームフォーマット判定回路がフレ
ームフォーマット正常と判定したとき前記被暗号化信号
を選択しフレームフォーマット異常と判定したとき前記
擬似信号を選択する切替器と、この切替器の選択出力を
入力する暗号化器とを備え、受信側に、復号化器と、こ
の復号化器が復号化した信号のフレームフォーマット判
定を行う第２のフレームフォーマット判定回路とを備え
ている。An encryption device according to the present invention is an encryption device of an encryption method that needs to synchronize encryption and decryption, wherein a first frame format determination circuit that determines a frame format of an encrypted signal on a transmission side; A pseudo signal generator for generating a pseudo signal having the same frame format as the signal to be encrypted, and when the first frame format determining circuit determines that the frame format is normal, selecting the encrypted signal and determining that the frame format is abnormal A switching unit for selecting the pseudo signal; and an encryption unit for inputting a selection output of the switching unit. The reception side performs a decryption unit and determines a frame format of a signal decrypted by the decryption unit. A second frame format determination circuit.
又、本発明の暗号装置は、前記復号化器が復号化した
信号を一時保持してから前記第２のフレームフォーマッ
ト判定回路へ出力するバッファ回路を含んで構成されて
いてもよい。Further, the encryption device of the present invention may be configured to include a buffer circuit that temporarily holds the signal decrypted by the decryptor and outputs the signal to the second frame format determination circuit.
次に本発明について図面を参照して説明する。 Next, the present invention will be described with reference to the drawings.
第１図は本発明の一実施例を示すブロック図である。 FIG. 1 is a block diagram showing one embodiment of the present invention.
被暗号化信号である送信信号７は、通常、送信側暗号
装置６において暗号化器３により暗号化され送信され
る。この送信信号７は、一度バッファ回路１に入力さ
れ、フレームフォーマット判定器４において正しいフレ
ームフォーマットの信号であるか否か常に判定されてい
る。送信信号７のフレームフォーマットが異常であった
場合、フレームフォーマット判定信号８によりスイッチ
２が切替り、擬似信号発生器５が作動する。擬似信号発
生器５は、送信信号７と同じフレームフォーマットの擬
似信号９（アイドルパターン等）を送出する。擬似信号
９はスイッチ２を介し暗号化器３に入力され、送信信号
（暗号文）10となり出力される。従って、送信側暗号装
置６においては、常に正しいフレームフォーマットの送
信信号７又は擬似信号９が暗号化され出力される。The transmission signal 7, which is an encrypted signal, is normally encrypted by the encryptor 3 in the transmission-side encryption device 6 and transmitted. The transmission signal 7 is input to the buffer circuit 1 once, and is always determined by the frame format determiner 4 as to whether or not the signal has a correct frame format. When the frame format of the transmission signal 7 is abnormal, the switch 2 is switched by the frame format determination signal 8 and the pseudo signal generator 5 operates. The pseudo signal generator 5 sends out a pseudo signal 9 (idle pattern or the like) having the same frame format as the transmission signal 7. The pseudo signal 9 is input to the encryptor 3 via the switch 2 and is output as a transmission signal (cipher text) 10. Therefore, the transmitting side encryption device 6 always encrypts and outputs the transmission signal 7 or the pseudo signal 9 having the correct frame format.
受信側暗号装置14では、送信信号（暗号文）10が入力
され、復号化器11で原信号に復号化され出力されるとと
もに、複合化された信号がバッファ回路12を介し、フレ
ームフォーマット判定器13に入力され、原信号への復元
化が正常であるか否かの判定、いいかえれば、暗号化及
び復号化の同期判定が行われる。In the receiving-side encryption device 14, the transmission signal (ciphertext) 10 is input, and is decrypted and output to the original signal by the decryption device 11, and the decrypted signal is passed through the buffer circuit 12 to the frame format determination device. 13 to determine whether the restoration to the original signal is normal or not, in other words, to determine the synchronization between encryption and decryption.
以上説明したように本発明によれば、暗号化と復号化
の同期をとる必要がある暗号方式の暗号装置において、
送信側では被暗号化信号のフレームフォーマットが異常
の場合擬似信号を暗号化して出力し、受信側では、復号
化した後にフレームフォーマットの判定を行うことによ
り、同期判定用の専用ビットを設けることなく暗号化及
び復号化の同期判定を行うことができ、また、被暗号化
信号の異常を送信側で検出でき、暗号装置の異常（暗号
化及び復号化の同期外れ）を受信側で検出できるという
効果を有する。As described above, according to the present invention, in an encryption device of an encryption method that needs to synchronize encryption and decryption,
The transmitting side encrypts and outputs the pseudo signal when the frame format of the signal to be encrypted is abnormal, and the receiving side determines the frame format after decryption, thereby eliminating the need for a dedicated bit for synchronization determination. It is possible to determine the synchronization of encryption and decryption, to detect an abnormality in the signal to be encrypted on the transmission side, and to detect an abnormality in the encryption device (out of synchronization between encryption and decryption) on the reception side. Has an effect.
第１図は本発明の一実施例を示すブロック図である。 １……バッファ回路、２……スイッチ、３……暗号化
器、４……フレームフォーマット判定器、５……擬似信
号発生器、６……送信側暗号装置、７……送信信号、８
……フレームフォーマット判定信号、９……擬似信号、
10……送信信号（暗号文）、11……復号化器、12……バ
ッファ回路、13……フレームフォーマット判定器、14…
…受信側暗号装置。FIG. 1 is a block diagram showing one embodiment of the present invention. DESCRIPTION OF SYMBOLS 1 ... Buffer circuit, 2 ... Switch, 3 ... Encryptor, 4 ... Frame format discriminator, 5 ... Pseudo signal generator, 6 ... Transmission side encryption device, 7 ... Transmission signal, 8
…… Frame format judgment signal, 9 …… Pseudo signal,
10 ... transmitted signal (ciphertext), 11 ... decoder, 12 ... buffer circuit, 13 ... frame format determiner, 14 ...
... Receiving side encryption device.
───────────────────────────────────────────────────── フロントページの続き (58)調査した分野(Int.Cl.7，ＤＢ名) H04L 9/00 H04K 1/00 - 3/00 G09C 1/00 - 5/00 ──────────────────────────────────────────────────続 き Continued on the front page (58) Field surveyed (Int. Cl. 7 , DB name) H04L 9/00 H04K 1/00-3/00 G09C 1/00-5/00
Claims (2)
号方式の暗号装置において、送信側に、被暗号化信号の
フレームフォーマット判定を行う第１のフレームフォー
マット判定回路と、前記被暗号信号と同じフレームフォ
ーマットの擬似信号を発生する擬似信号発生器と、前記
第１のフレームフォーマット判定回路がフレームフォー
マット正常と判定したとき前記被暗号化信号を選択しフ
レームフォーマット異常と判定したとき前記擬似信号を
選択する切替器と、この切替器の選択出力を入力する暗
号化器とを備え、受信側に、復号化器と、この復号化器
が復号化した信号のフレームフォーマット判定を行う第
２のフレームフォーマット判定回路とを備えたことを特
徴とする暗号装置。A first frame format determining circuit for determining a frame format of an encrypted signal on a transmitting side in an encryption device of an encryption system which needs to synchronize encryption and decryption; A pseudo signal generator for generating a pseudo signal having the same frame format as the signal; and a pseudo signal generator for selecting the encrypted signal when the first frame format determination circuit determines that the frame format is normal and for generating the pseudo signal when determining that the frame format is abnormal. A switching device for selecting a signal, and an encryption device for inputting a selection output of the switching device; and a second device for determining a frame format of a signal decrypted by the decryption device on the receiving side. And a frame format determination circuit.
してから前記第２のフレームフォーマット判定回路へ出
力するバッファ回路を含むことを特徴とする請求項１記
載の暗号装置。2. The encryption apparatus according to claim 1, further comprising a buffer circuit for temporarily holding a signal decoded by said decoder and outputting the signal to said second frame format determination circuit.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2183009A JP3057724B2 (en) | 1990-07-11 | 1990-07-11 | Encryption device |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2183009A JP3057724B2 (en) | 1990-07-11 | 1990-07-11 | Encryption device |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0470233A JPH0470233A (en) | 1992-03-05 |
| JP3057724B2 true JP3057724B2 (en) | 2000-07-04 |
Family
ID=16128145
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2183009A Expired - Lifetime JP3057724B2 (en) | 1990-07-11 | 1990-07-11 | Encryption device |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3057724B2 (en) |
-
1990
- 1990-07-11 JP JP2183009A patent/JP3057724B2/en not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0470233A (en) | 1992-03-05 |
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