JP2934055B2 - Resistor - Google Patents

Resistor

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JP2934055B2
JP2934055B2 JP13633691A JP13633691A JP2934055B2 JP 2934055 B2 JP2934055 B2 JP 2934055B2 JP 13633691 A JP13633691 A JP 13633691A JP 13633691 A JP13633691 A JP 13633691A JP 2934055 B2 JP2934055 B2 JP 2934055B2
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Description

【発明の詳細な説明】DETAILED DESCRIPTION OF THE INVENTION

【0001】[0001]

【産業上の利用分野】本発明は発熱量のほとんど無い抵
抗体に関するものである。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a resistor having almost no heat generation.

【0002】[0002]

【従来の技術】従来の抵抗は、電力消費を伴うものであ
つた。即ち、抵抗Rに流れる電流をI、抵抗Rに印加さ
れる電圧をVとした場合の消費電力Pは、P=R・I2
=V・I(ワツト)で表される。ここで、1ワツト=1
J/Sである。
2. Description of the Related Art Conventional resistors involve power consumption. That is, when the current flowing through the resistor R is I and the voltage applied to the resistor R is V, the power consumption P is P = R · I 2
= VI (wat). Here, 1 watt = 1
J / S.

【0003】[0003]

【発明が解決しようとする課題】しかしながら、抵抗R
中を電流Iがt(s)流れると、熱H=R・I2
(J)を発生する。ここで、Hの単位はJ(ジユール)
である。従つて、P=1〔W〕としてHに代入すると、
1(Wh)=3600(J)の熱を発生することにな
る。
However, the resistance R
When a current I flows through the inside for t (s), heat H = R · I 2 t
(J) occurs. Here, the unit of H is J (joule).
It is. Therefore, when P = 1 [W] and substituted into H,
1 (Wh) = 3600 (J) of heat will be generated.

【0004】この様に、従来の抵抗器は、電力消費によ
つて発熱を伴い、温度上昇が常である。従って、この抵
抗器より発生する熱を如何に放熱拡散するかは大きな問
題であつた。また、電力の消費量も大きく、この点も大
きな問題点であつた。
[0004] As described above, the conventional resistor generates heat due to power consumption, and the temperature always rises. Therefore, how to dissipate and diffuse the heat generated from this resistor has been a major problem. Also, the power consumption is large, which is also a major problem.

【0005】[0005]

【課題を解決するための手段】本発明は、上述の課題を
解決することを目的としてなされたもので、上述の課題
を解決する一手段として以下の構成を備える。即ち、等
価抵抗値に対応した所定実効電力量を有するパルス信号
を出力するパルス信号出力手段と、該パルス信号出力手
段よりの出力パルス信号を接続回路の高電位側に接続さ
れる第1の外部接続端子よりの供給電圧と接続回路の接
地電位側に接続される第3の外部接続端子電圧との振幅
を有するパルス信号に変換するパルス変換手段と、該パ
ルス変換手段の変換パルス信号を整流平滑して出力を負
荷に接続される第2の外部接続端子に出力する出力手段
と、接続負荷の変動により生じる電流変化を検出する検
出手段とを備え、検出手段での検出電流値を前記パルス
信号出力手段にフイードバツクし、パルス信号出力手段
は前記検出手段での検出電流値が一定となるように出力
パルス幅を変調する。
SUMMARY OF THE INVENTION The present invention has been made for the purpose of solving the above-mentioned problems, and has the following structure as one means for solving the above-mentioned problems. That is, a pulse signal output means for outputting a pulse signal having a predetermined effective power amount corresponding to the equivalent resistance value, and a first external signal connected to the high potential side of the connection circuit for outputting the pulse signal from the pulse signal output means. Pulse conversion means for converting the supply voltage from the connection terminal to a pulse signal having an amplitude of a third external connection terminal voltage connected to the ground potential side of the connection circuit; and rectifying and smoothing the converted pulse signal of the pulse conversion means. And output means for outputting an output to a second external connection terminal connected to the load, and detection means for detecting a change in current caused by a change in the connection load. The output signal is fed back, and the pulse signal output means modulates the output pulse width so that the current value detected by the detection means is constant.

【0006】そして例えば、本抵抗体をプルアツプ抵抗
としての使用態様の時には第1の外部接続端子と第2の
外部接続端子間に負荷を接続し、プルダウン抵抗として
の使用態様の時には第2の外部接続端子と第3の接続端
子間に負荷を接続する。
For example, when the present resistor is used as a pull-up resistor, a load is connected between the first external connection terminal and the second external connection terminal, and when the present resistor is used as a pull-down resistor, the second external connection terminal is used. A load is connected between the connection terminal and the third connection terminal.

【0007】[0007]

【作用】以上の構成において、抵抗として動作するにも
係わらず、ほとんど発熱しないで、しかも消費電力も少
ない抵抗体が提供できる。
With the above arrangement, it is possible to provide a resistor that generates little heat and consumes little power despite operating as a resistor.

【0008】[0008]

【実施例】以下、図面を参照して本発明に係る一実施例
を詳細に説明する。
DETAILED DESCRIPTION OF THE PREFERRED EMBODIMENTS An embodiment according to the present invention will be described below in detail with reference to the drawings.

【0009】[0009]

【第1実施例】図1は本発明に係る一実施例の構成を示
す図である。以下、図1を参照して本発明に係る第1実
施例の概略構成を説明する。図1において、1は所定周
波数のパルス信号を発生する発振回路、2は発振回路1
よりのパルス信号に対して任意のパルス幅でのパルス幅
変調を行うパルス幅変調回路、3はPNPトランジス
タ、4はNPNトランジスタであり、両トランジスタは
トーテンポール接続となつており、PNPトランジスタ
3のコレクタ端子が外部接続端子Aに、NPNトランジ
スタ4のエミツタ端子が外部接続端子Cに接続され、P
NPトランジスタ3のエミツタ端子がNPNトランジス
タ4のコレクタ端子に接続されている。更に、両トラン
ジスタ3,4のベース端子はパルス幅変調回路2の出力
に接続されている。
FIG. 1 is a diagram showing the configuration of an embodiment according to the present invention. Hereinafter, the schematic configuration of the first embodiment according to the present invention will be described with reference to FIG. In FIG. 1, reference numeral 1 denotes an oscillation circuit for generating a pulse signal of a predetermined frequency, and 2 denotes an oscillation circuit.
A pulse width modulation circuit for performing pulse width modulation with an arbitrary pulse width on the pulse signal is a PNP transistor, 4 is an NPN transistor, both transistors are totem pole connected, and a collector of the PNP transistor 3 The terminal is connected to the external connection terminal A, the emitter terminal of the NPN transistor 4 is connected to the external connection terminal C,
The emitter terminal of the NP transistor 3 is connected to the collector terminal of the NPN transistor 4. Further, the base terminals of the transistors 3 and 4 are connected to the output of the pulse width modulation circuit 2.

【0010】5はPNPトランジスタ3のコレクタ端子
とNPNトランジスタ4のエミツタ端子と、外部接続端
子B間に配設されたフイルタ回路であり、図2に示すL
とCで示される等価回路構成を備え、PNPトランジス
タ3のコレクタ端子とNPNトランジスタ4のエミツタ
端子よりの後述するパルス信号を平滑する。6はパルス
条件設定回路であり、フイルタ回路5の出力(外部接続
端子B)を入力して該入力値に応じてパルス幅変調回路
2の変調パルス幅を制御している。即ち、負荷変動を補
正するためのフイードバツクを行つている。
Reference numeral 5 denotes a filter circuit disposed between the collector terminal of the PNP transistor 3, the emitter terminal of the NPN transistor 4, and the external connection terminal B.
And C, and smoothes a pulse signal to be described later from the collector terminal of the PNP transistor 3 and the emitter terminal of the NPN transistor 4. Reference numeral 6 denotes a pulse condition setting circuit which receives the output of the filter circuit 5 (external connection terminal B) and controls the modulation pulse width of the pulse width modulation circuit 2 according to the input value. That is, feedback is performed to correct the load fluctuation.

【0011】なお、21乃至23は接続回路へのパルス
によるノイズ又は電磁波による影響を軽減するためのビ
ーズフイルタであり、このビーズフイルタ21乃至23
に替え、本実施例回路全体を電磁的遮蔽部材でシールド
してもよい。またはこの両方を備える構成としてもよ
い。電磁的遮蔽部材は例えばフエライト材等が使用でき
る。
Reference numerals 21 to 23 denote bead filters for reducing the effects of noise or electromagnetic waves due to pulses on the connection circuit. These bead filters 21 to 23 are provided.
Alternatively, the entire circuit of this embodiment may be shielded by an electromagnetic shielding member. Alternatively, a configuration including both of them may be adopted. As the electromagnetic shielding member, for example, a ferrite material or the like can be used.

【0012】図1に示す本実施例回路の動作原理を以下
に説明する。本実施例の抵抗体は、従来の抵抗の考え方
とは全く異なる概念に基づく抵抗体であり、従来の抵抗
と見掛け上同等の働きをする等価抵抗体であり、発熱量
Hが、極めて小さくなつている。そして、本実施例抵抗
体をパルス的に駆動して等価的に所望の抵抗値を得てい
る。
The principle of operation of the circuit of this embodiment shown in FIG. 1 will be described below. The resistor of the present embodiment is a resistor based on a concept completely different from the conventional concept of a resistor, and is an equivalent resistor having an apparently equivalent function to the conventional resistor. ing. Then, the resistor of this embodiment is driven in a pulsed manner to obtain a desired resistance value equivalently.

【0013】発振回路1よりの出力パルス信号aは、図
3にaで示す所定周波数のデユーテイ比1対1のパルス
信号を出力する。このパルス信号をパルス幅変調回路2
で本実施例の抵抗値に対応したパルス幅の信号にパルス
幅変調する。例えば、図3にAで示すパルス、又はBに
示すパルス等に変調してパルス信号cとして出力する。
この信号bはトーテンポール接続のトランジスタ3,4
でスイツチングされ、フイルタ回路5へは図3にA´又
はB′で示すパルス信号に変換されて入力される。フイ
ルタ回路5では、この入力信号を平滑し、図3にA´又
はB′で示す信号に斜線で示す”I1 −(I1バー)”
または”I2 −(I2 バー)”の直流電流に変換して外
部接続端子Bに出力する。以上が本実施例回路の基本的
な回路動作である。
The output pulse signal a from the oscillation circuit 1 outputs a pulse signal having a duty ratio of 1: 1 at a predetermined frequency indicated by a in FIG. This pulse signal is converted to a pulse width modulation circuit 2
Then, pulse width modulation is performed on a signal having a pulse width corresponding to the resistance value of the present embodiment. For example, the pulse signal is modulated as a pulse indicated by A in FIG. 3 or a pulse indicated by B in FIG.
This signal b is output from the totem-pole connected transistors 3 and 4
, And is converted into a pulse signal indicated by A 'or B' in FIG. 3 and input to the filter circuit 5. In the filter circuit 5, this input signal is smoothed, and "I 1- (I 1 bar)" indicated by hatching is added to the signal indicated by A 'or B' in FIG.
Alternatively, it is converted to a DC current of “I 2 − (I 2 bar)” and output to the external connection terminal B. The above is the basic circuit operation of the circuit of this embodiment.

【0014】実際の回路において抵抗として用いられる
態様には、図4に示すプルアツプタイプとプルダウンタ
イプとがある。図4において、Ruがプルアツプ抵抗、
Rdがプルダウン抵抗である。このいずれに用いるかで
等価抵抗の回路形式が異なつてくる。以下、先ず本実施
例抵抗体をプルアツプ抵抗として用いる場合を説明す
る。
As a mode used as a resistor in an actual circuit, there are a pull-up type and a pull-down type shown in FIG. In FIG. 4, Ru is a pull-up resistor,
Rd is a pull-down resistor. The circuit form of the equivalent resistance differs depending on which one is used. Hereinafter, the case where the resistor of the present embodiment is used as a pull-up resistor will be described first.

【0015】プルアツプ抵抗として用いる場合には、図
1の抵抗体の外部接続端子Aと外部接続端子B間を負荷
抵抗とし、外部接続端子Cを接地する。即ち、図5に示
す接続状態として使用する。この場合には、外部接続端
子Aは略回路電源電圧であるVaが印加され、発振回路
1及びパルス幅変調回路2よりの出力信号のハイレベル
電位は略この電圧Vaとなる。
When used as a pull-up resistor, a portion between the external connection terminal A and the external connection terminal B of the resistor shown in FIG. 1 is used as a load resistance, and the external connection terminal C is grounded. That is, the connection state shown in FIG. 5 is used. In this case, Va, which is approximately the circuit power supply voltage, is applied to the external connection terminal A, and the high-level potential of the output signal from the oscillation circuit 1 and the pulse width modulation circuit 2 is approximately this voltage Va.

【0016】発振回路1より高電位レベルが略Vaで図
3にaで示す周期t1 のパルス信号が出力される。な
お、このパルス信号のデユーテイ比は、50%でも、或
いは他の任意のデユーテイ比でも任意である。このパル
ス信号に対して、パルス幅変調回路2では、内蔵するボ
リウムによつて本抵抗体が所望の等価抵抗値となるパル
ス幅のパルス幅変調された変調信号を生成して両トラン
ジスタ3,4のベース端子に出力する。このパルス幅
は、図3にAまたはBに示す様にt0 は任意のパルス幅
に調整可能である。
The oscillation circuit 1 outputs a pulse signal having a high potential level of approximately Va and a cycle t 1 shown in FIG. 3A. Note that the duty ratio of the pulse signal is 50% or any other duty ratio. In response to the pulse signal, the pulse width modulation circuit 2 generates a pulse width-modulated signal having a pulse width of which the resistor has a desired equivalent resistance value by means of a built-in volume, and generates a modulation signal of both transistors 3 and 4. Output to the base terminal. This pulse width can be adjusted to an arbitrary pulse width at t 0 as shown by A or B in FIG.

【0017】トーテンポール構成のトランジスタ3,4
のベース端子にこの変調信号が入力されると、このパル
スがロウレベルの時には、PNPトランジスタ3がオ
フ、NPNトランジスタ4がオンとなり、パルスがハイ
レベルの時には、PNPトランジスタ3がオン、NPN
トランジスタ4がオフとなる。この結果、信号線cには
ハイレベルがI1 でロウレベルが接地レベルの、ベース
端子入力パルス信号と略同一位相の変調信号AまたはB
と略同タイミングの信号が出力される。このパルス幅変
調された信号をA′及びB′に示す。この信号はフイル
タ回路5で整流/平滑され、パルス幅に比例した、A′
及びB′に斜線レベルで示す”I1 −(I 1バー)”ま
たは”I2 −(I2 バー)”の直流電流信号(開放時の
直流電圧)が出力される。
Transistors 3 and 4 of totem pole configuration
When this modulation signal is input to the base terminal of this
When the signal is low level, the PNP transistor 3 is turned off.
The NPN transistor 4 is turned on and the pulse is high.
Level, the PNP transistor 3 is turned on and the NPN
The transistor 4 is turned off. As a result, the signal line c
High level is I1And the low level is the ground level, the base
Modulation signal A or B having substantially the same phase as the terminal input pulse signal
Are output at substantially the same timing as. This pulse width variation
The tuned signals are shown at A 'and B'. This signal is
A ′ that is rectified / smoothed by the
And B 'at the diagonal level.1− (I 1Bar)
Or "ITwo− (ITwoBar) ”DC current signal (open
DC voltage) is output.

【0018】以下、本実施例抵抗体の原理を説明する。
本実施例抵抗体は、等価的にはパルス幅変調回路2より
のパルス信号により駆動されるスイツチ回路といえ、原
理的には図6に示す様に、電源Vo の直流電圧はスイツ
チ回路の働きにより負荷抵抗Ro にパルス的に加わつて
いる構成である。図6の場合において、パルスのピーク
電圧はVo であり、これが負荷抵抗にパルス的に加わ
り、その結果としてパルス電流が流れることになる。こ
の時のパルス電流による平均電流”I−(Iバー)”は
以下の様に表すことができる。
Hereinafter, the principle of the resistor of this embodiment will be described.
This embodiment resistor, say switch circuit is equivalently driven by a pulse signal from the pulse width modulation circuit 2, in principle, as shown in FIG. 6, the DC voltage of the power supply V o is the switching circuit it is configured to have One Kuwawa in a pulsed manner to the load resistor R o by the operation. In the case of Figure 6, the peak voltage of the pulse is V o, which is applied to a pulsed manner to the load resistor, so that the pulse current flows as a result. The average current "I- (I bar)" based on the pulse current at this time can be expressed as follows.

【0019】[0019]

【数1】 (Equation 1)

【0020】この結果、スイツチ部分を等価抵抗Ref
f とすると、このReff は以下の様に表せる。 Reff =RO (ts /to ) (1) また、図7の回路によつても等価的に表わすことができ
る。
As a result, the switch is replaced with the equivalent resistance Ref.
Assuming that f, this Ref can be expressed as follows. Reff = R O (t s / t o) (1) also can be expressed also equivalently in cowpea to the circuit of FIG.

【0021】この回路の有効抵抗は、 Reff ={(ts +t0 )/C}・{1/(1−e-t0/RoC )}−Ro (2) で与えられ、{t0 /(Ro C)≪1の場合、 Reff =Ro (ts /to ) (3) となる。The effective resistance of this circuit, Reff = {(t s + t 0) / C} · {1 / (1-e -t0 / RoC)} - given by R o (2), {t 0 / If (R o C) ≪1, then Reff = R o (t s / t o ) (3).

【0022】即ち、上記(1)式と(2)式は同じ結論
となる。以上より、等価抵抗がRo (ts /t0 )に比
例することがわかる。これが、本実施例抵抗体における
基本的な動作原理である。しかしながら、このままでは
負荷抵抗Ro にReff が依存することになり、使い難
い。そこで、本実施例では以下の方法をとることが望ま
しい。
That is, the above expressions (1) and (2) have the same conclusion. Thus, the equivalent resistance seen to be proportional to R o (t s / t 0 ). This is the basic operation principle of the resistor of this embodiment. However, this remains a will depend is Reff the load resistance R o, difficult to use. Therefore, in this embodiment, it is desirable to adopt the following method.

【0023】即ち、負荷抵抗RO への供給電流が一定に
なるように制御する方法、電圧が一定になるように制御
する方法等が考えられる。これらの基本となる回路が図
8に示す回路であり、負荷抵抗RO の状態を電流又は電
圧の形で検出し、この検出結果に基づきパルス条件設定
回路6で発振回路1およびパルス幅変調回路2より構成
されるパルス発生器での発生パルス幅を制御してパルス
幅を自動的に調整して負荷抵抗RO への供給電流が一定
になるように制御、又は電圧が一定になるように制御す
る。なお、フイルタはパルス波形をスムースな波形にす
るためのものである。
That is, a method of controlling the supply current to the load resistance R O to be constant, a method of controlling the voltage to be constant, and the like can be considered. These basic circuits are the circuits shown in FIG. 8, which detect the state of the load resistance R O in the form of current or voltage, and based on the detection result, the pulse condition setting circuit 6 generates the oscillation circuit 1 and the pulse width modulation circuit. The pulse width is automatically adjusted by controlling the pulse width generated by the pulse generator composed of the two, so that the supply current to the load resistor R O is constant or the voltage is constant. Control. The filter is for making the pulse waveform smooth.

【0024】電流を一定にするためには、負荷抵抗Ro
の変動に対して、Reff も変動するようにパルス幅Ts
を制御(電流が一定になるように、負荷抵抗Ro に印加
する電圧値を制御)すればよい。例えば、基準の電流値
と負荷抵抗Ro に流れる電流値とを比較し、その差分を
なくすよう制御する。なお、この場合において、負荷抵
抗Ro に印加可能な最大電圧はVo までであり、負荷抵
抗の抵抗値に制限がある。
To keep the current constant, the load resistance R o
The pulse width T s so that Reff also fluctuates with respect to the fluctuation of
(Control the voltage value applied to the load resistance Ro so that the current is constant). For example, a reference current value is compared with a current value flowing through the load resistor Ro , and control is performed to eliminate the difference. Incidentally, in this case, the maximum voltage that can be applied to the load resistor R o is up to V o, is limited to the resistance value of the load resistor.

【0025】例えば、RO =10Ωである場合に、定電
流I=0.5Aを流したい場合において、Vo =10V
でt0 =1msとした場合を例に説明する。なお、図8
の回路における全体としての抵抗値Rを、R=Reff +
O で表わす。I=0.5Aということは、Vo =10
Vの場合にはR=20Ωである必要がある。R=Reff
+RO =20ΩよりReff =10Ωとなる。
For example, when R O = 10Ω, and when a constant current I = 0.5 A is desired to flow, V o = 10 V
The following describes an example where t 0 = 1 ms. FIG.
The resistance value R as a whole in the circuit of FIG.
Expressed as RO. I = 0.5 A means that V o = 10
In the case of V, it is necessary that R = 20Ω. R = Reff
From + R O = 20Ω, Reff = 10Ω.

【0026】上述した計算式式Reff =RO (ts /t
o )よりt0 =1msからts =1msであることがも
とめられる。従つて、パルス発生器よりは、t0 =1m
s、ts =1msのパルスを発生されるように制御すれ
ばよい。この状態時に、Ro の抵抗値が変動し、RO
1Ωと急激に低下した場合に、R=Reff +RO =20
ΩよりReff =19Ωとなる。従つて、上述の計算式よ
りts =11msのパルスを発生されるように制御すれ
ばよい。
[0026] The above-mentioned formula formula Reff = R O (t s / t
o ) indicates that t 0 = 1 ms to t s = 1 ms. Therefore, from the pulse generator, t 0 = 1 m
What is necessary is just to control so that a pulse of s, t s = 1 ms is generated. During this state, the resistance value of R o varies, R O =
When the resistance drops sharply to 1Ω, R = Reff + R O = 20
Reff = 19Ω from Ω. Therefore, it is sufficient to control so that a pulse of t s = 11 ms is generated from the above formula.

【0027】I=0.5Aの一定電流としたい場合にお
けるRO の抵抗値とts のパルス幅との関係を図9に、
パルス条件設定回路6によるパルス発生器へのフイード
バツク電圧とパルス幅t0 の関係等を図10に示す。図
8の回路において、Ro =10Ωの場合は、Vo =10
Vであることより図8のd点における電位は5Vとな
り、パルス条件設定回路6には5Vが送られる。パルス
条件設定回路6は5Vが入力されれば図10に示すよう
にパルス発生器よりts =1msのパルスが出力される
ように制御する。
FIG. 9 shows the relationship between the resistance value of R O and the pulse width of t s when a constant current of I = 0.5 A is desired.
FIG. 10 shows the relationship between the feedback voltage to the pulse generator and the pulse width t 0 by the pulse condition setting circuit 6. In the circuit of FIG. 8, when R o = 10Ω, V o = 10
8, the potential at point d in FIG. 8 becomes 5 V, and 5 V is sent to the pulse condition setting circuit 6. The pulse condition setting circuit 6 controls so that a pulse of t s = 1 ms is output from the pulse generator as shown in FIG. 10 when 5 V is input.

【0028】もし、Ro =1Ωであれば、Reff =19
Ωとなり、図8のd点における電位は0.5Vとなりパ
ルス条件設定回路6には0.5Vが送られ、パルス条件
設定回路6は図9に示すようにパルス発生器よりts
19msのパルスが出力されるように制御する。なお、
o =10Vの時には,抵抗値Rが20Ω以上となつた
場合には定電流に制御できず、負荷抵抗の抵抗値に制限
がある。
If R o = 1Ω, Reff = 19
8, the potential at the point d in FIG. 8 becomes 0.5 V, and 0.5 V is sent to the pulse condition setting circuit 6. As shown in FIG. 9, the pulse condition setting circuit 6 receives t s =
Control is performed so that a pulse of 19 ms is output. In addition,
When V o = 10 V, if the resistance value R is 20 Ω or more, the current cannot be controlled to a constant current, and the resistance value of the load resistance is limited.

【0029】更に、電圧を一定にするためには、パルス
幅T0 を制御して、Reff を負荷抵抗Ro の変動に対し
て負荷抵抗Ro に印加される電圧が一定になるように制
御すればよい。例えば、基準の電圧値と負荷抵抗Ro
の印加電圧であるd点の電圧値とを比較し、その差分を
なくすよう制御する。なお、この場合においては、最少
負荷抵抗Ro に制限がある。
Furthermore, in order to make the voltage constant by controlling the pulse width T 0, control such that the voltage applied to the load resistor R o for variations in the load resistance R o of Reff becomes constant do it. For example, a reference voltage value is compared with a voltage value at a point d which is a voltage applied to the load resistor Ro , and control is performed so as to eliminate the difference. In this case, the minimum load resistance Ro is limited.

【0030】以上の原理を実際の回路で実現したのが図
1の回路である。この図1に示す回路を図5に示す様に
プルアツプ抵抗として用いた場合においても、Ruの発
熱は原理的に発生せず、僅かにトランジスタの飽和電圧
(約0.2V〜0.4V)、飽和抵抗(数Ω〜数十Ω)
による発熱、及び各回路よりの僅かの発熱があるのみで
ある。しかし、これらの発熱はごく僅かであり、殆んど
発熱量のない抵抗体とすることができる。更に、大電流
を消費して熱に変える方式ではないことより、抵抗体で
の消費電力も低く抑えることができる。
The circuit shown in FIG. 1 realizes the above principle with an actual circuit. Even when the circuit shown in FIG. 1 is used as a pull-up resistor as shown in FIG. 5, heat generation of Ru does not occur in principle, and the saturation voltage (about 0.2 V to 0.4 V) of the transistor is slightly increased. Saturation resistance (several ohms to tens of ohms)
And only slight heat from each circuit. However, these heat generations are very small, and a resistor having almost no heat generation can be obtained. Furthermore, since it is not a method of consuming a large current and converting it to heat, the power consumption of the resistor can be suppressed low.

【0031】以上は本実施例の抵抗体を プルアツプ抵
抗として用いる場合の例を説明した。しかし、本実施例
はプルダウン抵抗として用いることもできる。この場合
には、図11に示す様に、外部接続端子Aを電源に、外
部接続端子Bを負荷抵抗Ro側に、外部接続端子Cを接
地側に接続する。この場合においても、等価抵抗Rdは
上述したプルアツプ抵抗として用いた場合と同様にし
て、パルス幅変調回路2のボリウムの設定値に従い一義
的に定まり、相違はない。この場合においても、抵抗体
よりの発熱量は殆どない。
In the above, an example in which the resistor of this embodiment is used as a pull-up resistor has been described. However, this embodiment can also be used as a pull-down resistor. In this case, as shown in FIG. 11, the external connection terminal A is connected to the power supply, the external connection terminal B is connected to the load resistor Ro, and the external connection terminal C is connected to the ground side. Also in this case, the equivalent resistance Rd is uniquely determined according to the set value of the volume of the pulse width modulation circuit 2 in the same manner as in the case where the equivalent resistance Rd is used as the pull-up resistor, and there is no difference. Also in this case, there is almost no heat generation from the resistor.

【0032】以上説明した様に本実施例によれば、抵抗
体での消費電力、及び発熱量を低く抑えることができ
る。
As described above, according to this embodiment, the power consumption and the heat generation of the resistor can be suppressed low.

【0033】[0033]

【第2実施例】以上の説明は、いわば本発明の原理を忠
実に回路化した例について行つた。しかし、本発明は以
上の例に限定されるものではなく、同様の等価回路を達
成する構成であれば、任意の構成を採用できる。原理的
に上述した第1実施例と同様構成であるが、より簡略化
した詳細回路構成を図12を参照して以下に説明する。
Second Embodiment The above description has been made with respect to an example in which the principle of the present invention is faithfully implemented as a circuit. However, the present invention is not limited to the above example, and any configuration can be adopted as long as a similar equivalent circuit is achieved. Although the configuration is basically the same as that of the first embodiment described above, a more simplified detailed circuit configuration will be described below with reference to FIG.

【0034】図12は本発明に係る第2実施例の詳細回
路図であり、破線で囲つた30部分が図1の発振回路1
およびパルス幅変調回路2を合わせ備えるデユーテイ比
可変タイプの発振回路であり、ボリウムVR1によりデ
ユーテイ比を任意に変更可能に構成している。そして、
TR1,TR2,R1〜R4,C1,C2でCR発振回
路を構成している。このCR発振回路30よりの出力パ
ルス信号は、抵抗R5を介してPNPトランジスタTR
3のベースに接続され、該トランジスタTR3をオン/
オフし、入力信号の反転信号を出力する。このトランジ
スタTR3のコレクタは抵抗R6を介して抵抗R7でプ
ルアツプされたNPN型トランジスタTR4のベースに
接続されており、更に、このトランジスタTR4で反転
され、35に示すフイルタ回路へはCR発振回路30よ
りの出力パルス信号と同期した外部接続端子Aよりの供
給電圧をハイレベル電圧としたパルス信号が供給され
る。このパルス信号はフイルタ回路35のL1及びC3
で整流平滑される。
FIG. 12 is a detailed circuit diagram of a second embodiment according to the present invention.
And a duty ratio variable type oscillation circuit including the pulse width modulation circuit 2 and the duty ratio can be arbitrarily changed by the volume VR1. And
TR1, TR2, R1 to R4, C1, and C2 constitute a CR oscillation circuit. An output pulse signal from the CR oscillation circuit 30 is supplied to a PNP transistor TR via a resistor R5.
3 and turns on / off the transistor TR3.
Turns off and outputs an inverted signal of the input signal. The collector of the transistor TR3 is connected to the base of an NPN transistor TR4 pulled up by a resistor R7 via a resistor R6. The collector of the transistor TR3 is inverted by the transistor TR4. A pulse signal having a high supply voltage from the external connection terminal A synchronized with the output pulse signal is supplied. This pulse signal is applied to L1 and C3 of the filter circuit 35.
Is rectified and smoothed.

【0035】更に、その出力の電流又は電圧がパルス条
件設定回路6を介してCR発振回路30にフイ−ルドバ
ツクされ、CR発振回路30よりの出力パルスのパルス
幅が変調される。この結果、図12の構成においても、
図1に示す第1実施例と同様、図12の構成を備える抵
抗体をプルアツプ抵抗として用いる場合には、外部接続
端子Aと外部接続端子B間を負荷抵抗とし、外部接続端
子Cを接地する。即ち、図5に示す接続状態として使用
する。プルダウン抵抗として用いる場合には、外部接続
端子Bと外部接続端子C間に負荷抵抗を接続し、外部接
続端子Aを電源に接続し、図11に示す接続状態として
使用する。
Further, the output current or voltage is field-backed to the CR oscillation circuit 30 via the pulse condition setting circuit 6, and the pulse width of the output pulse from the CR oscillation circuit 30 is modulated. As a result, in the configuration of FIG.
As in the first embodiment shown in FIG. 1, when a resistor having the configuration shown in FIG. 12 is used as a pull-up resistor, the load between the external connection terminal A and the external connection terminal B is set as a load resistance, and the external connection terminal C is grounded. . That is, the connection state shown in FIG. 5 is used. When used as a pull-down resistor, a load resistor is connected between the external connection terminal B and the external connection terminal C, the external connection terminal A is connected to a power supply, and the connection state shown in FIG. 11 is used.

【0036】以上説明した第2実施例においても、消費
電力も少なく、また、発熱量も少ない抵抗体が提供でき
る。
The second embodiment described above can also provide a resistor that consumes less power and generates less heat.

【0037】[0037]

【他の実施例】以上の説明は発振回路よりの発振パルス
信号の発振周波数を固定し、発振パルスのデユーテイ比
を変化させて等価抵抗値を変える例について説明した。
しかし、本発明は以上の例に限定されるものではなく、
パルス幅変調に替え、FM変調回路を設け、等価抵抗値
に従い発振周波数を変化させて接続端子Bでの開放出力
電圧値を変化させ、所望の等価抵抗値を得るように構成
してもよい。
Other Embodiments In the above description, an example was described in which the oscillation frequency of the oscillation pulse signal from the oscillation circuit was fixed, and the duty ratio of the oscillation pulse was changed to change the equivalent resistance value.
However, the present invention is not limited to the above examples,
Instead of the pulse width modulation, an FM modulation circuit may be provided so that the oscillation frequency is changed according to the equivalent resistance value to change the open output voltage value at the connection terminal B to obtain a desired equivalent resistance value.

【0038】また、この等価抵抗値を可変とする必要の
ない場合には、ボリウムではなく、固定抵抗により抵抗
分を分ければよい。このように構成することにより、調
整過程も不要となり、かつ廉価にできる。
When it is not necessary to make the equivalent resistance variable, the resistance may be divided by a fixed resistance instead of a volume. With this configuration, the adjustment process is not required, and the cost can be reduced.

【0039】[0039]

【発明の効果】以上説明したように本発明によれば、抵
抗として動作するにも係わらず、ほとんど発熱しない
で、しかも消費電力も少ない抵抗体が提供できる。
As described above, according to the present invention, it is possible to provide a resistor that generates little heat and consumes less power despite operating as a resistor.

【図面の簡単な説明】[Brief description of the drawings]

【図1】本発明に係る第1実施例の構成図である。FIG. 1 is a configuration diagram of a first embodiment according to the present invention.

【図2】図1のフイルタ回路の等価回路を示す図であ
る。
FIG. 2 is a diagram showing an equivalent circuit of the filter circuit of FIG.

【図3】第1実施例の各部の信号波形を示す図である。FIG. 3 is a diagram showing signal waveforms of respective units of the first embodiment.

【図4】実際の回路において抵抗として用いられる態様
を示す図である。
FIG. 4 is a diagram showing a mode used as a resistor in an actual circuit.

【図5】第1実施例の抵抗体をプルアツプ抵抗として用
いる場合の接続例を示す図である。
FIG. 5 is a diagram showing a connection example when the resistor of the first embodiment is used as a pull-up resistor.

【図6】本実施例の抵抗体の基本原理を説明するための
図である。
FIG. 6 is a diagram for explaining the basic principle of the resistor according to the present embodiment.

【図7】本実施例の抵抗体を等価的に表した他の回路例
を示す図である。
FIG. 7 is a diagram showing another example of a circuit equivalently representing the resistor of the present embodiment.

【図8】本実施例の抵抗体におけるフイードバツクによ
つてパルス条件を変更する構成の概略を示す図である。
FIG. 8 is a diagram schematically showing a configuration in which pulse conditions are changed by feedback in the resistor of the present embodiment.

【図9】第1実施例の負荷抵抗に定電流を供給する場合
の負荷抵抗の抵抗値と本実施例での制御パルス幅の関係
を示す図である。
FIG. 9 is a diagram illustrating a relationship between a resistance value of a load resistor and a control pulse width in the present embodiment when a constant current is supplied to the load resistor of the first embodiment.

【図10】第1実施例の負荷抵抗に定電流を供給する場
合の負荷抵抗の抵抗値とフイードバツク電圧及び制御パ
ルス幅の関係を示す図である。
FIG. 10 is a diagram showing a relationship between a resistance value of a load resistor, a feedback voltage and a control pulse width when a constant current is supplied to the load resistor of the first embodiment.

【図11】第1実施例の抵抗体をプルダウン抵抗として
用いる場合の接続例を示す図、
FIG. 11 is a diagram showing a connection example when the resistor according to the first embodiment is used as a pull-down resistor;

【図12】本発明に係る第2実施例の回路図である。FIG. 12 is a circuit diagram of a second embodiment according to the present invention.

【符号の説明】[Explanation of symbols]

1 発振回路 2 パルス幅変調回路 5,35 フイルタ回路 6 パルス条件設定回路 30 CR発振回路 DESCRIPTION OF SYMBOLS 1 Oscillation circuit 2 Pulse width modulation circuit 5, 35 Filter circuit 6 Pulse condition setting circuit 30 CR oscillation circuit

Claims (2)

(57)【特許請求の範囲】(57) [Claims] 【請求項1】等価抵抗値に対応した所定実効電力量を有
するパルス信号を出力するパルス信号出力手段と、該パ
ルス信号出力手段よりの出力パルス信号を接続回路の高
電位側に接続される第1の外部接続端子よりの供給電圧
と接続回路の接地電位側に接続される第3の外部接続端
子電圧との振幅を有するパルス信号に変換するパルス変
換手段と、該パルス変換手段の変換パルス信号を整流平
滑して出力を負荷に接続される第2の外部接続端子に出
力する出力手段と、前記接続負荷の変動により生じる電
流変化を検出する検出手段とを備え、 前記検出手段での検出電流値を前記パルス信号出力手段
にフイードバツクし、前記パルス信号出力手段は前記検
出手段での検出電流値が一定となるように出力パルス幅
を変調することを特徴とする抵抗体。
1. A pulse signal output means for outputting a pulse signal having a predetermined effective power amount corresponding to an equivalent resistance value, and a pulse signal output from the pulse signal output means connected to a high potential side of a connection circuit. Pulse converting means for converting a voltage supplied from the first external connection terminal into a pulse signal having an amplitude of a third external connection terminal voltage connected to the ground potential side of the connection circuit; and a converted pulse signal of the pulse conversion means Output means for rectifying and smoothing the output and outputting the output to a second external connection terminal connected to the load; and detection means for detecting a current change caused by the fluctuation of the connection load. A value is fed back to the pulse signal output means, and the pulse signal output means modulates an output pulse width so that a current value detected by the detection means is constant. .
【請求項2】請求項1記載の抵抗体において、 プルアツプ抵抗としての使用態様の時には第1の外部接
続端子と第2の外部接続端子間に負荷を接続し、プルダ
ウン抵抗としての使用態様の時には第2の外部接続端子
と第3の接続端子間に負荷を接続することを特徴とする
抵抗体。
2. A resistor according to claim 1, wherein a load is connected between the first external connection terminal and the second external connection terminal in a use mode as a pull-up resistor, and in a use mode as a pull-down resistor. A resistor, wherein a load is connected between the second external connection terminal and the third connection terminal.
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