JP2866432B2 - CD-WO device - Google Patents

CD-WO device

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JP2866432B2
JP2866432B2 JP5747790A JP5747790A JP2866432B2 JP 2866432 B2 JP2866432 B2 JP 2866432B2 JP 5747790 A JP5747790 A JP 5747790A JP 5747790 A JP5747790 A JP 5747790A JP 2866432 B2 JP2866432 B2 JP 2866432B2
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unit
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Description

【発明の詳細な説明】 [産業上の利用分野] 本発明は、CD−WO(コンパクトディスク−ライトワン
ス)装置に関する。
Description: TECHNICAL FIELD The present invention relates to a CD-WO (Compact Disc-Write Once) device.

[従来の技術] CD−ROM(コンパクトディスク−リード オンリー
メモリ)やCD−I(コンパクトディスク−インタラクテ
ィブ)といった、CDへのデータの書き込みをユーザでは
行わないタイプにおいては、CDにデータを書き込む際の
フォーマットが既に決まっている。一方、CD−WOのよう
に、CDへのデータの書き込みがユーザにおいても行える
タイプのものにおいても、CD−ROMのフォーマットに準
じたフォーマットにて、ディスクへのデータの書き込
み、及び読み出すシステムが開発されつつある。この明
細書で、CDとは回転ディスクにディジタル情報を光学的
あるいは磁気的に読取可能に書き込んだ記録媒体を言
い、その寸法には制限されない。
[Prior Art] CD-ROM (Compact Disc-Read Only)
In a type such as a memory) or a CD-I (compact disk-interactive), in which data is not written on a CD by a user, a format for writing data on the CD is already determined. On the other hand, a system for writing and reading data to and from a disc in a format similar to the format of a CD-ROM has also been developed for a type such as a CD-WO in which a user can write data to a CD. Is being done. In this specification, a CD refers to a recording medium in which digital information is optically or magnetically read on a rotating disk, and is not limited in its size.

CD−ROMやCD−Iのフォーマットでは、第3図に示す
ようにモード、フォームに応じて2352バイトの1ブロッ
ク内に、一ブロックを判別するためのデータが記録され
るシンクパターン、一枚のCDにおける時間情報であるA
タイムやモードを規定するデータが記録されているヘッ
ダ、ユーザデータ、エラー検出用のデータであるEDC
(エラー ディテクション コード)、エラー訂正用の
データであるECC(エラー コレクション コード)、
さらにCD−Iにおいてはユーザデータの種類や形式、フ
ォーム等を規定するサブヘッダが設けられ、これらによ
り一つのブロックが構成されている。
In the format of a CD-ROM or CD-I, as shown in FIG. 3, a sync pattern in which data for identifying one block is recorded in one block of 2352 bytes according to the mode and form, A which is time information on CD
EDC which is header for recording data that defines time and mode, user data, and data for error detection
(Error detection code), error correction code (ECC),
Further, the CD-I is provided with sub-headers that define the type, format, form, and the like of user data, and these constitute one block.

実際にCDに情報を書き込む構成部分いわゆるドライブ
システム部以外の、いわゆるホストシステム部において
ユーザデータの処理が行なわれていることより、例えば
CD−WOによりCDへデータを書き込む場合には上記のホス
トシステム部あるいはドライブシステム部のいずれかの
構成部分にて上記ホストシステムが有するユーザデータ
に上述したシンクパターン等のデータを付加しなければ
ならない。
Since the processing of the user data is performed in a so-called host system unit other than the component that actually writes information on the CD, the so-called drive system unit, for example,
When writing data to a CD by CD-WO, data such as the sync pattern described above must be added to the user data possessed by the host system in either the host system unit or the drive system unit. .

ホストシステムにてこれらを付加するとすれば、中央
演算処理装置(以下CPUと記す)及びメモリにおける負
担が大きくなり、能率的でない。又、上記ヘッダデータ
部分に記録されるAタイムのデータは、上記ブロック毎
に順次インクリメントさせれば良いこと、モードは通常
トラック内では一定であることにより、CD−WOにおいて
これらはドライブシステム部にて生成、付加した方が効
率的である。
If these are added by the host system, the load on the central processing unit (hereinafter referred to as CPU) and the memory increases, which is not efficient. Also, the A-time data recorded in the header data portion may be sequentially incremented for each block, and the mode is usually constant within a track. It is more efficient to generate and add them.

よって、本発明では、CD−WO装置においてドライブシ
ステム部にてシンクパターン、ヘッダ、サブヘッダ等の
データを付加するCD−WO装置を提供することを目的とす
る。
Accordingly, an object of the present invention is to provide a CD-WO device in which data such as a sync pattern, a header, and a subheader is added by a drive system unit in the CD-WO device.

[課題を解決するための手段] 本発明は、光ディスクに書き込む書き込みデータを保
存するホストシステム部と、上記ホストシステム部から
上記書き込みデータが供給され光ディスクに上記書き込
みデータの書きこみ動作を行うドライブシステム部とを
有し、CD−ROM及びCD−Iの規定に準じたフォーマット
にて情報を光ディスクに書き込むCD−WO装置において、 上記ホストシステム部は、上記書き込みデータ内のユ
ーザデータを上記ドライブシステム部へ送出し、 上記ドライブシステム部は、上記ホストシステム部よ
りデータが供給されることで各構成部分の動作制御を行
う制御部と、上記フォーマットに応じて上記書き込みデ
ータに含まれるユーザデータ以外のデータを上記制御部
の制御により作成するデータ作成部と、上記ホストシス
テム部より供給される上記ユーザデータ及び上記作成部
にて作成される上記ユーザデータ以外のデータを上記フ
ォーマットに応じて記憶する書き込み読み出し可能なメ
モリと、上記メモリに書きこまれたデータを上記光ディ
スクへ書き込むためにデータ処理を行う信号処理回路へ
送出するデータ送出部と、を備えたことを特徴とする。
Means for Solving the Problems The present invention provides a host system unit for storing write data to be written to an optical disk, and a drive system to which the write data is supplied from the host system unit and performs an operation of writing the write data to the optical disk A CD-WO device for writing information on an optical disc in a format conforming to the provisions of a CD-ROM and a CD-I, wherein the host system unit stores user data in the write data in the drive system unit. The drive system unit includes a control unit that controls the operation of each component by being supplied with data from the host system unit, and data other than user data included in the write data according to the format. A data creation unit that creates the data under the control of the control unit; A write / read memory for storing the user data supplied from the unit and data other than the user data created by the creation unit in accordance with the format, and transferring the data written in the memory to the optical disc. A data transmission unit that transmits the data to a signal processing circuit that performs data processing for writing.

[作用] ドライブシステム部は、ユーザデータ以外の所定のデ
ータをデータ作成部にて作成するので、ホストシステム
部に備わるCPU、メモリの負担を少なくするように作用
する。
[Operation] Since the drive system unit creates predetermined data other than the user data in the data creation unit, the drive system unit acts to reduce the load on the CPU and memory provided in the host system unit.

[実施例] 本発明のCD−WO装置に備わるドライブシステム部の一
実施例における構成を示す第1図において、ホストシス
テムが有するCDへ記録するためのユーザデータが供給さ
れるホストインタフェース1の出力側は、本ドライブシ
ステム部を構成する回路素子内に設けられるアドレスバ
ス2、データバス3及び後述するアビトレーション回路
4に接続される。又、アドレスバス2及びデータバス3
にはCDへ記録されるシンクパターン等の各種データを記
憶するバッファRAM5が接続されているので、ホストシス
テムより送出されたユーザデータは、DMAもしくはプロ
グラム転送によりホストインタフェース1、データバス
3を介してバッファRAM5に記憶される。バッファRAM5
は、ブロック毎にページ分けされており、例えばCD−I
フォーム1のデータの書き込みを行う場合、ホストシス
テムは各ページの、第3図に示す、リラティブアドレス
の24番地より2071番地まで2048バイトのユーザデータを
記憶する。尚、上記ブロックとは、磁気記録媒体である
フロッピディスクに情報を書き込む際のセクタに相当す
るものをいう。
[Embodiment] In FIG. 1 showing a configuration of an embodiment of a drive system unit provided in a CD-WO device of the present invention, an output of a host interface 1 to which user data for recording on a CD of a host system is supplied. The side is connected to an address bus 2, a data bus 3, and an arbitration circuit 4, which will be described later, provided in circuit elements constituting the drive system unit. Also, address bus 2 and data bus 3
Is connected to a buffer RAM 5 for storing various data such as a sync pattern recorded on a CD, so that user data sent from the host system is transferred via the host interface 1 and the data bus 3 by DMA or program transfer. It is stored in the buffer RAM5. Buffer RAM5
Is divided into pages for each block. For example, CD-I
When writing the data of Form 1, the host system stores 2048 bytes of user data of each page from the relative address address 24 to the address 2071 shown in FIG. The above-mentioned block corresponds to a sector when information is written on a floppy disk which is a magnetic recording medium.

システムコントローラ6は、独自にホストシステムと
コマンドの送受を行い、CDに記録するデータであるヘッ
ダの初期値、サブヘッダのバリューフォーマット、転送
ブロック数をホストシステムより受け取り本ドライブシ
ステム内の構成部分の動作を制御する回路である。シス
テムコントローラ6の出力側は、制御回路7、ヘッダ部
データ生成回路9、サブヘッダ部データレジスタ10、ア
ドレス生成回路11、シーケンサ12、及びシステムコント
ローラデータバス15に接続される。
The system controller 6 independently sends and receives commands to and from the host system, receives from the host system the initial value of the header, the value format of the subheader, and the number of transfer blocks, which are data to be recorded on the CD, from the host system, and operates the components in the drive system. Is a circuit that controls The output side of the system controller 6 is connected to the control circuit 7, the header data generation circuit 9, the subheader data register 10, the address generation circuit 11, the sequencer 12, and the system controller data bus 15.

制御回路7の出力側は、アビトレーション回路4、シ
ンクパターン発生回路8、ヘッダ部データ生成回路9、
サブヘッダ部生成回路10、アドレス生成回路11、シーケ
ンサ12、及び上記構成部分8ないし11の出力側に接続さ
れているそれぞれのバッファのイネイブル端子に接続さ
れる。このような制御回路7は、ホストシステムより同
期信号が供給されることで動作を開始するシーケンサ12
より供給される制御信号にて動作を開始し、システムコ
ントローラ6より制御信号が供給されることで上記構成
部分8ないし11の動作を制御し、これらの構成部分にて
生成されたデータの送出を制御するとともにアビトレー
ション回路4の動作を制御する。又、上記構成部分8な
いし10の出力側は、それぞれ上記バッファを介してデー
タバス3に接続され、アドレス生成回路11の出力側は上
記バッファを介してアドレスバス2に接続される。
The output side of the control circuit 7 includes an arbitration circuit 4, a sync pattern generation circuit 8, a header data generation circuit 9,
The sub-header generation circuit 10, the address generation circuit 11, the sequencer 12, and the enable terminals of the buffers connected to the outputs of the components 8 to 11 are connected. Such a control circuit 7 is a sequencer 12 that starts operating when a synchronization signal is supplied from the host system.
The operation is started by a control signal supplied from the controller, and the control signal is supplied from the system controller 6 to control the operation of the components 8 to 11 and to transmit the data generated by these components. Controls the operation of the arbitration circuit 4. The output side of each of the components 8 to 10 is connected to the data bus 3 via the buffer, and the output side of the address generation circuit 11 is connected to the address bus 2 via the buffer.

シンクパターン発生回路8は、CD−ROM及びCD−Iの
規格にて定められているシンクパターンを発生する回路
である。
The sync pattern generation circuit 8 is a circuit that generates a sync pattern defined by the standards of CD-ROM and CD-I.

ヘッダ部データ生成回路9はシステムコントローラ6
より供給されるAタイムの初期値のデータがセットさ
れ、制御回路7からの指示にてこれをインクリメント
し、順次送出するする回路である。尚、ヘッダ部のモー
ドバイトについてはシステムコントローラ6より値がセ
ットされるが、一度にCDに記録されるすべてのブロック
の内、最初の3ブロックと最後の3ブロックについて
は、制御回路7により特別なコードを生成するように制
御される。
The header section data generation circuit 9 includes a system controller 6
This is a circuit in which data of the initial value of the A-time supplied is set, incremented by an instruction from the control circuit 7, and sequentially transmitted. The value of the mode byte in the header is set by the system controller 6, but among all the blocks recorded on the CD at once, the first three blocks and the last three blocks are specially controlled by the control circuit 7. Is controlled to generate a simple code.

サブヘッダ部データレジスタ10は、システムコントロ
ーラ6よりサブヘッダの値が供給されこれを格納する回
路である。
The sub-header data register 10 is a circuit that receives the value of the sub-header from the system controller 6 and stores the value.

アドレス生成回路11は、第3図に示すようなフォーマ
ットに対応するように上記シンクパターンや上記ヘッダ
等のデータをバッファRAM5に書き込むためのアドレスを
発生する回路である。
The address generation circuit 11 is a circuit for generating an address for writing data such as the sync pattern and the header into the buffer RAM 5 so as to correspond to the format shown in FIG.

アビトレーション回路4は、上記シンクパターンやヘ
ッダ等のデータのバッファRAM5への書き込みが衝突した
場合に、それを調整するための信号を発生する回路であ
る。
The arbitration circuit 4 is a circuit for generating a signal for adjusting the write of the data such as the sync pattern and the header into the buffer RAM 5 when the write collision occurs.

シーケンサ12の出力側は、制御回路7及びEDC,ECCの
各データを付加するEDC,ECC付加回路13に接続され、シ
ーケンサ12は、構成部分8ないし10の生成データがバッ
ファRAM5へ記憶された旨の信号が制御回路7より供給さ
れることで、EDC,ECC付加回路13の動作を開始させる。
The output side of the sequencer 12 is connected to the control circuit 7 and an EDC / ECC adding circuit 13 for adding EDC / ECC data, and the sequencer 12 informs that the data generated by the constituent parts 8 to 10 has been stored in the buffer RAM 5. Is supplied from the control circuit 7, the operation of the EDC / ECC addition circuit 13 is started.

EDC,ECC付加回路13は、CD−ROM及びCD−Iの規格に則
り、EDC,ECCのデータを計算する回路であり、その出力
側は、アドレスバス2、データバス3、及びアビトレー
ション回路4に接続される。よって、EDC,ECC付加回路1
3は、上述したシンクパターン、ヘッダ等の各データが
バッファRAM5に記憶された後、シーケンサ12の制御によ
りEDC,ECCのデータをデータバス3を介してバッファRAM
5に記憶する。
The EDC and ECC adding circuit 13 is a circuit for calculating EDC and ECC data in accordance with the standards of CD-ROM and CD-I, and its output side is an address bus 2, a data bus 3, and an arbitration circuit 4. Connected to. Therefore, EDC, ECC additional circuit 1
3, after each data such as the above-mentioned sync pattern and header is stored in the buffer RAM 5, EDC and ECC data are transferred to the buffer RAM 5 through the data bus 3 under the control of the sequencer 12.
Remember in 5.

シリアルインタフェース14は、アドレスバス2、デー
タバス3、アビトレーション回路4に接続され、一ブロ
ックを構成するシンクパターン、ヘッダ、ユーザデー
タ、EDC,ECC等のデータのバッファRAM5への付加が終了
したページのデータをデータバス3を介して読み出し、
CDへデータを書き込むためデータ処理を行う次段の信号
処理回路へ上記読み出したデータをシリアルに送出す
る。
The serial interface 14 is connected to the address bus 2, the data bus 3, and the arbitration circuit 4, and is a page for which data such as a sync pattern, a header, user data, EDC, and ECC constituting one block has been added to the buffer RAM 5. Is read via the data bus 3, and
The read data is transmitted serially to a signal processing circuit at the next stage which performs data processing for writing data to the CD.

このように構成されるCD−WO装置の動作を第1図及び
第2図を参照し以下に説明する。尚、第2図内にS1,S2
…とあるのは、ステップ1、ステップ2…を表してい
る。又、第2図に示すフローチャートではバッファRAM5
にm個のブロックが記憶されるものとする。
The operation of the CD-WO device configured as described above will be described below with reference to FIGS. In FIG. 2, S1, S2
.. Represent steps 1, 2 and so on. In the flowchart shown in FIG.
M blocks are stored.

ステップ1にて、ホストシステムよりシステムコント
ローラ6にコマンドが供給されることで、システムコン
トローラ6はヘッダ部データ生成回路9にホストシステ
ムより供給されたヘッダデータの初期値を書き込み、サ
ブヘッダ部データレジスタ10にサブヘッダデータを書き
込む。又、システムコントローラ6は、制御回路7、ア
ドレス生成回路11、及びシーケンサ12にブロック構成の
フォーマットの指示を行う。さらに、ホストシステムよ
りユーザデータが送出され、ホストインタフェース1、
データバス3を介してバッファRAM5に記憶される。
In step 1, when the command is supplied from the host system to the system controller 6, the system controller 6 writes the initial value of the header data supplied from the host system into the header data generation circuit 9, and the sub header data register 10 Write subheader data to Further, the system controller 6 instructs the control circuit 7, the address generation circuit 11, and the sequencer 12 about the format of the block configuration. Further, user data is transmitted from the host system, and the host interface 1,
The data is stored in the buffer RAM 5 via the data bus 3.

ステップ2にて、今より記憶するブロックが記憶可能
か否かが判断され、記憶不可能な場合には処理を終了
し、記憶可能な場合にはステップ3へ移行する。
In step 2, it is determined whether or not the block to be stored can be stored. If the block cannot be stored, the process ends. If the block can be stored, the process proceeds to step 3.

ステップ3にて、システムコントローラ6よりシーケ
ンサ12に信号が送出されることでシーケンサ12は制御回
路7に動作開始信号を送出する。よって制御回路7は、
シンクパターン発生回路8及びアドレス生成回路11を動
作させる。よって、シンクパターン発生回路8にて発生
し送出されたシンクパターンデータは、データバス3を
介しアドレス生成回路11が送出するアドレスに従い、バ
ッファRAM5内のリラティブアドレス0から11に書き込ま
れる。
In step 3, a signal is sent from the system controller 6 to the sequencer 12, so that the sequencer 12 sends an operation start signal to the control circuit 7. Therefore, the control circuit 7
The sync pattern generation circuit 8 and the address generation circuit 11 are operated. Therefore, the sync pattern data generated and transmitted by the sync pattern generation circuit 8 is written to the relative addresses 0 to 11 in the buffer RAM 5 in accordance with the address transmitted by the address generation circuit 11 via the data bus 3.

次のステップ4は、一度にCDに記録される総ブロック
数の内、記録を最初に開始した1番目のブロックより3
番目のブロックと、最終ブロックから3番目のブロック
より最終ブロックとのブロックを作成する場合に関係す
るステップであり、通常のユーザデータを記録する場合
にはステップ4の処理はなされず上記ステップ3よりス
テップ5へ移行する。
The next step 4 is to start with 3 blocks from the first block of the total number of blocks recorded on the CD at one time.
This is a step related to the case of creating a block consisting of the first block and the last block from the third block from the last block. When ordinary user data is recorded, the processing of step 4 is not performed and Move to step 5.

これらの総ブロック数の最初と最後の3ブロックは、
CDへのデータの書き込みが不安定となる可能性があるこ
とにより特殊なデータを記録する。即ち、ステップ4−
1では最初のブロックと、最終ブロックとが処理の対象
であり、これらのブロックにはヘッダデータが付加され
リンクブロックとなる。ステップ4−2では、最初から
2番目のブロックが処理対象であり、このブロックには
ヘッダデータが付加されファースト ラン イン デー
タが付加される。ステップ4−3では最初から3番目の
ブロックが処理対象であり、このブロックではヘッダデ
ータが付加されたセカンド ラン イン データが付加
される。ステップ4−4では、最終から3番目のブロッ
クが処理対象であり、このブロックではヘッダデータが
付加されファースト ラン アウト データが付加され
る。ステップ4−5では最終から2番目のブロックが処
理対象であり、このブロックではヘッダデータが付加さ
れセカンド ラン アウト データが付加される。
The first and last three blocks of these total blocks are
Special data is recorded because the writing of data to a CD may become unstable. That is, step 4-
In 1, the first block and the last block are to be processed, and these blocks are added with header data and become link blocks. In step 4-2, the second block from the beginning is to be processed, and header data is added to this block, and first run-in data is added. In step 4-3, the third block from the beginning is to be processed. In this block, second run-in data to which header data has been added is added. In step 4-4, the third block from the last is to be processed. In this block, header data is added and first run-out data is added. In step 4-5, the second to last block is to be processed. In this block, header data is added and second run-out data is added.

尚、ヘッダ部データ生成回路9に外部からの制御信号
が供給されることで、システムコントローラ6にて書き
込まれたAタイムをそのまま出力するか、もしくはイン
クリメントした後出力するかを選択できる機能を設けた
り、又、外部からの信号によりリンクブロック、ファー
スト ラン イン ブロック、セカンド ラン イン
ブロック、ユーザデータ、ファースト ラン アウト
ブロック、セカンド ラン アウト ブロック、に応じ
たモードバイトが生成できる機能を設けることにより、
第2図に示すフローが自動的に実行されるシステムを実
現することができる。
When a control signal is supplied from the outside to the header part data generation circuit 9, a function is provided for selecting whether to output the A time written by the system controller 6 as it is or to output it after incrementing it. Link block, first run-in block, second run-in block
Block, user data, first run out
By providing a function that can generate a mode byte according to the block and the second run-out block,
A system in which the flow shown in FIG. 2 is automatically executed can be realized.

ステップ5及び6においては、上述したステップ3と
同様に、システムコントローラ6は、ヘッダ部データ生
成回路9及びサブヘッダ部データレジスタ10を動作さ
せ、これらの回路素子より送出されるヘッダデータ及び
サブヘッダデータはそれぞれバッファRAM5内の所定のア
ドレスに書き込まれる。尚、CD−ROMにおけるモード1
のように一ブロック内の所定番地に0を書き込むように
規定されているものについては所定番地に所定のデータ
が書き込まれる。
In steps 5 and 6, as in step 3 described above, the system controller 6 operates the header data generation circuit 9 and the subheader data register 10, and outputs the header data and subheader data transmitted from these circuit elements. Are respectively written to predetermined addresses in the buffer RAM 5. Mode 1 on CD-ROM
In such a case that 0 is written at a predetermined address in one block, predetermined data is written at a predetermined address.

シンクパターン、ヘッダ、サブヘッダのデータがバッ
ファRAM5内に記憶されたときには、制御回路7はシーケ
ンサ12へ信号を送出し、シーケンサ12はこの信号を受信
することでEDC,ECC付加回路13を駆動させる。よって、
ステップ7及び8にてEDC,ECCのデータがEDC,ECC付加回
路13よりデータバス3を介してバッファRAM5に記憶され
る。
When the data of the sync pattern, header, and subheader is stored in the buffer RAM 5, the control circuit 7 sends a signal to the sequencer 12, and the sequencer 12 drives the EDC / ECC addition circuit 13 by receiving the signal. Therefore,
In steps 7 and 8, EDC and ECC data are stored in the buffer RAM 5 from the EDC and ECC adding circuit 13 via the data bus 3.

以上の動作にて一つのブロックが完成し、このブロッ
クを構成するデータは、ステップ9にてデータバス3、
シリアルインタフェース14を介して、CDへデータを記録
するためシリアルインタフェース14より送出されるデー
タを信号処理する信号処理回路へ送出される。
By the above operation, one block is completed, and the data constituting this block is stored in the data bus 3,
Via the serial interface 14, the data sent from the serial interface 14 for recording data on a CD is sent to a signal processing circuit for signal processing.

ステップ10において、CDへ記録されたブロック数のカ
ウントが行なわれ、そして再びステップ2へ戻り上述と
同様の処理が行なわれる。
In step 10, the number of blocks recorded on the CD is counted, and the process returns to step 2 again to perform the same processing as described above.

尚、第2図及び上述の説明は、理解が容易なようにホ
ストシステムからのデータ転送及びシリアルインタフェ
ース14からのデータ送出についてシーケンシャルなフロ
ーとしたが、これらの処理は実際にはパイプライン化さ
れパラレルに実行される。
In FIG. 2 and the above description, the data transfer from the host system and the data transmission from the serial interface 14 have been described as a sequential flow for easy understanding. However, these processes are actually pipelined. Executed in parallel.

このように、ドライブシステム部にてシンクパター
ン、ヘッダ、サブヘッダ、EDC,ECCの各データを作成し
所定のフォーマットにてブロックを構成することによ
り、ホストシステムにおけるCPU、メモリの負担を小さ
くすることができる。又、ホストシステムよりドライブ
システム部へ供給されるデータ量を少なくすることがで
きる。
As described above, by creating each data of the sync pattern, the header, the subheader, the EDC, and the ECC in the drive system unit and configuring the blocks in a predetermined format, the load on the CPU and the memory in the host system can be reduced. it can. Further, the amount of data supplied from the host system to the drive system unit can be reduced.

又、フォーマットに対応したバッファRAM5のアドレス
にシンクパターン、ヘッダ、サブヘッダのデータを予め
付加するので、EDC,ECCのデコードロジックの一部とわ
ずかな回路を追加することでEDC,ECCデータのエンコー
ド回路を実現することができる。
In addition, since the data of the sync pattern, header, and subheader are added in advance to the address of the buffer RAM5 corresponding to the format, the EDC and ECC data encoding circuit can be added by adding a part of the EDC and ECC decoding logic and a small circuit. Can be realized.

又、Aタイムのインクリメントや、リンク、ラン イ
ン,ラン アウトの各ブロックに応じたヘッダを自動的
に生成付加するので、システムコントローラのソフトウ
エアの負担を軽減することができる。
Further, since the header corresponding to the increment of the A-time and the link, run-in, and run-out blocks is automatically generated and added, the load on the software of the system controller can be reduced.

[発明の効果] 以上詳述したように本発明によれば、CD−WO装置を構
成するドライブシステム部にてCDに記録するユーザデー
タ以外の所定データを作成することより、ホストシステ
ム部におけるCPU、メモリの負担を減少させることがで
きCD−WO装置を能率的に動作せることができる。
[Effects of the Invention] As described above in detail, according to the present invention, a drive system unit constituting a CD-WO device creates predetermined data other than user data to be recorded on a CD. Thus, the load on the memory can be reduced, and the CD-WO device can be operated efficiently.

【図面の簡単な説明】[Brief description of the drawings]

第1図は本発明のCD−WO装置の一実施例における構成を
示すブロック図、第2図は第1図に示す装置の動作を示
すフローチャート、第3図は第1図に示す装置にて使用
されるブロックの構成を示す図である。 1……ホストインタフェース、 4……アビトレーション回路、 5……バッファRAM、 6……システムコントローラ、7……制御回路、 8……シンクパターン発生回路、 9……ヘッダ部データ生成回路、 10……サブヘッダ部データレジスタ、 11……アドレス生成回路、12……シーケンサ、 13……EDC,ECC付加回路、 14……シリアルインタフェース。
FIG. 1 is a block diagram showing the configuration of an embodiment of the CD-WO device of the present invention, FIG. 2 is a flowchart showing the operation of the device shown in FIG. 1, and FIG. 3 is the device shown in FIG. FIG. 3 is a diagram showing a configuration of a block used. 1 Host interface 4 Arbitration circuit 5 Buffer RAM 6 System controller 7 Control circuit 8 Sync pattern generation circuit 9 Header data generation circuit 10 … Subheader data register, 11… Address generation circuit, 12 …… Sequencer, 13 …… EDC / ECC addition circuit, 14 …… Serial interface.

Claims (1)

(57)【特許請求の範囲】(57) [Claims] 【請求項1】光ディスクに書き込む書き込みデータを保
存するホストシステム部と、上記ホストシステム部から
上記書き込みデータが供給され光ディスクに上記書き込
みデータの書きこみ動作を行うドライブシステム部とを
有し、CD−ROM及びCD−Iの規定に準じたフォーマット
にて情報を光ディスクに書き込むCD−WO装置において、 上記ホストシステム部は、上記書き込みデータ内のユー
ザデータを上記ドライブシステム部へ送出し、 上記ドライブシステム部は、上記ホストシステム部より
データが供給されることで各構成部分の動作制御を行う
制御部と、上記フォーマットに応じて上記書き込みデー
タに含まれるユーザデータ以外のデータを上記制御部の
制御により作成するデータ作成部と、上記ホストシステ
ム部より供給される上記ユーザデータ及び上記作成部に
て作成される上記ユーザデータ以外のデータを上記フォ
ーマットに応じて記憶する書き込み読み出し可能なメモ
リと、上記メモリに書きこまれたデータを上記光ディス
クへ書き込むためにデータ処理を行う信号処理回路へ送
出するデータ送出部と、を備えたことを特徴とするCD−
WO装置。
A host system for storing write data to be written to an optical disk; and a drive system for supplying the write data from the host system and writing the write data to the optical disk. In a CD-WO device for writing information on an optical disc in a format conforming to the ROM and CD-I specifications, the host system unit sends user data in the write data to the drive system unit, and the drive system unit Creates a control unit that controls the operation of each component by supplying data from the host system unit, and creates data other than user data included in the write data according to the format under the control of the control unit And a user supplied from the host system unit. A writable and readable memory that stores data and data other than the user data created by the creation unit according to the format, and performs data processing to write the data written in the memory to the optical disc. A data transmission unit for transmitting the data to a signal processing circuit.
WO device.
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