JP2834168B2 - Distributed amplifier - Google Patents

Distributed amplifier

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JP2834168B2
JP2834168B2 JP1007713A JP771389A JP2834168B2 JP 2834168 B2 JP2834168 B2 JP 2834168B2 JP 1007713 A JP1007713 A JP 1007713A JP 771389 A JP771389 A JP 771389A JP 2834168 B2 JP2834168 B2 JP 2834168B2
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【発明の詳細な説明】 〔産業上の利用分野〕 この発明は、広帯域で高出力を得るように動作する分
布型増幅器に関するものである。
Description: BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a distributed amplifier that operates to obtain high output in a wide band.

〔従来の技術〕 第4図は例えば“ア モノリシック ガリウム ヒ素
1−13ギガヘルツ トラベリング ウエーブ アンプリ
ファイア",アイイーイーイートランスアクションズ,MTT
−第30巻,第7号,7月1982年,976−981ページ(“A Mon
olithic GaAs 1−13GHz Traveling−Wave Amplifier",I
EEE Trans.,Vol.MTT−30,No.7,July 1982,pp.976−98
1)に示された従来の分布型増幅器を示す回路図であ
り、図において、1は入力端子、2は出力端子、3は電
界効果トランジスタ(以下、FETという)、4はFET3の
入力端子、5はFET3の出力端子、6はFET3の接地端子、
7は入力側終端用抵抗回路、8は出力側終端用抵抗回
路、9,11は分布定数線路、10は位相調整用線路である。
[Prior Art] FIG. 4 shows, for example, "A Monolithic Gallium Arsenic 1-13 GHz Traveling Wave Amplifier", IEETransactions, MTT
—Vol. 30, No. 7, July 1982, pp. 976-981 (“A Mon
olithic GaAs 1-13GHz Traveling-Wave Amplifier ", I
EEE Trans., Vol. MTT-30, No. 7, July 1982, pp. 976-98
1 is a circuit diagram showing the conventional distributed amplifier shown in 1), in which 1 is an input terminal, 2 is an output terminal, 3 is a field effect transistor (hereinafter referred to as FET), 4 is an input terminal of FET3, 5 is the output terminal of FET3, 6 is the ground terminal of FET3,
7 is an input-side termination resistor circuit, 8 is an output-side termination resistor circuit, 9 and 11 are distributed constant lines, and 10 is a phase adjustment line.

また、このような分布型増幅器では、分布定数線路9
と隣接して配置されたFET3のゲート・ソース間のキャパ
シタンスCgsとで特性インピーダンスZgをもつ疑似的分
布定数線路が形成され、入力側終端用抵抗回路7とで入
力側結合回路Pが構成される。また、上記各FETセルの
ドレイン・ソース間キャパシタンスCdsと位相調整用線
路10および分布定数線路11とで疑似的分布定数線路が形
成され、出力側終端用抵抗回路8とで出力側結合回路Q
が構成される。
In such a distributed amplifier, the distributed constant line 9
And a capacitance Cgs between the gate and the source of the FET 3 disposed adjacently, a pseudo distributed constant line having a characteristic impedance Zg is formed, and the input-side terminating resistor circuit 7 forms an input-side coupling circuit P. . Further, a pseudo distributed constant line is formed by the drain-source capacitance Cds of each of the FET cells, the phase adjusting line 10 and the distributed constant line 11, and the output side termination circuit 8 and the output side coupling circuit Q
Is configured.

次に動作について説明する。入力端子1から入力され
たマイクロ波電力は、各分布定数線路9を入力側終端用
抵抗回路7の方向に伝搬していく。このように伝搬して
いくマイクロ波電力の大部分は各FET3に順次分配され、
増幅される。一方、上記各FET3に分配されなかった不要
マイクロ波電力は、入力側終端用抵抗回路7にて吸収さ
れる。このため、上記構成の入力側結合回路Pは、一般
的に、特に整合回路を用いることなく、広帯域にわたり
良好な入力反射特性が得られる。
Next, the operation will be described. The microwave power input from the input terminal 1 propagates through each distributed constant line 9 in the direction of the input-side termination resistor circuit 7. Most of the microwave power propagating in this way is sequentially distributed to each FET 3,
Amplified. On the other hand, unnecessary microwave power not distributed to each of the FETs 3 is absorbed by the input-side terminating resistance circuit 7. For this reason, the input-side coupling circuit P having the above configuration can generally obtain good input reflection characteristics over a wide band without using a matching circuit.

一方、各FET3に入力されたマイクロ波電力は、各FET3
のゲート幅に応じて増幅され、位相調整用線路10および
分布定数線路11を経て出力端子2の方向に伝搬してい
く。また、入力端子1から出力端子2までのそれぞれの
伝搬経路における電気長が等しくなるように選ばれるた
め、各FET3で増幅されたマイクロ波電力は上記出力側結
合回路で順次合成されて、出力端子2に出力される。そ
して上記出力側結合回路の構成により、入力側と同様に
広帯域にわたり良好な出力反射特性が得られる。
On the other hand, the microwave power input to each FET3
And propagates in the direction of the output terminal 2 via the phase adjusting line 10 and the distributed constant line 11. In addition, since the electric lengths in the respective propagation paths from the input terminal 1 to the output terminal 2 are selected to be equal, the microwave power amplified by each FET 3 is sequentially combined by the output side coupling circuit, and 2 is output. With the configuration of the output side coupling circuit, good output reflection characteristics can be obtained over a wide band as in the case of the input side.

ところで、上記のような分布型増幅器の高出力化を図
る一般的な方法としては、周期的に配置するFET3の個数
を増大させたり、各FET3のゲート幅を増大させるものが
ある。上記文献によれば、分布型増幅器の利得Gは近似
的に と表わせる。ここで、αgはゲート側回路の単位長当り
の減衰定数、lgはFET3の単位セル当りのゲート側線路
長、Zgはゲート側線路の特性インピーダンス、gmはFET3
の相互コンダクタンス、nはFET3の個数である。上記の
式より、利得はnに関して単調増加せず、 になると利得は増加しなくなる。従って、FET3の数をこ
れ以上増大させても利得は増加せず、結果として、増幅
器の出力も増大しなくなる。また、各FET3のゲート幅を
増大させると、ゲート・ソース間キャパシタCgsが増加
し、増幅器のしゃ断周波数が低下し、広帯域に出力を得
る事ができなくなる。
By the way, as a general method for increasing the output of the distributed amplifier as described above, there are methods of increasing the number of FETs 3 arranged periodically or increasing the gate width of each FET 3. According to the above document, the gain G of the distributed amplifier is approximately Can be expressed as Here, αg is the attenuation constant per unit length of the gate side circuit, lg is the gate side line length per unit cell of FET3, Zg is the characteristic impedance of the gate side line, and gm is FET3
And n is the number of FET3. From the above equation, the gain does not increase monotonically with n, , The gain no longer increases. Therefore, even if the number of FETs 3 is further increased, the gain does not increase, and as a result, the output of the amplifier does not increase. When the gate width of each FET 3 is increased, the gate-source capacitor Cgs increases, the cutoff frequency of the amplifier decreases, and it is impossible to obtain an output over a wide band.

〔発明が解決しようとする課題〕[Problems to be solved by the invention]

従来の分布型増幅器は以上のように構成されているの
で、高出力化しようとすると、各FET3のゲート幅を増大
させたり、FET3の個数を増大させなければならず、それ
にともなって増幅器のしゃ断周波数が低下し、広帯域に
わたって出力が得られなくなるほか、利得の減少が生
じ、出力が増大しなくなるなどの問題点があった。
Since the conventional distributed amplifier is configured as described above, in order to increase the output, it is necessary to increase the gate width of each FET3 or increase the number of FET3, and accordingly, the amplifier is shut down. There have been problems in that the frequency is reduced, an output cannot be obtained over a wide band, the gain is reduced, and the output is not increased.

この発明は上記のような問題点を解消するためになさ
れたもので、広帯域にわたり高出力を得ることができる
分布型増幅器を得ることを目的とする。
SUMMARY OF THE INVENTION The present invention has been made to solve the above problems, and has as its object to obtain a distributed amplifier capable of obtaining high output over a wide band.

〔課題を解決するための手段〕[Means for solving the problem]

この発明に係る分布型増幅器は多段の電界効果トラン
ジスタ、段間整合回路及び位相調整用線路を有する複数
個の多段増幅器の入力端子と入力側終端用抵抗回路と
を、順次分布定数線路を介して接続し、上記各多段増幅
器の出力端子と出力側終端用抵抗回路とを他の分布定数
線路を介して順次接続したものである。
The distributed amplifier according to the present invention sequentially connects input terminals of a plurality of multi-stage amplifiers having a multi-stage field-effect transistor, an inter-stage matching circuit, and a phase adjustment line and an input-side terminating resistor circuit via distributed constant lines. The output terminals of the multi-stage amplifiers and the output-side terminating resistance circuit are sequentially connected via another distributed constant line.

〔作 用〕(Operation)

この発明における分布型増幅器は、複数個の多段増幅
器の入力端子及び入力側終端用抵抗を順次接続する分布
定数線路のインダクタンス成分と、各多段増幅器の初段
FETのゲート・ソース間キャパシタンス成分とからなる
分布型構成の入力側結合回路にて広帯域にわたる整合を
おこなうとともに、各多段増幅器の最終段FETのゲート
幅を増大させることにより、従来のように隣接して配置
するFETの個数を増大させたり、上記FETのゲート幅を増
大させて、しゃ断周波数を低下させることなく、高出力
のマイクロ波電力を得られるようにする。
A distributed amplifier according to the present invention includes an inductance component of a distributed constant line that sequentially connects input terminals of a plurality of multistage amplifiers and input-side termination resistors, and a first stage of each multistage amplifier.
The input-side coupling circuit of the distributed configuration consisting of the gate-source capacitance component of the FET performs matching over a wide band, and the gate width of the final-stage FET of each multistage amplifier is increased, so that the adjacent By increasing the number of FETs arranged or increasing the gate width of the FETs, high-output microwave power can be obtained without lowering the cutoff frequency.

〔発明の実施例〕(Example of the invention)

以下、この発明の一実施例を図について説明する。第
1図において、12は複数段あるうちの初段FET、13は段
間整合回路、14は最終段FET、17は初段FET12、段間整合
回路13、最終段FET14および位相調整用線路10から成る
2段増幅器、15は上記2段増幅器17の入力端子、16は出
力端子である。そして、これらの2段増幅器の複数個
が、既述の分布定数線路9,11を介して入力側終端用抵抗
回路7および出力側終端用抵抗回路8に接続されてい
る。そして、この分布型増幅器では、上記各2段増幅器
17の初段FET12のゲート・ソース間キャパシタンスCgsと
上記分布定数線路9とで、特性インピーダンスZgをもつ
疑似的分布定数線路が形成され、入力側終端用抵抗回路
7とで、入力側結合回路が構成される。
An embodiment of the present invention will be described below with reference to the drawings. In FIG. 1, 12 is a first stage FET of a plurality of stages, 13 is an interstage matching circuit, 14 is a last stage FET, 17 is a first stage FET 12, an interstage matching circuit 13, a last stage FET 14, and a phase adjusting line 10. A two-stage amplifier 15 is an input terminal of the two-stage amplifier 17, and 16 is an output terminal. A plurality of these two-stage amplifiers are connected to the input-side termination resistance circuit 7 and the output-side termination resistance circuit 8 via the distributed constant lines 9 and 11 described above. In this distributed amplifier, the above two-stage amplifiers
A pseudo distributed constant line having a characteristic impedance Zg is formed by the gate-source capacitance Cgs of the 17 first-stage FET 12 and the distributed constant line 9, and an input-side coupling circuit is formed by the input-side terminating resistor circuit 7. Is done.

また、同様に、上記各2段増幅器17の最終段FET14の
ドレイン・ソース間キャパシタンスCdsと位相調整用線
路10及び分布定数線路11とで、疑似的分布定数線路が形
成され、出力側終端用抵抗回路8とで、出力側結合回路
が構成される。このような構成の結合回路は一般的に広
帯域な整合が可能である。
Similarly, a pseudo-distributed constant line is formed by the drain-source capacitance Cds of the final-stage FET 14 of each of the two-stage amplifiers 17, the phase adjusting line 10, and the distributed constant line 11, and the output-side termination resistor is formed. The circuit 8 forms an output-side coupling circuit. The coupling circuit having such a configuration can generally perform broadband matching.

次に動作について説明する。入力端子1から入力され
たマイクロ波電力は、各分布定数線路9を入力側終端用
抵抗回路7の方向に伝搬し、各2段増幅器17に順次分配
される。ここで各分布定数線路9の特性インピーダン
ス,線路長,入力側終端用抵抗回路7の抵抗値を各初段
FET12に応じた適当な値を選ぶことにより、広帯域の整
合をおこなう事ができるとともに、広帯域にわたり各2
段増幅器17に分配される電力をできるだけ均等にするこ
とができる。一方、各2段増幅器17の初段FET12で増幅
されたマイクロ波電力は、各2段増幅器17に入れた段間
整合回路13を介して、最終段FET14に入力される。この
ため、さらに最終段FET14のゲート幅に応じて、増幅さ
れる。この結果、最終段FET14のゲート幅を増大させる
事によって、従来のように隣接して配置するFETの個数
を増大させることなく、高出力のマイクロ波電力を得る
事ができ、また、最終段FET14のゲート幅をいくら増大
させても、初段FET12のCgsにはほとんど影響を与えず、
しゃ断周波数を低下させることもないため、広帯域に高
出力が得られる。このように、最終段FET14から出力さ
れたマイクロ波電力は、それぞれ位相調整用線路10,分
布定数線路11を出力端子2の方向に伝搬し、順次合成さ
れていき出力端子2から出力される。すなわち、この発
明によれば、出力側の各位相調整用線路10の特性インピ
ーダンス及び線路長、各分布定数線路11の特性インピー
ダンス及び線路長、出力側終端用抵抗回路8の抵抗値
を、各2段増幅器17の最終段FET14に応じた適当な値に
選ぶことにより、広帯域にわたって各2段増幅器17の出
力電力を合成することができ、出力端子2より高出力の
マイクロ波電力を得ることができる。
Next, the operation will be described. The microwave power input from the input terminal 1 propagates through each distributed constant line 9 in the direction of the input-side termination resistor circuit 7 and is sequentially distributed to each two-stage amplifier 17. Here, the characteristic impedance of each distributed constant line 9, the line length, and the resistance value of the input-side termination resistor circuit 7 are set in each initial stage.
By selecting an appropriate value according to the FET 12, broadband matching can be performed, and each of the two
The power distributed to the stage amplifier 17 can be made as equal as possible. On the other hand, the microwave power amplified by the first-stage FET 12 of each two-stage amplifier 17 is input to the last-stage FET 14 via the interstage matching circuit 13 provided in each of the two-stage amplifiers 17. Therefore, the signal is further amplified according to the gate width of the final-stage FET 14. As a result, by increasing the gate width of the final-stage FET 14, high-output microwave power can be obtained without increasing the number of FETs arranged adjacently as in the conventional case. No matter how much the gate width is increased, Cgs of the first stage FET 12 is hardly affected.
Since the cutoff frequency is not reduced, high output can be obtained in a wide band. As described above, the microwave power output from the final-stage FET 14 propagates through the phase adjustment line 10 and the distributed constant line 11 in the direction of the output terminal 2, is sequentially combined, and is output from the output terminal 2. That is, according to the present invention, the characteristic impedance and the line length of each output-side phase adjusting line 10, the characteristic impedance and the line length of each distributed constant line 11, and the resistance value of the output-side terminating resistor circuit 8 are set to 2 respectively. By selecting an appropriate value according to the final-stage FET 14 of the stage amplifier 17, the output power of each of the two-stage amplifiers 17 can be combined over a wide band, and microwave power of higher output can be obtained from the output terminal 2. .

第2図はこの発明の他の実施例を示す回路図である。
この実施例では、最終段FET14を2個並列に動作させた
多段増幅器17Aを隣接して配置している。18は最終段FET
14の出力を合成するための出力側合成回路である。この
実施例によれば、最終段FET14を並列に動作させ、出力
側合成回路18で合成する事によって、簡単な入力及び出
力の結合回路で高出力のマイクロ波電力を得ることがで
きる。
FIG. 2 is a circuit diagram showing another embodiment of the present invention.
In this embodiment, a multi-stage amplifier 17A in which two final-stage FETs 14 are operated in parallel is arranged adjacently. 18 is the final stage FET
This is an output-side combining circuit for combining 14 outputs. According to this embodiment, by operating the final-stage FETs 14 in parallel and synthesizing them by the output-side synthesizing circuit 18, high-output microwave power can be obtained with a simple input and output coupling circuit.

第3図はこの発明のさらに他の実施例を示す回路図で
ある。この実施例では、隣接して配置した多段増幅器17
Bの最終段FET14を並列に動作させ、その出力を合成せず
に、それぞれ位相調整用線路10に直接接続している。各
最終段FET14の出力はそれぞれ位相調整用線路10,分布定
数線路11を伝搬し順次合成されるため、出力側合成回路
18を用いずに、高出力のマイクロ波電力を得ることがで
きる。
FIG. 3 is a circuit diagram showing still another embodiment of the present invention. In this embodiment, the multi-stage amplifiers 17 arranged adjacent to each other are used.
The B final stage FETs 14 are operated in parallel, and their outputs are directly connected to the phase adjustment lines 10 without combining the outputs. Since the output of each final stage FET 14 propagates through the phase adjustment line 10 and the distributed constant line 11 and is sequentially synthesized, the output side synthesis circuit
High power microwave power can be obtained without using 18.

〔発明の効果〕〔The invention's effect〕

以上のように、この発明によれば隣接して配置された
複数個の多段増幅器と入力側終端用抵抗回路とを分布定
数線路により順次接続して入力側結合回路を形成するよ
うに構成したので、広帯域にわたる電力分配および整合
がおこなえるとともに、従来のように隣接して配置する
FETの個数を増大させたり、上記FETのゲート幅を増大さ
せずに、最終段FETのゲート幅を増大させることによっ
て、しゃ断周波数を低下させることなく、高出力のマイ
クロ波電力を出力できるものが得られる効果がある。
As described above, according to the present invention, a plurality of adjacent multistage amplifiers and the input-side terminating resistor circuit are sequentially connected by the distributed constant line to form the input-side coupling circuit. , Provides power distribution and matching over a wide band, and is located adjacently as before
By increasing the gate width of the final stage FET without increasing the number of FETs or increasing the gate width of the above-mentioned FETs, it is possible to output high-power microwave power without lowering the cutoff frequency. There is an effect that can be obtained.

【図面の簡単な説明】[Brief description of the drawings]

第1図はこの発明の一実施例による分布型増幅器を示す
回路図、第2図および第3図はこの発明の他の実施例を
示す分布型増幅器の回路図、第4図は従来の分布型増幅
器を示す回路図である。 7は入力側終端用抵抗回路、8は出力側終端用抵抗回
路、9,11は分布定数線路、10は位相調整用線路、12はFE
T(初段FET)、13は段間整合回路、14はFET(最終段FE
T)、15は2段増幅器の入力端子、16は2段増幅器の出
力端子、17,17A,17Bは多段増幅器(2段増幅器)、Pは
入力側結合回路、Qは出力側結合回路である。 なお、図中、同一符号は同一、または相当部分を示す。
FIG. 1 is a circuit diagram showing a distributed amplifier according to one embodiment of the present invention, FIGS. 2 and 3 are circuit diagrams of a distributed amplifier according to another embodiment of the present invention, and FIG. 4 is a conventional distributed amplifier. FIG. 2 is a circuit diagram showing a type amplifier. 7 is an input-side termination resistor circuit, 8 is an output-side termination resistor circuit, 9 and 11 are distributed constant lines, 10 is a phase adjustment line, and 12 is FE
T (first stage FET), 13 is interstage matching circuit, 14 is FET (final stage FE
T) and 15 are input terminals of a two-stage amplifier, 16 is an output terminal of a two-stage amplifier, 17, 17A and 17B are multi-stage amplifiers (two-stage amplifiers), P is an input side coupling circuit, and Q is an output side coupling circuit. . In the drawings, the same reference numerals indicate the same or corresponding parts.

フロントページの続き (72)発明者 浦崎 修治 神奈川県鎌倉市大船5丁目1番1号 三 菱電機株式会社情報電子研究所内 (56)参考文献 特開 昭63−120506(JP,A) 特開 昭62−109411(JP,A) 特開 昭60−233912(JP,A) (58)調査した分野(Int.Cl.6,DB名) H03F 3/60 JOIS WPIContinuation of the front page (72) Inventor Shuji Urasaki 5-1-1, Ofuna, Kamakura City, Kanagawa Prefecture Inside the Information Electronics Research Laboratory, Mitsubishi Electric Corporation (56) References JP-A-63-120506 (JP, A) JP-A Sho 62-109411 (JP, A) JP-A-60-233912 (JP, A) (58) Fields investigated (Int. Cl. 6 , DB name) H03F 3/60 JOIS WPI

Claims (1)

(57)【特許請求の範囲】(57) [Claims] 【請求項1】隣接して配置される、多段の電界効果トラ
ンジスタ、これらの各段の電界効果トランジスタ間に入
れた段間整合回路及び位相調整用線路を有する複数個の
多段増幅器と、上記各多段増幅器のそれぞれの入力端子
及び入力側終端用抵抗回路を分布定数線路を介して順次
接続してなる入力側結合回路と、上記各多段増幅器のそ
れぞれの出力端子及び出力側終端用抵抗回路を他の分布
定数線路にて順次接続して成る出力側結合回路とを備え
た分布型増幅器。
A plurality of multi-stage amplifiers having adjacent multi-stage field-effect transistors, an inter-stage matching circuit interposed between these respective field-effect transistors, and a phase adjusting line; The input-side coupling circuit in which the input terminals and the input-side terminating resistor circuits of the multi-stage amplifier are sequentially connected via a distributed constant line, and the output terminal and the output-side terminating resistor circuit of each of the multi-stage amplifiers are other. And an output side coupling circuit sequentially connected by distributed constant lines.
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