JP2709475B2 - Image forming device - Google Patents
Image forming deviceInfo
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Description
【発明の詳細な説明】 （産業上の技術分野） 本発明は、Ｃ−MOS型ICのラッチアップ防止回路を有
する画像形成装置に関する。Description: TECHNICAL FIELD The present invention relates to an image forming apparatus having a C-MOS type IC latch-up prevention circuit.
（従来の技術） Ｃ−MOS型ICは、安価，高速，低消費電力などのメリ
ットを持つが、ラッチアップによる破損の危険性がある
ため、複数の電源回路にまたがるような回路構成で使用
すると、各々の電源回路のON/OFFシーケンスがラッチア
ップを起こさない条件で行なう必要があった。(Prior art) C-MOS type ICs have advantages such as low cost, high speed, and low power consumption. However, there is a risk of damage due to latch-up. Therefore, when used in a circuit configuration that spans multiple power supply circuits, Therefore, it is necessary to perform the ON / OFF sequence of each power supply circuit under conditions that do not cause latch-up.
ここで、ラッチアップ発生条件は、 Ｖ入力＞VCC Ｖ入力＜VEE の場合に起こる。その理由は、Ｃ−MOS型ICの構造上、V
CC−VEE間に寄生サイリスタが存在し、前記条件が成立
した場合、寄生サイリスタがトリガされ、VCC→VEEへ大
電流が流れることにより、素子の破損を引起こす。Here, the latch-up occurrence condition occurs when V input> V CC V input <V EE . The reason is that, due to the structure of the C-MOS type IC, V
Parasitic thyristor is present between the CC -V EE, if the condition is satisfied, the parasitic thyristor is triggered by a large current flows to the V CC → V EE, cause damage to the device.
例えばレーザープリンタにおけるレーザーダイオード
（LD）の出力パワー調整回路においては、上記のような
問題があるためＣ−MOS型のD/Aコンバータを使用するこ
とができなかった。For example, in an output power adjustment circuit of a laser diode (LD) in a laser printer, a C-MOS type D / A converter cannot be used due to the above-described problem.
第３図は前記出力パワー調整回路の一例のブロック図
を示す。LDは経時的に出力パワーが変動するので、通常
LDと対になった受光素子（何れも図面上では省略）によ
って得られる情報（LDドライブ回路４からのパワー適正
信号S4）をLDパワー調整回路２へフィードバックして出
力パワー調整を行なう必要がある。FIG. 3 shows a block diagram of an example of the output power adjusting circuit. Since the output power of an LD fluctuates over time,
It is necessary to adjust the output power by feeding back information (power appropriate signal S 4 from LD drive circuit 4) obtained by a light receiving element paired with the LD (both omitted in the drawing) to LD power adjustment circuit 2. is there.
この出力パワー調整はCPU1のパワー調整スタート信号
S1をONすることで開始される。ゲートアレー等で構成さ
れるLDパワー調整回路２は、パワーデータ信号S2を自動
的に変化させ、D/Aコンバータ３からパワー調整信号S3
をLDドライブ回路４へ入力し、前記パワー適正信号S4が
変化する点のパワーデータへ収束するように動作する。This output power adjustment is the power adjustment start signal of CPU1.
It is started by turning ON the S 1. The LD power adjustment circuit 2 composed of a gate array or the like automatically changes the power data signal S 2 and outputs the power adjustment signal S 3 from the D / A converter 3.
The input to the LD drive circuit 4 operates as the power proper signal S 4 is converged to the power data of the transit points.
上記D/Aコンバータ３は、８〜12bitのパワーデータ信
号S2をアナログ量に変換し、パワー調整信号S3としてLD
ドライブ回路４の出力パワーを制御する。また、LDドラ
イブ回路４はパワー調整信号S3に応じたLD出力パワーで
LDを駆動し、このLDと対となった受光素子の情報（受光
量）を一定の基準値と比較するコンパレータ（図では省
略）を介してLDパワー調整回路２へパワー適正信号S4を
フィードバックする。The D / A converter 3 converts the power data signal S 2 of 8~12bit the analog quantity, LD as a power adjustment signal S 3
The output power of the drive circuit 4 is controlled. Further, LD drive circuit 4 is in LD output power corresponding to the power adjustment signal S 3
Drives the LD, the feedback power proper signal S 4 to the LD power adjusting circuit 2 via the information of the light receiving element becomes the LD paired comparator for comparing (light receiving amount) and a constant reference value (omitted in the drawing) I do.
上述したD/Aコンバータ３の前段にあるLDパワー調整
回路２は電源Ａによって駆動されるデジタル回路であ
り、D/Aコンバータ３自体はアナログ回路と共通の電源
Ｂによって駆動されている。The LD power adjustment circuit 2 at the preceding stage of the D / A converter 3 is a digital circuit driven by a power supply A, and the D / A converter 3 itself is driven by a power supply B common to an analog circuit.
このため、例えば電源ＡがONし、電源ＢがOFFとなる
期間が存在すると、パワーデータ信号S2がTTLレベルでD
/Aコンバータ３に与えられるので、D/Aコンバータの電
源ＢがVCC＝0V,D/AコンバータのＶ入力≒5V（TTLレベ
ル）となり、ラッチアップが引起こされる可能性があ
る。従って、Ｃ−MOS型のD/Aコンバータを使用すること
ができなかった。Thus, for example, power supply A is turned ON, when the power supply B there is a period to be OFF, D power data signal S 2 is at the TTL level
Since the power is supplied to the / A converter 3, the power supply B of the D / A converter becomes V CC = 0 V, the V input of the D / A converter ≒ 5 V (TTL level), and latch-up may occur. Therefore, a C-MOS type D / A converter cannot be used.
（発明が解決しようとする課題） 上述したように、Ｃ−MOS型ICのメリットを十分に生
かしたレーザープリンタにおけるレーザーダイオードの
出力パワー調整回路、特にD/Aコンバータに使用できな
いという問題があった。(Problems to be Solved by the Invention) As described above, there is a problem that it cannot be used for an output power adjustment circuit of a laser diode in a laser printer that makes full use of the merits of a C-MOS type IC, particularly a D / A converter. .
本発明はこのような問題を解決し、Ｃ−MOS型ICによ
るD/Aコンバータを用いても、ラッチアップによる破損
を防止する回路を有する画像形成装置を提供することを
目的とするものである。An object of the present invention is to solve such a problem and to provide an image forming apparatus having a circuit for preventing damage due to latch-up even when a D / A converter using a C-MOS type IC is used. .
（構成および作用） 本発明は上記目的を達成するため、レーザーダイオー
ドの出力パワーを調整するためのパワーデータ信号を調
整するLDパワー調整回路と、このLDパワー調整回路によ
って調整されたパワーデータ信号をアナログ量に変換し
てパワー調整信号を出力するD/Aコンバータと、このD/A
コンバータからのパワー調整信号に応じた出力パワーで
前記レーザーダイオードを駆動させるLDドライブ回路
と、前記LDパワー調整回路の電源となる低電源と、前記
D/AコンバータおよびLDドライブ回路の電源となりかつ
前記低電源よりも高電圧の高電源とを有する画像形成装
置であって、前記D/AコンバータをＣ−MOS型のICから構
成し、さらに前記ICの電源端子に前記低電源および前記
高電源を接続し、しかも、前記ICの電源端子と前記低電
源との間および前記ICと前記高電源との間に、各電源電
圧出力に対し、順方向にダイオードを接続したことを特
徴とする。(Structure and Operation) In order to achieve the above object, the present invention provides an LD power adjustment circuit for adjusting a power data signal for adjusting the output power of a laser diode, and a power data signal adjusted by the LD power adjustment circuit. A D / A converter that converts power to an analog amount and outputs a power adjustment signal, and this D / A
An LD drive circuit that drives the laser diode with an output power according to a power adjustment signal from a converter, a low power supply serving as a power supply for the LD power adjustment circuit,
An image forming apparatus having a high power supply having a higher voltage than the low power supply and serving as a power supply for a D / A converter and an LD drive circuit, wherein the D / A converter is configured from a C-MOS type IC, The low power supply and the high power supply are connected to the power supply terminal of the IC, and the power supply voltage output is sequentially applied between the power supply terminal of the IC and the low power supply and between the IC and the high power supply. A diode is connected in the direction.
本発明によれば、Ｃ−MOS型ICによるD/Aコンバータを
LDの出力パワー調整回路に使用し、その電源端子には前
段回路の電源回路と、それ自体の電源回路とに夫々の電
源電圧出力に対し、順方向のダイオードが接続されてい
るので、前段回路の電源ＡがONし、D/Aコンバータの電
源ＢがOFFの期間が存在しても、前段回路の電源電圧（V
CC≒5V）がダイオードを介して入力され、これとD/Aコ
ンバータへのＶ入力（≒5V・TTLレベル）とがほぼ等し
いのでラッチアップが起こることが防止される。そして
D/Aコンバータはそれ自体の電源Ｂの電圧により正常に
動作することができる。According to the present invention, a D / A converter using a C-MOS type IC is provided.
It is used for the output power adjustment circuit of LD, and its power supply terminal is connected to the power supply circuit of the pre-stage circuit and the power supply circuit of itself. Even if there is a period in which the power supply A is ON and the power supply B of the D / A converter is OFF, the power supply voltage (V
CC ≒ 5V) is input via a diode, and this is almost equal to the V input (≒ 5V · TTL level) to the D / A converter, so that latch-up is prevented. And
The D / A converter can operate normally by its own power supply B voltage.
（実施例） 第１図は本発明の一実施例による回路図を示し、第３
図と同一数字，記号は同じものを表す。ここで、本実施
例は図に示すようにCPU1,LDパワー調整回路２の電源Ａ
を、Ｃ−MOS型ICで構成されるD/Aコンバータ３の補助電
源として、その電源電圧出力の順方向にダイオードD1を
接続し、また、D/Aコンバータ３自体の電源Ｂについて
も、その電源電圧出力の順方向にダイオードD2を接続し
た回路構成となっている。(Embodiment) FIG. 1 shows a circuit diagram according to an embodiment of the present invention, and FIG.
The same numbers and symbols as in the figure represent the same items. Here, in this embodiment, as shown in FIG.
And as an auxiliary power source composed of the D / A converter 3 in C-MOS type IC, connected to the diode D 1 in the forward direction of the power supply voltage output, As for the power supply B of the D / A converter 3 itself, It has a circuit configuration in which a diode is connected D 2 in the forward direction of the power supply voltage output.
この付加ダイオード回路によって、電源ＡがON,電源
ＢがOFFの期間が存在しても、電源ＡのVCC≒5VとD/Aコ
ンバータ３への入力電圧Ｖ入力≒5V（TTL）とがほぼ等
価となり、D/AコンバータのＣ−MOS型ICをラッチアップ
することがない。即ち前述したラッチアップ発生条件が
成立せず防止される。電源ＢがONすればダイオードD2を
介して電源電圧出力が供給されD/Aコンバータは正常に
動作する。With this additional diode circuit, even when the power supply A is ON and the power supply B is OFF, the V CC of the power supply A is approximately 5 V and the input voltage V input to the D / A converter 3 is approximately 5 V (TTL). It is equivalent and does not latch up the C-MOS type IC of the D / A converter. That is, the above-described latch-up occurrence condition is not satisfied and is prevented. If source B ON the power supply voltage output through a diode D 2 is supply D / A converter operates normally.
第２図は本発明によるD/Aコンバータの具体的な回路
を示す。D/Aコンバータ３のVREFINとIOUT1とは通常の使
用方法とは逆となるように使用している。即ち、基準電
圧は、5VツェナーダイオードD3によって作られ、電源Ｂ
の＋12VがONした後、D/Aコンバータ３は正常動作を行な
う。D/AコンバータのIOUT1に供給された電圧から、前記
5VツェナーダイオードD3で基準電圧が作られているの
で、Ｖ入力VCCが守られ、ラッチアップすることがな
い。FIG. 2 shows a specific circuit of the D / A converter according to the present invention. V REFIN and I OUT1 of the D / A converter 3 are used so as to be opposite to the usual usage. That is, the reference voltage is made by 5V Zener diode D 3, the power supply B
After + 12V of ON is turned on, the D / A converter 3 operates normally. From the voltage supplied to I OUT1 of the D / A converter,
Since the reference voltage is made from a 5V Zener diode D 3, V input V CC is protected, it is not to latch-up.
（発明の効果） 以上説明したように本発明はD/Aコンバータに対する
高電源からの電圧供給が遮断された場合でも低電源によ
ってD/Aコンバータに電圧が供給されるため、ラッチア
ップを確実に防止することができるようになり、その結
果、Ｃ−MOS型のICの良好なスイッチング特性を応用し
た低価格のD/Aコンバータを構成することが可能とな
り、安定したLDパワー調整が行えるようになる。(Effect of the Invention) As described above, according to the present invention, even when the voltage supply from the high power supply to the D / A converter is cut off, the voltage is supplied to the D / A converter from the low power supply, so that the latch-up can be reliably performed. As a result, it is possible to configure a low-cost D / A converter that applies the good switching characteristics of the C-MOS type IC, and to achieve stable LD power adjustment. Become.
第１図は本発明の一実施例による回路図、第２図は第１
図の具体回路図、第３図は従来のレーザープリンタにお
けるLDパワー調整回路のブロック図である。 １……CPU、２……LDパワー調整回路、３……D/Aコンバ
ータ、４……LDドライブ回路、A,B……電源、D1,D2……
ダイオード、D3……5Vツェナーダイオード。FIG. 1 is a circuit diagram according to an embodiment of the present invention, and FIG.
FIG. 3 is a block diagram of an LD power adjustment circuit in a conventional laser printer. 1 ...... CPU, 2 ...... LD power adjustment circuit, 3 ...... D / A converter, 4 ...... LD drive circuit, A, B ...... power, D 1, D 2 ......
Diode, D 3 …… 5V Zener diode.
Claims (1)
るためのパワーデータ信号を調整するLDパワー調整回路
と、このLDパワー調整回路によって調整されたパワーデ
ータ信号をアナログ量に変換してパワー調整信号を出力
するD/Aコンバータと、このD/Aコンバータからのパワー
調整信号に応じた出力パワーで前記レーザーダイオード
を駆動させるLDドライブ回路と、前記LDパワー調整回路
の電源となる低電源と、前記D/AコンバータおよびLDド
ライブ回路の電源となりかつ前記低電源よりも高電圧の
高電源とを有する画像形成装置であって、 前記D/AコンバータをＣ−MOS型のICから構成し、さらに
前記ICの電源端子に前記低電源および前記高電源を接続
し、しかも、前記ICの電源端子と前記低電源との間およ
び前記ICと前記高電源との間に、各電源電圧出力に対
し、順方向にダイオードを接続したことを特徴とする画
像形成装置。1. An LD power adjusting circuit for adjusting a power data signal for adjusting an output power of a laser diode, and a power data signal adjusted by the LD power adjusting circuit is converted into an analog quantity to convert the power adjusting signal. A D / A converter for outputting, an LD drive circuit for driving the laser diode with an output power according to a power adjustment signal from the D / A converter, a low power supply serving as a power supply for the LD power adjustment circuit, An image forming apparatus serving as a power supply for an A / A converter and an LD drive circuit and having a high power supply having a higher voltage than the low power supply, wherein the D / A converter comprises a C-MOS type IC, and further comprising the IC The low power supply and the high power supply are connected to the power supply terminal of the power supply, and the power supply voltage is applied between the power supply terminal of the IC and the low power supply and between the IC and the high power supply. An image forming apparatus in which a diode is connected in a forward direction with respect to an output.
Priority Applications (1)
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|---|---|---|---|
| JP63134366A JP2709475B2 (en) | 1988-06-02 | 1988-06-02 | Image forming device |
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|---|---|
| JPH01304945A JPH01304945A (en) | 1989-12-08 |
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| JP63134366A Expired - Fee Related JP2709475B2 (en) | 1988-06-02 | 1988-06-02 | Image forming device |
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|---|---|
| JP (1) | JP2709475B2 (en) |
Family Cites Families (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6244685U (en) * | 1985-09-05 | 1987-03-18 | ||
| JPS62189522A (en) * | 1986-02-15 | 1987-08-19 | Nec Home Electronics Ltd | Power source circuit for microcomputer |
-
1988
- 1988-06-02 JP JP63134366A patent/JP2709475B2/en not_active Expired - Fee Related
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