JP2516968B2 - Flattening material for two-layer electron beam resist - Google Patents

Flattening material for two-layer electron beam resist

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    • G03FPHOTOMECHANICAL PRODUCTION OF TEXTURED OR PATTERNED SURFACES, e.g. FOR PRINTING, FOR PROCESSING OF SEMICONDUCTOR DEVICES; MATERIALS THEREFOR; ORIGINALS THEREFOR; APPARATUS SPECIALLY ADAPTED THEREFOR
    • G03F7/00Photomechanical, e.g. photolithographic, production of textured or patterned surfaces, e.g. printing surfaces; Materials therefor, e.g. comprising photoresists; Apparatus specially adapted therefor
    • G03F7/004Photosensitive materials

Description

【発明の詳細な説明】 〔概要〕 二層構造をとる電子線レジストにおいて、露光する際
に生ずる電荷蓄積を解消するために、下層レジストを高
分子ポリカチオンまたは低分子量カチオンのテトラシア
ノキノジメタン塩型錯体と光硬化性樹脂組成物との混合
物から構成し、導電性を保持させたレジスト材料。
DETAILED DESCRIPTION OF THE INVENTION [Outline] In an electron beam resist having a two-layer structure, in order to eliminate charge accumulation that occurs during exposure, the lower layer resist is a high molecular weight polycation or low molecular weight cation tetracyanoquinodimethane. A resist material comprising a mixture of a salt-type complex and a photocurable resin composition, which retains conductivity.

〔産業上の利用分野〕[Industrial applications]

本発明は二層構造電子線レジストに係り、特に作業性
の向上と電子蓄積を無くした下層レジストの改良に関す
る。
The present invention relates to a two-layer structure electron beam resist, and more particularly to improvement of workability and improvement of a lower layer resist which eliminates electron accumulation.

大量の情報を高速に処理する情報処理技術の進歩と共
に、半導体装置は大容量化が行われてLSIやVLSIが実用
化されているが、これらは何れも単位素子の小形化によ
り実現されている。
With the progress of information processing technology for processing a large amount of information at high speed, semiconductor devices have been increased in capacity and LSIs and VLSIs have been put into practical use, but these are all realized by miniaturization of unit elements. .

すなわち、各単位素子を形成する電極面積や素子相互
を連絡する配線パターン幅は極度に微小化したものが用
いられており、最小パターン幅として1μm程度のもの
が使用されている。
That is, the electrode area forming each unit element and the wiring pattern width for interconnecting the elements are extremely miniaturized, and the minimum pattern width is about 1 μm.

さて、IC,LSIなど半導体集積回路を初めとし、表面波
フィルタなど微細な電子回路は殆どの場合に薄膜形成技
術と写真蝕刻技術(フォトリソグラフィ)を用いて形成
されている。
Now, fine electronic circuits such as surface integrated filters such as semiconductor integrated circuits such as ICs and LSIs are almost always formed by using thin film forming technology and photolithography technology (photolithography).

いま、最も微細化が進んでいる半導体集積回路につい
て説明すると、半導体基板(ウエハ)の上に感光性レジ
スト(フォトレジスト)をスピンコートして薄膜を作
り、選択露光により必要とする位置を窓開けし、イオン
注入法などにより半導体領域を作り、フォトレジストを
除去した後、化学気相成長法などを用いてウエハの全面
に絶縁層を形成している。
The semiconductor integrated circuit, which has been miniaturized most, is described below. A photosensitive resist (photoresist) is spin-coated on a semiconductor substrate (wafer) to form a thin film, and a required position is opened by selective exposure. Then, a semiconductor region is formed by an ion implantation method or the like, the photoresist is removed, and then an insulating layer is formed over the entire surface of the wafer by a chemical vapor deposition method or the like.

次に、この絶縁層にフォトレジスト被覆と選択露光お
よびドライエッチングからなる写真蝕刻技術を適用して
電極位置を窓開けし、このウエハの上に真空蒸着法やス
パッタ法などの薄膜形成技術を用いて導体金属の薄膜を
作り、先と同様に写真蝕刻技術を用い、各単位素子毎に
例えばX方向の微細な配線パターンを形成する。
Next, a photo-resisting technique consisting of photoresist coating, selective exposure and dry etching is applied to this insulating layer to open a window for an electrode position, and a thin film forming technique such as a vacuum deposition method or a sputtering method is used on this wafer. A thin film of conductive metal is formed by using the photolithography technique as described above, and a fine wiring pattern in the X direction, for example, is formed for each unit element.

次に、この上に先と同様に薄膜形成技術を用いて絶縁
層を形成した後、コンタクトホールを穴開けし、この上
に導体金属を蒸着して薄膜を形成した後、写真蝕刻技術
を用い、各単位素子毎に例えばY方向の微細な配線パタ
ーンを形成する。
Next, after forming an insulating layer on this using the thin film forming technique as before, a contact hole is opened, a conductive metal is vapor-deposited on this to form a thin film, and then a photo-etching technique is used. A fine wiring pattern in the Y direction, for example, is formed for each unit element.

このように薄膜形成技術と写真蝕刻技術とにより微細
パターンが形成されているが、最小パターン幅が1μm
未満まで微細化が進んできたため露光光源として紫外線
に代わって電子線が使用されるようになった。
As described above, a fine pattern is formed by the thin film forming technique and the photo-etching technique, but the minimum pattern width is 1 μm.
Since miniaturization has progressed to less than this, electron beams have come to be used as an exposure light source instead of ultraviolet rays.

すなわち、紫外線露光による微細パターンの形成は波
長による制限から1μm以上に限られるのに対し、電子
線の波長は加速電圧により異なるものゝ、0.1Å程度と
格段に短いために1μm未満の微細パターンの形成が可
能となる。
That is, the formation of a fine pattern by UV exposure is limited to 1 μm or more due to the wavelength limitation, whereas the wavelength of the electron beam varies depending on the accelerating voltage. Can be formed.

次に、集積回路の配線パターンの形成には例えばX方
向配線パターンとY方向配線パターンとの立体交叉が必
要となるが、交叉部には顕著な段差が生じており、その
ため平坦面と同様な方法で写真蝕刻技術を適用すると配
線パターン幅が狭いために断線を生じ易いと云う問題が
ある。
Next, in order to form the wiring pattern of the integrated circuit, for example, a three-dimensional intersection of the X-direction wiring pattern and the Y-direction wiring pattern is required, but a significant step is generated at the intersection portion, and therefore, similar to a flat surface. When the photo-etching technique is applied by the method, there is a problem that the wiring pattern width is narrow and thus the disconnection is likely to occur.

そこで、この解決法として、二層構造のレジストを用
い、下層レジストでウエハ表面部の平坦化を行い、この
上に電子線レジストを塗布して電子線を照射し、選択露
光する写真蝕刻技術が開発されている。
Therefore, as a solution to this problem, a photolithography technique of using a two-layer structure resist, flattening the wafer surface with a lower layer resist, coating an electron beam resist on this, irradiating an electron beam, and selectively exposing Being developed.

本発明はこの平坦化用下層レジストの改良に関するも
のである。
The present invention relates to an improvement in this lower layer resist for planarization.

〔従来の技術〕[Conventional technology]

二層構造電子線レジスト用下層レジストの必要条件
は、 電荷の蓄積がないこと。
The requirement for the lower layer resist for a two-layer electron beam resist is that there is no charge accumulation.

短時間の処理により形成できること。It can be formed by a short-time treatment.

弗素ガスプラズマや塩素ガスプラズマに対し耐ドライ
エッチング性が優れていること。
Excellent dry etching resistance against fluorine gas plasma and chlorine gas plasma.

などが挙げられる。And the like.

すなわち、に関する問題として、電子線露光におい
ては照射した電子線により上層レジストが感光され、ま
たかなりの量の電子線は上層レジストを貫通して下層レ
ジストにまで達する。
That is, as a problem related to the above, in the electron beam exposure, the upper layer resist is exposed by the electron beam irradiated, and a considerable amount of the electron beam penetrates the upper layer resist and reaches the lower layer resist.

こゝで、電子は負に帯電しているために下層レジスト
の中に電荷の蓄積(チャージアップ)が起こると、電子
線の投射が妨げられ、そのため露光したパターンの位置
ずれを生ずると云う問題がある。
Here, since the electrons are negatively charged, the accumulation of charges in the lower layer resist (charge-up) hinders the projection of the electron beam, resulting in the displacement of the exposed pattern. There is.

この解消法としては下層レジストに導電性をもたせて
電荷の蓄積をなくする方法がよく、発明者等は先にポリ
ビニルベンジルトリメチルアンモニウム・TCNQ塩型錯体
をクレゾールノボラック樹脂に加え、レジストの導電率
を10-15〜10-12Scm-1とすることを提案している。(特
願昭60-254003)然し、この塩型錯体は合成が難しく、
また樹脂との相溶性が良くないと云う問題があった。
As a solution to this, a method of making the lower layer resist conductive so as to prevent the accumulation of electric charge is good, and the inventors previously added polyvinylbenzyltrimethylammonium / TCNQ salt type complex to the cresol novolac resin to improve the conductivity of the resist. It is proposed to set 10 -15 to 10 -12 Scm -1 . (Japanese Patent Application No. 60-254003) However, this salt type complex is difficult to synthesize,
There is also a problem that the compatibility with the resin is not good.

また、について従来はクレゾールノボラック樹脂と
ナフトキノンアジド化合物とからなるポジ型レジストが
使用されているが、平坦化層として使用するためには20
0℃で1時間程度のベーキング処理が必要であり、時間
を要することが問題であった。
In addition, as for the conventional, a positive resist composed of a cresol novolac resin and a naphthoquinone azide compound has been used, but it is necessary to use a positive resist for use as a planarizing layer.
The baking process is required at 0 ° C. for about 1 hour, which is a problem.

〔発明が解決しようとする問題点〕[Problems to be solved by the invention]

以上記したように段差のある被処理基板上に微小線幅
の導体パターンを形成するには二層構造の電子線レジス
トを使用することが必要である。
As described above, it is necessary to use an electron beam resist having a two-layer structure in order to form a conductor pattern having a minute line width on a substrate having a step.

然し、電子線レジストの使用に当たっては照射電子の
蓄積(チャージアップ)の現象があり、これによるパタ
ーンの位置ずれをなくすことが必要である。
However, when using the electron beam resist, there is a phenomenon of accumulation (charge-up) of irradiation electrons, and it is necessary to eliminate the positional deviation of the pattern due to this phenomenon.

これに対して、発明者等は下層レジストに導電性をも
たせる方法を提案しているが作業性と特性の点で充分と
は言えない。
On the other hand, the inventors have proposed a method of making the lower layer resist conductive, but it is not sufficient in terms of workability and characteristics.

そこで、これを解決することが課題である。 Therefore, the problem is to solve this.

〔問題点を解決するための手段〕[Means for solving problems]

上記の問題は高い段差を含む被処理基板上に下層レジ
ストを塗布して平坦化した後、上層に電子線レジストを
塗布して露光を行い、写真蝕刻技術を用いてレジストパ
ターンの形成を行うのに使用する下層レジストが、高分
子ポリカチオンまたは低分子量カチオンのテトラシアノ
キノジメタン塩型錯体と光硬化性樹脂組成物との混合物
からなる二層構造電子線レジスト用平坦化材料の使用に
より解決することができる。
The above problem is that after applying a lower layer resist on the substrate to be processed including a high step and flattening it, an upper layer is coated with an electron beam resist and exposed, and a resist pattern is formed using a photo-etching technique. The lower layer resist used for the solution is solved by using a planarizing material for a two-layer structure electron beam resist, which is composed of a mixture of a tetracyanoquinodimethane salt type complex of a high molecular weight polycation or a low molecular weight cation and a photocurable resin composition. can do.

〔作用〕[Action]

本発明は従来の研究線上の所産物としてなされたもの
で、市販されているか或いは合成が容易な高分子ポリカ
チオンのテトラシアノキノジメタン(略称TCNQ)の塩型
錯体または低分子量カチオンの塩型錯体を用いることに
より導電性をもたせ、また、樹脂としては紫外線硬化樹
脂を用いることにより硬化時間を短縮するものである。
The present invention has been made as a product on the conventional research line, and is a salt-type complex of tetracyanoquinodimethane (abbreviated as TCNQ) of a high molecular weight polycation which is commercially available or easy to synthesize or a salt-type of a low molecular weight cation. The use of a complex provides conductivity, and the use of an ultraviolet curable resin as the resin shortens the curing time.

このようにして形成した下層レジストは従来の下層レ
ジストの導電率が10-17〜10-16Scm-1であったものが10
-15〜10-12Scm-1に増加させることができ、これにより
電子線露光に当たり、電荷蓄積のためにパターンずれが
生ずると云う問題を解決することができる。
The lower-layer resist formed in this manner has a conventional lower-layer resist conductivity of 10 −17 to 10 −16 Scm −1.
It can be increased to -15 to 10 -12 Scm -1 , which can solve the problem that a pattern shift occurs due to charge accumulation in electron beam exposure.

〔実施例〕〔Example〕

実施例1:〔高分子ポリカチオンTCNQ塩型錯体(Simple-s
alt)の使用例〕 第1図に構造式を示す高分子PiX-TCNQ塩型錯体をジメ
チルフォルムアミド(略称DMF)に溶解して0.4重量%の
溶液とした。
Example 1: [Polymer polycation TCNQ salt type complex (Simple-s
Example of use of alt)] A polymer PiX-TCNQ salt-type complex having a structural formula shown in Fig. 1 was dissolved in dimethylformamide (abbreviation: DMF) to prepare a 0.4 wt% solution.

これに紫外線硬化性エポキシ・アクリレート樹脂(品
名リポキシSP-4010昭和高分子(株))に光重合開始剤
としてベンゾフェノン(和光純薬(株))を加えて下層
レジスト用溶液を作った。
A lower layer resist solution was prepared by adding benzophenone (Wako Pure Chemical Industries, Ltd.) as a photopolymerization initiator to an ultraviolet curable epoxy acrylate resin (Product name: Lipoxy SP-4010 Showa Highpolymer Co., Ltd.).

これをシリコン(Si)ウエハの上にスピンコート法に
より塗布し、厚さが2μmの平坦化層を形成した。
This was applied onto a silicon (Si) wafer by spin coating to form a flattening layer having a thickness of 2 μm.

紫外線を照射して硬化させた後、上層にシリコーンレ
ジストを0.2μmの厚さに塗布し、80℃で20分間プリベ
ークして硬化させた。
After being cured by being irradiated with ultraviolet rays, a silicone resist was applied to the upper layer to a thickness of 0.2 μm and prebaked at 80 ° C. for 20 minutes to cure.

次に、加速電圧20KV,露光量16μC/cm2の条件で電子線
露光を行い、メチルイソブチルケトン(略称MIBK)を用
いて30秒現像した後、イソプロピルアルコール(略称IP
A)で10秒間リンスした。
Next, electron beam exposure is performed under the conditions of an accelerating voltage of 20 KV and an exposure amount of 16 μC / cm 2 , and after developing for 30 seconds using methyl isobutyl ketone (abbreviation MIBK), isopropyl alcohol (abbreviation IP
Rinse with A) for 10 seconds.

このようにして形成したパターンをマスクにして酸素
(O2)プラズマエッチングを行ってパターンを転写し、
0.5μmのライン・アンド・スペースを解像した。
Using the pattern thus formed as a mask, oxygen (O 2 ) plasma etching is performed to transfer the pattern,
A line and space of 0.5 μm was resolved.

次に、このパターンの位置ずれ量を調べたところ電荷
蓄積による位置ずれは全く認められなかった。
Next, when the amount of positional deviation of this pattern was examined, no positional deviation due to charge accumulation was observed.

実施例2:〔低分子量カチオンのTCNQ塩型錯体(Simple-s
alt)を用いた場合〕 1,4−ジメチルピペラジンとジクロルメタンを反応さ
せて得た第2図に構造式を示す低分子量カチオン−TCNQ
塩型錯体をDMFに溶解して1重量%の溶液とした。
Example 2: [TNCQ salt-type complex of low molecular weight cation (Simple-s
alt)] 1,4-dimethylpiperazine and dichloromethane were reacted to obtain a low molecular weight cation-TCNQ whose structural formula is shown in Fig. 2.
The salt complex was dissolved in DMF to give a 1% by weight solution.

これをエン・チオール系光硬化性樹脂組成物〔アデカ
オプトマーBY-300(旭電化工業(株)〕をエピクロルヒ
ドリン(3:1)溶液に添加し、これをSiウエハ上にスピ
ンコートして2μm厚の平坦化層を形成し、紫外線を照
射して硬化させた。
The ene / thiol photocurable resin composition [Adekaoptomer BY-300 (Asahi Denka Kogyo Co., Ltd.)] was added to the epichlorohydrin (3: 1) solution, and this was spin-coated on a Si wafer to 2 μm. A thick flattening layer was formed and was irradiated with ultraviolet rays to be cured.

以下、実施例1と同様にして上層レジストを形成し、
パターンを形成したところ0.5μmのライン・アンド・
スペースを解像しており、またパターンの位置ずれ量を
調べたところ電荷蓄積による位置ずれは全く認められな
かった。
Thereafter, an upper layer resist is formed in the same manner as in Example 1,
When a pattern is formed, 0.5 μm line and
The space was resolved, and when the amount of pattern displacement was examined, no displacement due to charge accumulation was observed.

実施例3:〔低分子量カチオンのTCNQ塩型錯体(Complex-
salt)を用いた場合〕 第3図に構造式を示すn−ブチルアクリジウムのTCNQ
塩型錯体をDMFに溶解して0.5重量%の溶液とした。
Example 3: [TCNQ salt-type complex of low molecular weight cation (Complex-
salt)] The TCNQ of n-butyl acridium whose structural formula is shown in Fig. 3
The salt complex was dissolved in DMF to give a 0.5 wt% solution.

これを実施例1と同様にリポキシSP-4010にベンゾフ
ェノンを加えて希釈した液に添加して下層レジスト液を
作り、厚さが2μmの平坦化層を形成した後、紫外線を
照射して硬化させた。
This is added to a solution obtained by adding benzophenone to Lipoxy SP-4010 and diluting it in the same manner as in Example 1 to form a lower layer resist solution, and after forming a planarizing layer having a thickness of 2 μm, it is irradiated with ultraviolet rays and cured. It was

以下、実施例1と同様にして上層レジストを形成し、
パターンを形成したところ0.5μmのライン・アンド・
スペースを解像しており、またパターンの位置ずれ量を
調べたところ電荷蓄積による位置ずれは全く認められな
かった。
Thereafter, an upper layer resist is formed in the same manner as in Example 1,
When a pattern is formed, 0.5 μm line and
The space was resolved, and when the amount of pattern displacement was examined, no displacement due to charge accumulation was observed.

〔発明の効果〕〔The invention's effect〕

以上記したように高分子ポリカチオンまたは低分子量
カチオンのTCNQ塩型錯体と光硬化性樹脂組成物との混合
物を下層レジストとして使用すると作業性が良く、また
電子線照射の際の電荷蓄積がないので高精度の微細パタ
ーンの形成が可能となる。
As described above, when a mixture of a TCNQ salt type complex of a high molecular weight polycation or a low molecular weight cation and a photocurable resin composition is used as a lower layer resist, workability is good and there is no charge accumulation during electron beam irradiation. Therefore, it is possible to form a highly precise fine pattern.

【図面の簡単な説明】[Brief description of drawings]

第1図は高分子ポリカチオンPix-TCNQ塩型錯体の構造
式、 第2図は低分子量カチオン−TCNQ塩型錯体の構造式、 第3図はn−ブチルアクリジウム−TCNQ塩型錯体の構造
式、 である。
FIG. 1 is a structural formula of a high molecular weight polycation Pix-TCNQ salt type complex, FIG. 2 is a structural formula of a low molecular weight cation-TCNQ salt type complex, and FIG. 3 is a structure of an n-butyl acridium-TCNQ salt type complex. The formula is.

───────────────────────────────────────────────────── フロントページの続き (72)発明者 芝 昭二 川崎市中原区上小田中1015番地 富士通 株式会社内 (72)発明者 渡部 慶二 川崎市中原区上小田中1015番地 富士通 株式会社内 (56)参考文献 特開 昭59−107347(JP,A) 特開 昭59−93441(JP,A) 特開 昭61−144639(JP,A) 特開 昭60−8839(JP,A) 特表 昭58−502169(JP,A) ─────────────────────────────────────────────────── ─── Continuation of the front page (72) Inventor Shoji Shiba, 1015 Kamiodanaka, Nakahara-ku, Kawasaki City, Fujitsu Limited (72) Inventor Keiji Watanabe, 1015, Kamedotachu, Nakahara-ku, Kawasaki, Fujitsu Ltd. (56) References JP-A-59-107347 (JP, A) JP-A-59-93441 (JP, A) JP-A-61-144639 (JP, A) JP-A-60-8839 (JP, A) Special table Sho-58-502169 (JP, A)

Claims (1)

(57)【特許請求の範囲】(57) [Claims] 【請求項1】高い段差を含む被処理基板上に下層レジス
トを塗布して平坦化した後、上層に電子線レジストを塗
布して露光を行い、写真蝕刻技術を用いてレジストパタ
ーンの形成を行うのに使用する下層レジストが、主鎖に
カチオン部を含む高分子ポリカチオンまたは低分子量カ
チオンのテトラシアノキノジメタン塩型錯体と光硬化性
樹脂組成物との混合物からなることを特徴とする二層構
造電子線レジスト用平坦化材料。
1. A lower layer resist is coated on a substrate to be processed having a high step to be planarized, and then an electron beam resist is coated on the upper layer for exposure, and a resist pattern is formed by using a photo-etching technique. The lower layer resist used for the above is composed of a mixture of a tetracyanoquinodimethane salt type complex of a high molecular weight polycation or a low molecular weight cation having a cation portion in the main chain and a photocurable resin composition. Planarization material for layered electron beam resist.
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