JP2023523946A - ウエハエッジにおける材料特性を維持するためのリップシールエッジエクスクルージョン処理 - Google Patents
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- 239000000463 material Substances 0.000 title claims abstract description 38
- 230000007717 exclusion Effects 0.000 title description 9
- 239000000758 substrate Substances 0.000 claims abstract description 196
- 229910052751 metal Inorganic materials 0.000 claims abstract description 157
- 239000002184 metal Substances 0.000 claims abstract description 157
- 239000004065 semiconductor Substances 0.000 claims abstract description 110
- 238000004070 electrodeposition Methods 0.000 claims abstract description 71
- 238000009713 electroplating Methods 0.000 claims abstract description 62
- PXHVJJICTQNCMI-UHFFFAOYSA-N Nickel Chemical compound [Ni] PXHVJJICTQNCMI-UHFFFAOYSA-N 0.000 claims abstract description 61
- 239000003792 electrolyte Substances 0.000 claims abstract description 39
- 229910052759 nickel Inorganic materials 0.000 claims abstract description 29
- ATJFFYVFTNAWJD-UHFFFAOYSA-N Tin Chemical compound [Sn] ATJFFYVFTNAWJD-UHFFFAOYSA-N 0.000 claims abstract description 18
- 238000000034 method Methods 0.000 claims description 87
- 238000007747 plating Methods 0.000 claims description 28
- 229920002120 photoresistant polymer Polymers 0.000 claims description 19
- 239000002659 electrodeposit Substances 0.000 claims description 8
- 229910052709 silver Inorganic materials 0.000 claims description 8
- 239000004332 silver Substances 0.000 claims description 8
- 239000010949 copper Substances 0.000 claims description 6
- RYGMFSIKBFXOCR-UHFFFAOYSA-N Copper Chemical compound [Cu] RYGMFSIKBFXOCR-UHFFFAOYSA-N 0.000 claims description 5
- 150000001875 compounds Chemical class 0.000 claims description 5
- 229910052802 copper Inorganic materials 0.000 claims description 5
- 230000015654 memory Effects 0.000 claims description 5
- 238000000059 patterning Methods 0.000 claims description 3
- 230000000694 effects Effects 0.000 abstract description 5
- 230000002411 adverse Effects 0.000 abstract description 3
- 235000012431 wafers Nutrition 0.000 description 24
- 230000008569 process Effects 0.000 description 22
- 238000000151 deposition Methods 0.000 description 20
- 150000002739 metals Chemical group 0.000 description 19
- 230000008021 deposition Effects 0.000 description 17
- 238000004519 manufacturing process Methods 0.000 description 14
- 238000012545 processing Methods 0.000 description 12
- QCEUXSAXTBNJGO-UHFFFAOYSA-N [Ag].[Sn] Chemical compound [Ag].[Sn] QCEUXSAXTBNJGO-UHFFFAOYSA-N 0.000 description 10
- 230000006835 compression Effects 0.000 description 7
- 238000007906 compression Methods 0.000 description 7
- 150000002500 ions Chemical class 0.000 description 7
- 230000000873 masking effect Effects 0.000 description 5
- BQCADISMDOOEFD-UHFFFAOYSA-N Silver Chemical compound [Ag] BQCADISMDOOEFD-UHFFFAOYSA-N 0.000 description 4
- -1 silver ions Chemical class 0.000 description 4
- 229910007637 SnAg Inorganic materials 0.000 description 3
- 238000000231 atomic layer deposition Methods 0.000 description 3
- 238000005229 chemical vapour deposition Methods 0.000 description 3
- 238000005240 physical vapour deposition Methods 0.000 description 3
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 description 2
- 238000004140 cleaning Methods 0.000 description 2
- 229910017052 cobalt Inorganic materials 0.000 description 2
- 239000010941 cobalt Substances 0.000 description 2
- GUTLYIVDDKVIGB-UHFFFAOYSA-N cobalt atom Chemical compound [Co] GUTLYIVDDKVIGB-UHFFFAOYSA-N 0.000 description 2
- 238000005336 cracking Methods 0.000 description 2
- 230000000254 damaging effect Effects 0.000 description 2
- 230000007547 defect Effects 0.000 description 2
- 238000010586 diagram Methods 0.000 description 2
- 238000001459 lithography Methods 0.000 description 2
- 239000000203 mixture Substances 0.000 description 2
- 230000009467 reduction Effects 0.000 description 2
- 230000002829 reductive effect Effects 0.000 description 2
- 238000011160 research Methods 0.000 description 2
- 229910052710 silicon Inorganic materials 0.000 description 2
- 239000010703 silicon Substances 0.000 description 2
- 229940100890 silver compound Drugs 0.000 description 2
- 238000003860 storage Methods 0.000 description 2
- 229910000881 Cu alloy Inorganic materials 0.000 description 1
- VEQPNABPJHWNSG-UHFFFAOYSA-N Nickel(2+) Chemical compound [Ni+2] VEQPNABPJHWNSG-UHFFFAOYSA-N 0.000 description 1
- KJTLSVCANCCWHF-UHFFFAOYSA-N Ruthenium Chemical compound [Ru] KJTLSVCANCCWHF-UHFFFAOYSA-N 0.000 description 1
- 239000002253 acid Substances 0.000 description 1
- 230000009471 action Effects 0.000 description 1
- 230000004913 activation Effects 0.000 description 1
- 238000000137 annealing Methods 0.000 description 1
- 230000008901 benefit Effects 0.000 description 1
- 230000015572 biosynthetic process Effects 0.000 description 1
- 238000004891 communication Methods 0.000 description 1
- 230000001010 compromised effect Effects 0.000 description 1
- 239000004020 conductor Substances 0.000 description 1
- 238000001816 cooling Methods 0.000 description 1
- 230000032798 delamination Effects 0.000 description 1
- 239000013536 elastomeric material Substances 0.000 description 1
- 238000007772 electroless plating Methods 0.000 description 1
- 238000005530 etching Methods 0.000 description 1
- 238000010438 heat treatment Methods 0.000 description 1
- 238000010348 incorporation Methods 0.000 description 1
- 238000005468 ion implantation Methods 0.000 description 1
- 239000010410 layer Substances 0.000 description 1
- 238000005259 measurement Methods 0.000 description 1
- 238000001465 metallisation Methods 0.000 description 1
- 238000012986 modification Methods 0.000 description 1
- 230000004048 modification Effects 0.000 description 1
- 229910001453 nickel ion Inorganic materials 0.000 description 1
- 238000004806 packaging method and process Methods 0.000 description 1
- 230000036961 partial effect Effects 0.000 description 1
- 230000002093 peripheral effect Effects 0.000 description 1
- 238000012805 post-processing Methods 0.000 description 1
- 238000011112 process operation Methods 0.000 description 1
- 238000003672 processing method Methods 0.000 description 1
- 229910052707 ruthenium Inorganic materials 0.000 description 1
- 238000005389 semiconductor device fabrication Methods 0.000 description 1
- 235000012239 silicon dioxide Nutrition 0.000 description 1
- 239000000377 silicon dioxide Substances 0.000 description 1
- 229910000679 solder Inorganic materials 0.000 description 1
- 239000000126 substance Substances 0.000 description 1
- 229910001432 tin ion Inorganic materials 0.000 description 1
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- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
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- H01L21/28—Manufacture of electrodes on semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/268
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Abstract
【解決手段】半導体基板上のスルーマスクフィーチャへの金属の連続電着は、マスク材料へのリップシールの圧力の悪影響を低減するために行われる。第1の電気めっき工程では、半導体基板の端から第1の距離において基板との最内接点を有するリップシールを用いて、第1の金属(例えば、ニッケル)が電着される。第2の電気めっき工程では、半導体基板の端から第1の距離よりも長い距離において基板との最内接点を有するリップシールを用いて、第2の金属(例えば、スズ)が電着される。これにより、第1の電着工程中に損傷を受けうる地点から少なくとも部分的にリップシール圧が移され、第1の電気めっき工程中にマスク材料に形成された割れが電解液から遮蔽されうる。【選択図】図3
Description
本願の一部として、本明細書と同時にPCT出願書が提出される。同時に出願されたPCT出願書に認められる利益または優先権を本願が主張する各出願は、その全てが全ての目的のために参照により本明細書に援用される。
本発明は、半導体デバイス製造のための方法および装置に関する。具体的には、本発明の実施形態は、金属の電着、特にスルーマスク電気めっきに関する。
半導体デバイス製造におけるスルーマスク電気めっきは、底部に露出した導電層を有する凹状フィーチャへの金属の電着を含む。凹状フィーチャの側壁およびこれら基板のフィールド領域は、フォトレジストなどの非導電性マスク材料からなる。電気めっき中に半導体基板は、マスク材料の下にある導電層に電気接触することにより、および、電源からその層に負電圧を印加することにより、陰極バイアスされる。この接触は一般に、基板ホルダアセンブリにおいて半導体基板の周囲で行われる。
基板ホルダは通常、半導体基板、および、ウエハ基板の外縁および裏面を電解液から遮蔽するエラストマリップシールを保持するカップも備える。電気めっき中に、陰極バイアスされた基板は電解液に接触させられる。電解液は、半導体基板上の陰極バイアスされた金属と接触すると、電解液に含まれるイオンの電気化学的還元を引き起こす。いくつかの適用では、ウエハレベルパッケージング(WLP)において、2つの金属(例えば、スズおよび銀)がスズイオンおよび銀イオンを含む電解液を用いて電気めっきされる。形成されたスズ-銀(SnAg)の突起は、次にいくつかの基板を一緒にはんだ付けするために用いられうる。
本明細書に記載の背景技術の説明は、本開示の内容を一般的に提示するためである。現在挙げられている発明者の発明は、本背景技術欄だけでなく、出願時に先行技術に該当しない説明の態様に記載される範囲において、本開示に対する先行技術として明示的にも黙示的にも認められない。
半導体基板上のスルーマスク凹状フィーチャに金属を連続電着するための方法および装置が提供される。提供される方法は、連続電気めっき中のマスク材料への損傷の悪影響を低減するために用いられうる。
一態様では、複数のスルーマスク凹状フィーチャを有する半導体基板に金属を電着する方法が提供される。この方法は、(a)第1のリップシールを用いる第1の電気めっきセルにおいて、半導体基板の凹状スルーマスクフィーチャを完全に充填することなく凹状スルーマスクフィーチャに第1の金属を電着し、第1のリップシールは、半導体基板の周囲で半導体基板に接触し、第1のリップシールと半導体基板との最内接点は、半導体基板の端から第1の距離に位置し、(b)(a)の後に、第2のリップシールを用いる第2の電気めっきセルにおいて、半導体基板の凹状スルーマスクフィーチャに第2の金属を電着することを含み、第2のリップシールは、半導体基板の周囲で半導体基板に接触し、第2のリップシールと半導体基板との最内接点は、半導体基板の端から第2の距離に位置し、第2の距離は第1の距離よりも長い。いくつかの実施形態では、マスク材料はフォトレジストであり、第1のリップシールおよび第2のリップシールは、半導体基板上のフォトレジスト材料に接触する。いくつかの実施形態では、第2の金属の電着は、マスク材料のレベルよりも上に電着した第2の金属の突起をもたらさない。
いくつかの実施形態では、この方法は、第1の金属が電着した後に、半導体基板を第1のリップシールとの接触から解放し、第2の金属を電気めっきする前の一定期間(例えば、少なくとも1時間)に、半導体基板をリップシールと接触しないままにすることを含む。
この方法は、第1の金属の堆積が温かい電解液で実行されたときに有効である。これは、温かい電解液がリップシール付近のマスク材料の損傷を引き起こしやすいためである。一実施形態では、第1の金属は、25℃よりも高い(例えば、40℃よりも高い)温度を有するめっき浴(電解液)で電着される。特定の一実施形態では、第1の金属はニッケルであり、ニッケルは25℃よりも高い(例えば、40℃よりも高い)温度を有するめっき浴を用いて電着される。
一実施形態では、第1の金属はニッケルであり、第2の金属はスズまたはスズと銀との化合物である。いくつかの実施形態では、第1の金属はニッケルであり、第2の金属はスズまたはスズと銀との化合物であり、この方法はさらに、ニッケルの電着の前に、凹状スルーマスクフィーチャに銅を電着することを含む。
いくつかの実施形態では、第1のリップシールおよび第2のリップシールは異なるリップシールであり、第2のリップシールは、(リップシール同士の内径を比較して)第1のリップシールよりも小さい直径を有する。
別の実施形態では、第1のリップシールおよび第2のリップシールは、異なる位置で基板と接触するように調節されるように構成されている同じリップシールである。
一実施形態では、金属の連続堆積中に用いられる半導体基板は、半製品の高帯域幅メモリ(HBM)デバイスである。
いくつかの実施形態では、記載の方法はさらに、半導体基板にフォトレジストを塗布する工程と、フォトレジストを露光する工程と、フォトレジストをパターニングし、パターンを半導体基板に転写する工程と、半導体基板からフォトレジストを選択的に除去する工程と、を含む。
別の態様では、半導体基板に金属を電気めっきするためのシステムが提供される。このシステムは、(a)半導体基板に第1の金属を電着するように構成され、第1のリップシールを有する基板ホルダを備える第1の電気めっき装置と、(b)半導体基板に第2の金属を電着するように構成され、第1のリップシールよりも小さい直径を有する第2のリップシールを有する基板ホルダを備える第2の電気めっき装置と、(c)プログラム命令を含むコントローラと、を備える。プログラム命令は、(i)半導体基板上のスルーマスク凹状フィーチャを部分的に充填するために、第1の電気めっき装置において第1の金属を電気めっきする工程と、(ii)第1の金属が電気めっきされた後に、第2の電気めっき装置において第2の金属を電気めっきする工程と、が生じるように構成されている。
別の態様では、半導体基板に金属を電気めっきするためのシステムが提供される。このシステムは、(a)加熱電解液から半導体基板に第1の金属を電着するように構成され、第1のリップシールを有する基板ホルダを備える第1の電気めっき装置と、(b)非加熱電解液から半導体基板に第2の金属を電着するように構成され、第1のリップシールよりも小さい直径を有する第2のリップシールを有する基板ホルダを備える第2の電気めっき装置と、を備える。
本明細書に記載の装置は、本明細書に記載の方法の工程が生じるように設定されたプログラム命令を有するコントローラを備えうる。
別の態様では、本明細書に記載の方法の工程が生じるように設定されたコードを含む非一時的コンピュータ機械可読媒体が提供される。
本明細書に記載の主題の実施形態のこれらおよび他の態様は、添付の図面および以下の発明を実施するための形態において説明される。
半導体デバイス処理で用いられるいくつかのプロセスでは、半導体基板上のスルーマスク凹状フィーチャへのいくつかの金属の連続電着が用いられる。例えば、高帯域幅メモリ(HBM)デバイスの製造に用いられるいくつかの処理方法では、ニッケルがスルーマスクフィーチャに電着され、続いて、同じ凹状フィーチャにスズまたはスズ-銀の化合物が電着される。このプロセスは一般に、基板ホルダに半導体基板を固定し、ニッケルイオンを含む電解液に半導体基板の加工面を浸漬する工程と、基板を陰極バイアスする工程と、スルーマスクフィーチャにニッケルを電着する工程と、を含む。半導体基板が基板ホルダに固定されたときは、リップシールは半導体基板の周囲のマスク材料に圧着される。ニッケルの電着が完了した後に、基板は基板ホルダから解放され、第2の金属の電着が開始する前に、一定期間(例えば、1~24時間)格納されることがある。格納後に、半導体基板は再び基板ホルダに設置され、そこでリップシールは再び基板の周囲のマスク材料に圧着される。次に、基板は第2の電解液(例えば、Sn2+イオンまたはSn2+イオンとAg+イオンとの混合物を含む電解液)と接触させられ、陰極バイアスをかけられて、スルーマスク凹状フィーチャに第2の金属(例えば、スズまたはスズ-銀の化合物)が堆積する。
スルーマスク(例えば、スルーフォトレジスト)フィーチャにおける金属の連続電着中に生じる問題の1つは、第1の金属の電着中のマスク材料における不慮の割れの形成であり、それにより第2の金属の連続電着中に基板の周囲でめっき不良が生じうる。割れは、基板ホルダのリップシールによるマスク材料の圧縮、および、基板が基板ホルダから解放され、第2の金属のめっき前に格納庫に設置された後のこの圧縮の連続開放が原因で形成される可能性がある。割れは、第1の金属の電着中に温かいまたは熱い電解液が用いられたときに悪化する。電解液は、第2の金属の電着中に割れに浸透し、後にマスク材料のピーリングまたはフレーキングを伴う、マスク材料の下の第2の金属の望ましくない電着をもたらす可能性があることが発見された。これらの問題は、第2の金属の不均一な電着を引き起こす。
第2の金属の電気めっき不良を防ぐ、または最小限にするための方法および装置が提供される。この方法および装置は、第1の電着が高温で実施された場合(例えば、第1の電着における電解液温度が約25℃よりも高い(約30℃よりも高い、または約40℃よりも高いなど)場合)に半導体基板に電気めっきするのに特に有効であるが、これらの適用に限定されない。記載の方法は、HBMメモリの製造中に用いられうるが、一般に、凹状フィーチャへの金属の連続電着を用いるあらゆるプロセスに適用可能である。この方法は、様々な金属の電着中のめっき不良を最小限にするために用いられうるが、主にニッケル(Ni)に続くスズ-銀(SnAg)の連続電着に関して説明されるだろう。
特許請求の範囲で用いられる「金属」という用語は、1つ以上の金属を意味し、「金属の電着」は単一金属の電着に限定されない。例えば、「金属」はスズと銀との化合物であってよい。いくつかの実施形態では、この方法は、ニッケル(Ni)の電着に続く単一金属としてのスズ(Sn)の電着のために用いられる。いくつかの実施形態では、この方法は、銅(Cu)の電着、続いてニッケル(Ni)の電着、続いてスズ(Sn)またはスズ-銀(SnAg)の電着のために用いられる。
本明細書で用いられる「半導体基板」という用語は、その構造内のあらゆる半導体材料を含む半導体デバイス製造のあらゆる段階における基板を意味する。半導体基板の半導体材料は、露出される必要がないことが理解される。半導体基板の例は、半導体材料を覆う複数の他の材料(例えば、誘電体)層を有する半導体ウエハである。以下の詳細な説明は、開示の実施形態が半導体ウエハ(例えば、200mm、300mm、または450mmの半導体ウエハ)で実施されることを前提としているが、開示の実施形態はそれに限定されない。ワークピースは、様々な形状、寸法、および材料を有してよい。半導体ウエハに加えて、開示の実施形態を利用できる他のワークピースは、プリント回路基板などの様々な物品を含む。
数値に関連して「約」という用語が用いられるときは、特定されない限り、記載された数値の±10%の範囲を含む。
記載の方法により、マスク材料へのリップシールの圧力の悪影響を低減するために、半導体基板上のスルーマスクフィーチャへの金属の連続電着が行われる。第1の電気めっき工程では、基板の端から第1の距離において半導体基板との最内接点を有するリップシールを用いて、第1の金属(例えば、ニッケル)が電着される。第2の電気めっき工程では、基板の端から第1の距離よりも長い距離において半導体基板との最内接点を有するリップシールを用いて、第2の金属(例えば、スズ-銀)が電着される。このシーケンスは、第1の金属の堆積中に損なわれうるマスク部分の少なくとも一部への圧力の低減をもたらし、これらの部分を電解液から遮蔽することもできる。
この方法は、図1A、図1B、および図1Cによって表される。これらの図は、半導体基板がうつ伏せの配向で保持された、スルーマスクフィーチャへの金属の電着中の基板ホルダ内の基板の周囲部分の概略断面図を示す。図1Aは、スルーマスクフィーチャへの第1の金属(例えば、ニッケル)の電着を表す。基板101は一般に、部分103(半導体、誘電体、および導電層の組み合わせを含みうる)と、部分103と直接接触する導電シード層105とを有する半導体ウエハである。導電シード層105は、銅(銅合金を含む)、コバルト、ルテニウムなどの様々な金属を含みうる。半導体基板の周囲のシード層は、基板に電気接触し、電気めっき中に基板を負にバイアスするために用いられる。第1の金属層107(例えば、ニッケル層)は、シード層105の上のパターンマスク層109(例えば、フォトレジスト層)によって形成された凹状スルーマスクフィーチャに堆積する。第1の金属層の電着前に、シード層105は、スルーマスク凹状フィーチャの底部で電解液に曝される。第1の金属の電気めっき中に、半導体基板101は、(電源に電気接続された)導電コンタクト111が基板の周囲でシード層105に接触し、電気めっき中に半導体基板101を負にバイアスするように構成されている基板ホルダに設置される。半導体基板はリップシール113に圧着され、半導体基板101とリップシール113との最内接点115は、半導体基板101の端からの距離D1で示されたように、基板の周囲に位置する。半導体基板101は、基板ホルダのカップ117によって支持される。リップシール113は一般にエラストマ材料からなり、基板の周囲でマスク材料109に圧着する環状部分を有する。マスク材料109の圧縮により、リップシール133との接点付近でマスク材料109に割れが生じることが分かる。
エッジエクスクルージョンゾーン(基板の端から基板とリップシールとの最内接点までの領域)の処理がなく、マスク材料への損傷の影響を軽減するために何も行動が取られなかった場合、第2の金属の堆積中に第1のリップシールと同じ直径のリップシールが用いられる。例えば、第1の金属の電着後(図1A参照)に、基板はウエハホルダから取り外され、任意の収納後に、第1の金属の電着時に用いられたリップシールと同じマスク材料の位置に圧着される同じリップシールを有する、第2のウエハホルダに搬送されてよい。これは、第1の金属の上に第2の金属の電着が施されたウエハ基板のエッジ部分の概略断面図を示す図2Aに表されている。第2の金属119(例えば、スズ-銀)は、基板の加工面が第2の金属のイオンを含む電解液に浸漬されている間に、第1の金属107(例えば、ニッケル)の上に堆積する。この場合、基板の端からリップシール133と基板101との最内接点までの距離D2は、第1の金属の堆積時に用いられた距離D1と同じである。この構成は、マスク材料の下にある第2の金属の望ましくない電着をもたらし、マスク材料の剥離、および基板の端付近の第2の金属の不均一な電着を引き起こしうる。
本明細書に記載の実施形態では、エッジエクスクルージョンゾーンは、第2の金属の電着中の基板の端からリップシールと基板との最内接点までの距離が、第1の金属の電着時に用いられた基板の端からリップシールの最内接点までの距離よりも大きくなるようにリップシールが構成されるように処理される。これは、例えば第1の金属の電着時に用いられたリップシールよりも小さい直径(基板に接触するリップシールの環状部分の内径)を有するリップシールを用いることにより実現できる。これは、第2の金属の電着が施されている基板の端の概略的な部分断面図を示す図1Cによって表されている。この実施形態では、図1Aに示されたリップシール113よりも小さい直径を有するリップシール114が用いられる。リップシール114とウエハ基板101との最内接点116からの距離D3は、図1Aに示した距離D1よりも大きい。いくつかの実施形態では、ウエハの端からリップシール114と基板101との外側接点までの距離D4も、第1の金属の電着時に用いられた、ウエハの端からリップシール113と基板101との外側接点までの相当距離よりも長い。第2の金属の電着時に小径のリップシールを用いることにより、マスク材料における割れ、および、続くめっきの不均一性の影響を低減または回避できる。
特定の実施形態では、ニッケル(第1の金属)の電着時に用いたリップシールは、基板端から2.25mmにおいて基板との最内接点を有し、スズ-銀(第2の金属)の電着時に用いたリップシールは、基板の端から2.40mmにおいて基板との最内接点を有する。
いくつかの実施形態では、第2の金属の電着時における基板の端からリップシールと基板との最内接点までの距離は、第1の金属の電着時における基板の端からリップシールと基板との最内接点までの距離よりも、約0.1~0.5mm(例えば、約0.15~0.25mm)だけ長い。つまり、図1Aおよび図1Cを参照すると、いくつかの実施形態では、D3ひくD1は約0.1~0.5mm(例えば、約0.15~0.25mm)である。これは、2つのリップシールの最内径の概略上面図を示す図2によっても表されている。リップシール201は、第1の金属の電着時に用いられる大径リップシールである。リップシール203は、第2の金属の電着時に用いられる小径リップシールである。2つのリップシールの半径差Lは、いくつかの実施形態では約0.1~0.5mm(例えば、約0.15~0.25mm)であり、図1Aおよび図1Cに示す断面図に関連して上記したD3およびD1の差に相当する。
図3は、本明細書に記載の実施形態によりエッジエクスクルージョンゾーン処理を用いて電気めっきを行うための例示的なプロセスフロー図を提供する。このプロセスは、スルーマスク凹状フィーチャを有する半導体基板を電気めっき装置に提供する工程301で始まる。基板(例えば、半製品HBMデバイス)は、基板の端においてマスク材料に圧着されるリップシールを有する基板ホルダに固定され、スルーレジスト凹状フィーチャに金属を電気めっきするように構成されている電気めっき液に浸漬される。電気めっき液は、めっきされる金属のイオンを含み、必要に応じて酸を含んでよい。工程303では、リップシールと半導体基板との最内接点が半導体基板の端から第1の距離に位置するように構成されているリップシールを用いて、第1の金属が凹状フィーチャを完全に充填することなく凹状フィーチャに電着される。次に工程305において、リップシールと半導体基板との最内接点が半導体基板の端からより長い距離に位置するように構成されているリップシールを用いて、第2の金属が凹状フィーチャに電着される。いくつかの実施形態では、第1の金属および第2の金属の電着は、2つの異なる基板ホルダを用いて実施され、第1の金属の電着に用いられた基板ホルダは、第2の金属の電着に用いられたリップシールよりも大きい直径のリップシールを有する。
いくつかの実施形態では、エッジエクスクルージョンゾーンは、異なる直径のリップシールを用いて処理できるが、他の実施形態では、トルクまたは圧縮を用いて変更されるように構成されている単一リップシールを用いることにより、同じ効果が得られる。
いくつかの実施形態では、リップシールはトルクを用いて第1の構成から第2の構成に変更される。かかるリップシール407の例は図4A~4Cに示されており、リップシールとウエハとの最内接点401、403、および405の位置は、基板409を保持するカップ411のトルクを用いて、図4Aの構成、図4Bの構成、および図4Cの構成の間で変更できる。例えば、第1の金属のめっきは、リップシール407が位置401(最内接点)で半導体基板409に接触する図4Aに示す位置にあるときに行われうる。次に、基板は異なる電解液に接するために搬送され、リップシールは、リップシールと基板との最内接点405が、ウエハの端から図4Aに示す接点401よりもさらに内側になるように、トルクを用いて図4Cに示す位置に設定されてよい。第2の金属は、この構成において電気めっきされうる。あるいは、第1の金属は、リップシールと基板との最内接点403が図4Aおよび図4Cに示すいずれの構成よりも基板の端に近くなる、図4Bに示す構成において電気めっきされてよい。図4Bに示す構成を用いて第1の金属が電気めっきされた後に、基板は第2の電解液に搬送され、リップシールの構成は、共により大きいエッジエクスクルージョンゾーン(基板の端からリップシールと基板との最内接点までの距離)を提供する、図4Aまたは図4Cに示すいずれかの構成に変更できる。次に第2の金属は、図4Aまたは図4Cに示すリップシール構成を用いて凹状フィーチャに電気めっきされる。異なる工程は、異なる手法で同一リップシールにトルクを与えることにより異なるエクスクルージョンを進めるハードウェアを支持する、リップシールの変更を有してよい。
いくつかの実施形態では、リップシールは圧縮を用いて第1の構成から第2の構成に変更される。かかるリップシールの例は、リップシールとウエハとの接点がカップ圧縮力または接点ばね圧縮力を用いて変更できる図5A~5Bに表されている。例えば、第1の金属のめっきは、リップシール501が図5Aに示す位置(非圧縮状態)にあり、基板503との最内接点を地点505に有するときに行うことができる。次に、基板は(リップシールを変更することなく)異なる電解液に移され、リップシール501の構成は、リップシール501と基板503との最内接点507が図6Aに示す構成よりも基板の端から遠くなるように、図6Bに示す構成(圧縮状態)に変更できる。
記載の方法は、例として2つの金属の連続堆積を用いて説明されているが、記載の実施形態は2つの金属の電着に限定されず、全ての工程または少なくともいくつかの工程中にエッジエクスクルージョンゾーンが処理されうる、より多くの金属(例えば、3つ、4つ、または5つの金属)の連続電着に用いられうることに注意されたい。例えば、3つの金属が連続して堆積される場合、第1の金属の堆積時に用いられるリップシールは、第2の金属の堆積時に用いられるリップシールよりも大きい直径を有してよく、同様に第2の金属の堆積時に用いられるリップシールは、第3の金属の堆積時に用いられるリップシールよりも大きい直径を有してよい。別の実施形態では、第1の金属および第2の金属の堆積時に用いられるリップシールは同じ直径を有してよく、第3の金属の堆積時に用いられるリップシールは、これらいずれのリップシールよりも小さい直径を有してよい。3つの金属がスルーマスクフィーチャにめっきされる連続電着の例は、銅に続いてニッケル、その次にスズまたはスズ-銀の連続電着を含む。
記載の方法は、第1の金属の電着が高温(例えば、少なくとも約25℃(少なくとも約30℃、または少なくとも約40℃など))で行われるときに特に有効である。これは、温かいまたは熱い電解液が冷たい電解液よりも広範囲でマスク材料(例えば、有機フォトレジスト材料)を損傷する能力があるためである。高温で電気めっきされることが多い金属の例は、ニッケルおよびコバルトを含む。いくつかの実施形態では、第1の金属は高温で電気めっきされ、第2の金属は常温で電気めっきされる。
いくつかの実施形態では、記載の方法は、金属をスルーマスクフィーチャに連続電気めっきするために用いられ、電着した金属は、フォトレジスト面によって規定されたフィールド領域よりも上に形成されない。かかるめっきは、リップシール材料への金属めっきのリスクを最小限にするため、いくつかの実施形態で用いられる。
装置
装置
本明細書に記載の堆積方法は、様々な電気めっき装置で実施できる。いくつかの実施形態では、第1の金属(例えば、ニッケル)の電気めっきは、第1のめっき室と、第1のリップシールを備える第1の基板ホルダとを有する第1の電気めっき装置で行われ、第2の金属の電気めっきは、第2のめっき室と、第2のリップシール(例えば、第1のリップシールよりも小径のリップシール)を備える第2の基板ホルダとを有する第2の電気めっき装置で行われる。
第1の金属または第2の金属の堆積に適した装置は、電解液および陽極を保持するように構成されているめっき室と、基板を陰極バイアスするためのコンタクトを有する基板ホルダと、基板およびリップシールを保持するためのカップとを備える。堆積は、仰向けまたはうつ伏せの配向で行われうる。いくつかのめっきツールも垂直に動いてよい。適した装置の例は、カリフォルニア州フレモントのラム・リサーチ・コーポレーションから入手可能なSABRE 3Dツールである。いくつかの実施形態では、電気めっきツールは、(同一または異なる金属を電着するための)複数のめっきセルと、個々のめっきセル間で基板を搬送するためのロボットツールとを備える。
図6には、うつ伏せの配向で第1の金属または第2の金属の電着に用いられうる装置の概略断面図を示す。この装置は、電解液603を保持するように構成されているめっき室601と、陽極605とを備える。基板ホルダ607は、半導体基板609をうつ伏せの配向で保持し、電気めっき中に基板609を回転させるように構成されている。基板ホルダ607はさらに、電気めっき中に基板を陰極(負)バイアスするように構成されている電気コンタクトを備える。図の実施形態では、装置はさらに、基板609付近(例えば、基板の約10mm以内)にイオン抵抗性イオン透過性要素611を備える。イオン抵抗性イオン透過性要素611は一般に、電解液の流れを可能にする複数の貫通流路または3D多孔性網を有する非導電性材料からなるプレートである。イオン抵抗性イオン透過性要素611は、半導体基板609のめっきの均一性を向上させるために用いられることが多い。めっき室601は、電解液の導入のための開口613を備える。図の実施形態では、電解液はめっき室の底部で導入され、次に矢印615で示すように、イオン抵抗性イオン透過性要素611の流路を通って半導体基板609に向かって流れる。他の実施形態では、電解液は、半導体基板609の加工面にほぼ垂直な電解液の流れに加えて、またはそれに代えて、半導体基板609の加工面にほぼ平行な方向で横方向に注入されうる。
いくつかの実施形態では、装置はさらに、陽極と陰極バイアスされた基板との間に、めっき室を陽極液室と陰極液室とに分離するイオン透過性部材を備える。陽極液室および陰極液室の電解液は、異なる組成を有してよい。例えば、スズ-銀の電着中に、陰極液はスズイオンおよび銀イオンの両方を含むが、陽極液はスズイオンのみを含んでよい。
いくつかの実施形態では、この装置はさらに、電解液を高温(例えば、少なくとも約30℃の温度)に維持するためにヒータおよび温度センサを備える。例えば、いくつかの実施形態では、ニッケルの電着に用いられる装置はヒータを有し、少なくとも約30℃の温度のニッケル電解液を用いて電気めっきするように構成されている。
いくつかの実施形態では、この装置はさらに、本明細書に記載の方法の工程を実施させるためのプログラム命令を有するコントローラを備える。
図7には、複数の金属を電着するように構成されている一体型装置が示されている。この実施形態では、装置700は電気めっきセル707のセットを有し、各々は対構造または複数の「二重」構造の電解液含有浴を含む。装置700は、電気めっき自体に加えて、様々な他の電気めっきまたは電気平坦化関連プロセスおよびサブステップ(例えば、スピンリンス、スピンドライ、金属およびシリコンのウェットエッチング、無電解めっき、プリウェットおよびプリケミカル処理、還元、アニール、フォトレジスト剥離、および表面予備活性化)を実施してよい。図7において、装置700は上面図を概略的に示され、1つのレベルまたは「フロア」のみが示されているが、かかる装置(例えば、ラム・リサーチ・コーポレーションのSabre(商標)3Dツール)が互いの上に「積層された」2つ以上のレベルを有してよく、各々が同一または異なる種類の処理ステーションを有してよいことは、当業者に容易に理解されるだろう。いくつかの実施形態では、異なる金属用の電気めっきステーションは、ツールの異なるレベルに配置される。他の実施形態では、第1の金属および第2の金属の両方を電気めっきするためのステーションを1つのレベルに備えてよい。
再び図7を参照すると、電気めっきされる基板706は一般に、フロントエンドローディングFOUP(前開き一体型ポッド)701を通じて装置700に提供され、この例では、フロントエンドロボット702によってFOUPから装置700の主基板処理領域に運び込まれる。フロントエンドロボット702は、スピンドル703によって1つのステーションから別のアクセス可能なステーション(この例では、2つのフロントエンドアクセス可能ステーション704および2つのフロントエンドアクセス可能ステーション708が示されている)に多次元で動かされた基板706を格納および移動できる。フロントエンドアクセス可能ステーション704および708は、例えば前処理ステーションおよびスピンリンスドライ(SRD)ステーションを含んでよい。フロントエンドロボット702の左右の横方向動作は、ロボットトラック702aを用いて実現される。各基板706は、モータ(図示せず)に接続されたスピンドルによって動かされるカップ/コーンアセンブリ(図示せず)によって保持されてよく、モータは取り付け金具709に取り付けられてよい。この例には、4つの「二重」電気めっきセル707(合計で8つのセル707)も示されている。電気めっきセル707は、第1の金属および第2の金属を電気めっきするために用いられてよい。めっきステーション707の1つにおいて第1の金属が電気めっきされた後に、基板は、装置700の同じレベルまたは異なるレベルの、第2の金属を電気めっきするように構成されているめっきセルに搬送される。システムコントローラ(図示せず)は、電着装置700のいくつかまたは全ての特性を制御するために電着装置700に結合されてよい。システムコントローラは、本明細書で前述したプロセスにより命令を実行するようにプログラムされてよい、または構成されてよい。
システムコントローラは一般に、1つ以上のメモリデバイスと、装置が本発明による方法を実施できるように命令を実行するように構成されている1つ以上のプロセッサとを備えるだろう。システムコントローラには、本発明によるプロセス動作を制御するための命令を含む機械可読媒体が結合されてよい。
いくつかの実施形態では、コントローラは、上記の例の一部でありうる、システムの一部である。かかるシステムは、処理ツール、チャンバ、処理用プラットフォーム、および/または特定の処理構成部品(ウエハ台座、ガス流システムなど)を含む半導体処理機器を備えることができる。これらのシステムは、半導体ウエハまたは基板の処理前、処理中、および処理後の動作を制御するための電子機器と一体化されてよい。これらの電子機器は、システムの様々な構成部品または副部品を制御できる「コントローラ」と呼ばれてよい。コントローラは、処理要件および/またはシステムの種類に応じて、電解液の供給、温度設定(例えば、加熱および/または冷却)、陰極に供給される圧力、特定のシステムに接続されたツールおよび他の搬送ツールおよび/またはロードロックに対するウエハ搬入出を含む、本明細書に開示のあらゆるプロセスを制御するようにプログラムされてよい。
概して、様々な実施形態において、コントローラは、命令を受信し、命令を発行し、動作を制御し、洗浄動作を可能にし、エンドポイント測定を可能にするなどの様々な集積回路、ロジック、メモリ、および/または、ソフトウェアを有する電子機器として定義されてよい。集積回路は、プログラム命令を記憶するファームウェア形式のチップ、デジタル信号プロセッサ(DSP)、特定用途向け集積回路(ASIC)として定義されるチップ、および/または、プログラム命令(例えば、ソフトウェア)を実行する1つ以上のマイクロプロセッサまたはマイクロコントローラを含む。プログラム命令は、半導体ウエハ上でもしくは半導体ウエハ向けに、またはシステムに対して特定のプロセスを実行するための動作パラメータを定義する様々な個別設定(または、プログラムファイル)の形でコントローラに伝達される命令であってよい。いくつかの実施形態では、動作パラメータは、1つ以上の層、材料、金属、酸化物、シリコン、二酸化シリコン、表面、回路、および/または、ウエハ金型の製造時における1つ以上の処理工程を実現するために、プロセスエンジニアによって定義されたレシピの一部であってよい。
いくつかの実施形態では、コントローラは、システムと一体化もしくは結合された、そうでなければシステムにネットワーク接続された、もしくはこれらが組み合わされたコンピュータの一部であってよい、またはそのコンピュータに結合されてよい。例えば、コントローラは、ウエハ処理のリモートアクセスを可能にする「クラウド」内にある、またはファブホストコンピュータシステムの全てもしくは一部であってよい。コンピュータは、システムへのリモートアクセスを可能にして、製造動作の進捗状況を監視し、過去の製造動作の経歴を調査し、複数の製造動作から傾向または性能の基準を調査して、現行の処理のパラメータを変更してよい、または現行の処理に続く処理工程を設定してよい、または新しいプロセスを開始してよい。いくつかの例では、リモートコンピュータ(例えば、サーバ)は、ローカルネットワークまたはインターネットを含みうるネットワークを通じて、プロセスレシピをシステムに提供できる。リモートコンピュータは、次にリモートコンピュータからシステムに伝達されるパラメータおよび/もしくは設定のエントリまたはプログラミングを可能にするユーザインタフェースを含んでよい。いくつかの例では、コントローラは、1つ以上の動作中に実施される各処理工程のパラメータを特定する命令をデータ形式で受信する。パラメータは、実施されるプロセスの種類、および、コントローラが接続するまたは制御するツールの種類に固有であってよいことを理解されたい。よって、上述のように、コントローラは、例えば互いにネットワーク接続された1つ以上の別々のコントローラを含むことと、本明細書に記載のプロセスおよび制御などの共通の目的に向けて協働することとにより分散されてよい。かかる目的で分散されたコントローラの例は、遠隔に(例えば、プラットフォームレベルで、またはリモートコンピュータの一部として)位置し、協働してチャンバにおけるプロセスを制御する1つ以上の集積回路と連通するチャンバ上の1つ以上の集積回路だろう。
制限するものではないが、システムの例は、プラズマエッチングチャンバまたはプラズマエッチングモジュール、堆積チャンバまたは堆積モジュール、スピンリンスチャンバまたはスピンリンスモジュール、金属めっきチャンバまたは金属めっきモジュール、洗浄チャンバまたは洗浄モジュール、ベベルエッジエッチングチャンバまたはベベルエッジエッチングモジュール、物理蒸着(PVD)チャンバまたはPVDモジュール、化学蒸着(CVD)チャンバまたはCVDモジュール、原子層堆積(ALD)チャンバまたはALDモジュール、原子層エッチング(ALE)チャンバまたはALEモジュール、イオン注入チャンバまたはイオン注入モジュール、トラックチャンバまたはトラックモジュール、ならびに、半導体ウエハの製作および/または製造において関連または使用できる任意の他の半導体処理システムを含んでよい。
上記のように、コントローラは、ツールによって実施されるプロセス工程に応じて、他のツール回路もしくはモジュール、他のツール部品、クラスタツール、他のツールインタフェース、隣接するツール、近接するツール、工場全体に設置されたツール、メインコンピュータ、別のコントローラ、または、半導体製造工場においてツール位置および/もしくはロードポートに対してウエハ容器を搬入出する材料搬送に用いられるツール、のうちの1つ以上と連通してよい。
パターニング法/装置
パターニング法/装置
本明細書に上記した装置/プロセスは、例えば、半導体デバイス、表示装置、LED、太陽電池パネルなどの製作または製造のために、リソグラフィパターニングツールまたはプロセスと併せて用いられてよい。通常、必ずではないが、かかるツール/プロセスは、共通の製作設備で一緒に用いられる、または実施されるだろう。膜のリソグラフィパターニングは通常、(1)スピンオンツールまたはスプレイオンツールを用いてワークピース(すなわち、基板)にフォトレジストを塗布する工程、(2)ホットプレート、炉、またはUV硬化ツールを用いてフォトレジストを硬化させる工程、(3)ウエハステッパなどのツールによって可視光、UV光、EUV光、またはX線光にフォトレジストを露光する工程、(4)ウェットベンチなどのツールを用いて、レジストを現像して選択的に除去することによりレジストをパターニングする工程、(5)ドライエッチングツールまたはプラズマ支援エッチングツールを用いて、下地膜またはワークピースにレジストパターンを転写する工程、および(6)RFまたはマイクロ波プラズマレジスト剥離剤などのツールを用いてレジストを除去する工程、のいくつかまたは全てを含み、各工程はいくつかの可能なツールで行われる。
Claims (20)
- 複数のスルーマスク凹状フィーチャを有する半導体基板に金属を電着する方法であって、
(a)第1のリップシールを用いる第1の電気めっきセル内で、前記半導体基板の前記凹状スルーマスクフィーチャを完全に充填することなく前記凹状スルーマスクフィーチャに第1の金属を電着し、前記第1のリップシールは、前記半導体基板の周囲で前記半導体基板に接触し、前記第1のリップシールと前記半導体基板との最内接点は、前記半導体基板の端から第1の距離に位置し、
(b)(a)の後に、第2のリップシールを用いる第2の電気めっきセル内で、前記半導体基板の前記凹状スルーマスクフィーチャに第2の金属を電着することを備え、前記第2のリップシールは、前記半導体基板の周囲で前記半導体基板に接触し、前記第2のリップシールと前記半導体基板との最内接点は、前記半導体基板の前記端から第2の距離に位置し、前記第2の距離は、前記第1の距離よりも長い、方法。 - 請求項1に記載の方法であって、
前記第2の距離は、前記第1の距離よりも約0.1~0.5mmだけ長い、方法。 - 請求項1に記載の方法であって、
前記第2の距離は、前記第1の距離よりも約0.15~0.25mmだけ長い、方法。 - 請求項1に記載の方法であって、
前記第1のリップシールおよび前記第2のリップシールは、前記半導体基板上のフォトレジスト材料と接触する、方法。 - 請求項1から4のいずれかに記載の方法であって、
前記第1の金属は、25℃よりも高い温度を有するめっき浴で電着される、方法。 - 請求項1から4のいずれかに記載の方法であって、
前記第1の金属は、40℃よりも高い温度を有するめっき浴で電着される、方法。 - 請求項1から4のいずれかに記載の方法であって、
前記第1の金属はニッケルであり、前記ニッケルは、25℃よりも高い温度を有するめっき浴で電着される、方法。 - 請求項1から4のいずれかに記載の方法であって、
前記第1の金属はニッケルであり、前記ニッケルは、40℃よりも高い温度を有するめっき浴で電着される、方法。 - 請求項1から4のいずれかに記載の方法であって、
前記第1の金属はニッケルであり、前記第2の金属は、スズまたはスズと銀との化合物である、方法。 - 請求項1から4のいずれかに記載の方法であって、
前記第1の金属はニッケルであり、前記第2の金属は、スズまたはスズと銀との化合物であり、前記方法は、さらに、ニッケルの電着前に前記凹状スルーマスクフィーチャに銅を電着することを備える、方法。 - 請求項1から4のいずれかに記載の方法であって、
(b)における電着は、マスク材料のレベルより上に前記電着した第2の金属の突起をもたらさない、方法。 - 請求項1から4のいずれかに記載の方法であって、
前記第1のリップシールおよび前記第2のリップシールは異なるリップシールであり、前記第2のリップシールは、前記第1のリップシールよりも小さい直径を有する、方法。 - 請求項1から4のいずれかに記載の方法であって、
前記第1のリップシールおよび前記第2のリップシールは、異なる位置で前記基板と接触するように調節されるよう構成されている同じリップシールである、方法。 - 請求項1から4のいずれかに記載の方法であって、
前記半導体基板は、半製品高帯域幅メモリ(HBM)デバイスである、方法。 - 請求項1から4のいずれかに記載の方法であって、さらに、
(a)の後に、前記半導体基板を前記第1のリップシールとの接触から解放し、(b)の前に少なくとも1時間にわたって、前記半導体基板をリップシールと接触しないままにすることを備える、方法。 - 請求項1から4のいずれかに記載の方法であって、さらに、
前記半導体基板にフォトレジストを塗布する工程と、
前記フォトレジストを露光する工程と、
前記フォトレジストをパターニングし、前記パターンを前記半導体基板に転写する工程と、
前記半導体基板から前記フォトレジストを選択的に除去する工程と、
を備える、方法。 - 前記半導体基板に金属を電気めっきするためのシステムであって、
(a)前記半導体基板に第1の金属を電着するように構成され、第1のリップシールを有する基板ホルダを備える第1の電気めっき装置と、
(b)前記半導体基板に第2の金属を電着するように構成され、第2のリップシールを有する基板ホルダを備える第2の電気めっき装置と、前記第2のリップシールは、前記第1のリップシールよりも小さい直径を有し、
(c)コントローラであって、
i.前記半導体基板上のスルーマスク凹状フィーチャを部分的に充填するために、前記第1の電気めっき装置において前記第1の金属を電気めっきする工程と、
ii.前記第1の金属が電気めっきされた後に、前記第2の電気めっき装置において前記第2の金属を電気めっきする工程と、
が生じるように構成されているプログラム命令を含む、コントローラと、
を備える、システム。 - 前記半導体基板に金属を電気めっきするためのシステムであって、
(a)加熱電解液から前記半導体基板に第1の金属を電着するように構成され、第1のリップシールを有する基板ホルダを備える第1の電気めっき装置と、
(b)非加熱電解液から前記半導体基板に第2の金属を電着するように構成され、第2のリップシールを有する基板ホルダを備える第2の電気めっき装置とを備え、前記第2のリップシールは、前記第1のリップシールよりも小さい直径を有する、システム。 - 請求項18に記載のシステムであって、
前記第1のリップシールの半径と前記第2のリップシールの半径との差は、約0.1~0.5mmである、システム。 - 請求項1に記載の方法であって、
前記第1のリップシールの半径と前記第2のリップシールの半径との差は、約0.15~0.25mmである、方法。
Applications Claiming Priority (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US202063018365P | 2020-04-30 | 2020-04-30 | |
US63/018,365 | 2020-04-30 | ||
PCT/US2021/026248 WO2021221872A1 (en) | 2020-04-30 | 2021-04-07 | Lipseal edge exclusion engineering to maintain material integrity at wafer edge |
Publications (1)
Publication Number | Publication Date |
---|---|
JP2023523946A true JP2023523946A (ja) | 2023-06-08 |
Family
ID=78373846
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2022564502A Pending JP2023523946A (ja) | 2020-04-30 | 2021-04-07 | ウエハエッジにおける材料特性を維持するためのリップシールエッジエクスクルージョン処理 |
Country Status (6)
Country | Link |
---|---|
US (1) | US20230167571A1 (ja) |
JP (1) | JP2023523946A (ja) |
KR (1) | KR20230006883A (ja) |
CN (1) | CN115516140A (ja) |
TW (1) | TW202230482A (ja) |
WO (1) | WO2021221872A1 (ja) |
Family Cites Families (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6855037B2 (en) * | 2001-03-12 | 2005-02-15 | Asm-Nutool, Inc. | Method of sealing wafer backside for full-face electrochemical plating |
US7735451B2 (en) * | 2002-11-15 | 2010-06-15 | Ebara Corporation | Substrate processing method and apparatus |
US9512538B2 (en) * | 2008-12-10 | 2016-12-06 | Novellus Systems, Inc. | Plating cup with contoured cup bottom |
KR101581276B1 (ko) * | 2014-09-26 | 2016-01-04 | 주식회사 티케이씨 | 박형화 웨이퍼의 도금시 에지 부분의 손상 방지를 위한 웨이퍼 취급장치 |
JP7162341B2 (ja) * | 2018-01-11 | 2022-10-28 | オリエンタル鍍金株式会社 | めっき積層体の製造方法及びめっき積層体 |
-
2021
- 2021-04-07 US US17/997,170 patent/US20230167571A1/en active Pending
- 2021-04-07 KR KR1020227041848A patent/KR20230006883A/ko active Search and Examination
- 2021-04-07 CN CN202180031832.8A patent/CN115516140A/zh active Pending
- 2021-04-07 WO PCT/US2021/026248 patent/WO2021221872A1/en active Application Filing
- 2021-04-07 JP JP2022564502A patent/JP2023523946A/ja active Pending
- 2021-04-27 TW TW110115031A patent/TW202230482A/zh unknown
Also Published As
Publication number | Publication date |
---|---|
US20230167571A1 (en) | 2023-06-01 |
CN115516140A (zh) | 2022-12-23 |
TW202230482A (zh) | 2022-08-01 |
KR20230006883A (ko) | 2023-01-11 |
WO2021221872A1 (en) | 2021-11-04 |
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