JP2023179206A - Power supply device and image forming device - Google Patents

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Shuntaro Nakayama
崇彦 長谷川
Takahiko Hasegawa
淳一 佐々木
Junichi Sasaki
健太朗 梶田
Kentaro Kajita
洸三郎 鈴木
Kozaburo Suzuki
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Abstract

To provide a power supply device to be protected by appropriately controlling discharge time of a gate of a first transistor when the first transistor is turned off.SOLUTION: A power supply device includes: a first converter unit that generates a first voltage according to an input voltage regardless of a first mode and a second mode; a first transistor that is turned on during the first mode to output the first voltage as a second voltage and is turned off during the second mode to stop the output from the second voltage; a second converter that generates a third voltage during the first mode and stops generating the third voltage during the second mode; and a gate control unit that turns off the first transistor by conducting a discharge path connected to the gate of the first transistor in response to a decrease in the third voltage during the second voltage is outputted and suppresses conduction of the discharge path in response to a decrease in the third voltage while the output of the second voltage is stopped.SELECTED DRAWING: Figure 1

Description

本発明は、電源装置および画像形成装置に関する。 The present invention relates to a power supply device and an image forming apparatus.

電源と負荷との間に接続され、負荷に供給する電源をオンまたはオフする半導体スイッチを有する電源装置が知られている。この種の電源装置では、負荷への出力電流と半導体スイッチをオンした後の経過時間に応じて半導体スイッチを制御することで、半導体スイッチが保護される(例えば、特許文献1参照)。 2. Description of the Related Art A power supply device is known that includes a semiconductor switch that is connected between a power supply and a load and turns on or off the power supplied to the load. In this type of power supply device, the semiconductor switch is protected by controlling the semiconductor switch according to the output current to the load and the elapsed time after the semiconductor switch is turned on (for example, see Patent Document 1).

しかしながら、半導体スイッチのゲート電圧を、半導体スイッチをオフするレベルに設定するまでに掛かるゲートの放電時間によっては、半導体スイッチを含む電源装置を誤動作または故障から保護できないおそれがある。 However, depending on the gate discharge time required to set the gate voltage of the semiconductor switch to a level that turns off the semiconductor switch, there is a possibility that the power supply device including the semiconductor switch cannot be protected from malfunction or failure.

上記の課題に鑑み、本発明は、第1トランジスタがオフする場合の第1トランジスタのゲートの放電時間を適切に制御することで、電源装置を保護することを目的とする。 In view of the above problems, an object of the present invention is to protect a power supply device by appropriately controlling the discharge time of the gate of the first transistor when the first transistor is turned off.

上記技術的課題を解決するため、本発明の一形態の電源装置は、第1モードおよび第2モードにかかわりなく入力電圧に応じて第1電圧を生成する第1コンバータ部と、前記第1モード中にオンして前記第1電圧を第2電圧として出力し、前記第2モード中にオフして前記第2電圧の出力を停止する第1トランジスタと、前記第1モード中に第3電圧を生成し、前記第2モード中に第3電圧の生成を停止する第2コンバータ部と、前記第2電圧の出力中、前記第3電圧の低下に応じて前記第1トランジスタのゲートに接続される放電経路を導通させて前記第1トランジスタをオフし、前記第2電圧の出力の停止中、前記第3電圧の低下に応じた前記放電経路の導通を抑制するゲート制御部と、を有することを特徴とする。 In order to solve the above technical problem, a power supply device according to one embodiment of the present invention includes: a first converter section that generates a first voltage according to an input voltage regardless of the first mode and the second mode; a first transistor that is turned on during the mode to output the first voltage as a second voltage, and turned off during the second mode to stop outputting the second voltage; and a first transistor that outputs the first voltage as a second voltage during the second mode; a second converter unit that generates a third voltage and stops generating a third voltage during the second mode; and a second converter unit that is connected to the gate of the first transistor in response to a decrease in the third voltage while outputting the second voltage. and a gate control unit that makes the discharge path conductive, turns off the first transistor, and suppresses conduction of the discharge path in response to a decrease in the third voltage while outputting the second voltage is stopped. Features.

第1トランジスタがオフする場合の第1トランジスタのゲートの放電時間を適切に制御することで、電源装置を保護することができる。 By appropriately controlling the discharge time of the gate of the first transistor when the first transistor is turned off, the power supply device can be protected.

本発明の一実施形態に係る電源装置の一例を示す回路ブロック図である。FIG. 1 is a circuit block diagram showing an example of a power supply device according to an embodiment of the present invention. 図1のコンバータ部の一例を示す回路ブロック図である。FIG. 2 is a circuit block diagram showing an example of a converter section in FIG. 1. FIG. 他の電源装置の一例を示す回路ブロック図である。FIG. 3 is a circuit block diagram showing an example of another power supply device. 図1および図3の電源装置の動作の一例を示すタイミング図である。4 is a timing chart showing an example of the operation of the power supply device of FIGS. 1 and 3. FIG. 図1の電源装置の動作の別の例を示すタイミング図である。2 is a timing chart showing another example of the operation of the power supply device of FIG. 1. FIG. 本発明の別の実施形態に係る電源装置の一例を示す回路ブロック図である。FIG. 3 is a circuit block diagram showing an example of a power supply device according to another embodiment of the present invention. 図6の電源装置の動作の一例を示すタイミング図である。7 is a timing chart showing an example of the operation of the power supply device of FIG. 6. FIG. 図1および図6の電源装置が搭載される画像形成装置の一例を示す全体構成図である。7 is an overall configuration diagram showing an example of an image forming apparatus in which the power supply device of FIGS. 1 and 6 is installed. FIG.

以下、図面を用いて実施形態を説明する。以下では、電圧が伝達される電圧線には、電圧名と同じ符号を使用し、信号が伝達される信号線には、信号名と同じ符号を使用する。各図面において、同一構成部分には同一符号を付し、重複した説明を省略する場合がある。 Hereinafter, embodiments will be described using the drawings. In the following, the same symbols as the voltage names are used for voltage lines through which voltages are transmitted, and the same symbols as the signal names are used for signal lines through which signals are transmitted. In each drawing, the same components are given the same reference numerals, and redundant explanations may be omitted.

図1は、本発明の一実施形態に係る電源装置の一例を示す回路ブロック図である。図1に示す電源装置100は、商用電源等の交流電源ACから供給される交流電圧Vinを使用して複数種の直流電圧DC5X、DC5、DC24を生成して負荷に出力する機能を有する。直流電圧DC5Xは、第1電圧の一例であり、例えば5Vである。直流電圧DC5は、第2電圧の一例であり、例えば5Vである。直流電圧DC24は、第3電圧の一例であり、例えば24Vである。
電源装置100は、平滑部20、コンバータ部30、電力供給部40、コンバータ部50、放電部60、トランジスタQ1、Q2、抵抗素子R1、R2、R3、ダイオードD1、D2およびコンデンサC2を有する。特に限定されないが、例えば、トランジスタQ1、Q2は、nチャネル型の絶縁ゲート電界効果トランジスタである。コンバータ部30は、第1コンバータ部の一例であり、コンバータ部50は、第2コンバータ部の一例である。
FIG. 1 is a circuit block diagram showing an example of a power supply device according to an embodiment of the present invention. The power supply device 100 shown in FIG. 1 has a function of generating a plurality of types of DC voltages DC5X, DC5, and DC24 using an AC voltage Vin supplied from an AC power source AC such as a commercial power source, and outputting the generated DC voltages to a load. The direct current voltage DC5X is an example of the first voltage, and is, for example, 5V. The direct current voltage DC5 is an example of the second voltage, and is, for example, 5V. The direct current voltage DC24 is an example of the third voltage, and is, for example, 24V.
Power supply device 100 includes smoothing section 20, converter section 30, power supply section 40, converter section 50, discharge section 60, transistors Q1, Q2, resistance elements R1, R2, R3, diodes D1, D2, and capacitor C2. Although not particularly limited, for example, the transistors Q1 and Q2 are n-channel type insulated gate field effect transistors. Converter section 30 is an example of a first converter section, and converter section 50 is an example of a second converter section.

平滑部20は、交流電圧Vinを全波整流するダイオードブリッジDBと、全波整流した電圧を平滑化するコンデンサC1とを有し、平滑化により生成した直流電圧を出力する。コンバータ部30は、平滑部20から出力される直流電圧から直流電圧DC5Xを生成する。 The smoothing unit 20 includes a diode bridge DB that performs full-wave rectification on the AC voltage Vin, and a capacitor C1 that smoothes the full-wave rectified voltage, and outputs a DC voltage generated by the smoothing. Converter unit 30 generates DC voltage DC5X from the DC voltage output from smoothing unit 20.

電力供給部40は、省エネ信号ECOが通常モードを示す場合、コンバータ部30から受ける定電圧をコンバータ部50に供給する。電力供給部40は、省エネ信号ECOが省エネルギーモードを示す場合、コンバータ部30から受ける定電圧のコンバータ部50への供給を停止する。通常モードは、第1モードの一例であり、省エネルギーモードは、第2モードの一例である。例えば、省エネ信号ECOは、通常モード中にロウレベルに設定され、省エネルギーモード中にハイレベルに設定される。以下では、省エネルギーモードは、省エネモードとも称される。 The power supply section 40 supplies the constant voltage received from the converter section 30 to the converter section 50 when the energy saving signal ECO indicates the normal mode. When the energy saving signal ECO indicates the energy saving mode, the power supply section 40 stops supplying the constant voltage received from the converter section 30 to the converter section 50 . The normal mode is an example of the first mode, and the energy saving mode is an example of the second mode. For example, the energy saving signal ECO is set to low level during normal mode, and set to high level during energy saving mode. In the following, the energy saving mode is also referred to as energy saving mode.

コンバータ部50は、電力供給部40から定電圧を受けている間に動作し、平滑部20から出力される直流電圧から直流電圧DC24を生成する。コンバータ部50は、電力供給部40から定電圧を受けない場合、直流電圧DC24の生成動作を停止する。すなわち、コンバータ部50は、通常モード中に直流電圧DC24を生成し、省エネモード中に直流電圧DC24の生成を停止する。 Converter section 50 operates while receiving constant voltage from power supply section 40 and generates direct current voltage DC24 from the direct current voltage output from smoothing section 20. When converter section 50 does not receive constant voltage from power supply section 40, converter section 50 stops generating operation of direct current voltage DC24. That is, the converter section 50 generates the DC voltage DC24 during the normal mode, and stops generating the DC voltage DC24 during the energy saving mode.

トランジスタQ1のゲートは、抵抗素子R1、R2およびダイオードD2を介して直流電圧線DC24に接続される。ダイオードD2は、アノードが直流電圧線DC24に接続され、カソードが抵抗素子R2に接続される。トランジスタQ1のドレインは直流電圧線DC5Xに接続され、トランジスタQ1のソースは、直流電圧線DC5に接続される。トランジスタQ1は、ゲートでハイレベルを受けているときにオンし、直流電圧線DC5Xを直流電圧線DC5に接続して、直流電圧DC5を生成する。例えば、トランジスタQ1は、コンバータ部50が直流電圧DC24を生成したことに基づいてオンし、直流電圧DC24が生成されている間にオンし続ける。 The gate of transistor Q1 is connected to DC voltage line DC24 via resistance elements R1, R2 and diode D2. The diode D2 has an anode connected to the DC voltage line DC24 and a cathode connected to the resistance element R2. The drain of transistor Q1 is connected to DC voltage line DC5X, and the source of transistor Q1 is connected to DC voltage line DC5. Transistor Q1 turns on when receiving a high level at its gate, connects DC voltage line DC5X to DC voltage line DC5, and generates DC voltage DC5. For example, transistor Q1 is turned on based on converter section 50 generating direct current voltage DC24, and continues to be turned on while direct current voltage DC24 is being generated.

トランジスタQ1は、ゲートでロウレベルを受けているときにオフし、直流電圧線DC5Xと直流電圧線DC5との接続を遮断し、直流電圧DC5の生成を停止する。例えば、トランジスタQ1は、コンバータ部50が直流電圧DC24の生成を停止したことに基づいてオフし、直流電圧DC24の生成が停止されている間にオフし続ける。トランジスタQ1は、第1トランジスタの一例である。 Transistor Q1 turns off when receiving a low level at its gate, cuts off the connection between DC voltage line DC5X and DC voltage line DC5, and stops generating DC voltage DC5. For example, transistor Q1 is turned off based on converter section 50 stopping generation of direct current voltage DC24, and continues to be turned off while generation of direct current voltage DC24 is stopped. Transistor Q1 is an example of a first transistor.

電源装置100は、交流電圧Vinを受けている間、直流電圧DC5Xを常時出力する。電源装置100は、交流電圧Vinを受けている間で通常モード中に直流電圧DC24を出力し、トランジスタQ1をオンさせることで直流電圧DC5を出力する。電源装置100は、交流電圧Vinを受けている間で省エネモード中に直流電圧DC24、DC5の出力を停止する。 The power supply device 100 constantly outputs a direct current voltage DC5X while receiving the alternating current voltage Vin. The power supply device 100 outputs the DC voltage DC24 in the normal mode while receiving the AC voltage Vin, and outputs the DC voltage DC5 by turning on the transistor Q1. The power supply device 100 stops outputting the DC voltages DC24 and DC5 in the energy saving mode while receiving the AC voltage Vin.

このように、電源装置100は、通常モード中、コンバータ部30が生成する直流電圧を2系統に分岐して直流電圧DC5X、DC5として出力する。例えば、直流電圧DC5Xを動作電源として受ける負荷は、動作モードを制御するために常時動作する制御回路を有する。例えば、直流電圧DC5を動作電源として受ける負荷は、通常モード中のみ動作する制御回路を有する。例えば、直流電圧DC24を動作電源として受ける負荷は、通常モード中のみ動作する駆動機構等を有する。 In this manner, during the normal mode, power supply device 100 branches the DC voltage generated by converter section 30 into two systems and outputs them as DC voltages DC5X and DC5. For example, a load that receives direct current voltage DC5X as an operating power source has a control circuit that is constantly operating to control the operating mode. For example, a load that receives direct current voltage DC5 as its operating power source has a control circuit that operates only during normal mode. For example, a load that receives direct current voltage DC24 as an operating power source has a drive mechanism or the like that operates only in the normal mode.

コンデンサC2、抵抗素子R3およびトランジスタQ2は、抵抗素子R1、R2の接続ノードであるノードND1と接地線VSSとの間に並列に接続される。トランジスタQ2は、通常モード中、ゲートでロウレベルの省エネ信号ECOを受けてオフする。トランジスタQ2は、省エネモード中、ゲートでハイレベルの省エネ信号ECOを受けてオンし、ノードND1およびトランジスタQ1のゲートを接地線VSSに接続する。 Capacitor C2, resistance element R3, and transistor Q2 are connected in parallel between node ND1, which is a connection node between resistance elements R1 and R2, and ground line VSS. During the normal mode, transistor Q2 receives a low-level energy saving signal ECO at its gate and is turned off. During the energy saving mode, transistor Q2 is turned on upon receiving a high-level energy saving signal ECO at its gate, and connects node ND1 and the gate of transistor Q1 to ground line VSS.

例えば、省エネ信号ECOは、直流電圧DC5Xを受けて動作モードを制御するために動作する制御回路により生成され、電源装置100に出力される。電源装置100は、省エネモード中、コンバータ部50の動作を停止し、コンバータ部30から負荷への直流電圧DC5の供給を停止する。また、電源装置100が搭載されるシステムは、省エネモード中、直流電圧DC5、DC24を受ける負荷の動作を停止する。 For example, the energy saving signal ECO is generated by a control circuit that receives the direct current voltage DC5X and operates to control the operation mode, and is output to the power supply device 100. During the energy saving mode, power supply device 100 stops the operation of converter section 50 and stops supplying direct current voltage DC5 from converter section 30 to the load. Further, the system in which the power supply device 100 is installed stops the operation of the load receiving the direct current voltages DC5 and DC24 during the energy saving mode.

これにより、省エネモード中、電源装置100およびシステムの消費電力が低減される。このように、電源装置100は、省エネ信号ECOの論理レベルに応じて、直流電圧DC5Xのみ出力する消費電力の小さい省エネ状態と、直流電圧DC5X、DC5、DC24の全てを出力する消費電力の大きい稼働状態とに切り替えることができる。 This reduces the power consumption of the power supply device 100 and the system during the energy saving mode. In this way, the power supply device 100 can operate in a low power consumption energy saving state in which only the DC voltage DC5X is output, and in a high power consumption operation state in which all of the DC voltages DC5X, DC5, and DC24 are output, depending on the logic level of the energy saving signal ECO. You can switch between states.

放電部60は、ノードND1と直流電圧線DC24との間に直列に接続されるダイオードD1およびトランジスタTr1(NPN型バイポーラトランジスタ)を有する。ダイオードD1は、アノードがノードND1に接続され、カソードがトランジスタTr1のコレクタに接続される。ダイオードD1およびトランジスタTr1は、ノードND1(すなわち、トランジスタQ1のゲート)と直流電圧線DC24との間に形成される放電経路の一例である。 The discharge section 60 includes a diode D1 and a transistor Tr1 (NPN bipolar transistor) connected in series between the node ND1 and the DC voltage line DC24. The diode D1 has an anode connected to the node ND1 and a cathode connected to the collector of the transistor Tr1. Diode D1 and transistor Tr1 are an example of a discharge path formed between node ND1 (ie, the gate of transistor Q1) and DC voltage line DC24.

トランジスタTr1のベースは、直流電圧線DC5に接続される。トランジスタTr1は、直流電圧DC5が正常値(例えば、5V)の場合にオンする。これにより、トランジスタQ1のゲートから直流電圧線DC24への放電経路が導通される。 The base of the transistor Tr1 is connected to a DC voltage line DC5. The transistor Tr1 is turned on when the direct current voltage DC5 is a normal value (eg, 5V). As a result, the discharge path from the gate of transistor Q1 to DC voltage line DC24 is made conductive.

例えば、コンバータ部50が、直流電圧DC24を正常に生成している場合、トランジスタQ1のゲートおよびノードND1は、抵抗素子R3の抵抗値を抵抗素子R2の抵抗値よりも十分大きく設定することで、直流電圧DC24に設定されるため、放電部60による放電は行われない。 For example, when the converter unit 50 normally generates the direct current voltage DC24, the gate of the transistor Q1 and the node ND1 can be set by setting the resistance value of the resistance element R3 to be sufficiently larger than the resistance value of the resistance element R2. Since the direct current voltage is set to DC24, no discharge is performed by the discharge section 60.

直流電圧DC5が正常値のときにコンバータ部50が動作を停止し、直流電圧DC24が接地電圧VSSに向けて低下した場合、放電部60を介した放電により、トランジスタQ1のゲート電圧は急速に低下する(放電機能の有効状態)。これにより、トランジスタQ1はオフし、直流電圧DC5の生成は停止される。 When the converter unit 50 stops operating when the DC voltage DC5 is at a normal value and the DC voltage DC24 decreases toward the ground voltage VSS, the gate voltage of the transistor Q1 rapidly decreases due to discharge through the discharge unit 60. (discharge function enabled state). As a result, transistor Q1 is turned off and generation of direct current voltage DC5 is stopped.

直流電圧線DC5が短絡により0Vになった場合、トランジスタTr1はオフし、放電部60によるトランジスタQ1のゲートと直流電圧線DC24との放電経路は遮断される(放電機能の無効状態)。 When the DC voltage line DC5 becomes 0V due to a short circuit, the transistor Tr1 is turned off, and the discharge path between the gate of the transistor Q1 and the DC voltage line DC24 by the discharge section 60 is cut off (the discharge function is disabled).

このように、放電部60は、直流電圧DC5の生成状態に応じて、トランジスタQ1のゲートの放電経路を有効または無効に切り替える機能を有する。放電部60は、直流電圧DC5の出力中、直流電圧DC24の低下に応じてトランジスタQ1のゲートを放電させてトランジスタQ1をオフするゲート制御部の一例である。また、放電部60は、直流電圧DC5の出力の停止中、直流電圧DC24の低下に応じたトランジスタQ1のゲートの放電を抑制するゲート制御部の一例である。 In this way, the discharge unit 60 has a function of switching the discharge path of the gate of the transistor Q1 between enabled and disabled depending on the generation state of the direct current voltage DC5. The discharge unit 60 is an example of a gate control unit that discharges the gate of the transistor Q1 and turns off the transistor Q1 in response to a decrease in the DC voltage DC24 while the DC voltage DC5 is being output. Further, the discharge unit 60 is an example of a gate control unit that suppresses discharge of the gate of the transistor Q1 in response to a decrease in the DC voltage DC24 while the output of the DC voltage DC5 is stopped.

図2は、図1のコンバータ部30、50の一例を示す回路ブロック図である。コンバータ部30は、トランスT1と、トランジスタQ3と、パルス幅決定部32および電流検出部33を含む制御部31と、定電圧生成部34と、出力フィードバック部35と、平滑部36とを有し、フライバックコンバータとして動作する。 FIG. 2 is a circuit block diagram showing an example of the converter sections 30 and 50 of FIG. 1. The converter section 30 includes a transformer T1, a transistor Q3, a control section 31 including a pulse width determining section 32 and a current detecting section 33, a constant voltage generating section 34, an output feedback section 35, and a smoothing section 36. , operates as a flyback converter.

制御部31は、トランスT1の補助巻き線からの電力を受けて動作する。制御部31の電流検出部33は、トランスT1の1次側の電流を検出する。出力フィードバック部35は、トランスT1の2次側の出力電圧を制御部31にフィードバックする。 The control unit 31 operates by receiving power from the auxiliary winding of the transformer T1. The current detection unit 33 of the control unit 31 detects the current on the primary side of the transformer T1. The output feedback section 35 feeds back the output voltage on the secondary side of the transformer T1 to the control section 31.

制御部31は、1次側の電流検出結果と2次側の出力電圧のフィードバック結果とに基づいて、トランジスタQ3への印加電圧のパルス幅をパルス幅決定部32により決定する。また、制御部31は、電流検出部33が閾値を超える電流を検出した場合、パルス幅を0にすることで、トランジスタQ3のスイッチング動作を停止する。さらに、制御部31は、電流検出部33が閾値を超える電流を検出している時間が一定時間を経過した場合、ラッチ停止する。 The control unit 31 uses the pulse width determining unit 32 to determine the pulse width of the voltage applied to the transistor Q3 based on the primary side current detection result and the secondary side output voltage feedback result. Further, when the current detection unit 33 detects a current exceeding the threshold value, the control unit 31 sets the pulse width to 0 to stop the switching operation of the transistor Q3. Further, the control unit 31 latches and stops when the current detection unit 33 detects a current exceeding the threshold value for a certain period of time.

コンバータ部50は、制御部51および主回路52を有する。制御部51は、通常モード中、コンバータ部30のトランス補助巻き線からの電力を電力供給部40を介して受けることで動作し、主回路52の動作を制御する。主回路52は、制御部51による制御を受け、平滑部20から出力される直流電圧を使用して直流電圧DC24を生成する。 Converter section 50 has a control section 51 and a main circuit 52. During the normal mode, the control section 51 operates by receiving power from the transformer auxiliary winding of the converter section 30 via the power supply section 40, and controls the operation of the main circuit 52. The main circuit 52 is controlled by the control unit 51 and generates a DC voltage DC24 using the DC voltage output from the smoothing unit 20.

制御部51は、例えば、主回路52が生成する直流電圧DC24を分圧した電圧が参照電圧に近づくように主回路52をフィードバック制御する。なお、省エネモード中、電力供給部40からの電力の供給が停止される制御部51は、動作を停止する。このため、省エネモード中、制御部51による主回路52のフィードバック制御は停止され、主回路52による直流電圧DC24の生成は停止される。 For example, the control unit 51 performs feedback control on the main circuit 52 so that the voltage obtained by dividing the direct current voltage DC24 generated by the main circuit 52 approaches the reference voltage. Note that during the energy saving mode, the control unit 51, to which the power supply from the power supply unit 40 is stopped, stops operating. Therefore, during the energy saving mode, feedback control of the main circuit 52 by the control unit 51 is stopped, and generation of the direct current voltage DC24 by the main circuit 52 is stopped.

図3は、他の電源装置の一例を示す回路ブロック図である。図1と同一または同様の要素については、詳細な説明は省略する。図3に示す電源装置200は、平滑部20、コンバータ部30、電力供給部40、コンバータ部50、トランジスタQ1、Q2、抵抗素子R1、R2、R3、ダイオードD2、コンデンサC2、電流検出部70および停止部80を有する。電源装置200において、電流検出部70および停止部80を除く構成および接続関係は、図1の放電部60を持たないことを除き、図1の電源装置100と同様である。 FIG. 3 is a circuit block diagram showing an example of another power supply device. Detailed description of elements that are the same or similar to those in FIG. 1 will be omitted. The power supply device 200 shown in FIG. 3 includes a smoothing section 20, a converter section 30, a power supply section 40, a converter section 50, transistors Q1, Q2, resistance elements R1, R2, R3, a diode D2, a capacitor C2, a current detection section 70, and It has a stop part 80. In the power supply device 200, the configuration and connection relationship excluding the current detection section 70 and the stop section 80 are the same as those of the power supply device 100 of FIG. 1, except that the discharge section 60 of FIG. 1 is not included.

電流検出部70は、直流電圧線DC5に接続され、トランジスタQ1の出力電流を検出する。停止部80は、トランジスタQ1がオンされてから所定時間が経過するまでトランジスタQ1のゲート電圧の制御を保留する機能を有する。しかしながら、電源装置200は、直流電圧DC24の停止時にトランジスタQ1のゲートの放電時間を制御しない。このため、例えば、交流電圧Vinの瞬断が発生したときにトランジスタQ1のゲート電圧を迅速に低下させられない場合、コンバータ部30がラッチ停止するおそれがある。 The current detection section 70 is connected to the DC voltage line DC5 and detects the output current of the transistor Q1. The stop unit 80 has a function of suspending control of the gate voltage of the transistor Q1 until a predetermined time has elapsed after the transistor Q1 was turned on. However, the power supply device 200 does not control the discharge time of the gate of the transistor Q1 when the direct current voltage DC24 is stopped. Therefore, for example, if the gate voltage of the transistor Q1 cannot be lowered quickly when a momentary interruption of the AC voltage Vin occurs, there is a possibility that the converter section 30 will latch and stop.

図4は、図1の電源装置100および図3の電源装置200の動作の一例を示すタイミング図である。図4は、交流電圧Vinの瞬断が発生したときの動作を示している。 FIG. 4 is a timing chart showing an example of the operation of the power supply device 100 of FIG. 1 and the power supply device 200 of FIG. 3. FIG. 4 shows the operation when a momentary interruption of the AC voltage Vin occurs.

電源装置100では、交流電圧Vinの瞬断が発生すると、平滑部20から出力される直流電圧(入力電圧)が低下する。これに伴い、コンバータ部50からの直流電圧DC24の出力が停止され、直流電圧DC24が接地電圧VSSに向けて低下する(図4(a))。 In the power supply device 100, when a momentary interruption of the AC voltage Vin occurs, the DC voltage (input voltage) output from the smoothing section 20 decreases. Accordingly, the output of the DC voltage DC24 from the converter unit 50 is stopped, and the DC voltage DC24 decreases toward the ground voltage VSS (FIG. 4(a)).

瞬断の発生時に、トランジスタQ1は、直流電圧DC5を出力しており、放電部60のトランジスタTr1は、オンしている(図4(b))。このため、直流電圧DC24の低下に追従してダイオードD1に電流を流すことができ、トランジスタQ1のゲート電圧を急速に低下させてトランジスタQ1を直ちにオフすることができる(図4(c))。トランジスタQ1のオフにより、直流電圧DC5は接地電圧VSSまで低下する(図4(d))。 When the instantaneous interruption occurs, the transistor Q1 is outputting a direct current voltage DC5, and the transistor Tr1 of the discharge section 60 is turned on (FIG. 4(b)). Therefore, current can be caused to flow through the diode D1 following the decrease in the direct current voltage DC24, and the gate voltage of the transistor Q1 can be rapidly decreased to immediately turn off the transistor Q1 (FIG. 4(c)). By turning off the transistor Q1, the DC voltage DC5 decreases to the ground voltage VSS (FIG. 4(d)).

トランジスタQ1がオフすることにより、コンバータ部30の出力と直流電圧線DC5との接続が遮断され、コンバータ部30の出力に接続される負荷は小さくなる。このため、コンバータ部30は、交流電圧Vinの瞬断が発生した状態でもラッチ停止することなく動作し続けることができる。すなわち、コンバータ部30は、瞬断の発生時にも正常な直流電圧DC5Xを出力し続けることができる(図4(e))。コンバータ部30の出力電流は、コンバータ部30の出力に接続される負荷が小さくなるため減少する(図4(f))。 By turning off transistor Q1, the connection between the output of converter section 30 and DC voltage line DC5 is cut off, and the load connected to the output of converter section 30 becomes smaller. Therefore, the converter section 30 can continue to operate without being latched to a halt even in a state where a momentary interruption of the alternating current voltage Vin occurs. That is, the converter section 30 can continue to output the normal direct current voltage DC5X even when a momentary power outage occurs (FIG. 4(e)). The output current of the converter section 30 decreases because the load connected to the output of the converter section 30 becomes smaller (FIG. 4(f)).

瞬断の解消により交流電圧Vinの振幅が元に戻り、コンバータ部50は、直流電圧DC24の生成を再開する(図4(g))。直流電圧DC24の上昇に伴い、トランジスタQ1のゲート電圧が上昇し、トランジスタQ1がオンする(図4(h))。これにより、直流電圧DC5の出力が再開される(図4(i))。トランジスタQ1のオンにより、コンバータ部30の出力に接続される負荷が大きくなるため、コンバータ部30の出力電流は増加する(図4(j))。そして、コンバータ部30は、正常な状態に戻る。 As the instantaneous interruption is resolved, the amplitude of the alternating current voltage Vin returns to its original level, and the converter section 50 resumes generating the direct current voltage DC24 (FIG. 4(g)). As the direct current voltage DC24 rises, the gate voltage of the transistor Q1 rises, turning on the transistor Q1 (FIG. 4(h)). As a result, the output of the direct current voltage DC5 is restarted (FIG. 4(i)). By turning on the transistor Q1, the load connected to the output of the converter section 30 increases, so the output current of the converter section 30 increases (FIG. 4(j)). The converter section 30 then returns to its normal state.

このように、直流電圧DC5の電圧値に応じてオンまたはオフするトランジスタTr1を含む放電部60を電源装置100に設けることで、瞬断の発生時にトランジスタQ1を迅速にオフすることができる。これにより、コンバータ部30の出力負荷が軽減されるため、ラッチ停止による過剰な保護を抑制することができ、瞬断の解消後、直流電圧DC24、DC5の生成を再開することができる。 In this way, by providing the power supply device 100 with the discharge section 60 including the transistor Tr1 that is turned on or off depending on the voltage value of the DC voltage DC5, the transistor Q1 can be quickly turned off when a momentary power outage occurs. As a result, the output load of the converter section 30 is reduced, so that excessive protection due to latch stop can be suppressed, and generation of the direct current voltages DC24 and DC5 can be restarted after the momentary interruption is resolved.

電源装置200では、電源装置100と同様に、交流電圧Vinの瞬断が発生すると、平滑部20から出力される直流電圧(入力電圧)が低下する。これに伴い、コンバータ部50が直流電圧DC24の出力を停止し、直流電圧DC24が接地電圧VSSまで低下する(図4(k))。 In the power supply device 200, similarly to the power supply device 100, when a momentary interruption of the AC voltage Vin occurs, the DC voltage (input voltage) output from the smoothing section 20 decreases. Accordingly, the converter unit 50 stops outputting the direct current voltage DC24, and the direct current voltage DC24 decreases to the ground voltage VSS (FIG. 4(k)).

電源装置200は、図1の放電部60を持たないため、トランジスタQ1のゲート電圧を急峻に低下させる放電経路がない。このため、直流電圧DC24が接地電圧VSSまで低下してもトランジスタQ1のゲート電圧は徐々に低下し、瞬断の発生中にトランジスタQ1はオフしない(図4(l))。 Since the power supply device 200 does not have the discharge section 60 shown in FIG. 1, there is no discharge path that steeply lowers the gate voltage of the transistor Q1. Therefore, even if the direct current voltage DC24 drops to the ground voltage VSS, the gate voltage of the transistor Q1 gradually drops, and the transistor Q1 does not turn off during the momentary interruption (FIG. 4(l)).

トランジスタQ1のオン状態が維持されるため、コンバータ部30は、出力に接続される負荷が大きい状態、かつ入力電圧が低い状態で動作し続ける。このため、コンバータ部30の1次側の電流も大きくなり、コンバータ部30はラッチ停止する。 Since the transistor Q1 is maintained in the on state, the converter section 30 continues to operate with a large load connected to the output and a low input voltage. Therefore, the current on the primary side of converter section 30 also increases, and converter section 30 latches to a halt.

ラッチ停止によりコンバータ部30は、直流電圧DC5Xの生成を停止する(図4(m))。直流電圧DC5の生成の停止により、直流電圧DC5の出力も停止される(図4(n))。そして、コンバータ部30の出力電流はゼロになる(図4(o))。ラッチ停止状態は、瞬断が解消した後も続くため、電源装置200の全系統が停止したままとなってしまう。 Due to the latch stop, the converter unit 30 stops generating the direct current voltage DC5X (FIG. 4(m)). By stopping the generation of the DC voltage DC5, the output of the DC voltage DC5 is also stopped (FIG. 4(n)). Then, the output current of the converter section 30 becomes zero (FIG. 4(o)). Since the latch stop state continues even after the instantaneous power outage is resolved, the entire system of the power supply device 200 remains stopped.

なお、電源装置200において、コンバータ部30の出力に接続された負荷が軽い場合、ラッチ停止せず、瞬断の解消後に直流電圧DC5X、DC24、DC5の出力が復帰する場合もある。しかしながら、瞬断の発生時にトランジスタQ1がオフすることなくオン状態に維持されるため、瞬断後の起動シーケンスが通常と異なってしまう。 In addition, in the power supply device 200, when the load connected to the output of the converter section 30 is light, the latching stop may not occur and the output of the DC voltages DC5X, DC24, and DC5 may be restored after the momentary interruption is resolved. However, since the transistor Q1 is maintained in the on state without being turned off when a momentary interruption occurs, the startup sequence after the momentary interruption is different from normal.

例えば、通常の起動シーケンスでは、直流電圧DC5X、DC24、DC5の順に出力が開始されるが、瞬断の解消後は、直流電圧DC5X、DC5、DC24の順で出力が開始される。起動シーケンスが異なる場合、電源装置200が搭載されるシステムにおいて、予期せぬエラーが発生するおそれがある。 For example, in a normal startup sequence, output of DC voltages DC5X, DC24, and DC5 is started in this order, but after the momentary interruption is resolved, output is started in this order of DC voltages DC5X, DC5, and DC24. If the startup sequences are different, an unexpected error may occur in the system in which the power supply device 200 is installed.

図5は、図1の電源装置100の動作の別の例を示すタイミング図である。図5は、直流電圧線DC5の短絡時に、放電部60による放電機能が無効状態にされたときの動作を示している。図5のかぎ括弧内に示す動作タイミングは、直流電圧線DC5の短絡時に、放電部60による放電機能が有効状態であるとしたときの動作を示している。例えば、図5のかぎ括弧内は、図1の放電部60がトランジスタTr1を持たない場合の動作を示す。 FIG. 5 is a timing chart showing another example of the operation of the power supply device 100 of FIG. 1. FIG. 5 shows the operation when the discharge function of the discharge unit 60 is disabled when the DC voltage line DC5 is short-circuited. The operation timing shown in the square brackets in FIG. 5 indicates the operation when the discharge function of the discharge section 60 is in an effective state when the DC voltage line DC5 is short-circuited. For example, the portion in parentheses in FIG. 5 shows the operation when the discharge section 60 in FIG. 1 does not include the transistor Tr1.

コンバータ部30は、直流電圧DC5が接地電圧VSSまたは接地電圧VSSに近い電圧まで低下したことを、直流電圧DC5Xに基づいて検出することで、直流電圧線DC5の短絡の発生を検出する。コンバータ部30は、短絡を検出した場合、トランジスタQ3(図2)のスイッチング動作を停止する(図5(a))。これにより、コンバータ部30からコンバータ部50への電力供給が停止するため、コンバータ部50の動作が停止し、直流電圧DC24が接地電圧VSSまで低下する(図5(b))。 Converter unit 30 detects the occurrence of a short circuit in DC voltage line DC5 by detecting, based on DC voltage DC5X, that DC voltage DC5 has decreased to ground voltage VSS or a voltage close to ground voltage VSS. When converter section 30 detects a short circuit, it stops the switching operation of transistor Q3 (FIG. 2) (FIG. 5(a)). As a result, the power supply from the converter section 30 to the converter section 50 is stopped, so the operation of the converter section 50 is stopped, and the direct current voltage DC24 decreases to the ground voltage VSS (FIG. 5(b)).

直流電圧線DC5の短絡により放電部60のトランジスタTr1は、ロウレベルに対応する電圧値の直流電圧DC5を受けてオフし、放電部60の放電機能は無効状態になる。このため、直流電圧線DC5の短絡時、トランジスタQ1のゲートは、直流電圧DC24が低下しても放電されない。トランジスタQ1のゲート電圧は、例えば、抵抗R1、R3から接地線VSSまでの経路を介して徐々に低下する(図5(c))。 Due to the short circuit of the DC voltage line DC5, the transistor Tr1 of the discharge section 60 receives the DC voltage DC5 having a voltage value corresponding to the low level and is turned off, and the discharge function of the discharge section 60 becomes disabled. Therefore, when the DC voltage line DC5 is short-circuited, the gate of the transistor Q1 is not discharged even if the DC voltage DC24 decreases. The gate voltage of the transistor Q1 gradually decreases, for example, via a path from the resistors R1 and R3 to the ground line VSS (FIG. 5(c)).

コンバータ部30は、トランジスタQ1がオフするまでの間に、直流電圧DC5X(すなわち、直流電圧DC5)の低電圧(例えば、接地電圧VSS)が一定時間継続したことに基づいてラッチ停止する。すなわち、放電機能を無効状態に設定可能な放電部60を有する電源装置100は、短絡に対する電源装置100の保護機能を働かせることができる。このように、電源装置100に放電部60を設けるだけでなく、直流電圧DC5の出力状態に応じて放電機能の有効状態と無効状態を切り替えることで、電源装置100内のコンバータ部30等の回路を適切に保護することができる。 The converter section 30 latches to a halt based on the fact that the low voltage (for example, the ground voltage VSS) of the DC voltage DC5X (that is, the DC voltage DC5) continues for a certain period of time until the transistor Q1 is turned off. That is, the power supply device 100 having the discharge section 60 whose discharge function can be set to an invalid state can activate the protection function of the power supply device 100 against short circuits. In this way, in addition to providing the discharge section 60 in the power supply device 100, by switching the discharge function between the valid state and the disabled state according to the output state of the direct current voltage DC5, the circuits such as the converter section 30 in the power supply device 100 can be can be properly protected.

これに対して、かぎ括弧内に示すように、直流電圧線DC5の短絡時に、放電部60による放電機能が有効状態である場合、直流電圧線DC5の短絡時にトランジスタQ1のゲート電圧が直ちに接地電圧VSSに向けて低下する(図5(d))。これにより、トランジスタQ1は、コンバータ部30がラッチ停止する前にオフする。 On the other hand, as shown in the square brackets, when the discharge function by the discharge unit 60 is enabled when the DC voltage line DC5 is short-circuited, the gate voltage of the transistor Q1 immediately changes to the ground voltage when the DC voltage line DC5 is short-circuited. It decreases toward VSS (Fig. 5(d)). As a result, transistor Q1 is turned off before converter section 30 is latched to a halt.

トランジスタQ1がオフすると、コンバータ部30と短絡箇所とは、トランジスタQ1により遮断される。このため、コンバータ部30は、直流電圧線DC5の短絡を検出しなくなり、トランジスタQ3のスイッチング動作を再開する(図5(e))。 When transistor Q1 is turned off, converter section 30 and the short-circuit location are cut off by transistor Q1. Therefore, the converter section 30 no longer detects the short circuit of the DC voltage line DC5, and resumes the switching operation of the transistor Q3 (FIG. 5(e)).

トランジスタQ3のスイッチング動作の再開により、直流電圧DC5Xの生成が再開される(図5(f))。また、コンバータ部30からコンバータ部50への電力の供給が再開される。これにより、コンバータ部50は、直流電圧DC24の生成を再開する(図5(g))。直流電圧DC24の生成の再開により、直流電圧DC24の上昇に追従してトランジスタQ1のゲート電圧が上昇し、トランジスタQ1の閾値電圧VTを超えたときに、トランジスタQ1はオンする(図5(h))。 By restarting the switching operation of transistor Q3, generation of direct current voltage DC5X is restarted (FIG. 5(f)). Furthermore, the supply of power from converter section 30 to converter section 50 is restarted. Thereby, the converter section 50 restarts generation of the direct current voltage DC24 (FIG. 5(g)). By restarting the generation of the DC voltage DC24, the gate voltage of the transistor Q1 increases in accordance with the rise in the DC voltage DC24, and when it exceeds the threshold voltage VT of the transistor Q1, the transistor Q1 is turned on (FIG. 5 (h) ).

トランジスタQ1のオンにより、コンバータ部30と短絡箇所とがトランジスタQ1を介して接続される。これにより、コンバータ部30は、直流電圧線DC5の短絡を再び検出し、トランジスタQ3のスイッチング動作を停止する(図5(i))。以上の動作が繰り返されるため、コンバータ部30はラッチ停止することなく、繰り返し起動され、短絡に対する電源装置100の保護機能を働かせることができない。 Turning on transistor Q1 connects converter section 30 and the short circuit via transistor Q1. As a result, the converter unit 30 detects the short circuit of the DC voltage line DC5 again and stops the switching operation of the transistor Q3 (FIG. 5(i)). Since the above operation is repeated, the converter unit 30 is repeatedly activated without being latched to a stop, and the protection function of the power supply device 100 against short circuits cannot be activated.

以上、この実施形態では、直流電圧DC5の電圧値に応じてオンまたはオフするトランジスタTr1を含む放電部60が電源装置100に設けられる。これにより、放電機能の有効状態と無効状態を切り替えることができ、電源装置100内の回路を適切に保護することができる。すなわち、トランジスタQ1がオフする場合のトランジスタQ1のゲートの放電時間を適切に制御することで、電源装置100を保護することができる。 As described above, in this embodiment, the power supply device 100 is provided with the discharge section 60 including the transistor Tr1 that is turned on or off depending on the voltage value of the direct current voltage DC5. Thereby, the discharge function can be switched between a valid state and a disabled state, and the circuit within the power supply device 100 can be appropriately protected. That is, the power supply device 100 can be protected by appropriately controlling the discharge time of the gate of the transistor Q1 when the transistor Q1 is turned off.

例えば、放電部60を電源装置100に設けることで、瞬断の発生時にトランジスタQ1を迅速にオフすることができる。これにより、コンバータ部30の出力負荷が軽減するため、ラッチ停止による過剰な保護を抑制することができ、瞬断の解消後、直流電圧DC24、DC5の生成を再開することができる。 For example, by providing the discharge section 60 in the power supply device 100, the transistor Q1 can be quickly turned off when a momentary power outage occurs. As a result, the output load of the converter section 30 is reduced, so that excessive protection due to latch stop can be suppressed, and generation of the direct current voltages DC24 and DC5 can be restarted after the momentary interruption is resolved.

直流電圧線DC5が短絡した場合に、放電部60による放電機能を無効状態にすることで、コンバータ部30をラッチ停止させることができ、短絡に対する電源装置100の保護機能を働かせることができる。 When the DC voltage line DC5 is short-circuited, by disabling the discharge function of the discharge section 60, the converter section 30 can be latched stopped, and the protection function of the power supply device 100 against short circuits can be activated.

さらに、電源装置100が、トランジスタQ1がオンされてから所定時間が経過するまでトランジスタQ1のゲート電圧の制御を保留する機能を有する場合にも、放電部60を設けることにより、瞬断の発生時にトランジスタQ1を迅速にオフさせることができる。 Furthermore, even when the power supply device 100 has a function of suspending control of the gate voltage of the transistor Q1 until a predetermined time has elapsed after the transistor Q1 is turned on, by providing the discharge section 60, it is possible to Transistor Q1 can be quickly turned off.

図6は、本発明の別の実施形態に係る電源装置の一例を示す回路ブロック図である。上述した実施形態と同一または同様の要素については、同じ符号を付し、詳細な説明は省略する。図6に示す電源装置110は、図1の電源装置100に電圧検出部90およびトランジスタTr2(NPN型バイポーラトランジスタ)を追加している。トランジスタTr2は、第2トランジスタの一例である。 FIG. 6 is a circuit block diagram showing an example of a power supply device according to another embodiment of the present invention. Elements that are the same as or similar to those in the embodiment described above are given the same reference numerals, and detailed explanations are omitted. A power supply device 110 shown in FIG. 6 adds a voltage detection section 90 and a transistor Tr2 (NPN bipolar transistor) to the power supply device 100 shown in FIG. Transistor Tr2 is an example of a second transistor.

電圧検出部90は、直流電圧DC5が0Vより高い所定電圧以下であることを検出した場合(すなわち、短絡ではない低電圧を検出した場合)、トランジスタTr2をオンさせるベース電流をトランジスタTr2のベースに出力する。 When the voltage detection unit 90 detects that the DC voltage DC5 is lower than a predetermined voltage higher than 0V (that is, when detecting a low voltage that is not a short circuit), the voltage detection unit 90 supplies a base current that turns on the transistor Tr2 to the base of the transistor Tr2. Output.

トランジスタTr2は、コレクタがノードND1および抵抗素子R1を介してトランジスタQ1のゲートに接続され、エミッタが接地されている。このため、直流電圧DC5が0Vより高い所定の電圧値以下になったとき、トランジスタQ1のゲートは接地され、トランジスタQ1はオフする。 The transistor Tr2 has a collector connected to the gate of the transistor Q1 via the node ND1 and the resistive element R1, and an emitter that is grounded. Therefore, when the direct current voltage DC5 becomes equal to or less than a predetermined voltage value higher than 0V, the gate of the transistor Q1 is grounded, and the transistor Q1 is turned off.

図7は、図6の電源装置110の動作の一例を示すタイミング図である。図7は、例えば、図2のコンバータ部50の制御部51等のフィードバック系の回路の異常によりコンバータ部50の出力異常が発生したときの動作を示している。出力異常が発生する前、直流電圧DC24、DC5(DC5X)は、正常に出力されている(図7(a)、(b))。また、電圧検出部90は、正常な直流電圧DC5を検出するため、トランジスタTr2のベースにベース電流を出力せず、トランジスタTr2はオフしている(図7(c))。 FIG. 7 is a timing diagram showing an example of the operation of the power supply device 110 of FIG. 6. FIG. 7 shows the operation when an abnormality in the output of the converter section 50 occurs due to an abnormality in a feedback system circuit such as the control section 51 of the converter section 50 in FIG. 2, for example. Before the output abnormality occurs, the DC voltages DC24 and DC5 (DC5X) are normally output (FIGS. 7(a) and (b)). Further, in order to detect the normal DC voltage DC5, the voltage detection unit 90 does not output a base current to the base of the transistor Tr2, and the transistor Tr2 is turned off (FIG. 7(c)).

この後、コンバータ部50の出力異常が発生し、例えば、直流電圧DC24が正常値と接地電圧VSSの中間値まで低下する(図7(d))。直流電圧DC24の低下により、トランジスタQ1のゲートから直流電圧線DC24に放電部60を介して電流が流れる。これにより、トランジスタQ1のゲート電圧は、直流電圧DC24の電圧値に向けて低下する(図7(e))。 After this, an abnormal output of the converter section 50 occurs, and, for example, the direct current voltage DC24 decreases to an intermediate value between the normal value and the ground voltage VSS (FIG. 7(d)). As the direct current voltage DC24 decreases, a current flows from the gate of the transistor Q1 to the direct current voltage line DC24 via the discharge section 60. As a result, the gate voltage of the transistor Q1 decreases toward the voltage value of the direct current voltage DC24 (FIG. 7(e)).

トランジスタQ1のゲート電圧の低下によりトランジスタQ1は、非飽和領域で動作する(図7(f))。これにより、トランジスタQ1のドレイン、ソース間の電圧降下が大きくなるため、直流電圧DC5が低下する(図7(g))。電圧検出部90は、直流電圧DC5の低下(短絡ではない)を検出する。そして、電圧検出部90は、トランジスタTr2のベースにベース電流を出力し、トランジスタTr2をオンさせる(図7(h))。 Due to the decrease in the gate voltage of transistor Q1, transistor Q1 operates in a non-saturation region (FIG. 7(f)). As a result, the voltage drop between the drain and source of the transistor Q1 becomes large, so that the direct current voltage DC5 decreases (FIG. 7(g)). The voltage detection unit 90 detects a decrease (not a short circuit) in the direct current voltage DC5. Then, the voltage detection unit 90 outputs a base current to the base of the transistor Tr2, turning on the transistor Tr2 (FIG. 7(h)).

トランジスタTr2のオンにより、トランジスタQ1のゲート電圧が接地電圧VSSに向けて低下し、トランジスタQ1はオフする(図7(i))。トランジスタQ1のオフにより、直流電圧DC5の出力が停止される(図7(j))。これにより、トランジスタQ1が非飽和状態で動作し続けることを抑止することができ、トランジスタQ1を故障または破損から保護することができる。 By turning on the transistor Tr2, the gate voltage of the transistor Q1 decreases toward the ground voltage VSS, and the transistor Q1 turns off (FIG. 7(i)). By turning off the transistor Q1, the output of the direct current voltage DC5 is stopped (FIG. 7(j)). Thereby, it is possible to prevent the transistor Q1 from continuing to operate in a non-saturated state, and it is possible to protect the transistor Q1 from failure or damage.

これに対して、電源装置110が電圧検出部90およびトランジスタTr2を持たない場合、コンバータ部50の帰還系の異常により直流電圧DC24が低下した状態が続くと、トランジスタQ1のゲート電圧が低下した状態が継続するおそれがある。この場合、トランジスタQ1が非飽和領域で動作し続けるおそれがある。また、トランジスタQ1が非飽和領域で動作している間、トランジスタQ1のドレインとソース間の電圧降下により直流電圧DC5も低下する。この場合、トランジスタQ1の損失が増大し、トランジスタQ1が故障または破損するおそれがある。 On the other hand, when the power supply device 110 does not include the voltage detection section 90 and the transistor Tr2, if the DC voltage DC24 continues to decrease due to an abnormality in the feedback system of the converter section 50, the gate voltage of the transistor Q1 decreases. There is a risk that this will continue. In this case, there is a possibility that the transistor Q1 continues to operate in the non-saturation region. Further, while the transistor Q1 is operating in the non-saturation region, the DC voltage DC5 also decreases due to the voltage drop between the drain and source of the transistor Q1. In this case, the loss of transistor Q1 increases, and there is a risk that transistor Q1 will fail or be damaged.

以上、この実施形態においても、上述した実施形態と同様の効果を得ることができる。例えば、直流電圧DC5の電圧値に応じてオンまたはオフするトランジスタTr1を含む放電部60を電源装置110に設けることで、放電機能の有効状態と無効状態を切り替えることができ、電源装置110内の回路を適切に保護することができる。 As described above, in this embodiment as well, the same effects as in the above-described embodiment can be obtained. For example, by providing the power supply device 110 with a discharge section 60 including a transistor Tr1 that is turned on or off depending on the voltage value of the direct current voltage DC5, the discharge function can be switched between a valid state and a disabled state, and the The circuit can be properly protected.

さらに、この実施形態では、電圧検出部90およびトランジスタTr2が電源装置110に設けられる。これにより、例えば、コンバータ部50の出力異常が発生した場合に、トランジスタQ1が非飽和状態で動作し続けることを抑止することができ、トランジスタQ1を故障または破損から保護することができる。 Furthermore, in this embodiment, the voltage detection section 90 and the transistor Tr2 are provided in the power supply device 110. Thereby, for example, when an abnormality in the output of the converter section 50 occurs, it is possible to prevent the transistor Q1 from continuing to operate in a non-saturated state, and it is possible to protect the transistor Q1 from failure or damage.

図8は、図1の電源装置100および図6の電源装置110が搭載される画像形成装置の一例を示す全体構成図である。図8に示す画像形成装置1は、例えば、コピー機能、プリント機能、スキャナ機能およびファクシミリ機能等を有するデジタル複合機(MFP:Multi-Function Printer)である。画像形成装置1は、画像形成装置1の操作部のアプリケーション切り替えキー等により、コピー機能、プリント機能、スキャナ機能およびファクシミリ機能をそれぞれ実現する動作モードを相互に切り替えることが可能である。画像形成装置1は、コピー機能の選択時にはコピーモードとなり、プリント機能の選択時にはプリントモードとなり、スキャナ機能の選択時にはスキャナモードとなり、ファクシミリ機能の選択時にはファクシミリモードとなる。 FIG. 8 is an overall configuration diagram showing an example of an image forming apparatus in which the power supply device 100 of FIG. 1 and the power supply device 110 of FIG. 6 are installed. The image forming apparatus 1 shown in FIG. 8 is, for example, a digital multi-function printer (MFP) having a copy function, a print function, a scanner function, a facsimile function, and the like. The image forming apparatus 1 can mutually switch between operation modes for realizing a copy function, a print function, a scanner function, and a facsimile function by using an application switching key or the like on an operation unit of the image forming apparatus 1. The image forming apparatus 1 enters a copy mode when a copy function is selected, a print mode when a print function is selected, a scanner mode when a scanner function is selected, and a facsimile mode when a facsimile function is selected.

また、画像形成装置1は、内部回路の状態に応じて、内部状態が通常モードまたは省エネモード(省電力モード)等に切り替わる。例えば、通常モードは、動作中モード(動作している状態)および待機モード(待機している状態)を有する。 Further, the internal state of the image forming apparatus 1 is switched to a normal mode, an energy saving mode (power saving mode), etc. depending on the state of the internal circuit. For example, the normal mode includes an operating mode (operating state) and a standby mode (standby state).

例えば、動作中モードは、画像またはテキストデータ等を紙媒体等に印刷するコピーモードまたはプリントモードを含む。プリントモードは、ファクシミリモードにおいて受信データを紙媒体等に印刷する動作を含む。また、動作中モードは、原稿等をスキャンするスキャナモードまたはファクシミリモードにおける送受信動作を含む。内部回路の状態は、ユーザによる操作部の操作または画像形成装置1内での制御により切り替わる。 For example, the active mode includes a copy mode or a print mode in which images, text data, etc. are printed on a paper medium or the like. The print mode includes an operation of printing received data on a paper medium or the like in the facsimile mode. Furthermore, the active mode includes transmission and reception operations in a scanner mode for scanning a document or the like or in a facsimile mode. The state of the internal circuit is switched by the user's operation of the operating unit or by control within the image forming apparatus 1.

例えば、画像形成装置1は、自動原稿送り装置2(ADF:Auto Document Feeder)、画像読み取り装置3、書き込みユニット4、プリンタユニット5、操作パネル11、制御装置12および電源装置13を有する。 For example, the image forming apparatus 1 includes an automatic document feeder (ADF) 2, an image reading device 3, a writing unit 4, a printer unit 5, an operation panel 11, a control device 12, and a power supply device 13.

電源装置13は、図1の電源装置100または図6の電源装置110である。電源装置13は、生成した直流電圧DC24をプリンタユニット5等の各種負荷に供給する。例えば、負荷として、各種モータ、感光体ドラム6を帯電させる帯電器および現像装置7の現像ローラ等がある。 The power supply device 13 is the power supply device 100 in FIG. 1 or the power supply device 110 in FIG. The power supply device 13 supplies the generated direct current voltage DC24 to various loads such as the printer unit 5. For example, the loads include various motors, a charger that charges the photosensitive drum 6, a developing roller of the developing device 7, and the like.

電源装置13は、生成した直流電圧DC5を制御装置12に搭載されるCPUおよびメモリ等の動作電源として制御装置12に供給する。電源装置13は、生成した直流電圧DC5Xを操作パネル11が接続される制御基板に搭載されるCPU(Central Processing Unit)およびメモリ等の動作電源として制御基板に常時供給する。 The power supply device 13 supplies the generated direct current voltage DC5 to the control device 12 as an operating power source for the CPU, memory, etc. mounted on the control device 12. The power supply device 13 constantly supplies the generated direct current voltage DC5X to the control board as an operating power source for a CPU (Central Processing Unit), memory, etc. mounted on the control board to which the operation panel 11 is connected.

プリンタユニット5は、感光体ドラム6、現像装置7、搬送ベルト8および定着装置9と、給紙トレイ10が収納される収納空間とを有する。自動原稿送り装置2、画像読み取り装置3、書き込みユニット4、プリンタユニット5および操作パネル11は、画像を形成する本体部の一例である。 The printer unit 5 includes a photosensitive drum 6, a developing device 7, a conveyor belt 8, a fixing device 9, and a storage space in which a paper feed tray 10 is stored. The automatic document feeder 2, image reading device 3, writing unit 4, printer unit 5, and operation panel 11 are examples of a main body that forms images.

プリンタユニット5は、画像情報に基づいて紙媒体等に転写するトナー像を作成する。プリンタユニット5は、画像を形成する画像形成部の一例である。以下、画像形成装置1での画像の形成の流れの一例として、動作モードがコピーモードに設定されている場合について簡単に説明する。 The printer unit 5 creates a toner image to be transferred onto a paper medium or the like based on the image information. The printer unit 5 is an example of an image forming section that forms an image. Hereinafter, as an example of the flow of image formation in the image forming apparatus 1, a case where the operation mode is set to copy mode will be briefly described.

コピーモードでは、コピーの対象である複数枚の原稿が自動原稿送り装置2にセットされ、あるいは、コピーの対象である原稿が画像読み取り装置3上にセットされる。操作パネル11に表示されるスタートボタンが押されると、自動原稿送り装置2は、原稿を1枚ずつ画像読み取り装置3に給送する。画像読み取り装置3は、自動原稿送り装置2から順に送られる原稿の各々または画像読み取り装置3にセットされた原稿の画像情報を読み取る。画像読み取り装置3により読み取られた画像情報は、例えば、制御装置12に搭載される画像処理部により処理される。 In the copy mode, a plurality of documents to be copied are set on the automatic document feeder 2, or a document to be copied is set on the image reading device 3. When the start button displayed on the operation panel 11 is pressed, the automatic document feeder 2 feeds the documents one by one to the image reading device 3. The image reading device 3 reads image information of each document sequentially sent from the automatic document feeder 2 or the document set in the image reading device 3. The image information read by the image reading device 3 is processed by, for example, an image processing section installed in the control device 12.

書き込みユニット4は、画像処理部により処理された画像情報を光情報に変換する。感光体ドラム6は、感光体ドラム6に対向する位置に配置される帯電器により一様に帯電された後、書き込みユニット4により変換された光情報を含むレーザ光により露光される。露光により、感光体ドラム6上には静電潜像が形成される。現像装置7は、感光体ドラム6上の静電潜像を現像し、感光体ドラム6上にトナー像を形成する。搬送ベルト8は、トナー像を紙媒体等に転写する。定着装置9は、トナー像を紙媒体等に定着させる。そして、原稿の画像がコピーされた転写紙は、排出部から排出される。 The writing unit 4 converts the image information processed by the image processing section into optical information. The photoreceptor drum 6 is uniformly charged by a charger placed opposite the photoreceptor drum 6, and then exposed to laser light containing converted optical information by the writing unit 4. An electrostatic latent image is formed on the photoreceptor drum 6 by exposure. The developing device 7 develops the electrostatic latent image on the photoreceptor drum 6 and forms a toner image on the photoreceptor drum 6 . The conveyor belt 8 transfers the toner image onto a paper medium or the like. The fixing device 9 fixes the toner image onto a paper medium or the like. Then, the transfer paper on which the original image has been copied is discharged from the discharge section.

例えば、上述した待機モード(=通常モード)は、コピーモードにおいて、スタートボタンが押されるまでの状態であり、動作中モード(=通常モード)は、スタートボタンが押されてから紙媒体等が排出されるまでの状態である。電源装置13が直流電圧DC24、DC5、DC5Xを生成する通常モードでは、モータ等の負荷は、直流電圧DC24を受けて動作または動作可能な状態である。 For example, the standby mode (=normal mode) mentioned above is the state until the start button is pressed in copy mode, and the operating mode (=normal mode) is the state from when the start button is pressed until paper media etc. are ejected. This is the state until the In the normal mode in which the power supply device 13 generates the DC voltages DC24, DC5, and DC5X, a load such as a motor operates or can operate upon receiving the DC voltage DC24.

動作中モードの終了後、画像形成装置1の状態は待機モードに戻り、待機モードが所定時間継続すると省エネモード(スリープ状態)になる。そして、電源装置13は、ハイレベルの省エネ信号ECOを受けて、直流電圧DC24、DC5の生成を停止する。省エネモード中に、操作パネル11が操作されると画像形成装置1の状態は待機モードに復帰する。この場合、電源装置13は、ロウレベルの省エネ信号ECOを受けて、直流電圧DC24、DC5の生成を再開する。 After the active mode ends, the state of the image forming apparatus 1 returns to the standby mode, and when the standby mode continues for a predetermined period of time, the image forming apparatus 1 enters the energy saving mode (sleep state). Then, upon receiving the high-level energy saving signal ECO, the power supply device 13 stops generating the direct current voltages DC24 and DC5. If the operation panel 11 is operated during the energy saving mode, the state of the image forming apparatus 1 returns to the standby mode. In this case, the power supply device 13 receives the low-level energy saving signal ECO and restarts generation of the direct current voltages DC24 and DC5.

操作パネル11は、ユーザの操作に応じた各種の入力を受け付けるとともに、操作パネル11の表示部に各種の情報を表示する。例えば、操作パネル11に表示される情報は、入力を受け付けた操作を示す情報、画像形成装置1の動作状況を示す情報、または、画像形成装置1の設定状態を示す情報などである。操作パネル11が接続される制御基板は、直流電圧DC5Xを受けて常時動作する。このため、操作パネル11は、通常モード中だけでなく、省エネモード中にも各種の入力を受け付けることができる。操作パネル11は、外部からの操作を受け付ける外部インタフェース部の一例である。 The operation panel 11 receives various inputs according to user operations, and displays various information on the display section of the operation panel 11. For example, the information displayed on the operation panel 11 is information indicating the operation for which the input has been accepted, information indicating the operating status of the image forming apparatus 1, information indicating the setting state of the image forming apparatus 1, or the like. The control board to which the operation panel 11 is connected operates constantly by receiving the direct current voltage DC5X. Therefore, the operation panel 11 can accept various inputs not only during the normal mode but also during the energy saving mode. The operation panel 11 is an example of an external interface section that accepts operations from the outside.

制御装置12は、内蔵するCPU等のコントローラに制御プログラムを実行させることで、プリンタユニット5の制御、通信の制御および操作パネル11への入力の制御等、画像形成装置1の全体の動作を制御する。そして、制御装置12は、画像処理プログラムまたはデータ処理プログラムを実行することで画像処理またはデータ処理を実施し、紙媒体等に転写する画像を形成する。制御装置12は、直流電圧DC5を受けて動作するため、省エネモード中に動作を停止する。 The control device 12 controls the overall operation of the image forming apparatus 1, such as controlling the printer unit 5, controlling communication, and controlling input to the operation panel 11, by causing a built-in controller such as a CPU to execute a control program. do. Then, the control device 12 performs image processing or data processing by executing an image processing program or a data processing program, and forms an image to be transferred to a paper medium or the like. Since the control device 12 operates in response to the direct current voltage DC5, it stops operating during the energy saving mode.

なお、図8では、図1に示す電源装置100または図6に示す電源装置110が、電源装置13として画像形成装置1に搭載される例が示されている。しかしながら、図1に示す電源装置100または図6に示す電源装置110は、複数種の直流電圧DC24、DC5、DC5Xが供給され、省エネモード中に直流電圧DC24、DC5が使用されない電子機器に搭載可能である。 Note that FIG. 8 shows an example in which the power supply device 100 shown in FIG. 1 or the power supply device 110 shown in FIG. 6 is installed in the image forming apparatus 1 as the power supply device 13. However, the power supply device 100 shown in FIG. 1 or the power supply device 110 shown in FIG. 6 is supplied with multiple types of DC voltages DC24, DC5, and DC5X, and can be installed in electronic equipment in which the DC voltages DC24 and DC5 are not used during energy saving mode. It is.

本発明の態様は、例えば、以下の通りである。
<1>
第1モードおよび第2モードにかかわりなく、入力電圧に応じて第1電圧を生成する第1コンバータ部と、
前記第1モード中にオンして前記第1電圧を第2電圧として出力し、前記第2モード中にオフして前記第2電圧の出力を停止する第1トランジスタと、
前記第1モード中に第3電圧を生成し、前記第2モード中に第3電圧の生成を停止する第2コンバータ部と、
前記第2電圧の出力中、前記第3電圧の低下に応じて前記第1トランジスタのゲートに接続される放電経路をオンさせて前記第1トランジスタをオフし、前記第2電圧の出力の停止中、前記第3電圧の低下に応じた前記放電経路のオンを抑制するゲート制御部と、
を有することを特徴とする電源装置。
<2>
前記ゲート制御部は、前記第2電圧を出力する電圧線が短絡した場合、前記第3電圧の低下に応じた前記放電経路のオンを抑制すること
を特徴とする前記<1>に記載の電源装置。
<3>
前記第1電圧は、前記放電経路のオンの抑制によりオンし続ける前記第1トランジスタを介して前記第2電圧とともに低下し、
前記第1コンバータ部は、前記第1電圧の低下が一定時間継続したことに基づいてラッチ停止すること
を特徴とする前記<2>に記載の電源装置。
<4>
前記第2電圧の電圧値を検出する電圧検出部と、
前記第1トランジスタのゲートと接地線との間に接続され、前記電圧検出部が、前記第2電圧が接地電圧より高い所定電圧まで低下したことを検出したとき、前記第1トランジスタのゲートを接地する第2トランジスタと
を有することを特徴とする前記<1>ないし前記<3>のいずれかに記載の電源装置。
<5>
前記<1>ないし前記<4>のいずれかに記載の電源装置と、
前記第1モード中に前記第2電圧および前記第3電圧を使用して画像を形成する画像形成部と、
前記第2モード中に前記第1電圧を使用して外部からの操作を受け付ける外部インタフェース部と、
を有することを特徴とする画像形成装置。
Aspects of the present invention are, for example, as follows.
<1>
A first converter section that generates a first voltage according to an input voltage regardless of the first mode or the second mode;
a first transistor that is turned on during the first mode to output the first voltage as a second voltage, and turned off during the second mode to stop outputting the second voltage;
a second converter unit that generates a third voltage during the first mode and stops generating the third voltage during the second mode;
While outputting the second voltage, a discharge path connected to the gate of the first transistor is turned on to turn off the first transistor in response to a decrease in the third voltage, and while outputting the second voltage is stopped. , a gate control unit that suppresses turning on of the discharge path in response to a decrease in the third voltage;
A power supply device comprising:
<2>
The power supply according to <1>, wherein the gate control unit suppresses turning on of the discharge path in response to a decrease in the third voltage when a voltage line that outputs the second voltage is short-circuited. Device.
<3>
The first voltage decreases together with the second voltage through the first transistor, which remains on due to suppression of turning on of the discharge path,
The power supply device according to <2>, wherein the first converter unit latches and stops based on the fact that the first voltage continues to decrease for a certain period of time.
<4>
a voltage detection unit that detects the voltage value of the second voltage;
is connected between the gate of the first transistor and a ground line, and when the voltage detection unit detects that the second voltage has decreased to a predetermined voltage higher than the ground voltage, the gate of the first transistor is grounded. The power supply device according to any one of <1> to <3>, further comprising a second transistor.
<5>
The power supply device according to any one of <1> to <4> above,
an image forming unit that forms an image using the second voltage and the third voltage during the first mode;
an external interface unit that receives an external operation using the first voltage during the second mode;
An image forming apparatus comprising:

以上、各実施形態に基づき本発明の説明を行ってきたが、上記実施形態に示した要件に本発明が限定されるものではない。これらの点に関しては、本発明の主旨をそこなわない範囲で変更することができ、その応用形態に応じて適切に定めることができる。 Although the present invention has been described above based on each embodiment, the present invention is not limited to the requirements shown in the above embodiments. These points can be changed without detracting from the gist of the present invention, and can be determined appropriately depending on the application thereof.

1 画像形成装置
2 自動原稿送り装置
3 画像読み取り装置
4 書き込みユニット
5 プリンタユニット
6 感光体ドラム
7 現像装置
8 搬送ベルト
9 定着装置
10 給紙トレイ
11 操作パネル
12 制御装置
13 電源装置
20 平滑部
30 コンバータ部
31 制御部
32 パルス幅決定部
33 電流検出部
34 定電圧生成部
35 出力フィードバック部
36 平滑部
40 電力供給部
50 コンバータ部
51 制御部
52 主回路
60 放電部
70 電流検出部
80 停止部
90 電圧検出部
100、110、200 電源装置
AC 交流電源
D1、D2 ダイオード
DB ダイオードブリッジ
DC5、DC5X、DC24 直流電圧
ECO 省エネ信号
Q1、Q2、Q3 トランジスタ
T1 トランス
Tr1、Tr2 トランジスタ
Vin 交流電圧
1 Image forming device 2 Automatic document feeder 3 Image reading device 4 Writing unit 5 Printer unit 6 Photosensitive drum 7 Developing device 8 Conveyance belt 9 Fixing device 10 Paper feed tray 11 Operation panel 12 Control device 13 Power supply device 20 Smoothing section 30 Converter Section 31 Control section 32 Pulse width determination section 33 Current detection section 34 Constant voltage generation section 35 Output feedback section 36 Smoothing section 40 Power supply section 50 Converter section 51 Control section 52 Main circuit 60 Discharge section 70 Current detection section 80 Stop section 90 Voltage Detection unit 100, 110, 200 Power supply AC AC power supply D1, D2 Diode DB Diode bridge DC5, DC5X, DC24 DC voltage ECO Energy saving signal Q1, Q2, Q3 Transistor T1 Transformer Tr1, Tr2 Transistor Vin AC voltage

特開2019-62657号公報JP2019-62657A

Claims (5)

第1モードおよび第2モードにかかわりなく入力電圧に応じて第1電圧を生成する第1コンバータ部と、
前記第1モード中にオンして前記第1電圧を第2電圧として出力し、前記第2モード中にオフして前記第2電圧の出力を停止する第1トランジスタと、
前記第1モード中に第3電圧を生成し、前記第2モード中に第3電圧の生成を停止する第2コンバータ部と、
前記第2電圧の出力中、前記第3電圧の低下に応じて前記第1トランジスタのゲートに接続される放電経路を導通させて前記第1トランジスタをオフし、前記第2電圧の出力の停止中、前記第3電圧の低下に応じた前記放電経路の導通を抑制するゲート制御部と、
を有することを特徴とする電源装置。
a first converter section that generates a first voltage according to an input voltage regardless of the first mode and the second mode;
a first transistor that is turned on during the first mode to output the first voltage as a second voltage, and turned off during the second mode to stop outputting the second voltage;
a second converter unit that generates a third voltage during the first mode and stops generating the third voltage during the second mode;
While outputting the second voltage, a discharge path connected to the gate of the first transistor is made conductive in response to a decrease in the third voltage to turn off the first transistor, and while outputting the second voltage is stopped. , a gate control unit that suppresses conduction of the discharge path in response to a decrease in the third voltage;
A power supply device comprising:
前記ゲート制御部は、前記第2電圧を出力する電圧線が短絡した場合、前記第3電圧の低下に応じた前記放電経路の導通を抑制すること
を特徴とする請求項1に記載の電源装置。
The power supply device according to claim 1, wherein the gate control unit suppresses conduction of the discharge path according to a decrease in the third voltage when a voltage line that outputs the second voltage is short-circuited. .
前記第1電圧は、前記放電経路の導通の抑制によりオンし続ける前記第1トランジスタを介して前記第2電圧とともに低下し、
前記第1コンバータ部は、前記第1電圧の低下が一定時間継続したことに基づいてラッチ停止すること
を特徴とする請求項2に記載の電源装置。
The first voltage decreases together with the second voltage through the first transistor that remains on due to suppression of conduction of the discharge path,
The power supply device according to claim 2, wherein the first converter unit latches and stops based on the fact that the first voltage continues to decrease for a certain period of time.
前記第2電圧の電圧値を検出する電圧検出部と、
前記第1トランジスタのゲートに接続され、前記電圧検出部が、前記第2電圧が接地電圧より高い所定電圧まで低下したことを検出したとき、前記第1トランジスタのゲートを接地する第2トランジスタと
を有することを特徴とする請求項1に記載の電源装置。
a voltage detection unit that detects the voltage value of the second voltage;
a second transistor connected to the gate of the first transistor, which grounds the gate of the first transistor when the voltage detection section detects that the second voltage has decreased to a predetermined voltage higher than a ground voltage; The power supply device according to claim 1, further comprising a power supply device.
請求項1ないし請求項4のいずれか1項に記載の電源装置と、
前記第1モード中に前記第2電圧および前記第3電圧を使用して画像を形成する画像形成部と、
前記第2モード中に前記第1電圧を使用して外部からの操作を受け付ける外部インタフェース部と、
を有することを特徴とする画像形成装置。
The power supply device according to any one of claims 1 to 4,
an image forming unit that forms an image using the second voltage and the third voltage during the first mode;
an external interface unit that receives an external operation using the first voltage during the second mode;
An image forming apparatus comprising:
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