JP2019034862A - Method for manufacturing silicon carbide epitaxial substrate - Google Patents

Method for manufacturing silicon carbide epitaxial substrate Download PDF

Info

Publication number
JP2019034862A
JP2019034862A JP2017155844A JP2017155844A JP2019034862A JP 2019034862 A JP2019034862 A JP 2019034862A JP 2017155844 A JP2017155844 A JP 2017155844A JP 2017155844 A JP2017155844 A JP 2017155844A JP 2019034862 A JP2019034862 A JP 2019034862A
Authority
JP
Japan
Prior art keywords
defect point
silicon carbide
defect
main surface
total length
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP2017155844A
Other languages
Japanese (ja)
Inventor
健司 神原
Kenji Kambara
健司 神原
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Sumitomo Electric Industries Ltd
Original Assignee
Sumitomo Electric Industries Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Sumitomo Electric Industries Ltd filed Critical Sumitomo Electric Industries Ltd
Priority to JP2017155844A priority Critical patent/JP2019034862A/en
Publication of JP2019034862A publication Critical patent/JP2019034862A/en
Pending legal-status Critical Current

Links

Images

Landscapes

  • Length Measuring Devices By Optical Means (AREA)
  • Investigating Materials By The Use Of Optical Means Adapted For Particular Applications (AREA)
  • Crystals, And After-Treatments Of Crystals (AREA)
  • Testing Or Measuring Of Semiconductors Or The Like (AREA)

Abstract

To provide a silicon carbide epitaxial substrate capable of suppressing the occurrence of a linear defect on the surface of an epitaxial layer.SOLUTION: A method for manufacturing a silicon carbide epitaxial substrate comprises steps of: preparing a silicon carbide substrate 10; detecting a defect point being a depression or projection existing on the main surface 10A of the substrate 10; checking the total length used as the total of a line segment corresponding to a defect point group linearly arranged in defect points on the main surface; and forming epitaxial layers 60 and 70 on the main surface 10A on which it is checked that the total length is equal to or less than a predetermined threshold value.SELECTED DRAWING: Figure 1

Description

本発明は、炭化珪素エピ基板の製造方法に関するものである。   The present invention relates to a method for manufacturing a silicon carbide epi-substrate.

炭化珪素(SiC)層を含む半導体装置が知られている。この半導体装置は、炭化珪素基板上に炭化珪素からなるエピタキシャル層(以下、「エピ層」ともいう)がエピタキシャル成長により形成された炭化珪素エピ基板を準備し、エピ層内にデバイス領域を形成するとともに、エピ層上に電極等を形成することにより製造することができる。   A semiconductor device including a silicon carbide (SiC) layer is known. This semiconductor device prepares a silicon carbide epi substrate in which an epitaxial layer made of silicon carbide (hereinafter also referred to as an “epi layer”) is formed by epitaxial growth on a silicon carbide substrate, and forms a device region in the epi layer. It can be manufactured by forming an electrode or the like on the epi layer.

上記用途に使用される炭化珪素基板には高い表面平滑性が求められる。表面平滑性の高い炭化珪素基板を得る方法は、例えば特許文献1に記載されている。特許文献1においては、特定の研磨液と研磨パッドとを用いて炭化珪素基板を研磨することにより、表面平滑性の高い炭化珪素基板が得られることが開示されている。   High surface smoothness is required for the silicon carbide substrate used for the above applications. A method for obtaining a silicon carbide substrate having high surface smoothness is described in Patent Document 1, for example. Patent Document 1 discloses that a silicon carbide substrate having high surface smoothness can be obtained by polishing a silicon carbide substrate using a specific polishing liquid and a polishing pad.

特開2015−57864号公報Japanese Patent Laying-Open No. 2015-57864

炭化珪素エピ基板においては、エピ層表面の線状欠陥(スクラッチ)の発生をできる限り抑制することが求められる。エピ層表面の線状欠陥の中には、炭化珪素基板の表面に存在する欠陥に起因するものがある。例えば炭化珪素基板の表面に線状欠陥が存在すると、基板表面の欠陥に対応する線状欠陥がエピ層表面上に発生しやすくなる。エピ層表面上での線状欠陥の発生を抑制するために、エピ層の形成前に炭化珪素基板の表面に存在する線状欠陥を検出し、必要に応じて炭化珪素基板の表面を研磨することが行われる。   In a silicon carbide epi substrate, it is required to suppress the occurrence of linear defects (scratches) on the epi layer surface as much as possible. Some linear defects on the surface of the epi layer are caused by defects existing on the surface of the silicon carbide substrate. For example, when a linear defect exists on the surface of the silicon carbide substrate, a linear defect corresponding to the defect on the substrate surface is likely to occur on the epilayer surface. In order to suppress the occurrence of linear defects on the epilayer surface, the linear defects present on the surface of the silicon carbide substrate are detected before the formation of the epilayer, and the surface of the silicon carbide substrate is polished as necessary. Is done.

一方、炭化珪素基板の表面において明確な線状欠陥が確認されていない箇所であるにも関わらず、エピ層の表面の対応箇所に線状欠陥が発生する場合もある。エピ層を形成した後に顕在化する線状欠陥を低減するために、その線状欠陥の原因を特定し、炭化珪素基板表面の表面状態を適切に管理し、エピ層表面での線状欠陥の発生を抑制することが求められている。   On the other hand, a linear defect may occur at a corresponding location on the surface of the epi layer, although it is a location where no clear linear defect has been confirmed on the surface of the silicon carbide substrate. In order to reduce the linear defects that become apparent after the formation of the epi layer, the cause of the linear defects is specified, the surface state of the silicon carbide substrate surface is appropriately managed, and the linear defects on the epi layer surface are There is a demand to suppress the occurrence.

そこで、エピ層表面での線状欠陥の発生が抑制された炭化珪素エピ基板を製造可能な炭化珪素エピ基板の製造方法を提供することを目的の1つとする。   Then, it aims at providing the manufacturing method of the silicon carbide epi substrate which can manufacture the silicon carbide epi substrate by which generation | occurrence | production of the linear defect in the epi layer surface was suppressed.

本願の炭化珪素エピ基板の製造方法は、炭化珪素からなり、主面を有する炭化珪素基板を準備する工程と主面に存在する凹部又は凸部である欠陥点を検出する工程と、欠陥点のうち、直線状に並ぶ欠陥点群に対応する線分の長さの、主面内における総和である総長さを確認する工程と、総長さが所定の閾値以下であることが確認された主面上にエピタキシャル層を形成する工程と、を含む。   A method for manufacturing a silicon carbide epi-substrate of the present application includes a step of preparing a silicon carbide substrate having a main surface, a step of detecting a defect point that is a concave portion or a convex portion existing on the main surface, Among them, a step of confirming the total length, which is the sum of the lengths of the line segments corresponding to the defect point groups arranged in a straight line, in the main surface, and the main surface whose total length is confirmed to be equal to or less than a predetermined threshold Forming an epitaxial layer thereon.

上記炭化珪素エピ基板の製造方法によれば、エピ層表面での線状欠陥の発生が抑制された炭化珪素エピ基板を提供することができる。   According to the method for manufacturing a silicon carbide epi substrate, it is possible to provide a silicon carbide epi substrate in which the occurrence of linear defects on the epi layer surface is suppressed.

炭化珪素エピ基板の製造方法の手順を示すフローチャートである。It is a flowchart which shows the procedure of the manufacturing method of a silicon carbide epi substrate. 炭化珪素基板の構造を示す斜視図である。It is a perspective view which shows the structure of a silicon carbide substrate. 炭化珪素基板の構造を示す概略断面図である。It is a schematic sectional drawing which shows the structure of a silicon carbide substrate. 炭化珪素基板とその主面に存在する欠陥点を示す模式図である。It is a schematic diagram which shows the defect point which exists in a silicon carbide substrate and its main surface. 総長さを決定する方法を説明するための模式図である。It is a schematic diagram for demonstrating the method of determining total length. 総長さを決定する方法を説明するための模式図である。It is a schematic diagram for demonstrating the method of determining total length. 総長さを決定する方法を説明するための模式図である。It is a schematic diagram for demonstrating the method of determining total length. 総長さを決定する方法を説明するための模式図である。It is a schematic diagram for demonstrating the method of determining total length. 総長さを決定する方法を説明するための模式図である。It is a schematic diagram for demonstrating the method of determining total length. 総長さを決定する方法を説明するための模式図である。It is a schematic diagram for demonstrating the method of determining total length. 有効帯状領域を示す模式図である。It is a schematic diagram which shows an effective belt-shaped area | region. 炭化珪素基板の主面上の有効帯状領域を示す模式図である。It is a schematic diagram which shows the effective strip | belt-shaped area | region on the main surface of a silicon carbide substrate. 炭化珪素エピ基板の構造を示す概略断面図である。It is a schematic sectional drawing which shows the structure of a silicon carbide epi substrate.

[本願発明の実施形態の説明]
最初に本願発明の実施態様を列記して説明する。本願の炭化珪素エピ基板の製造方法は、炭化珪素からなり、主面を有する炭化珪素基板を準備する工程と、主面に存在する凹部又は凸部である欠陥点を検出する工程と、欠陥点のうち、直線状に並ぶ欠陥点群に対応する線分の長さの、主面内における総和である総長さを確認する工程と、総長さが所定の閾値以下であることが確認された主面上にエピタキシャル層を形成する工程と、を含む。
[Description of Embodiment of Present Invention]
First, embodiments of the present invention will be listed and described. The method of manufacturing a silicon carbide epi-substrate of the present application includes a step of preparing a silicon carbide substrate made of silicon carbide and having a main surface, a step of detecting a defect point that is a concave portion or a convex portion existing on the main surface, and a defect point Among them, a step of confirming the total length, which is the sum of the lengths of the line segments corresponding to the defect point group arranged in a straight line, in the main surface, and the main length confirmed to be equal to or less than a predetermined threshold. Forming an epitaxial layer on the surface.

炭化珪素基板の主面上にエピタキシャル成長により炭化珪素からなるエピ層を形成する場合、エピ層の状態は炭化珪素基板の主面の表面状態の影響を受ける。例えば炭化珪素基板の主面に線状欠陥(スクラッチ)が存在する場合、形成されるエピ層の表面においても線状欠陥が形成されやすい。しかしながら、エピ層に線状欠陥が発生するのは炭化珪素基板の主面にも線状欠陥が発生する場合に限られない。炭化珪素基板の表面において線状欠陥が確認されていない箇所であるにも関わらず、エピ層を形成すると線状欠陥が顕在化する場合もある。   When an epitaxial layer made of silicon carbide is formed by epitaxial growth on the main surface of the silicon carbide substrate, the state of the epi layer is affected by the surface state of the main surface of the silicon carbide substrate. For example, when a linear defect (scratch) exists on the main surface of the silicon carbide substrate, the linear defect is easily formed on the surface of the formed epi layer. However, the occurrence of linear defects in the epi layer is not limited to the case where linear defects occur on the main surface of the silicon carbide substrate. In some cases, a linear defect becomes apparent when an epi layer is formed in spite of the fact that a linear defect is not confirmed on the surface of the silicon carbide substrate.

本発明者らは、炭化珪素基板の主面上の特定の規則性を有する欠陥点群の存在がエピ層において顕在化する線状欠陥の原因の一つであることを突き止めた。そのような規則性を有する欠陥点群の存在を検出し、その数を低減することで、エピ層における線状欠陥の発生数を低減することが可能となる。またさらに、直線状に並ぶ欠陥点群に対応する線分の長さの、炭化珪素基板の主面内における総和である総長さを確認することにより、炭化珪素基板の表面状態を適切に管理しながら炭化珪素エピ基板を製造することが可能となる。   The present inventors have found that the presence of a defect point group having a specific regularity on the main surface of a silicon carbide substrate is one of the causes of linear defects that are manifested in the epilayer. By detecting the presence of such a defect point group having regularity and reducing the number thereof, the number of occurrences of linear defects in the epi layer can be reduced. Furthermore, the surface state of the silicon carbide substrate is appropriately managed by confirming the total length, which is the sum of the lengths of the line segments corresponding to the defect point groups arranged in a straight line, within the main surface of the silicon carbide substrate. However, a silicon carbide epi substrate can be manufactured.

また上記総長さが所定の閾値以下であることが確認された主面上にエピタキシャル層を形成することで、線状欠陥の発生が抑制された炭化珪素エピ基板を製造することが可能となる。   In addition, by forming an epitaxial layer on the main surface whose total length is confirmed to be equal to or less than a predetermined threshold value, it is possible to manufacture a silicon carbide epi substrate in which the occurrence of linear defects is suppressed.

総長さを確認する工程において、欠陥点のうち、任意の第1の欠陥点と、第1の欠陥点からの距離が10μm以上600μm以下である第2の欠陥点とを含む直線帯状領域を設定し、直線帯状領域のうち、直線帯状領域の第1の欠陥点と第2の欠陥点とを結ぶ方向の、第1の欠陥点から見て第2の欠陥点側および第1の欠陥点から見て第2の欠陥点とは反対側に向けて、10μm以上600μm以下の距離範囲内に他の欠陥点が存在することを条件に上記他の欠陥点まで順次延長して形成される直線帯状の有効帯状領域を抽出し、有効帯状領域の、第1の欠陥点と第2の欠陥点とを結ぶ方向の長さを線分の長さとして求め、総長さとして、有効帯状領域を決定するために用いた欠陥点が重複しないように有効帯状領域を主面全体において抽出し、抽出された有効帯状領域に対応する上記線分の長さの総和を求めるようにしてもよい。このようにすることで、上述の特定の規則性を有する欠陥点群をより適切に検出することができる。   In the step of checking the total length, a straight belt-like region including any first defect point among the defect points and a second defect point having a distance from the first defect point of 10 μm to 600 μm is set. From the first defect point side and the first defect point in the direction connecting the first defect point and the second defect point in the straight band region of the straight band region. A linear strip formed by sequentially extending to the other defect point on the condition that the other defect point exists within a distance range of 10 μm or more and 600 μm or less toward the opposite side to the second defect point. The effective strip region is extracted, the length of the effective strip region in the direction connecting the first defect point and the second defect point is obtained as the length of the line segment, and the effective strip region is determined as the total length. The effective belt-like region is extracted over the entire main surface so that the defect points used for this purpose do not overlap. Corresponding to the extracted effective band regions may be obtaining the sum of the length of the line segment. By doing in this way, the defect point group which has the above-mentioned specific regularity can be detected more appropriately.

総長さを確認する工程において設定される直線帯状領域の幅は20μmであってもよい。幅20μmの上記直線帯状領域を設定することにより、上述の特定の規則性を有する欠陥点群の検出をより的確に行うことができる。   The width of the straight strip region set in the step of confirming the total length may be 20 μm. By setting the straight band-like region having a width of 20 μm, the defect point group having the specific regularity described above can be detected more accurately.

総長さを確認する工程において、5以上の欠陥点を含むように上記有効帯状領域を設定してもよい。このようにすることで、上述の特定の規則性を有する欠陥群の検出をより適切に行うことができる。   In the step of confirming the total length, the effective band-shaped region may be set so as to include five or more defect points. By doing in this way, the defect group which has the above-mentioned specific regularity can be detected more appropriately.

総長さを確認する工程において、長さが1mm以上である線分の長さの総和を上記総長さとしてもよい。このようにすることで、上記総長さをより適切に決定することができる。   In the step of confirming the total length, the total length of line segments having a length of 1 mm or more may be set as the total length. By doing in this way, the said total length can be determined more appropriately.

欠陥点を検出する工程において、上記欠陥点として、周囲の領域からの深さが10nm以上の凹部又は周囲の領域からの高さが10nm以上の凸部である欠陥点を検出するようにしてもよい。このようにすることで、上述の特定の規則性を有する欠陥群の検出をより適切に行うことができる。   In the step of detecting a defect point, a defect point that is a recess having a depth of 10 nm or more from the surrounding region or a projection having a height of 10 nm or more from the surrounding region is detected as the defect point. Good. By doing in this way, the defect group which has the above-mentioned specific regularity can be detected more appropriately.

総長さを確認する工程において、総長さが閾値を超えると確認された場合、主面を研磨する工程をさらに含んでもよい。また主面を研磨する工程が実施された場合、欠陥点を検出する工程および総長さを確認する工程が再度実施されてもよい。このようにすることで線状欠陥のより少ない炭化珪素基板を準備することができる。   In the step of confirming the total length, when it is confirmed that the total length exceeds the threshold, a step of polishing the main surface may be further included. Moreover, when the process of grind | polishing a main surface is implemented, the process of detecting a defect point and the process of confirming total length may be implemented again. By doing in this way, a silicon carbide substrate with fewer linear defects can be prepared.

上記閾値が炭化珪素基板の主面の外接円の直径から、上記主面内に存在する線状欠陥の長手方向長さの総和を差し引いた値であってもよい。このような閾値を基準値として設定することで炭化珪素基板の表面状態をより適切に管理することができる。   The threshold value may be a value obtained by subtracting the sum of the longitudinal lengths of linear defects existing in the main surface from the diameter of the circumscribed circle of the main surface of the silicon carbide substrate. By setting such a threshold value as a reference value, the surface state of the silicon carbide substrate can be managed more appropriately.

上記主面の外接円の直径が150mm以上200mm以下であってもよい。このような大きさの主面を備えた炭化珪素基板は、半導体装置用の炭化珪素エピ基板を作成するのに好適である。   The circumscribed circle diameter of the main surface may be 150 mm or greater and 200 mm or less. A silicon carbide substrate having such a main surface is suitable for producing a silicon carbide epi-substrate for a semiconductor device.

上記炭化珪素エピ基板の製造方法においては、画像処理により欠陥点を検出する工程および総長さを確認する工程のうち少なくとも一つの工程を実施してもよい。画像処理を利用することで、欠陥の検出および有効帯状領域長さの総和である総長さの確認をより効率的に実施することができる。   In the method for manufacturing the silicon carbide epi substrate, at least one of a step of detecting a defect point by image processing and a step of confirming the total length may be performed. By utilizing image processing, it is possible to more efficiently carry out detection of defects and confirmation of the total length, which is the sum of effective band-like region lengths.

[本願発明の実施形態の詳細]
次に、本願の炭化珪素エピ基板の製造方法の実施の形態を、図面を参照しつつ説明する。以下の図面において同一又は相当する部分には同一の参照番号を付しその説明は繰返さない。
[Details of the embodiment of the present invention]
Next, an embodiment of a method for manufacturing a silicon carbide epi-substrate of the present application will be described with reference to the drawings. In the following drawings, the same or corresponding parts are denoted by the same reference numerals, and description thereof will not be repeated.

[炭化珪素エピ基板の製造方法]
図1〜図13を参照して本発明の一実施の形態について説明する。図1は炭化珪素エピ基板の製造方法の手順を示すフローチャートである。図2は炭化珪素基板の構造を示す斜視図である。図3は炭化珪素基板の断面の構造を示す概略断面図である。図4は炭化珪素基板とその主面に存在する欠陥点を示す模式図である。図5〜図10は、それぞれ、総長さを決定する方法を説明するための概略図である。図11は有効帯状領域を示す模式図である。図12は炭化珪素基板の主面上の有効帯状領域を示す模式図である。図13は炭化珪素エピ基板の断面の構造を示す概略断面図である。
[Method for producing silicon carbide epi-substrate]
An embodiment of the present invention will be described with reference to FIGS. FIG. 1 is a flowchart showing a procedure of a method for manufacturing a silicon carbide epi-substrate. FIG. 2 is a perspective view showing the structure of the silicon carbide substrate. FIG. 3 is a schematic cross-sectional view showing a cross-sectional structure of the silicon carbide substrate. FIG. 4 is a schematic diagram showing a silicon carbide substrate and defect points existing on its main surface. 5 to 10 are schematic diagrams for explaining a method of determining the total length, respectively. FIG. 11 is a schematic diagram showing an effective band-like region. FIG. 12 is a schematic diagram showing an effective band-like region on the main surface of the silicon carbide substrate. FIG. 13 is a schematic cross-sectional view showing a cross-sectional structure of the silicon carbide epi-substrate.

図1を参照して、本実施の形態に係る炭化珪素エピ基板の製造方法は、ステップS10〜ステップS50の各ステップと、必要に応じてステップS60とを含む。以下に各工程の詳細を説明する。   Referring to FIG. 1, the method for manufacturing a silicon carbide epi substrate according to the present embodiment includes steps S <b> 10 to S <b> 50 and step S <b> 60 as necessary. Details of each step will be described below.

[基板準備工程]
図1〜図3を参照して、まず炭化珪素からなり、主面10Aを有する炭化珪素基板10が準備される(ステップS10)。炭化珪素基板10は、炭化珪素の単結晶を所望の厚みにスライスし、その主面10Aを平坦化処理することにより得られる。主面10Aの平坦化処理は、例えば主面10Aに対する、MP(Mechanical Polishing)、CMP(Chemical Mechanical Polishing)などの研磨によって行う。その後、平坦化処理された主面10Aを洗浄することにより本実施の形態に係る炭化珪素基板10が得られる。本実施の形態において得られる炭化珪素基板10は、主面10Aの外接円の直径が150mm以上200mm以下の形状を有する。
[Board preparation process]
Referring to FIGS. 1 to 3, first, silicon carbide substrate 10 made of silicon carbide and having main surface 10A is prepared (step S10). Silicon carbide substrate 10 is obtained by slicing a single crystal of silicon carbide to a desired thickness and planarizing main surface 10A thereof. The flattening process of the main surface 10A is performed by polishing the main surface 10A, such as MP (Mechanical Polishing) or CMP (Chemical Mechanical Polishing). Thereafter, silicon carbide substrate 10 according to the present embodiment is obtained by cleaning planarized main surface 10A. Silicon carbide substrate 10 obtained in the present embodiment has a shape in which a circumscribed circle of main surface 10A has a diameter of 150 mm or greater and 200 mm or less.

[欠陥点検出工程]
次に、主面10Aに存在する欠陥点を検出する(ステップS20)。欠陥の検出は、例えば光学系を利用して欠陥の検出を行うウェハ欠陥検査装置により好適に実施することができる。ウェハ欠陥検査装置の例としては、共焦点微分干渉顕微鏡を備える欠陥検査装置としては、レーザーテック株式会社製のWASAVIシリーズ「SICA 6X」等が挙げられる。
[Defect point detection process]
Next, a defect point existing on the main surface 10A is detected (step S20). The defect detection can be suitably performed by, for example, a wafer defect inspection apparatus that detects defects using an optical system. As an example of a wafer defect inspection apparatus, as a defect inspection apparatus including a confocal differential interference microscope, a WASAVI series “SICA 6X” manufactured by Lasertec Corporation may be used.

本実施の形態において検出される欠陥点は、例えば周囲の領域からの深さが10nm以上の凹部又は周囲の領域からの高さが10nm以上の凸部である点状の欠陥とする。また本実施の形態においては、点状の欠陥のうち、直径10μmの範囲内に含まれる欠陥群は単一の欠陥点として検出する。   The defect point detected in the present embodiment is, for example, a point-like defect having a recess having a depth of 10 nm or more from the surrounding region or a protrusion having a height of 10 nm or more from the surrounding region. In the present embodiment, among the dot-like defects, the defect group included in the range of 10 μm in diameter is detected as a single defect point.

図4を参照して、炭化珪素基板10の主面10Aには、例えば欠陥点P〜欠陥点P、並びに欠陥点Qおよび欠陥点Qが存在するものとする。ステップS20においてはこれらの欠陥点を検出する。このとき、主面10Aに存在する全欠陥点を検出するのが好ましい。なおステップS20において検出される炭化珪素基板10の主面10A上の他の欠陥点については図示を省略する。 Referring to FIG. 4, it is assumed that, for example, defect point P 1 to defect point P 4 , defect point Q 1, and defect point Q 2 exist on main surface 10A of silicon carbide substrate 10. In step S20, these defect points are detected. At this time, it is preferable to detect all defect points present on the main surface 10A. Illustration of other defect points on main surface 10A of silicon carbide substrate 10 detected in step S20 is omitted.

[総長さ確認工程]
次に、欠陥点のうち、直線状に並ぶ欠陥点群に対応する線分の長さの、主面10A内における総和である総長さを確認する(ステップS30)。図4には、直線状に並ぶ欠陥点P〜欠陥点Pからなる欠陥点群が示されている。本実施の形態においては、直線状に並ぶ上記欠陥点群に対応する線分の長さ(すなわち、図10における欠陥点P3〜欠陥点P間の、第1の欠陥点Pと第2の欠陥点Pとを結ぶ方向の長さ)を求める場合を例として説明する。
[Total length confirmation process]
Next, the total length which is the sum total in the main surface 10A of the length of the line segment corresponding to the defect point group arranged in a straight line among the defect points is confirmed (step S30). FIG. 4 shows a defect point group including defect points P 1 to P 4 arranged in a straight line. In this embodiment, the length of the line corresponding to the defective point group arranged in a straight line (i.e., between the defect points P 3 ~ defect point P z in FIG. 10, a first defect point P 1 second The case where the length in the direction connecting the two defect points P2) is determined will be described as an example.

なお総長さの確認は画像処理用のソフトウェアを用いた画像処理により行ってもよく、ウェハ欠陥検査装置において主面10Aの写真を取得し、その写真に対し画像処理を行うことによって確認してもよい。また主面10Aの写真を取得し、目視にて総長さを確認することも可能である。   The total length may be confirmed by image processing using image processing software, or may be confirmed by acquiring a photograph of the main surface 10A in the wafer defect inspection apparatus and performing image processing on the photograph. Good. It is also possible to obtain a photograph of the main surface 10A and visually confirm the total length.

本実施の形態において、具体的には以下のような手順で上記総長さを確認する。図5を参照して、まずステップS20において検出された欠陥点のうち、任意の第1の欠陥点Pと、第1の欠陥点からの距離が10μm以上600μm以下である第2の欠陥点Pとを抽出する。次に第1の欠陥点Pと第2の欠陥点Pとを含むように幅Wが20μmの直線帯状領域20を設定する。直線帯状領域20は、境界線21と境界線22とに挟まれた領域である。 In the present embodiment, specifically, the total length is confirmed by the following procedure. Referring to FIG. 5, first, among the detected defect point in step S20, the defect point P 1 of the arbitrary first, second defect point distance from the first defect point of 10μm or more 600μm or less to extract and P 2. Next, a straight belt-like region 20 having a width W of 20 μm is set so as to include the first defect point P 1 and the second defect point P 2 . The straight belt-like region 20 is a region sandwiched between the boundary line 21 and the boundary line 22.

次に図6〜図11を参照して、直線帯状領域20のうち有効帯状領域50を抽出する。有効帯状領域50は、直線帯状領域20の第1の欠陥点Pと第2の欠陥点Pとを結ぶ方向の、第1の欠陥点Pから見て第2の欠陥点P側(図6において矢印Dの向きで示される側)および第1の欠陥点Pから見て第2の欠陥点とは反対側(図6において矢印Dの向きで示される側)に向けて、10μm以上600μm以下の距離範囲内に他の欠陥点が存在することを条件に、上記他の欠陥点まで順次延長して形成される直線帯状の部分である。 Next, referring to FIG. 6 to FIG. 11, the effective belt-like region 50 is extracted from the straight belt-like region 20. The effective band region 50 is on the second defect point P 2 side as viewed from the first defect point P 1 in the direction connecting the first defect point P 1 and the second defect point P 2 of the straight band region 20. towards (side indicated by the direction of arrow D 2 in FIG. 6) opposite to the second defect point when viewed from and the first defect point P 1 (the side indicated by the direction of arrow D 1 in FIG. 6) In other words, it is a straight belt-like portion formed by sequentially extending to the other defect points on condition that another defect point exists within a distance range of 10 μm or more and 600 μm or less.

図6〜図11を参照して有効帯状領域50を抽出する方法を具体的に説明する。図6を参照して、まず直線帯状領域20内であって、第1の欠陥点Pから見て矢印Dの向きの、第1の欠陥点Pからの距離が10μm以上600μm以下の範囲30内に他の欠陥点が存在するか否かを確認する。図6に示すように、範囲30内には第2の欠陥点Pが存在する。そのため、図7に示すように有効帯状領域50が矢印Dの向きに第2の欠陥点Pまで延長される。一方、図6を参照して、直線帯状領域20の外に存在する欠陥点Qは上記条件を満たさないため、有効帯状領域50を形成するための対象から除外される。 A method for extracting the effective band-like region 50 will be specifically described with reference to FIGS. Referring to FIG 6, first, a within the linear band-like region 20, the first defect point P 1 from seeing arrow D 1 direction, the distance from the first defect point P 1 is less 600μm or 10μm It is confirmed whether or not there is another defect point within the range 30. As shown in FIG. 6, the second defect point P < b > 2 exists within the range 30. Therefore, as shown in FIG. 7, the effective belt-like region 50 is extended to the second defect point P 2 in the direction of the arrow D 1 . On the other hand, referring to FIG. 6, defect point Q 1 existing outside straight belt-like region 20 does not satisfy the above condition, and is excluded from the object for forming effective belt-like region 50.

また直線帯状領域20内であって、第1の欠陥点Pから見て矢印Dの向き(第1の欠陥点Pから見て第2の欠陥点Pとは反対側)の、第1の欠陥点Pからの距離が10μm以上600μm以下の範囲32内に他の欠陥点が存在するか否かを確認する。図6に示すように、範囲32内には第3の欠陥点Pが存在する。そのため、図7に示すように有効帯状領域50が矢印Dの向きに第3の欠陥点Pまで延長される。 The A within the linear band-like region 20, the arrow D 2 when viewed from the first defect point P 1 the orientation of the (first opposite side of the second defect point P 2 as viewed from the defect point P 1), It is confirmed whether or not there is another defect point in the range 32 where the distance from the first defect point P1 is 10 μm or more and 600 μm or less. As shown in FIG. 6, the third defect point P 3 exists in the range 32. Therefore, the effective band-like region 50 as shown in FIG. 7 is extended to third defect point P 3 in the direction of arrow D 2.

図8〜図10を参照して、同様の処理を、上記条件を満たす他の欠陥点が存在しなくなるまで繰り返す。図8を参照して、直線帯状領域20内であって、第1の欠陥点Pから見て矢印Dの向きの、有効帯状領域50の一方の端部(第2の欠陥点Pを含む端部)からの距離が10μm以上600μm以下の範囲34内には、第4の欠陥点Pが存在する。したがって、有効帯状領域50は矢印D側に第4の欠陥点Pまで延長される。 With reference to FIGS. 8 to 10, the same processing is repeated until there is no other defect point that satisfies the above conditions. Referring to FIG. 8, one end portion (second defect point P 2) of effective band region 50 in straight band region 20 and in the direction of arrow D 1 as viewed from first defect point P 1. distance from the end) containing the within the range 34 600 .mu.m or 10 [mu] m, the fourth defect point P 4 exists. Therefore, the effective belt-like region 50 is extended to the fourth defect point P 4 on the arrow D 1 side.

一方、図8を参照して、直線帯状領域20内であって、第1の欠陥点Pから見て矢印Dの向きの、有効帯状領域50のもう一方の端部(第3の欠陥点Pを含む端部)からの距離が10μm以上600μm以下の範囲36内には他の欠陥点が存在しない。直線帯状領域20内ではあるが範囲36の外にある欠陥点Qは、上記条件を満たさないため有効帯状領域50を形成するための対象から除外される。 On the other hand, referring to FIG. 8, a within the linear band-like region 20, the orientation arrow D 2 when viewed from the first defect point P 1, the other end of the effective belt region 50 (third defect other defects point does not exist in the distance 10μm or 600μm within the range 36 from the end portion) including point P 3. There is within the linear band-like region 20 but a defect point Q 2 to which are outside the scope 36 is excluded from for forming the effective band-like region 50 for the above condition is not met.

ここで上記距離範囲の上限が600μmであるのは、有効帯状領域50の端部からの最短距離が600μmを超える位置に存在する欠陥点は、有効帯状領域50に含まれる他の欠陥点群とは関連性が低く、有効帯状領域50に含まれる他の欠陥点群と関連してエピ層における線状欠陥を形成するおそれは比較的低いと考えられるからである。具体的には、欠陥点P,P,P,Pからなる欠陥点群はエピ層における線状欠陥の原因となり得るが、その線状欠陥が、欠陥点Pからの距離が600μmを超える欠陥点Qに対応するエピ層上の位置にまで到達するおそれは比較的低いと考えられるからである。一方、下限を10μmとするのは、互いの距離が10μm以内の複数の欠陥点については、単一の欠陥点として取り扱っても上記総長さを確認するのに十分だからである。 Here, the upper limit of the distance range is 600 μm because the defect points existing at the position where the shortest distance from the end of the effective band region 50 exceeds 600 μm are the other defect point groups included in the effective band region 50. This is because the relationship is low, and it is considered that the risk of forming a linear defect in the epilayer in relation to other defect point groups included in the effective band-like region 50 is relatively low. Specifically, a defect point group including defect points P 1 , P 2 , P 3 , and P 4 can cause a linear defect in the epi layer, but the linear defect has a distance from the defect point P 3. possibility of reaching the position on the epitaxial layer corresponding to the defective point Q 2 to which more than 600μm is because it is considered to be relatively low. On the other hand, the lower limit is set to 10 μm because a plurality of defect points whose distances are within 10 μm are sufficient to confirm the total length even if they are handled as a single defect point.

このように、第3の欠陥点Pよりも矢印Dの向きにはこれ以上有効帯状領域50は延長されない。この時点で、図9に示すように、有効帯状領域50は第3の欠陥点Pおよび第4の欠陥点Pまで延長される。 Thus, the third more effective band-like region 50 in the direction of arrow D 2 than the defect point P 3 is not extended. At this point, as shown in FIG. 9, the effective band-like region 50 is extended to third defect point P 3 and the fourth defect point P 4.

図10を参照して、上記同様の条件で直線帯状領域20の範囲内で矢印Dの向きに有効帯状領域50を順次延長する。最終的に、欠陥点PZ−1から矢印Dの向きに10μm以上600μm以下の距離範囲内にある欠陥点であって、その欠陥点から矢印Dの向きに10μm以上600μm以下の距離範囲38内には他の欠陥点が存在しない欠陥点Pまで有効帯状領域50を延長する。このようにして図11に示すような有効帯状領域50が抽出される。上記Zは5以上の整数である。 Referring to FIG. 10, successively extending the effective band-like region 50 in the direction of arrow D 1 in the range of the linear band-like region 20 in the above same conditions. Finally, a defect point within a distance range of 10 μm or more and 600 μm or less from the defect point P Z-1 in the direction of arrow D 1 , and a distance range of 10 μm or more and 600 μm or less from the defect point in the direction of arrow D 1 The effective belt-like region 50 is extended to the defect point P z in which no other defect point exists in 38. In this way, an effective band-like region 50 as shown in FIG. 11 is extracted. Z is an integer of 5 or more.

本実施の形態における有効帯状領域50は、直線帯状の部分であって、その部分内に5以上の欠陥点が存在する。また有効帯状領域50の、第1の欠陥点Pと第2の欠陥点Pとを結ぶ方向の長さLは1mm以上である。仮に直線帯状の部分に含まれる欠陥点の数が4以下であれば本実施の形態においては有効帯状領域50としては取り扱わないこととする。同様に、長さLが1mm未満であれば有効帯状領域50としては取り扱わないこととする。 The effective belt-like region 50 in the present embodiment is a straight belt-like portion, and five or more defect points exist in the portion. Further, the length L 1 in the direction connecting the first defect point P 1 and the second defect point P 2 of the effective belt-like region 50 is 1 mm or more. If the number of defect points included in the straight strip portion is 4 or less, the effective strip region 50 is not handled in the present embodiment. Similarly, if the length L1 is less than 1 mm, the effective band-like region 50 is not handled.

なお、有効帯状領域50を決定するにあたり、上記有効帯状領域50に含まれる欠陥点の数の下限値は必ずしも5である必要はなく、例えば3または10のように適宜設定することができる。また有効帯状領域50の、第1の欠陥点Pと第2の欠陥点Pとを結ぶ方向の長さLの下限値についても必ずしも1mmである必要はなく、例えば0.5mmまたは1.5mmとすることもできる。 In determining the effective band-like region 50, the lower limit value of the number of defect points included in the effective band-like region 50 is not necessarily 5 and can be set as appropriate, for example, 3 or 10. Further, the lower limit value of the length L 1 in the direction connecting the first defect point P 1 and the second defect point P 2 of the effective band-shaped region 50 is not necessarily 1 mm, for example 0.5 mm or 1 .5 mm can also be used.

次に図12を参照して同様の操作を主面10A全体において行い、主面10A上の有効帯状領域50,52,54を抽出する。このとき、既に他の有効帯状領域を決定するために用いた欠陥点が重複しないように抽出する。上記のようにして抽出した有効帯状領域50,52,54の、第1の欠陥点Pと第2の欠陥点Pとを結ぶ方向の長さL,L,L,・・・の総和である総長さ(L+L+L+・・・)を確認する。 Next, referring to FIG. 12, the same operation is performed on the entire main surface 10A to extract the effective band-like regions 50, 52, and 54 on the main surface 10A. At this time, extraction is performed so that the defect points already used for determining other effective band-like regions do not overlap. Lengths L 1 , L 2 , L 3 ,... In the direction connecting the first defect point P 1 and the second defect point P 2 of the effective strip regions 50, 52, 54 extracted as described above. • Check the total length (L 1 + L 2 + L 3 +...) That is the sum of

[総長さと閾値との比較]
次にステップS30において確認された上記総長さ(L+L+L+・・・)を所定の閾値と対比し、総長さが閾値以下であるか否かを確認する(ステップS40)。所定の閾値は、例えば主面10Aの外接円の直径に基づいて、その直径から、主面10Aに存在する線状欠陥(スクラッチ)の長手方向長さの総和を差し引いた値とすることができる。言い換えると、主面10Aに存在する線状欠陥(スクラッチ)の長手方向長さと、有効帯状領域50,52,54の、第1の欠陥点Pと第2の欠陥点Pとを結ぶ方向の長さの総和(L+L+L+・・・)との和が主面10Aの外接円の直径以下であることが確認される。このような閾値を設定することで、主面10Aの表面状態を適切に管理し、エピ層表面での線状欠陥の発生率を低減することができる。
[Comparison of total length and threshold]
Next, the total length (L 1 + L 2 + L 3 +...) Confirmed in step S30 is compared with a predetermined threshold value to check whether the total length is equal to or less than the threshold value (step S40). The predetermined threshold value can be a value obtained by subtracting the sum of the longitudinal lengths of linear defects (scratches) present on the main surface 10A from the diameter based on the diameter of the circumscribed circle of the main surface 10A, for example. . In other words, the direction connecting the longitudinal length of the linear defects existing on the main surface 10A (scratching), the effective band-like region 50, 52, 54, the first defect point P 1 and the second defect point P 2 It is confirmed that the sum of the total lengths (L 1 + L 2 + L 3 +...) Is equal to or smaller than the diameter of the circumscribed circle of the main surface 10A. By setting such a threshold value, the surface state of the main surface 10A can be appropriately managed, and the incidence rate of linear defects on the epilayer surface can be reduced.

[エピタキシャル層形成工程]
最後に、ステップS40において、炭化珪素基板10の主面10Aにおける上記総長さが所定の閾値以下であることが確認された場合(ステップS40においてYESの場合)、その主面10A上にエピタキシャル層(エピ層)が形成される(ステップS50)。
[Epitaxial layer formation process]
Finally, in step S40, when it is confirmed that the total length on main surface 10A of silicon carbide substrate 10 is equal to or smaller than a predetermined threshold value (in the case of YES in step S40), an epitaxial layer (on the main surface 10A) An epi layer is formed (step S50).

図1、図2および図12を参照して、ステップS50では、炭化珪素基板10の主面10Aに対してサーマルクリーニング、水素エッチングなどが実施されて主面10Aの清浄性が確保された後、主面10A上に炭化珪素からなる半導体層がエピタキシャル成長により形成される。具体的には、導電型がn型である炭化珪素基板10の主面10A上に、エピタキシャル成長により導電型がn型である炭化珪素からなるバッファ層60が形成される。さらにバッファ層60の主面60A上に導電型がn型である炭化珪素からなるドリフト層70が形成される。バッファ層60およびドリフト層70は、たとえばn型不純物を含む原料ガスを用いた気相エピタキシャル成長が実施されることにより順次形成される。このようにして主面10A上にエピタキシャル層(バッファ層60およびドリフト層70)が形成された炭化珪素エピ基板100が製造される。   Referring to FIGS. 1, 2 and 12, in step S50, after the main surface 10A of silicon carbide substrate 10 is subjected to thermal cleaning, hydrogen etching, etc. to ensure the cleanliness of main surface 10A, A semiconductor layer made of silicon carbide is formed on main surface 10A by epitaxial growth. Specifically, buffer layer 60 made of silicon carbide having n-type conductivity is formed by epitaxial growth on main surface 10A of silicon carbide substrate 10 having n-type conductivity. Further, drift layer 70 made of silicon carbide having n-type conductivity is formed on main surface 60A of buffer layer 60. The buffer layer 60 and the drift layer 70 are sequentially formed by performing vapor phase epitaxial growth using, for example, a source gas containing an n-type impurity. Thus, silicon carbide epi-substrate 100 having epitaxial layers (buffer layer 60 and drift layer 70) formed on main surface 10A is manufactured.

[研磨工程]
ステップS40において確認される有効帯状領域の、第1の欠陥点Pと第2の欠陥点Pとを結ぶ方向の長さの総和が所定の閾値を超えると確認された場合(ステップS40においてNOの場合)、主面10Aを研磨する工程(ステップS60)を行ってもよい。主面10Aの研磨は、上述のMP、CMPなどの研磨法により行うことができる。
[Polishing process]
The effective band-like region which is confirmed in step S40, if the first defect point P 1 and the second sum direction length connecting the defect point P 2 is confirmed to exceed a predetermined threshold value (in step S40 In the case of NO), a step of polishing the main surface 10A (step S60) may be performed. The main surface 10A can be polished by the above-described polishing methods such as MP and CMP.

また主面10Aを研磨する工程が実施された場合、欠陥点を検出する工程(ステップS20)および総長さを確認する工程(ステップS30)が再度実施されてもよい。総長さを確認する工程(ステップS30)が再度実施され、総長さが所定の閾値以下であることが確認されると、主面10A上にエピタキシャル層(バッファ層60およびドリフト層70)が形成されることにより炭化珪素エピ基板100が製造される(ステップS50)。   Moreover, when the process of grind | polishing 10 A of main surfaces is implemented, the process (step S20) which detects a defect point, and the process (step S30) which confirms total length may be implemented again. The step of confirming the total length (step S30) is performed again, and when it is confirmed that the total length is equal to or less than a predetermined threshold, an epitaxial layer (buffer layer 60 and drift layer 70) is formed on main surface 10A. Thus, silicon carbide epi substrate 100 is manufactured (step S50).

以上が本実施の形態の説明である。なお上記実施形態においては、欠陥点を検出することについてのみ説明したが、同時にスクラッチなどの他の傷や欠陥を検出するようにしてもよい。   The above is the description of the present embodiment. In the above embodiment, only the detection of the defect point has been described, but other scratches and defects such as a scratch may be detected at the same time.

またステップS30において確認される有効帯状領域50,52,54,・・・の、第1の欠陥点Pと第2の欠陥点Pとを結ぶ方向の長さの総和が所定の閾値を超えると確認された場合(ステップS40においてNOの場合)、研磨工程(ステップS60)を行う代わりに、そのような炭化珪素基板10を不良品として廃棄処理することも可能である。 The effective band-like region is confirmed in step S30 50, 52, 54, of ..., the first defect point P 1 and the second sum direction length connecting the defect point P 2 is a predetermined threshold value When it is confirmed that it exceeds (NO in step S40), instead of performing the polishing step (step S60), such silicon carbide substrate 10 may be discarded as a defective product.

また上記実施の形態においては、上記所定の閾値を、主面10Aの外接円の直径に基づいて、その直径から、主面10Aに存在する線状欠陥(スクラッチ)の長手方向長さの総和を差し引いた値としたが、閾値は適宜設定可能である。例えば主面10A内の検出すべき欠陥点群の管理の厳密度に応じて、閾値をより小さい値に設定したり、その逆に閾値をより大きい値に設定したりすることもできる。   In the above-described embodiment, the predetermined threshold value is calculated based on the diameter of the circumscribed circle of the main surface 10A, and the sum of the longitudinal lengths of linear defects (scratches) existing on the main surface 10A is calculated from the diameter. Although the subtracted value is used, the threshold can be set as appropriate. For example, the threshold value can be set to a smaller value, or conversely, the threshold value can be set to a larger value according to the strictness of management of the defect point group to be detected in the main surface 10A.

このように上記炭化珪素エピ基板の製造方法によれば、エピ層表面での線状欠陥の発生が抑制された炭化珪素エピ基板を提供することができる。   Thus, according to the manufacturing method of the said silicon carbide epi substrate, the silicon carbide epi substrate by which generation | occurrence | production of the linear defect in the epi layer surface was suppressed can be provided.

今回開示された実施の形態はすべての点で例示であって、どのような面からも制限的なものではないと理解されるべきである。本発明の範囲は上記した意味ではなく、特許請求の範囲によって示され、特許請求の範囲と均等の意味及び範囲内でのすべての変更が含まれることが意図される。   It should be understood that the embodiments disclosed herein are illustrative in all respects and are not restrictive in any aspect. The scope of the present invention is defined by the terms of the claims, rather than the meaning described above, and is intended to include any modifications within the scope and meaning equivalent to the terms of the claims.

本願の炭化珪素エピ基板の製造方法は、エピ層表面での線状欠陥の発生が抑制された炭化珪素エピ基板を製造することが求められる技術分野において、特に有利に適用され得る。   The method for manufacturing a silicon carbide epi-substrate of the present application can be applied particularly advantageously in a technical field where it is required to manufacture a silicon carbide epi-substrate in which the occurrence of linear defects on the epi layer surface is suppressed.

10 炭化珪素基板
10A 主面
20 直線帯状領域
21 境界線
22 境界線
30 範囲
32 範囲
34 範囲
36 範囲
38 範囲
50 有効帯状領域
52 有効帯状領域
54 有効帯状領域
60 バッファ層
60A 主面
70 ドリフト層
100 炭化珪素エピ基板
DESCRIPTION OF SYMBOLS 10 Silicon carbide substrate 10A Main surface 20 Straight strip region 21 Boundary line 22 Boundary line 30 Range 32 Range 34 Range 36 Range 38 Range 50 Effective strip region 52 Effective strip region 54 Effective strip region 60 Buffer layer 60A Main surface 70 Drift layer 100 Carbonization Silicon epi substrate

Claims (10)

炭化珪素からなり、主面を有する炭化珪素基板を準備する工程と、
前記主面に存在する凹部又は凸部である欠陥点を検出する工程と、
前記欠陥点のうち、直線状に並ぶ欠陥点群に対応する線分の長さの、前記主面内における総和である総長さを確認する工程と、
前記総長さが所定の閾値以下であることが確認された前記主面上にエピタキシャル層を形成する工程と、を含む、炭化珪素エピ基板の製造方法。
A step of preparing a silicon carbide substrate made of silicon carbide and having a main surface;
Detecting a defect point which is a concave portion or a convex portion existing on the main surface;
Of the defect points, the step of confirming the total length that is the sum of the lengths of the line segments corresponding to the defect point group arranged in a straight line in the main surface;
Forming an epitaxial layer on the main surface where the total length is confirmed to be equal to or less than a predetermined threshold value.
前記総長さを確認する工程において、
前記欠陥点のうち、任意の第1の欠陥点と、前記第1の欠陥点からの距離が10μm以上600μm以下である第2の欠陥点とを含む直線帯状領域を設定し、前記直線帯状領域のうち、前記直線帯状領域の前記第1の欠陥点と前記第2の欠陥点とを結ぶ方向の、前記第1の欠陥点から見て前記第2の欠陥点側および前記第1の欠陥点から見て前記第2の欠陥点とは反対側に向けて、10μm以上600μm以下の距離範囲内に他の前記欠陥点が存在することを条件に前記他の欠陥点まで順次延長して形成される直線帯状の有効帯状領域を抽出し、前記有効帯状領域の、前記第1の欠陥点と前記第2の欠陥点とを結ぶ方向の長さを前記線分の長さとして求め、
前記総長さとして、前記有効帯状領域を決定するために用いた前記欠陥点が重複しないように前記有効帯状領域を前記主面全体において抽出し、抽出された前記有効帯状領域に対応する前記線分の長さの総和を求める、請求項1に記載の炭化珪素エピ基板の製造方法。
In the step of checking the total length,
Among the defect points, a straight band region including an arbitrary first defect point and a second defect point having a distance of 10 μm or more and 600 μm or less from the first defect point is set, and the straight band region Among the first defect point side and the first defect point in the direction connecting the first defect point and the second defect point in the straight belt-like region, as viewed from the first defect point. From the viewpoint of the second defect point, the second defect point is formed so as to extend to the other defect point on the condition that another defect point exists within a distance range of 10 μm to 600 μm. The effective strip region is extracted as a length of the line segment in the direction connecting the first defect point and the second defect point of the effective strip region,
As the total length, the effective band area is extracted in the entire main surface so that the defect points used for determining the effective band area do not overlap, and the line segment corresponding to the extracted effective band area is extracted. The method for manufacturing a silicon carbide epi-substrate according to claim 1, wherein a total sum of the lengths is calculated.
前記総長さを確認する工程において設定される前記直線帯状領域の幅は20μmである、請求項2に記載の炭化珪素エピ基板の製造方法。   3. The method for manufacturing a silicon carbide epi substrate according to claim 2, wherein a width of the linear strip region set in the step of checking the total length is 20 μm. 前記総長さを確認する工程において、5以上の前記欠陥点を含むように前記有効帯状領域を設定する、請求項2又は請求項3のいずれか1項に記載の炭化珪素エピ基板の製造方法。   4. The method of manufacturing a silicon carbide epi substrate according to claim 2, wherein in the step of confirming the total length, the effective band-like region is set so as to include five or more defect points. 5. 前記総長さを確認する工程において、長さが1mm以上である前記線分の長さの総和を前記総長さとする、請求項1〜請求項4のいずれか1項に記載の炭化珪素エピ基板の製造方法。   5. The silicon carbide epi-substrate according to claim 1, wherein in the step of checking the total length, a total length of the line segments having a length of 1 mm or more is set as the total length. Production method. 前記欠陥点を検出する工程において、前記欠陥点として、周囲の領域からの深さが10nm以上の凹部又は周囲の領域からの高さが10nm以上の凸部である欠陥点を検出する、請求項1〜請求項5のいずれか1項に記載の炭化珪素エピ基板の製造方法。   The step of detecting the defect point, wherein the defect point is a defect point that is a recess having a depth of 10 nm or more from a surrounding region or a projection having a height of 10 nm or more from the surrounding region. The method for manufacturing a silicon carbide epi-substrate according to any one of claims 1 to 5. 前記総長さを確認する工程において、前記総長さが前記閾値を超えると確認された場合、前記主面を研磨する工程をさらに含み、
前記主面を研磨する工程が実施された場合、前記欠陥点を検出する工程および前記総長さを確認する工程が再度実施される請求項1〜請求項6のいずれか1項に記載の炭化珪素エピ基板の製造方法。
In the step of confirming the total length, if it is confirmed that the total length exceeds the threshold, the method further includes a step of polishing the main surface,
The silicon carbide according to any one of claims 1 to 6, wherein when the step of polishing the main surface is performed, the step of detecting the defect point and the step of confirming the total length are performed again. Epi substrate manufacturing method.
前記閾値が前記主面の外接円の直径から、前記主面内に存在する線状欠陥の長手方向長さの総和を差し引いた値である請求項1〜請求項7のいずれか1項に記載の炭化珪素エピ基板の製造方法。   8. The value according to claim 1, wherein the threshold value is a value obtained by subtracting a sum total of longitudinal lengths of linear defects existing in the main surface from a diameter of a circumscribed circle of the main surface. Of manufacturing a silicon carbide epi-substrate. 前記主面の外接円の直径が150mm以上200mm以下である請求項1〜請求項8のいずれか1項に記載の炭化珪素エピ基板の製造方法。   The method for manufacturing a silicon carbide epi-substrate according to any one of claims 1 to 8, wherein a diameter of a circumscribed circle of the main surface is not less than 150 mm and not more than 200 mm. 画像処理により前記欠陥点を検出する工程および前記総長さを確認する工程のうち少なくとも一つの工程を実施する請求項1〜請求項9のいずれか1項に記載の炭化珪素エピ基板の製造方法。   The method for manufacturing a silicon carbide epi substrate according to any one of claims 1 to 9, wherein at least one of a step of detecting the defect point by image processing and a step of confirming the total length is performed.
JP2017155844A 2017-08-10 2017-08-10 Method for manufacturing silicon carbide epitaxial substrate Pending JP2019034862A (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP2017155844A JP2019034862A (en) 2017-08-10 2017-08-10 Method for manufacturing silicon carbide epitaxial substrate

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP2017155844A JP2019034862A (en) 2017-08-10 2017-08-10 Method for manufacturing silicon carbide epitaxial substrate

Publications (1)

Publication Number Publication Date
JP2019034862A true JP2019034862A (en) 2019-03-07

Family

ID=65636902

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2017155844A Pending JP2019034862A (en) 2017-08-10 2017-08-10 Method for manufacturing silicon carbide epitaxial substrate

Country Status (1)

Country Link
JP (1) JP2019034862A (en)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2021166161A1 (en) * 2020-02-20 2021-08-26 株式会社日立ハイテク Defect inspection system, defect inspection method, and method for creating teacher data

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2021166161A1 (en) * 2020-02-20 2021-08-26 株式会社日立ハイテク Defect inspection system, defect inspection method, and method for creating teacher data

Similar Documents

Publication Publication Date Title
JP5839069B2 (en) Silicon carbide single crystal substrate, silicon carbide epitaxial substrate, and manufacturing method thereof
AU2014236652B2 (en) Methods for improving solar cell lifetime and efficiency
JP4552858B2 (en) Manufacturing method of bonded wafer
CN106992113B (en) Semiconductor wafer, semiconductor structure and method for manufacturing semiconductor wafer
KR20120101097A (en) Sic epitaxial wafer and method for manufacturing same
JP6441088B2 (en) Silicon wafer manufacturing method and semiconductor device manufacturing method
JP2010016078A (en) Silicon monocrystal wafer, method for manufacturing the silicon monocrystal wafer and method for evaluating the silicon monocrystal wafer
TWI400743B (en) Silicon wafer and its manufacturing method
JP2016058623A (en) Processing method for semiconductor wafer, manufacturing method of bonded wafer, and manufacturing method of epitaxial wafer
CN110060959B (en) Method for manufacturing bonded wafer
JP2004186226A (en) Method for manufacturing soi wafer
JP2019034862A (en) Method for manufacturing silicon carbide epitaxial substrate
JP2011071193A (en) Lamination soi wafer and manufacturing method of the same
KR102454449B1 (en) Wafer manufacturing method
CN109690733B (en) Method for manufacturing bonded SOI wafer
KR20180031694A (en) Method for manufacturing a semiconductor wafer
EP3511976B1 (en) Bonding substrate surface defect evaluation method
JP2006294774A (en) Evaluation method of semiconductor wafer, evaluation device, and manufacturing method of semiconductor wafer
JP6260603B2 (en) Silicon carbide single crystal substrate, silicon carbide epitaxial substrate, and manufacturing method thereof
JP7217608B2 (en) SiC substrate, SiC epitaxial wafer and manufacturing method thereof
JP6443520B1 (en) Semiconductor wafer evaluation method and semiconductor wafer manufacturing method using the method
JP6150075B2 (en) Epitaxial wafer manufacturing method
KR102019658B1 (en) Soi wafer manufacturing method
JP2010153488A (en) Manufacturing method of soi wafer, and soi wafer
EP3742473A1 (en) Method for manufacturing bonded wafer, and bonded wafer