JP2019021070A - 情報処理装置、情報処理方法、及びプログラム - Google Patents
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Abstract
【解決手段】記憶部711は、処理対象データの仮想アドレス空間を示す情報を記憶する。処理部712は、仮想アドレス空間を介して処理対象データに対する所定の処理を行う。監視部713は、仮想アドレス空間に含まれる複数の領域のうち、監視対象として設定された複数の監視領域に対する、処理部712からのアクセスを監視する。制御部714は、複数の監視領域のうち、監視部713がアクセスを検出した監視領域の仮想アドレスに基づいて、所定の制御を行う。
【選択図】図7
Description
図1は、HPC並列ファイルシステムの構成例を示している。図1のHPC並列ファイルシステムは、計算ノード101−1〜計算ノード101−3及びデータノード102−1〜データノード102−3を含み、これらのノードは、通信ネットワーク104によって互いに接続されている。各データノード102−i(i=1〜3)は、記憶装置103−iを有する。計算ノード及びデータノードの個数は、4個以上であってもよい。
E3 G=8MB S=10MB
E4 G=10MB S=10MB
E5 G=8MB S=50MB
E6 G=10MB S=50MB
E7 G=32MB S=50MB
E8 G=8MB S=128MB
E9 G=10MB S=128MB
E10 G=32MB S=128MB
E11 G=128MB S=128MB
E12 G=8MB S=512MB
E13 G=32MB S=512MB
E14 G=128MB S=512MB
E15 G=512MB S=512MB
(付記1)
処理対象データの仮想アドレス空間を示す情報を記憶する記憶部と、
前記仮想アドレス空間を介して前記処理対象データに対する所定の処理を行う処理部と、
前記仮想アドレス空間に含まれる複数の領域のうち、監視対象として設定された複数の監視領域に対する、前記処理部からのアクセスを監視する監視部と、
前記複数の監視領域のうち、前記監視部がアクセスを検出した監視領域の仮想アドレスに基づいて、所定の制御を行う制御部と、
を備えることを特徴とする情報処理装置。
(付記2)
前記複数の監視領域は、前記仮想アドレス空間内において互いに隣接しない位置に設定され、
前記処理部は、前記所定の処理において、前記仮想アドレス空間に含まれる前記複数の領域に対して所定の順序でアクセスし、
前記監視部は、前記処理部が前記所定の処理を開始する前に、前記複数の監視領域それぞれを保護し、前記処理部が前記所定の処理を開始した後に、保護されている領域に対するアクセスを示す制御信号が発生した場合、前記制御信号に基づいて、アクセスが発生した監視領域を特定し、特定した監視領域の仮想アドレスを前記制御部へ出力することを特徴とする付記1記載の情報処理装置。
(付記3)
前記監視部は、前記特定した監視領域の保護を解除して、次の監視領域に対するアクセスを監視し、
前記処理部は、保護が解除された監視領域にアクセスすることで、前記所定の処理を行うことを特徴とする付記2記載の情報処理装置。
(付記4)
前記処理対象データは、通信ネットワークを介して前記情報処理装置と接続された複数のストレージ装置に分散して格納され、
前記記憶部は、前記仮想アドレス空間に含まれる前記複数の領域のうち一部の領域に対応するデータを記憶し、
前記制御部は、前記監視部がアクセスを検出した仮想アドレスに基づいて、前記処理部がアクセスする仮想アドレスのアドレス範囲を予測し、前記複数のストレージ装置のうち、予測したアドレス範囲の部分データを記憶するストレージ装置に対して、データ転送要求を送信し、前記部分データを記憶する前記ストレージ装置から受信した前記部分データを前記記憶部に格納することを特徴とする付記1乃至3のいずれか1項に記載の情報処理装置。
(付記5)
前記処理対象データは、第1プロセスから第2プロセスへ転送されるデータであり、
前記記憶部は、前記仮想アドレス空間に含まれる前記複数の領域のうち一部の領域に対応するデータを記憶し、
前記制御部は、前記第1プロセスが前記記憶部に前記処理対象データを書き込むように、前記第1プロセスを制御し、
前記処理部は、前記第2プロセスが前記記憶部から前記処理対象データを読み出すように、前記第2プロセスを制御し、
前記制御部は、前記監視部がアクセスを検出した仮想アドレスに基づいて、前記第1プロセスに、前記第2プロセスへ転送するデータを書き込ませることを特徴とする付記1乃至3のいずれか1項に記載の情報処理装置。
(付記6)
前記記憶部は、前記仮想アドレス空間に含まれる前記複数の領域のうち一部の領域に対応するデータを記憶するとともに、前記所定の処理において前記処理部がアクセスする仮想アドレスと、前記所定の処理における前記処理部の挙動を示す識別情報との対応関係を記憶し、
前記制御部は、前記対応関係に基づいて、前記監視部がアクセスを検出した仮想アドレスに対応する識別情報を出力することを特徴とする付記1乃至3のいずれか1項に記載の情報処理装置。
(付記7)
コンピュータが、
処理対象データの仮想アドレス空間を介して前記処理対象データに対する所定の処理を行い、
前記仮想アドレス空間に含まれる複数の領域のうち、監視対象として設定された複数の監視領域に対するアクセスを監視し、
前記複数の監視領域のうち、アクセスを検出した監視領域の仮想アドレスに基づいて、所定の制御を行う、
ことを特徴とする情報処理方法。
(付記8)
前記複数の監視領域は、前記仮想アドレス空間内において互いに隣接しない位置に設定され、
前記コンピュータは、前記所定の処理を開始する前に、前記複数の監視領域それぞれを保護し、前記所定の処理において、前記仮想アドレス空間に含まれる前記複数の領域に対して所定の順序でアクセスし、保護されている領域に対するアクセスを示す制御信号が発生した場合、前記制御信号に基づいて、アクセスが発生した監視領域を特定し、特定した監視領域の仮想アドレスを前記制御部へ出力することを特徴とする付記7記載の情報処理方法。
(付記9)
前記コンピュータは、前記特定した監視領域の保護を解除して、次の監視領域に対するアクセスを監視し、保護が解除された監視領域にアクセスすることで、前記所定の処理を行うことを特徴とする付記8記載の情報処理方法。
(付記10)
前記処理対象データは、通信ネットワークを介して前記情報処理装置と接続された複数のストレージ装置に分散して格納され、
前記コンピュータは、前記仮想アドレス空間に含まれる前記複数の領域のうち一部の領域に対応するデータを記憶する記憶部を含み、
前記コンピュータは、前記アクセスを検出した仮想アドレスに基づいて、アクセスする仮想アドレスのアドレス範囲を予測し、前記複数のストレージ装置のうち、予測したアドレス範囲の部分データを記憶するストレージ装置に対して、データ転送要求を送信し、前記部分データを記憶する前記ストレージ装置から受信した前記部分データを前記記憶部に格納することを特徴とする付記7乃至9のいずれか1項に記載の情報処理方法。
(付記11)
処理対象データの仮想アドレス空間を介して前記処理対象データに対する所定の処理を行い、
前記仮想アドレス空間に含まれる複数の領域のうち、監視対象として設定された複数の監視領域に対するアクセスを監視し、
前記複数の監視領域のうち、アクセスを検出した監視領域の仮想アドレスに基づいて、所定の制御を行う、
処理をコンピュータに実行させるためのプログラム。
(付記12)
前記複数の監視領域は、前記仮想アドレス空間内において互いに隣接しない位置に設定され、
前記コンピュータは、前記所定の処理を開始する前に、前記複数の監視領域それぞれを保護し、前記所定の処理において、前記仮想アドレス空間に含まれる前記複数の領域に対して所定の順序でアクセスし、保護されている領域に対するアクセスを示す制御信号が発生した場合、前記制御信号に基づいて、アクセスが発生した監視領域を特定し、特定した監視領域の仮想アドレスを前記制御部へ出力することを特徴とする付記11記載のプログラム。
(付記13)
前記コンピュータは、前記特定した監視領域の保護を解除して、次の監視領域に対するアクセスを監視し、保護が解除された監視領域にアクセスすることで、前記所定の処理を行うことを特徴とする付記12記載のプログラム。
(付記14)
前記処理対象データは、通信ネットワークを介して前記情報処理装置と接続された複数のストレージ装置に分散して格納され、
前記コンピュータは、前記仮想アドレス空間に含まれる前記複数の領域のうち一部の領域に対応するデータを記憶する記憶部を含み、
前記コンピュータは、前記アクセスを検出した仮想アドレスに基づいて、アクセスする仮想アドレスのアドレス範囲を予測し、前記複数のストレージ装置のうち、予測したアドレス範囲の部分データを記憶するストレージ装置に対して、データ転送要求を送信し、前記部分データを記憶する前記ストレージ装置から受信した前記部分データを前記記憶部に格納することを特徴とする付記11乃至13のいずれか1項に記載のプログラム。
102−1〜102−3、902−1〜902−M データノード
103−1〜103−3、202−1〜202−3 記憶装置
104、203、903 通信ネットワーク
201−1〜201−3 ノード
301−1〜301−3 キャッシュ
401〜403、603 データ
411、3711、3712 矢印
501 位置
502 範囲
601 仮想アドレス空間
602、3301、4002 メモリ
604、611−1〜611−6 領域
612−1〜612−6、3713 ページ
701 情報処理装置
711、1001−i、1101−j 記憶部
712、1002−i 処理部
713、1003−i 監視部
714、1004−i、1102−j 制御部
1201 深層学習プロセス
1202 メモリマップドアドレス
1203 LMDBデータファイル
1204 制御信号
1205 シグナルハンドラ
1206 入出力プロセス
1401〜1403 位置
3201 計算ノードシステム
3202 データノードシステム
3212、3222、3233、3313 SSD
3213、3303 GPU
3221 MDS
3223 MGT
3224 HDD MDT
3225 SSD MDT
3231−1〜3231−3 OSS
3232 HDD
3234−1、3234−2、3235−1〜3235−4 OST
3302、3312、4001 CPU
3304、3311 HCA
3501 横線
3502 矩形
3701 第1プロセス
3702 第2プロセス
3703 共有メモリ
4003 補助記憶装置
4004 媒体駆動装置
4005 ネットワーク接続装置
4006 バス
4007 可搬型記録媒体
Claims (8)
- 処理対象データの仮想アドレス空間を示す情報を記憶する記憶部と、
前記仮想アドレス空間を介して前記処理対象データに対する所定の処理を行う処理部と、
前記仮想アドレス空間に含まれる複数の領域のうち、監視対象として設定された複数の監視領域に対する、前記処理部からのアクセスを監視する監視部と、
前記複数の監視領域のうち、前記監視部がアクセスを検出した監視領域の仮想アドレスに基づいて、所定の制御を行う制御部と、
を備えることを特徴とする情報処理装置。 - 前記複数の監視領域は、前記仮想アドレス空間内において互いに隣接しない位置に設定され、
前記処理部は、前記所定の処理において、前記仮想アドレス空間に含まれる前記複数の領域に対して所定の順序でアクセスし、
前記監視部は、前記処理部が前記所定の処理を開始する前に、前記複数の監視領域それぞれを保護し、前記処理部が前記所定の処理を開始した後に、保護されている領域に対するアクセスを示す制御信号が発生した場合、前記制御信号に基づいて、アクセスが発生した監視領域を特定し、特定した監視領域の仮想アドレスを前記制御部へ出力することを特徴とする請求項1記載の情報処理装置。 - 前記監視部は、前記特定した監視領域の保護を解除して、次の監視領域に対するアクセスを監視し、
前記処理部は、保護が解除された監視領域にアクセスすることで、前記所定の処理を行うことを特徴とする請求項2記載の情報処理装置。 - 前記処理対象データは、通信ネットワークを介して前記情報処理装置と接続された複数のストレージ装置に分散して格納され、
前記記憶部は、前記仮想アドレス空間に含まれる前記複数の領域のうち一部の領域に対応するデータを記憶し、
前記制御部は、前記監視部がアクセスを検出した仮想アドレスに基づいて、前記処理部がアクセスする仮想アドレスのアドレス範囲を予測し、前記複数のストレージ装置のうち、予測したアドレス範囲の部分データを記憶するストレージ装置に対して、データ転送要求を送信し、前記部分データを記憶する前記ストレージ装置から受信した前記部分データを前記記憶部に格納することを特徴とする請求項1乃至3のいずれか1項に記載の情報処理装置。 - 前記処理対象データは、第1プロセスから第2プロセスへ転送されるデータであり、
前記記憶部は、前記仮想アドレス空間に含まれる前記複数の領域のうち一部の領域に対応するデータを記憶し、
前記制御部は、前記第1プロセスが前記記憶部に前記処理対象データを書き込むように、前記第1プロセスを制御し、
前記処理部は、前記第2プロセスが前記記憶部から前記処理対象データを読み出すように、前記第2プロセスを制御し、
前記制御部は、前記監視部がアクセスを検出した仮想アドレスに基づいて、前記第1プロセスに、前記第2プロセスへ転送するデータを書き込ませることを特徴とする請求項1乃至3のいずれか1項に記載の情報処理装置。 - 前記記憶部は、前記仮想アドレス空間に含まれる前記複数の領域のうち一部の領域に対応するデータを記憶するとともに、前記所定の処理において前記処理部がアクセスする仮想アドレスと、前記所定の処理における前記処理部の挙動を示す識別情報との対応関係を記憶し、
前記制御部は、前記対応関係に基づいて、前記監視部がアクセスを検出した仮想アドレスに対応する識別情報を出力することを特徴とする請求項1乃至3のいずれか1項に記載の情報処理装置。 - コンピュータが、
処理対象データの仮想アドレス空間を介して前記処理対象データに対する所定の処理を行い、
前記仮想アドレス空間に含まれる複数の領域のうち、監視対象として設定された複数の監視領域に対するアクセスを監視し、
前記複数の監視領域のうち、アクセスを検出した監視領域の仮想アドレスに基づいて、所定の制御を行う、
ことを特徴とする情報処理方法。 - 処理対象データの仮想アドレス空間を介して前記処理対象データに対する所定の処理を行い、
前記仮想アドレス空間に含まれる複数の領域のうち、監視対象として設定された複数の監視領域に対するアクセスを監視し、
前記複数の監視領域のうち、アクセスを検出した監視領域の仮想アドレスに基づいて、所定の制御を行う、
処理をコンピュータに実行させるためのプログラム。
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2017139449A JP7003470B2 (ja) | 2017-07-18 | 2017-07-18 | 情報処理装置、情報処理方法、及びプログラム |
US16/035,118 US10649814B2 (en) | 2017-07-18 | 2018-07-13 | Device, method, and medium for executing a computing process within an accessed monitoring region |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2017139449A JP7003470B2 (ja) | 2017-07-18 | 2017-07-18 | 情報処理装置、情報処理方法、及びプログラム |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2019021070A true JP2019021070A (ja) | 2019-02-07 |
JP7003470B2 JP7003470B2 (ja) | 2022-01-20 |
Family
ID=65019063
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2017139449A Active JP7003470B2 (ja) | 2017-07-18 | 2017-07-18 | 情報処理装置、情報処理方法、及びプログラム |
Country Status (2)
Country | Link |
---|---|
US (1) | US10649814B2 (ja) |
JP (1) | JP7003470B2 (ja) |
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- 2017-07-18 JP JP2017139449A patent/JP7003470B2/ja active Active
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2018
- 2018-07-13 US US16/035,118 patent/US10649814B2/en active Active
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Publication number | Publication date |
---|---|
US10649814B2 (en) | 2020-05-12 |
JP7003470B2 (ja) | 2022-01-20 |
US20190026159A1 (en) | 2019-01-24 |
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