JP6920286B2 - 例外処理 - Google Patents
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- 208000011580 syndromic disease Diseases 0.000 claims description 74
- 238000012545 processing Methods 0.000 claims description 66
- 238000012546 transfer Methods 0.000 claims description 21
- 238000007726 management method Methods 0.000 claims description 10
- 238000000034 method Methods 0.000 claims description 10
- 230000001960 triggered effect Effects 0.000 claims description 8
- 238000013500 data storage Methods 0.000 claims description 2
- 238000013507 mapping Methods 0.000 claims 7
- 230000011664 signaling Effects 0.000 claims 1
- 239000004071 soot Substances 0.000 claims 1
- 238000006243 chemical reaction Methods 0.000 description 10
- 230000006399 behavior Effects 0.000 description 5
- 230000004044 response Effects 0.000 description 3
- 101100494729 Syncephalastrum racemosum SPSR gene Proteins 0.000 description 1
- 238000007792 addition Methods 0.000 description 1
- 230000002730 additional effect Effects 0.000 description 1
- 230000001419 dependent effect Effects 0.000 description 1
- 238000012986 modification Methods 0.000 description 1
- 230000004048 modification Effects 0.000 description 1
- 238000011084 recovery Methods 0.000 description 1
- 238000013519 translation Methods 0.000 description 1
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- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F9/00—Arrangements for program control, e.g. control units
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- G06F9/30—Arrangements for executing machine instructions, e.g. instruction decode
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- G06F9/3861—Recovery, e.g. branch miss-prediction, exception handling
- G06F9/3865—Recovery, e.g. branch miss-prediction, exception handling using deferred exception handling, e.g. exception flags
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- G06F11/00—Error detection; Error correction; Monitoring
- G06F11/07—Responding to the occurrence of a fault, e.g. fault tolerance
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- G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
- G06F9/30—Arrangements for executing machine instructions, e.g. instruction decode
- G06F9/30003—Arrangements for executing specific machine instructions
- G06F9/3004—Arrangements for executing specific machine instructions to perform operations on memory
- G06F9/30043—LOAD or STORE instructions; Clear instruction
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- G—PHYSICS
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- G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
- G06F9/30—Arrangements for executing machine instructions, e.g. instruction decode
- G06F9/30098—Register arrangements
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- G06F9/00—Arrangements for program control, e.g. control units
- G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
- G06F9/30—Arrangements for executing machine instructions, e.g. instruction decode
- G06F9/38—Concurrent instruction execution, e.g. pipeline or look ahead
- G06F9/3861—Recovery, e.g. branch miss-prediction, exception handling
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F9/00—Arrangements for program control, e.g. control units
- G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
- G06F9/44—Arrangements for executing specific programs
- G06F9/455—Emulation; Interpretation; Software simulation, e.g. virtualisation or emulation of application or operating system execution engines
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Description
複数のレジスタと、
複数のレジスタの所与のレジスタとのデータ値の転送を含む、例外をトリガする処理動作の試みられた実行を検出し、例外をトリガする処理動作を少なくとも部分的にエミュレートするために例外処理プログラム命令の実行をトリガするための、例外処理回路と、
例外をトリガする処理動作を特徴付け、かつ、データ値を含むシンドロームデータを格納するためのシンドロームデータストアと、
を備え、
例外処理回路が、シンドロームデータ内のデータ値を使用して、所与のレジスタとの転送を遂行する装置を提供する。
データを格納するための複数のレジスタ手段と、
複数のレジスタ手段の所与のレジスタ手段とのデータ値の転送を含む、例外をトリガする処理動作の試みられた実行を検出し、例外をトリガする処理動作を少なくとも部分的にエミュレートするために例外処理プログラム命令の実行をトリガするための、例外処理手段と、
例外をトリガする処理動作を特徴付け、かつ、データ値を含むシンドロームデータを格納するためのシンドロームデータ格納手段と、
を備え、
例外処理手段が、シンドロームデータ内のデータ値を使用して、所与のレジスタ手段との転送を遂行する装置を提供する。
データを複数のレジスタ内に格納することと、
複数のレジスタの所与のレジスタ手段とのデータ値の転送を含む、例外をトリガする処理動作の試みられた実行を検出することと、
例外をトリガする処理動作を少なくとも部分的にエミュレートするために例外処理プログラム命令の実行をトリガすることと、
例外をトリガする処理動作を特徴付け、かつ、データ値を含むシンドロームデータを格納することと、
シンドロームデータ内のデータ値を使用して、所与のレジスタ手段との転送を遂行することと、
を含む方法を提供する。
Claims (19)
- データを処理するための装置であって、
複数のレジスタと、
前記複数のレジスタの所与のレジスタとのデータ値の転送を含む、例外をトリガする処理動作の試みられた実行を検出し、前記例外をトリガする処理動作を少なくとも部分的にエミュレートするために例外処理プログラム命令の実行をトリガするための、例外処理回路と、
前記例外をトリガする処理動作を特徴付け、かつ、前記データ値を含むシンドロームデータを格納するためのシンドロームデータストアと、
を備え、
前記例外処理回路が、前記シンドロームデータ内の前記データ値を使用して、前記所与のレジスタとの前記転送を遂行し、
前記シンドロームデータが、第1の状態と第2の状態とを有するリプレイ状態データを含み、
前記リプレイ状態データが前記第2の状態を有するときで、前記例外をトリガする処理動作の試みられた実行の際に、前記例外処理回路が、前記リプレイ状態データを前記第1の状態に設定し、前記例外処理プログラム命令の実行をトリガし、
前記リプレイ状態データが前記第1の状態を有するときで、前記例外をトリガする処理動作の試みられた実行の際に、前記例外処理回路が、前記リプレイ状態データを前記第2の状態に設定し、前記例外処理プログラム命令をトリガすることを抑制し、前記例外をトリガする処理動作を完了したものとして合図する、装置。 - 前記例外をトリガする処理動作が、前記データ値をメモリアドレスから前記所与のレジスタに転送するロード動作であり、
前記例外処理プログラム命令が、前記データ値を前記メモリアドレスから前記シンドロームデータストアに転送し、
前記ロード動作の試みられた再実行の際に、前記例外処理回路が、前記データ値を前記シンドロームデータストアから前記所与のレジスタに転送する、請求項1に記載の装置。 - 前記例外をトリガする処理動作が、前記データ値を前記所与のレジスタからメモリアドレスに転送する格納動作であり、
前記格納動作の前記試みられた実行の際に、前記例外処理回路が、前記データ値を前記所与のレジスタから前記シンドロームデータストアに転送し、
前記例外処理プログラム命令が、前記データ値を前記シンドロームデータストアから前記メモリアドレスに転送する、請求項1に記載の装置。 - 前記リプレイ状態データが前記第1の状態を有するときで、前記例外をトリガする処理動作の試みられた実行の際に、前記例外処理回路が、前記データ値を前記シンドロームデータストアから前記所与のレジスタに転送する、請求項2に記載の装置。
- 前記例外処理プログラム命令の完了の際に、前記例外処理回路が、前記例外をトリガする処理動作の試みられた再実行をトリガする、請求項1〜4のいずれか一項に記載の装置。
- 前記シンドロームデータが、例外の入口と出口において保存され回復される現在プログラムステータスデータの一部である、請求項1〜5のいずれか一項に記載の装置。
- 前記例外をトリガする処理動作が、データ中断をトリガする、請求項1〜6のいずれか一項に記載の装置。
- 前記例外をトリガする処理動作に対応するプログラム命令が、ゲストプログラムの一部であり、前記例外処理プログラム命令が、前記ゲストプログラムに実行環境を提供する仮想化プログラムの一部である、請求項1〜7のいずれか一項に記載の装置。
- 前記仮想化プログラムが、前記ゲストプログラムのプライベートな状態データへのアクセスを阻止される、請求項8に記載の装置。
- 前記プライベートな状態データが、前記ゲストプログラムの実行中の前記複数のレジスタ内のデータ値を含む、請求項9に記載の装置。
- 第1の段のマッピングデータと第2の段のマッピングデータとを含むマッピングデータに依存してメモリへのアクセスを管理するためのメモリ管理ユニットを備え、前記ゲストプログラムが、前記第1の段のマッピングデータを管理し、前記仮想化プログラムが、前記第2の段のマッピングデータを管理し、前記例外をトリガする処理動作が、前記第2の段のマッピングデータを使用して検出される、請求項8、9、および10のいずれか一項に記載の装置。
- 前記第1の段のマッピングデータが、前記仮想化プログラムにより前記ゲストプログラムの前記プライベートな状態データへアクセスする、請求項9および10のいずれか一項に従属する場合の請求項11に記載の装置。
- 前記転送が、前記所与のレジスタと入出力デバイスとの間である、請求項1〜12のいずれか一項に記載の装置。
- 前記シンドロームデータが、メモリアドレスを指し示すアドレスデータを含み、前記データ値の前記転送が、前記所与のレジスタと前記メモリアドレスとの間である、請求項1〜13のいずれか一項に記載の装置。
- 前記シンドロームデータが、前記データ値のサイズデータを含む、請求項1〜14のいずれか一項に記載の装置。
- 前記シンドロームデータが、前記転送が前記データ値の前記所与のレジスタへのロードであるか、前記データ値の前記所与のレジスタからの書き込みであるかを指定する、請求項1〜15のいずれか一項に記載の装置。
- 前記シンドロームデータストアが、シンドロームレジスタである、請求項1〜16のいずれか一項に記載の装置。
- データを処理するための装置であって、
データを格納するための複数のレジスタ手段と、
前記複数のレジスタ手段の所与のレジスタ手段とのデータ値の転送を含む、例外をトリガする処理動作の試みられた実行を検出し、前記例外をトリガする処理動作を少なくとも部分的にエミュレートするために例外処理プログラム命令の実行をトリガするための、例外処理手段と、
前記例外をトリガする処理動作を特徴付け、かつ、前記データ値を含むシンドロームデータを格納するためのシンドロームデータ格納手段と、
を備え、
前記例外処理手段が、前記シンドロームデータ内の前記データ値を使用して、前記所与のレジスタ手段との前記転送を遂行し、
前記シンドロームデータが、第1の状態と第2の状態とを有するリプレイ状態データを含み、
前記リプレイ状態データが前記第2の状態を有するときで、前記例外をトリガする処理動作の試みられた実行の際に、前記例外処理手段が、前記リプレイ状態データを前記第1の状態に設定し、前記例外処理プログラム命令の実行をトリガし、
前記リプレイ状態データが前記第1の状態を有するときで、前記例外をトリガする処理動作の試みられた実行の際に、前記例外処理手段が、前記リプレイ状態データを前記第2の状態に設定し、前記例外処理プログラム命令をトリガすることを抑制し、前記例外をトリガする処理動作を完了したものとして合図する、装置。 - データを処理する方法であって、
データを複数のレジスタ内に格納するステップと、
前記複数のレジスタの所与のレジスタとのデータ値の転送を含む、例外をトリガする処理動作の試みられた実行を検出するステップと、
前記例外をトリガする処理動作を少なくとも部分的にエミュレートするために例外処理プログラム命令の実行をトリガするステップと、
前記例外をトリガする処理動作を特徴付け、かつ、前記データ値を含むシンドロームデータを格納するステップと、
前記シンドロームデータ内の前記データ値を使用して、前記所与のレジスタとの前記転送を遂行するステップと、
を含み、
前記シンドロームデータが、第1の状態と第2の状態とを有するリプレイ状態データを含み、
前記リプレイ状態データが前記第2の状態を有するときで、前記例外をトリガする処理動作の試みられた実行の際に、前記試みられた実行を検出するステップが、前記リプレイ状態データを前記第1の状態に設定し、前記例外処理プログラム命令の実行をトリガし、
前記リプレイ状態データが前記第1の状態を有するときで、前記例外をトリガする処理動作の試みられた実行の際に、前記試みられた実行を検出するステップが、前記リプレイ状態データを前記第2の状態に設定し、前記例外処理プログラム命令をトリガすることを抑制し、前記例外をトリガする処理動作を完了したものとして合図する、方法。
Applications Claiming Priority (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
GB1518165.4 | 2015-10-14 | ||
GB1518165.4A GB2543306B (en) | 2015-10-14 | 2015-10-14 | Exception handling |
PCT/GB2016/052784 WO2017064453A1 (en) | 2015-10-14 | 2016-09-09 | Exception handling |
Publications (3)
Publication Number | Publication Date |
---|---|
JP2018531462A JP2018531462A (ja) | 2018-10-25 |
JP2018531462A6 JP2018531462A6 (ja) | 2018-12-13 |
JP6920286B2 true JP6920286B2 (ja) | 2021-08-18 |
Family
ID=55131018
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2018517424A Active JP6920286B2 (ja) | 2015-10-14 | 2016-09-09 | 例外処理 |
Country Status (9)
Country | Link |
---|---|
US (1) | US10649787B2 (ja) |
EP (1) | EP3341834B1 (ja) |
JP (1) | JP6920286B2 (ja) |
KR (1) | KR102613643B1 (ja) |
CN (1) | CN108139906B (ja) |
GB (1) | GB2543306B (ja) |
IL (1) | IL257898B (ja) |
TW (1) | TWI724034B (ja) |
WO (1) | WO2017064453A1 (ja) |
Families Citing this family (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
GB2579617B (en) * | 2018-12-06 | 2021-01-27 | Advanced Risc Mach Ltd | An apparatus and method for handling exception causing events |
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US11816217B2 (en) * | 2020-04-10 | 2023-11-14 | Vmware, Inc. | Decoy memory allocation |
Family Cites Families (23)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
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-
2015
- 2015-10-14 GB GB1518165.4A patent/GB2543306B/en active Active
-
2016
- 2016-09-09 CN CN201680057785.3A patent/CN108139906B/zh active Active
- 2016-09-09 JP JP2018517424A patent/JP6920286B2/ja active Active
- 2016-09-09 EP EP16766055.4A patent/EP3341834B1/en active Active
- 2016-09-09 US US15/759,907 patent/US10649787B2/en active Active
- 2016-09-09 WO PCT/GB2016/052784 patent/WO2017064453A1/en active Application Filing
- 2016-09-09 KR KR1020187012810A patent/KR102613643B1/ko active IP Right Grant
- 2016-10-05 TW TW105132139A patent/TWI724034B/zh active
-
2018
- 2018-03-06 IL IL257898A patent/IL257898B/en active IP Right Grant
Also Published As
Publication number | Publication date |
---|---|
KR20180067581A (ko) | 2018-06-20 |
IL257898B (en) | 2020-03-31 |
GB2543306B (en) | 2019-05-01 |
GB2543306A (en) | 2017-04-19 |
CN108139906A (zh) | 2018-06-08 |
EP3341834A1 (en) | 2018-07-04 |
JP2018531462A (ja) | 2018-10-25 |
CN108139906B (zh) | 2022-09-02 |
TW201715408A (zh) | 2017-05-01 |
US20180239607A1 (en) | 2018-08-23 |
KR102613643B1 (ko) | 2023-12-14 |
GB201518165D0 (en) | 2015-11-25 |
US10649787B2 (en) | 2020-05-12 |
EP3341834B1 (en) | 2021-05-12 |
TWI724034B (zh) | 2021-04-11 |
IL257898A (en) | 2018-05-31 |
WO2017064453A1 (en) | 2017-04-20 |
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JPWO2020182498A5 (ja) |
Legal Events
Date | Code | Title | Description |
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A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20190902 |
|
A131 | Notification of reasons for refusal |
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A521 | Request for written amendment filed |
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A01 | Written decision to grant a patent or to grant a registration (utility model) |
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A61 | First payment of annual fees (during grant procedure) |
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|
R150 | Certificate of patent or registration of utility model |
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