JP2017514394A - マルチシンボルワードのための同期方法 - Google Patents
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Abstract
Description
本出願は、その内容全体が参照により本明細書に組み込まれる、2014年4月22日に米国特許庁に出願された仮特許出願第61/982,466号および2015年4月9日に米国特許庁に出願された米国非仮出願第14/682,846号の優先権および利益を主張する。
図30は、CCIe通信リンクから埋め込みクロック情報を復元するのに利用することができるCDR回路3000の例を示すブロック図である。CDR回路3000は、SCL信号216および/またはSDA信号218のマスキングを許可するように適応される。この例では、第1のゲート3026におけるSCL信号216のブロッキングを可能にするために、SCLMASK信号3002が与えられてよく、第2のゲート3028におけるSDA信号218のブロッキングを可能にするために、SDAMASK信号3030が与えられてよい。いくつかの事例では、図示されるCDR回路3000および/または他のCDR回路の他の変形体が使われてよい。
図36は、CCIeとI2Cの混合環境において動作するCCIeデバイス向けのフレーム同期プロセスを示す状態図3600である。最初に、CCIeデバイスは、同一の動作モードにあり、フレームに同期されている。アイドル状態3604において、CCIeデバイスは、I2C動作モードをサポートする状態3602に遷移し得る。I2CモードからCCIeモードへの遷移は、CCIeデバイスをアイドル状態3604に置き、この状態から、CCIeデバイスはアクティブ通信状態3602、3606に遷移し得る。初期CCIeアクティブ通信状態3606において、CCIe通信は、CCIeデバイスが、デバイスによって使われるスレーブIDに対応するスレーブIDを検出したときに始まり得る。スレーブは次いで、状態3608に入り、この状態で、アドレス情報を待つ。読取りまたは書込みが次いで、書込み状態3610または1つもしくは複数の読取り状態3612、3614、3616において完了される。いくつかのアクティブ状態3610、3612、または3616からの退出により、デバイスはアイドル状態3604に戻り得る。
本明細書で開示するいくつかの態様に従って適応されたマスタおよびスレーブデバイスは、複数の動作モードおよび/または複数のプロトコルをサポートするシリアルバスに結合され、そのシリアルバスを介して通信することができる。
図41は、本明細書において開示される1つまたは複数の機能を実施するように構成することができる処理回路4102を利用する装置のためのハードウェア実施態様の簡略化された例を示す概念図4100である。本開示の様々な態様によると、本明細書で開示するような要素、または要素の任意の部分、または要素の任意の組合せは、処理回路4102を使用して実装されてもよい。処理回路4102は、ハードウェアモジュールとソフトウェアモジュールの何らかの組合せによって制御される1つまたは複数のプロセッサ4104を含んでもよい。プロセッサ4104の例は、マイクロプロセッサ、マイクロコントローラ、デジタル信号プロセッサ(DSP)、フィールドプログラマブルゲートアレイ(FPGA)、プログラマブル論理デバイス(PLD)、状態機械、シーケンサ、ゲート論理、個別ハードウェア回路、および本開示全体にわたって記載された様々な機能性を実施するように構成された他の適切なハードウェアを含む。1つまたは複数のプロセッサ4104は、特定の機能を実施し、ソフトウェアモジュール4116のうちの1つによって構成され、増強され、または制御されてもよい専用プロセッサを含んでもよい。1つまたは複数のプロセッサ4104は、初期化中にロードされたソフトウェアモジュール4116の組合せを通じて構成されてもよく、動作中に1つまたは複数のソフトウェアモジュール4116のローディングまたはアンローディングによってさらに構成されてもよい。
102 処理回路
106 トランシーバ
108 特定用途向けIC(ASIC)
110 アプリケーションプログラミングインターフェース(API)
112 メモリ、メモリデバイス
114 ローカルデータベース
122 アンテナ
124 ディスプレイ
126 キーパッド
128 ボタン
200 装置
202 デバイス、イメージングデバイス
204 センサー制御機能
206 構成レジスタ、記憶媒体、レジスタ
208 クロック生成回路
210 トランシーバ
210a 受信機
210b 共通回路、記憶媒体、レジスタ
210c 送信機
212 制御論理、プロセッサ
214a ラインドライバ/受信機
214b ラインドライバ/受信機
216 SCL信号、信号
218 SDA信号、信号
220 デバイス、CCIeマスタデバイス、マスタデバイス
222a〜n デバイス
230 CCIeバス
300 送信機
302 トランスコーダ
304 エンコーダ
306 ラインドライバ
308 オープンドレイン出力トランジスタ
310 入力データ
312 3進数
314 シンボル
320 受信機、受信回路
322 回路、トランスコーダ
324 回路、デコーダ
326 ラインインターフェース回路
328 クロックおよびデータ復元(CDR)回路
330 出力データ要素
334 シンボル
336 シンボル
338 受信クロック、クロック
402 シンボル順序付けサークル
422 Psシンボル、前のシンボル
424 現在のシンボル
426 3進数、遷移数
502 スレーブ識別子(スレーブID)
512 読取り/書込みビット
602 スレーブID、シーケンス
604 スレーブID、シーケンス
606 START状態
608 START状態
610 START状態
612 パルス
614 クロック信号
622 12シンボルの送信、CCIe送信、送信
624 12シンボルの送信、CCIe送信、送信
626 START状態
628 START状態
630 START状態
700 状態機械
702 状態
706 SLCIライン
706b クロック信号
708 SCLIライン
716 状態、無効状態値
732 組合せ論理、論理
802 CCIeシンボル送信
1008 パルス
1106 第2のシンボルパルス
1110 第1のパルス
1111 第2のパルス
1112 第3のシンボルパルス
1114 第1のシンボルパルス
1120 第1のシンボルスロット、シンボルスロット
1120' 伸長されたシンボルスロット
1122 第2のシンボルスロット
1122' 伸長されたシンボルスロット
1124 第3のシンボルスロット
1124' 伸長されたシンボルスロット
1402 第5のシンボルスロット
1404 第2のシンボルスロット
1406 後続パルス
1502 シンボルスロット
1504 シンボルスロット
1702 状態機械
1706 スタート検出論理
1708 第2の論理
1714 準安定条件
1716 フリップフロップ
1802 シンボル
2508 受信機クロック(RXCLK信号)
2522a フレーム
2522c フレーム
2524a 同期機会
2524b 同期機会
2526 ハートビートワード
2602 データ範囲
2604 データ範囲
2606 サブレンジ
2608 サブレンジ
2716a 遷移
2716b 遷移
2802 現在のシンボル、シンボル
2812 現在のシンボル、シンボル
2806 受信クロック信号(RXCLK信号)
2816 受信クロック信号(RXCLK信号)
2902 第1の回路
2904 RXCLK信号
2906 非同期S-Rラッチ、S-Rラッチ
2908 フリップフロップ
2910 フリップフロップ
2912 SCL低検出(SCL0DET)信号、制御信号
2914 SR信号、制御信号
2916 リセット信号
2920 ダウンカウンタ
2922 初期化値、初期値
2924 CNT信号
2926 SEL信号
2928 SCLMASK信号
3000 CDR回路
3002 SCLMASK信号
3004 比較器
3006 セットリセットラッチ
3008 ワンショット回路
3010 レベルラッチ
3012 「遅延S」遅延要素、遅延要素
3014 2進比較信号(NE信号)
3016 信号(NEFLT信号)
3018 内部受信クロック(IRXCLK)信号
3020 入力(SI)信号
3022 信号(S信号)
3024 遅延要素
3026 第1のゲート
3028 第2のゲート
3030 SDAMASK信号
3100 論理回路構成
3102 第1のゲート
3124 比較の結果
3128 比較の結果
3130 SYNC12PRE信号
3132 SYNC20PRE信号
3140 信号(SYNC12)
3142 SCLMASK信号、信号(SYNC20)
3200 論理回路構成
3206 SDAMASK信号
3602 状態、アクティブ通信状態
3604 アイドル状態
3606 アクティブ通信状態、初期CCIeアクティブ通信状態
3608 状態
3610 書込み状態、アクティブ状態
3612 読取り状態、アクティブ状態
3614 読取り状態
3616 読取り状態、アクティブ状態
3700 UNSYNCコード
3802 アクティブ状態
3804 アクティブ状態
3806 コマンド
3808 「例外」状態
3810 アイドル状態
3812 アクティブ状態
3814 アクティブ状態
3902 非同期モード
3904 12シンボルCCIe送信モード、CCIe送信モード、CCIeモード
3906 20シンボルCCIe送信モード、CCIe送信モード、CCIeモード
3908 I2Cモード
3910 UNSYNCコード
3912 UNSYNCコード
3918 「12シンボル進入」I2C一斉呼出し
3920 「20シンボル進入」I2C一斉呼出し
3922 「12シンボル退出」一斉呼出し
3924 「20シンボル退出」一斉呼出し
4102 処理回路
4104 プロセッサ
4106 ストレージ
4108 バスインターフェース
4110 バス
4112 トランシーバ
4114 ランタイム画像
4116 ソフトウェアモジュール
4118 ユーザインターフェース
4120 プログラム、時分割プログラム
4122 論理回路
4300 装置
4302 処理回路
4304 モジュールまたは回路
4306 モジュールまたは回路
4308 モジュールまたは回路
4310 モジュールまたは回路
4312 ラインインターフェース回路
4314 コネクタ、ワイヤ
4316 プロセッサ
4318 コンピュータ可読記憶媒体
4320 バス
Claims (30)
- データ通信の方法であって、
シリアルバス上で第1の同期(SYNC)コードを送信するステップと、
前記第1のSYNCコードに応答して前記第1のデバイスとの同期を確立した後、第1のプロトコルに関連付けられた第1の動作モードに従って、前記シリアルバスを介して第1のデバイスと通信するステップと、
前記シリアルバス上で非同期(UNSYNC)コードを送信するステップであって、前記UNSYNCコードは、前記第1のデバイスとの同期の喪失を引き起こすように構成される、ステップと、
前記シリアルバス上で第2のSYNCコードを送信するステップと、
前記第2のSYNCコードに応答して前記第2のデバイスとの同期を確立した後、前記第1のプロトコルに関連付けられた第2の動作モードに従って、前記シリアルバスを介して第2のデバイスと通信するステップとを含む方法。 - 前記第1のプロトコルはカメラ制御インターフェース(CCIe)プロトコルを含み、前記第1の動作モードは、前記シリアルバス上で送信されるべき12個のシンボル中でデータワードが符号化される動作モードに対応する、請求項1に記載の方法。
- 前記第1のSYNCコードを送信するステップは、
前記シリアルバス上で、12個のシンボルからなるシーケンスを送信するステップであって、12個のシンボルからなる前記シーケンスは、前記シリアルバスのシリアルクロック(SCL)線を、12個のシンボルからなる前記シーケンスの送信中、論理高シグナリング状態に留まらせ、さらに、前記シリアルバスのシリアルデータ(SDA)線に、12個のシンボルからなる前記シーケンスの連続するシンボルの間の各遷移においてシグナリング状態を変えさせるように選択される、ステップを含む、請求項2に記載の方法。 - 前記第1のプロトコルはCCIeプロトコルを含み、前記第2の動作モードは、前記シリアルバス上で送信されるべき20個のシンボル中でデータワードが符号化される動作モードに対応する、請求項1に記載の方法。
- 前記第2のSYNCコードを送信するステップは、
前記シリアルバス上で、20個のシンボルからなるシーケンスを送信するステップであって、20個のシンボルからなる前記シーケンスは、前記シリアルバスのシリアルクロック(SCL)線を、20個のシンボルからなる前記シーケンスの送信中、論理高シグナリング状態に留まらせ、さらに、前記シリアルバスのシリアルデータ(SDA)線に、20個のシンボルからなる前記シーケンスの連続するシンボルの間の各遷移においてシグナリング状態を変えさせるように選択される、ステップを含む、請求項4に記載の方法。 - 前記第1のプロトコルはCCIeプロトコルを含み、前記第1のデバイスと通信するステップは、
シンボルのシーケンス中で、1つまたは複数のデータワードをスレーブCCIeデバイスに送信するステップを含む、請求項1に記載の方法。 - 前記第1のSYNCコードは同期ワードおよびハートビートワードを含み、前記ハートビートワードは、1つまたは複数のスレーブCCIeデバイスがクロック信号を生成することを可能にする、請求項1に記載の方法。
- 前記UNSYNCコードはエラー条件のインジケータを含み、前記エラー条件の前記インジケータの存在は、前記第1のデバイスを非同期状態に入らせる、請求項1に記載の方法。
- 前記シリアルバス上で一斉呼出しを送信するステップであって、前記一斉呼出しは、前記シリアルバスをアイドル状態に入らせるために選択される、ステップと、
前記シリアルバスが前記アイドル状態に入った後、第2のプロトコルを使って、前記シリアルバスに結合された第3のデバイスと通信するステップとをさらに含む、請求項1に記載の方法。 - 前記第1のプロトコルはCCIeプロトコルを含み、前記第2のプロトコルはインター集積回路(I2C)プロトコルを含む、請求項9に記載の方法。
- 前記シリアルバスに接続された少なくとも1つのデバイスは、インター集積回路(I2C)プロトコルを使って通信することに制限される、請求項1に記載の方法。
- シリアルバスを介して通信するために構成されたトランシーバと、
少なくとも1つのプロセッサとを備える装置であって、前記少なくとも1つのプロセッサは、
第1の同期(SYNC)コードを、前記シリアルバス上での送信のために前記トランシーバに与え、
前記第1のSYNCコードに応答して、前記第1のデバイスとの同期が確立された後、第1のプロトコルに関連付けられた第1の動作モードに従って、前記シリアルバスを介して第1のデバイスと通信し、
非同期(UNSYNC)コードを、前記シリアルバス上での送信のために前記トランシーバに与え、前記UNSYNCコードは、前記第1のデバイスとの同期の喪失を引き起こすように構成され、
第2のSYNCコードを、前記シリアルバス上での送信のために前記トランシーバに与え、
前記第2のSYNCコードに応答して、前記第2のデバイスとの同期が確立された後、前記第1のプロトコルに関連付けられた第2の動作モードに従って、前記シリアルバスを介して第2のデバイスと通信するように構成される、装置。 - 前記第1のプロトコルはカメラ制御インターフェース(CCIe)プロトコルを含み、前記第1の動作モードは、前記シリアルバス上で送信されるべき12個のシンボル中でデータワードが符号化される動作モードに対応する、請求項12に記載の装置。
- 前記第1のSYNCコードは、前記シリアルバスのシリアルクロック(SCL)線を、12個のシンボルからなるシーケンスの送信中、論理高シグナリング状態に留まらせるように選択され、シリアルデータ(SDA)線に、12個のシンボルからなる前記シーケンスの連続するシンボルの間の各遷移においてシグナリング状態を変えさせるようにさらに選択された、12個のシンボルからなる前記シーケンスを含む、請求項13に記載の装置。
- 前記第1のプロトコルはCCIeプロトコルを含み、前記第2の動作モードは、前記シリアルバス上で送信されるべき20個のシンボル中でデータワードが符号化される動作モードに対応する、請求項12に記載の装置。
- 前記第2のSYNCコードは、前記シリアルバスのシリアルクロック(SCL)線を、20個のシンボルからなるシーケンスの送信中、論理高シグナリング状態に留まらせるように選択され、シリアルデータ(SDA)線に、20個のシンボルからなる前記シーケンスの連続するシンボルの間の各遷移においてシグナリング状態を変えさせるようにさらに選択された、20個のシンボルからなる前記シーケンスを含む、請求項15に記載の装置。
- 前記第1のプロトコルはCCIeプロトコルを含み、
シンボルのシーケンス中に、1つまたは複数のデータワードを符号化するように適応されたエンコーダであって、シンボルの前記シーケンスは、前記トランシーバによって、前記シリアルバスを介してスレーブCCIeデバイスに送信される、エンコーダをさらに備える、請求項12に記載の装置。 - 前記第1のSYNCコードは同期ワードおよびハートビートワードを含み、前記ハートビートワードは、1つまたは複数のスレーブCCIeデバイスがクロック信号を生成することを可能にする、請求項12に記載の装置。
- 前記UNSYNCコードはエラー条件のインジケータを含み、前記エラー条件の前記インジケータの存在は、前記第1のデバイスを非同期状態に入らせる、請求項12に記載の装置。
- 前記少なくとも1つのプロセッサは、
前記シリアルバス上で一斉呼出しを送信させ、前記一斉呼出しは、前記シリアルバスをアイドル状態に入らせるために選択され、
前記シリアルバスが前記アイドル状態に入った後、第2のプロトコルを使って、前記シリアルバスに結合された第3のデバイスと通信するように構成され、
前記第1のプロトコルはCCIeプロトコルを含み、前記第2のプロトコルはインター集積回路(I2C)プロトコルを含む、請求項12に記載の装置。 - 命令を記憶したコンピュータ可読記憶媒体であって、前記命令は、プロセッサによって実行されると、前記プロセッサに、
第1の同期(SYNC)コードを、シリアルバス上での送信のためにトランシーバに与えさせ、
前記第1のSYNCコードに応答して、前記第1のデバイスとの同期が確立された後、第1のプロトコルに関連付けられた第1の動作モードに従って、前記シリアルバスを介して第1のデバイスと通信させ、
非同期(UNSYNC)コードを、前記シリアルバス上での送信のために前記トランシーバに与えさせ、前記UNSYNCコードは、前記第1のデバイスとの同期の喪失を引き起こすように構成され、
第2のSYNCコードを、前記シリアルバス上での送信のために前記トランシーバに与えさせ、
前記第2のSYNCコードに応答して、前記第2のデバイスとの同期が確立された後、前記第1のプロトコルに関連付けられた第2の動作モードに従って、前記シリアルバスを介して第2のデバイスと通信させる、記憶媒体。 - 前記第1のプロトコルはカメラ制御インターフェース(CCIe)プロトコルを含み、前記第1の動作モードは、前記シリアルバス上で送信されるべき12個のシンボル中に第1のデータワードが符号化される動作モードに対応し、前記第2の動作モードは、前記シリアルバス上で送信されるべき20個のシンボル中に第2のデータワードが符号化される動作モードに対応する、請求項21に記載の記憶媒体。
- 前記第1のSYNCコードは、前記シリアルバスのシリアルクロック(SCL)線を、12個のシンボルからなるシーケンスの送信中、論理高シグナリング状態に留まらせるように選択され、前記シリアルバスのシリアルデータ(SDA)線に、12個のシンボルからなる前記シーケンスの連続するシンボルの間の各遷移においてシグナリング状態を変えさせるようにさらに選択された、12個のシンボルからなるシーケンスを含み、前記第2のSYNCコードは、前記シリアルバスの前記SCL線を、20個のシンボルからなる前記シーケンスの送信中、前記論理高シグナリング状態に留まらせるように選択され、前記SDA線に、20個のシンボルからなる前記シーケンスの連続するシンボルの間の各遷移におけるシグナリング状態を変えさせるようにさらに選択された、20個のシンボルからなる前記シーケンスを含む、請求項21に記載の記憶媒体。
- 前記UNSYNCコードはエラー条件のインジケータを含み、前記エラー条件の前記インジケータの存在は、前記第1のデバイスを非同期状態に入らせる、請求項21に記載の記憶媒体。
- 前記命令は、前記プロセッサに、
前記シリアルバス上で送信されるべき一斉呼出しを与えさせ、前記一斉呼出しは、前記シリアルバスをアイドル状態に入らせるために選択され、
前記シリアルバスが前記アイドル状態に入った後、第2のプロトコルを使って、前記シリアルバスに結合された第3のデバイスと通信させ、
前記第1のプロトコルはCCIeプロトコルを含み、前記第2のプロトコルはインター集積回路(I2C)プロトコルを含む、請求項21に記載の記憶媒体。 - シリアルバスを介して通信するために構成されたトランシーバと、
第1の同期(SYNC)コードを、前記シリアルバス上での送信のために前記トランシーバに与えるための手段と、
前記第1のSYNCコードに応答して、前記第1のデバイスとの同期が確立された後、第1のプロトコルに関連付けられた第1の動作モードに従って、前記シリアルバスを介して第1のデバイスと通信するための手段と、
非同期(UNSYNC)コードを、前記シリアルバス上での送信のために前記トランシーバに与えるための手段であって、前記UNSYNCコードは、前記第1のデバイスとの同期の喪失を引き起こすように構成される、手段と、
第2のSYNCコードを、前記シリアルバス上での送信のために前記トランシーバに与えるための手段と、
前記第2のSYNCコードに応答して、前記第2のデバイスとの同期が確立された後、前記第1のプロトコルに関連付けられた第2の動作モードに従って、前記シリアルバスを介して第2のデバイスと通信するための手段とを備える、装置。 - 前記第1のプロトコルはカメラ制御インターフェース(CCIe)プロトコルを含み、前記第1の動作モードは、前記シリアルバス上で送信されるべき12個のシンボル中に第1のデータワードが符号化される動作モードに対応し、前記第2の動作モードは、前記シリアルバス上で送信されるべき20個のシンボル中に第2のデータワードが符号化される動作モードに対応する、請求項26に記載の装置。
- 前記第1のSYNCコードは、前記シリアルバスのシリアルクロック(SCL)線を、12個のシンボルからなるシーケンスの送信中、論理高シグナリング状態に留まらせるように選択され、前記シリアルバスのシリアルデータ(SDA)線に、12個のシンボルからなる前記シーケンスの連続するシンボルの間の各遷移においてシグナリング状態を変えさせるようにさらに選択された、12個のシンボルからなるシーケンスを含み、前記第2のSYNCコードは、前記シリアルバスの前記SCL線を、20個のシンボルからなる前記シーケンスの送信中、前記論理高シグナリング状態に留まらせるように選択され、前記SDA線に、20個のシンボルからなる前記シーケンスの連続するシンボルの間の各遷移におけるシグナリング状態を変えさせるようにさらに選択された、20個のシンボルからなる前記シーケンスを含む、請求項26に記載の装置。
- 前記UNSYNCコードはエラー条件のインジケータを含み、前記エラー条件の前記インジケータの存在は、前記第1のデバイスを非同期状態に入らせる、請求項26に記載の装置。
- 前記シリアルバス上で送信されるべき一斉呼出しを送信させるための手段であって、前記一斉呼出しは、前記シリアルバスをアイドル状態に入らせるために選択される、手段と、
前記シリアルバスが前記アイドル状態に入った後、第2のプロトコルを使って、前記シリアルバスに結合された第3のデバイスと通信する手段とをさらに備え、
前記第1のプロトコルはCCIeプロトコルを含み、前記第2のプロトコルはインター集積回路(I2C)プロトコルを含む、請求項26に記載の装置。
Applications Claiming Priority (5)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US201461982466P | 2014-04-22 | 2014-04-22 | |
US61/982,466 | 2014-04-22 | ||
US14/682,846 US9710424B2 (en) | 2014-04-22 | 2015-04-09 | Synchronization method for multi-symbol words |
US14/682,846 | 2015-04-09 | ||
PCT/US2015/025464 WO2015164102A1 (en) | 2014-04-22 | 2015-04-10 | Synchronization method for multi-symbol words |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2017514394A true JP2017514394A (ja) | 2017-06-01 |
JP2017514394A5 JP2017514394A5 (ja) | 2018-05-17 |
Family
ID=54322156
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2016563438A Ceased JP2017514394A (ja) | 2014-04-22 | 2015-04-10 | マルチシンボルワードのための同期方法 |
Country Status (7)
Country | Link |
---|---|
US (1) | US9710424B2 (ja) |
EP (1) | EP3134820B1 (ja) |
JP (1) | JP2017514394A (ja) |
KR (1) | KR20160146786A (ja) |
CN (1) | CN106462533A (ja) |
BR (1) | BR112016024704A2 (ja) |
WO (1) | WO2015164102A1 (ja) |
Families Citing this family (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US10417172B2 (en) | 2014-04-28 | 2019-09-17 | Qualcomm Incorporated | Sensors global bus |
US9734121B2 (en) | 2014-04-28 | 2017-08-15 | Qualcomm Incorporated | Sensors global bus |
WO2019040360A1 (en) * | 2017-08-24 | 2019-02-28 | Qualcomm Incorporated | GLOBAL SENSOR BUS |
CN108334469A (zh) * | 2017-12-20 | 2018-07-27 | 广州晶序达电子科技有限公司 | 一种高速差分串行数据传输的方法、系统和装置 |
US10901928B2 (en) * | 2018-02-15 | 2021-01-26 | United States Of America As Represented By The Secretary Of The Air Force | Data access control in an open system architecture |
WO2023072373A1 (en) * | 2021-10-26 | 2023-05-04 | Kone Corporation | Elevator communication system |
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Family Cites Families (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6880026B2 (en) | 2002-05-16 | 2005-04-12 | International Business Machines Corporation | Method and apparatus for implementing chip-to-chip interconnect bus initialization |
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US9288032B2 (en) | 2012-04-13 | 2016-03-15 | Futurewei Technologies, Inc. | Dynamic frame structure for synchronous time-division duplexing digital subscriber lines |
US8898358B2 (en) * | 2012-07-04 | 2014-11-25 | International Business Machines Corporation | Multi-protocol communication on an I2C bus |
-
2015
- 2015-04-09 US US14/682,846 patent/US9710424B2/en active Active
- 2015-04-10 EP EP15721910.6A patent/EP3134820B1/en not_active Not-in-force
- 2015-04-10 JP JP2016563438A patent/JP2017514394A/ja not_active Ceased
- 2015-04-10 WO PCT/US2015/025464 patent/WO2015164102A1/en active Application Filing
- 2015-04-10 KR KR1020167031026A patent/KR20160146786A/ko unknown
- 2015-04-10 CN CN201580021178.7A patent/CN106462533A/zh active Pending
- 2015-04-10 BR BR112016024704A patent/BR112016024704A2/pt not_active IP Right Cessation
Patent Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
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JP2012142690A (ja) * | 2010-12-28 | 2012-07-26 | Sony Corp | 電子機器、電子機器の制御方法、送信装置および受信装置 |
Also Published As
Publication number | Publication date |
---|---|
CN106462533A (zh) | 2017-02-22 |
BR112016024704A2 (pt) | 2017-08-15 |
KR20160146786A (ko) | 2016-12-21 |
US9710424B2 (en) | 2017-07-18 |
US20150301980A1 (en) | 2015-10-22 |
EP3134820A1 (en) | 2017-03-01 |
WO2015164102A1 (en) | 2015-10-29 |
EP3134820B1 (en) | 2018-03-14 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
A521 | Written amendment |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20180327 |
|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20180327 |
|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20190206 |
|
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20190218 |
|
A045 | Written measure of dismissal of application |
Free format text: JAPANESE INTERMEDIATE CODE: A045 Effective date: 20190701 |