JP2017229130A - Power supply apparatus, circuit board and battery preservation method - Google Patents
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Abstract
Description
本発明は、電力供給装置、回路基板及び電池保存方法に関する。 The present invention relates to a power supply device, a circuit board, and a battery storage method.
アミューズメント用途の機器で使用されるモジュールでは、回路素子や電池が回路基板に直接実装されている場合が多い。
特許文献1には、関連する技術として、電池を搭載したメモリバックアップ用の回路基板に関する技術が開示されている。特許文献1に記載されている回路基板は、コネクタを介してメモリバックアップを実現する回路基板であり、搭載される電池は充電可能である。
In modules used in amusement equipment, circuit elements and batteries are often directly mounted on a circuit board.
回路素子や電池が回路基板に直接実装されるモジュールでは、回路素子や電池が回路基板に実装された時点で回路素子を介してモジュールの負荷に電流が流れ、モジュールの検査が行われる前に電池の消耗が開始されてしまう。特に、負荷が抵抗性の素子を含む場合には、負荷に電流が流れ続け、電池の消耗が激しくなる。
そこで、電池と負荷との間に機械スイッチを設けて電池から負荷への電力の経路を開状態と閉状態に切り替えることが考えられる。
しかしながら、アミューズメント用途などの機器で使用されるモジュールでは使用できる部品に制約があり、機械スイッチやコネクタなどの部品の使用ができない場合がある。また、信頼性を担保する見地から、機械スイッチやコネクタをできるだけ使用しない方が望ましい。
特許文献1に記載された回路基板と同様に電池として充電可能な電池を用いることも考えられる。しかしながら、この場合にも充電を行うためにはコネクタが必要であり、コネクタを使用できない場合がある。
そのため、電子部品や電源が回路基板に直接実装されアミューズメント用途で使用されるモジュールにおいて、電池の消耗を防ぐことのできる技術が求められていた。
In modules in which circuit elements and batteries are directly mounted on the circuit board, the current flows to the module load via the circuit elements when the circuit elements and batteries are mounted on the circuit board, and the battery is inspected before the module is inspected. Consumption starts. In particular, when the load includes a resistive element, a current continues to flow through the load, and battery consumption becomes severe.
Thus, it is conceivable to provide a mechanical switch between the battery and the load to switch the power path from the battery to the load between the open state and the closed state.
However, there are restrictions on the parts that can be used in modules used in devices such as amusement applications, and there are cases where parts such as mechanical switches and connectors cannot be used. Also, from the viewpoint of ensuring reliability, it is desirable to use as few mechanical switches and connectors as possible.
It is also conceivable to use a rechargeable battery as the battery as in the circuit board described in
Therefore, there is a need for a technique that can prevent battery consumption in a module that is mounted on a circuit board and has electronic components and a power supply directly used for amusement purposes.
本発明は、上記の課題を解決することのできる電力供給装置、回路基板及び電池保存方法を提供することを目的としている。 An object of the present invention is to provide a power supply device, a circuit board, and a battery storage method that can solve the above-described problems.
上記目的を達成するために、本発明は、外部に電力を供給する電源と前記電源から電力を受ける負荷と前記電源との間に設けられ所定の端子に印加される電圧に応じて開状態と閉状態とに切り替わるスイッチング素子と、前記スイッチング素子を開状態に維持する電圧保持部と、を備える電力供給装置である。 In order to achieve the above object, the present invention provides an open state in accordance with a voltage applied to a predetermined terminal provided between a power source that supplies power to the outside, a load that receives power from the power source, and the power source. A power supply device comprising: a switching element that switches to a closed state; and a voltage holding unit that maintains the switching element in an open state.
また、本発明は、外部に電力を供給する電源と前記電源から電力を受ける負荷と前記電源との間に設けられ所定の端子に印加される電圧に応じて開状態と閉状態とに切り替わるスイッチング素子、前記電源と並列に接続され一端が前記所定の端子に接続されて前記スイッチング素子を開状態に維持する抵抗のそれぞれを実装するための回路基板であって、前記電源、前記スイッチング素子、前記抵抗のそれぞれが実装され、前記所定の端子に接続される前記電源と前記抵抗との間の第1配線が切断された場合に、前記スイッチング素子が開状態から閉状態へと切り替わる配線パターンを備える回路基板である。 In addition, the present invention provides switching that switches between an open state and a closed state according to a voltage applied to a predetermined terminal provided between a power source that supplies power to the outside, a load that receives power from the power source, and the power source. A circuit board for mounting each of the resistors connected in parallel to the power source and having one end connected to the predetermined terminal and maintaining the switching device in an open state, the power source, the switching device, Each of the resistors is mounted, and when the first wiring between the power source connected to the predetermined terminal and the resistor is disconnected, the switching element includes a wiring pattern that switches from an open state to a closed state. It is a circuit board.
また、本発明は、外部に電力を供給する電池、前記電池から電力を受ける負荷と前記電池との間に設けられ所定の端子に印加される電圧に応じて開状態と閉状態とに切り替わるスイッチング素子、前記スイッチング素子を開状態に維持する電圧保持部のそれぞれが実装された回路基板を、前記電圧保持部が前記スイッチング素子を開状態に維持する状態で保存する、電池保存方法である。 The present invention also provides a battery that supplies power to the outside, a load that is provided between the battery that receives power from the battery and the battery, and switches between an open state and a closed state according to a voltage applied to a predetermined terminal. A battery storage method for storing a circuit board on which an element and a voltage holding unit that maintains the switching element in an open state are mounted in a state where the voltage holding unit maintains the switching element in an open state.
本発明によれば、電子部品や電源が回路基板に直接実装されアミューズメント用途で使用されるモジュールにおいて、電池の消耗を防ぐことができる。 ADVANTAGE OF THE INVENTION According to this invention, consumption of a battery can be prevented in the module in which an electronic component and a power supply are directly mounted on a circuit board and used for an amusement application.
<第一の実施形態>
本発明の第一の実施形態による電力供給装置について説明する。
本発明の第一の実施形態による電力供給装置は、本発明の最小構成の電力供給装置である。
<First embodiment>
A power supply device according to a first embodiment of the present invention will be described.
The power supply apparatus according to the first embodiment of the present invention is a power supply apparatus having a minimum configuration according to the present invention.
本発明の第一の実施形態による電力供給装置1は、図1に示すように、少なくとも、電源10と、スイッチング素子20と、電圧保持部30と、を備える。
As shown in FIG. 1, the
電源10は、外部に電力を供給する。
スイッチング素子20は、電源10と図示されていない負荷との間に設けられる。スイッチング素子20は、ゲートを備える。スイッチング素子20は、ゲートに印加される電圧に応じて開状態と閉状態とに切り替わる。
電圧保持部30は、スイッチング素子20を開状態に維持する。
The
The
The
このようにすれば、電力供給装置1は、電子部品や電源が回路基板に直接実装されアミューズメント用途で使用されるモジュールにおいて、電池の消耗を防ぐことができる。
In this way, the
<第二の実施形態>
本発明の第二の実施形態による電力供給装置について説明する。
本発明の第二の実施形態による電力供給装置1は、図2に示すように、電源10と、スイッチング素子20と、電圧保持部30と、を備える。
なお、図2には、負荷40が示されている。
<Second Embodiment>
A power supply device according to a second embodiment of the present invention will be described.
As shown in FIG. 2, the
In FIG. 2, a
電源10は、例えば、電池である。
スイッチング素子20は、例えば、図2に示すpMOS(Metal Oxide Semiconductor)トランジスタである。
電圧保持部30は、抵抗301を備える。
The
The
The
電源10、スイッチング素子20、電圧保持部30、負荷40のそれぞれは、図3に示すように、回路基板50上に実装される。
Each of the
電源10の高電圧側の端子a1は、回路基板50におけるパターン配線(以下、「パターン配線」と記載)を介して、スイッチング素子20のソース、スイッチング素子20のゲート(所定の端子)、抵抗301の端子c1のそれぞれに接続される。
The high voltage side terminal a1 of the
電源10の低電圧側の端子b1は、パターン配線を介して、抵抗301の端子d1、負荷40の端子e1のそれぞれに接続される。
The low-voltage side terminal b1 of the
スイッチング素子20のドレインは、パターン配線を介して、負荷40の端子f1に接続される。
The drain of the
なお、端子b1、端子d1、端子e1のそれぞれは、図示されていないグラウンドパターン配線を介して接続されている。 Each of the terminal b1, the terminal d1, and the terminal e1 is connected through a ground pattern wiring (not shown).
スイッチング素子20のソース、スイッチング素子のゲート、抵抗301の端子c1のそれぞれには、電源10によってHigh状態を示す同一の電圧が印加される。
The same voltage indicating the high state is applied to the source of the
スイッチング素子20は、ソースとゲートのそれぞれに同一の電圧が印加されると、開状態となり、負荷40に電流をほとんど流さない。
その結果、スイッチング素子20のドレインは、Low状態を示す電圧となる。
なお、このとき、電力供給装置1において流れる全電流の大部分は、電源10によって印加された電圧により抵抗301が流す電流である。
When the same voltage is applied to the source and the gate of the
As a result, the drain of the switching
At this time, most of the total current flowing in the
ここで、図2に示す電力供給装置1において、電源10の端子a1と抵抗301の端子c1とを接続しているパターン配線A1(第1配線、図2におけるA−A’間のパターン配線)が切断される。
例えば、パターン配線A1の切断は、図3で示す回路基板50のように、A−A’間にミシン目(スリット)の加工を施し、ミシン目に沿って回路基板50を切断することにより実現される。このとき、図3で示す回路基板50は、回路基板50aと回路基板50bのそれぞれに分離される。
なお、パターン配線A1の切断を行うために施される回路基板50の加工は、ミシン目の加工のほか、図4に示すVカットラインなどの回路基板の一部を切断するための加工であってもよい。
Here, in the
For example, the pattern wiring A1 is cut by cutting perforations (slits) between AA ′ and cutting the
The processing of the
パターン配線A1が切断された場合、スイッチング素子20のソースには、電源10によって、High状態を示す電圧が印加される。また、抵抗301の端子c1には電源10によるHigh状態を示す電圧が印加されなくなるため、抵抗301は、電流を流さない。そのため、抵抗301の端子c1、スイッチング素子20のゲートのそれぞれには、電源10によってLow状態を示す電圧が印加される。
スイッチング素子20のゲートがスイッチング素子20のソースよりも電圧が低くなり、実効的なゲート電圧(Vgs−Vth)の絶対値がスイッチング素子20のソース・ドレイン間電圧Vdsよりも大きくなる。
When the pattern wiring A <b> 1 is cut, a voltage indicating a high state is applied to the source of the switching
The voltage of the gate of the switching
スイッチング素子20は、実効的なゲート電圧(Vgs−Vth)の絶対値がスイッチング素子20のソース・ドレイン間電圧Vdsよりも大きくなると、閉状態となり、負荷40に電流を流す。
その結果、スイッチング素子20のドレインは、High状態を示す電圧となる。
なお、このとき、スイッチング素子20は、pMOSトランジスタの線形領域で動作する。
When the absolute value of the effective gate voltage (Vgs−Vth) becomes larger than the source-drain voltage Vds of the switching
As a result, the drain of the switching
At this time, the switching
したがって、図5に示す真理値表のように、電圧保持部30は、パターン配線A1が切断される前には、スイッチング素子20のゲートをHigh状態を示す電圧に保持する。スイッチング素子20は、ゲートがHigh状態を示す電圧である場合、開状態となる。その結果、スイッチング素子20には電流が流れず、負荷40には電力が供給されない。
また、図5に示す真理値表のように、電圧保持部30は、パターン配線A1が切断された後には、スイッチング素子20のゲートをLow状態を示す電圧に保持する。スイッチング素子20は、ゲートがLow状態を示す電圧である場合、閉状態となる。その結果、電源10からスイッチング素子20を介して負荷40に電流が流れ、電源10から負荷40に電力が供給される。
Therefore, as in the truth table shown in FIG. 5, the
Further, as in the truth table shown in FIG. 5, the
以上、本発明の第二の実施形態による電力供給装置1において、電源10は、負荷40に電力を供給する。スイッチング素子20は、電源10と負荷40との間に設けられる。スイッチング素子20は、ゲート(所定の端子)を備える。スイッチング素子20は、ゲートに印加される電圧に応じて開状態と閉状態とに切り替わる。電圧保持部30は、電源10と並列に接続され端子c1(一端)がゲートに接続されてスイッチング素子20を開状態に維持する抵抗301を備える。また、スイッチング素子20は、ゲートに接続される電源10と抵抗301との間のパターン配線A1(第1配線)が切断された場合に、開状態から閉状態へと切り替わる。
このようにすれば、電力供給装置1は、電子部品や電源が回路基板に直接実装されアミューズメント用途で使用されるモジュールにおいて、電池の消耗を防ぐことができる。
As described above, in the
In this way, the
<第三の実施形態>
本発明の第三の実施形態による電力供給装置について説明する。
本発明の第三の実施形態による電力供給装置1は、図6に示すように、電源10と、スイッチング素子20と、電圧保持部30と、を備える。
なお、図6には、負荷40が示されている。
<Third embodiment>
A power supply device according to a third embodiment of the present invention will be described.
As shown in FIG. 6, the
FIG. 6 shows the
スイッチング素子20は、例えば、図6に示すnMOSトランジスタである。
電圧保持部30は、抵抗301を備える。
The switching
The
電源10、スイッチング素子20、電圧保持部30、負荷40のそれぞれは、回路基板50上に実装される。
Each of the
電源10の高電圧側の端子a2は、パターン配線を介して、抵抗301の端子c2、負荷40の端子e2のそれぞれに接続される。
A terminal a2 on the high voltage side of the
電源10の低電圧側の端子b2は、パターン配線を介して、スイッチング素子20のソース、スイッチング素子20のゲート(所定の端子)、抵抗301の端子d2のそれぞれに接続される。
The terminal b2 on the low voltage side of the
スイッチング素子20のドレインは、パターン配線を介して、負荷40の端子f2に接続される。
The drain of the switching
スイッチング素子20のソース、スイッチング素子のゲート、抵抗301の端子d2のそれぞれには、電源10によってLow状態を示す同一の電圧が印加される。
The same voltage indicating the low state is applied to the source of the switching
スイッチング素子20は、ソースとゲートのそれぞれに同一の電圧が印加されると、開状態となり、負荷40に電流をほとんど流さない。
その結果、スイッチング素子20のドレインは、High状態を示す電圧となる。
なお、このとき、電力供給装置1において流れる全電流の大部分は、電源10によって印加された電圧により抵抗301が流す電流である。
When the same voltage is applied to the source and the gate of the switching
As a result, the drain of the switching
At this time, most of the total current flowing in the
ここで、図6に示す電力供給装置1において、電源10の端子b2と抵抗301の端子d2とを接続しているパターン配線B1(第1配線、図6におけるB−B’間のパターン配線)が切断される。
パターン配線B1の切断は、回路基板50におけるB−B’間にミシン目の加工を施し、ミシン目に沿って回路基板50を切断することにより実現される。
Here, in the
The cutting of the pattern wiring B1 is realized by performing perforation processing between BB ′ in the
パターン配線B1が切断された場合、スイッチング素子20のソースには、電源10によって、Low状態を示す電圧が印加される。また、抵抗301の端子d2には電源10によるLow状態を示す電圧が印加されなくなるため、抵抗301は、電流を流さない。そのため、抵抗301の端子d2、スイッチング素子20のゲートのそれぞれには、電源10によってHigh状態を示す電圧が印加される。
スイッチング素子20のゲートがスイッチング素子20のソースよりも電圧が高くなり、実効的なゲート電圧(Vgs−Vth)がスイッチング素子20のソース・ドレイン間電圧Vdsよりも大きくなる。
When the pattern wiring B <b> 1 is cut, a voltage indicating a low state is applied to the source of the switching
The gate of the switching
スイッチング素子20は、実効的なゲート電圧(Vgs−Vth)がスイッチング素子20のソース・ドレイン間電圧Vdsよりも大きくなると、閉状態となり、負荷40に電流を流す。
その結果、スイッチング素子20のドレインは、Low状態を示す電圧となる。
なお、このとき、スイッチング素子20は、nMOSトランジスタの線形領域で動作する。
When the effective gate voltage (Vgs−Vth) becomes larger than the source-drain voltage Vds of the switching
As a result, the drain of the switching
At this time, the switching
したがって、図7に示す真理値表のように、電圧保持部30は、パターン配線B1が切断される前には、スイッチング素子20のゲートをLow状態を示す電圧に保持する。スイッチング素子20は、ゲートがLow状態を示す電圧である場合、開状態となる。その結果、スイッチング素子20には電流が流れず、負荷40には電力が供給されない。
また、図7に示す真理値表のように、電圧保持部30は、パターン配線B1が切断された後には、スイッチング素子20のゲートをHigh状態を示す電圧に保持する。スイッチング素子20は、ゲートがHigh状態を示す電圧である場合、閉状態となる。その結果、電源10から負荷40に電流が流れ、電源10から負荷40に電力が供給される。
Therefore, as in the truth table shown in FIG. 7, the
Further, as in the truth table shown in FIG. 7, the
以上、本発明の第三の実施形態による電力供給装置1において、電源10は、負荷40に電力を供給する。スイッチング素子20は、電源10と負荷40との間に設けられる。スイッチング素子20は、ゲート(所定の端子)を備える。スイッチング素子20は、ゲートに印加される電圧に応じて開状態と閉状態とに切り替わる。電圧保持部30は、電源10と並列に接続され端子d2(一端)がゲートに接続されてスイッチング素子20を開状態に維持する抵抗301を備える。また、スイッチング素子20は、ゲートに接続される電源10と抵抗301との間のパターン配線B1(第1配線)が切断された場合に、開状態から閉状態へと切り替わる。
このようにすれば、電力供給装置1は、電子部品や電源が回路基板に直接実装されアミューズメント用途で使用されるモジュールにおいて、電池の消耗を防ぐことができる。
As described above, in the
In this way, the
<第四の実施形態>
本発明の第四の実施形態による電力供給装置について説明する。
本発明の第四の実施形態による電力供給装置1は、図8に示すように、電源10と、スイッチング素子20と、電圧保持部30と、を備える。
なお、図8には、負荷40が示されている。
<Fourth embodiment>
A power supply device according to a fourth embodiment of the present invention will be described.
As shown in FIG. 8, the
In FIG. 8, a
電源10は、例えば、電池である。
スイッチング素子20は、例えば、図8に示すpMOSトランジスタである。
電圧保持部30は、抵抗301と、サイリスタ302と、抵抗303と、nMOSトランジスタ304と、を備える。
The
The switching
The
電源10、スイッチング素子20、電圧保持部30、負荷40のそれぞれは、回路基板50上に実装される。
Each of the
電源10の高電圧側の端子a3は、パターン配線を介して、スイッチング素子20のソース、抵抗301の端子c3、サイリスタ302のアノードのそれぞれに接続される。
A terminal a3 on the high voltage side of the
電源10の低電圧側の端子b3は、パターン配線を介して、抵抗303の端子e3、nMOSトランジスタ304のソース、負荷40の端子g3のそれぞれに接続される。
The low-voltage side terminal b3 of the
スイッチング素子20のゲートは、パターン配線を介して、抵抗301の端子d3、nMOSトランジスタ304のドレインのそれぞれに接続される。
The gate of the switching
スイッチング素子20のドレインは、パターン配線を介して、負荷40の端子h3に接続される。
The drain of the switching
サイリスタ302のカソードは、パターン配線を介して、抵抗303の端子f3、nMOSトランジスタ304のゲートのそれぞれに接続される。
なお、サイリスタ302のゲートは、単独で存在する端子である。
The cathode of the
The gate of the
スイッチング素子20のソース、抵抗301の端子c3、サイリスタ302のアノードのそれぞれには、電源10によってHigh状態を示す同一の電圧が印加される。
The same voltage indicating the high state is applied to the source of the switching
サイリスタ302のゲートにLow状態を示す電圧が印加される場合、サイリスタ302は、オフ状態であり、抵抗303に電流を流さない。
その結果、nMOSトランジスタ304のゲートは、Low状態を示す電圧となる。
When a voltage indicating a low state is applied to the gate of the
As a result, the gate of the
nMOSトランジスタのゲートがLow状態を示す電圧である場合、nMOSトランジスタ304はオフ状態であり、抵抗301に電流を流さない。
その結果、スイッチング素子20のゲートは、ソースと同一の電位となる。
When the gate of the nMOS transistor has a voltage indicating a low state, the
As a result, the gate of the switching
スイッチング素子20は、ソースとゲートのそれぞれが同一の電位となると、開状態となり、負荷40に電流をほとんど流さない。
その結果、スイッチング素子20のドレインは、Low状態を示す電圧となる。
When the source and the gate of the switching
As a result, the drain of the switching
また、サイリスタ302のゲートにHigh状態を示す電圧が印加された場合、サイリスタ302は、オン状態であり、抵抗303に電流を流す。
その結果、nMOSトランジスタ304のゲートは、High状態を示す電圧となり、実効的なゲート電圧(Vgs−Vth)がnMOSトランジスタ304のソース・ドレイン間電圧Vdsよりも大きくなる。
In addition, when a voltage indicating a high state is applied to the gate of the
As a result, the gate of the
nMOSトランジスタ304は、実効的なゲート電圧(Vgs−Vth)がソース・ドレイン間電圧Vdsよりも大きくなると、オン状態となり、抵抗301に電流を流す。
その結果、スイッチング素子20のゲートは、Low状態を示す電圧となる。
When the effective gate voltage (Vgs−Vth) becomes larger than the source-drain voltage Vds, the
As a result, the gate of the switching
このとき、スイッチング素子20は、スイッチング素子20のゲートがスイッチング素子20のソースよりも電圧が低くなり、実効的なゲート電圧(Vgs−Vth)の絶対値がスイッチング素子20のソース・ドレイン間電圧Vdsよりも大きくなる。
At this time, in the switching
スイッチング素子20は、実効的なゲート電圧(Vgs−Vth)の絶対値がスイッチング素子20のソース・ドレイン間電圧Vdsよりも大きくなると、閉状態となり、負荷40に電流を流す。
その結果、スイッチング素子20のドレインは、High状態を示す電圧となる。
なお、このとき、スイッチング素子20は、pMOSトランジスタの線形領域で動作する。
When the absolute value of the effective gate voltage (Vgs−Vth) becomes larger than the source-drain voltage Vds of the switching
As a result, the drain of the switching
At this time, the switching
したがって、上述のサイリスタのゲートがLow状態の電圧を示す状態を切り替え前、サイリスタのゲートがHigh状態の電圧を示す状態を切り替え後とすると、図9に示す真理値表のように、電圧保持部30は、切り替え前には、スイッチング素子20のゲートをHigh状態を示す電圧に保持する。スイッチング素子20は、ゲートがHigh状態を示す電圧である場合、開状態となる。その結果、スイッチング素子20には電流が流れず、負荷40には電力が供給されない。
また、図9に示す真理値表のように、電圧保持部30は、切り替え後には、スイッチング素子20のゲートをLow状態を示す電圧に保持する。スイッチング素子20は、ゲートがLow状態を示す電圧である場合、閉状態となる。その結果、電源10からスイッチング素子20を介して負荷40に電流が流れ、電源10から負荷40に電力が供給される。
Accordingly, when the state in which the gate of the thyristor exhibits a low state voltage is switched before and after the state in which the gate of the thyristor exhibits a high state voltage is switched, the voltage holding unit is as shown in the truth table shown in FIG. 30 holds the gate of the switching
Further, as in the truth table shown in FIG. 9, the
以上、本発明の第四の実施形態による電力供給装置1において、電源10は、負荷40に電力を供給する。スイッチング素子20は、電源10と負荷40との間に設けられる。スイッチング素子20は、ゲート(所定の端子)を備える。スイッチング素子20は、ゲートに印加される電圧に応じて開状態と閉状態とに切り替わる。電圧保持部30は、抵抗301と、サイリスタ302と、抵抗303と、nMOSトランジスタ304と、を備える。サイリスタのゲートがLow状態の電圧を示す状態を切り替え前、サイリスタのゲートがHigh状態の電圧を示す状態を切り替え後とすると、電圧保持部30は、切り替え前には、スイッチング素子20のゲートをHigh状態を示す電圧に保持する。スイッチング素子20は、ゲートがHigh状態を示す電圧である場合、開状態となる。その結果、スイッチング素子20には電流が流れず、負荷40には電力が供給されない。また、電圧保持部30は、切り替え後には、スイッチング素子20のゲートをLow状態を示す電圧に保持する。スイッチング素子20は、ゲートがLow状態を示す電圧である場合、閉状態となる。その結果、電源10からスイッチング素子20を介して負荷40に電流が流れ、電源10から負荷40に電力が供給される。
このようにすれば、電力供給装置1は、電子部品や電源が回路基板に直接実装されアミューズメント用途で使用されるモジュールにおいて、電池の消耗を防ぐことができる。
As described above, in the
In this way, the
<第五の実施形態>
本発明の第五の実施形態による電力供給装置について説明する。
本発明の第五の実施形態による電力供給装置1は、図10に示すように、電源10と、スイッチング素子20と、電圧保持部30と、を備える。
なお、図10には、負荷40が示されている。
<Fifth embodiment>
A power supply device according to a fifth embodiment of the present invention will be described.
As shown in FIG. 10, the
In FIG. 10, a
電源10は、例えば、電池である。
スイッチング素子20は、例えば、図10に示すnMOSトランジスタである。
電圧保持部30は、抵抗301と、サイリスタ302と、抵抗303と、pMOSトランジスタ305と、を備える。
The
The switching
The
電源10、スイッチング素子20、電圧保持部30、負荷40のそれぞれは、回路基板50上に実装される。
Each of the
電源10の低電圧側の端子a4は、パターン配線を介して、抵抗303の端子c4、pMOSトランジスタ305のソース、負荷40の端子g4のそれぞれに接続される。
The low voltage side terminal a4 of the
電源10の高電圧側の端子b4は、パターン配線を介して、スイッチング素子20のソース、抵抗301の端子e4、サイリスタ302のカソードのそれぞれに接続される。
A terminal b4 on the high voltage side of the
スイッチング素子20のゲートは、パターン配線を介して、抵抗301の端子f4、pMOSトランジスタ305のドレインのそれぞれに接続される。
The gate of the switching
スイッチング素子20のドレインは、パターン配線を介して、負荷40の端子h4に接続される。
The drain of the switching
サイリスタ302のアノードは、パターン配線を介して、抵抗303の端子d4、pMOSトランジスタ305のゲートのそれぞれに接続される。
なお、サイリスタ302のゲートは、単独で存在する端子である。
The anode of the
The gate of the
スイッチング素子20のソース、抵抗301の端子e4、サイリスタ302のカソードのそれぞれには、電源10によってLow状態を示す同一の電圧が印加される。
The same voltage indicating the low state is applied by the
サイリスタ302のゲートにLow状態を示す電圧が印加される場合、サイリスタ302は、オフ状態であり、抵抗303に電流を流さない。
その結果、pMOSトランジスタ305のゲートは、High状態を示す電圧となる。
When a voltage indicating a low state is applied to the gate of the
As a result, the gate of the
pMOSトランジスタのゲートがHigh状態を示す電圧である場合、pMOSトランジスタ305はオフ状態であり、抵抗301に電流を流さない。
その結果、スイッチング素子20のゲートは、ソースと同一の電位となる。
When the gate of the pMOS transistor has a voltage indicating a high state, the
As a result, the gate of the switching
スイッチング素子20は、ソースとゲートのそれぞれが同一の電位となると、開状態となり、負荷40に電流をほとんど流さない。
その結果、スイッチング素子20のドレインは、High状態を示す電圧となる。
When the source and the gate of the switching
As a result, the drain of the switching
また、サイリスタ302のゲートにHigh状態を示す電圧が印加された場合、サイリスタ302は、オン状態であり、抵抗303に電流を流す。
その結果、pMOSトランジスタ305のゲートは、Low状態を示す電圧となり、実効的なゲート電圧(Vgs−Vth)の絶対値がpMOSトランジスタ305のソース・ドレイン間電圧Vdsよりも大きくなる。
In addition, when a voltage indicating a high state is applied to the gate of the
As a result, the gate of the
pMOSトランジスタ305は、実効的なゲート電圧(Vgs−Vth)の絶対値がソース・ドレイン間電圧Vdsよりも大きくなると、オン状態となり、抵抗301に電流を流す。
その結果、スイッチング素子20のゲートは、High状態を示す電圧となる。
When the absolute value of the effective gate voltage (Vgs−Vth) becomes larger than the source-drain voltage Vds, the
As a result, the gate of the switching
このとき、スイッチング素子20は、スイッチング素子20のゲートがスイッチング素子20のソースよりも電圧が高くなり、実効的なゲート電圧(Vgs−Vth)がスイッチング素子20のソース・ドレイン間電圧Vdsよりも大きくなる。
At this time, in the switching
スイッチング素子20は、実効的なゲート電圧(Vgs−Vth)がスイッチング素子20のソース・ドレイン間電圧Vdsよりも大きくなると、閉状態となり、負荷40に電流を流す。
その結果、スイッチング素子20のドレインは、Low状態を示す電圧となる。
なお、このとき、スイッチング素子20は、nMOSトランジスタの線形領域で動作する。
When the effective gate voltage (Vgs−Vth) becomes larger than the source-drain voltage Vds of the switching
As a result, the drain of the switching
At this time, the switching
したがって、上述のサイリスタのゲートがLow状態の電圧を示す状態を切り替え前、サイリスタのゲートがHigh状態の電圧を示す状態を切り替え後とすると、図11に示す真理値表のように、電圧保持部30は、切り替え前には、スイッチング素子20のゲートをLow状態を示す電圧に保持する。スイッチング素子20は、スイッチング素子20のゲートがLow状態を示す電圧である場合、開状態となる。その結果、スイッチング素子20には電流が流れず、負荷40には電力が供給されない。
また、図11に示す真理値表のように、電圧保持部30は、切り替え後には、スイッチング素子20のゲートをHigh状態を示す電圧に保持する。スイッチング素子20は、スイッチング素子20のゲートがHigh状態を示す電圧である場合、閉状態となる。その結果、電源10からスイッチング素子20を介して負荷40に電流が流れ、電源10から負荷40に電力が供給される。
Accordingly, when the state in which the gate of the thyristor exhibits a low state voltage is switched before and after the state in which the gate of the thyristor exhibits a high state voltage is switched, the voltage holding unit is as shown in the truth table shown in FIG. 30 holds the gate of the switching
Further, as in the truth table shown in FIG. 11, the
以上、本発明の第五の実施形態による電力供給装置1において、電源10は、負荷40に電力を供給する。スイッチング素子20は、電源10と負荷40との間に設けられる。スイッチング素子20は、ゲート(所定の端子)を備える。スイッチング素子20は、ゲートに印加される電圧に応じて開状態と閉状態とに切り替わる。電圧保持部30は、抵抗301と、サイリスタ302と、抵抗303と、pMOSトランジスタ305と、を備える。サイリスタのゲートがLow状態の電圧を示す状態を切り替え前、サイリスタのゲートがHigh状態の電圧を示す状態を切り替え後とすると、電圧保持部30は、切り替え前には、スイッチング素子20のゲートをLow状態を示す電圧に保持する。スイッチング素子20は、スイッチング素子20のゲートがLow状態を示す電圧である場合、開状態となる。その結果、スイッチング素子20には電流が流れず、負荷40には電力が供給されない。また、電圧保持部30は、切り替え後には、スイッチング素子20のゲートをHigh状態を示す電圧に保持する。スイッチング素子20は、スイッチング素子20のゲートがHigh状態を示す電圧である場合、閉状態となる。その結果、電源10からスイッチング素子20を介して負荷40に電流が流れ、電源10から負荷40に電力が供給される。
このようにすれば、電力供給装置1は、電子部品や電源が回路基板に直接実装されアミューズメント用途で使用されるモジュールにおいて、電池の消耗を防ぐことができる。
As described above, in the
In this way, the
<第六の実施形態>
本発明の第六の実施形態による電力供給装置について説明する。
本発明の第六の実施形態による電力供給装置1は、図12に示すように、電源10と、スイッチング素子20と、電圧保持部30と、を備える。
なお、図12には、負荷40が示されている。
<Sixth embodiment>
A power supply device according to a sixth embodiment of the present invention will be described.
As shown in FIG. 12, the
In FIG. 12, a
電源10は、例えば、電池である。
スイッチング素子20は、例えば、図12に示すpMOSトランジスタである。
電圧保持部30は、SR−FF(Set−Reset Flip−Flop)306と、抵抗307と、抵抗308と、を備える。
The
The switching
The
電源10、スイッチング素子20、電圧保持部30、負荷40のそれぞれは、回路基板50上に実装される。また、回路基板50上には、SR−FF306に信号を入力するための端子S、端子R、端子GNDが設けられている。
Each of the
電源10の高電圧側の端子a5は、パターン配線を介して、スイッチング素子20のソース、SR−FF306の電源端子Vのそれぞれに接続される。
The high voltage side terminal a5 of the
電源10の低電圧側の端子b5は、パターン配線を介して、SR−FF306のGND、抵抗307の端子c5、抵抗308の端子e5、負荷40の端子g5、SR−FF306に信号を入力するための端子GNDのそれぞれに接続される。
The terminal b5 on the low voltage side of the
スイッチング素子20のゲートは、パターン配線を介して、SR−FF306の端子Qに接続される。
The gate of the switching
スイッチング素子20のドレインは、パターン配線を介して、負荷40の端子h5に接続される。
The drain of the switching
SR−FF306の端子Sは、パターン配線を介して、抵抗308の端子f5、SR−FF306に信号を入力するための端子Sのそれぞれに接続される。
The terminal S of the SR-
SR−FF306の端子Rは、パターン配線を介して、抵抗307の端子d5、SR−FF306に信号を入力するための端子Rのそれぞれに接続される。
The terminal R of the SR-
SR−FF306に信号を入力するための端子SにHigh状態を示す電圧が印加され、SR−FF306に信号を入力するための端子RにLow状態を示す電圧が印加される場合、SR−FF306の出力Qは、High状態を示す電圧となり、スイッチング素子20のソースとゲートのそれぞれが同一の電位となる。
When a voltage indicating a high state is applied to the terminal S for inputting a signal to the SR-
スイッチング素子20は、ソースとゲートのそれぞれが同一の電位となると、開状態となり、負荷40に電流をほとんど流さない。
その結果、スイッチング素子20のドレインは、Low状態を示す電圧となる。
When the source and the gate of the switching
As a result, the drain of the switching
次に、SR−FF306に信号を入力するための端子Sと端子RのそれぞれにLow状態を示す電圧が印加されると、SR−FF306は、直前の状態を保持し、SR−FF306の出力Qは、High状態を示す電圧を保持する。
その結果、スイッチング素子20のドレインは、Low状態を示す電圧を保持する。
Next, when a voltage indicating a low state is applied to each of the terminal S and the terminal R for inputting a signal to the SR-
As a result, the drain of the switching
また、SR−FF306に信号を入力するための端子SにLow状態を示す電圧が印加され、SR−FF306に信号を入力するための端子RにHigh状態を示す電圧が印加される場合、SR−FF306の出力Qは、Low状態を示す電圧となる。
When a voltage indicating a low state is applied to the terminal S for inputting a signal to the SR-
このとき、スイッチング素子20は、スイッチング素子20のゲートがスイッチング素子20のソースよりも電圧が低くなり、実効的なゲート電圧(Vgs−Vth)の絶対値がスイッチング素子20のソース・ドレイン間電圧Vdsよりも大きくなる。
At this time, in the switching
スイッチング素子20は、実効的なゲート電圧(Vgs−Vth)の絶対値がスイッチング素子20のソース・ドレイン間電圧Vdsよりも大きくなると、閉状態となり、負荷40に電流を流す。
その結果、スイッチング素子20のドレインは、High状態を示す電圧となる。
なお、このとき、スイッチング素子20は、pMOSトランジスタの線形領域で動作する。
When the absolute value of the effective gate voltage (Vgs−Vth) becomes larger than the source-drain voltage Vds of the switching
As a result, the drain of the switching
At this time, the switching
したがって、上述のSR−FF306に信号を入力するための端子SにHigh状態を示す電圧が印加され、SR−FF306に信号を入力するための端子RにLow状態を示す電圧が印加される場合を保管前、SR−FF306に信号を入力するための端子Sと端子RのそれぞれにLow状態を示す電圧が印加される場合を保管後、その後にSR−FF306に信号を入力するための端子SにLow状態を示す電圧が印加され、SR−FF306に信号を入力するための端子RにHigh状態を示す電圧が印加される場合を設定時とすると、図13に示す真理値表のように、電圧保持部30は、保管時及び保管後には、スイッチング素子20のゲートをHigh状態を示す電圧に保持する。スイッチング素子20は、ゲートがHigh状態を示す電圧である場合、開状態となる。その結果、スイッチング素子20には電流が流れず、負荷40には電力が供給されない。
また、図13に示す真理値表のように、電圧保持部30は、設定後には、スイッチング素子20のゲートをLow状態を示す電圧に保持する。スイッチング素子20は、ゲートがLow状態を示す電圧である場合、閉状態となる。その結果、電源10からスイッチング素子20を介して負荷40に電流が流れ、電源10から負荷40に電力が供給される。
なお、図13に示す真理値表における切断後とは、回路基板50が切断され、SR−FF306に信号を入力するための端子S、端子R、端子GNDが回路基板50から切り離された状態を示している。SR−FF306に信号を入力するための端子S、端子R、端子GNDが回路基板50から切り離されても、設定時の論理状態は変化しない。
Therefore, a case where a voltage indicating a high state is applied to the terminal S for inputting a signal to the SR-
Further, as shown in the truth table shown in FIG. 13, the
Note that after cutting in the truth table shown in FIG. 13, the
なお、SR−FF306の端子Qをスイッチング素子20のゲートに接続させる代わりに出力Qの論理状態を反転した端子Qbarをスイッチング素子20のゲートに接続させてもよい。ただし、SR−FF306の端子Qをスイッチング素子20のゲートに接続させる代わりに端子Qbarをスイッチング素子20のゲートに接続させる場合、図14に示す真理値表のように、SR−FFの入力Sと、入力Rとを変更する必要がある。
Instead of connecting the terminal Q of the SR-
また、SR−FF306の代わりにJK−FF(JK Flip−Flop)を用いてもよい。その場合、SR−FF306の端子Sの代わりがJK−FFの端子Jである。また、SR−FF306の端子Rの代わりがJK−FFの端子Kである。
Further, JK-FF (JK Flip-Flop) may be used instead of SR-FF306. In that case, the terminal S of the SR-
以上、本発明の第六の実施形態による電力供給装置1において、電源10は、負荷40に電力を供給する。スイッチング素子20は、電源10と負荷40との間に設けられる。スイッチング素子20は、ゲート(所定の端子)を備える。スイッチング素子20は、ゲートに印加される電圧に応じて開状態と閉状態とに切り替わる。電圧保持部30は、SR−FF306と、抵抗307と、抵抗308と、を備える。電源10、スイッチング素子20、電圧保持部30、負荷40のそれぞれは、回路基板50上に実装される。回路基板50上には、SR−FF306に信号を入力するための端子S、端子R、端子GNDが設けられている。SR−FF306に信号を入力するための端子SにHigh状態を示す電圧が印加され、SR−FF306に信号を入力するための端子RにLow状態を示す電圧が印加される場合を保管前とする。SR−FF306に信号を入力するための端子Sと端子RのそれぞれにLow状態を示す電圧が印加される場合を保管後とする。その後にSR−FF306に信号を入力するための端子SにLow状態を示す電圧が印加され、SR−FF306に信号を入力するための端子RにHigh状態を示す電圧が印加される場合を設定時とする。電圧保持部30は、保管時及び保管後には、スイッチング素子20のゲートをHigh状態を示す電圧に保持する。スイッチング素子20は、ゲートがHigh状態を示す電圧である場合、開状態となる。その結果、スイッチング素子20には電流が流れず、負荷40には電力が供給されない。また、電圧保持部30は、設定後には、スイッチング素子20のゲートをLow状態を示す電圧に保持する。スイッチング素子20は、ゲートがLow状態を示す電圧である場合、閉状態となる。その結果、電源10からスイッチング素子20を介して負荷40に電流が流れ、電源10から負荷40に電力が供給される。
このようにすれば、電力供給装置1は、電子部品や電源が回路基板に直接実装されアミューズメント用途で使用されるモジュールにおいて、電池の消耗を防ぐことができる。
As described above, in the
In this way, the
<第七の実施形態>
本発明の第七の実施形態による電力供給装置について説明する。
本発明の第七の実施形態による電力供給装置1は、図15に示すように、電源10と、スイッチング素子20と、電圧保持部30と、を備える。
なお、図15には、負荷40が示されている。
<Seventh embodiment>
A power supply device according to a seventh embodiment of the present invention will be described.
As shown in FIG. 15, the
FIG. 15 shows the
電源10は、例えば、電池である。
スイッチング素子20は、例えば、図15に示すnMOSトランジスタである。
電圧保持部30は、SR−FF306と、抵抗307と、抵抗308と、を備える。
The
The switching
The
電源10、スイッチング素子20、電圧保持部30、負荷40のそれぞれは、回路基板50上に実装される。また、回路基板50上には、SR−FF306に信号を入力するための端子S、端子R、端子GNDが設けられている。
Each of the
電源10の高電圧側の端子a6は、パターン配線を介して、スイッチング素子20のソース、SR−FF306の電源端子Vのそれぞれに接続される。
A terminal a6 on the high voltage side of the
電源10の低電圧側の端子b6は、パターン配線を介して、SR−FF306のGND、抵抗307の端子c6、抵抗308の端子e6、負荷40の端子g6、SR−FF306に信号を入力するための端子GNDのそれぞれに接続される。
The terminal b6 on the low voltage side of the
スイッチング素子20のゲートは、パターン配線を介して、SR−FF306の端子Qbarに接続される。
The gate of the switching
スイッチング素子20のドレインは、パターン配線を介して、負荷40の端子h5に接続される。
The drain of the switching
SR−FF306の端子Sは、パターン配線を介して、抵抗308の端子f5、SR−FF306に信号を入力するための端子Sのそれぞれに接続される。
The terminal S of the SR-
SR−FF306の端子Rは、パターン配線を介して、抵抗307の端子d5、SR−FF306に信号を入力するための端子Rのそれぞれに接続される。
The terminal R of the SR-
SR−FF306に信号を入力するための端子SにHigh状態を示す電圧が印加され、SR−FF306に信号を入力するための端子RにLow状態を示す電圧が印加される場合、SR−FF306の出力Qbarは、Low状態を示す電圧となり、スイッチング素子20のソースとゲートのそれぞれが同一の電位となる。
When a voltage indicating a high state is applied to the terminal S for inputting a signal to the SR-
スイッチング素子20は、ソースとゲートのそれぞれが同一の電位となると、開状態となり、負荷40に電流をほとんど流さない。
その結果、スイッチング素子20のドレインは、High状態を示す電圧となる。
When the source and the gate of the switching
As a result, the drain of the switching
次に、SR−FF306に信号を入力するための端子Sと端子RのそれぞれにLow状態を示す電圧が印加されると、SR−FF306は、直前の状態を保持し、SR−FF306の出力Qbarは、Low状態を示す電圧を保持する。
その結果、スイッチング素子20のドレインは、High状態を示す電圧を保持する。
Next, when a voltage indicating a low state is applied to each of the terminal S and the terminal R for inputting a signal to the SR-
As a result, the drain of the switching
また、SR−FF306に信号を入力するための端子SにLow状態を示す電圧が印加され、SR−FF306に信号を入力するための端子RにHigh状態を示す電圧が印加される場合、SR−FF306の出力Qbarは、High状態を示す電圧となる。
When a voltage indicating a low state is applied to the terminal S for inputting a signal to the SR-
このとき、スイッチング素子20は、スイッチング素子20のゲートがスイッチング素子20のソースよりも電圧が高くなり、実効的なゲート電圧(Vgs−Vth)がスイッチング素子20のソース・ドレイン間電圧Vdsよりも大きくなる。
At this time, in the switching
スイッチング素子20は、実効的なゲート電圧(Vgs−Vth)がスイッチング素子20のソース・ドレイン間電圧Vdsよりも大きくなると、閉状態となり、負荷40に電流を流す。
その結果、スイッチング素子20のドレインは、Low状態を示す電圧となる。
なお、このとき、スイッチング素子20は、nMOSトランジスタの線形領域で動作する。
When the effective gate voltage (Vgs−Vth) becomes larger than the source-drain voltage Vds of the switching
As a result, the drain of the switching
At this time, the switching
したがって、上述のSR−FF306に信号を入力するための端子SにHigh状態を示す電圧が印加され、SR−FF306に信号を入力するための端子RにLow状態を示す電圧が印加される場合を保管前、SR−FF306に信号を入力するための端子Sと端子RのそれぞれにLow状態を示す電圧が印加される場合を保管後、その後にSR−FF306に信号を入力するための端子SにLow状態を示す電圧が印加され、SR−FF306に信号を入力するための端子RにHigh状態を示す電圧が印加される場合を設定時とすると、図16に示す真理値表のように、電圧保持部30は、保管時及び保管後には、スイッチング素子20のゲートをHigh状態を示す電圧に保持する。スイッチング素子20は、ゲートがHigh状態を示す電圧である場合、開状態となる。その結果、スイッチング素子20には電流が流れず、負荷40には電力が供給されない。
また、図16に示す真理値表のように、電圧保持部30は、設定後には、スイッチング素子20のゲートをLow状態を示す電圧に保持する。スイッチング素子20は、ゲートがLow状態を示す電圧である場合、閉状態となる。その結果、電源10からスイッチング素子20を介して負荷40に電流が流れ、電源10から負荷40に電力が供給される。
なお、図16に示す真理値表における切断後とは、回路基板50が切断され、SR−FF306に信号を入力するための端子S、端子R、端子GNDが回路基板50から切り離された状態を示している。SR−FF306に信号を入力するための端子S、端子R、端子GNDが回路基板50から切り離されても、設定時の論理状態は変化しない。
Therefore, a case where a voltage indicating a high state is applied to the terminal S for inputting a signal to the SR-
Further, as shown in the truth table shown in FIG. 16, after the setting, the
Note that after cutting in the truth table shown in FIG. 16, the
なお、SR−FF306の端子Qbarをスイッチング素子20のゲートに接続させる代わりに出力Qbarの論理状態を反転した端子Qをスイッチング素子20のゲートに接続させてもよい。ただし、SR−FF306の端子Qbarをスイッチング素子20のゲートに接続させる代わりに端子Qをスイッチング素子20のゲートに接続させる場合、図17に示す真理値表のように、SR−FFの入力Sと、入力Rとを変更する必要がある。
Note that instead of connecting the terminal Qbar of the SR-
また、SR−FF306の代わりにJK−FFを用いてもよい。その場合、SR−FF306の端子Sの代わりがJK−FFの端子Jである。また、SR−FF306の端子Rの代わりがJK−FFの端子Kである。
Further, JK-FF may be used instead of SR-FF306. In that case, the terminal S of the SR-
以上、本発明の第七の実施形態による電力供給装置1において、電源10は、負荷40に電力を供給する。スイッチング素子20は、電源10と負荷40との間に設けられる。スイッチング素子20は、ゲート(所定の端子)を備える。スイッチング素子20は、ゲートに印加される電圧に応じて開状態と閉状態とに切り替わる。電圧保持部30は、SR−FF306と、抵抗307と、抵抗308と、を備える。電源10、スイッチング素子20、電圧保持部30、負荷40のそれぞれは、回路基板50上に実装される。回路基板50上には、SR−FF306に信号を入力するための端子S、端子R、端子GNDが設けられている。SR−FF306に信号を入力するための端子SにHigh状態を示す電圧が印加され、SR−FF306に信号を入力するための端子RにLow状態を示す電圧が印加される場合を保管前とする。SR−FF306に信号を入力するための端子Sと端子RのそれぞれにLow状態を示す電圧が印加される場合を保管後とする。その後にSR−FF306に信号を入力するための端子SにLow状態を示す電圧が印加され、SR−FF306に信号を入力するための端子RにHigh状態を示す電圧が印加される場合を設定時とする。電圧保持部30は、保管時及び保管後には、スイッチング素子20のゲートをHigh状態を示す電圧に保持する。スイッチング素子20は、ゲートがHigh状態を示す電圧である場合、開状態となる。その結果、スイッチング素子20には電流が流れず、負荷40には電力が供給されない。また、電圧保持部30は、設定後には、スイッチング素子20のゲートをLow状態を示す電圧に保持する。スイッチング素子20は、ゲートがLow状態を示す電圧である場合、閉状態となる。その結果、電源10からスイッチング素子20を介して負荷40に電流が流れ、電源10から負荷40に電力が供給される。
このようにすれば、電力供給装置1は、電子部品や電源が回路基板に直接実装されアミューズメント用途で使用されるモジュールにおいて、電池の消耗を防ぐことができる。
As described above, in the
In this way, the
なお、本発明の実施形態における真理値表は、負荷40として抵抗性の負荷を想定した場合の論理を示している。しかしながら、本発明の実施形態における負荷40は、抵抗性の負荷に限定するものではない。本発明の実施形態における負荷40は、それぞれのモジュールの用途に応じた負荷(例えば、容量性の負荷)であってよい。
Note that the truth table in the embodiment of the present invention shows the logic when a resistive load is assumed as the
なお、本発明の実施形態による電力供給装置1は、pMOSトランジスタの代わりにpnpバイポーラトランジスタを用いて構成されてもよい。また、本発明の実施形態による電力供給装置1は、nMOSトランジスタの代わりにnpnバイポーラトランジスタを用いて構成されてもよい。
The
なお、本発明の実施形態における処理は、適切な処理が行われる範囲において、処理の順番が入れ替わってもよい。 Note that the processing order of the processing according to the embodiment of the present invention may be changed within a range in which appropriate processing is performed.
本発明の実施形態における記憶部のそれぞれは、適切な情報の送受信が行われる範囲においてどこに備えられていてもよい。また、記憶部のそれぞれは、適切な情報の送受信が行われる範囲において複数存在しデータを分散して記憶していてもよい。 Each of the storage units in the embodiment of the present invention may be provided anywhere as long as appropriate information is transmitted and received. Each of the storage units may exist in a range in which appropriate information is transmitted and received, and data may be distributed and stored.
本発明の実施形態について説明したが、上述の電力供給装置1のそれぞれは内部に、コンピュータシステムを有していてもよい。そして、上述した処理の過程は、プログラムの形式でコンピュータ読み取り可能な記録媒体に記憶されており、このプログラムをコンピュータが読み出して実行することによって、上記処理が行われる。ここでコンピュータ読み取り可能な記録媒体とは、磁気ディスク、光磁気ディスク、CD−ROM、DVD−ROM、半導体メモリ等をいう。また、このコンピュータプログラムを通信回線によってコンピュータに配信し、この配信を受けたコンピュータがそのプログラムを実行するようにしてもよい。
Although the embodiment of the present invention has been described, each of the above-described
また、上記プログラムは、前述した機能の一部を実現してもよい。さらに、上記プログラムは、前述した機能をコンピュータシステムにすでに記録されているプログラムとの組み合わせで実現できるファイル、いわゆる差分ファイル(差分プログラム)であってもよい。 The program may realize part of the functions described above. Further, the program may be a so-called difference file (difference program) that can realize the above-described functions in combination with a program already recorded in the computer system.
本発明のいくつかの実施形態を説明したが、これらの実施形態は、例であり、発明の範囲を限定しない。これらの実施形態は、発明の要旨を逸脱しない範囲で、追加、種々の省略、置き換え、変更を行ってよい。 Although several embodiments of the present invention have been described, these embodiments are examples and do not limit the scope of the invention. These embodiments may be added, variously omitted, replaced, and changed without departing from the gist of the invention.
1・・・電力供給装置
10・・・電源
20・・・スイッチング素子
30・・・電圧保持部
40・・・負荷
50、50a、50b・・・回路基板
301、303、307、308・・・抵抗
302・・・サイリスタ
304・・・nMOSトランジスタ
305・・・pMOSトランジスタ
306・・・SR−FF
A1・・・パターン配線
DESCRIPTION OF
A1 ... Pattern wiring
Claims (8)
前記スイッチング素子を開状態に維持する電圧保持部と、
を備える電力供給装置。 A switching element that is provided between a power source that supplies power to the outside, a load that receives power from the power source, and a voltage applied to a predetermined terminal, and switches between an open state and a closed state;
A voltage holding unit for maintaining the switching element in an open state;
A power supply device comprising:
前記電源と並列に接続され一端が前記所定の端子に接続されて前記スイッチング素子を開状態に維持する抵抗、
を備え、
前記スイッチング素子は、
前記所定の端子に接続される前記電源と前記抵抗との間の第1配線が切断された場合に、開状態から閉状態へと切り替わる、
請求項1に記載の電力供給装置。 The voltage holding unit is
A resistor connected in parallel with the power source and having one end connected to the predetermined terminal to maintain the switching element in an open state;
With
The switching element is
When the first wiring between the power source and the resistor connected to the predetermined terminal is cut, the open state is switched to the closed state.
The power supply apparatus according to claim 1.
前記電源、前記スイッチング素子及び前記電圧保持部が実装された回路基板上に形成され、
前記スイッチング素子は、
前記第1配線が形成された回路基板部分を取り除かれることによって前記第1配線が切断された場合に、開状態から閉状態へと切り替わる、
請求項2に記載の電力供給装置。 The first wiring is
Formed on a circuit board on which the power source, the switching element and the voltage holding unit are mounted;
The switching element is
When the first wiring is cut by removing the circuit board portion on which the first wiring is formed, the state is switched from the open state to the closed state.
The power supply apparatus according to claim 2.
MOSトランジスタである、
請求項1から請求項3の何れか一項に記載の電力供給装置。 The switching element is
A MOS transistor,
The power supply device according to any one of claims 1 to 3.
外部から印加されたハイ状態を示す信号、または、ロウ状態を示す信号を受け、受けた信号に基づいて前記所定の端子に電圧を印加し、
前記スイッチング素子は、
前記電圧保持部によって前記所定の端子に印加された電圧に応じて、開状態から閉状態へと切り替わる、
請求項1に記載の電力供給装置。 The voltage holding unit is
Receiving a signal indicating a high state or a signal indicating a low state applied from the outside, and applying a voltage to the predetermined terminal based on the received signal;
The switching element is
According to the voltage applied to the predetermined terminal by the voltage holding unit, the open state is switched to the closed state.
The power supply apparatus according to claim 1.
前記電源、前記スイッチング素子、前記抵抗のそれぞれが実装され、前記所定の端子に接続される前記電源と前記抵抗との間の第1配線が切断された場合に、前記スイッチング素子が開状態から閉状態へと切り替わる配線パターンを備える回路基板。 A switching element that is provided between a power source that supplies power to the outside, a load that receives power from the power source, and the power source, and that switches between an open state and a closed state in accordance with a voltage applied to a predetermined terminal; A circuit board for mounting each of the resistors connected at one end to the predetermined terminal and maintaining the switching element in an open state,
When each of the power source, the switching element, and the resistor is mounted and the first wiring between the power source and the resistor connected to the predetermined terminal is disconnected, the switching element is closed from the open state. A circuit board provided with a wiring pattern that switches to a state.
請求項6に記載の回路基板。 The circuit board portion on which the first wiring is formed is processed so as to be removable.
The circuit board according to claim 6.
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JP2016122582A JP6822647B2 (en) | 2016-06-21 | 2016-06-21 | Power supply device, circuit board and battery storage method |
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JP6822647B2 JP6822647B2 (en) | 2021-01-27 |
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Citations (3)
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---|---|---|---|---|
JPH0591226A (en) * | 1991-05-15 | 1993-04-09 | Fuji Xerox Co Ltd | Facsimile equipment |
JPH11237934A (en) * | 1998-02-23 | 1999-08-31 | Yaskawa Electric Corp | Auxiliary power unit |
JP2001291935A (en) * | 2000-04-10 | 2001-10-19 | Mitsubishi Electric Corp | Circuit board and device using the same |
-
2016
- 2016-06-21 JP JP2016122582A patent/JP6822647B2/en active Active
Patent Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0591226A (en) * | 1991-05-15 | 1993-04-09 | Fuji Xerox Co Ltd | Facsimile equipment |
JPH11237934A (en) * | 1998-02-23 | 1999-08-31 | Yaskawa Electric Corp | Auxiliary power unit |
JP2001291935A (en) * | 2000-04-10 | 2001-10-19 | Mitsubishi Electric Corp | Circuit board and device using the same |
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