JP2015198295A - 情報処理システム、その制御方法、及び制御装置 - Google Patents
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Abstract
Description
図1は、本実施形態による情報処理システムの構成例を説明する図である。本実施形態による情報処理システムは、例えばデータセンタに構築されたシステムである。図1には、説明上、便宜的に、情報処理システムの一部を抜粋して表している。
トンネル通信用のパケット(以降「トンネル化パケット」と表記)は、本来の通信に使用するプロトコルで記述されたパケット(以降「通常パケット」と表記)をカプセル化して作成される。図3に表すトンネリングプロトコル情報40は、カプセル化のために通常パケットに付加される情報である。図3に表す例では、トンネリングプロトコル情報40は、送信先MACアドレス(図3中「Outer MAC DA」と表記)、送信元MACアドレス(図3中「Outer MAC SA」と表記)、VLAN−ID、送信先IPアドレス(図3中「Outer IP DA」と表記)、送信元IPアドレス(図3中「Outer IP SA」と表記)、及びトンネルIDを含む。
送信元MACアドレス、及び送信元IPアドレスは、GARPパケットを送信するホスト1に割り当てられたMACアドレス、及びIPアドレスである。探索対象MACアドレス、及び探索対象IPアドレスは、GARPパケットの応答をすべきホスト1を指定する。GARPパケットでは、探索対象MACアドレス、及び探索対象IPアドレスは、GARPパケットを送信するホスト1に割り当てられているMACアドレス、及びIPアドレスとなる。
(付記1)
パケットの送信元である第1の情報処理装置と、前記パケットの送信先である第2の情報処理装置と、第1のポートと第2のポートを備えるとともに前記パケットを前記第1のポートと前記第2のポート間で中継する第3の情報処理装置と、前記第1の情報処理装置と前記第2の情報処理装置と前記第3の情報処理装置を制御する制御装置とを有する情報処理システムにおいて、
前記制御装置は、
前記第2の情報処理装置を識別する第2の識別情報を含むアドレスを解決するための第1の要求パケットを受信しないように前記第2の情報処理装置に設定する設定部と、
前記第3の情報処理装置に前記第1のポートから前記第1の識別情報を含む第1の確認パケットを送信させ、前記第1の情報処理装置に前記第1の要求パケットを送信させ、前記第3の情報処理装置に前記第1のポートから前記第1の要求パケットに対する第1の応答パケットを送信させる制御部とを有することを特徴とする情報処理システム。
(付記2)
前記設定部はさらに、
前記第1の情報処理装置を識別する第1の識別情報を含むアドレスを解決するための第2の要求パケットを受信しないように前記第1の情報処理装置を設定し、
前記制御部はさらに、
前記第3の情報処理装置に前記第2のポートから前記第2の識別情報を含む第2の確認パケットを送信させ、前記第2の情報処理装置に前記第2の要求パケットを送信させ、前記第3の情報処理装置に前記第2のポートから前記第2の要求パケットに対する第2の応答パケットを送信させることを特徴とする付記1記載の情報処理システム。
(付記3)
前記情報処理システムは、
3台以上の複数の情報処理装置を有し、
前記制御装置はさらに、
前記ネットワークで輻輳が発生した場合、前記複数の情報処理装置のうち、発生した輻輳を回避できる経路上に存在する情報処理装置を、前記第3の情報処理装置として選択する選択部を有することを特徴とする付記1又は2記載の情報処理システム。
(付記4)
前記選択部は、
前記複数の情報処理装置のうち、前記第3の情報処理装置として選択可能な情報処理装置が複数存在する場合、選択可能な各情報処理装置が備える演算処理装置の使用率に基づいて、前記第3の情報処理装置を選択することを特徴とする付記3記載の情報処理システム。
(付記5)
パケットの送信元である第1の情報処理装置と、前記パケットの送信先である第2の情報処理装置と、第1のポートと第2のポートを備えるとともに前記パケットを前記第1のポートと前記第2のポート間で中継する第3の情報処理装置とを制御する制御装置において、
前記制御装置は、
前記第2の情報処理装置を識別する第2の識別情報を含むアドレスを解決するための第1の要求パケットを受信しないように前記第2の情報処理装置に設定する設定部と、
前記第3の情報処理装置に、前記第1のポートから前記第1の識別情報を含む第1の確認パケットを送信させ、前記第1の情報処理装置に、前記第1の要求パケットを送信させ、前記第3の情報処理装置に、前記第1のポートから前記第1の要求パケットに対する第1の応答パケットを送信させる制御部とを有することを特徴とする制御装置。
(付記6)
パケットの送信元である第1の情報処理装置と、前記パケットの送信先である第2の情報処理装置と、第1のポートと第2のポートを備えるとともに前記パケットを前記第1のポートと前記第2のポート間で中継する第3の情報処理装置と、前記第1の情報処理装置と前記第2の情報処理装置と前記第3の情報処理装置を制御する制御装置とを有する情報処理システムの制御方法において、
前記制御装置が、
前記第2の情報処理装置を識別する第2の識別情報を含むアドレスを解決するための第1の要求パケットを受信しないように前記第2の情報処理装置に設定し、
前記第3の情報処理装置に、前記第1のポートから前記第1の識別情報を含む第1の確認パケットを送信させ、
前記第1の情報処理装置に、前記第1の要求パケットを送信させ、
前記第3の情報処理装置に、前記第1のポートから前記第1の要求パケットに対する第1の応答パケットを送信させることを特徴とする情報処理システムの制御方法。
(付記7)
パケットの送信元である第1の情報処理装置と、前記パケットの送信先である第2の情報処理装置と、第1のポートと第2のポートを備えるとともに前記パケットを前記第1のポートと前記第2のポート間で中継する第3の情報処理装置とを制御する制御装置の制御プログラムにおいて、
前記制御装置に、
前記第2の情報処理装置を識別する第2の識別情報を含むアドレスを解決するための第1の要求パケットを受信しないように、前記第2の情報処理装置に設定させ、
前記第1のポートから前記第1の識別情報を含む第1の確認パケットを、前記第3の情報処理装置に送信させ、
前記第1の要求パケットを、前記第1の情報処理装置に送信させ、
前記第1のポートから前記第1の要求パケットに対する第1の応答パケットを、前記第3の情報処理装置に送信させることを特徴とする制御装置の制御プログラム。
2、2−1〜2−6 スイッチ
2a フォワーディングテーブル
3 制御サーバ
3c 制御プログラム
10−1、10−11〜10−18 VMn
11、31 CPU
12、32 FWH
13、33 メモリ
14、34 ハードディスク装置
15、15−1、15−2、35 NIC
100 ARPテーブル
101 ゲストOS
105 転送アプリケーション
111 フィルタリング機能
112 アドレス解決機能
121 イベント受信機能
122 テーブルクリア送信機能
123 転送機能
201 状態検出機能
202 テーブル更新機能
203 パケット中継機能
301 監視機能
302 L2GW配備機能
303 フィルタリング設定通知機能
304 テーブルクリア送信指示通知機能
Claims (5)
- パケットの送信元である第1の情報処理装置と、前記パケットの送信先である第2の情報処理装置と、第1のポートと第2のポートを備えるとともに前記パケットを前記第1のポートと前記第2のポート間で中継する第3の情報処理装置と、前記第1の情報処理装置と前記第2の情報処理装置と前記第3の情報処理装置を制御する制御装置とを有する情報処理システムにおいて、
前記制御装置は、
前記第2の情報処理装置を識別する第2の識別情報を含むアドレスを解決するための第1の要求パケットを受信しないように前記第2の情報処理装置に設定する設定部と、
前記第3の情報処理装置に前記第1のポートから前記第1の識別情報を含む第1の確認パケットを送信させ、前記第1の情報処理装置に前記第1の要求パケットを送信させ、前記第3の情報処理装置に前記第1のポートから前記第1の要求パケットに対する第1の応答パケットを送信させる制御部とを有することを特徴とする情報処理システム。 - 前記設定部はさらに、
前記第1の情報処理装置を識別する第1の識別情報を含むアドレスを解決するための第2の要求パケットを受信しないように前記第1の情報処理装置を設定し、
前記制御部はさらに、
前記第3の情報処理装置に前記第2のポートから前記第2の識別情報を含む第2の確認パケットを送信させ、前記第2の情報処理装置に前記第2の要求パケットを送信させ、前記第3の情報処理装置に前記第2のポートから前記第2の要求パケットに対する第2の応答パケットを送信させることを特徴とする請求項1記載の情報処理システム。 - 前記情報処理システムは、
3台以上の複数の情報処理装置を有し、
前記制御装置はさらに、
前記ネットワークで輻輳が発生した場合、前記複数の情報処理装置のうち、発生した輻輳を回避できる経路上に存在する情報処理装置を、前記第3の情報処理装置として選択する選択部を有することを特徴とする請求項1又は2記載の情報処理システム。 - パケットの送信元である第1の情報処理装置と、前記パケットの送信先である第2の情報処理装置と、第1のポートと第2のポートを備えるとともに前記パケットを前記第1のポートと前記第2のポート間で中継する第3の情報処理装置とを制御する制御装置において、
前記制御装置は、
前記第2の情報処理装置を識別する第2の識別情報を含むアドレスを解決するための第1の要求パケットを受信しないように前記第2の情報処理装置に設定する設定部と、
前記第3の情報処理装置に、前記第1のポートから前記第1の識別情報を含む第1の確認パケットを送信させ、前記第1の情報処理装置に、前記第1の要求パケットを送信させ、前記第3の情報処理装置に、前記第1のポートから前記第1の要求パケットに対する第1の応答パケットを送信させる制御部とを有することを特徴とする制御装置。 - パケットの送信元である第1の情報処理装置と、前記パケットの送信先である第2の情報処理装置と、第1のポートと第2のポートを備えるとともに前記パケットを前記第1のポートと前記第2のポート間で中継する第3の情報処理装置と、前記第1の情報処理装置と前記第2の情報処理装置と前記第3の情報処理装置を制御する制御装置とを有する情報処理システムの制御方法において、
前記制御装置が、
前記第2の情報処理装置を識別する第2の識別情報を含むアドレスを解決するための第1の要求パケットを受信しないように前記第2の情報処理装置に設定し、
前記第3の情報処理装置に、前記第1のポートから前記第1の識別情報を含む第1の確認パケットを送信させ、
前記第1の情報処理装置に、前記第1の要求パケットを送信させ、
前記第3の情報処理装置に、前記第1のポートから前記第1の要求パケットに対する第1の応答パケットを送信させることを特徴とする情報処理システムの制御方法。
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