JP2013539574A - 不正なモード変更の操作 - Google Patents
不正なモード変更の操作 Download PDFInfo
- Publication number
- JP2013539574A JP2013539574A JP2013523663A JP2013523663A JP2013539574A JP 2013539574 A JP2013539574 A JP 2013539574A JP 2013523663 A JP2013523663 A JP 2013523663A JP 2013523663 A JP2013523663 A JP 2013523663A JP 2013539574 A JP2013539574 A JP 2013539574A
- Authority
- JP
- Japan
- Prior art keywords
- instruction
- change
- mode
- program
- unauthorized
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
- 230000008859 change Effects 0.000 title claims abstract description 113
- 238000012545 processing Methods 0.000 claims abstract description 80
- 230000004044 response Effects 0.000 claims abstract description 43
- 238000001514 detection method Methods 0.000 claims abstract description 25
- 238000000034 method Methods 0.000 claims description 19
- 208000011580 syndromic disease Diseases 0.000 claims description 13
- 230000004048 modification Effects 0.000 claims description 4
- 238000012986 modification Methods 0.000 claims description 4
- 238000004590 computer program Methods 0.000 claims 1
- 230000007246 mechanism Effects 0.000 description 5
- 238000010586 diagram Methods 0.000 description 3
- 230000008569 process Effects 0.000 description 3
- 230000006399 behavior Effects 0.000 description 2
- 238000013459 approach Methods 0.000 description 1
- 230000009118 appropriate response Effects 0.000 description 1
- 230000003111 delayed effect Effects 0.000 description 1
- 238000013461 design Methods 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 230000003993 interaction Effects 0.000 description 1
- 230000004043 responsiveness Effects 0.000 description 1
- 230000001960 triggered effect Effects 0.000 description 1
Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F9/00—Arrangements for program control, e.g. control units
- G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
- G06F9/30—Arrangements for executing machine instructions, e.g. instruction decode
- G06F9/30003—Arrangements for executing specific machine instructions
- G06F9/30076—Arrangements for executing specific machine instructions to perform miscellaneous control operations, e.g. NOP
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F9/00—Arrangements for program control, e.g. control units
- G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
- G06F9/30—Arrangements for executing machine instructions, e.g. instruction decode
- G06F9/30098—Register arrangements
- G06F9/30101—Special purpose registers
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F21/00—Security arrangements for protecting computers, components thereof, programs or data against unauthorised activity
- G06F21/50—Monitoring users, programs or devices to maintain the integrity of platforms, e.g. of processors, firmware or operating systems
- G06F21/52—Monitoring users, programs or devices to maintain the integrity of platforms, e.g. of processors, firmware or operating systems during program execution, e.g. stack integrity ; Preventing unwanted data erasure; Buffer overflow
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F21/00—Security arrangements for protecting computers, components thereof, programs or data against unauthorised activity
- G06F21/70—Protecting specific internal or peripheral components, in which the protection of a component leads to protection of the entire computer
- G06F21/71—Protecting specific internal or peripheral components, in which the protection of a component leads to protection of the entire computer to assure secure computing or processing of information
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F9/00—Arrangements for program control, e.g. control units
- G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
- G06F9/30—Arrangements for executing machine instructions, e.g. instruction decode
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F9/00—Arrangements for program control, e.g. control units
- G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
- G06F9/30—Arrangements for executing machine instructions, e.g. instruction decode
- G06F9/30181—Instruction operation extension or modification
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F9/00—Arrangements for program control, e.g. control units
- G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
- G06F9/30—Arrangements for executing machine instructions, e.g. instruction decode
- G06F9/30181—Instruction operation extension or modification
- G06F9/30189—Instruction operation extension or modification according to execution mode, e.g. mode flag
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F9/00—Arrangements for program control, e.g. control units
- G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
- G06F9/30—Arrangements for executing machine instructions, e.g. instruction decode
- G06F9/30181—Instruction operation extension or modification
- G06F9/30196—Instruction operation extension or modification using decoder, e.g. decoder per instruction set, adaptable or programmable decoders
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F9/00—Arrangements for program control, e.g. control units
- G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
- G06F9/30—Arrangements for executing machine instructions, e.g. instruction decode
- G06F9/38—Concurrent instruction execution, e.g. pipeline or look ahead
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F9/00—Arrangements for program control, e.g. control units
- G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
- G06F9/30—Arrangements for executing machine instructions, e.g. instruction decode
- G06F9/38—Concurrent instruction execution, e.g. pipeline or look ahead
- G06F9/3861—Recovery, e.g. branch miss-prediction, exception handling
Landscapes
- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Software Systems (AREA)
- Physics & Mathematics (AREA)
- General Engineering & Computer Science (AREA)
- General Physics & Mathematics (AREA)
- Computer Security & Cryptography (AREA)
- Computer Hardware Design (AREA)
- Mathematical Physics (AREA)
- Executing Machine-Instructions (AREA)
- Storage Device Security (AREA)
Abstract
Description
プログラム命令に応答してデータ処理動作を実施する処理回路であって、複数のモードを有する、処理回路と、
不正なプログラム命令によって指定される前記処理回路の不正なモードの変更を実施するための試行に応答して、
(i)前記不正なモードの変更を抑制し、かつ
(ii)不正変更のビットを、前記不正な変更を実施することを試行する前記不正なプログラム命令を示す既定の値に設定する、
不正変更の検出回路と、を備え、
前記不正変更のビットが前記既定の値を有する間、前記処理回路は、未定義命令としてのさらなるプログラム命令に応答する、装置を提供する。
プログラム命令に応答してデータ処理動作を実施するための処理手段であって、複数のモードを有する、処理手段と、
不正なプログラム命令によって指定される前記処理回路の不正なモードの変更を実施するための試行を検出するため、ならびに、前記試行に応答して、
(i)前記不正なモードの変更を抑制するため、および
(ii)不正変更のビットを、前記不正な変更を実施することを試行する前記不正なプログラム命令を示す既定の値に設定するため
の不正変更の検出手段と、を備え、
前記不正変更のビットが前記既定の値を有する間、前記処理手段は、未定義命令としてのさらなるプログラム命令に応答する、装置を提供する。
処理回路を使用してプログラム命令に応答してデータ処理動作を実施するステップであって、前記処理回路は、複数のモードを有する、ステップと、
不正なプログラム命令によって指定される前記処理回路の不正なモードの変更を実施するための試行の検出に応答して、
(i)前記不正なモードの変更を抑制し、かつ
(ii)不正変更のビットを、前記不正な変更を実施することを試行する前記不正なプログラム命令を示す既定の値に設定するステップと、
前記不正変更のビットが前記既定の値を有する間、未定義命令としてのさらなるプログラム命令に応答するステップと、を含む、方法を提供する。
4 汎用レジスタバンク
6 乗算器
8 シフタ
10 加算器
12 復号器
16 プログラムカウンタレジスタ
18 プログラムステータスレジスタ
20 保存されたプログラムステータスレジスタ
22 検出回路
24 不正変更のビット
26 保存された不正変更のビット
28 シンドロームレジスタ
プログラム命令に応答してデータ処理動作を実施する処理回路であって、複数のモードを有する、処理回路と、
不正なプログラム命令によって指定される前記処理回路の不正なモードの変更を実施するための試行に応答して、
(i)前記不正なモードの変更を抑制し、かつ
(ii)現在のプログラムステータスレジスタ内の不正変更のビットを、前記不正な変更を実施することを試行する前記不正なプログラム命令を示す既定の値に設定する、
不正変更の検出回路と、を備え、
前記不正変更のビットが前記既定の値を有する間、前記処理回路は、未定義命令としてのさらなるプログラム命令に応答する、装置を提供する。
プログラム命令に応答してデータ処理動作を実施するための処理手段であって、複数のモードを有する、処理手段と、
不正なプログラム命令によって指定される前記処理回路の不正なモードの変更を実施するための試行を検出するため、ならびに、前記試行に応答して、
(i)前記不正なモードの変更を抑制するため、および
(ii)現在のプログラムステータスレジスタ内の不正変更のビットを、前記不正な変更を実施することを試行する前記不正なプログラム命令を示す既定の値に設定するため
の不正変更の検出手段と、を備え、
前記不正変更のビットが前記既定の値を有する間、前記処理手段は、未定義命令としてのさらなるプログラム命令に応答する、装置を提供する。
処理回路を使用してプログラム命令に応答してデータ処理動作を実施するステップであって、前記処理回路は、複数のモードを有する、ステップと、
不正なプログラム命令によって指定される前記処理回路の不正なモードの変更を実施するための試行の検出に応答して、
(i)前記不正なモードの変更を抑制し、かつ
(ii)現在のプログラムステータスレジスタ内の不正変更のビットを、前記不正な変更を実施することを試行する前記不正なプログラム命令を示す既定の値に設定するステップと、
前記不正変更のビットが前記既定の値を有する間、未定義命令としてのさらなるプログラム命令に応答するステップと、を含む、方法を提供する。
Claims (24)
- データを処理するための装置であって、
プログラム命令に応答してデータ処理動作を実施する処理回路であって、複数のモードを有する、処理回路と、
不正なプログラム命令によって指定される前記処理回路の不正なモードの変更を実施するための試行に応答して、
(i)前記不正なモードの変更を抑制し、かつ
(ii)不正変更のビットを、前記不正な変更を実施することを試行する前記不正なプログラム命令を示す既定の値に設定する、
不正変更の検出回路と、を備え、
前記不正変更のビットが前記既定の値を有する間、前記処理回路は、未定義命令としてのさらなるプログラム命令に応答する、装置。 - 前記処理回路の現在のモード含む、前記装置の現在の状態を定義するデータ、および前記不正変更のビットを記憶するように構成される、現在のプログラムステータスレジスタを備える、請求項1に記載の装置。
- 前記不正なプログラム命令は、
(i)許容されないモードの変更を特定する、明示的なモードの変更命令、ならびに
(ii)新たなプログラムカウンタ値および許容されない新たなモードを特定する、例外命令からのリターン
のうちの1つである、請求項1または2のいずれか1項に記載の装置。 - 前記例外命令からのリターンは、それぞれのレジスタから前記新たなプログラムカウンタ値および前記新たなモードを取り出す、請求項3に記載の装置。
- 前記例外命令からのリターンは、メモリから前記新たなプログラムカウンタ値および前記新たなモードを取り出す、請求項3に記載の装置。
- 前記不正なモードの変更は、
(i)より高い権限のレベルを有するモードへの変更、および
(ii)前記モードが何であるかを示す、前記装置によって記憶される他の状態データと矛盾するモードへの変更のうちの1つである、請求項1〜5のいずれか1項に記載の装置。 - 前記処理回路は、例外イベントに応答して、前記例外イベントに関連付けられる例外操作プログラム命令が実行されるように、前記不正変更のビットの現在の値を保存されたビットとして保存し、かつ前記不正変更のビットを前記既定の値とは異なる値に設定するように構成される、請求項1〜6のいずれか1項に記載の装置。
- 前記処理回路は、前記例外操作プログラム命令の実行からのリターン後、前記不正変更のビットが前記保存されたビットと一致するように設定されるように構成される、請求項7に記載の装置。
- 前記不正なモードの変更を試行した前記不正なプログラム命令のタイプを示す、シンドローム値を記憶するように構成される、シンドロームレジスタを備える、請求項1〜8のいずれか1項に記載の装置。
- 前記処理回路は、未定義命令例外イベントをトリガすることによって、未定義命令を実行するための試行に応答する、請求項1〜9のいずれか1項に記載の装置。
- 前記複数のモードは、
(i)前記装置のリソースへの異なるアクセスのレベルを有する、複数の異なる権限のレベル、ならびに
(ii)各々が、異なる命令セットからのプログラム命令の復号および実行に対応する、複数の異なる命令セットモード
のうちの1つ以上を含む、請求項1〜10のいずれか1項に記載の装置。 - データを処理するための装置であって、
プログラム命令に応答してデータ処理動作を実施するための処理手段であって、複数のモードを有する、処理手段と、
不正なプログラム命令によって指定される処理回路の不正なモードの変更を実施するための試行を検出するため、ならびに、前記試行に応答して、
(i)前記不正なモードの変更を抑制するため、および
(ii)不正変更のビットを、前記不正な変更を実施することを試行する前記不正なプログラム命令を示す既定の値に設定するため
の不正な変更の検出手段と、を備え、
前記不正変更のビットが前記既定の値を有する間、前記処理手段は、未定義命令としてのさらなるプログラム命令に応答する、装置。 - データを処理するための方法であって、
処理回路を使用してプログラム命令に応答してデータ処理動作を実施するステップであって、前記処理回路は、複数のモードを有する、ステップと、
不正なプログラム命令によって指定される前記処理回路の不正なモードの変更を実施するための試行の検出に応答して、
(i)前記不正なモードの変更を抑制し、かつ
(ii)不正変更のビットを、前記不正な変更を実施することを試行する前記不正なプログラム命令を示す既定の値に設定するステップと、
前記不正変更のビットが前記既定の値を有する間、未定義命令としてのさらなるプログラム命令に応答するステップと、を含む、方法。 - 現在のプログラムステータスレジスタに、前記処理回路の現在のモードを含むデータ、および前記不正変更のビットを記憶するステップを含む、請求項13に記載の方法。
- 前記不正なプログラム命令は、
(i)許容されないモードの変更を特定する、明示的なモードの変更命令、ならびに
(ii)新たなプログラムカウンタ値および許容されない新たなモードを特定する、例外命令からのリターン
のうちの1つである、請求項13または14のいずれか1項に記載の方法。 - 前記例外命令からのリターンは、それぞれのレジスタから前記新たなプログラムカウンタ値および前記新たなモードを取り出す、請求項15に記載の方法。
- 前記例外命令からのリターンは、メモリから前記新たなプログラムカウンタ値および前記新たなモードを取り出す、請求項15に記載の方法。
- 前記不正なモードの変更は、
(i)より高い権限のレベルを有するモードへの変更、および
(ii)前記モードが何であるかを示す、他の記憶された状態データと矛盾するモードへの変更のうちの1つである、請求項13から17のいずれか1項に記載の方法。 - 例外イベントに応答して、前記例外イベントに関連付けられる例外操作プログラム命令が実行されるように、前記不正変更のビットの現在の値を保存されたビットとして保存することと、前記不正変更のビットを前記既定の値とは異なる値に設定することと、を含む、請求項13から18のいずれか1項に記載の方法。
- 前記例外操作プログラム命令の実行からのリターン後、前記不正変更のビットは、前記保存されたビットと一致するように設定される、請求項19に記載の方法。
- シンドロームレジスタ内に、前記不正なモードの変更を試行した前記不正なプログラム命令のタイプを示す、シンドローム値を記憶することを含む、請求項13から20のいずれか1項に記載の方法。
- 未定義命令を実行するための試行に応答して、未定義命令例外イベントをトリガすることを含む、請求項13から21のいずれか1項に記載の方法。
- 前記複数のモードは、
(i)リソースへの異なるアクセスのレベルを有する、複数の異なる権限のレベル、ならびに
(ii)各々が、異なる命令セットからのプログラム命令の復号および実行に対応する、複数の異なる命令セットモード
のうちの1つ以上を含む、請求項13から22のいずれか1項に記載の方法。 - 請求項13から23のいずれか1項に記載の方法を実施するように、コンピュータを制御する、コンピュータプログラムを備える、仮想機械。
Applications Claiming Priority (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
GB1013467.4A GB2482701C (en) | 2010-08-11 | 2010-08-11 | Illegal mode change handling |
GB1013467.4 | 2010-08-11 | ||
PCT/GB2011/051095 WO2012020238A1 (en) | 2010-08-11 | 2011-06-13 | Illegal mode change handling |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2013539574A true JP2013539574A (ja) | 2013-10-24 |
JP5699213B2 JP5699213B2 (ja) | 2015-04-08 |
Family
ID=42931474
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2013523663A Active JP5699213B2 (ja) | 2010-08-11 | 2011-06-13 | 不正なモード変更の操作 |
Country Status (10)
Country | Link |
---|---|
US (1) | US8959318B2 (ja) |
EP (1) | EP2572274B1 (ja) |
JP (1) | JP5699213B2 (ja) |
KR (1) | KR101740224B1 (ja) |
CN (1) | CN103052941B (ja) |
GB (1) | GB2482701C (ja) |
IL (1) | IL223265A0 (ja) |
MY (1) | MY160351A (ja) |
TW (1) | TWI509453B (ja) |
WO (1) | WO2012020238A1 (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2020523680A (ja) * | 2017-06-15 | 2020-08-06 | エイアールエム リミテッド | 命令セット内の変更を制御する装置及び方法 |
Families Citing this family (19)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
GB201217531D0 (en) * | 2012-10-01 | 2012-11-14 | Advanced Risc Mach Ltd | ARMv7-M Asset Protection Proposal |
US10210349B2 (en) | 2012-02-08 | 2019-02-19 | Arm Limited | Data processing apparatus and method using secure domain and less secure domain |
GB2499287A (en) * | 2012-02-08 | 2013-08-14 | Advanced Risc Mach Ltd | Exception handling in data processing with different security domains |
US9213828B2 (en) | 2012-02-08 | 2015-12-15 | Arm Limited | Data processing apparatus and method for protecting secure data and program code from non-secure access when switching between secure and less secure domains |
US9477834B2 (en) | 2012-02-08 | 2016-10-25 | Arm Limited | Maintaining secure data isolated from non-secure access when switching between domains |
US9116711B2 (en) | 2012-02-08 | 2015-08-25 | Arm Limited | Exception handling in a data processing apparatus having a secure domain and a less secure domain |
JP5591883B2 (ja) * | 2012-07-23 | 2014-09-17 | 株式会社東芝 | 情報処理装置、プログラム |
GB2517494B (en) * | 2013-08-23 | 2021-02-24 | Advanced Risc Mach Ltd | Handling time intensive instructions |
GB2530050B (en) * | 2014-09-10 | 2021-07-21 | Advanced Risc Mach Ltd | Debugging in a data processing apparatus |
GB2538091B (en) * | 2015-05-07 | 2018-03-14 | Advanced Risc Mach Ltd | Verifying correct code execution context |
US20170185400A1 (en) * | 2015-12-23 | 2017-06-29 | Intel Corporation | Mode-specific endbranch for control flow termination |
US9785800B2 (en) | 2015-12-23 | 2017-10-10 | Intel Corporation | Non-tracked control transfers within control transfer enforcement |
GB2549774B (en) * | 2016-04-28 | 2019-04-10 | Imagination Tech Ltd | Method for handling exceptions in exception-driven system |
US10360353B2 (en) * | 2017-02-08 | 2019-07-23 | International Business Machines Corporation | Execution control of computer software instructions |
GB2563884B (en) * | 2017-06-28 | 2020-01-08 | Advanced Risc Mach Ltd | Exception return instruction |
GB2563887B (en) * | 2017-06-28 | 2019-12-25 | Advanced Risc Mach Ltd | Masking of architectural state associated with a realm |
US10956157B1 (en) * | 2018-03-06 | 2021-03-23 | Advanced Micro Devices, Inc. | Taint protection during speculative execution |
CN110853751B (zh) * | 2019-11-25 | 2023-04-14 | 安徽名流健康管理有限公司 | 多普勒超声诊断实时显示系统 |
US11556346B2 (en) * | 2020-06-10 | 2023-01-17 | Qualcomm Incorporated | Security enhancement in hierarchical protection domains |
Citations (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH05189231A (ja) * | 1992-01-14 | 1993-07-30 | Pfu Ltd | 命令フェッチにおけるエラー処理方式 |
EP0649091A1 (en) * | 1993-10-13 | 1995-04-19 | International Business Machines Corporation | Correction and modification of microprocessor chip operations |
JP2004280801A (ja) * | 2003-02-24 | 2004-10-07 | Matsushita Electric Ind Co Ltd | プロセッサおよびこのプロセッサ用のプログラムを生成するコンパイラ装置 |
US20070150730A1 (en) * | 2005-12-23 | 2007-06-28 | Texas Instruments Incorporated | Method and system for preventing unauthorized processor mode switches |
JP2008090542A (ja) * | 2006-09-29 | 2008-04-17 | Fujitsu Ltd | エラー処理方法及び情報処理装置 |
US20080244137A1 (en) * | 2007-03-30 | 2008-10-02 | Uwe Kranich | Processor comprising a first and a second mode of operation and method of operating the same |
JP2008257735A (ja) * | 2007-04-03 | 2008-10-23 | Arm Ltd | 保護された関数呼び出し |
JP2010500661A (ja) * | 2006-08-09 | 2010-01-07 | クゥアルコム・インコーポレイテッド | プロセッサ命令セット動作モードを比較するデバッグ回路 |
Family Cites Families (17)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100315347B1 (ko) * | 1999-11-18 | 2001-11-26 | 윤종용 | 반도체 메모리 장치의 동작모드 세팅회로 및 방법 |
US6886112B2 (en) * | 2002-06-28 | 2005-04-26 | Microsoft Corporation | Recovering from device failure |
JP2004062309A (ja) * | 2002-07-25 | 2004-02-26 | Fujitsu Ltd | 不当命令処理方法及びプロセッサ |
WO2004046925A1 (en) * | 2002-11-18 | 2004-06-03 | Arm Limited | Security mode switching via an exception vector |
US20040168047A1 (en) * | 2003-02-24 | 2004-08-26 | Matsushita Electric Industrial Co., Ltd. | Processor and compiler for creating program for the processor |
US7281271B1 (en) * | 2003-09-25 | 2007-10-09 | Symantec Corporation | Exception handling validation system and method |
US7076637B2 (en) * | 2003-10-29 | 2006-07-11 | Qualcomm Inc. | System for providing transitions between operating modes of a device |
KR100586500B1 (ko) * | 2004-03-18 | 2006-06-07 | 학교법인고려중앙학원 | 버퍼 오버플로우 공격들을 감지하고 복구하는 방법 및 그장치 |
US7647589B1 (en) * | 2005-02-07 | 2010-01-12 | Parallels Software International, Inc. | Methods and systems for safe execution of guest code in virtual machine context |
US20070050848A1 (en) * | 2005-08-31 | 2007-03-01 | Microsoft Corporation | Preventing malware from accessing operating system services |
US20070067826A1 (en) * | 2005-09-19 | 2007-03-22 | Texas Instruments Incorporated | Method and system for preventing unsecure memory accesses |
US20100132053A1 (en) * | 2005-10-04 | 2010-05-27 | Nec Corporation | Information processing device, information processing method and program |
US7971018B2 (en) * | 2006-05-01 | 2011-06-28 | Mediatek Inc. | Method and apparatus for secure context switching in a system including a processor and cached virtual memory |
US7689817B2 (en) * | 2006-11-16 | 2010-03-30 | Intel Corporation | Methods and apparatus for defeating malware |
JP2008250387A (ja) * | 2007-03-29 | 2008-10-16 | Toshiba Corp | 情報処理装置 |
US20090070565A1 (en) * | 2007-09-11 | 2009-03-12 | Tellabs Reston Inc. | Methods, systems, computer programs and apparatus for changing a processor state |
US8150950B2 (en) * | 2008-05-13 | 2012-04-03 | Schneider Electric USA, Inc. | Automated discovery of devices in large utility monitoring systems |
-
2010
- 2010-08-11 GB GB1013467.4A patent/GB2482701C/en active Active
-
2011
- 2011-06-13 KR KR1020137003612A patent/KR101740224B1/ko active IP Right Grant
- 2011-06-13 CN CN201180038092.7A patent/CN103052941B/zh active Active
- 2011-06-13 WO PCT/GB2011/051095 patent/WO2012020238A1/en active Application Filing
- 2011-06-13 EP EP11733693.3A patent/EP2572274B1/en active Active
- 2011-06-13 JP JP2013523663A patent/JP5699213B2/ja active Active
- 2011-06-13 MY MYPI2012701039A patent/MY160351A/en unknown
- 2011-06-28 US US13/067,808 patent/US8959318B2/en active Active
- 2011-08-08 TW TW100128204A patent/TWI509453B/zh active
-
2012
- 2012-11-26 IL IL223265A patent/IL223265A0/en active IP Right Grant
Patent Citations (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH05189231A (ja) * | 1992-01-14 | 1993-07-30 | Pfu Ltd | 命令フェッチにおけるエラー処理方式 |
EP0649091A1 (en) * | 1993-10-13 | 1995-04-19 | International Business Machines Corporation | Correction and modification of microprocessor chip operations |
JP2004280801A (ja) * | 2003-02-24 | 2004-10-07 | Matsushita Electric Ind Co Ltd | プロセッサおよびこのプロセッサ用のプログラムを生成するコンパイラ装置 |
US20070150730A1 (en) * | 2005-12-23 | 2007-06-28 | Texas Instruments Incorporated | Method and system for preventing unauthorized processor mode switches |
JP2010500661A (ja) * | 2006-08-09 | 2010-01-07 | クゥアルコム・インコーポレイテッド | プロセッサ命令セット動作モードを比較するデバッグ回路 |
JP2008090542A (ja) * | 2006-09-29 | 2008-04-17 | Fujitsu Ltd | エラー処理方法及び情報処理装置 |
US20080244137A1 (en) * | 2007-03-30 | 2008-10-02 | Uwe Kranich | Processor comprising a first and a second mode of operation and method of operating the same |
JP2008257735A (ja) * | 2007-04-03 | 2008-10-23 | Arm Ltd | 保護された関数呼び出し |
Non-Patent Citations (3)
Title |
---|
CSNG200900464012; 鈴木章浩,追川修一: 'ARMアーキテクチャ用仮想マシンモニタの開発' 情報処理学会研究報告 Vol:2009-ARC-183,No:12, 20090615, Pages:1〜8, 社団法人情報処理学会 * |
JPN6014045327; 鈴木章浩,追川修一: 'ARMアーキテクチャ用仮想マシンモニタの開発' 情報処理学会研究報告 Vol:2009-ARC-183,No:12, 20090615, Pages:1〜8, 社団法人情報処理学会 * |
JPN6014045329; 'ARMアーキテクチャリファレンスマニュアル ARM DDI 0100HJ-00' [online] , 200503, Pages:A2-11〜A2-15, ftp.at.netbsd.org * |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2020523680A (ja) * | 2017-06-15 | 2020-08-06 | エイアールエム リミテッド | 命令セット内の変更を制御する装置及び方法 |
Also Published As
Publication number | Publication date |
---|---|
JP5699213B2 (ja) | 2015-04-08 |
GB2482701A (en) | 2012-02-15 |
IL223265A0 (en) | 2013-02-03 |
CN103052941B (zh) | 2016-03-09 |
GB2482701C (en) | 2018-12-26 |
US20120042154A1 (en) | 2012-02-16 |
EP2572274A1 (en) | 2013-03-27 |
GB2482701B (en) | 2017-01-11 |
MY160351A (en) | 2017-02-28 |
KR101740224B1 (ko) | 2017-05-26 |
GB201013467D0 (en) | 2010-09-22 |
US8959318B2 (en) | 2015-02-17 |
TWI509453B (zh) | 2015-11-21 |
EP2572274B1 (en) | 2014-11-19 |
TW201229809A (en) | 2012-07-16 |
WO2012020238A1 (en) | 2012-02-16 |
CN103052941A (zh) | 2013-04-17 |
KR20130137591A (ko) | 2013-12-17 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
JP5699213B2 (ja) | 不正なモード変更の操作 | |
US10140448B2 (en) | Systems and methods of asynchronous analysis of event notifications for computer security applications | |
JP7432586B2 (ja) | スタック・ポインタを検証すること | |
JP2014518582A (ja) | Dllインジェクション機能を持つコンピュータ装置及びdllインジェクション方法 | |
US20170220795A1 (en) | Information-processing device, information-processing monitoring method, and recording medium | |
US10372908B2 (en) | System and method for detecting malware in a stream of bytes | |
US20220366037A1 (en) | Domain transition disable configuration parameter | |
US9864708B2 (en) | Safely discovering secure monitors and hypervisor implementations in systems operable at multiple hierarchical privilege levels | |
JP2005316599A (ja) | 割込制御装置 | |
CN109388948B (zh) | 一种基于虚拟化技术的潜在恶意软件分析方法及相关装置 | |
EP4073635B1 (en) | Intermodal calling branch instruction | |
CN110799940B (zh) | 内容数据管理 | |
US11726811B2 (en) | Parallel context switching for interrupt handling | |
TW202418067A (zh) | 堆疊指標切換有效性檢查 | |
GB2623800A (en) | Stack pointer switch validity checking |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20130805 |
|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20141015 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20141027 |
|
A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20141219 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20150119 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20150216 |
|
R150 | Certificate of patent or registration of utility model |
Ref document number: 5699213 Country of ref document: JP Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |