JP2013247320A - Method for preparing thin film device and method for preparing common mode filter using the same - Google Patents
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Abstract
Description
本発明は、薄膜デバイスを調製する方法およびそれを使用したコモンモードフィルタを調製する方法に関し、より詳しくは、乾燥ポリイミド膜から絶縁層を調製する方法およびそれを使用したコモンモードフィルタを調製する方法に関する。 The present invention relates to a method for preparing a thin film device and a method for preparing a common mode filter using the same, and more particularly, a method for preparing an insulating layer from a dry polyimide film and a method for preparing a common mode filter using the same. About.
薄膜デバイスにおいて、異なる層の導電パターンを電気的に分離するために、ポリイミド膜などの絶縁層が広く使用されている。従来技術において、ポリイミド膜は、一般にスピンコート技法により形成され、一般に、ポリイミド膜の厚さを均一にすることが望ましい。 In thin film devices, an insulating layer such as a polyimide film is widely used to electrically separate conductive patterns of different layers. In the prior art, the polyimide film is generally formed by a spin coating technique, and it is generally desirable to make the thickness of the polyimide film uniform.
図1および2は、従来技術による薄膜デバイス10を調製する方法を示している。図1を参照し、堆積、リソグラフィー、電気メッキおよびエッチングの各プロセスを行って、基板11上に第1の導電パターン13を形成し、次いで、スピンコートプロセスおよび熱処理プロセスによって、第1の導電パターン13上に第1の絶縁層15を形成する。
1 and 2 illustrate a method of preparing a
図2を参照し、堆積、リソグラフィー、電気メッキおよびエッチングの各プロセスを行って、第1の絶縁層15上に第2の導電パターン17を形成し、次いで、スピンコートプロセスおよび熱処理プロセスによって、第2の導電パターン17上に第2の絶縁層19を形成する。
Referring to FIG. 2, deposition, lithography, electroplating, and etching processes are performed to form second
スピンコートプロセスにより形成された第1の絶縁層15は、第1の導電パターン13を第2の導電パターン17から電気的に分離させることができる。しかしながら、スピンコートプロセスにより形成された第1の絶縁層15の表面は、平らではない。このため、第2の導電パターン17を調製するリソグラフィープロセスの位置合せが妨げられる、すなわち、その後に形成される第2の導電パターン17の位置に影響するであろう。その上、第1の導電パターン13と第2の導電パターン17の間の第1の絶縁層15の厚さは均一ではなく、これにより、薄膜デバイス10の電気的性質が影響を受けてしまう。
The first
本発明のある態様は、乾燥ポリイミド膜から形成された絶縁層を備えた薄膜デバイスを調製する方法およびそれを使用したコモンモードフィルタを調製する方法を提供する。 Certain aspects of the present invention provide a method for preparing a thin film device with an insulating layer formed from a dry polyimide film and a method for preparing a common mode filter using the same.
本発明のこの態様による薄膜デバイスを調製する方法は、基板上に第1の導電パターンを形成する工程、第1の導電パターン上に乾燥ポリイミド膜を配置する工程、乾燥ポリイミド膜が第1の導電パターン中の空間を満たすように乾燥ポリイミド膜に力を印加する工程、および乾燥ポリイミド膜上に第2の導電パターンを形成する工程を有してなる。 A method of preparing a thin film device according to this aspect of the invention includes a step of forming a first conductive pattern on a substrate, a step of placing a dry polyimide film on the first conductive pattern, and the dry polyimide film being a first conductive pattern. The method includes a step of applying a force to the dry polyimide film so as to fill a space in the pattern, and a step of forming a second conductive pattern on the dry polyimide film.
本発明の別の態様によるコモンモードフィルタを調製する方法は、基板上に第1の導電パターンを形成する工程、第1の導電パターン上に乾燥ポリイミド膜を配置する工程、乾燥ポリイミド膜が第1の導電パターン中の空間を満たすように乾燥ポリイミド膜に力を印加する工程、および乾燥ポリイミド膜上に第2の導電パターンを形成する工程を有してなる。この「コモンモードフィルタ」は、前記「薄膜デバイス」の特定の用途の内の1つであることに留意されたい。 A method for preparing a common mode filter according to another aspect of the present invention includes: a step of forming a first conductive pattern on a substrate; a step of disposing a dry polyimide film on the first conductive pattern; A step of applying a force to the dry polyimide film so as to fill a space in the conductive pattern, and a step of forming a second conductive pattern on the dry polyimide film. Note that this “common mode filter” is one of the specific applications of the “thin film device”.
以下の本発明の詳細な説明がよりよく理解されるように、先の説明は、本発明の特徴をかなり広く概説してきた。本発明の追加の特徴は、下文に記載され、本発明の特許請求の範囲の主題を形成する。開示された概念および特別の実施の形態は、本発明の同じ目的を実施するための他の構造またはプロセスを改変または設計するための基礎として容易に利用されるであろうことが当業者には認識されよう。そのような同等の構造が、添付の特許請求の範囲に述べられた本発明の精神および範囲から逸脱しないことが当業者には理解されよう。 The foregoing has outlined rather broadly the features of the present invention in order that the detailed description of the invention that follows may be better understood. Additional features of the invention will be described hereinafter which form the subject of the claims of the invention. It will be apparent to those skilled in the art that the disclosed concepts and specific embodiments may be readily utilized as a basis for modifying or designing other structures or processes for carrying out the same purposes of the present invention. Be recognized. Those skilled in the art will recognize that such equivalent constructions do not depart from the spirit and scope of the invention as set forth in the appended claims.
本発明の目的が、以下の説明を読み、添付の図面を参照した際に明白になるであろう。
図3から8は、本発明のある実施の形態による薄膜デバイス30を調製する方法を示す。図3を参照すると、堆積、リソグラフィー、電気メッキおよびエッチングの各プロセスを行って、基板31上に空間35と共に第1の導電パターン33A〜33Cを形成する。その後、図4に示されるように、第1の導電パターン33A〜33C上に乾燥ポリイミド膜37を配置する。
3-8 illustrate a method of preparing a
図5を参照して、第1の導電パターン33A〜33C中の空間35を乾燥ポリイミド膜37が満たすように乾燥ポリイミド膜37に力25を印加する。その後、第1の導電パターン33A〜33Cを電気的に絶縁するための絶縁層として働く乾燥ポリイミド膜37に硬化プロセスを行う。
Referring to FIG. 5,
本発明のある実施の形態において、ゴムまたはダイヤフラムなどのエラストマー23を通じた液圧プレスにより、またはローラにより、乾燥ポリイミド膜37に力25を印加する。本発明のある実施の形態において、力25は、実質的に真空環境中で乾燥ポリイミド膜37に印加される。本発明のある実施の形態において、力25は、実質的に50℃と110℃の間の温度で乾燥ポリイミド膜37に印加される。この温度は、乾燥ポリイミド膜37のガラス転移温度以上である。本発明のある実施の形態において、硬化プロセスは、160℃と370℃の間の温度で行われる熱処理プロセスである。
In one embodiment of the invention,
図6を参照して、乾燥ポリイミド膜37にパターン形成プロセスを行って、孔39を形成し、第1の導電パターン33Bの一部分を露出させる。本発明のある実施の形態において、パターン形成プロセスはリソグラフィープロセスを含む。
Referring to FIG. 6, the
図7を参照して、堆積、リソグラフィー、電気メッキおよびエッチングの各プロセスを含む製造プロセスを乾燥ポリイミド膜37に行って、この乾燥ポリイミド膜37上に空間45と共に第2の導電パターン43A〜43Cを形成する。それに加え、この製造プロセスは、図7に示されるように、第2の導電パターン43Bを第1の導電パターン33Bに接続するビア41も形成する。その後、図4および図5に示された製造プロセスを行って、図8に示されるように、薄膜デバイス30の第2の導電パターン43A〜43Cを電気的に絶縁するための絶縁層として働く乾燥ポリイミド膜47を形成する。
Referring to FIG. 7, a manufacturing process including deposition, lithography, electroplating, and etching processes is performed on
図9から18は、本発明の1つの実施の形態によるコモンモードフィルタ100を調製する方法を示す。
9-18 illustrate a method of preparing a
図9を参照すると、スピンコートプロセスによって、磁性基板111上に、ポリイミド膜などの第1の絶縁層121が形成される。
Referring to FIG. 9, a first
図10を参照すると、薄膜金属堆積プロセス、フォトリソグラフィープロセス、電気メッキプロセスおよびエッチングプロセスによって、第1の絶縁層121上に下側コイル主導層113が形成される。本発明のある実施の形態において、薄膜金属堆積プロセスはスパッタリングプロセスである。
Referring to FIG. 10, a lower coil
図11を参照すると、図4および図5に記載された製造プロセスによって、すなわち、下側コイル主導層113上に乾燥ポリイミド膜を配置し、この乾燥ポリイミド膜が下側コイル主導層113を被覆するように乾燥ポリイミド膜に力を印加することによって、下側コイル主導層113上に乾燥ポリイミド膜から第2の絶縁層122を形成する。その後、図6に記載された製造プロセスによって、第2の絶縁層122にパターン形成プロセスを行って、孔1221を形成する。この孔1221は、下側コイル主導層113の一部分を露出する。
Referring to FIG. 11, a dry polyimide film is disposed on the lower coil
図12を参照すると、薄膜金属堆積プロセス、フォトリソグラフィープロセス、電気メッキプロセスおよびエッチングプロセスによって、第2の絶縁層122上に第1のコイル本体層114が形成される。本発明のある実施の形態において、薄膜金属堆積プロセスはスパッタリングプロセスである。本発明のある実施の形態において、第1のコイル本体層114は、空間1141と共に導電パターンを含む。
Referring to FIG. 12, a first
図13を参照すると、図4および図5に記載された製造プロセスによって、すなわち、第1のコイル本体層114上に乾燥ポリイミド膜を配置し、この乾燥ポリイミド膜が第1のコイル本体層114の導電パターン内の空間1141を満たすように乾燥ポリイミド膜に力を印加することによって、第1のコイル本体層114上に乾燥ポリイミド膜から第3の絶縁層123を形成する。
Referring to FIG. 13, a dry polyimide film is disposed on the first
図14を参照すると、薄膜金属堆積プロセス、フォトリソグラフィープロセス、電気メッキプロセスおよびエッチングプロセスによって、第3の絶縁層123上に第2のコイル本体層115が形成される。本発明のある実施の形態において、薄膜金属堆積プロセスはスパッタリングプロセスである。本発明のある実施の形態において、第2のコイル本体層115は、空間1151と共に導電パターンを含む。
Referring to FIG. 14, a second
図15を参照すると、図4および図5に記載された製造プロセスによって、すなわち、第2のコイル本体層115上に乾燥ポリイミド膜を配置し、この乾燥ポリイミド膜が第2のコイル本体層115の導電パターン内の空間1151を満たすように乾燥ポリイミド膜に力を印加することによって、第2のコイル本体層115上に乾燥ポリイミド膜から第4の絶縁層124を形成する。その後、図6に記載された製造プロセスによって、第4の絶縁層124にパターン形成プロセスを行って、孔1241を形成する。この孔1241は、第2のコイル本体層115の一部分を露出する。
Referring to FIG. 15, a dry polyimide film is disposed on the second
図16を参照すると、薄膜金属堆積プロセス、フォトリソグラフィープロセス、電気メッキプロセスおよびエッチングプロセスによって、上側コイル主導層116が形成される。本発明のある実施の形態において、薄膜金属堆積プロセスはスパッタリングプロセスである。
Referring to FIG. 16, the upper coil
図17を参照すると、図4および図5に記載された製造プロセスによって、すなわち、上側コイル主導層116上に乾燥ポリイミド膜を配置し、この乾燥ポリイミド膜が上側コイル主導層116を被覆するように乾燥ポリイミド膜に力を印加することによって、上側コイル主導層116上に乾燥ポリイミド膜から第5の絶縁層125を形成する。
Referring to FIG. 17, the dry polyimide film is disposed on the upper coil
図18を参照すると、スクリーン印刷プロセスによって、第5の絶縁層125上に磁性材料層117を形成して、コモンモードフィルタ100を完成する。
Referring to FIG. 18, a
図19から27は、本発明の1つの実施の形態によるコモンモードフィルタ200を調製する方法を示す。
19-27 illustrate a method for preparing a
図19を参照すると、非磁性誘電体基板211上に磁性材料層212を形成する。本発明のある実施の形態において、非磁性誘電体基板211は、Al2O3、AlN、ガラス、または石英を含んでよい。本発明のある実施の形態において、磁性材料層212は、高い透磁性を有し、NiZnフェライト材料またはMnZnフェライト材料などのフェライトを含んでもよい。
Referring to FIG. 19, a
図20を参照すると、スピンコートプロセスによって、磁性材料層212上に、ポリイミド膜などの第1の絶縁層221が形成される。
Referring to FIG. 20, a first insulating
図21を参照すると、薄膜金属堆積プロセス、フォトリソグラフィープロセス、電気メッキプロセスおよびエッチングプロセスによって、第1の絶縁層221上に第1のコイル本体層213が形成される。本発明のある実施の形態において、薄膜金属堆積プロセスはスパッタリングプロセスである。本発明のある実施の形態において、第1のコイル本体層213は、空間2131と共に導電パターンを含む。
Referring to FIG. 21, a first
図22を参照すると、図4および図5に記載された製造プロセスによって、すなわち、第1のコイル本体層213上に乾燥ポリイミド膜を配置し、この乾燥ポリイミド膜が第1のコイル本体層213の導電パターン内の空間2131を満たすように乾燥ポリイミド膜に力を印加することによって、第1のコイル本体層213上に乾燥ポリイミド膜から第2の絶縁層222を形成する。その後、図6に記載された製造プロセスによって、第2の絶縁層222にパターン形成プロセスを行って、孔2221を形成する。この孔2221は、第1のコイル本体層213の一部分を露出する。
Referring to FIG. 22, a dry polyimide film is disposed on the first
図23を参照すると、薄膜金属堆積プロセス、フォトリソグラフィープロセス、電気メッキプロセスおよびエッチングプロセスによって、第2の絶縁層222上にコイル主導層214が形成される。本発明のある実施の形態において、薄膜金属堆積プロセスはスパッタリングプロセスであり、孔2221内のコイル主導層214は第1のコイル本体層213と接触している。
Referring to FIG. 23, a coil
図24を参照すると、図4および図5に記載された製造プロセスによって、すなわち、コイル主導層214上に乾燥ポリイミド膜を配置し、この乾燥ポリイミド膜に力を印加することによって、コイル主導層214上に乾燥ポリイミド膜から第3の絶縁層223を形成し、それによって、コイル主導層214を絶縁する。
Referring to FIG. 24, the
図25を参照すると、薄膜金属堆積プロセス、フォトリソグラフィープロセス、電気メッキプロセスおよびエッチングプロセスによって、第3の絶縁層223上に第2のコイル本体層215が形成される。本発明のある実施の形態において、薄膜金属堆積プロセスはスパッタリングプロセスであり、第2のコイル本体層215は、第3の絶縁層223中のコイル主導層214と接触している。本発明のある実施の形態において、第2のコイル本体層215は、空間2151と共に導電パターンを含む。
Referring to FIG. 25, a second
図26を参照すると、図4および図5に記載された製造プロセスによって、すなわち、第2のコイル本体層215上に乾燥ポリイミド膜を配置し、この乾燥ポリイミド膜が第2のコイル本体層215の導電パターン内の空間2151を満たすように乾燥ポリイミド膜に力を印加することによって、第2のコイル本体層215上に乾燥ポリイミド膜から第4の絶縁層224を形成する。
Referring to FIG. 26, a dry polyimide film is disposed on the second
図27を参照すると、スクリーン印刷プロセスによって、第4の絶縁層224上に磁性材料層217を形成して、コモンモードフィルタ200を完成する。
Referring to FIG. 27, the
本発明とその目的を詳しく記載してきたが、添付の特許請求の範囲により定義された本発明の精神および範囲から逸脱せずに、様々な変更、置換および改変を行えることが理解されよう。例えば、先に議論されたプロセスの多くは、異なる方法論で実施し、他のプロセスまたはその組合せによって置き換えられる。 Although the invention and its objects have been described in detail, it will be understood that various changes, substitutions and modifications can be made without departing from the spirit and scope of the invention as defined by the appended claims. For example, many of the processes discussed above are implemented with different methodologies and replaced by other processes or combinations thereof.
さらに、本出願の範囲は、本明細書に記載されたプロセス、装置、製造、物質の組成、手段、方法および工程の特定の実施の形態に制限されることは意図されていない。本発明の開示から当業者には容易に認識されるように、ここに記載された対応する実施の形態と実質的に同じ機能を果たすまたは実質的に同じ結果を達成する、既存の、または後に開発される、プロセス、装置、製造、物質の組成、手段、方法、または工程を、本発明にしたがって使用してよい。したがって、添付の特許請求の範囲は、そのようなプロセス、装置、製造、物質の組成、手段、方法、または工程をその範囲内に含むことが意図されている。 Furthermore, the scope of this application is not intended to be limited to the specific embodiments of the processes, apparatus, manufacture, composition of matter, means, methods and steps described herein. As will be readily appreciated by those skilled in the art from the disclosure of the present invention, existing or later that performs substantially the same function or achieves substantially the same results as the corresponding embodiments described herein. Any process, apparatus, manufacture, composition of matter, means, method or process that may be developed may be used in accordance with the present invention. Accordingly, the appended claims are intended to include within their scope such processes, machines, manufacture, compositions of matter, means, methods, or steps.
10,30 薄膜デバイス
11,31 基板
13,33A〜33C 第1の導電パターン
15 第1の絶縁層
17,43A〜43C 第2の導電パターン
19 第2の絶縁層
25 力
35,1141,1151,2131,2151 空間
37,47 乾燥ポリイミド膜
100,200 コモンモードフィルタ
111 磁性基板
113 下側コイル主導層
114,213 第1のコイル本体層
115,215 第2のコイル本体層
116 上側コイル主導層
121,221 第1の絶縁層
122,222 第2の絶縁層
123,223 第3の絶縁層
124,224 第4の絶縁層
125 第5の絶縁層
211 非磁性誘電体基板
212,217 磁性材料層
214 コイル主導層
DESCRIPTION OF
Claims (20)
基板上に少なくとも1つの第1の導電パターンを形成する工程、
前記第1の導電パターン上に乾燥ポリイミド膜を配置する工程、
前記乾燥ポリイミド膜が前記第1の導電パターン中の空間を満たすように該乾燥ポリイミド膜に力を印加する工程、および
前記乾燥ポリイミド膜上に少なくとも1つの第2の導電パターンを形成する工程、
を有してなる薄膜デバイスを調製する方法。 A method for preparing a thin film device comprising:
Forming at least one first conductive pattern on the substrate;
Disposing a dry polyimide film on the first conductive pattern;
Applying a force to the dry polyimide film so that the dry polyimide film fills a space in the first conductive pattern; and forming at least one second conductive pattern on the dry polyimide film;
A method of preparing a thin film device comprising:
基板上に少なくとも1つの第1の導電パターンを形成する工程、
前記第1の導電パターン上に乾燥ポリイミド膜を配置する工程、
前記乾燥ポリイミド膜が前記第1の導電パターン中の空間を満たすように該乾燥ポリイミド膜に力を印加する工程、および
前記乾燥ポリイミド膜上に少なくとも1つの第2の導電パターンを形成する工程、
を有してなるコモンモードフィルタを調製する方法。 A method for preparing a common mode filter comprising:
Forming at least one first conductive pattern on the substrate;
Disposing a dry polyimide film on the first conductive pattern;
Applying a force to the dry polyimide film so that the dry polyimide film fills a space in the first conductive pattern; and forming at least one second conductive pattern on the dry polyimide film;
A method of preparing a common mode filter comprising:
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Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2022513216A (en) * | 2018-12-14 | 2022-02-07 | ゼネラル・エレクトリック・カンパニイ | High-voltage semiconductor device with improved electric field suppression |
JP2022513218A (en) * | 2018-12-14 | 2022-02-07 | ゼネラル・エレクトリック・カンパニイ | How to manufacture high voltage semiconductor devices with improved electric field suppression |
Citations (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH01147895A (en) * | 1987-12-03 | 1989-06-09 | Hitachi Chem Co Ltd | Manufacture of high density multilayer interconnection board |
JPH09270323A (en) * | 1996-03-29 | 1997-10-14 | Toshiba Corp | Electronic device, manufacturing method thereof and planar inductor |
JPH10209644A (en) * | 1997-01-16 | 1998-08-07 | Nippon Steel Chem Co Ltd | Manufacture of multilayer wiring board |
JPH10209583A (en) * | 1997-01-27 | 1998-08-07 | Mitsui Chem Inc | Flexible metal foil polyimide laminate |
JP2011035364A (en) * | 2009-08-03 | 2011-02-17 | Inpaq Technology Co Ltd | Common mode filter, and method for manufacturing the same |
JP2012009798A (en) * | 2010-06-28 | 2012-01-12 | Inpaq Technology Co Ltd | Thin type common mode filter and method of manufacturing the same |
-
2012
- 2012-05-29 JP JP2012121672A patent/JP2013247320A/en active Pending
Patent Citations (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH01147895A (en) * | 1987-12-03 | 1989-06-09 | Hitachi Chem Co Ltd | Manufacture of high density multilayer interconnection board |
JPH09270323A (en) * | 1996-03-29 | 1997-10-14 | Toshiba Corp | Electronic device, manufacturing method thereof and planar inductor |
JPH10209644A (en) * | 1997-01-16 | 1998-08-07 | Nippon Steel Chem Co Ltd | Manufacture of multilayer wiring board |
JPH10209583A (en) * | 1997-01-27 | 1998-08-07 | Mitsui Chem Inc | Flexible metal foil polyimide laminate |
JP2011035364A (en) * | 2009-08-03 | 2011-02-17 | Inpaq Technology Co Ltd | Common mode filter, and method for manufacturing the same |
JP2012009798A (en) * | 2010-06-28 | 2012-01-12 | Inpaq Technology Co Ltd | Thin type common mode filter and method of manufacturing the same |
Cited By (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2022513216A (en) * | 2018-12-14 | 2022-02-07 | ゼネラル・エレクトリック・カンパニイ | High-voltage semiconductor device with improved electric field suppression |
JP2022513218A (en) * | 2018-12-14 | 2022-02-07 | ゼネラル・エレクトリック・カンパニイ | How to manufacture high voltage semiconductor devices with improved electric field suppression |
US11538769B2 (en) | 2018-12-14 | 2022-12-27 | General Electric Company | High voltage semiconductor devices having improved electric field suppression |
JP7241879B2 (en) | 2018-12-14 | 2023-03-17 | ゼネラル・エレクトリック・カンパニイ | High voltage semiconductor device with improved field suppression |
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Legal Events
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Free format text: JAPANESE INTERMEDIATE CODE: A602 Effective date: 20131217 |
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A02 | Decision of refusal |
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