JP2013200868A5 - - Google Patents

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JP2013200868A5
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  1. 記憶デバイスを含む動的に適用されるキャッシュを管理する方法であって、
    データをホストから受け取るステップと、
    前記受け取ったデータを圧縮データに圧縮するステップと、
    前記圧縮データを格納するステップと、
    前記記憶デバイス上の利用可能なスペース量を決定するステップと、
    前記記憶デバイス上の前記利用可能スペース量が設定閾値よりも大きいときに、前記受け取ったデータのサイズと前記圧縮データのサイズとの差の少なくとも一部に従う量によって、前記ホストに提示される論理キャパシティを増量するステップと
    を含む、方法。
  2. 記利用可能スペース量が予約量よりも少ないときにスペースを開放するステップを更に含む、請求項1に記載の方法。
  3. 記利用可能スペース量が前記予約量よりも少ないときを通知するステップを更に含む、請求項2に記載の方法。
  4. 記利用可能スペース量を決定する前記ステップが、
    前記利用可能スペース量が前記設定閾値よりも大きいときを通知するステップと、
    前記利用可能スペース量を決定するために問い合わせを行うステップと
    を含む、請求項1に記載の方法。
  5. 該方法における各ステップ、データが前記ホストから受け取られる毎に実行される、請求項1に記載の方法。
  6. 記受け取ったデータを圧縮データに圧縮する前記ステップが、無損失のアルゴリズムを用いて前記データを圧縮するステップを含む、請求項1に記載の方法。
  7. 動的に適用されるキャッシュ格納のためのシステムであって、
    ホストから受け取ったデータを格納するための物理キャパシティを有する記憶デバイスと、
    前記ホストから受け取った前記データを圧縮データ・サイズに圧縮するための圧縮モジュールと、
    制御モジュールであって、前記ホストからデータを受け取るように構成され、前記記憶デバイス上の利用可能スペースを決定するように構成され、及び前記ホストから受け取った前記データのサイズと前記圧縮データのサイズとの差に基づき再利用されるスペースを決定するように構成される、制御モジュールと、
    前記再利用されるスペースの少なくとも一部を含み及び可変サイズを有する論理キャパシティを、前記ホストに提示するように構成されるインタフェース・モジュールと
    を備える、システム。
  8. 記制御モジュールが、前記記憶デバイス上の前記利用可能スペース量が予約量よりも少ないときに、前記記憶デバイス上のスペースを開放するように更に構成される、請求項7に記載のシステム。
  9. 記記憶デバイスが半導体ドライブである、請求項7に記載のシステム。
  10. 定の最小論理キャパシティが前記ホストに提示される、請求項7に記載のシステム。
  11. 方法であって、
    記憶デバイスが記憶インタフェースを介して複数のデータ部分を受け取るステップと、
    前記データ部分のそれぞれを縮小して各縮小データ部分を形成するステップであって、前記データ部分のうち少なくとも幾つかが前記各縮小データ部分よりも大きいサイズを有する、ステップと、
    前記データ部分を前記記憶デバイスのデータ・メモリ内に前記縮小データ部分として格納するステップと、
    前記データ・メモリの利用率(utilization)に従って前記データ・メモリの論理キャパシティを決定するステップであって、前記データ・メモリの前記論理キャパシティが前記縮小に従って変化する、ステップとからなり、
    前記論理キャパシティが、前記データ部分の総サイズと前記縮小データ部分の総サイズとの差が増すにつれて増量される、
    方法。
  12. 記論理キャパシティ、前記データ・メモリが格納することができる前記データ部分の数に対応する、請求項11に記載の方法。
  13. 記利用率が特定の閾値を超過したことに応じて、前記データ・メモリから前記縮小データ部分のうち1またはそれ以上を削除するステップを更に含む、請求項11に記載の方法。
  14. 記削除するステップが、前記記憶デバイスのタグ・メモリにおける1またはそれ以上のエントリを無効にするステップを含む、請求項13に記載の方法。
  15. 記特定の閾値が、前記記憶デバイスのライト・アンプリフィケーションを特定の値未満に維持するものである請求項13に記載の方法。
  16. 記論理キャパシティ、前記データ部分の総サイズ前記縮小データ部分の総サイズの差が減るにつれて減量される、請求項11に記載の方法。
  17. 記記憶インタフェースが、SATAインタフェース、SASインタフェース、およびPCIeインタフェースのうちの1つである、請求項11に記載の方法。
  18. 記データ・メモリが不揮発性データ・メモリである、請求項11に記載の方法。
  19. 記縮小するステップが圧縮するステップを含む、請求項11に記載の方法。
  20. 記データ部分のうちの特定の1つについての前記記憶デバイスへの要求に応じて前記データ・メモリから前記各縮小データ部分を読み取るステップと、前記各縮小データ部分の縮小を回復させて(reverse)前記特定のデータ部分を回復させるステップと、前記特定のデータ部分を前記ホストに戻すステップ更に含む、請求項11に記載の方法。
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