JP2012095010A - Image reading device - Google Patents

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PROBLEM TO BE SOLVED: To read out each pixel data stored in a memory from a CIS (Contact Image Sensor) in a pixel arrangement order and execute various processes on an image with accuracy while suppressing the manufacturing cost even when any one of CISs with different output types is provided, in an image reading device.SOLUTION: An image reading device 1 has: a memory 3 storing each pixel data outputted from a CIS 2 in an address depending on an output type of the CIS 2; and a storage control circuit 4. The storage control circuit 4 changes over a method for reading the pixel data from the memory 3, based on output type information for the CIS 2. Thereby, each pixel data can be read out from the memory 3 in a pixel arrangement order to accurately execute various processes on an image even when any one of CISs 2 with different output types is provided. Further, since the storage control circuit corresponding to the CIS 2 is not required to be prepared for each output type of the CIS 2 at manufacturing for the purpose of performing image processing with accuracy, components can be commonalized.

Description

本発明は、原稿の画像を読み取る画像読取装置に関する。   The present invention relates to an image reading apparatus that reads an image of a document.

従来から、原稿の画像をCIS(Contact Image Sensor)により読み取り、その読み取った画像データをメモリに格納し、画像補正処理等の際に、メモリから画像データを読み出して、画像に各種の処理を施す画像読取装置が知られている。   Conventionally, an image of a document is read by a CIS (Contact Image Sensor), the read image data is stored in a memory, and the image data is read from the memory and subjected to various kinds of processing during image correction processing or the like. An image reading apparatus is known.

CISは、1方向に配列された複数の受光素子を有しており、各受光素子に対して相対移動する原稿の画像を、受光素子により1ラインずつ読み取り、各受光素子の受光量を画像の各画素データとする。画像読取装置は、CISから出力された各画素データをメモリに書き込む。   The CIS has a plurality of light receiving elements arranged in one direction. An image of a document that moves relative to each light receiving element is read line by line by the light receiving elements, and the amount of light received by each light receiving element is calculated. Each pixel data is used. The image reading apparatus writes each pixel data output from the CIS into the memory.

このようなCISには、画素データの出力方式が異なるリニア出力タイプと分離出力タイプが在る。リニア出力タイプは、各画素データを画素配列順に出力する。分離出力タイプは、各画素を、基準画素から数えて奇数番目に配置された画素から成る奇数画素グループと、基準画素から数えて偶数番目に配置された画素から成る偶数画素グループとに分離して、それら分離されたグループ毎に画素データを画素配列順に出力する。   Such CIS includes a linear output type and a separate output type that differ in the output method of pixel data. The linear output type outputs each pixel data in the order of pixel arrangement. The separated output type separates each pixel into an odd-numbered pixel group composed of odd-numbered pixels counted from the reference pixel and an even-numbered pixel group composed of even-numbered pixels counted from the reference pixel. The pixel data is output in the pixel arrangement order for each of the separated groups.

上記画像読取装置においては、いずれの出力タイプのCISを用いるかによって、メモリ内の画素データの書き込み位置が異なる。従って、従来の画像読取装置においては、製造時に、CISの出力タイプ毎に、CISに対応して画素データを画素配列順に読み出す画像読出し回路を用意して組み込み、これにより、出荷後、画素データを画素配列順に読み出して、画像への各種処理を正確に実行できるようにしている。しかしながら、製造時に、CISの出力タイプ別に、CISに対応した画像読出し回路を準備する必要があり、製造コストが増加してしまう。   In the image reading apparatus, the writing position of the pixel data in the memory differs depending on which output type CIS is used. Therefore, in the conventional image reading apparatus, for each CIS output type, an image reading circuit that reads out pixel data corresponding to the CIS in the order of pixel arrangement is prepared and incorporated at the time of manufacture. It reads out in the pixel arrangement order so that various processes on the image can be executed accurately. However, at the time of manufacturing, it is necessary to prepare an image reading circuit corresponding to the CIS for each output type of the CIS, which increases the manufacturing cost.

ところで、CISの出力方式に応じて、メモリにおいてCISによる読取画像データの書き込みアドレスを制御する画像読取装置が知られている(例えば、特許文献1参照)。また、画像読取装置ではないが、読み取った画像を複数のブロックに分割し、各ブロックの画像を並行に出力可能なCIS(例えば、特許文献2参照)や、解像度に応じた読取速度が実現可能であり、かつ、高速なCIS(例えば、特許文献3参照)が知られている。しかしながら、特許文献1〜3に記載の技術では、上記の問題を解決することは難しい。   By the way, an image reading apparatus that controls a write address of read image data by CIS in a memory in accordance with a CIS output method is known (for example, see Patent Document 1). Moreover, although it is not an image reading device, it can realize a CIS that can divide the read image into a plurality of blocks and output the image of each block in parallel (for example, see Patent Document 2) and a reading speed according to the resolution. And high-speed CIS (see, for example, Patent Document 3) is known. However, it is difficult to solve the above problems with the techniques described in Patent Documents 1 to 3.

特開2006−191362号公報JP 2006-191362 A 特開平6−189080号公報JP-A-6-189080 特開平11−234473号公報JP 11-234473 A

本発明は、上記の従来の問題を解決するためになされたものであり、出力タイプが異なるCISのいずれが設けられたとしても、製造コストを抑えながら、CISから記憶手段に記憶される各画素データを画素配列順に読み出すことができ、画像への各種処理を正確に実行することができる画像読取装置を提供することを目的とする。   The present invention has been made to solve the above-described conventional problems, and each pixel stored in the storage means from the CIS while suppressing the manufacturing cost regardless of which of the CISs having different output types is provided. An object of the present invention is to provide an image reading apparatus capable of reading data in the order of pixel arrangement and accurately executing various processes on an image.

上記目的を達成するために本発明の画像読取装置は、1方向に配列された複数の受光素子を有し、該複数の受光素子に対して相対移動する原稿の画像を該受光素子により1ラインずつ読み取り、各受光素子の受光量を該画像の各画素データとするCIS(Contact Image Sensor)と、前記CISにより読み取られた各ラインの画像データを記憶するための記憶手段と、前記CISにより読み取られ該CISから出力される各ラインの画像データを前記記憶手段に記憶させる記憶制御手段と、前記記憶手段に記憶されている各ラインの画像データを読み出す画像読出し手段と、前記画像読出し手段により読み出された各ラインの画像データを基に各種処理を実行可能な処理手段と、を備え、前記記憶制御手段は、前記CISからの各画素データの出力順と各画素データのアドレスの順序とが同じになるように各画素データを前記記憶手段に記憶させる画像読取装置において、前記CISは、前記各画素データを画素配列順に出力する第1の出力タイプであるか、又は、前記各画素を、基準画素から数えて奇数番目に配置された画素から成る奇数画素グループと、該基準画素から数えて偶数番目に配置された画素から成る偶数画素グループとに分離して、それら分離されたグループ毎に画素データを画素配列順に出力する第2の出力タイプであり、前記CISが前記第1の出力タイプと前記第2の出力タイプのいずれであるかをユーザが入力するためのタイプ判別手段と、を備え、前記記憶制御手段は、前記タイプ判別手段により前記CISが第1の出力タイプであると判別されたときには、前記記憶手段の予め設定された第1のスタートアドレスから順に前記各画素データを記憶させ、前記タイプ判別手段により前記CISが第2の出力タイプであると判別されたときには、該CISから出力される各画素データが前記奇数画素グループと前記偶数画素グループのいずれであるかを判別し、前記奇数画素グループと判別された画素データを、前記記憶手段の予め設定された第2のスタートアドレスから順に記憶させ、前記偶数画素グループと判別された画素データを、該記憶手段の予め設定された第3のスタートアドレスから順に記憶させ、前記画像読出し手段は、前記タイプ判別手段により前記CISが第1の出力タイプであると判別されたときには、前記第1のスタートアドレスから順に画素データを読み出すことにより、各画素データを画素配列順に読み出し、前記タイプ判別手段により前記CISが第2の出力タイプであると判別されたときには、前記第2のスタートアドレスと前記第3のスタートアドレスとから順に、前記奇数画素グループの画素データと前記偶数画素グループの画素データとを交互に読み出すことにより、各画素データを画素配列順に読み出すことを特徴とする。   In order to achieve the above object, an image reading apparatus of the present invention has a plurality of light receiving elements arranged in one direction, and an image of an original that moves relative to the plurality of light receiving elements is displayed on the line by the light receiving elements. CIS (Contact Image Sensor) that reads each pixel and uses the amount of light received by each light receiving element as each pixel data of the image, storage means for storing image data of each line read by the CIS, and reading by the CIS Storage control means for storing the image data of each line output from the CIS in the storage means, image reading means for reading out the image data of each line stored in the storage means, and reading by the image reading means. Processing means capable of executing various processes based on the output image data of each line, and the storage control means outputs each pixel data from the CIS In the image reading apparatus that stores the pixel data in the storage means so that the order of the addresses of the pixel data is the same, the CIS is a first output type that outputs the pixel data in the order of pixel arrangement. Or each pixel is separated into an odd pixel group consisting of odd-numbered pixels counted from a reference pixel and an even pixel group consisting of even-numbered pixels counted from the reference pixel Then, it is a second output type that outputs pixel data in order of pixel arrangement for each of the separated groups, and the user determines whether the CIS is the first output type or the second output type. A type discriminating means for inputting, when the storage discriminating means judges that the CIS is the first output type by the type discriminating means. Each pixel data is stored in order from the preset first start address of the storage means, and when the CIS is determined to be the second output type by the type determination means, it is output from the CIS. It is determined whether each pixel data is the odd pixel group or the even pixel group, and the pixel data determined as the odd pixel group is stored in order from a preset second start address of the storage means. The pixel data determined as the even-numbered pixel group is stored in order from a preset third start address of the storage means, and the image reading means is configured to output the first output of the CIS by the type determination means. When it is determined that it is a type, each pixel is read out in order from the first start address, thereby Data is read in order of pixel arrangement, and when the CIS is determined to be the second output type by the type determining means, the odd pixel group is sequentially read from the second start address and the third start address. Each pixel data is read in order of pixel arrangement by alternately reading pixel data and pixel data of the even-numbered pixel group.

この発明において、前記CISは、前記受光素子の受光量の分解能が予め定められた複数種類のいずれかであり、前記分解能が前記複数種類のいずれであるかを入力するための分解能入力手段と、前記画像読出し手段から前記処理手段に伝送される前記画素データを一時的に記憶する画素記憶手段と、前記画素記憶手段に前記画素データが格納される毎に該画素記憶手段のポインタをインクリメントするポインタインクリメント手段と、をさらに備え、前記ポインタインクリメント手段は、前記分解能入力手段により入力される分解能情報を基に、前記ポインタのインクリメントの回数を調整することが好ましい。   In the present invention, the CIS is one of a plurality of predetermined resolutions of the amount of light received by the light receiving element, and resolution input means for inputting which of the plurality of resolutions is the resolution. Pixel storage means for temporarily storing the pixel data transmitted from the image reading means to the processing means, and a pointer for incrementing a pointer of the pixel storage means each time the pixel data is stored in the pixel storage means Preferably, the pointer increment means adjusts the number of increments of the pointer based on the resolution information input by the resolution input means.

本発明によれば、CISが、読み取った各画素データを異なった方式で出力する出力タイプのいずれであったとしても、画像読出し手段は、タイプ判別手段により判別されたCISの出力タイプ情報を基に、CISから出力され記憶手段に記憶される各画素データを画素配列順に読み出すことができ、画像への各種処理を正確に実行することができる。しかも、画像処理を正確に行えるようにするために、製造の際、CISの出力タイプ毎に、CISに対応した画像読出し手段を用意する必要がなくなり、従って、部品の共通化を図ることができ、製造コストを抑えることができる。   According to the present invention, regardless of the output type in which each read pixel data is output in a different manner, the image reading means is based on the CIS output type information determined by the type determining means. In addition, each pixel data output from the CIS and stored in the storage means can be read in the order of pixel arrangement, and various processes on the image can be executed accurately. In addition, in order to perform image processing accurately, it is not necessary to prepare an image reading means corresponding to CIS for each output type of CIS at the time of manufacturing, and therefore, it is possible to share parts. Manufacturing costs can be reduced.

本発明の一実施形態に係る画像読取装置の電気的ブロック図。1 is an electrical block diagram of an image reading apparatus according to an embodiment of the present invention. 上記装置においてメモリに格納された画素データを読み出す処理の一部の手順を示すフローチャート。5 is a flowchart showing a part of a procedure of a process of reading pixel data stored in a memory in the apparatus. 上記の残りの手順を示すフローチャート。The flowchart which shows said remaining procedure.

以下、本発明の一実施形態に係る画像読取装置について図面を参照して説明する。図1は、本実施形態の画像読取装置の構成を示す。この画像読取装置1は、原稿の画像を読み取るスキャナ等に適用される。画像読取装置1は、上記画像を読み取るCIS(Contact Image Sensor)2と、CIS2により読み取られた画像データを記憶するためのメモリ3(記憶手段)と、CIS2により読み取られた画像データをメモリ3に記憶させ、かつ、メモリ3から適宜、画像データを読み出す記憶制御回路4(記憶制御手段、画像読出し手段)とを備える。記憶制御回路4は、CIS2の後述する出力タイプ及び分解能の種類に応じて、データ読出し処理の内容を変更する。   Hereinafter, an image reading apparatus according to an embodiment of the present invention will be described with reference to the drawings. FIG. 1 shows the configuration of the image reading apparatus of the present embodiment. The image reading apparatus 1 is applied to a scanner or the like that reads an image of a document. The image reading apparatus 1 includes a CIS (Contact Image Sensor) 2 for reading the image, a memory 3 (storage means) for storing image data read by the CIS 2, and image data read by the CIS 2 in the memory 3. A storage control circuit 4 (storage control means, image reading means) for storing and reading out image data from the memory 3 as appropriate is provided. The storage control circuit 4 changes the contents of the data read process according to the output type and resolution type described later of the CIS 2.

また、画像読取装置1は、記憶制御回路4により読み出された画像データに所定の処理を施すことにより、画像のガンマ補正を行うガンマ補正回路5(処理手段)と、記憶制御回路4からガンマ補正回路5へのデータ伝送経路中に設けられ、画像データを一時的に記憶するFIFO(First in, First Out)回路6(画素記憶手段)とを備える。さらに、画像読取装置1は、CIS2の分解能の種類を入力するための入力回路7(分解能入力手段)と、上記各回路を制御し、かつCIS2の出力タイプを判別するマイクロプロセッサ8(タイプ判別手段)とを備える。   In addition, the image reading apparatus 1 performs a predetermined process on the image data read by the storage control circuit 4 to perform a gamma correction circuit 5 (processing unit) that performs image gamma correction, and a gamma correction circuit 5 that performs gamma correction from the storage control circuit 4. A FIFO (First in, First Out) circuit 6 (pixel storage means) is provided in the data transmission path to the correction circuit 5 and temporarily stores image data. Further, the image reading apparatus 1 includes an input circuit 7 (resolution input means) for inputting the type of resolution of the CIS 2 and a microprocessor 8 (type discrimination means) for controlling each circuit and determining the output type of the CIS 2. ).

CIS2は、1方向に配列された複数の受光素子を有するラインセンサである。このラインセンサは、複数の受光素子に対して相対移動する原稿の画像を一定期間毎又は一定移動距離毎に、受光素子により1ラインずつ読み取り、各受光素子の受光量を、読み取った画像の各画素データとし、各画素データをライン毎に画素配列順に出力する。上記受光素子の配列方向は、原稿の副走査方向と同じである。上記受光素子と原稿とを相対的に移動させるため、CIS2が原稿の主走査方向に移動可能に構成されていてもよいし、画像読取装置1に、原稿を上記受光素子の配列方向と直交する方向に移動させる移動機構が設けられていてもよい。   The CIS 2 is a line sensor having a plurality of light receiving elements arranged in one direction. This line sensor reads an image of a document that moves relative to a plurality of light receiving elements, line by line by a light receiving element at regular intervals or at constant movement distances, and determines the amount of light received by each light receiving element. The pixel data is output in the pixel arrangement order for each line. The arrangement direction of the light receiving elements is the same as the sub-scanning direction of the document. In order to relatively move the light receiving element and the original, the CIS 2 may be configured to be movable in the main scanning direction of the original, or the original is placed in the image reading apparatus 1 at right angles to the arrangement direction of the light receiving elements. A moving mechanism for moving in the direction may be provided.

CIS2は、画素データの出力方式が異なるリニア出力タイプと分離出力タイプのいずれでもよい。リニア出力タイプ(第1の出力タイプ)は、各画素データを画素配列順に出力する。分離出力タイプ(第2の出力タイプ)は、各画素を、基準画素から数えて奇数番目に配置された画素(以下、奇数画素という)から成る奇数画素グループと、基準画素から数えて偶数番目に配置された画素(以下、偶数画素という)から成る偶数画素グループとに分離して、それら分離されたグループ毎に画素データを画素配列順に出力する。画像読取装置1は、CIS2がいずれの出力タイプであっても、CIS2と通信可能に構成されている。CIS2は、分離出力タイプの場合、まず奇数画素グループの画素データを送出し、次に偶数画素グループの画素データを送出する。また、CIS2は、各受光素子の受光量の分解能が予め定められた複数種類のいずれかであり、画像読取装置1は、それら複数種類の分解能のいずれにも対応可能に構成されている。本実施形態のCIS2の分解能は、例えば8ビットと16ビット(実際に使用されるのは12ビットの画素データ)の2種類のいずれかである。   The CIS 2 may be either a linear output type or a separated output type that has different pixel data output methods. The linear output type (first output type) outputs each pixel data in the order of pixel arrangement. In the separated output type (second output type), each pixel is an odd-numbered pixel group consisting of pixels arranged oddly from the reference pixel (hereinafter referred to as odd-numbered pixels), and even-numbered from the reference pixel. The pixel data is separated into even pixel groups composed of arranged pixels (hereinafter referred to as even pixels), and pixel data is output in the pixel arrangement order for each of the separated groups. The image reading apparatus 1 is configured to be communicable with the CIS 2 regardless of the output type of the CIS 2. In the case of the separation output type, the CIS 2 first transmits pixel data of the odd pixel group, and then transmits pixel data of the even pixel group. Further, the CIS 2 is one of a plurality of types in which the resolution of the amount of light received by each light receiving element is determined in advance, and the image reading apparatus 1 is configured to be able to handle any of these types of resolutions. The resolution of the CIS2 in this embodiment is, for example, one of two types of 8 bits and 16 bits (actually used is 12-bit pixel data).

メモリ3は、CIS2により読み取られた各ラインの画像データを記憶可能なSDRAM(Synchronous Dynamic Random Access Memory)等により構成される。メモリ3の記憶単位は例えば8ビットである。   The memory 3 is configured by an SDRAM (Synchronous Dynamic Random Access Memory) that can store image data of each line read by the CIS 2. The storage unit of the memory 3 is, for example, 8 bits.

記憶制御回路4は、DMA I/F(Direct Memory Access Interface)等により構成される。記憶制御回路4は、CIS2から出力される各ラインの画像データをメモリ3に記憶させる。各ラインの画像データは、1ラインの画素データ列から成っている。記憶制御回路4は、ライン毎に、CIS2からの各画素データの出力順と各画素データのアドレスの順序とが同じになるように各画素データをメモリ3に記憶させる。   The storage control circuit 4 is configured by a DMA I / F (Direct Memory Access Interface) or the like. The storage control circuit 4 stores the image data of each line output from the CIS 2 in the memory 3. Each line of image data consists of a line of pixel data. The storage control circuit 4 stores the pixel data in the memory 3 so that the output order of the pixel data from the CIS 2 and the address order of the pixel data are the same for each line.

また、記憶制御回路4(ポインタインクリメント手段)は、FIFO回路6に画素データが格納される毎にFIFO回路6のポインタをインクリメントする機能を有する。   The storage control circuit 4 (pointer increment means) has a function of incrementing the pointer of the FIFO circuit 6 every time pixel data is stored in the FIFO circuit 6.

FIFO回路6は、記憶制御回路4からガンマ補正回路5に転送される画素データを一時的に記憶するバッファリング方式のフロー制御回路により構成される。このフロー制御回路は、転送される画素データを、ガンマ補正回路5が処理可能な状態になるまで記憶し、その後、ガンマ補正回路5に出力する。この出力順は、画素データがFIFO回路6に入力された順と同じ順序である。FIFO回路6の記憶単位は例えば8ビットにする。   The FIFO circuit 6 includes a buffering type flow control circuit that temporarily stores pixel data transferred from the storage control circuit 4 to the gamma correction circuit 5. This flow control circuit stores the transferred pixel data until the gamma correction circuit 5 is ready for processing, and then outputs it to the gamma correction circuit 5. This output order is the same as the order in which the pixel data is input to the FIFO circuit 6. The storage unit of the FIFO circuit 6 is 8 bits, for example.

入力回路7は、CIS2の各受光素子の分解能が上記複数種類のいずれであるかを入力するためのインタフェース等により構成されており、本実施形態では、上記分解能が8ビットと16ビットの2種類のいずれであるかを入力可能とされている。入力回路7は、例えば、そのような入力のためのトグルスイッチ、波形スイッチ、又はスライドスイッチ等の2極スイッチを有する。上記分解能についての入力情報に基づき、記憶制御回路4は、FIFO回路6のポインタのインクリメントの回数を調整する。具体的には、記憶制御回路4は、上記分解能が8ビットと入力されたとき、インクリメントの回数を1回とし、上記分解能が16ビットと入力されたとき、インクリメントの回数を2回とする。入力回路7は、上記分解能の種類だけでなく、他の情報も入力可能であってもよい。   The input circuit 7 is configured by an interface or the like for inputting which of the plurality of types of resolution of each light receiving element of the CIS 2 is used. In this embodiment, the resolution is two types of 8 bits and 16 bits. It is possible to input any of them. The input circuit 7 includes a two-pole switch such as a toggle switch, a waveform switch, or a slide switch for such input. Based on the input information about the resolution, the storage control circuit 4 adjusts the number of increments of the pointer of the FIFO circuit 6. Specifically, the storage control circuit 4 sets the number of increments to 1 when the resolution is input as 8 bits, and sets the number of increments as 2 when the resolution is input as 16 bits. The input circuit 7 may be capable of inputting not only the resolution type but also other information.

マイクロプロセッサ8には、CIS2により出力された画素データが入力され、マイクロプロセッサ8は、その入力された画素データを記憶制御回路4に転送する。記憶制御回路4は、この転送された画素データをメモリ3に格納する。また、マイクロプロセッサ8は、CIS2がリニア出力タイプと分離出力タイプのいずれであるかを判別する。この判別処理は、例えば、マイクロプロセッサ8においてCIS2からの画素データ入力用に設けた端子のうち、実際に画素データが入力された端子数に応じて行われる。その端子数が1つであればCIS2はリニア出力タイプと判別され、上記端子数が2つであれば分離出力タイプと判別される。   The microprocessor 8 receives the pixel data output from the CIS 2, and the microprocessor 8 transfers the input pixel data to the storage control circuit 4. The storage control circuit 4 stores the transferred pixel data in the memory 3. Further, the microprocessor 8 determines whether the CIS 2 is a linear output type or a separated output type. This determination processing is performed according to the number of terminals to which pixel data is actually input among the terminals provided for inputting pixel data from the CIS 2 in the microprocessor 8, for example. If the number of terminals is one, CIS2 is determined as a linear output type, and if the number of terminals is two, it is determined as a separate output type.

次に、記憶制御回路4におけるメモリ3へのデータ書込み処理について説明する。記憶制御回路4は、マイクロプロセッサ8によりCIS2がリニア出力タイプであると判別されたときには、メモリ3の予め設定された第1スタートアドレスから順に各画素データを記憶させる。CIS2により読み取られたライン画像が複数である場合、最初に読み取られたライン画像の画素データ列は、上記のように格納される。そして、次以降に読み取られたライン画像の画素データ列は、最初のライン画像が格納されたアドレス領域の続きに連続して、ラインの読取り順と同じアドレス順で格納される。   Next, data write processing to the memory 3 in the storage control circuit 4 will be described. When the microprocessor 8 determines that the CIS 2 is a linear output type, the storage control circuit 4 stores each pixel data in order from the preset first start address of the memory 3. When there are a plurality of line images read by CIS2, the pixel data string of the line image read first is stored as described above. Then, the pixel data string of the line image read after the next is stored in the same address order as the line reading order, following the address area in which the first line image is stored.

記憶制御回路4は、マイクロプロセッサ8によりCIS2が分離出力タイプであると判別されたときには、CIS2から出力される各画素データが奇数画素グループと偶数画素グループのいずれであるかを判別する。この判別処理においては、例えば、予め設定されたCIS2の画素数、又は入力回路7から入力されるCIS2の画素数に基づいて奇数画素の個数が算出される。そして、CIS2から出力される画素データの個数がカウントされ、そのカウント数が上記の算出された奇数画素の個数と等しくなるまでは、出力される画素データが奇数画素のデータであると判別され、その後に出力される画素データについては偶数画素のデータと判別される。   When the microprocessor 8 determines that the CIS 2 is the separation output type, the storage control circuit 4 determines whether each pixel data output from the CIS 2 is an odd pixel group or an even pixel group. In this determination processing, for example, the number of odd pixels is calculated based on the preset number of CIS2 pixels or the number of CIS2 pixels input from the input circuit 7. Then, the number of pixel data output from the CIS 2 is counted, and it is determined that the output pixel data is odd-numbered pixel data until the counted number becomes equal to the calculated number of odd-numbered pixels, The pixel data output thereafter is determined as even-numbered pixel data.

そして、記憶制御回路4は、奇数画素グループと判別された画素データを、メモリ3の予め設定された第2スタートアドレスから順に記憶させ、偶数画素グループと判別された画素データを、メモリ3の予め設定された第3スタートアドレスから順に記憶させる。CIS2により読み取られたライン画像が複数である場合、最初に読み取られたライン画像の奇数画素グループと偶数画素グループとは、上記のように格納される。そして、次以降に読み取られたライン画像の奇数画素グループと偶数画素グループとは、それぞれ、最初のライン画像の奇数画素グループと偶数画素グループとがそれぞれ格納されたアドレス領域の続きに連続して、ラインの読取り順と同じアドレス順で格納される。上記第1スタートアドレス、第2スタートアドレス、及び第3スタートアドレスは、入力回路7により設定可能であり、第1スタートアドレスと第2スタートアドレスとは同じでもよい。第3スタートアドレスは、第2スタートアドレスよりもアドレス値が大きく設定される。   Then, the storage control circuit 4 sequentially stores the pixel data determined as the odd pixel group from the preset second start address of the memory 3 and stores the pixel data determined as the even pixel group in the memory 3 in advance. It memorizes in order from the set third start address. When there are a plurality of line images read by the CIS2, the odd pixel group and the even pixel group of the line image read first are stored as described above. Then, the odd-numbered pixel group and the even-numbered pixel group of the line image read from the next onward are respectively continuous to the continuation of the address area in which the odd-numbered pixel group and the even-numbered pixel group of the first line image are respectively stored, Stored in the same address order as the line reading order. The first start address, the second start address, and the third start address can be set by the input circuit 7, and the first start address and the second start address may be the same. The third start address is set to have a larger address value than the second start address.

次に、記憶制御回路4におけるメモリ3からの画素データ読出し処理について説明する。記憶制御回路4は、マイクロプロセッサ8によりCIS2がリニア出力タイプであると判別されたときには、第1スタートアドレスから順に画素データを読み出し、それにより、各画素データをライン順に、かつライン毎の画素配列順に読み出す。記憶制御回路4は、マイクロプロセッサ8によりCIS2が分離出力タイプであると判別されたときには、第2スタートアドレスと第3スタートアドレスとから順に、奇数画素グループの画素データと偶数画素グループの画素データとを交互に読み出し、それにより、各画素データをライン順に、かつライン毎の画素配列順に読み出す。そして、記憶制御回路4は、読み出された画素データを順次、FIFO回路6に書き込む。   Next, pixel data reading processing from the memory 3 in the storage control circuit 4 will be described. When the microprocessor 8 determines that the CIS 2 is a linear output type, the storage control circuit 4 reads pixel data in order from the first start address, whereby each pixel data is arranged in line order and pixel arrangement for each line. Read sequentially. When the microprocessor 8 determines that the CIS 2 is a separate output type, the storage control circuit 4 sequentially outputs the pixel data of the odd pixel group and the pixel data of the even pixel group in order from the second start address and the third start address. Are alternately read out, whereby each pixel data is read out in the order of lines and in the order of pixel arrangement for each line. Then, the storage control circuit 4 sequentially writes the read pixel data to the FIFO circuit 6.

図2及び図3は、上記画素データ読出し処理の詳細な手順の一例を示す。図2に示されるように、記憶制御回路4は、マイクロプロセッサ8によりCIS2がリニア出力タイプであると判別されたとき(S101でYes)、メモリ3のポインタを第1スタートアドレスに設定する(S102)。   2 and 3 show an example of a detailed procedure of the pixel data reading process. As shown in FIG. 2, when the microprocessor 8 determines that the CIS 2 is a linear output type (Yes in S101), the storage control circuit 4 sets the pointer of the memory 3 to the first start address (S102). ).

入力回路7により、CIS2の各受光素子の分解能が8ビットである旨が入力された場合(S103でYes)、記憶制御回路4は、メモリ3のポインタにより指定されるアドレスの画素データを読み出し(S104)、その読み出された画素データを、FIFO回路6においてポインタにより指定される記憶領域に書き込む(S105)。   When the input circuit 7 inputs that the resolution of each light receiving element of the CIS 2 is 8 bits (Yes in S103), the storage control circuit 4 reads the pixel data at the address specified by the pointer of the memory 3 ( In S104, the read pixel data is written in the storage area designated by the pointer in the FIFO circuit 6 (S105).

そして、記憶制御回路4は、メモリ3のポインタを1回、インクリメントし(S106)、FIFO回路6のポインタを1回、インクリメントする(S107)。全画素データの読出しが終了していなければ(S108でNo)、S104〜S107の処理が繰り返され、第1スタートアドレスから順に画素データが読み出される。   Then, the storage control circuit 4 increments the pointer of the memory 3 once (S106), and increments the pointer of the FIFO circuit 6 once (S107). If reading of all the pixel data has not been completed (No in S108), the processing of S104 to S107 is repeated, and the pixel data is read sequentially from the first start address.

入力回路7により、CIS2の各受光素子の分解能が16ビットである旨が入力された場合(S103でNo、S109でYes)、記憶制御回路4は、メモリ3のポインタにより指定されるアドレスと次のアドレスの画素データを読み出し(S110)、その読み出された画素データを、FIFO回路6においてポインタにより指定される記憶領域に書き込む(S111)。   When the input circuit 7 inputs that the resolution of each light receiving element of the CIS 2 is 16 bits (No in S103, Yes in S109), the storage control circuit 4 determines the address specified by the pointer of the memory 3 and the next Is read out (S110), and the read out pixel data is written in the storage area designated by the pointer in the FIFO circuit 6 (S111).

記憶制御回路4は、メモリ3のポインタを2回、インクリメントし(S112)、FIFO回路6のポインタを2回、インクリメントする(S113)全画素データの読出しが終了していなければ(S114でNo)、S110〜S113の処理が繰り返される。   The storage control circuit 4 increments the pointer of the memory 3 twice (S112), and increments the pointer of the FIFO circuit 6 twice (S113). If reading of all pixel data is not completed (No in S114). , S110 to S113 are repeated.

図3に示されるように、マイクロプロセッサ8によりCIS2が分離出力タイプであると判別されたとき(S101でNo、S201でYes)、記憶制御回路4は、メモリ3のポインタを第2スタートアドレスに設定する(S202)。入力回路7により、CIS2の各受光素子の分解能が8ビットである旨が入力された場合(S203でYes)、S104、S105、S107と同内容の処理を実行する(S204〜S206)。   As shown in FIG. 3, when the microprocessor 8 determines that CIS2 is a separate output type (No in S101, Yes in S201), the storage control circuit 4 sets the pointer of the memory 3 to the second start address. Set (S202). When the input circuit 7 inputs that the resolution of each light receiving element of the CIS 2 is 8 bits (Yes in S203), the same processing as S104, S105, and S107 is executed (S204 to S206).

記憶制御回路4は、全画素データの読出しが終了していなければ(S207でNo)、メモリ3において、現在のポインタが指定しているアドレスに、第3スタートアドレスと第2スタートアドレスとのアドレス差を加えたアドレスを算出し(S208)、その算出したアドレスにポインタを移動させる(S209)。その後、S104〜S107と同じ内容の処理が実行される(S210〜S213)。   If the reading of all the pixel data has not been completed (No in S207), the storage control circuit 4 sets the addresses of the third start address and the second start address to the address specified by the current pointer in the memory 3. An address with the difference added is calculated (S208), and the pointer is moved to the calculated address (S209). Thereafter, the same processing as S104 to S107 is executed (S210 to S213).

記憶制御回路4は、全画素データの読出しが終了していなければ(S214でNo)、メモリ3において、現在のポインタが指定するアドレスから上記アドレス差を減じたアドレスを算出し(S215)、その算出したアドレスにポインタを移動し(S216)、S204の処理に戻る。   If the reading of all pixel data has not been completed (No in S214), the storage control circuit 4 calculates an address in the memory 3 by subtracting the address difference from the address specified by the current pointer (S215). The pointer is moved to the calculated address (S216), and the process returns to S204.

入力回路7により、CIS2の各受光素子の分解能が16ビットである旨が入力された場合(S203でNo、S217でYes)、S110、S111、S113と同内容の処理を実行する(S218〜S220)。   When the input circuit 7 inputs that the resolution of each light receiving element of CIS2 is 16 bits (No in S203, Yes in S217), the same processing as S110, S111, and S113 is executed (S218 to S220). ).

記憶制御回路4は、全画素データの読出しが終了していなければ(S221でNo)、S208、S209、S110〜S113と同内容の処理を行う(S222〜S227)。その後、記憶制御回路4は、全画素データの読出しが終了していなければ(S228でNo)、S215、S216と同内容の処理を実施し(S229、S230)、S218以降の処理を再び実行する。   If the reading of all pixel data has not been completed (No in S221), the storage control circuit 4 performs the same processing as S208, S209, S110 to S113 (S222 to S227). Thereafter, if the reading of all pixel data has not been completed (No in S228), the storage control circuit 4 performs the same processing as S215 and S216 (S229 and S230), and executes the processing after S218 again. .

本実施形態においては、CIS2が、読み取った各画素データを出力する方式がリニア出力タイプと分離出力タイプのいずれであったとしても、記憶制御回路4は、マイクロプロセッサ8により判別されるCIS2の出力タイプ情報を基に、CIS2から出力されメモリ3に記憶される各画素データを画素配列順に読み出すことができる。従って、ガンマ補正回路5による画像へのガンマ補正を正確に実行することができる。しかも、ガンマ補正処理を正確に行えるようにするために、製造時に、CIS2の出力タイプ毎に、CIS2に対応した記憶制御回路を用意する必要がなくなり、従って、部品の共通化を図ることができ、製造コストを抑えることができる。   In this embodiment, the storage control circuit 4 outputs the output of the CIS 2 that is discriminated by the microprocessor 8 regardless of whether the CIS 2 outputs each read pixel data of the linear output type or the separated output type. Based on the type information, each pixel data output from the CIS 2 and stored in the memory 3 can be read in the pixel arrangement order. Therefore, the gamma correction to the image by the gamma correction circuit 5 can be executed accurately. In addition, in order to perform the gamma correction processing accurately, it is not necessary to prepare a storage control circuit corresponding to the CIS2 for each output type of the CIS2 at the time of manufacture. Therefore, it is possible to share parts. Manufacturing costs can be reduced.

また、CIS2の各受光素子の受光量の分解能が8ビットと16ビットのいずれであっても、記憶制御回路4は、入力回路7から入力される分解能情報を基に、各受光素子の受光量に対応する各画素データを画素単位で、FIFO回路6を介してガンマ補正回路5に正確に伝送することができる。従って、ガンマ補正回路5によるガンマ補正の正確さを向上することができる。しかも、ガンマ補正処理を正確に行えるようにするために、製造時に、分解能が異なるCIS2毎に、CIS2に対応した記憶制御回路を用意する必要がなくなり、従って、部品の共通化を図ることができる。   In addition, regardless of whether the resolution of the light reception amount of each light receiving element of CIS 2 is 8 bits or 16 bits, the storage control circuit 4 uses the light reception amount of each light receiving element based on the resolution information input from the input circuit 7. Can be accurately transmitted to the gamma correction circuit 5 via the FIFO circuit 6 in units of pixels. Therefore, the accuracy of gamma correction by the gamma correction circuit 5 can be improved. In addition, in order to perform the gamma correction processing accurately, it is not necessary to prepare a storage control circuit corresponding to CIS2 for each CIS2 having different resolutions at the time of manufacture, and therefore, it is possible to share parts. .

なお、本発明は、上記の実施形態の構成に限定されるものでなく、使用目的に応じ、様々な変形が可能である。例えば、原稿画像の各ラインの画像データにデータ処理を施し、ガンマ処理以外の他の処理を原稿画像に実行可能な処理回路を設けてもよい。   In addition, this invention is not limited to the structure of said embodiment, A various deformation | transformation is possible according to a use purpose. For example, a processing circuit may be provided that performs data processing on the image data of each line of the document image and can execute processing other than gamma processing on the document image.

1 画像読取装置
2 CIS
3 メモリ(記憶手段)
4 記憶制御回路(記憶制御手段、画像読出し手段、ポインタインクリメント手段)
5 ガンマ補正回路(処理手段)
6 FIFO回路(画素記憶手段)
7 入力回路(分解能入力手段)
8 マイクロプロセッサ(タイプ判別手段)
1 Image reader 2 CIS
3 Memory (memory means)
4 Storage control circuit (storage control means, image reading means, pointer increment means)
5 Gamma correction circuit (processing means)
6 FIFO circuit (pixel storage means)
7 Input circuit (resolution input means)
8 Microprocessor (Type discrimination means)

Claims (2)

1方向に配列された複数の受光素子を有し、該複数の受光素子に対して相対移動する原稿の画像を該受光素子により1ラインずつ読み取り、各受光素子の受光量を該画像の各画素データとするCIS(Contact Image Sensor)と、
前記CISにより読み取られた各ラインの画像データを記憶するための記憶手段と、
前記CISにより読み取られ該CISから出力される各ラインの画像データを前記記憶手段に記憶させる記憶制御手段と、
前記記憶手段に記憶されている各ラインの画像データを読み出す画像読出し手段と、
前記画像読出し手段により読み出された各ラインの画像データを基に各種処理を実行可能な処理手段と、を備え、
前記記憶制御手段は、前記CISからの各画素データの出力順と各画素データのアドレスの順序とが同じになるように各画素データを前記記憶手段に記憶させる画像読取装置において、
前記CISは、前記各画素データを画素配列順に出力する第1の出力タイプであるか、又は、前記各画素を、基準画素から数えて奇数番目に配置された画素から成る奇数画素グループと、該基準画素から数えて偶数番目に配置された画素から成る偶数画素グループとに分離して、それら分離されたグループ毎に画素データを画素配列順に出力する第2の出力タイプであり、
前記CISが前記第1の出力タイプと前記第2の出力タイプのいずれであるかを判別するタイプ判別手段と、を備え、
前記記憶制御手段は、
前記タイプ判別手段により前記CISが第1の出力タイプであると判別されたときには、前記記憶手段の予め設定された第1のスタートアドレスから順に前記各画素データを記憶させ、
前記タイプ判別手段により前記CISが第2の出力タイプであると判別されたときには、該CISから出力される各画素データが前記奇数画素グループと前記偶数画素グループのいずれであるかを判別し、前記奇数画素グループと判別された画素データを、前記記憶手段の予め設定された第2のスタートアドレスから順に記憶させ、前記偶数画素グループと判別された画素データを、該記憶手段の予め設定された第3のスタートアドレスから順に記憶させ、
前記画像読出し手段は、
前記タイプ判別手段により前記CISが第1の出力タイプであると判別されたときには、前記第1のスタートアドレスから順に画素データを読み出すことにより、各画素データを画素配列順に読み出し、
前記タイプ判別手段により前記CISが第2の出力タイプであると判別されたときには、前記第2のスタートアドレスと前記第3のスタートアドレスとから順に、前記奇数画素グループの画素データと前記偶数画素グループの画素データとを交互に読み出すことにより、各画素データを画素配列順に読み出すことを特徴とする画像読取装置。
An image of a document having a plurality of light receiving elements arranged in one direction and moving relative to the plurality of light receiving elements is read line by line by the light receiving elements, and the amount of light received by each light receiving element is determined for each pixel of the image. CIS (Contact Image Sensor) as data,
Storage means for storing image data of each line read by the CIS;
Storage control means for storing image data of each line read by the CIS and output from the CIS in the storage means;
Image reading means for reading image data of each line stored in the storage means;
Processing means capable of executing various processes based on the image data of each line read by the image reading means,
In the image reading apparatus, the storage control unit stores the pixel data in the storage unit so that the output order of the pixel data from the CIS and the address order of the pixel data are the same.
The CIS is a first output type that outputs the pixel data in order of pixel arrangement, or an odd pixel group composed of pixels that are odd-numbered when the pixels are counted from a reference pixel; It is a second output type that separates into even-numbered pixel groups composed of even-numbered pixels counted from the reference pixel, and outputs pixel data in the pixel arrangement order for each of the separated groups.
Type discrimination means for discriminating whether the CIS is the first output type or the second output type;
The storage control means
When the type discriminating means discriminates that the CIS is the first output type, each pixel data is stored in order from the preset first start address of the storage means,
When the CIS is determined to be the second output type by the type determination unit, it is determined whether each pixel data output from the CIS is the odd pixel group or the even pixel group, The pixel data determined to be an odd pixel group is stored in order from the preset second start address of the storage means, and the pixel data determined to be the even pixel group is stored in the preset first data of the storage means. Store in order from the start address of 3,
The image reading means includes
When the CIS is determined to be the first output type by the type determining means, the pixel data is read in order from the first start address, thereby reading each pixel data in the pixel arrangement order.
When the CIS is determined to be the second output type by the type determining means, the pixel data of the odd pixel group and the even pixel group are sequentially from the second start address and the third start address. An image reading apparatus that reads out each pixel data in the order of pixel arrangement by alternately reading out the pixel data of the first and second pixels.
前記CISは、前記受光素子の受光量の分解能が予め定められた複数種類のいずれかであり、
前記分解能が前記複数種類のいずれであるかを入力するための分解能入力手段と、
前記画像読出し手段から前記処理手段に伝送される前記画素データを一時的に記憶する画素記憶手段と、
前記画素記憶手段に前記画素データが格納される毎に該画素記憶手段のポインタをインクリメントするポインタインクリメント手段と、をさらに備え、
前記ポインタインクリメント手段は、前記分解能入力手段により入力される分解能情報を基に、前記ポインタのインクリメントの回数を調整することを特徴とする請求項1に記載の画像読取装置。
The CIS is any one of a plurality of predetermined resolutions of the amount of light received by the light receiving element,
Resolution input means for inputting whether the resolution is the plurality of types;
Pixel storage means for temporarily storing the pixel data transmitted from the image reading means to the processing means;
Pointer increment means for incrementing a pointer of the pixel storage means each time the pixel data is stored in the pixel storage means,
The image reading apparatus according to claim 1, wherein the pointer increment unit adjusts the number of increments of the pointer based on resolution information input by the resolution input unit.
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