JP2012033718A - Semiconductor device and manufacturing method of the same - Google Patents

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嘉則 関
Kazuhisa Okada
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Abstract

PROBLEM TO BE SOLVED: To provide a semiconductor device which has a highly-airtight cavity encapsulating an element region including elements and the like.SOLUTION: The semiconductor device manufacturing method comprises the steps of preparing a semiconductor substrate 10 on which an element region 11 including elements is formed, forming, on the semiconductor substrate 10, a resin layer 13 having a through hole 13A exposing the element region 11, subsequently forming a metallic thin film 14 extending from the resin layer 13 including a side wall 13W of the through hole 13A to cover a part of the semiconductor substrate 10, bonding a support member 15 so as to directly contact the metallic thin film 14, and encapsulating the element region 11 in a cavity 16 surrounded by the semiconductor substrate 10, the resin layer 13, the metallic thin film 14 and the support member 15. In the bonding step, bonded interfaces of the metallic thin film 14 and the support member 15 are bonded by using a surface activated bonding method in a vacuum.

Description

本発明は、半導体装置及びその製造方法に関し、特に、半導体基板に形成された素子を封止した半導体装置及びその製造方法に関する。   The present invention relates to a semiconductor device and a manufacturing method thereof, and more particularly, to a semiconductor device in which an element formed on a semiconductor substrate is sealed and a manufacturing method thereof.

近年、MEMS(Micro Electro Mechanical Systems)や受光素子などの素子が半導体基板上で封止された半導体装置が開発されている。このような半導体装置においては、半導体基板上にMEMSや受光素子が形成された素子領域を囲んで樹脂層が形成される。そして、その樹脂層上に、樹脂からなる接着剤を介してガラス基板が貼り合わされる。即ち、半導体基板上の素子領域は、半導体基板、樹脂層及びガラス基板によって囲まれたキャビティ内に封止される。このような封止構造を有する半導体装置は、特許文献1,2に記載されている。   In recent years, semiconductor devices in which elements such as MEMS (Micro Electro Mechanical Systems) and light receiving elements are sealed on a semiconductor substrate have been developed. In such a semiconductor device, a resin layer is formed on a semiconductor substrate so as to surround an element region where a MEMS or a light receiving element is formed. And a glass substrate is bonded on the resin layer through an adhesive made of resin. That is, the element region on the semiconductor substrate is sealed in a cavity surrounded by the semiconductor substrate, the resin layer, and the glass substrate. A semiconductor device having such a sealing structure is described in Patent Documents 1 and 2.

国際公開第2008/023824号International Publication No. 2008/023824 国際公開第2008/023827号International Publication No. 2008/023827

しかしながら、上述のような従来の半導体装置では、樹脂層の密度の粗さや、樹脂層の表面の凹凸を起因として、樹脂層とガラス基板の間を通って、あるいは樹脂からなる接着剤とガラス基板の間を通って、外部の水分がキャビティ内に浸入するという問題が生じていた。あるいは、外部の水分は、キャビティの側壁となる樹脂層そのものを浸透して浸入する場合もあった。キャビティ内に浸入した水分は、結露となって光の透過に悪影響を与える恐れがあり、素子に対して電気的または機械的な損傷を与える恐れもあった。   However, in the conventional semiconductor device as described above, due to the roughness of the density of the resin layer and the unevenness of the surface of the resin layer, it passes between the resin layer and the glass substrate, or the adhesive and the glass substrate made of resin. As a result, there was a problem that external moisture entered the cavity. Alternatively, external moisture may penetrate and penetrate the resin layer itself that becomes the side wall of the cavity. Moisture that has entered the cavity may cause dew condensation and adversely affect light transmission, and may cause electrical or mechanical damage to the device.

本発明の半導体装置は、上述の課題に鑑みてなされたものであり、半導体基板と、
前記半導体基板の表面に形成された素子を含む素子領域と、前記素子領域を露出する貫通孔を有して前記半導体基板上に配置された樹脂層と、前記樹脂層上及び前記貫通孔内の側壁上に配置された金属薄膜と、前記樹脂層上に形成された金属薄膜と、前記金属薄膜と直接接合された支持体と、を備え、前記半導体基板、前記樹脂層及、前記金属薄膜及び前記支持体によって囲まれてなるキャビティ内に前記素子領域が封止されたことを特徴とする。
The semiconductor device of the present invention has been made in view of the above-described problems, and includes a semiconductor substrate,
An element region including an element formed on a surface of the semiconductor substrate; a resin layer disposed on the semiconductor substrate having a through hole exposing the element region; and on the resin layer and in the through hole A metal thin film disposed on a side wall; a metal thin film formed on the resin layer; and a support directly bonded to the metal thin film, the semiconductor substrate, the resin layer, the metal thin film, and The element region is sealed in a cavity surrounded by the support.

また、本発明の半導体装置の製造方法は、素子を含む素子領域が形成された半導体基板と、支持体を準備し、前記半導体基板上に、前記素子領域を露出する貫通孔を有した樹脂層を形成する工程と、前記樹脂層上及び前記貫通孔内の側壁上に金属薄膜を形成する工程と、真空中で前記金属薄膜及び前記支持体の各表面の汚染物を除去する工程と、真空中で前記樹脂層上の前記金属薄膜と前記支持体とを直接接合する工程と、を備えることを特徴とする。   In addition, a method for manufacturing a semiconductor device according to the present invention provides a semiconductor substrate on which an element region including elements is formed and a support, and a resin layer having a through hole exposing the element region on the semiconductor substrate. Forming a metal thin film on the resin layer and on the side wall in the through hole, removing a contaminant on each surface of the metal thin film and the support in a vacuum, and vacuum A step of directly joining the metal thin film on the resin layer and the support.

本発明によれば、樹脂層上に形成された金属薄膜と支持体とを直接接合し、さらにキャビティの側壁の樹脂層を金属薄膜で覆っているので、キャビティの気密性が高くなり、外部からキャビティへの水分の浸入を防ぐことができる。   According to the present invention, the metal thin film formed on the resin layer and the support are directly joined, and the resin layer on the side wall of the cavity is covered with the metal thin film, so that the airtightness of the cavity is increased, and from the outside It is possible to prevent moisture from entering the cavity.

本発明の実施形態による半導体装置を示す断面図である。It is sectional drawing which shows the semiconductor device by embodiment of this invention. 本発明の実施形態による半導体装置を示す平面図である。It is a top view which shows the semiconductor device by embodiment of this invention. 本発明の実施形態による半導体装置の製造方法を示す断面図である。It is sectional drawing which shows the manufacturing method of the semiconductor device by embodiment of this invention. 本発明の実施形態による半導体装置の製造方法を示す断面図である。It is sectional drawing which shows the manufacturing method of the semiconductor device by embodiment of this invention. 本発明の実施形態による半導体装置の製造方法を示す断面図である。It is sectional drawing which shows the manufacturing method of the semiconductor device by embodiment of this invention. 図5の金属薄膜と支持体の接合を説明する部分拡大図である。It is the elements on larger scale explaining joining of the metal thin film of FIG. 5, and a support body. 本発明の実施形態による半導体装置の製造方法を示す断面図である。It is sectional drawing which shows the manufacturing method of the semiconductor device by embodiment of this invention. 本発明の実施形態による半導体装置の製造方法を示す断面図である。It is sectional drawing which shows the manufacturing method of the semiconductor device by embodiment of this invention. 本発明の実施形態による半導体装置の変形例を示す断面図である。It is sectional drawing which shows the modification of the semiconductor device by embodiment of this invention.

本発明の実施形態による半導体装置の概略構成について、以下に図面を参照して説明する。図1は、完成した半導体装置を示す断面図である。   A schematic configuration of a semiconductor device according to an embodiment of the present invention will be described below with reference to the drawings. FIG. 1 is a cross-sectional view showing a completed semiconductor device.

この半導体装置の半導体基板10の表面には、素子及び配線等を含む素子領域11が配置され、その素子と接続されたパッド電極12が半導体基板10の端部に配置されている。半導体基板10は例えばシリコン基板からなる。素子領域11の素子には、例えば、フォトダイオード、CCDなどの受光素子が含まれるが、これ以外の電気的あるいは機械的デバイス、例えばMEMS等が含まれてもよい。以下では、素子領域11はフォトダイオード、CCDなどの受光素子を含むものとして説明する。   An element region 11 including elements and wirings is disposed on the surface of the semiconductor substrate 10 of the semiconductor device, and a pad electrode 12 connected to the element is disposed at an end of the semiconductor substrate 10. The semiconductor substrate 10 is made of, for example, a silicon substrate. The elements in the element region 11 include, for example, light receiving elements such as photodiodes and CCDs, but may include other electrical or mechanical devices such as MEMS. Hereinafter, the element region 11 will be described as including a light receiving element such as a photodiode or a CCD.

また、半導体基板10の表面には、素子領域11上を露出する貫通孔13Aを有した樹脂層13が配置されている。半導体基板10に対して垂直方向から見ると、樹脂層13は素子領域11の周囲を囲むように配置されている。樹脂層13は、例えばアクリル、ポリイミド、エポキシ樹脂などの有機系樹脂、好ましくは、フォトリソグラフィ工程に用いられる感光性の有機系樹脂からなる。以下では、樹脂層13は感光性のポリイミドであるものとして説明する。   A resin layer 13 having a through hole 13 </ b> A that exposes the element region 11 is disposed on the surface of the semiconductor substrate 10. When viewed from the direction perpendicular to the semiconductor substrate 10, the resin layer 13 is disposed so as to surround the periphery of the element region 11. The resin layer 13 is made of, for example, an organic resin such as acrylic, polyimide, or epoxy resin, preferably a photosensitive organic resin used in a photolithography process. Below, the resin layer 13 is demonstrated as what is photosensitive polyimide.

樹脂層13の上面及び貫通孔13Aの内側の側壁13W上には、アルミニウム、あるいはアルミニウムを含む金属からなる金属薄膜14が配置されている。さらに、金属薄膜14は、素子領域11と重畳しないように、半導体基板10上の一部まで連続して延びていることが好ましい。この金属薄膜14は、上記以外の金属、例えば銅あるいは銅を含む金属からなるものであってもよい。   A metal thin film 14 made of aluminum or a metal containing aluminum is disposed on the upper surface of the resin layer 13 and the side wall 13W inside the through hole 13A. Furthermore, the metal thin film 14 preferably extends continuously to a part on the semiconductor substrate 10 so as not to overlap with the element region 11. The metal thin film 14 may be made of a metal other than the above, for example, copper or a metal containing copper.

さらに、基板状の支持体15が、樹脂層13上の金属薄膜14を介して樹脂層13に貼り合わされている。以下では、支持体15は光を透過するガラス基板であるものとして説明する。   Further, a substrate-like support 15 is bonded to the resin layer 13 via a metal thin film 14 on the resin layer 13. Below, the support body 15 demonstrates as what is a glass substrate which permeate | transmits light.

一方、半導体基板10の裏面と側面には、パッド電極12と接続された配線17が延びており、その配線17上には、保護層18と、保護層18を貫通して配線17と接続するバンプ電極19が配置されている。   On the other hand, a wiring 17 connected to the pad electrode 12 extends on the back surface and side surface of the semiconductor substrate 10. A protective layer 18 is connected to the wiring 17 through the protective layer 18 on the wiring 17. A bump electrode 19 is disposed.

この半導体装置では、半導体基板10、樹脂層13、金属薄膜14、及び支持体15に囲まれたキャビティ16内に、素子等を含む素子領域11が封止されている。ここで、樹脂層13の上面の金属薄膜14と支持体15は直接接合しており、金属薄膜14と支持体15の接合面では、各表面の原子の結合手同士が直接結合している。また、キャビティ16内の側壁13Wとなる樹脂層13は、水分を透過しない金属薄膜14に覆われている。これにより、キャビティ16の気密性は従来例に比して高くなり、外部からの水分の浸入を防ぐことができる。さらに、金属薄膜14が、貫通孔13A内の側壁13Wから連続して半導体基板10の表面の一部上にも延びている場合、より確実にキャビティの気密性を高めることができる。   In this semiconductor device, an element region 11 including elements and the like is sealed in a cavity 16 surrounded by a semiconductor substrate 10, a resin layer 13, a metal thin film 14, and a support 15. Here, the metal thin film 14 on the upper surface of the resin layer 13 and the support 15 are directly bonded, and the bonding hands of the atoms on each surface are directly bonded to each other on the bonding surface of the metal thin film 14 and the support 15. The resin layer 13 that becomes the side wall 13W in the cavity 16 is covered with a metal thin film 14 that does not transmit moisture. Thereby, the airtightness of the cavity 16 becomes higher than that of the conventional example, and it is possible to prevent moisture from entering from the outside. Furthermore, when the metal thin film 14 extends continuously from a side wall 13W in the through-hole 13A to a part of the surface of the semiconductor substrate 10, the airtightness of the cavity can be improved more reliably.

なお、樹脂層13の替わりに、厚い金属層を形成し、半導体基板10、支持体15及び厚い金属層に囲まれたキャビティによる封止構造が考えられる。しかし、この封止構造を実現するためには、キャビティの高さを十分に確保するために、一般的な配線工程に比して極めて厚く金属層を形成する必要があり、製造工程における時間やコストが著しく増大してしまう。   In addition, instead of the resin layer 13, a thick metal layer is formed, and a sealing structure with a cavity surrounded by the semiconductor substrate 10, the support 15 and the thick metal layer is conceivable. However, in order to realize this sealing structure, it is necessary to form a metal layer extremely thicker than a general wiring process in order to secure a sufficient height of the cavity. Cost increases significantly.

仮に厚い金属層を形成しても、その金属層の表面の凹凸を平坦化するCMP等の追加の工程が必要となる。また、厚い金属層の形成工程での加熱処理や、厚い金属層に支持体15を貼り合せる際の厚い金属層に対する加熱処理(例えば400℃)によって、素子領域11の素子や半導体基板10が深刻な損傷を受ける恐れもある。   Even if a thick metal layer is formed, an additional process such as CMP for flattening the irregularities on the surface of the metal layer is required. Further, the element in the element region 11 and the semiconductor substrate 10 are seriously affected by the heat treatment in the formation process of the thick metal layer and the heat treatment (for example, 400 ° C.) on the thick metal layer when the support 15 is bonded to the thick metal layer. There is a risk of serious damage.

以下に、上述した半導体装置の製造方法について、図面を参照して説明する。図2は、この半導体装置の製造方法を示す平面図であり、ウェハ状の半導体基板10の一部を示している。図3−5及び図7−9は、この半導体装置の製造方法を示す断面図あり、1つの半導体装置と、それに隣接する他の半導体装置との境界、即ち図2のA−A線に沿った箇所を示している。図6(A)及び図6(B)は、図5の金属薄膜14と支持体15の接合を説明する部分拡大図である。   Hereinafter, a method for manufacturing the semiconductor device described above will be described with reference to the drawings. FIG. 2 is a plan view showing the method for manufacturing the semiconductor device, and shows a part of the wafer-like semiconductor substrate 10. 3-5 and FIG. 7-9 are cross-sectional views showing the method of manufacturing this semiconductor device, along the boundary between one semiconductor device and another semiconductor device adjacent thereto, that is, along the line AA in FIG. Shows the location. 6 (A) and 6 (B) are partial enlarged views for explaining the joining of the metal thin film 14 and the support 15 of FIG.

最初に、図2及び図3に示すように、例えばシリコン基板からなるウェハ状の半導体基板10を準備する。この半導体基板10の表面には、素子等を含む素子領域11、不図示のシリコン酸化膜等の絶縁膜、その絶縁膜上に形成されたパッド電極12が形成されている。なお、図2ではパッド電極12の図示は省略している。   First, as shown in FIGS. 2 and 3, a wafer-like semiconductor substrate 10 made of, for example, a silicon substrate is prepared. On the surface of the semiconductor substrate 10, an element region 11 including elements, an insulating film (not shown) such as a silicon oxide film, and a pad electrode 12 formed on the insulating film are formed. In addition, illustration of the pad electrode 12 is abbreviate | omitted in FIG.

次に、図3に示すように、半導体基板10の表面を覆って、例えばスピンコート法により感光性の有機系樹脂材料を塗布し、樹脂層13を形成する。スピンコート法によれば樹脂層13を極力平坦に形成することができる。樹脂層13の厚さT1は、キャビティ16の高さHの9割以上であり、例えば5μm〜50μmである(図1参照)。ここで、キャビティ16の高さHとは、互いに対向する半導体基板10の表面と支持体15の表面との距離である。なお、半導体基板10の表面にシリコン酸化膜等の不図示の絶縁膜が形成される場合には、キャビティの高さHは、その絶縁膜の表面と支持体15の表面との距離である。   Next, as shown in FIG. 3, a photosensitive organic resin material is applied by, for example, spin coating to cover the surface of the semiconductor substrate 10, thereby forming a resin layer 13. According to the spin coating method, the resin layer 13 can be formed as flat as possible. The thickness T1 of the resin layer 13 is 90% or more of the height H of the cavity 16, for example, 5 μm to 50 μm (see FIG. 1). Here, the height H of the cavity 16 is the distance between the surface of the semiconductor substrate 10 and the surface of the support 15 that face each other. When an insulating film (not shown) such as a silicon oxide film is formed on the surface of the semiconductor substrate 10, the cavity height H is the distance between the surface of the insulating film and the surface of the support 15.

次に、図4に示すように、不図示のマスクを用いて樹脂層13に対して露光及び現像を行い、素子領域11を露出する貫通孔13Aを樹脂層13に形成する。その後、樹脂層13を覆う金属薄膜14を形成する。金属薄膜14の厚さT2は、樹脂層13の厚さT1の10分の1以下であり、例えば0.2μm〜5μmである。   Next, as shown in FIG. 4, the resin layer 13 is exposed and developed using a mask (not shown) to form a through hole 13 </ b> A that exposes the element region 11 in the resin layer 13. Thereafter, a metal thin film 14 covering the resin layer 13 is formed. The thickness T2 of the metal thin film 14 is 1/10 or less of the thickness T1 of the resin layer 13, and is 0.2 μm to 5 μm, for example.

金属薄膜14は、例えば、スパッタ法により、樹脂層13上と貫通孔13A内の半導体基板10上の全面に形成された後、不図示のマスクを用いた露光及び現像により一部が除去されて、素子領域11を露出するようにパターニングされる。   The metal thin film 14 is formed on the entire surface of the resin layer 13 and the semiconductor substrate 10 in the through hole 13A by, for example, sputtering, and then partially removed by exposure and development using a mask (not shown). Then, patterning is performed so as to expose the element region 11.

即ち、金属薄膜14は、樹脂層13の上面と貫通孔13Aの内側の側壁13Wを覆っている。好ましくは、金属薄膜14は、側壁13Wから連続して半導体基板19の一部上(ただし素子領域11と重畳しない箇所)にも延びて形成される。   That is, the metal thin film 14 covers the upper surface of the resin layer 13 and the side wall 13W inside the through hole 13A. Preferably, the metal thin film 14 is formed so as to continuously extend from the side wall 13 </ b> W onto a part of the semiconductor substrate 19 (however, a portion not overlapping with the element region 11).

次に、図5に示すように、金属薄膜14を介して、樹脂層13と、例えば200μm〜600μmの厚さを有したガラス基板からなる支持体15を貼り合わせる。その際、金属薄膜14と支持体15は、その間に樹脂からなる接着剤等を介在させずに互いに直接接合される。以下に、この直接接合を実現する接合方法として、表面活性化接合法を用いた接合方法について説明する。   Next, as shown in FIG. 5, a resin layer 13 and a support 15 made of a glass substrate having a thickness of, for example, 200 μm to 600 μm are bonded together with a metal thin film 14 interposed therebetween. At that time, the metal thin film 14 and the support 15 are directly bonded to each other without interposing a resin adhesive or the like therebetween. Below, the joining method using the surface activation joining method is demonstrated as a joining method which implement | achieves this direct joining.

大気中では、接合面となる金属薄膜14と支持体15の各表面は、接合の妨げとなる汚染物(水分子や有機物分子)に覆われてしまう。そこで、そのような汚染物を除去した後で、接合面となる金属薄膜14と支持体15の各表面の原子の結合手同士を直接結合させて、両原子の結合を強固なものにする。   In the atmosphere, the surfaces of the metal thin film 14 and the support 15 serving as the bonding surfaces are covered with contaminants (water molecules and organic molecules) that hinder the bonding. Therefore, after removing such contaminants, the bonds between the atoms on the surfaces of the metal thin film 14 serving as the bonding surface and the support 15 are directly bonded to strengthen the bonds between the two atoms.

金属薄膜14と支持体15の各表面の汚染物を除去するには、イオンビームやプラズマなどによるスパッタエッチングが用いられる。スパッタエッチング後の各表面は周囲の気体分子とも反応しやすい状態にあるので、イオンビームにはアルゴンなどの不活性化ガスが用いられる。この汚染物除去工程は、真空状態の真空チャンバー40内で行われる。汚染物の除去後の金属薄膜14と支持体15の各表面では、結合手を持った原子が露出しているため、他の原子との結合力が大きい状態、即ち活性化された状態になる。   In order to remove contaminants on the surfaces of the metal thin film 14 and the support 15, sputter etching using an ion beam or plasma is used. Since each surface after sputter etching is in a state where it easily reacts with surrounding gas molecules, an inert gas such as argon is used for the ion beam. This contaminant removal process is performed in the vacuum chamber 40 in a vacuum state. At each surface of the metal thin film 14 and the support 15 after removal of contaminants, atoms with bonds are exposed, so that the bonding force with other atoms is high, that is, an activated state. .

その後、真空状態の真空チャンバー40内で、活性化された金属薄膜14と支持体15の各表面を互いに直接接するように対向させ、常温から比較的低い加熱温度(例えば約100℃以下)で圧着する。これにより、両者の強固な接合を得ることができる。この場合、真空チャンバー40の真空度は(約10−5Pa)であることが好ましい。 Thereafter, in the vacuum chamber 40 in a vacuum state, the activated metal thin film 14 and the surfaces of the support 15 are opposed to each other so as to be in direct contact with each other, and pressure bonding is performed at a relatively low heating temperature (for example, about 100 ° C. or less). To do. Thereby, both strong joining can be obtained. In this case, the degree of vacuum of the vacuum chamber 40 is preferably (about 10 −5 Pa).

こうして金属薄膜14を介して樹脂層13と支持体15が貼り合されることにより、半導体基板10、樹脂層13、金属薄膜14、及び支持体15に囲まれて素子領域11を封止するキャビティ16が形成される。   In this way, the resin layer 13 and the support 15 are bonded to each other through the metal thin film 14, so that the element region 11 is sealed by being surrounded by the semiconductor substrate 10, the resin layer 13, the metal thin film 14, and the support 15. 16 is formed.

上記工程において、金属薄膜14と支持体15が接合される前では、図6(A)に示すように、金属薄膜14は、樹脂層13の表面の凹凸を反映した凹凸を有している。しかし、図6(B)に示すように、金属薄膜14に支持体15が圧着されると、樹脂層13の弾性と、樹脂層13の厚さT1の10分の1以下という金属薄膜14の薄さゆえに、金属薄膜14は支持体15の表面の平坦性を反映するように変形し、支持体15に密着する。その際、樹脂層13は、金属薄膜14が変形するときの応力を吸収する緩衝層として機能する。なお、図6(A)及び図6(B)において、金属薄膜14に対向する支持体15の表面は、簡略されて極めて平坦に図示されているが、実際には凹凸を有する場合もあり、その場合においても、金属薄膜14は支持体15の表面の凹凸を反映するように変形し、支持体15に密着する。   In the above process, before the metal thin film 14 and the support 15 are joined, the metal thin film 14 has irregularities reflecting the irregularities on the surface of the resin layer 13 as shown in FIG. However, as shown in FIG. 6B, when the support 15 is pressure-bonded to the metal thin film 14, the elasticity of the resin layer 13 and the metal thin film 14 of 1/10 or less of the thickness T <b> 1 of the resin layer 13. Due to the thinness, the metal thin film 14 is deformed so as to reflect the flatness of the surface of the support 15 and is in close contact with the support 15. At that time, the resin layer 13 functions as a buffer layer that absorbs stress when the metal thin film 14 is deformed. In FIGS. 6A and 6B, the surface of the support 15 facing the metal thin film 14 is simplified and extremely flat, but may actually have irregularities. Even in this case, the metal thin film 14 is deformed so as to reflect the unevenness of the surface of the support 15 and is in close contact with the support 15.

このような金属薄膜14の変形と、上述した表面活性化接合法による金属薄膜14と支持体15との強固な直接接合と、水分を透過しない金属薄膜14によってキャビティ16内の側壁13Wが覆われることの相乗効果によって、従来例に比して確実にキャビティ16の気密性を高めることができる。さらに、金属薄膜14が側壁13Wから半導体基板10の表面の一部上に延びて形成される場合、より確実にキャビティの気密性を高めることができる。   The side wall 13W in the cavity 16 is covered with such deformation of the metal thin film 14, strong direct bonding between the metal thin film 14 and the support 15 by the surface activated bonding method described above, and the metal thin film 14 that does not transmit moisture. Due to this synergistic effect, the airtightness of the cavity 16 can be reliably increased as compared with the conventional example. Furthermore, when the metal thin film 14 is formed to extend from the side wall 13W onto a part of the surface of the semiconductor substrate 10, the airtightness of the cavity can be improved more reliably.

さらに、上記工程によれば、キャビティ16の高さHを十分に確保するために厚い金属層を形成する必要がないため、長時間のスパッタ工程など製造工程における時間やコストの増大を回避できる。そして金属層の表面の凹凸を平坦化するCMP等の追加の工程も必要ない。   Furthermore, according to the above process, since it is not necessary to form a thick metal layer in order to ensure a sufficient height H of the cavity 16, it is possible to avoid an increase in time and cost in the manufacturing process such as a long sputtering process. Further, there is no need for an additional step such as CMP for flattening the irregularities on the surface of the metal layer.

また、本実施形態の金属薄膜14の厚さT2は樹脂層13の厚さT1の10分の1以下と薄いため、厚い金属層の形成工程に必要となる長時間の高温な加熱処理を回避できる。また、金属薄膜14は、上述したように常温から比較的低い加熱温度で支持体15に貼り合せることができるため、厚い金属層に支持体15を貼り合せる際に必要となる高温の加熱処理を回避できる。そのため、加熱処理を起因として素子領域11の素子や半導体基板10が深刻な損傷を受けることを回避できる。   Further, since the thickness T2 of the metal thin film 14 of the present embodiment is as thin as 1/10 or less of the thickness T1 of the resin layer 13, it avoids long-time high-temperature heat treatment necessary for the thick metal layer forming process. it can. Moreover, since the metal thin film 14 can be bonded to the support 15 at a relatively low heating temperature from room temperature as described above, the high-temperature heat treatment necessary for bonding the support 15 to a thick metal layer is performed. Can be avoided. Therefore, it is possible to avoid serious damage to the elements in the element region 11 and the semiconductor substrate 10 due to the heat treatment.

その後、図7に示すように、半導体基板10のダイシングラインDLに沿った領域の一部をエッチングして、半導体基板10を貫通してパッド電極12の一部を露出するウィンドウ10Aを形成する。図の例では、ウィンドウ10Aは、例えば半導体基板10の平面方向において部分的に四角形状に開口するものであるが、これ以外にも、ダイシングラインDLに沿ってストリート状に延びるように形成されてもよい。   After that, as shown in FIG. 7, a part of the region along the dicing line DL of the semiconductor substrate 10 is etched to form a window 10 </ b> A that penetrates the semiconductor substrate 10 and exposes a part of the pad electrode 12. In the example shown in the figure, the window 10A is partially opened in a square shape in the planar direction of the semiconductor substrate 10, for example, but is formed so as to extend in a street shape along the dicing line DL. Also good.

次に、半導体基板10の裏面と側面を覆って不図示の絶縁膜を形成する。さらに、その絶縁膜を介して、半導体基板10の裏面から側面に延びると共にパッド電極12と接続するようにパターニングされた配線17を形成する。   Next, an insulating film (not shown) is formed so as to cover the back and side surfaces of the semiconductor substrate 10. Further, a wiring 17 is formed so as to extend from the back surface to the side surface of the semiconductor substrate 10 and to be connected to the pad electrode 12 through the insulating film.

次に、図8に示すように、ダイシングブレード等を用いて、ダイシングラインDLの全体に沿って、ウィンドウ10A内の樹脂層13から支持体15の厚さ方向の途中まで至る切り込みを形成する。その後、ウィンドウ10内を含む半導体基板10の裏面を覆って、ポリイミド等からなる保護膜18を形成する。さらに、半導体基板10の裏面上において、保護膜18の一部に設けられた開口部を通して配線17と接続するバンプ電極19を形成する。   Next, as shown in FIG. 8, using a dicing blade or the like, a cut is formed from the resin layer 13 in the window 10A to the middle of the support 15 in the thickness direction along the entire dicing line DL. Thereafter, a protective film 18 made of polyimide or the like is formed to cover the back surface of the semiconductor substrate 10 including the inside of the window 10. Further, a bump electrode 19 connected to the wiring 17 is formed on the back surface of the semiconductor substrate 10 through an opening provided in a part of the protective film 18.

最後に、ダイシングラインDLに沿ってダイシングを行う。このダイシングでは、パッド電極12の端部を覆う樹脂層13及び保護膜18が残存して、パッド電極12が露出しないように、保護膜19と樹脂層13が切断される。このようにして、半導体基板10等は、図1の半導体装置に個片化される。   Finally, dicing is performed along the dicing line DL. In this dicing, the protective film 19 and the resin layer 13 are cut so that the resin layer 13 and the protective film 18 covering the edge of the pad electrode 12 remain, and the pad electrode 12 is not exposed. In this way, the semiconductor substrate 10 and the like are separated into the semiconductor device of FIG.

なお、本発明は上記実施形態に限定されず、その要旨を逸脱しない範囲で変更が可能なことはいうまでもない。   Needless to say, the present invention is not limited to the above-described embodiment, and modifications can be made without departing from the scope of the invention.

上記実施形態では、支持体15はガラス基板であるものとして説明したが、これ以外にも、例えばシリコン基板やガリウム/ヒ素基板などの半導体基板が支持体15として用いられてもよい。金属薄膜14についても、上述したアルミニウムや銅に限定されず、例えば、金、プラチナ、銀、錫、鉛、または亜鉛を用いることができる。これらの場合においても、金属薄膜14と支持体15の接合に表面活性化接合法を用いることができる。これにより、上記実施形態と同様にキャビティ16の気密性は高くなる。   In the above embodiment, the support 15 has been described as a glass substrate. However, other than this, a semiconductor substrate such as a silicon substrate or a gallium / arsenic substrate may be used as the support 15. The metal thin film 14 is not limited to the above-described aluminum or copper, and for example, gold, platinum, silver, tin, lead, or zinc can be used. Even in these cases, the surface activated bonding method can be used for bonding the metal thin film 14 and the support 15. Thereby, the airtightness of the cavity 16 becomes high like the said embodiment.

また、上記実施形態の変形例として、図9に示すように、半導体基板10にはウィンドウ10Aが形成されず、配線17の替わりに、半導体基板10を貫通してパッド電極12と接続する貫通電極27が形成され、半導体基板10裏面には、その貫通電極27と接続したバンプ電極19が形成されてもよい。   As a modification of the above embodiment, as shown in FIG. 9, a window 10 </ b> A is not formed in the semiconductor substrate 10, and instead of the wiring 17, a through electrode that penetrates the semiconductor substrate 10 and is connected to the pad electrode 12. 27 may be formed, and a bump electrode 19 connected to the through electrode 27 may be formed on the back surface of the semiconductor substrate 10.

10 半導体基板 10A ウィンドウ
11 素子領域
12 パッド電極
13 樹脂層 13W 側壁 13A 貫通孔
14 金属薄膜
15 ガラス基板
16 キャビティ
17 配線
18 保護膜
19 バンプ電極
27 貫通電極
DL ダイシングライン
DESCRIPTION OF SYMBOLS 10 Semiconductor substrate 10A Window 11 Element area | region 12 Pad electrode 13 Resin layer 13W Side wall 13A Through-hole 14 Metal thin film 15 Glass substrate 16 Cavity 17 Wiring 18 Protective film 19 Bump electrode 27 Through-electrode DL Dicing line

Claims (10)

半導体基板と、
前記半導体基板の表面に形成された素子を含む素子領域と、
前記素子領域を露出する貫通孔を有して前記半導体基板上に配置された樹脂層と、
前記樹脂層上及び前記貫通孔内の側壁上に配置された金属薄膜と、
前記樹脂層上の前記金属薄膜と直接接合された支持体と、を備え、
前記半導体基板、前記樹脂層及、前記金属薄膜及び前記支持体によって囲まれてなるキャビティ内に前記素子領域が封止されたことを特徴とする半導体装置。
A semiconductor substrate;
An element region including an element formed on the surface of the semiconductor substrate;
A resin layer disposed on the semiconductor substrate with a through hole exposing the element region;
A metal thin film disposed on the resin layer and on the sidewall in the through hole;
A support directly bonded to the metal thin film on the resin layer,
A semiconductor device, wherein the element region is sealed in a cavity surrounded by the semiconductor substrate, the resin layer, the metal thin film, and the support.
前記金属薄膜は、前記貫通孔内の側壁上から前記半導体基板の一部上に延びて配置されていることを特徴とする請求項1に記載の半導体装置。   The semiconductor device according to claim 1, wherein the metal thin film is disposed so as to extend from a side wall in the through hole onto a part of the semiconductor substrate. 前記金属薄膜の厚さは前記樹脂層の厚さの10分の1以下であることを特徴とする請求項1又は請求項2に記載の半導体装置。   3. The semiconductor device according to claim 1, wherein a thickness of the metal thin film is equal to or less than one-tenth of a thickness of the resin layer. 前記支持体はガラス基板であることを特徴とする請求項1乃至請求項3のいずれかに記載の半導体装置。   The semiconductor device according to claim 1, wherein the support is a glass substrate. 前記金属薄膜はアルミニウム又は銅を含むことを特徴とする請求項1乃至請求項4のいずれかに記載の半導体装置。   The semiconductor device according to claim 1, wherein the metal thin film contains aluminum or copper. 素子を含む素子領域が形成された半導体基板と、支持体を準備し、
前記半導体基板上に、前記素子領域を露出する貫通孔を有した樹脂層を形成する工程と、
前記樹脂層上及び前記貫通孔内の側壁上に金属薄膜を形成する工程と、
真空中で前記金属薄膜及び前記支持体の各表面の汚染物を除去する工程と、
真空中で前記樹脂層上の前記金属薄膜と前記支持体とを直接接合する工程と、を備えることを特徴とする半導体装置の製造方法。
Preparing a semiconductor substrate on which an element region including elements is formed, and a support;
Forming a resin layer having a through hole exposing the element region on the semiconductor substrate;
Forming a metal thin film on the resin layer and on the side wall in the through hole;
Removing contaminants on each surface of the metal thin film and the support in vacuum;
And a step of directly bonding the metal thin film on the resin layer and the support in a vacuum.
前記金属薄膜は、前記貫通孔内の側壁上から前記半導体基板の一部上に延びて形成されることを特徴とする請求項6に記載の半導体装置の製造方法。   The method of manufacturing a semiconductor device according to claim 6, wherein the metal thin film is formed to extend from a side wall in the through hole to a part of the semiconductor substrate. 前記金属薄膜の厚さは前記樹脂層の厚さの10分の1以下であることを特徴とする請求項6又は請求項7に記載の半導体装置の製造方法。   8. The method of manufacturing a semiconductor device according to claim 6, wherein the thickness of the metal thin film is equal to or less than one tenth of the thickness of the resin layer. 前記支持体はガラス基板であることを特徴とする請求項6乃至請求項8のいずれかに記載の半導体装置の製造方法。   The method of manufacturing a semiconductor device according to claim 6, wherein the support is a glass substrate. 前記金属薄膜はアルミニウム又は銅を含むことを特徴とする請求項6乃至請求項9のいずれかに記載の半導体装置の製造方法。   10. The method for manufacturing a semiconductor device according to claim 6, wherein the metal thin film contains aluminum or copper.
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Cited By (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2013026486A (en) * 2011-07-22 2013-02-04 Yamaha Corp Hollow package
WO2014174994A1 (en) * 2013-04-26 2014-10-30 オリンパス株式会社 Image pickup apparatus
JP2014216930A (en) * 2013-04-26 2014-11-17 オリンパス株式会社 Imaging device
JP2014216554A (en) * 2013-04-26 2014-11-17 オリンパス株式会社 Imaging device
CN110386588A (en) * 2018-04-19 2019-10-29 格科微电子(上海)有限公司 A kind of implementation method of metal cantilever girder construction

Cited By (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2013026486A (en) * 2011-07-22 2013-02-04 Yamaha Corp Hollow package
WO2014174994A1 (en) * 2013-04-26 2014-10-30 オリンパス株式会社 Image pickup apparatus
JP2014216930A (en) * 2013-04-26 2014-11-17 オリンパス株式会社 Imaging device
JP2014216554A (en) * 2013-04-26 2014-11-17 オリンパス株式会社 Imaging device
CN105144385A (en) * 2013-04-26 2015-12-09 奥林巴斯株式会社 Image pickup apparatus
US9520428B2 (en) 2013-04-26 2016-12-13 Olympus Corporation Image pickup apparatus
CN105144385B (en) * 2013-04-26 2018-06-29 奥林巴斯株式会社 Photographic device
CN110386588A (en) * 2018-04-19 2019-10-29 格科微电子(上海)有限公司 A kind of implementation method of metal cantilever girder construction
CN110386588B (en) * 2018-04-19 2023-03-24 格科微电子(上海)有限公司 Implementation method of metal cantilever beam structure

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