JP2012018438A - トレースシステム - Google Patents
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Abstract
【解決手段】 本発明は、マルチコアCPUや、複数のCPUを持つ計算機システム上で、ソフトウェアトレーサを使用するトレースシステムにおいて、システムにかかっている負荷をリソース監視機構を用いて監視し、トレース統合制御機構が、負荷情報を元に、CPUコアをトレース専用に、若しくはトレースを取得するのに十分なリソースを確保出来る様、プロセスのCPU割り当てスケジュールを作成した後、システム制御機構を用いてプロセスの割り当てを実行する。その後、トレース統合制御機構がトレーサの実行・停止制御を行う。
【選択図】 図1
Description
図1は、本発明によるトレース収集機能を備える計算機システムの構成図である。複数のコア102、103、1041、105から成るマルチコアCPU101と、システム制御機構114と、トレーサ115と、リソース監視機構116を含み、マルチコアCPU101を含む計算機を制御するOS106と、補助記憶装置109に記録された、後述する各種制御・監視プログラムや、システム上で動作する各種プログラム、後述する各種テーブル等をシステム動作時に展開しておくメモリ107と、メモリ107に対し、データの読み書きの制御を行うメモリコントローラ108と、各種プログラムや、後述する各種テーブル等を保存しておく補助記憶装置109と、補助記憶装置へのデータの読み書きの制御を行うI/Oコントローラ110と、CPU101とメモリ107や補助記憶装置109とのデータの受け渡しに使用するシステムバス111と、CPU101の各コア102,103,104,105の、各コアの負荷(使用率)や、バス111等の負荷情報を、後述するトレース統合制御機構115からの制御により収集し、記録するリソース監視機構112と、本システムの制御対象であり、システムの情報を収集するためのトレーサ113と、トレーサによる悪影響を軽減するために、リソース監視機構が収集した負荷情報を元に、プログラム(プロセス)の動作するCPUの割り当て変更スケジューリングを実施するシステム制御機構114と、リソース監視機構112,トレーサ113,システム制御機構114の統合的な制御を実施するトレース統合制御機構115からなる。
102、103、104、105…コア
106…OS
107…メモリ
108…メモリコントローラ
109…補助記憶装置
110…I/Oコントローラ
111…システムバス
112…リソース監視機構
113…トレーサ
114…システム制御機構
115…トレース統合制御機構
116…リソース監視機構
Claims (6)
- マルチコアCPUを持つシステム、マルチCPUで実現される計算機システム上で、ソフトウェアトレーサを用いてトレースを実施するトレースシステムにおいて、上記システムのリソースを監視するリソース監視機構と、上記コア間、上記CPU間を跨いでプロセスの実行場所を制御するシステム制御機構と、上記リソース監視機構が取得した情報を元に、アプリケーションの負荷が無いコアを作るためのプロセススケジューリングを実施し、そのスケジュールの実行制御と、トレーサの実行制御をするトレース統合制御機構を持つことを特徴とするトレースシステム。
- 請求項1記載のトレースシステムにおいて、動作中の上記プロセススケジューリングを実施するに際し、CPU負荷を平均的に割り当てるようスケジューリングすることを特徴とするトレースシステム。
- 請求項1記載のトレースシステムにおいて、平均処理負荷と、最大負荷を用い、上記最大負荷と平均処理負荷の差がユーザが定義した値より小さい物をトレーサと同時に動作させることを特徴とするトレースシステム。
- 請求項1記載のトレースシステムにおいて、上記リソース監視機構、上記システム制御機構、上記トレース統合制御機構が、OSに組み込まれることを特徴とするトレースシステム。
- 請求項1記載のトレースシステムにおいて、上記リソース監視機構、上記システム制御機構、上記トレース統合制御機構が、OSに組み込まれないことを特徴とするトレースシステム。
- 請求項1記載のトレースシステムにおいて、上記リソース監視機構、上記システム制御機構がハードウェアによって実現され、上記トレーサと上記トレース統合制御機構が、ソフトウェアで実現されることを特徴とするトレースシステム。
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