JP2010139314A - Semiconductor stress sensor - Google Patents

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Makoto Morii
誠 森井
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Abstract

<P>PROBLEM TO BE SOLVED: To provide a semiconductor stress sensor having a small structure and capable of simultaneously detecting a plurality of stresses. <P>SOLUTION: The semiconductor stress sensor is formed by stacking a first stress detection wafer part 1 detecting a pressure, a second stress detection wafer part 2 detecting acceleration, and a through-wiring wafer part 3 in a vertical direction. Lead-out wiring 24a outputting an electric signal according to the pressure detected by the first stress detection wafer part 1 to the outside of the sensor is formed at the second stress detection wafer part 2. Lead-out wiring 24b connected to the lead-out wiring 24a and outputting an electric signal corresponding to the pressure detected by the first stress detection wafer part 1 to the outside of the sensor and lead out wiring 31 outputting an electric signal corresponding to the acceleration detected by the second stress detection wafer part 2 to the outside of the sensor are formed at the through-wiring wafer part 3. <P>COPYRIGHT: (C)2010,JPO&INPIT

Description

本発明は、1つのセンサで複数の物理量(応力)を検知する半導体応力センサに関する。   The present invention relates to a semiconductor stress sensor that detects a plurality of physical quantities (stresses) with one sensor.

従来、圧力や加速度等の応力を検出するセンサの技術としては、例えば以下に示す文献に記載されたものが知られている(特許文献1参照)。この文献には、ベース板とカバー板との間に接合一体化されて、互いに直角なX,Y,Z3方向の加速度を同時に検出する3軸加速度センサが形成された発明が記載されている。
特開平7−273353号公報
Conventionally, as a sensor technology for detecting stress such as pressure and acceleration, for example, those described in the following documents are known (see Patent Document 1). This document describes an invention in which a triaxial acceleration sensor is formed which is joined and integrated between a base plate and a cover plate to simultaneously detect accelerations in the X, Y, and Z3 directions perpendicular to each other.
JP-A-7-273353

上記従来の応力センサでは、加速度などの1種類の応力しか検知できなかった。このため、加速度や圧力といった複数の応力の検知が要求される、例えば携帯電話やデジタルカメラをはじめとした携帯情報機器などの多機能化された機器に使用する場合には、加速度を検知する加速度センサ部と圧力を検知する圧力センサ部とを半導体の基台に対して横方向に並べて配置して応力センサを形成する必要があった。   The conventional stress sensor can detect only one type of stress such as acceleration. For this reason, when used for multifunctional devices such as mobile information devices such as mobile phones and digital cameras that require detection of multiple stresses such as acceleration and pressure, the acceleration for detecting the acceleration It was necessary to form the stress sensor by arranging the sensor part and the pressure sensor part for detecting pressure side by side with respect to the semiconductor base.

このような構造体では、センサを小型化して他の半導体装置と複合集積化するには限界が生じ、携帯機器等の小型機器に搭載する際の障害になっていた。   In such a structure, there has been a limit to downsizing the sensor and integrating it with other semiconductor devices, which has been an obstacle when mounted on a small device such as a portable device.

そこで、本発明は上記に鑑みてなされたものであり、その目的とするところは、小型な構成であって複数の異なる応力を検知することが可能な半導体応力センサを提供することにある。   The present invention has been made in view of the above, and an object of the present invention is to provide a semiconductor stress sensor having a small configuration and capable of detecting a plurality of different stresses.

上記目的を達成するために、本発明に係る半導体応力センサは、第1の応力を検知する第1の応力検知ウェハ部と、第2の応力を検知する第2の応力検知ウェハ部と、前記第1の応力検知ウェハ部で検知された検知信号を出力する第1の引き出し配線と、前記第2の応力検知ウェハ部で検知された検知信号を出力する第2の引き出し配線が形成された配線ウェハ部とを有し、前記第1の応力検知ウェハ部、前記第2の応力検知ウェハ部ならびに前記配線ウェハ部が積層配置されてなることを第1の特徴とする。   In order to achieve the above object, a semiconductor stress sensor according to the present invention includes a first stress detection wafer unit that detects a first stress, a second stress detection wafer unit that detects a second stress, A wiring formed with a first lead-out wiring that outputs a detection signal detected by the first stress detection wafer unit and a second lead-out wiring that outputs a detection signal detected by the second stress detection wafer unit A first feature is that the first stress detection wafer portion, the second stress detection wafer portion, and the wiring wafer portion are stacked and arranged.

また、本発明に係る半導体応力センサは、第1の応力を検知する第1の応力検知ウェハ部と、第2の応力を検知し、第1の応力を検知する検知部の変位を抑制する抑制部が上部に積層配置され、前記第1の応力検知ウェハ部で検知された検知信号を出力する引き出し配線が形成された第2の応力検知ウェハ部とを有し、前記第1の応力検知ウェハと前記第2の応力検知ウェハ部とが積層配置されてなることを第2の特徴とする。   Moreover, the semiconductor stress sensor according to the present invention suppresses the displacement of the first stress detection wafer unit that detects the first stress and the detection unit that detects the second stress and detects the first stress. And a second stress detection wafer portion on which lead-out wiring for outputting a detection signal detected by the first stress detection wafer portion is formed, and the first stress detection wafer A second feature is that the second stress detection wafer portion is laminated.

本発明に係る半導体応力センサは、上記第1の特徴または第2の特徴の半導体応力センサにおいて、前記第1の応力検知ウェハ部は、第1の応力として加速度または圧力を検知し、前記第2の応力検知ウェハ部は、第2の応力として圧力または加速度を検知することを第3の特徴とする。   The semiconductor stress sensor according to the present invention is the semiconductor stress sensor according to the first feature or the second feature, wherein the first stress detection wafer unit detects acceleration or pressure as the first stress, and the second stress is detected. The third feature of the stress detection wafer portion is to detect pressure or acceleration as the second stress.

本発明に係る第1の特徴の半導体応力センサは、異なる応力を検知する複数のセンサを縦方向に積層配置して構成することで、センサを小型化することが可能となる。   The semiconductor stress sensor having the first feature according to the present invention can be downsized by arranging a plurality of sensors for detecting different stresses in a stacked manner in the vertical direction.

本発明に係る第2の特徴の半導体応力センサでは、第1の応力検知ウェハ部に抑制部を配置形成することで、抑制部により第1の応力を検知する検知部の変位を抑制することが可能となる。   In the semiconductor stress sensor of the second feature according to the present invention, the suppression unit is arranged and formed on the first stress detection wafer unit, thereby suppressing the displacement of the detection unit that detects the first stress by the suppression unit. It becomes possible.

本発明に係る第3の特徴の半導体応力センサでは、加速度と圧力の異なる応力を検知するセンサを小型化することが可能となる。   In the semiconductor stress sensor of the third feature according to the present invention, it is possible to reduce the size of the sensor that detects stresses having different acceleration and pressure.

以下、図面を用いて本発明を実施するための最良の実施例を説明する。   DESCRIPTION OF THE PREFERRED EMBODIMENTS The best embodiment for carrying out the present invention will be described below with reference to the drawings.

図1は本発明の実施例1に係る半導体応力センサの構成を示す断面図であり、図2は正面図である。図1ならびに図2に示す実施例1の半導体応力センサは、第1の応力を検知する第1の応力検知ウェハ部1と、第2の応力を検知する第2の応力検知ウェハ部2と、貫通配線ウェハ部3とを備え、第2の応力検知ウェハ部2を挟んで第1の応力検知ウェハ部1と貫通配線ウェハ部3が積層配置されて形成されている。   1 is a cross-sectional view showing a configuration of a semiconductor stress sensor according to Embodiment 1 of the present invention, and FIG. 2 is a front view thereof. The semiconductor stress sensor of Example 1 shown in FIG. 1 and FIG. 2 includes a first stress detection wafer unit 1 that detects a first stress, a second stress detection wafer unit 2 that detects a second stress, A through-wiring wafer portion 3 is provided, and the first stress detection wafer portion 1 and the through-wiring wafer portion 3 are laminated and formed with the second stress detection wafer portion 2 interposed therebetween.

第1の応力検知ウェハ部1は、第1の応力として圧力を検知する圧力センサの機能を有し、図3はその正面図である。第1の応力検知ウェハ部1は、矩形状のフレーム部11の中央が薄膜化されて受圧部となるダイヤフラム部12が形成されている。第1の応力検知ウェハ部1の下面(第2の応力検知ウェハ部2に接合されていない面)側から圧力を受けると、この圧力の物理量に応じてダイヤフラム部12が上下方向に変位し、この変位を例えばダイヤフラム部12の上面(第2の応力検知ウェハ部2が接合されている側の面)に形成されたピエゾ抵抗(図示せず)の抵抗値の変化量として検知し、この抵抗値の変化量を電気信号としてセンサ外部に取り出すことで、第1の応力検知ウェハ部1に印加された圧力を検知する。   The first stress detection wafer unit 1 has a function of a pressure sensor that detects pressure as the first stress, and FIG. 3 is a front view thereof. The first stress detection wafer portion 1 is formed with a diaphragm portion 12 that becomes a pressure receiving portion by thinning the center of a rectangular frame portion 11. When pressure is received from the lower surface (surface not joined to the second stress detection wafer part 2) side of the first stress detection wafer part 1, the diaphragm part 12 is displaced in the vertical direction according to the physical quantity of this pressure, This displacement is detected as, for example, the amount of change in the resistance value of a piezoresistor (not shown) formed on the upper surface of the diaphragm portion 12 (the surface on the side where the second stress detection wafer portion 2 is bonded). The pressure applied to the first stress detection wafer unit 1 is detected by taking out the amount of change in value as an electrical signal outside the sensor.

第1の応力検知ウェハ部1は、第2の応力検知ウェハ部2が接合される側のフレーム部11の表面に電気信号を外部に取り出す電極パッド部13が配置形成されている、
第2の応力検知ウェハ部2は、第2の応力として加速度を検知する加速度センサの機能を有し、図4はその正面図である。第2の応力検知ウェハ部2は、矩形状のフレーム部21の中央に、十字状に配置された4つのビーム部(センサ部)22に接合されて支持された錘部23が配置形成されている。この錘部23は、第2の応力検知ウェハ部2に加速度が印加されると印加された加速度の物理量に応じて変位し、その変位はビーム部22に伝達されてビーム部22が歪み、この歪みを例えばビーム部22の表面に形成されたピエゾ抵抗(図示せず)の抵抗値の変化量として検知し、この抵抗値の変化量を電気信号としてセンサ外部に取り出すことで、第2の応力検知ウェハ部2に印加された加速度を検知する。
In the first stress detection wafer unit 1, an electrode pad unit 13 for taking out an electric signal to the outside is disposed on the surface of the frame unit 11 on the side to which the second stress detection wafer unit 2 is bonded.
The second stress detection wafer unit 2 has a function of an acceleration sensor that detects acceleration as the second stress, and FIG. 4 is a front view thereof. The second stress detection wafer unit 2 includes a weight unit 23 that is bonded to and supported by four beam units (sensor units) 22 arranged in a cross shape at the center of a rectangular frame unit 21. Yes. When an acceleration is applied to the second stress detection wafer unit 2, the weight unit 23 is displaced according to a physical quantity of the applied acceleration, and the displacement is transmitted to the beam unit 22 to distort the beam unit 22. For example, the strain is detected as a change amount of a resistance value of a piezoresistor (not shown) formed on the surface of the beam portion 22, and the change amount of the resistance value is taken out as an electric signal to the outside of the sensor. The acceleration applied to the detection wafer unit 2 is detected.

第2の応力検知ウェハ部2は、そのビーム部22が第2の応力検知ウェハ部2のフレーム部11に接合されて第1の応力検知ウェハ部1に積層配置されている。   The second stress detection wafer unit 2 has a beam unit 22 bonded to the frame unit 11 of the second stress detection wafer unit 2 and is stacked on the first stress detection wafer unit 1.

第2の応力検知ウェハ部2は、その周辺部にフレーム部21ならびにビーム部22を貫通する引き出し配線24aが形成されている。この引き出し配線24aの一方端は、第1の応力検知ウェハ部1の電極パッド部13に電気的に接合され、他方端は第2の応力検知ウェハ部2におけるフレーム部21の表面(貫通配線ウェハ部3が接合される側の面)に配置形成された電極パッド部25に電気的に接合され、第1の応力検知ウェハ部1で得られた電気信号をセンサ外部に出力する配線の一部を構成する。   The second stress detection wafer portion 2 is formed with a lead-out wiring 24 a penetrating the frame portion 21 and the beam portion 22 in the peripheral portion thereof. One end of the lead wire 24a is electrically joined to the electrode pad portion 13 of the first stress detection wafer portion 1, and the other end is the surface of the frame portion 21 in the second stress detection wafer portion 2 (through wiring wafer). Part of the wiring that is electrically bonded to the electrode pad portion 25 disposed and formed on the surface to which the portion 3 is bonded and outputs the electrical signal obtained by the first stress detection wafer portion 1 to the outside of the sensor Configure.

貫通配線ウェハ部3は、第2の応力検知ウェハ部2のフレーム部21に接合されて第2の応力検知ウェハ部2に積層配置されて形成され、引き出し配線31、ならびに先の引き出し配線24aに接続される引き出し配線24bがウェハを貫通して形成されている。   The through wiring wafer portion 3 is formed by being joined to the frame portion 21 of the second stress detection wafer portion 2 and stacked on the second stress detection wafer portion 2, and is formed on the lead wiring 31 and the previous lead wiring 24a. A lead wire 24b to be connected is formed through the wafer.

引き出し配線31は、その一方端が貫通配線ウェハ部3の表面に形成された対応する電極パッド部32に電気的に接合され、他方端が第2の応力検知ウェハ部2の表面に配置形成された対応する電極パッド部26に電気的に接合され、第2の応力検知ウェハ部2で得られた先の電気信号をセンサ外部に出力する。   One end of the lead-out wiring 31 is electrically bonded to a corresponding electrode pad portion 32 formed on the surface of the through wiring wafer portion 3, and the other end is disposed and formed on the surface of the second stress detection wafer portion 2. In addition, it is electrically bonded to the corresponding electrode pad portion 26, and the previous electrical signal obtained by the second stress detection wafer portion 2 is output to the outside of the sensor.

引き出し配線24bは、その一方端が貫通配線ウェハ部3の表面に形成された対応する電極パッド部33に電気的に接合され、他方端が第2の応力検知ウェハ部2に形成された電極パッド部25に接合され、これにより第2の応力検知ウェハ部2に形成された引き出し配線24aと電気的に接続され、第1の応力検知ウェハ部1で得られた先の電気信号をセンサ外部に出力する。   The lead wire 24b is electrically bonded to a corresponding electrode pad portion 33 formed on the surface of the through wiring wafer portion 3 at one end, and an electrode pad formed at the second stress detection wafer portion 2 at the other end. Is connected to the lead wire 24a formed on the second stress detection wafer portion 2, and the previous electrical signal obtained by the first stress detection wafer portion 1 is connected to the outside of the sensor. Output.

このような積層構造は、各ウェハ部を構成する半導体の例えばシリコンウェハ同士を直接接合する従来から知られたウェハ直接接合技術を用いて各ウエハが接合されて形成される。その際に、各ウェハ部の各電極パッド部は、位置合わせされた後電極パッド部を構成する金属の例えば金(Au)同士を直接接合する金属接合技術を用いて接合される。各ウェハが接合された後、ウェハをダイシングして個々の半導体応力センサにチップ化される。   Such a laminated structure is formed by bonding the respective wafers using a conventionally known wafer direct bonding technique for directly bonding, for example, silicon wafers of semiconductors constituting each wafer portion. In that case, each electrode pad part of each wafer part is joined using the metal joining technique which joins the metal which comprises the electrode pad part after alignment, for example, gold | metal | money (Au) directly. After the wafers are bonded, the wafers are diced into individual semiconductor stress sensors.

このような積層構造は、ウェハ状態のままで配線や電極の形成と樹脂封止を行なうことを可能にしたWLP(ウェハー・レベル・パッケージ)の実装技術を用いることで、容易に製造することが可能である。   Such a laminated structure can be easily manufactured by using a WLP (wafer level package) mounting technique that enables formation of wiring and electrodes and resin sealing in the wafer state. Is possible.

このように、加速度センサと圧力センサとの、検知する物理量(応力)が異なる2つの応力センサを、ウェハ面に対して縦方向に積層配置して一体化することで、従来のように半導体ウェハ上に2つのセンサを横方向に並列配置する場合に比べて、センサの面積を格段に縮小することが可能となる。また、縦方向の厚みは、各センサ自体が薄膜化されているので、並列配置する構成に比べて、さほど厚くはならない。これにより、複数の物理量を検知する半導体応力センサを従来に比べて小型化することが可能となり、携帯機器等の小型機器の実装に好適なセンサを提供することができる。また、1枚のウェハ上に2つのセンサを積層配置することで、並列配置する場合に比べて集積度を高められることが可能となる。   In this way, by integrating two stress sensors, which are different in physical quantity (stress) to be detected, of the acceleration sensor and the pressure sensor by stacking and integrating in the vertical direction with respect to the wafer surface, a semiconductor wafer as in the conventional case Compared to the case where two sensors are arranged in parallel in the horizontal direction, the sensor area can be greatly reduced. Further, since the thickness of each sensor itself is reduced, the thickness in the vertical direction is not so thick as compared with the configuration in which the sensors are arranged in parallel. As a result, the semiconductor stress sensor that detects a plurality of physical quantities can be reduced in size compared to the conventional one, and a sensor suitable for mounting a small device such as a portable device can be provided. Further, by stacking and arranging two sensors on a single wafer, it is possible to increase the degree of integration as compared to the case of arranging them in parallel.

なお、この実施例1では、第1の応力検知ウェハ部1を圧力センサとし、第2の応力検知ウェハ部2を加速度センサとしているが、第1の応力検知ウェハ部1を加速度センサとし、第2の応力検知ウェハ部2を圧力センサとして構成してもよい。すなわち、図1において、第1の応力検知ウェハ部1と第2の応力検知ウェハ部2との上下積層位置を入れ替えて、図1に示す構造の圧力センサとして機能する第1の応力検知ウェハ部1を挟んで図1に示す構造の加速度センサとして機能する第2の応力検知ウェハ部2と貫通配線ウェハ部3とを積層配置する。   In the first embodiment, the first stress detection wafer unit 1 is a pressure sensor and the second stress detection wafer unit 2 is an acceleration sensor. However, the first stress detection wafer unit 1 is an acceleration sensor. The two stress detection wafer portions 2 may be configured as a pressure sensor. That is, in FIG. 1, the first stress detection wafer unit functioning as a pressure sensor having the structure shown in FIG. 1 by exchanging the upper and lower lamination positions of the first stress detection wafer unit 1 and the second stress detection wafer unit 2. A second stress detection wafer portion 2 and a through wiring wafer portion 3 that function as an acceleration sensor having the structure shown in FIG.

このような構成においても、同様の効果を得ることが可能になると共に、第1の応力検知ウェハ部1を構成する圧力センサのダイヤフラム部12で第2の応力検知ウェハ部2を構成する加速度センサの錘部23の変動を抑制することが可能となる。さらに、第1の応力検知ウェハ部1を構成する圧力センサのフレーム部11に第2の応力検知ウェハ部2を構成する加速度センサのビーム部22が接合されるので、圧力センサのダイヤフラム部12の下部を気密状態にすることが可能となり、圧力センサは絶対圧の変化を検知することが可能となる。   Even in such a configuration, the same effect can be obtained, and the acceleration sensor that configures the second stress detection wafer unit 2 with the diaphragm unit 12 of the pressure sensor that configures the first stress detection wafer unit 1. It is possible to suppress the fluctuation of the weight portion 23. Further, since the beam part 22 of the acceleration sensor constituting the second stress detection wafer part 2 is joined to the frame part 11 of the pressure sensor constituting the first stress detection wafer part 1, the diaphragm part 12 of the pressure sensor The lower part can be made airtight, and the pressure sensor can detect a change in absolute pressure.

図5は本発明の実施例2に係る半導体応力センサの構成を示す断面図であり、図6は正面図である。図1ならびに図2に示す実施例2の特徴とするところは、先の図1に示す実施例1の構成に比べて、図1に示す貫通配線ウェハ部3に代えて、ストップガラス41をダイボンド法により形成されるダイボンド部42を介して第2の応力検知ウェハ部2に接合して配置したことにある。   FIG. 5 is a sectional view showing a configuration of a semiconductor stress sensor according to the second embodiment of the present invention, and FIG. 6 is a front view. A feature of the second embodiment shown in FIGS. 1 and 2 is that the stop glass 41 is die-bonded in place of the through wiring wafer portion 3 shown in FIG. 1 as compared with the configuration of the first embodiment shown in FIG. In other words, the second stress detection wafer portion 2 is bonded and disposed via a die bond portion 42 formed by a method.

なお、第1の応力検知ウェハ部1の圧力センサで得られた電気信号は、実施例1と同様に第2の応力検知ウェハ部2を貫通して形成された引き出し配線24aによりセンサ外部に出力され、第2の応力検知ウェハ部2の加速度センサで得られた電気信号は、図示されていないが第2の応力検知ウェハ部2の表面に形成された電極パッド部からセンサ外部に出力される。   The electrical signal obtained by the pressure sensor of the first stress detection wafer unit 1 is output to the outside of the sensor by the lead-out wiring 24a formed through the second stress detection wafer unit 2 as in the first embodiment. The electric signal obtained by the acceleration sensor of the second stress detection wafer unit 2 is output to the outside of the sensor from an electrode pad unit formed on the surface of the second stress detection wafer unit 2 although not shown. .

このような構成においては、先の実施例1と同様の効果を得ることが可能になると共に、ストップガラス41は第2の応力検知ウェハ部2が加速度を検知する錘部23の上方向の変位を抑制する抑制部材として機能し、このストップガラス41により第2の応力検知ウェハ部2の錘部23の上側(ストップガラス41側)方向の変位を抑制することが可能となる。   In such a configuration, it is possible to obtain the same effect as in the first embodiment, and the stop glass 41 is displaced upward in the weight portion 23 where the second stress detection wafer portion 2 detects acceleration. This stop glass 41 can suppress displacement of the second stress detection wafer portion 2 in the upper side (stop glass 41 side) direction of the weight portion 23.

本発明の実施例1に係る半導体応力センサの構成を示す断面図である。It is sectional drawing which shows the structure of the semiconductor stress sensor which concerns on Example 1 of this invention. 本発明の実施例1に係る半導体応力センサの構成を示す正面図である。It is a front view which shows the structure of the semiconductor stress sensor which concerns on Example 1 of this invention. 本発明の実施例1に係る半導体応力センサにおける第1の応力検知ウェハ部1の構成を示す正面図である。It is a front view which shows the structure of the 1st stress detection wafer part 1 in the semiconductor stress sensor which concerns on Example 1 of this invention. 本発明の実施例1に係る半導体応力センサにおける第2の応力検知ウェハ部2の構成を示す正面図である。It is a front view which shows the structure of the 2nd stress detection wafer part 2 in the semiconductor stress sensor which concerns on Example 1 of this invention. 本発明の実施例2に係る半導体応力センサの構成を示す断面図である。It is sectional drawing which shows the structure of the semiconductor stress sensor which concerns on Example 2 of this invention. 本発明の実施例2に係る半導体応力センサの構成を示す正面図である。It is a front view which shows the structure of the semiconductor stress sensor which concerns on Example 2 of this invention.

符号の説明Explanation of symbols

1…第1の応力検知ウェハ部
2…第2の応力検知ウェハ部
3…貫通配線ウェハ部
11,21…フレーム部
12…ダイヤフラム部
13,25,26,32,33…電極パッド部
22…ビーム部
23…錘部
24a、24b,31…引き出し配線
41…ストップガラス
42…ダイボンド部
DESCRIPTION OF SYMBOLS 1 ... 1st stress detection wafer part 2 ... 2nd stress detection wafer part 3 ... Through-wiring wafer part 11, 21 ... Frame part 12 ... Diaphragm part 13, 25, 26, 32, 33 ... Electrode pad part 22 ... Beam Part 23: Weight part 24a, 24b, 31 ... Lead-out wiring 41 ... Stop glass 42 ... Die bond part

Claims (3)

第1の応力を検知する第1の応力検知ウェハ部と、
第2の応力を検知する第2の応力検知ウェハ部と、
前記第1の応力検知ウェハ部で検知された検知信号を出力する第1の引き出し配線と、前記第2の応力検知ウェハ部で検知された検知信号を出力する第2の引き出し配線が形成された配線ウェハ部とを有し、
前記第1の応力検知ウェハ部、前記第2の応力検知ウェハ部ならびに前記配線ウェハ部が積層配置されてなる
ことを特徴とする半導体応力センサ。
A first stress detection wafer portion for detecting a first stress;
A second stress detection wafer portion for detecting a second stress;
A first lead-out wiring that outputs a detection signal detected by the first stress detection wafer portion and a second lead-out wiring that outputs a detection signal detected by the second stress detection wafer portion are formed. A wiring wafer portion,
A semiconductor stress sensor, wherein the first stress detection wafer portion, the second stress detection wafer portion, and the wiring wafer portion are stacked.
第1の応力を検知する第1の応力検知ウェハ部と、
第2の応力を検知し、第2の応力を検知する検知部の変位を抑制する抑制部が上部に積層配置され、前記第1の応力検知ウェハ部で検知された検知信号を出力する引き出し配線が形成された第2の応力検知ウェハ部とを有し、
前記第1の応力検知ウェハ部と前記第2の応力検知ウェハ部とが積層配置されてなる
ことを特徴とする半導体応力センサ。
A first stress detection wafer portion for detecting a first stress;
A lead-out wiring that detects the second stress and suppresses the displacement of the detection unit that detects the second stress is stacked on the upper part and outputs a detection signal detected by the first stress detection wafer unit And a second stress detection wafer part formed with
A semiconductor stress sensor, wherein the first stress detection wafer part and the second stress detection wafer part are stacked.
前記第1の応力検知ウェハ部は、第1の応力として加速度または圧力を検知し、
前記第2の応力検知ウェハ部は、第2の応力として圧力または加速度を検知する
ことを特徴とする請求項1または2に記載の半導体応力センサ。
The first stress detection wafer unit detects acceleration or pressure as the first stress,
The semiconductor stress sensor according to claim 1, wherein the second stress detection wafer unit detects pressure or acceleration as the second stress.
JP2008314537A 2008-12-10 2008-12-10 Semiconductor stress sensor Pending JP2010139314A (en)

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* Cited by examiner, † Cited by third party
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JP2012154803A (en) * 2011-01-26 2012-08-16 Denso Corp Angular velocity sensor device

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