JP2010080870A - 再構成可能集積回路 - Google Patents
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Abstract
【解決手段】スイッチマトリックス、機能ブロック、およびルーティング配線を有する回路ブロックの基本タイルを基板上にアレイ状に配置した構造の再構成可能集積回路は、機能ブロックは少なくとも再構成可能なロジック回路および入出力回路の両方を有しており、ロジック機能を利用する基本タイルの割合と入出力機能を利用する基本タイルの割合とを用途に合わせて所定の割合で構成し、前記ロジック回路または入出力回路のいずれかを使用して前記基本タイルをロジック機能または入出力機能のいずれかで使用する。
【選択図】図2
Description
102 第2の基本タイル
103 再構成可能集積回路
202 横方向ルーティング配線
203 縦方向ルーティング配線
204 スイッチマトリックス
205 機能ブロック
206 第1のロジック回路
207 第2のロジック回路
208 入出力回路
209−212 インターナル配線
301−303 マルチプレクサ回路
304−306 記憶回路
307 インターナル配線
308 入出力配線
401−402 マルチプレクサ回路
403−404 記憶回路
405−406 インターナル配線
601−608 第1の基本タイル
609−610 第2の基本タイル
611−612 再構成可能集積回路
613−616 導電体
Claims (4)
- スイッチマトリックス、機能ブロック、およびルーティング配線を有する回路ブロックの基本タイルをアレイ状に配置した構造の再構成可能集積回路であって、
前記機能ブロックは少なくとも再構成可能なロジック回路および入出力回路の両方を有しており、
ロジック機能を利用する基本タイルの割合と入出力機能を利用する基本タイルの割合とを用途に合わせて所定の割合で構成し、前記ロジック回路または入出力回路のいずれかまたは両回路を使用して前記基本タイルをロジック機能または入出力機能のいずれかまたは両機能で使用する
ことを特徴とした再構成可能集積回路。 - 請求項1に記載の再構成可能集積回路において、
前記機能ブロックは、基本タイルへ入力される信号または基本タイルから出力される信号を、ロジック回路および入出力回路、入出力回路のみ、または、ロジック回路のみに対して選択的に伝搬する伝搬経路と、前記伝搬経路の経路を設定する回路構成情報を記憶する記憶素子とを有する
ことを特徴とした再構成可能集積回路。 - 請求項1に記載の再構成可能集積回路において、
前記基本タイルが再構成可能集積回路のアレイの任意の場所に配置され、
前記アレイの任意の場所に配置された基本タイルの入出力回路が、集積回路パッケージの入出力ピンと電気的に接続される、
ことを特徴とした再構成可能集積回路。 - 請求項1に記載の再構成可能集積回路において、
前記基本タイルが再構成可能集積回路のアレイの任意の場所に配置された再構成可能集積回路のシリコンダイの複数個を積層し、
積層したシリコンダイ上の基本タイルの入出力回路が電気的に他のシリコンダイ上の基本タイルの入出力回路と接続され、
積層したシリコンダイ上の基本タイルの入出力回路が集積回路パッケージの入出力ピンと電気的に接続される、
ことを特徴とした再構成可能集積回路。
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Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
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JP5365637B2 (ja) * | 2008-09-16 | 2013-12-11 | 日本電気株式会社 | 半導体プログラマブルデバイスおよびその制御方法 |
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2008
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