JP2009021280A - Multilayer capacitor - Google Patents
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Abstract
Description
本発明は、デカップリングの用途に適した積層コンデンサに関する。 The present invention relates to a multilayer capacitor suitable for decoupling applications.
デカップリングに用いられる積層コンデンサには高静電容量と低ESL(等価直列インダクタンス)が求められており、特許文献1及び2にはこの種の積層コンデンサが開示されている。 A multilayer capacitor used for decoupling requires high capacitance and low ESL (equivalent series inductance). Patent Documents 1 and 2 disclose this type of multilayer capacitor.
特許文献1の積層コンデンサは、直方体形状の本体と、本体の幅方向両側面それぞれに非接触で4個ずつ設けられた極性が交互に異なる計8個の外部電極とを備えている。本体は、幅方向両側縁にそれぞれ2個ずつ設けられた計4個の引出部を有する第1内部導体層と、幅方向両側縁にそれぞれ2個ずつ設けられた計4個の引出部を第1内部導体層の引出部とは異なる位置に有する第2内部導体層とを、誘電体層を介して交互に積層して一体化した構造を有している。各第1内部導体層の4個の引出部は一方極性の4個の外部電極に接続され、各第2内部導体層の4個の引出部は他方極性の残り4個の外部電極に接続されている。 The multilayer capacitor disclosed in Patent Document 1 includes a rectangular parallelepiped main body and a total of eight external electrodes that are provided in a non-contact manner on each of both sides in the width direction of the main body and have four different polarities. The main body has a first inner conductor layer having a total of four lead portions provided on each side edge in the width direction and a total of four lead portions provided on each side edge in the width direction. It has a structure in which the second inner conductor layers having positions different from the lead portions of the one inner conductor layer are alternately laminated and integrated through the dielectric layers. The four lead portions of each first inner conductor layer are connected to four external electrodes of one polarity, and the four lead portions of each second inner conductor layer are connected to the remaining four external electrodes of the other polarity. ing.
一方、特許文献2の積層コンデンサは、特許文献1の積層コンデンサの各第1内部導体層を幅方向に2分割すると共に各第2内部導体層を幅方向に2分割したような構造を備えている。
積層コンデンサの静電容量は基本的には内部導体層の積層数によって調整できるため、特許文献1及び特許文献2の積層コンデンサの何れもデカップリングの用途に適した充分な静電容量を得ることができる。 Since the capacitance of the multilayer capacitor can be basically adjusted by the number of laminated inner conductor layers, both of the multilayer capacitors disclosed in Patent Document 1 and Patent Document 2 can obtain sufficient capacitance suitable for decoupling applications. Can do.
一方、積層コンデンサのESLは該積層コンデンサの全体構造によって決まるものであるが、特許文献1及び特許文献2の積層コンデンサでは誘電体層を介して隣り合う異極性の引出部に流れる電流の向きが逆になるようにすることで各々の引出部に流れる電流により生じる磁界を相殺してESL低減を図っている。 On the other hand, the ESL of the multilayer capacitor is determined by the overall structure of the multilayer capacitor. However, in the multilayer capacitors of Patent Document 1 and Patent Document 2, the direction of the current flowing through the different-polarity lead-out portions through the dielectric layer is determined. By making it reverse, the magnetic field generated by the current flowing through each lead-out portion is canceled out to reduce ESL.
特許文献1及び特許文献2の積層コンデンサで採用されているESL低減手法は、一方極性の引出部から他方極性の引出部への電流経路で生じたインダクタンスを磁界相殺作用によって低減するものであるが、一方極性の引出部から他方極性の引出部への電流経路の長さを短くして該電流経路で生じ得るインダクタンスを低下させればより一層のESL低減を図ることができ、また、一方極性の引出部と他方極性の引出部を近づけて磁界相殺作用が効果的に行えるようにすればより一層のESL低減を図ることができる。 The ESL reduction method employed in the multilayer capacitors disclosed in Patent Document 1 and Patent Document 2 is to reduce the inductance generated in the current path from the one polarity lead portion to the other polarity lead portion by the magnetic field canceling action. If the length of the current path from the one-polarity lead part to the other-polarity lead part is shortened to reduce the inductance that can occur in the current path, the ESL can be further reduced. If the lead portion and the other polarity lead portion are brought close to each other so that the magnetic field canceling action can be effectively performed, the ESL can be further reduced.
本発明は前記事情に鑑みて創作されたもので、その目的とするところは、より一層の低ESL化が図られた積層コンデンサを提供することにある。 The present invention was created in view of the above circumstances, and an object of the present invention is to provide a multilayer capacitor in which ESL is further reduced.
前記目的を達成するため、本発明は、直方体形状の本体の側面に一方極性の第1外部電極と他方極性の第2外部電極とを非接触で交互に設けた積層コンデンサであって、本体は、同一平面に非接触で並ぶ複数の第1内部導体層と、同一平面に非接触で並ぶ第1内部導体層と同数の第2内部導体層とを、誘電体層を介して交互に積層して一体化した構造を有していて、誘電体層を介して積層方向で並ぶ第1,第2内部電極層それぞれによって複数の独立コンデンサ部を構成しており、各独立コンデンサ部の第1,第2内部導体層は同じ側縁の異なる位置に1つの引出部を有していて、各独立コンデンサ部の第1内部導体層の引出部は第1外部電極にそれぞれ接続され、且つ、第2内部導体層の引出部は該第1外部電極と隣接する第2外部電極にそれぞれ接続されており、各独立コンデンサ部の第1,第2内部導体層の引出部の中心間隔は、隣接する独立コンデンサ部にあって最も隣接する第1,第2内部導体層の引出部の中心間隔よりも狭い、ことをその特徴とする。 To achieve the above object, the present invention provides a multilayer capacitor in which a first external electrode having one polarity and a second external electrode having the other polarity are alternately provided in a non-contact manner on a side surface of a rectangular parallelepiped body. A plurality of first inner conductor layers arranged in a non-contact manner on the same plane and the same number of second inner conductor layers as the first inner conductor layers arranged in a non-contact manner on the same plane are alternately stacked via dielectric layers. A plurality of independent capacitor portions are constituted by the first and second internal electrode layers arranged in the stacking direction via the dielectric layers, and the first and second inner capacitor portions are respectively The second inner conductor layer has one lead portion at a different position on the same side edge, the lead portion of the first inner conductor layer of each independent capacitor portion is connected to the first outer electrode, and the second The lead portion of the inner conductor layer is connected to the second outer electrode adjacent to the first outer electrode. The center intervals of the lead portions of the first and second inner conductor layers of each independent capacitor portion are connected to each other. It is characterized by being narrower than the center interval of the parts.
この積層コンデンサによれば、各独立コンデンサ部の第1,第2内部導体層の引出部の中心間隔を、隣接する独立コンデンサ部にあって最も隣接する第1,第2内部導体層の引出部の中心間隔よりも狭くすることによって、一方極性の引出部から他方極性の引出部の電流経路の長さを短くして該電流経路で生じ得るインダクタンスを低下させることができ、しかも、一方極性の引出部と他方極性の引出部を近づけて該引出部に逆向きに流れる電流により得られる磁界相殺作用を効果的に行うことができ、これにより積層コンデンサのESLをより一層低減することができる。 According to the multilayer capacitor, the center interval of the lead portions of the first and second inner conductor layers of each independent capacitor portion is set so that the lead portions of the first and second inner conductor layers that are closest to each other in the adjacent independent capacitor portion. By making the center interval smaller than the center interval, the length of the current path from the one polarity lead portion to the other polarity lead portion can be shortened, and the inductance that can be generated in the current path can be reduced. The lead portion and the lead portion with the other polarity can be brought close to each other to effectively perform the magnetic field canceling action obtained by the current flowing in the reverse direction to the lead portion, thereby further reducing the ESL of the multilayer capacitor.
本発明によれば、より一層の低ESL化が図られた積層コンデンサを提供することができる。 According to the present invention, it is possible to provide a multilayer capacitor in which ESL is further reduced.
本発明の前記目的とそれ以外の目的と、構成特徴と、作用効果は、以下の説明と添付図面によって明らかとなる。 The above object and other objects, structural features, and operational effects of the present invention will become apparent from the following description and the accompanying drawings.
[第1実施形態]
図1〜図3は本発明(積層コンデンサ)の第1実施形態を示すもので、図1は積層コンデンサの斜視図、図2は図1に示した積層コンデンサの横断面図、図3は図1に示した本体の層構成を示す斜視図である。
[First Embodiment]
1 to 3 show a first embodiment of the present invention (multilayer capacitor). FIG. 1 is a perspective view of the multilayer capacitor, FIG. 2 is a cross-sectional view of the multilayer capacitor shown in FIG. 1, and FIG. FIG. 2 is a perspective view showing a layer configuration of a main body shown in FIG.
第1実施形態の積層コンデンサ10は、所定の長さ,幅及び高さを有する直方体形状の本体11と、本体11の幅方向両側面それぞれに非接触で交互に設けられた一方極性の第1外部電極12と他方極性の第2外部電極13とを備えている。
The
第1外部電極12と第2外部電極13は本体11の幅方向両側面それぞれに2個ずつ設けられており、本体11の一側面(図1の右側面)には計4個の第1,第2外部電極12,13が左から第1外部電極12,第2外部電極13,第1外部電極12,第2外部電極13の順に並んでいて、本体11の他側面(図1の左側面)には一側面の第1,第2外部電極12,13と向き合うように計4個の第1,第2外部電極12,13が左から第2外部電極13,第1外部電極12,第2外部電極13,第1外部電極12の順に並んでいる。
Two first
本体11は、同一平面に非接触で並ぶ2個の第1内部導体層14と、同一平面に非接触で並ぶ第1内部導体層と同数の第2内部導体層15とを、誘電体層DLを介して交互に積層して一体化した構造を有している。各第1内部導体層14と各第2内部導体層15はほぼ同サイズの矩形状を成し、同一平面に非接触で並ぶ2個の第1内部導体層14と同一平面に非接触で並ぶ2個の第2内部導体層15は誘電体層DLを介して積層方向で向き合っている。つまり、本体11には、誘電体層DLを介して積層方向で並ぶ第1,第2内部電極層14,15それぞれによって2個の独立コンデンサ部(符号無し)が長さ方向に間隔をおいて構成されている。
The
各第1内部導体層14はその幅方向一側縁(図3の右側縁)と幅方向他側縁(図3の左側縁)にそれぞれ1個の引出部14aを有し、各第2内部導体層15はその幅方向一側縁(図3の右側縁)と幅方向他側縁(図3の左側縁)にそれぞれ1個の引出部14aを有している。各第1内部導体層14の引出部14aと各第2内部導体層15の引出部15aはほぼ同サイズの矩形状を成し、同一平面に非接触で並ぶ2個の第1内部導体層14の引出部14aの位置と同一平面に非接触で並ぶ2個の第2内部導体層15の引出部15aの位置は長さ方向で異なっていて積層方向では向き合ってはいない。
Each first
図2に示すように、一方の独立コンデンサ部(図2の左側に構成されるコンデンサ部)を構成する各第1内部電極層14の一側縁(図2の上側縁)の引出部14aは本体11の一側面(図2の上側面)の最も左に位置する第1外部電極12に接続され、他側縁(図2の下側縁)の引出部14aは本体11の他側面(図2の下側面)の左から2番目に位置する第1外部電極12に接続されている。また、一方の独立コンデンサ部(図2の左側に構成されるコンデンサ部)を構成する各第2内部電極層15の一側縁(図2の上側縁)の引出部15aは本体11の一側面(図2の上側面)の左から2番目に位置する第2外部電極13に接続され、他側縁(図2の下側縁)の引出部15aは本体11の他側面(図2の下側面)の最も左に位置する第2外部電極13に接続されている。
As shown in FIG. 2, the lead-out
他方の独立コンデンサ部(図2の右側に構成されるコンデンサ部)を構成する各第1内部電極層14の一側縁(図2の上側縁)の引出部14aは本体11の一側面(図2の上側面)の左から3番目に位置する第1外部電極12に接続され、他側縁(図2の下側縁)の引出部14aは本体11の他側面(図2の下側面)の左から4番目に位置する第1外部電極12に接続されている。また、一方の独立コンデンサ部(図2の右側に構成されるコンデンサ部)を構成する各第2内部電極層15の一側縁(図2の上側縁)の引出部15aは本体11の一側面(図2の上側面)の左から4番目に位置する第2外部電極13に接続され、他側縁(図2の下側縁)の引出部15aは本体11の他側面(図2の下側面)の左から3番目に位置する第2外部電極13に接続されている。
The lead-out
図2に示すように、本体11の一側面(図2の上側面)に設けられた計4個の第1,第2外部電極12,13(2個の第1外部電極12と2個の第2外部電極13)において隣接する第1,第2外部電極12,13の中心間隔a1〜a3は全て等しい。
As shown in FIG. 2, a total of four first and second
また、各独立コンデンサ部を構成する第1,第2内部導体層14,15の引出部14a,15aの中心間隔b1,b3は、隣接する独立コンデンサ部にあって最も隣接する第1,第2内部導体層14,15の引出部14a,15aの中心間隔b2よりも狭い。しかも、前記中心間隔b1,b3は前記中心間隔a1〜a3よりも狭く、前記中心間隔b2は前記中心間隔a1〜a3よりも広い。
The center intervals b1 and b3 of the
寸法線等の図示を省略したが、本体11の他側面側(図2の下側面側)の第1,第2外部電極12,13の中心間隔と第1,第2内部導体層14,15の引出部14a,15aの中心間隔も前記と同じである。
Although illustration of dimension lines and the like is omitted, the center distance between the first and second
前記中心間隔b1,b3を狭くする際の可変範囲は、第1,第2外部電極12,13の幅と引出部14a,15aとの差に依存する。図2には可変範囲の最大値まで前記中心間隔b1,b3を狭くしたものを例示してあるが、必ずしも前記中心間隔b1,b3を可変範囲の最大値まで狭くする必要はない。
The variable range when the center distances b1 and b3 are reduced depends on the difference between the widths of the first and second
前述の積層コンデンサ10にあっては、前記中心間隔b1,b3を前記中心間隔b2よりも狭くすることによって、一方極性の引出部14aから他方極性の引出部15aへの電流経路の長さを短くして該電流経路で生じ得るインダクタンスを低下させることができ、しかも、一方極性の引出部14aと他方極性の引出部15aを近づけて該引出部14a,15aに逆向きに流れる電流により得られる磁界相殺作用を効果的に行うことができ、これにより積層コンデンサ10のESLをより一層低減することができる。
In the above-described
因みに、実験によれば、各引出部14a,15aの幅が150μmで長さが125μmの積層コンデンサにおいて前記中心間隔a1〜a3を500μmとし前記中心間隔b1,b3を400μmとし前記中心間隔b2を600μmとした場合には、前記中心間隔a1〜a3を500μmとし前記中心間隔b1〜b3を500μmとした場合に比べて5pH前後のESL低下を図ることができたことを付記する。
Incidentally, according to an experiment, in the multilayer capacitor in which each of the
[第2実施形態]
図4〜図6は本発明(積層コンデンサ)の第2実施形態を示すもので、図4は積層コンデンサの斜視図、図5は図4に示した積層コンデンサの横断面図、図6は図4に示した本体の層構成を示す斜視図である。
[Second Embodiment]
4 to 6 show a second embodiment of the present invention (multilayer capacitor). FIG. 4 is a perspective view of the multilayer capacitor, FIG. 5 is a cross-sectional view of the multilayer capacitor shown in FIG. 4, and FIG. 5 is a perspective view showing a layer configuration of a main body shown in FIG.
第2実施形態の積層コンデンサ20は、所定の長さ,幅及び高さを有する直方体形状の本体21と、本体21の幅方向両側面それぞれに非接触で交互に設けられた一方極性の第1外部電極22と他方極性の第2外部電極23とを備えている。
The
第1外部電極22と第2外部電極23は本体21の幅方向両側面それぞれに2個ずつ設けられており、本体21の一側面(図4の右側面)には計4個の第1,第2外部電極22,23が左から第1外部電極22,第2外部電極23,第1外部電極22,第2外部電極23の順に並んでいて、本体21の他側面(図4の左側面)には一側面の第1,第2外部電極22,23と向き合うように計4個の第1,第2外部電極22,23が左から第2外部電極23,第1外部電極22,第2外部電極23,第1外部電極22の順に並んでいる。
Two first
本体21は、同一平面に非接触で並ぶ2個の第1内部導体層24と、同一平面に非接触で並ぶ第1内部導体層と同数の第2内部導体層25とを、誘電体層DLを介して交互に積層して一体化した構造を有している。各第1内部導体層24と各第2内部導体層25はほぼ同サイズの矩形状を成し、同一平面に非接触で並ぶ2個の第1内部導体層24と同一平面に非接触で並ぶ2個の第2内部導体層25は誘電体層DLを介して積層方向で向き合っている。つまり、本体21には、誘電体層DLを介して積層方向で並ぶ第1,第2内部電極層24,25それぞれによって2個の独立コンデンサ部(符号無し)が長さ方向に間隔をおいて構成されている。
The
各第1内部導体層24はその幅方向一側縁(図6の右側縁)と幅方向他側縁(図6の左側縁)にそれぞれ1個の引出部24aを有し、各第2内部導体層25はその幅方向一側縁(図6の右側縁)と幅方向他側縁(図6の左側縁)にそれぞれ1個の引出部24aを有している。各第1内部導体層24の引出部24aと各第2内部導体層25の引出部25aはほぼ同サイズの矩形状を成し、同一平面に非接触で並ぶ2個の第1内部導体層24の引出部24aの位置と同一平面に非接触で並ぶ2個の第2内部導体層25の引出部25aの位置は長さ方向で異なっていて積層方向では向き合ってはいない。
Each first
図5に示すように、一方の独立コンデンサ部(図5の左側に構成されるコンデンサ部)を構成する各第1内部電極層24の一側縁(図5の上側縁)の引出部24aは本体21の一側面(図5の上側面)の最も左に位置する第1外部電極22に接続され、他側縁(図5の下側縁)の引出部24aは本体21の他側面(図5の下側面)の左から2番目に位置する第1外部電極22に接続されている。また、一方の独立コンデンサ部(図5の左側に構成されるコンデンサ部)を構成する各第2内部電極層25の一側縁(図5の上側縁)の引出部25aは本体21の一側面(図5の上側面)の左から2番目に位置する第2外部電極23に接続され、他側縁(図5の下側縁)の引出部25aは本体21の他側面(図5の下側面)の最も左に位置する第2外部電極23に接続されている。
As shown in FIG. 5, the lead-out
他方の独立コンデンサ部(図5の右側に構成されるコンデンサ部)を構成する各第1内部電極層24の一側縁(図5の上側縁)の引出部24aは本体21の一側面(図5の上側面)の左から3番目に位置する第1外部電極22に接続され、他側縁(図5の下側縁)の引出部24aは本体21の他側面(図5の下側面)の左から4番目に位置する第1外部電極22に接続されている。また、一方の独立コンデンサ部(図5の右側に構成されるコンデンサ部)を構成する各第2内部電極層25の一側縁(図5の上側縁)の引出部25aは本体21の一側面(図5の上側面)の左から4番目に位置する第2外部電極23に接続され、他側縁(図5の下側縁)の引出部25aは本体21の他側面(図5の下側面)の左から3番目に位置する第2外部電極23に接続されている。
The
図5に示すように、本体21の一側面(図5の上側面)に設けられた計4個の第1,第2外部電極22,23(2個の第1外部電極22と2個の第2外部電極23)において隣接する第1,第2外部電極22,23の中心間隔a1〜a3のうち、各独立コンデンサ部を構成する第1,第2内部導体層24,25の引出部24a,25aが接続された第1,第2外部電極22,23の中心間隔a1,a3は、隣接する独立コンデンサ部にあって最も隣接する第1,第2内部導体層24,25の引出部24a,25aが接続された第1,第2外部電極23,24の中心間隔a2よりも狭い。
As shown in FIG. 5, a total of four first and second
また、各独立コンデンサ部を構成する第1,第2内部導体層24,25の引出部24a,25aの中心間隔b1,b3は、隣接する独立コンデンサ部にあって最も隣接する第1,第2内部導体層24,25の引出部24a,25aの中心間隔b2よりも狭い。しかも、前記中心間隔b1,b3は前記中心間隔a1,a3よりも狭く、前記中心間隔b2は前記中心間隔a2よりも広い。
Further, the center intervals b1 and b3 of the
寸法線等の図示を省略したが、本体21の他側面側(図5の下側面側)の第1,第2外部電極22,23の中心間隔と第1,第2内部導体層24,25の引出部24a,25aの中心間隔も前記と同じである。
Although illustration of dimension lines and the like is omitted, the center distance between the first and second
前記中心間隔a1〜a3は積層コンデンサ毎に定められている規格値の公差に収まる範囲で可変することができる。また、前記中心間隔b1,b3を狭くする際の可変範囲は、第1,第2外部電極22,23の幅と引出部24a,25aとの差に依存する。図5には可変範囲の最大値まで前記中心間隔b1,b3を狭くしたものを例示してあるが、必ずしも前記中心間隔b1,b3を可変範囲の最大値まで狭くする必要はない。
The center intervals a1 to a3 can be varied within a range that falls within a tolerance of a standard value determined for each multilayer capacitor. Further, the variable range when the center distances b1 and b3 are narrowed depends on the difference between the widths of the first and second
前述の積層コンデンサ20にあっては、前記中心間隔b1,b3を前記中心間隔b3よりも狭くすることによって、一方極性の引出部24aから他方極性の引出部25aへの電流経路の長さを短くして該電流経路で生じ得るインダクタンスを低下させることができ、しかも、一方極性の引出部24aと他方極性の引出部15aを近づけて該引出部24a,25aに逆向きに流れる電流により得られる磁界相殺作用を効果的に行うことができ、これにより積層コンデンサ20のESLをより一層低減することができる。
In the above-described
また、前記中心間隔a1,a3を前記中心間隔a2よりも狭くすることによって前記中心間隔b1,b3をより狭くすることができるので、一方極性の引出部24aから他方極性の引出部15aへの電流経路の長さをより短くして該電流経路で生じ得るインダクタンスをより低下させることができ、しかも、一方極性の引出部24aと他方極性の引出部15aをより近づけて該引出部24a,25aに逆向きに流れる電流により得られる磁界相殺作用をより効果的に行うことができ、これにより積層コンデンサ20のESLをより一層低減することができる。
Further, since the center intervals b1 and b3 can be made narrower by making the center intervals a1 and a3 narrower than the center interval a2, the current from the one
因みに、実験によれば、各引出部24a,25aの幅が150μmで長さが125μmの積層コンデンサにおいて前記中心間隔a1,a3を400μmとし前記中心間隔a2を00μmとし前記中心間隔b1,b3を300μmとし前記中心間隔b2を700μmとした場合には、前記中心間隔a1〜a3を500μmとし前記中心間隔b1〜b3を500μmとした場合に比べて6pH前後のESL低下を図ることができたことを付記する。
Incidentally, according to the experiment, in the multilayer capacitor in which the
10…積層コンデンサ、11…本体、12…第1外部電極、13…第2外部電極、14…第1内部導体層、14a…引出部、15…第2内部導体層、15a…引出部、DL…誘電体層、20…積層コンデンサ、21…本体、22…第1外部電極、23…第2外部電極、24…第1内部導体層、24a…引出部、25…第2内部導体層、25a…引出部、DL…誘電体層。
DESCRIPTION OF
Claims (4)
本体は、同一平面に非接触で並ぶ複数の第1内部導体層と、同一平面に非接触で並ぶ第1内部導体層と同数の第2内部導体層とを、誘電体層を介して交互に積層して一体化した構造を有していて、誘電体層を介して積層方向で並ぶ第1,第2内部電極層それぞれによって複数の独立コンデンサ部を構成しており、
各独立コンデンサ部の第1,第2内部導体層は同じ側縁の異なる位置に1つの引出部を有していて、各独立コンデンサ部の第1内部導体層の引出部は第1外部電極にそれぞれ接続され、且つ、第2内部導体層の引出部は該第1外部電極と隣接する第2外部電極にそれぞれ接続されており、
各独立コンデンサ部の第1,第2内部導体層の引出部の中心間隔は、隣接する独立コンデンサ部にあって最も隣接する第1,第2内部導体層の引出部の中心間隔よりも狭い、
ことを特徴とする積層コンデンサ。 A multilayer capacitor in which a first external electrode having one polarity and a second external electrode having the other polarity are alternately provided in a non-contact manner on a side surface of a rectangular parallelepiped body,
The main body alternately includes a plurality of first inner conductor layers arranged in a non-contact manner on the same plane, and the same number of first inner conductor layers arranged in a non-contact manner on the same plane as the second inner conductor layers via a dielectric layer. A plurality of independent capacitor portions are configured by the first and second internal electrode layers arranged in the stacking direction via the dielectric layer, and having a structure integrated by stacking,
The first and second inner conductor layers of each independent capacitor portion have one lead portion at different positions on the same side edge, and the lead portion of the first inner conductor layer of each independent capacitor portion serves as the first outer electrode. Each connected, and the lead portion of the second inner conductor layer is connected to the second outer electrode adjacent to the first outer electrode,
The center interval between the lead portions of the first and second inner conductor layers of each independent capacitor portion is narrower than the center interval between the lead portions of the first and second inner conductor layers adjacent to each other in the adjacent independent capacitor portion.
A multilayer capacitor characterized by that.
同一平面に非接触で並ぶ第1内部導体層の数は2で、同一平面に非接触で並ぶ第2内部導体層の数は2で、独立コンデンサ部の数は2であり、
引出部は各独立コンデンサ部の第1,第2内部導体層の幅方向両側縁にそれぞれ1個ずつ設けられていて、各独立コンデンサ部の第1内部導体層の一側縁の引出部は本体の一側面の第1外部電極に接続され、且つ、他側縁の引出部は本体の他側面の第1外部電極に接続され、各独立コンデンサ部の第2内部導体層の一側縁の引出部は本体の一側面の第2外部電極に接続され、且つ、他側縁の引出部は本体の他側面の第2外部電極に接続されている、
ことを特徴とする請求項1に記載の積層コンデンサ。 Two first external electrodes and two second external electrodes are provided on each side surface in the width direction of the main body,
The number of first internal conductor layers arranged in a non-contact manner on the same plane is 2, the number of second internal conductor layers arranged in a non-contact manner on the same plane is 2, and the number of independent capacitor portions is 2.
One lead-out portion is provided on each side edge in the width direction of the first and second inner conductor layers of each independent capacitor portion, and the lead-out portion on one side edge of the first inner conductor layer of each independent capacitor portion is the main body. The lead portion on the other side is connected to the first external electrode on the other side of the main body, and the lead on the one side edge of the second internal conductor layer of each independent capacitor portion is connected to the first outer electrode on the other side. The part is connected to the second external electrode on one side of the main body, and the lead-out part on the other side edge is connected to the second external electrode on the other side of the main body.
The multilayer capacitor according to claim 1.
ことを特徴とする請求項1または2に記載の積層コンデンサ。 The center intervals of the first and second external electrodes to which the lead portions of the first and second inner conductor layers of each independent capacitor portion are connected are all equal, and the lead portions of the first and second inner conductor layers of each independent capacitor portion are the same. The center interval of is narrower than the center interval of the first and second external electrodes,
The multilayer capacitor according to claim 1 or 2, wherein
各独立コンデンサ部の第1,第2内部導体層の引出部の中心間隔は、各独立コンデンサ部の第1,第2内部導体層の引出部が接続された第1,第2外部電極の中心間隔よりも狭い、
ことを特徴とする請求項1または2に記載の積層コンデンサ。 The center distance between the first and second external electrodes to which the lead portions of the first and second inner conductor layers of each independent capacitor portion are connected is the first and second inner conductors closest to each other in the adjacent independent capacitor portion. Narrower than the center interval of the first and second external electrodes to which the lead portions of the layers are connected,
The center distance between the lead portions of the first and second internal conductor layers of each independent capacitor portion is the center of the first and second external electrodes to which the lead portions of the first and second internal conductor layers of each independent capacitor portion are connected. Narrower than the interval,
The multilayer capacitor according to claim 1 or 2, wherein
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
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Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
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Publications (3)
Publication Number | Publication Date |
---|---|
JP2009021280A true JP2009021280A (en) | 2009-01-29 |
JP2009021280A5 JP2009021280A5 (en) | 2010-08-26 |
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Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2007180785A Active JP5173291B2 (en) | 2007-07-10 | 2007-07-10 | Multilayer capacitor |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP5173291B2 (en) |
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