JP2008522571A - Composite resonant converter - Google Patents
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Abstract
第1のDC電圧を第2のDC電圧へ変換する複合共振コンバーターでは、半導体スイッチを有する半ブリッジの出力は、共振キャパシターを通じ変圧器の1次巻線と接続され、及び変圧器の2次巻線は、整流器素子、出力インダクター及び出力キャパシターと一緒に電流出力を形成する。出力キャパシターにかかる電圧と基準電圧とを供給され、他方の半導体スイッチがオフに切り替えられた後の所定時間において半導体スイッチの1つが対応してオンに切り替えられるよう、前記半導体スイッチを交互に制御する制御部が提案される。望ましくは、周波数は引き出された電力の上限値で制御され、一方で、引き出された電力の下限値でマーク・スペース比はそれぞれ選択された一定周波数に対し制御される。 In the composite resonant converter that converts the first DC voltage to the second DC voltage, the output of the half bridge with the semiconductor switch is connected to the primary winding of the transformer through the resonant capacitor, and the secondary winding of the transformer. The line together with the rectifier element, output inductor and output capacitor form a current output. A voltage applied to the output capacitor and a reference voltage are supplied, and the semiconductor switches are alternately controlled so that one of the semiconductor switches is correspondingly turned on at a predetermined time after the other semiconductor switch is turned off. A control unit is proposed. Preferably, the frequency is controlled by the upper limit value of the extracted power, while the mark / space ratio is controlled for each selected constant frequency by the lower limit value of the extracted power.
Description
本発明は、第1のDC電圧を第2のDC電圧へ変換する複合共振コンバーターに関する。半導体スイッチを有する半ブリッジの出力は、共振キャパシターを通じ変圧器の1次巻線と接続され、及び変圧器の2次巻線は、整流器素子、出力インダクター及び出力キャパシターと一緒に電流出力を形成する。 The present invention relates to a composite resonant converter that converts a first DC voltage to a second DC voltage. The output of the half bridge with the semiconductor switch is connected to the primary winding of the transformer through a resonant capacitor, and the secondary winding of the transformer forms a current output together with the rectifier element, the output inductor and the output capacitor. .
テレビジョンセット及びコンピューターの液晶ディスプレイ画面の電力供給では、種々の要件を満足する回路が必須である。大きな負荷範囲に対する安定した出力電圧に加え、及び入力電圧が変動する場合にも、最大効率が要求される。これは、例えば500mWの電力だけが回路から引き出されるスタンバイ動作に特に適用される。電磁適合要件も考慮に入れなければならない。この原則に適した複合共振コンバーターは、例えば非特許文献1に記載されている。しかしながら、知られている回路は、上述の要件の全てを満足せず、及び特に接続された装置のスタンバイ動作中の低電流消費の要件を満足しない。
本発明は、第1のDC電圧を第2のDC電圧へ変換する複合共振コンバーターを提供する。 The present invention provides a composite resonant converter that converts a first DC voltage to a second DC voltage.
本発明による複合共振コンバーターは、出力キャパシターに亘る電圧及び基準電圧を供給され得る制御部が、他方の半導体スイッチがオフに切り替えられた後の所定時間において、半導体スイッチの1つが対応してオンに切り替えられるよう、半導体スイッチを交互に制御することを特徴とする。本発明によるコンバーターでは、特に、周波数は引き出された電力の上限値で制御され、及び/又はマーク・スペース比は引き出された電力の下限値で選択された対応する一定周波数に対し制御される。 In the composite resonant converter according to the present invention, the control unit that can be supplied with the voltage across the output capacitor and the reference voltage has one of the semiconductor switches correspondingly turned on at a predetermined time after the other semiconductor switch is turned off. The semiconductor switches are controlled alternately so that they can be switched. In the converter according to the invention, in particular, the frequency is controlled by the upper limit of the extracted power and / or the mark / space ratio is controlled for the corresponding constant frequency selected by the lower limit of the extracted power.
本発明による共振コンバーターは、以下の利点により卓越している:
−電流出力は非常に小さく及び従って安価な出力キャパシターを可能にする、
−通常動作条件下で、本発明によるコンバーターのマーク・スペース比は、常に50%であり、これは必要とされる出力インダクターの大きさを最小化する、
−本発明によるコンバーターは、電圧がゼロ交差する時、半導体スイッチを切り替えさせ、EMCフィルターの損失及び費用を最小化する、
−結合された周波数及びマーク・スペース比制御は、オンに切り替える時、必要な周波数範囲及びオンに切り替える時の電流サージの両方を最小化する、
−電圧がゼロ交差する時の切り替えは、高効率及び同期整流の可能性に加え、コンバーターを広い電力範囲に亘り容易にスケールさせ、従って異なる電力の装置は、基本的に同一である回路を用い供給され得る、
−電圧がゼロ交差する時の切り替え及び高効率は、非常に小型の無線周波数装置のコンバーターの使用を特に有利にする。
The resonant converter according to the invention is distinguished by the following advantages:
-The current output is very small and thus allows an inexpensive output capacitor,
-Under normal operating conditions, the mark-space ratio of the converter according to the invention is always 50%, which minimizes the required output inductor size;
The converter according to the invention switches the semiconductor switch when the voltage crosses zero, minimizing the loss and cost of the EMC filter;
-Combined frequency and mark space ratio control minimizes both required frequency range and current surge when switching on, when switching on.
-Switching when the voltage crosses zero, in addition to the possibility of high efficiency and synchronous rectification, makes it easy to scale the converter over a wide power range, so different power devices use essentially the same circuit. Can be supplied,
The switching and high efficiency when the voltage crosses zero makes the use of a very small radio frequency device converter particularly advantageous.
特に有利な実施例は、下限電力値において、選択された周波数の周期がTlp=(n+1/2)×T0により与えられる場合、本発明によるコンバーターを最小の引き出された電力で望ましく動作させる。ここでnは引き出された電力に依存する整数であり、およびT0は発振器の周期である。発振器の周波数は、共振キャパシター並びに変圧器のストレイインダクタンス及び主インダクタンスの直列回路により記述される。 A particularly advantageous embodiment makes the converter according to the invention desirably operate with minimal extracted power if the period of the selected frequency is given by Tlp = (n + 1/2) × T0 at the lower power value. Where n is an integer that depends on the power drawn, and T0 is the period of the oscillator. The frequency of the oscillator is described by a series circuit of the resonant capacitor and the transformer stray inductance and main inductance.
コンバーターのある望ましい構成では、制御部はプログラム可能な装置により形成される。プログラム可能な装置では、周期は出力キャパシターにかかる電圧と基準電圧との関数として導出される。導出された周期は、最大周波数及び選択された周波数の周期と比較される。そして半導体スイッチへ供給された制御信号は、周波数及びマーク・スペース比の関数として導出される。 In one preferred configuration of the converter, the control unit is formed by a programmable device. In a programmable device, the period is derived as a function of the voltage across the output capacitor and the reference voltage. The derived period is compared to the maximum frequency and the period of the selected frequency. The control signal supplied to the semiconductor switch is derived as a function of frequency and mark / space ratio.
更に、特に滑らかな電流整流は、2次巻線が中央タップを有し、及び2次巻線の端がそれぞれ整流器素子と接続される場合、本発明によるコンバーターで達成される。これらは、例である実施例に示されたように整流ダイオード、又は対応する印加電圧の極性により制御される半導体スイッチ、特にMOSFETであって良い。後者はまた、同期整流子としても参照される。 Furthermore, particularly smooth current rectification is achieved with the converter according to the invention when the secondary winding has a center tap and the ends of the secondary winding are each connected to a rectifier element. These may be rectifier diodes, as shown in the exemplary embodiment, or semiconductor switches, in particular MOSFETs, controlled by the polarity of the corresponding applied voltage. The latter is also referred to as a synchronous commutator.
本発明のこれら及び他の態様は、以下に記載される実施例から、及びそれらを参照し説明されることにより明らかに説明される。 These and other aspects of the invention will be apparent from and will be elucidated with reference to the embodiments described hereinafter.
図1による回路構成では、2つの電界効果トランジスターS1及びS2は、DC電圧Uinが印加される制御部Rにより制御される半ブリッジを形成する。本発明によるコンバーターが電力供給ユニットとして用いられる場合、当該コンバーターの前に適切な整流器があるべきである。 In the circuit configuration according to FIG. 1, the two field effect transistors S1 and S2 form a half bridge controlled by the control unit R to which the DC voltage Uin is applied. If the converter according to the invention is used as a power supply unit, there should be a suitable rectifier in front of the converter.
2つの電界効果トランジスターS1及びS2の接続点は、半ブリッジの出力を形成し、及び共振キャパシターCrを通じて変圧器Trの1次巻線Pと接続される。回路の機能を説明するため、ストレイインダクタンスLr及び主インダクタンスLmは、独立に示されるが、それらインダクタンスのために別個の構成要素が回路内に設けられるものではない。 The connection point of the two field effect transistors S1 and S2 forms a half-bridge output and is connected to the primary winding P of the transformer Tr through the resonant capacitor Cr. To explain the function of the circuit, the stray inductance Lr and the main inductance Lm are shown independently, but no separate components are provided in the circuit for these inductances.
2次巻線Sは中央タップを有する。一方、2次巻線Sの端は、それぞれ整流ダイオードD1、D2、及び出力インダクターLoを通じ、出力キャパシターCo及び従って負荷Lと接続される。出力インダクターLoは、電流が負荷Lに課されるために十分高いインダクタンスを有する。出力電圧Uaは、しかしながら、図2及び図3と関連して記載される制御により、実質的に一定に保たれる。 The secondary winding S has a center tap. On the other hand, the end of the secondary winding S is connected to the output capacitor Co and thus the load L through the rectifier diodes D1 and D2 and the output inductor Lo, respectively. The output inductor Lo has a sufficiently high inductance so that a current is imposed on the load L. However, the output voltage Ua is kept substantially constant by the control described in connection with FIGS.
制御部Rは、電界効果トランジスターS1及びS2のために対応する制御信号C1、C2を生成する。電界効果トランジスターの1つが先ずオフに切り替えられ、そして他方の電界効果トランジスターが所定時間の後にオンに切り替えられる場合、切り替え時間は互いに異なる。補償電流は、出力キャパシター(図に示されない)を通じ、及び選択的にスナバキャパシター及び寄生ダイオードを通じて流れ得る。共振周波数は、f0=1/T0=1/[(Lr+Lm)×Cr]1/2として与えられ、例えば150kHzである。 The controller R generates corresponding control signals C1 and C2 for the field effect transistors S1 and S2. If one of the field effect transistors is switched off first and the other field effect transistor is switched on after a predetermined time, the switching times are different from each other. The compensation current can flow through the output capacitor (not shown) and optionally through the snubber capacitor and the parasitic diode. The resonance frequency is given as f0 = 1 / T0 = 1 / [(Lr + Lm) × Cr] 1/2 and is, for example, 150 kHz.
pmaxとp1の間の上限電力値での動作中、コンバーターは、従来の複合共振コンバーター(図2)として駆動され、マーク・スペース比はd=0.5であり、周波数はfminからfmaxへ上昇する。図2では、電力出力pの関数としての周波数fの特性は、2つの異なる入力電圧Uin1、Uin2に対し示される。この例では、入力電圧Uin1は、入力電圧Uin2より大きい。 During operation at an upper power value between pmax and p1, the converter is driven as a conventional composite resonant converter (FIG. 2), the mark-space ratio is d = 0.5, and the frequency increases from fmin to fmax. To do. In FIG. 2, the characteristic of frequency f as a function of power output p is shown for two different input voltages Uin1, Uin2. In this example, the input voltage Uin1 is larger than the input voltage Uin2.
p1より少ない電力消費では、コンバーターは、周波数f及びマーク・スペース比dの両方を介し制御される。この例では、離散周波数が選択される。対応する周期Tlpは、次のように計算される:Tlp=(n+l/2)×T0。ここで添え字lpは、下限電力値での動作モードを示す。 For power consumption less than p1, the converter is controlled via both frequency f and mark space ratio d. In this example, a discrete frequency is selected. The corresponding period Tlp is calculated as follows: Tlp = (n + 1/2) × T0. Here, the subscript lp indicates an operation mode at the lower limit power value.
n=0、1、2及び3では、図2の垂直線により示される周波数f0、f1、f2及びf3が得られる。p1とp2の間の電力範囲で周波数が値f0において一定に保たれる間、マーク・スペース比は連続的に減少する。電力がp2とp3の間で更に減少すると、周波数はf1に設定され、同時にマーク・スペース比は更に減少する。以下同様である。最小電力消費では、つまり接続された装置がスタンバイで動作される場合、dは、非常に小さい電力消費においてさえ効率が高いままであることを保証する最小値と仮定される。 For n = 0, 1, 2 and 3, the frequencies f0, f1, f2 and f3 indicated by the vertical lines in FIG. 2 are obtained. While the frequency is kept constant at the value f0 in the power range between p1 and p2, the mark-space ratio decreases continuously. As the power is further reduced between p2 and p3, the frequency is set to f1 and at the same time the mark-space ratio is further reduced. The same applies hereinafter. At minimum power consumption, i.e. when the connected device is operated in standby, d is assumed to be the minimum value that ensures that efficiency remains high even at very low power consumption.
制御部R(図1)は、望ましくは基本的にマイクロプロセッサーにより形成される。制御部の機能の説明は、図3にある。出力電圧Ua及び基準電圧Urefは、アナログ/デジタルコンバーター1へ供給される。アナログ/デジタルコンバーター1の出力信号の関数として、周期Toutは、制御アルゴリズムを用いて計算される。これは、3において周期Tref1=1/fmaxと比較される。Toutがより大きい場合、コンバーターは上限電力値で動作する。マーク・スペース比は従って4において0.5に設定される。T=Toutと共に、d=0.5はパルス幅変調器5の入力値として用いられる。制御信号C1及びC2は、これらの仕様に従い導出される。
The controller R (FIG. 1) is preferably basically formed by a microprocessor. The description of the function of the control unit is in FIG. The output voltage Ua and the reference voltage Uref are supplied to the analog /
ToutがTref1より大きくない場合、しかしながらToutは、6においてTref2と比較される。この周期は、例えば97kHzの周波数に対応する。従って、7において、制御信号C1及びC2の周期はT=Tref1に設定され、マーク・スペース比はd=0.5Tout/Tに設定される。この例では、コンバーターは、引き出された出力p1とp2の間の図2に示される範囲で動作する。8、9及び10において、それぞれ更なる基準周期Tref3、Tref4及びTref5との比較が実行される。示された例では、Tref3=1/36kHz、及びTref4=1/22kHzである。T及びdは、従って11、12、13において計算される。 If Tout is not greater than Tref1, however, Tout is compared to Tref2 at 6. This period corresponds to a frequency of 97 kHz, for example. Accordingly, in 7, the period of the control signals C1 and C2 is set to T = Tref1, and the mark / space ratio is set to d = 0.5 Tout / T. In this example, the converter operates in the range shown in FIG. 2 between the extracted outputs p1 and p2. At 8, 9 and 10, a comparison with further reference periods Tref3, Tref4 and Tref5 is performed, respectively. In the example shown, Tref3 = 1/36 kHz and Tref4 = 1/22 kHz. T and d are thus calculated at 11, 12, 13.
Toutが更なる閾値Tref5より小さい場合、制御信号C2及びC1は14において完全にオフに切り替えられる、つまりd=0である。 If Tout is smaller than the further threshold Tref5, the control signals C2 and C1 are switched off completely at 14, i.e. d = 0.
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