JP2008235588A - Schottky barrier diode - Google Patents
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Abstract
Description
本発明は、ショットキーバリアダイオードに関し、特に良好な順方向特性(低VF)と、良好な逆方向特性(低IR)とを兼ね備えたショットキーバリアダイオードに関する。 The present invention relates to a Schottky barrier diode, and more particularly, to a Schottky barrier diode having both good forward characteristics (low VF) and good reverse characteristics (low IR).
図4は、従来のショットキーバリアダイオード110を示す断面図である。 FIG. 4 is a cross-sectional view showing a conventional Schottky barrier diode 110.
基板SB’はn+型半導体基板121にn−型半導体層122を積層したものである。n−型半導体層122の表面にはこれとショットキー接合を形成する金属層(ショットキー金属層)125を設ける。この金属層125は例えばTiである。更に金属層125全面を覆ってアノード電極128となるAl層を設ける。半導体基板SB’外周には耐圧を確保するために高濃度のP型不純物を拡散したガードリング127が設けられ、その一部がショットキー金属層125とコンタクトする。基板SB’裏面はTi−Ni−Auなどのカソード電極129が設けられる(例えば、特許文献1参照。)。 The substrate SB ′ is obtained by stacking an n− type semiconductor layer 122 on an n + type semiconductor substrate 121. A metal layer (Schottky metal layer) 125 that forms a Schottky junction with the n − type semiconductor layer 122 is provided on the surface of the n − type semiconductor layer 122. This metal layer 125 is, for example, Ti. Further, an Al layer that serves as the anode electrode 128 is provided so as to cover the entire surface of the metal layer 125. A guard ring 127 in which high-concentration P-type impurities are diffused is provided on the outer periphery of the semiconductor substrate SB ′, and a part thereof contacts the Schottky metal layer 125. A cathode electrode 129 such as Ti—Ni—Au is provided on the back surface of the substrate SB ′ (see, for example, Patent Document 1).
また、図5に示す構造も知られている。これは、n−型半導体層122中に高濃度のp型不純物によるp+型不純物領域123を複数設けた構造である。同一符号で示す他の構成要素は図4と同様であるので説明は省略する。 A structure shown in FIG. 5 is also known. This is a structure in which a plurality of p + type impurity regions 123 made of high concentration p type impurities are provided in the n − type semiconductor layer 122. The other components indicated by the same reference numerals are the same as those in FIG.
このショットキーバリアダイオード(以下JBS:Junction Barrier Schottky Diode)120に逆バイアスを印加すると、図5の如くp+型不純物領域123からn−型半導体層122に空乏層dが広がる。隣り合うp+型不純物領域123の離間距離をその空乏層dがピンチオフする幅以下に設けることで、逆バイアス印加時にショットキー接合面にかかるカソード電界を緩和しリーク電流を低減させるものである。すなわち、ショットキー金属層125の特性として、IR特性をそれほど考慮せずにVF特性の低いものを選択することができる(例えば特許文献2参照。)。
図4に示す構造のショットキーバリアダイオード110の特性を決定する要因は、n−型半導体層122とショットキー金属層125との仕事関数差φBnである。しかし、φBnは金属に固有の値であるため、用いる金属層125によりその特性はほぼ決まってしまう。 The factor that determines the characteristics of the Schottky barrier diode 110 having the structure shown in FIG. 4 is the work function difference φBn between the n − type semiconductor layer 122 and the Schottky metal layer 125. However, since φBn is a value inherent to metal, its characteristics are almost determined by the metal layer 125 used.
さらに、あるショットキーバリアダイオード110について考えた場合、φBnが大きくなると、ショットキーバリアダイオード110の順方向電圧VFが高くなり、逆に逆方向電圧時のリーク電流IRは低減する。すなわち順方向電圧VFとリーク電流IRはトレードオフの関係にある。 Further, when a certain Schottky barrier diode 110 is considered, when φBn increases, the forward voltage VF of the Schottky barrier diode 110 increases, and conversely, the leakage current IR at the reverse voltage decreases. That is, the forward voltage VF and the leakage current IR are in a trade-off relationship.
また、図5の如きJBS120ではp+型不純物領域123とn−型半導体層122が金属層125およびアノード電極128によって同電位に接続されている。この場合のアノード接続されたp+型不純物領域123は順方向電圧印加時にはショットキーバリアダイオードとしては機能しない領域である。つまりピンチオフを完全にするために、p+型不純物領域123を近接しすぎると、p+型不純物領域123の総面積が広くなる。つまり、同じチップサイズであった場合に、図4のショットキーバリアダイオード110のショットキー接合部J’と比較して、金属層125とn−型半導体層122とのショットキー接合部J’の面積が低減する。その上、p+型不純物領域123を近接しすぎると、順方向電圧VF印加時の電流の経路を狭め、装置の抵抗が増加する問題もある。 In the JBS 120 as shown in FIG. 5, the p + type impurity region 123 and the n− type semiconductor layer 122 are connected to the same potential by the metal layer 125 and the anode electrode 128. In this case, the anode-connected p + -type impurity region 123 is a region that does not function as a Schottky barrier diode when a forward voltage is applied. That is, if the p + type impurity region 123 is too close to complete pinch-off, the total area of the p + type impurity region 123 becomes wide. That is, in the case of the same chip size, the Schottky junction J ′ between the metal layer 125 and the n − type semiconductor layer 122 is compared with the Schottky junction J ′ of the Schottky barrier diode 110 in FIG. The area is reduced. In addition, if the p + -type impurity region 123 is too close, there is a problem that the current path when the forward voltage VF is applied is narrowed and the resistance of the device is increased.
更にp+型不純物領域123とn−型半導体層122が同電位の場合、両者のエネルギーバンドがずれることで、pn接合界面では約0.6V分の電位差が生じる。つまり順方向電圧印加時であってもp+型不純物領域123周辺に空乏層dが存在し、p+型不純物領域123の幅の分に加えて電流の経路を狭め、抵抗成分増大を招く問題があった。 Further, when the p + -type impurity region 123 and the n − -type semiconductor layer 122 have the same potential, the energy band of the both shifts, and a potential difference of about 0.6 V occurs at the pn junction interface. That is, even when a forward voltage is applied, the depletion layer d exists around the p + -type impurity region 123, and in addition to the width of the p + -type impurity region 123, the current path is narrowed, leading to an increase in resistance component. It was.
このようなショットキー接合面積の低減と抵抗成分増大によって、従来のJBS120では実際には順方向特性が改善されない問題があった。 Due to the reduction of the Schottky junction area and the increase of the resistance component, the conventional JBS 120 has a problem that the forward characteristics are not actually improved.
またJBS120は、スイッチングタイムが増加する問題もある。例えば0.6Vを超える順方向電圧VFでJBS120を動作させると、p+型半導体領域123からn−型半導体層122へキャリア(正孔)が注入される。 The JBS 120 also has a problem that the switching time increases. For example, when the JBS 120 is operated with a forward voltage VF exceeding 0.6 V, carriers (holes) are injected from the p + type semiconductor region 123 into the n − type semiconductor layer 122.
この状態で逆方向電圧を印加すると、n−型半導体層122からのキャリアの引き抜きあるいは再結合を経た後、n−型半導体層122に空乏層dが広がる。つまりキャリアの引き抜きあるいは再結合に要する時間(逆回復時間trr)の増大によりスイッチングタイムの増大によりスイッチング特性が劣化する問題もあった。 When a reverse voltage is applied in this state, the depletion layer d spreads in the n − type semiconductor layer 122 after the carriers are extracted or recombined from the n − type semiconductor layer 122. That is, there is also a problem that switching characteristics deteriorate due to an increase in switching time due to an increase in time required for carrier extraction or recombination (reverse recovery time trr).
本発明はかかる課題に鑑みてなされ、一導電型半導体層と、該一導電型半導体層の一主面とショットキー接合を形成する金属層と、前記一導電型半導体層内に複数埋め込まれ、互いに離間された逆導電型の埋め込み領域と、を具備することにより解決するものである。 The present invention has been made in view of such a problem, and one conductive semiconductor layer, a metal layer that forms a Schottky junction with one main surface of the one conductive semiconductor layer, and a plurality of embedded in the one conductive semiconductor layer, The problem is solved by providing the opposite conductivity type buried regions spaced apart from each other.
本実施形態によれば、第1に、埋め込み領域は、n−型半導体層内に完全に埋め込まれており、金属層(ショットキー金属層)とコンタクトせず、アノード電極とも直接的に接続しない。つまり、金属層は、n−型半導体層とのみコンタクトする。従来のJBSでは、p+型不純物領域とその周辺の空乏層幅の分だけショットキー接合面積が低減したが、本実施形態によれば、(同じ動作領域面積で比較した場合)ショットキー面積が低減することはなく、順方向特性の向上に寄与できる。 According to this embodiment, first, the buried region is completely buried in the n − type semiconductor layer, does not contact the metal layer (Schottky metal layer), and does not directly connect to the anode electrode. . That is, the metal layer is in contact only with the n − type semiconductor layer. In the conventional JBS, the Schottky junction area is reduced by the width of the p + type impurity region and the surrounding depletion layer. However, according to the present embodiment, the Schottky area is reduced (when compared with the same operation region area). This can contribute to improving the forward characteristics.
第2に、n−型半導体層に、フローティング構造のp型不純物領域である埋め込み領域を設けることで、埋め込み領域とn−型半導体層とのエネルギーバンドをフラットな状態に維持できる。これにより、順方向電圧印加時であってもpn接合面に存在する空乏層を抑制でき、空乏層幅による抵抗増加を抑制できる。 Second, by providing a buried region which is a p-type impurity region having a floating structure in the n − type semiconductor layer, the energy band between the buried region and the n − type semiconductor layer can be maintained in a flat state. Thereby, even when a forward voltage is applied, a depletion layer present on the pn junction surface can be suppressed, and an increase in resistance due to the depletion layer width can be suppressed.
第3に、埋め込み領域がアノード電極と直接的に接続されていないので、順方向電圧印加時にp型不純物の埋め込み領域からn−型半導体層への正孔の注入が起こりにくい。つまりJBSと比較して、逆方向電圧印加時に、キャリアの引き抜きあるいは再結合の時間(逆回復時間trr)を大幅に低減できるので、逆回復時間trrの増大の問題も改善できる。 Third, since the buried region is not directly connected to the anode electrode, holes are less likely to be injected from the buried region of the p-type impurity into the n − -type semiconductor layer when a forward voltage is applied. That is, as compared with JBS, when a reverse voltage is applied, the carrier extraction or recombination time (reverse recovery time trr) can be greatly reduced, so that the problem of an increase in reverse recovery time trr can also be improved.
第4に、逆方向電圧印加時には、埋め込み領域からも空乏層が広がりさらにこれがピンチオフするため、ショットキー界面に到達するカソード電界を抑制することができる。つまり、従来のJBSと比較して逆方向リーク電流IRの抑制効果をある程度維持したまま、順方向特性VFを改善でき、リーク電流IRと順方向電圧VFのトレードオフを改善できる。 Fourth, when a reverse voltage is applied, the depletion layer also extends from the buried region and further pinches off, so that the cathode electric field reaching the Schottky interface can be suppressed. That is, the forward characteristic VF can be improved while maintaining the suppression effect of the reverse leakage current IR to some extent as compared with the conventional JBS, and the trade-off between the leakage current IR and the forward voltage VF can be improved.
本発明の実施の形態を図1から図3を用いて詳細に説明する。
Embodiments of the present invention will be described in detail with reference to FIGS.
本実施形態のショットキーバリアダイオード100は、一導電型半導体層11と、金属層12と、埋め込み領域21と、から構成される。 The Schottky barrier diode 100 according to this embodiment includes a one-conductivity type semiconductor layer 11, a metal layer 12, and a buried region 21.
図1(A)を参照して、基板SBは、n+型シリコン半導体基板10上に例えばエピタキシャル成長などによりn−型半導体層11を積層したものである。n−型半導体層11は、シリコン半導体層であり、一例として不純物濃度は5E15cm−3程度、厚みは10μm程度である。 Referring to FIG. 1A, a substrate SB is obtained by stacking an n − type semiconductor layer 11 on an n + type silicon semiconductor substrate 10 by, for example, epitaxial growth. The n − type semiconductor layer 11 is a silicon semiconductor layer, and has an impurity concentration of about 5E15 cm −3 and a thickness of about 10 μm as an example.
n−型半導体層11の一主面(表面)には、金属層12を設ける。金属層は、チタン(Ti)、モリブデン(Mo)等であり、n−型半導体層11表面とショットキー接合を形成し、ショットキーバリアダイオード100が構成される。 A metal layer 12 is provided on one main surface (surface) of the n − type semiconductor layer 11. The metal layer is made of titanium (Ti), molybdenum (Mo), or the like, forms a Schottky junction with the surface of the n − type semiconductor layer 11, and the Schottky barrier diode 100 is configured.
埋め込み領域21は、n−型半導体層11内に埋め込まれたp型不純物領域であり、互いに距離Lで離間して複数配置される。埋め込み領域21の不純物濃度は、例えば1E18cm−3程度、形状は球状である。 The buried region 21 is a p-type impurity region buried in the n − -type semiconductor layer 11, and a plurality of buried regions 21 are arranged at a distance L from each other. The impurity concentration of the buried region 21 is, for example, about 1E18 cm −3 and the shape is spherical.
後に詳述するが、n−型半導体層11と金属層12とのショットキー接合部Jに逆方向電圧が印加された際、p型の不純物領域である埋め込み領域21からn−型半導体層11に空乏層が広がる。 As will be described in detail later, when a reverse voltage is applied to the Schottky junction J between the n − type semiconductor layer 11 and the metal layer 12, the buried region 21, which is a p type impurity region, changes from the n − type semiconductor layer 11. The depletion layer spreads out.
隣り合う埋め込み領域21間の距離Lは、このときのショットキー接合部Jの電界強度Eが、臨界電界強度Ecに達する以前に、埋め込み領域21からn−型半導体層11に広がる空乏層がピンチオフし、カソード電界をシャットアウトする距離とする。 The distance L between the adjacent buried regions 21 indicates that the depletion layer extending from the buried region 21 to the n − type semiconductor layer 11 is pinched off before the electric field strength E of the Schottky junction J at this time reaches the critical electric field strength Ec. And the distance at which the cathode electric field is shut out.
また埋め込み領域21は、ショットキー接合部Jから所定の深さDで配置される。埋め込み領域21は、n−型半導体層11と金属層12とのショットキー接合部Jより下方のn−型半導体層11内に完全に埋め込まれ、金属層12とコンタクトせず、直接的にいずれの電位も印加されることはないフローティング構造である。すなわち金属層12はショットキー接合部Jの全面において、n−型半導体層11とコンタクトする。 The embedded region 21 is disposed at a predetermined depth D from the Schottky junction J. The buried region 21 is completely buried in the n − type semiconductor layer 11 below the Schottky junction J between the n − type semiconductor layer 11 and the metal layer 12, does not contact the metal layer 12, and directly This is a floating structure in which no potential is applied. That is, the metal layer 12 contacts the n − type semiconductor layer 11 over the entire surface of the Schottky junction J.
ショットキー接合部Jを囲む基板SBの端部には、高濃度のp型不純物を拡散したガードリング18が設けられる。 A guard ring 18 in which high-concentration p-type impurities are diffused is provided at the end of the substrate SB surrounding the Schottky junction J.
金属層12表面には、例えばアルミニウム(Al)等の金属層により、アノード電極15が形成され、アノード電極15と対向するn+型シリコン半導体基板10の主面(裏面)には、Ti−Ni−Auなどの蒸着金属層などによりカソード電極16が形成される。 On the surface of the metal layer 12, an anode electrode 15 is formed of a metal layer such as aluminum (Al), for example. On the main surface (back surface) of the n + type silicon semiconductor substrate 10 facing the anode electrode 15, Ti—Ni— The cathode electrode 16 is formed by a deposited metal layer such as Au.
図2および図3を参照して、本実施形態のショットキーバリアダイオード(以下SBD)100の動作について、従来(図5)のJBS120と比較して説明する。図2は、順方向電圧印加時の断面概要図であり、図2(A)が本実施形態のSBD100、図2(B)が従来のJBS120である。また図3は、本実施形態のSBD100の逆方向電圧印加時の断面概要図である。 With reference to FIG. 2 and FIG. 3, the operation of the Schottky barrier diode (hereinafter referred to as SBD) 100 of the present embodiment will be described in comparison with the conventional JBS 120 (FIG. 5). 2A and 2B are schematic cross-sectional views when a forward voltage is applied. FIG. 2A shows the SBD 100 of this embodiment, and FIG. 2B shows a conventional JBS 120. FIG. FIG. 3 is a schematic cross-sectional view of the SBD 100 of this embodiment when a reverse voltage is applied.
図2(A)を参照して、SBD100に順方向電圧(アノード電極15に正電圧)が印加されると、矢印の如く電流が流れる。 Referring to FIG. 2A, when a forward voltage (a positive voltage is applied to anode electrode 15) is applied to SBD 100, a current flows as indicated by an arrow.
図2(B)の如く従来のJBS120でも、同様に矢印の如く電流が流れるが、JBS120では以下の問題がある。 In the conventional JBS 120 as shown in FIG. 2B, a current flows in the same manner as indicated by an arrow, but the JBS 120 has the following problems.
まず第1にp+型不純物領域123は基板SB’の深さ(垂直方向)に延在するよう形成されており、ショットキー接合部J’から所定の深さまでの電流の経路を狭め、電流の抵抗成分が増加する問題がある。 First, the p + -type impurity region 123 is formed so as to extend to the depth (vertical direction) of the substrate SB ′, narrowing the current path from the Schottky junction J ′ to a predetermined depth, There is a problem that the resistance component increases.
また、p+型不純物領域123とn−型半導体層122が金属層125およびアノード電極128により同電位に接続されており、両者のエネルギーバンドがずれることで約0.6V分の電位差が生じる。つまり順方向電圧印加時であってもp+型不純物領域123周辺に空乏層dが存在する。つまりp+型不純物領域123の存在のみならず、空乏層dによっても電流の経路が狭められ、抵抗成分増大を招く問題があった。 In addition, the p + -type impurity region 123 and the n − -type semiconductor layer 122 are connected to the same potential by the metal layer 125 and the anode electrode 128, and a potential difference of about 0.6 V is generated by shifting the energy bands of both. That is, even when forward voltage is applied, the depletion layer d exists around the p + type impurity region 123. That is, the current path is narrowed not only by the presence of the p + -type impurity region 123 but also by the depletion layer d, resulting in an increase in resistance component.
また、本実施形態のSBD100は、p型不純物領域である埋め込み領域21をフローティング構造とすることで、p型不純物領域である埋め込み領域21とn−型半導体層12のエネルギーバンドはフラットな状態を維持できる。従って順方向電圧印加時に、埋め込み領域21とn−型半導体層12とのpn接合面に空乏層が発生することはない(図2(A))。これにより、図2(B)の如く従来発生していた空乏層dの幅による電流経路の抵抗増加を抑制できる。 In the SBD 100 of this embodiment, the buried region 21 that is a p-type impurity region has a floating structure, so that the energy band between the buried region 21 that is a p-type impurity region and the n − type semiconductor layer 12 is flat. Can be maintained. Therefore, when a forward voltage is applied, a depletion layer does not occur at the pn junction surface between the buried region 21 and the n − type semiconductor layer 12 (FIG. 2A). As a result, the increase in resistance of the current path due to the width of the depletion layer d, which has been conventionally generated as shown in FIG.
第2には従来のJBS120では、p+型不純物領域123がn−型半導体層122表面に露出し、ショットキー金属層125とコンタクトするため、順方向電圧印加時には、p+型不純物領域123とその周辺に広がる空乏層dの幅の分のショットキー接合面積が低減してしまう。すなわち、ショットキー接合面積の低減により順方向電圧特性が劣化する問題もある。 Second, in the conventional JBS 120, the p + -type impurity region 123 is exposed on the surface of the n − -type semiconductor layer 122 and contacts the Schottky metal layer 125. Therefore, when a forward voltage is applied, the p + -type impurity region 123 and its periphery are exposed. As a result, the area of the Schottky junction corresponding to the width of the depletion layer d extending in the range is reduced. That is, there is also a problem that the forward voltage characteristics deteriorate due to the reduction of the Schottky junction area.
しかし本実施形態のSBD100では、埋め込み領域21は、n−型半導体層12内に完全に埋め込まれており、金属層(ショットキー金属層)12とコンタクトすることはなく、アノード電極15と直接的に接続しない。従って、ショットキー接合部Jとして十分な面積を確保することができ、順方向電圧特性の劣化を抑制したまま低IR特性を実現できる。 However, in the SBD 100 of the present embodiment, the buried region 21 is completely buried in the n − type semiconductor layer 12 and does not contact the metal layer (Schottky metal layer) 12, but directly with the anode electrode 15. Do not connect to. Therefore, a sufficient area as the Schottky junction J can be secured, and low IR characteristics can be realized while suppressing deterioration of the forward voltage characteristics.
第3に従来のJBS120では、約0.6Vより大きい順方向電圧を印加すると、JBS120はpn接合ダイオードとして動作し、図2(B)の如くp+型不純物領域123からn−型半導体層122にキャリア(正孔)Cが注入される。 Third, in the conventional JBS 120, when a forward voltage greater than about 0.6 V is applied, the JBS 120 operates as a pn junction diode, and the p + -type impurity region 123 is applied to the n − -type semiconductor layer 122 as shown in FIG. Carriers (holes) C are injected.
JBS120をオフ状態に切り替えるために逆方向電圧を印加すると、図5のごとくp+型不純物領域123からn−型半導体層122に空乏層dが広がるのであるが、このとき、n−型半導体層122にキャリア(正孔)Cが蓄積されているため、このキャリアCの流出または再結合が行われた後、空乏層dが広がり出す。すなわち空乏層dが広がる以前にキャリアCの流出または再結合のための時間(逆回復時間:trr)が発生する。 When a reverse voltage is applied to switch the JBS 120 to the off state, the depletion layer d spreads from the p + -type impurity region 123 to the n − -type semiconductor layer 122 as shown in FIG. Since carriers (holes) C are accumulated in the depletion layer d, the depletion layer d expands after the carriers C flow out or recombine. That is, before the depletion layer d spreads, a time for carrier C to flow out or recombine (reverse recovery time: trr) occurs.
このため、スイッチングタイムが増加するなどの問題がある。 For this reason, there are problems such as an increase in switching time.
しかし本実施形態では、埋め込み領域21がアノード電極15と直接的に接続されていないためpn接合ダイオードとして動作することはなく、順方向電圧印加時に正孔の注入が起こりにくい。従って、オフ状態に切り替えるため逆方向電圧を印加した際に発生する逆回復時間trrを従来のJBS120と比較して大幅に短縮できる。つまり低いリーク電流IR特性を有しながら逆回復時間trr損失の増大の問題も改善できる。 However, in this embodiment, since the buried region 21 is not directly connected to the anode electrode 15, it does not operate as a pn junction diode, and hole injection hardly occurs when a forward voltage is applied. Therefore, the reverse recovery time trr generated when the reverse voltage is applied to switch to the off state can be significantly shortened as compared with the conventional JBS 120. That is, the problem of increase in reverse recovery time trr loss can be improved while having low leakage current IR characteristics.
次に図3を参照して、逆方向電圧印加時の動作について説明する。 Next, the operation at the time of applying the reverse voltage will be described with reference to FIG.
SBD100に逆方向電圧(カソード電極16に正電圧)が印加されると、ショットキー接合部J全面からn−型半導体層11に空乏層dが広がるとともに、埋め込み領域21からも周囲のn−型半導体層11に空乏層dが広がり、埋め込み領域21間において空乏層dがピンチオフする。そして空乏層d内の電界によって基板SBの垂直方向のカソード電界をシャットアウトすることで、ショットキー界面の電界を緩和し、ひいてはリーク電流を低減するとともに、所定の耐圧を確保する。 When a reverse voltage (positive voltage on the cathode electrode 16) is applied to the SBD 100, the depletion layer d spreads from the entire surface of the Schottky junction J to the n − type semiconductor layer 11, and the surrounding n − type also extends from the buried region 21. The depletion layer d spreads in the semiconductor layer 11, and the depletion layer d is pinched off between the buried regions 21. Then, the cathode electric field in the vertical direction of the substrate SB is shut out by the electric field in the depletion layer d, so that the electric field at the Schottky interface is relaxed, thereby reducing the leakage current and securing a predetermined breakdown voltage.
つまり、従来のJBS120と比較して逆方向リーク電流IRの抑制効果を維持したまま、順方向特性VFを改善でき、リーク電流IRと順方向電圧VFのトレードオフを改善できる。 That is, the forward characteristic VF can be improved while maintaining the effect of suppressing the reverse leakage current IR as compared with the conventional JBS 120, and the trade-off between the leakage current IR and the forward voltage VF can be improved.
10 n+型シリコン半導体基板
11 n−型半導体層
12 (ショットキー)金属層
15 アノード電極
16 カソード電極
18 ガードリング
21 埋め込み領域
100 ショットキーバリアダイオード(SBD)
110 ショットキーバリアダイオード
120 ショットキーバリアダイオード(JBS)
121 n+型シリコン半導体基板
122 n−型半導体層
123 p+型不純物領域
125 (ショットキー)金属層
127 ガードリング
128 アノード電極
129 カソード電極
SB、SB’ 半導体基板
d 空乏層
10 n + type silicon semiconductor substrate 11 n− type semiconductor layer
12 (Schottky) metal layer 15 Anode electrode 16 Cathode electrode 18 Guard ring 21 Buried region 100 Schottky barrier diode (SBD)
110 Schottky Barrier Diode 120 Schottky Barrier Diode (JBS)
121 n + type silicon semiconductor substrate 122 n− type semiconductor layer 123 p + type impurity region 125 (Schottky) metal layer 127 guard ring 128 anode electrode 129 cathode electrode SB, SB ′ semiconductor substrate d depletion layer
Claims (5)
該一導電型半導体層の一主面とショットキー接合を形成する金属層と、
前記一導電型半導体層内に複数埋め込まれ、互いに離間された逆導電型の埋め込み領域と、
を具備することを特徴とするショットキーバリアダイオード。 One conductivity type semiconductor layer;
A metal layer that forms a Schottky junction with one principal surface of the one conductivity type semiconductor layer;
A plurality of buried regions of the opposite conductivity type embedded in the one conductivity type semiconductor layer and spaced apart from each other;
A Schottky barrier diode comprising:
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2007073278A JP2008235588A (en) | 2007-03-20 | 2007-03-20 | Schottky barrier diode |
Applications Claiming Priority (1)
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JP2008235588A true JP2008235588A (en) | 2008-10-02 |
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Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN104393055A (en) * | 2014-11-10 | 2015-03-04 | 电子科技大学 | Grooved diode with floating island structure |
CN111987139A (en) * | 2019-05-21 | 2020-11-24 | 上海先进半导体制造股份有限公司 | Silicon carbide Schottky diode and preparation method thereof |
JP7468432B2 (en) | 2021-03-30 | 2024-04-16 | トヨタ自動車株式会社 | Semiconductor Device |
-
2007
- 2007-03-20 JP JP2007073278A patent/JP2008235588A/en active Pending
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CN111987139A (en) * | 2019-05-21 | 2020-11-24 | 上海先进半导体制造股份有限公司 | Silicon carbide Schottky diode and preparation method thereof |
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