JP2008181984A - Semiconductor device - Google Patents
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Abstract
Description
本発明は、フリップチップ実装タイプの半導体装置に関する。 The present invention relates to a flip chip mounting type semiconductor device.
従来より、BGA/CSPなどのフリップチップ実装タイプの半導体装置が提案されている(例えば、特許文献1参照。)。図8(a)、(b)に従来のフリップチップ実装タイプの半導体装置の断面を示す。図8(b)に示す半導体装置は、図8(a)に示す半導体装置に対して、半導体素子がフリップチップ実装された配線基板上を成型封止材で封止したタイプのものである。 Conventionally, flip-chip mounting type semiconductor devices such as BGA / CSP have been proposed (see, for example, Patent Document 1). 8A and 8B show a cross section of a conventional flip chip mounting type semiconductor device. The semiconductor device shown in FIG. 8B is of the type in which a semiconductor substrate is flip-chip mounted on a wiring substrate on which a semiconductor element is flip-chip sealed with a molding sealing material.
図8において、10は配線基板、11は半導体素子、12は基板電極、13は突起電極、14は封止樹脂、15はソルダーレジスト、16は基板電極、17はハンダボール、18は成型封止材、19はクラックである。
In FIG. 8, 10 is a wiring board, 11 is a semiconductor element, 12 is a substrate electrode, 13 is a protruding electrode, 14 is a sealing resin, 15 is a solder resist, 16 is a substrate electrode, 17 is a solder ball, and 18 is a molded seal. The
図8に示すように、半導体素子11がフリップチップ実装されたこの種の半導体装置は、半導体素子11の裏面に形成された外部接続用の突起電極13の先端部が、配線基板10上に形成された基板電極12に当接し、配線基板10と半導体素子11との間には硬化した封止樹脂14が設けられている。封止樹脂14は半導体素子11が配線基板10の実装位置から移動しないように固定する役目と、基板電極12と突起電極13との接触部を封止して良好な電気接続状態を維持する役目を果たしている。また、配線基板10の半導体素子11を搭載する側の面(主面)には、素子搭載部を開口して形成されたソルダーレジスト15が設けられている。また、配線基板1の主面側とは反対側の面(裏面)に形成された基板電極16上にはハンダボール17が設けられている。ハンダボール17は、配線基板10に設けられた配線(図示せず)を介して基板電極12に電気的に接続する。また、図8(b)に示す半導体装置は、成型封止材18が、半導体素子11がフリップチップ実装された配線基板10上を封止している。
As shown in FIG. 8, in this type of semiconductor device in which the
続いて、従来の半導体装置の製造方法について説明する。
まず、主面上にソルダーレジスト15が設けられた配線基板10の素子搭載部にシート状の封止樹脂材を貼り付ける。この封止樹脂材は熱硬化性である。次に、半導体素子11を、突起電極13が形成されている裏面を配線基板10の主面側に向けて、封止樹脂材上に配置し、熱をかけながら半導体素子11を配線基板10の側に押し付ける。このとき、封止樹脂材が熱により軟化して半導体素子11の外側に流動するとともに、突起電極13の先端部が基板電極12に当接して導通する。
Next, a conventional method for manufacturing a semiconductor device will be described.
First, a sheet-like sealing resin material is attached to the element mounting portion of the
この状態で、温度を下げて封止樹脂材を硬化させ、封止樹脂14を形成する。これにより、配線基板10上の半導体素子11の位置が、硬化した封止樹脂14によって固定されて実装が完了する。
In this state, the sealing resin material is cured by lowering the temperature to form the sealing
次に、配線基板10の裏面側に形成されている基板電極16上に、リフロー加熱により、ハンダボール17を形成して、BGA(ボールグリッドアレイ型)半導体装置は完成する。さらに、図8(b)に示す半導体装置では、半導体素子11が実装された配線基板10上を成型封止材18で密封する。
Next, a
このように封止樹脂材を介したフリップチップ工法、とりわけ圧接方式により半導体素子が実装された半導体装置においては、配線基板10の基板電極12と半導体素子11の突起電極13とを常時安定した接続状態に保つために、硬化した封止樹脂14が、硬化反応に伴う極めて大きな収縮により発生する強い圧縮応力によって半導体素子11を配線基板10に押し付けている。その押し付ける力の大きさは、低温から125℃、150℃といった高温に至るまでの温度変化に半導体装置が曝されたときにも、封止樹脂14自体の熱収縮および熱膨張による寸法変化に耐えて、常時十分な接合力で配線基板10と半導体素子11とを接合できる大きさである。したがって一方では、封止樹脂14の周囲に存在する半導体装置の構成材料には、封止樹脂14の硬化収縮により発生する強い圧縮応力によって大きな引っ張り応力が生じることとなる。その結果、配線基板10上の樹脂層であるソルダーレジスト15にクラック19が生じ、このクラック19を起点として、配線基板10の配線層の銅配線が切断されることがあった。
本発明は、上記問題点に鑑み、封止樹脂の端面の配線基板側の端部とソルダーレジスト(第1の樹脂層)との間に、ソルダーレジストよりも柔らかい材質、あるいは延性を有するとともに、ソルダーレジストよりも破断時の応力値が小さい材質の樹脂層(第2の樹脂層)を介在させることにより、良好な接続信頼性を保ちつつ、ソルダーレジストのクラック故障のない半導体装置を提供することを目的とする。 In view of the above problems, the present invention has a softer material or ductility than the solder resist between the end portion of the end surface of the sealing resin on the wiring board side and the solder resist (first resin layer), By providing a resin layer (second resin layer) made of a material whose stress value at break is smaller than that of a solder resist, a semiconductor device free from crack failure of the solder resist while maintaining good connection reliability is provided. With the goal.
本発明の請求項1記載の半導体装置は、配線基板と、前記配線基板に実装された半導体素子と、前記配線基板上の前記半導体素子が実装された領域を開口して形成された第1の樹脂層と、前記配線基板と前記半導体素子とを接合する封止樹脂と、前記封止樹脂の端面の前記配線基板側の端部と前記第1の樹脂層との間に形成された第2の樹脂層と、を備え、前記第2の樹脂層は、前記第1の樹脂層よりも柔らかい材質、あるいは延性を有するとともに、前記第1の樹脂層よりも破断時の応力値が小さい材質であることを特徴とする。 According to a first aspect of the present invention, there is provided a first semiconductor device formed by opening a wiring board, a semiconductor element mounted on the wiring board, and a region on the wiring board where the semiconductor element is mounted. A resin layer, a sealing resin that joins the wiring substrate and the semiconductor element, and a second resin layer formed between the end of the sealing resin on the wiring substrate side and the first resin layer. The second resin layer is made of a softer material than the first resin layer, or a material having ductility and a stress value at breakage smaller than that of the first resin layer. It is characterized by being.
また、本発明の請求項2記載の半導体装置は、請求項1記載の半導体装置であって、前記第2の樹脂層は、さらに、前記第1の樹脂層の開口側端面を覆うように形成されていることを特徴とする。
Moreover, the semiconductor device according to
また、本発明の請求項3記載の半導体装置は、請求項1記載の半導体装置であって、前記第2の樹脂層は、前記第1の樹脂層の前記配線基板側とは反対側の全面に形成されていることを特徴とする。 According to a third aspect of the present invention, there is provided the semiconductor device according to the first aspect, wherein the second resin layer is an entire surface of the first resin layer opposite to the wiring board side. It is characterized by being formed.
また、本発明の請求項4記載の半導体装置は、請求項3記載の半導体装置であって、前記第2の樹脂層は、さらに、前記第1の樹脂層の開口側端面を覆うように形成されていることを特徴とする。 According to a fourth aspect of the present invention, there is provided the semiconductor device according to the third aspect, wherein the second resin layer is further formed so as to cover an opening side end surface of the first resin layer. It is characterized by being.
また、本発明の請求項5記載の半導体装置は、配線基板と、前記配線基板に実装された半導体素子と、前記配線基板上の前記半導体素子が実装された領域を開口して形成された第1の樹脂層と、前記配線基板と前記半導体素子とを接合する封止樹脂と、前記封止樹脂の端面の前記配線基板側の端部上を被覆するように形成された第2の樹脂層と、を備え、前記第2の樹脂層は、前記第1の樹脂層よりも柔らかい材質、あるいは延性を有するとともに、前記第1の樹脂層よりも破断時の応力値が小さい材質であることを特徴とする。 According to a fifth aspect of the present invention, there is provided a semiconductor device formed by opening a wiring board, a semiconductor element mounted on the wiring board, and a region on the wiring board where the semiconductor element is mounted. 1 resin layer, a sealing resin for joining the wiring substrate and the semiconductor element, and a second resin layer formed so as to cover the end portion of the end surface of the sealing resin on the wiring substrate side The second resin layer is made of a material softer than the first resin layer or a material having a ductility and a stress value at breakage smaller than that of the first resin layer. Features.
また、本発明の請求項6記載の半導体装置は、請求項1ないし5のいずれかに記載の半導体装置であって、前記第2の樹脂層は、さらに、前記封止樹脂よりも硬化収縮が少ない材質であることを特徴とする。
Moreover, the semiconductor device according to
また、本発明の請求項7記載の半導体装置は、請求項1ないし6のいずれかに記載の半導体装置であって、前記第2の樹脂層は、前記第1の樹脂層よりも剛性率が低く、2GPa以下であることを特徴とする。 A semiconductor device according to a seventh aspect of the present invention is the semiconductor device according to any one of the first to sixth aspects, wherein the second resin layer has a rigidity higher than that of the first resin layer. Low and 2 GPa or less.
また、本発明の請求項8記載の半導体装置は、請求項1ないし6のいずれかに記載の半導体装置であって、前記第2の樹脂層は、前記第1の樹脂層よりも破断歪みが大きく、3%以上であり、且つ前記第1の樹脂層よりも破断時の応力値が小さいことを特徴とする。 In addition, a semiconductor device according to an eighth aspect of the present invention is the semiconductor device according to any one of the first to sixth aspects, wherein the second resin layer has a fracture strain more than that of the first resin layer. It is large, 3% or more, and has a smaller stress value at break than the first resin layer.
また、本発明の請求項9記載の半導体装置は、請求項1ないし8のいずれかに記載の半導体装置であって、前記第1の樹脂層はソルダーレジストであることを特徴とする。また、本発明の請求項10記載の半導体装置は、請求項9記載の半導体装置であって、前記第2の樹脂層は、前記第1の樹脂層とは異なる材料からなるソルダーレジストであることを特徴とする。
A semiconductor device according to a ninth aspect of the present invention is the semiconductor device according to any one of the first to eighth aspects, wherein the first resin layer is a solder resist. The semiconductor device according to
また、本発明の請求項11記載の半導体装置は、請求項1ないし10のいずれかに記載の半導体装置であって、前記第2の樹脂層は、液状の樹脂材が硬化されたものであることを特徴とする。 A semiconductor device according to an eleventh aspect of the present invention is the semiconductor device according to any one of the first to tenth aspects, wherein the second resin layer is obtained by curing a liquid resin material. It is characterized by that.
また、本発明の請求項12記載の半導体装置は、請求項1ないし10のいずれかに記載の半導体装置であって、前記第2の樹脂層は、常温で固体のシート状の樹脂材が加熱溶融硬化されたものであることを特徴とする。 A semiconductor device according to a twelfth aspect of the present invention is the semiconductor device according to any one of the first to tenth aspects, wherein the second resin layer is heated by a sheet-like resin material that is solid at room temperature. It is melt-cured.
また、本発明の請求項13記載の半導体装置は、請求項1ないし12のいずれかに記載の半導体装置であって、前記封止樹脂は、液状の樹脂材が硬化されたものであることを特徴とする。 A semiconductor device according to a thirteenth aspect of the present invention is the semiconductor device according to any one of the first to twelfth aspects, wherein the sealing resin is obtained by curing a liquid resin material. Features.
また、本発明の請求項14記載の半導体装置は、請求項1ないし12のいずれかに記載の半導体装置であって、前記封止樹脂は、常温で固体のシート状の樹脂材が加熱溶融硬化されたものであることを特徴とする。
The semiconductor device according to
また、本発明の請求項15記載の半導体装置は、請求項1ないし14のいずれかに記載の半導体装置であって、前記封止樹脂は、導電性の粒子を含むことを特徴とする。 A semiconductor device according to a fifteenth aspect of the present invention is the semiconductor device according to any one of the first to fourteenth aspects, wherein the sealing resin includes conductive particles.
本発明によれば、封止樹脂材を介したフリップチップ工法、とりわけ圧接方式により半導体素子が実装された半導体装置において、封止樹脂材の強力な収縮力に起因する配線基板上のソルダーレジストのクラック損傷や、銅配線の断線、配線基板の基材のクラック損傷を防止でき、信頼性の高い半導体装置を実現できる。 According to the present invention, in a semiconductor device on which a semiconductor element is mounted by a flip chip method using a sealing resin material, particularly a pressure contact method, the solder resist on the wiring board caused by the strong contraction force of the sealing resin material It is possible to prevent crack damage, disconnection of copper wiring, and crack damage to the base material of the wiring board, thereby realizing a highly reliable semiconductor device.
さらに、低温から125℃、150℃といった高温に至るまでの温度変化に半導体装置が曝されたときにも、封止樹脂の熱収縮および熱膨張に起因する応力を吸収でき、配線基板上のソルダーレジストのクラック損傷や、銅配線の断線、配線基板の基材のクラック損傷を防止でき、品質および周囲温度変動に対する信頼性の高い半導体装置を実現できる。 Furthermore, even when the semiconductor device is exposed to a temperature change from low temperature to high temperature such as 125 ° C. and 150 ° C., it can absorb the stress caused by thermal shrinkage and thermal expansion of the sealing resin, and the solder on the wiring board Resist crack damage, copper wiring disconnection, and wiring board base material crack damage can be prevented, and a highly reliable semiconductor device with respect to quality and ambient temperature fluctuations can be realized.
以下、本発明の実施の形態について、図面を交えて説明する。
図1(a)は本実施の形態における半導体装置の平面を示す図、図1(b)は図1(a)に示すA−A部の断面を示す図である。
Hereinafter, embodiments of the present invention will be described with reference to the drawings.
FIG. 1A is a diagram illustrating a plan view of the semiconductor device according to the present embodiment, and FIG. 1B is a diagram illustrating a cross-section of the AA portion illustrated in FIG.
図1において、1は配線基板、2は半導体素子、3は第1の基板電極、4は突起電極、5は封止樹脂、5a〜5dは封止樹脂5の端面の配線基板側の端部、6は第1の樹脂層、7は第2の樹脂層、8は第2の基板電極、9はハンダボールである。
In FIG. 1, 1 is a wiring substrate, 2 is a semiconductor element, 3 is a first substrate electrode, 4 is a protruding electrode, 5 is a sealing resin, and 5a to 5d are end portions of the end surface of the sealing
配線基板1は、少なくとも1つ以上の面に配線が設けられており、表面あるいは裏面のいずれか一方の面に予め形成された素子搭載部に第1の基板電極3が形成され、その素子搭載部に半導体素子2がフリップチップ実装されている。
The
半導体素子2は、回路配線が形成された面を配線基板1の素子搭載部に対向して配置されており、突起電極4を介して配線基板1上の第1の基板電極3に電気的に接続している。また、配線基板1と半導体素子2の間には封止樹脂5が充填されており、封止樹脂5は半導体素子2を配線基板1上に接合している。
The
また、配線基板1の半導体素子を搭載する側の面(主面)には、半導体素子2が実装される領域(素子搭載部)を開口して形成された第1の樹脂層6が設けられている。ここで、第1の樹脂層6はソルダーレジストであり、フリップチップ実装では、半導体素子上の狭いピッチの電極にあわせて、配線基板上にも狭いピッチで基板電極を設ける必要があり、解像度があまり高くできないソルダーレジストは、素子搭載部を開口して形成される。
Further, a
さらに、第1の樹脂層6が設けられた配線基板2の主面上には、第1の樹脂層6とは異なる材料からなり、第1の樹脂層6よりも柔らかい材質、あるいは延性を有するとともに、第1の樹脂層6よりも破断時の応力値が小さい材質の第2の樹脂層7が設けられている。具体的には、第2の樹脂層7は、封止樹脂5の端部(辺)5a〜5dと第1の樹脂層6との間に介在する。ここで、柔らかい材質とは、応力に対して歪みが小さいことをいい、延性を有する材質とは、歪みの増加に対して応力が増加する割合が、歪みが大きくなるにつれて小さくなる材料であって、大きく歪んでも低い応力のまま破断しないことをいう。
Further, the main surface of the
また、配線基板1の主面側とは反対側の面(裏面)に形成された第2の基板電極8上にはハンダボール9が設けられている。ハンダボール9は、配線基板1に設けられた配線(図示せず)を介して第1の基板電極3に電気的に接続する。
A
続いて、本実施の形態における半導体装置の製造方法の一例について説明する。
まず、主面上に第1、第2の樹脂層6、7が設けられた配線基板1の素子搭載部に、半導体素子2の外形と相似形で平面形状(シート状)の封止樹脂材を貼り付ける。この封止樹脂材は常温で固体の熱硬化性樹脂である。
Next, an example of a method for manufacturing a semiconductor device in this embodiment will be described.
First, a planar (sheet-like) sealing resin material similar to the outer shape of the
次に、半導体素子2を、突起電極4が形成されている面を配線基板1の主面側に向けて配置する。そして、封止樹脂材を間に挟み、加熱しながら半導体素子2を配線基板1へ押し付けて熱圧着する。このとき、封止樹脂材は加熱溶融され軟化する。軟化した封止樹脂材は半導体素子2の外側に押し広げられ、配線基板1と半導体素子2との間を埋め合わせる。さらに、軟化した封止樹脂材は、半導体素子2の外形からはみ出す。
Next, the
その後、パッケージの温度が徐々に下げられ、封止樹脂材は硬化して封止樹脂5となる。また、この封止樹脂材の硬化反応に伴う大きな収縮力により、配線基板1の第1の基板電極3と突起電極4との接続が行われる。そして、この接続後、配線基板1の裏面側に形成されている第2の基板電極8上にハンダボール9を形成する。
Thereafter, the temperature of the package is gradually lowered, and the sealing resin material is cured to become the sealing
以上のように、本実施の形態における半導体装置では、半導体素子2の外形の外側にはみ出している封止樹脂5の各端部5a〜5dの直下に、平面形状が矩形の第2の樹脂層7が応力緩和のために形成されている。
As described above, in the semiconductor device according to the present embodiment, the second resin layer having a rectangular planar shape is directly below each
第2の樹脂層7は、第1の樹脂層(ソルダーレジスト)6とは異なる材料であって、第1の樹脂層よりも柔らかい材質、あるいは延性を有するとともに、第1の樹脂層6よりも破断時の応力値が小さい材質の樹脂にて形成され、帯状の層となっている。第1の樹脂層6よりも柔らかい材質、あるいは延性を有するとともに、第1の樹脂層6よりも破断時の応力値が小さい材質とすることによって応力緩和効果がもたらされる。具体的には、封止樹脂材の強力な硬化収縮力に起因する応力や、封止樹脂5の熱収縮および熱膨張に起因する応力を緩和して、その力が直接第1の樹脂層6にかからないようにしている。したがって、配線基板1の表面に形成されている第1の樹脂層(ソルダーレジスト)6のクラック損傷や、配線基板1の基材のクラック損傷、導体配線の断線という不良を防止することができる。
The
なお、ここでは、配線基板1の素子搭載部を取り囲むように、素子搭載部の4つの辺に沿って環状に第2の樹脂層7を形成したが、これらの辺のうちの特定の辺に対してのみ第2の樹脂層7を形成してもよい。また、第2の樹脂層7として、ソルダーレジストの機能を有する樹脂を使用してもよい。
Here, the
また、封止樹脂5として、常温で固体のシート状の封止樹脂材が加熱溶融硬化されたものを用いたが、液状の封止樹脂材を配線基板1の素子搭載部に塗布して加熱硬化したものであっても構わない。また、非導電性の封止樹脂材と導電性の粒子を含む異方性導電性樹脂材のいずれを用いても実施できる。また、第2の樹脂層7としては、例えば、液状の樹脂材を硬化したものや、常温で固体のシート状の樹脂材を加熱溶融硬化したものを用いることができる。
Further, as the sealing
続いて、本実施の形態における半導体装置の他の例1について、図面を交えて説明する。
図2は本実施の形態における半導体装置の他の例1の断面を示す図である。図1に示す半導体装置では、半導体素子2の外形周辺の封止樹脂5の端部5a〜5dの直下付近にのみ第2の樹脂層7を形成したが、図2に示す半導体装置では、第2の樹脂層7は、さらに、第1の樹脂層(ソルダーレジスト)6の開口側端面をも覆うように形成されている。
Next, another example 1 of the semiconductor device in this embodiment will be described with reference to the drawings.
FIG. 2 is a view showing a cross section of another example 1 of the semiconductor device according to the present embodiment. In the semiconductor device shown in FIG. 1, the
このように第1の樹脂層6の端面下と配線基板1との接着部を第1の樹脂層よりも柔らかい材質、あるいは延性を有するとともに、第1の樹脂層6よりも破断時の応力値が小さい材質の樹脂で被覆することにより、第1の樹脂層6と配線基板1との剥離を抑えることができる。
As described above, the bonding portion between the end surface of the
続いて、本実施の形態における半導体装置の他の例2について、図面を交えて説明する。
図3は本実施の形態における半導体装置の他の例2の断面を示す図である。図1に示す半導体装置では、半導体素子2の外形周辺の封止樹脂5の端部5a〜5dの直下付近にのみ第2の樹脂層7を形成したが、図3に示す半導体装置では、第2の樹脂層7は、第1の樹脂層(ソルダーレジスト)6の配線基板1側とは反対側の全面に形成されている。
Next, another example 2 of the semiconductor device in this embodiment will be described with reference to the drawings.
FIG. 3 is a view showing a cross section of another example 2 of the semiconductor device according to the present embodiment. In the semiconductor device shown in FIG. 1, the
このように第1の樹脂層6の表面全面を第2の樹脂層7で被覆することにより、封止樹脂材としてシート状のものを用いた場合に封止樹脂材の貼り付け位置にばらつきがあっても、また封止樹脂材として液状のものを用いた場合に封止樹脂材の塗布位置にばらつきがあっても、配線基板1の表面に形成されている第1の樹脂層(ソルダーレジスト)6のクラック損傷や、配線基板1の基材のクラック損傷、導体配線の断線という不良を防止することができる。
By covering the entire surface of the
続いて、本実施の形態における半導体装置の他の例3について、図面を交えて説明する。
図4は本実施の形態における半導体装置の他の例3の断面を示す図である。図3に示す半導体装置では、第1の樹脂層(ソルダーレジスト)6の配線基板1側とは反対側の全面に第2の樹脂層7を形成したが、図4に示す半導体装置では、第2の樹脂層7は、さらに、第1の樹脂層6の開口側端面をも覆うように形成されている。
Next, another example 3 of the semiconductor device in this embodiment will be described with reference to the drawings.
FIG. 4 is a view showing a cross section of another example 3 of the semiconductor device according to the present embodiment. In the semiconductor device shown in FIG. 3, the
このように第1の樹脂層6の端面下と配線基板1との接着部を第1の樹脂層よりも柔らかい材質、あるいは延性を有するとともに、第1の樹脂層6よりも破断時の応力値が小さい材質の樹脂で被覆することにより、第1の樹脂層6と配線基板1との剥離を抑えることができる。
As described above, the bonding portion between the end surface of the
続いて、本実施の形態における半導体装置の他の例4について、図面を交えて説明する。
図5は本実施の形態における半導体装置の他の例4の断面を示す図である。図1〜4に示す半導体装置では、半導体素子2の外形周辺の封止樹脂5の端部5a〜5dの直下に第2の樹脂層7を形成したが、図5に示す半導体装置では、第2の樹脂層7は、封止樹脂5の端部上を被覆するように形成されている。
Next, another example 4 of the semiconductor device in this embodiment will be described with reference to the drawings.
FIG. 5 is a view showing a cross section of another example 4 of the semiconductor device according to the present embodiment. In the semiconductor device shown in FIGS. 1 to 4, the
この図5に示す半導体装置の製造方法の一例について説明する。
まず、主面上に第1の樹脂層(ソルダーレジスト)6が設けられた配線基板1の素子搭載部に、半導体素子2の外形と相似形で平面形状(シート状)の封止樹脂材を貼り付ける。この封止樹脂材は常温で固体の熱硬化性樹脂である。
An example of a method for manufacturing the semiconductor device shown in FIG. 5 will be described.
First, a planar (sheet-like) sealing resin material similar to the outer shape of the
次に、半導体素子2を、突起電極4が形成されている面を配線基板1の主面側に向けて配置する。そして、封止樹脂材を間に挟み、加熱しながら半導体素子2を配線基板1へ押し付けて熱圧着する。このとき、封止樹脂材は加熱溶融され軟化する。軟化した封止樹脂材は半導体素子2の外側に押し広げられ、配線基板1と半導体素子2との間を埋め合わせる。さらに、軟化した封止樹脂材は、半導体素子2の外形からはみ出す。
Next, the
次に、パッケージの温度が徐々に下げられ、封止樹脂材は硬化して封止樹脂5となる。また、この封止樹脂材の硬化反応に伴う大きな収縮力により、配線基板1の第1の基板電極3と突起電極4との接続が行われる。
Next, the temperature of the package is gradually lowered, and the sealing resin material is cured to become the sealing
次に、半導体素子2の外形の外側にはみ出している封止樹脂5の端面の配線基板1側の各端部を被覆するように第2の樹脂層7を形成する。そして、この第2の樹脂層7の形成後、配線基板1の裏面側に形成されている第2の基板電極8上にハンダボール9を形成する。
Next, a
このように第1の樹脂層よりも柔らかい材質、あるいは延性を有するとともに、第1の樹脂層6よりも破断時の応力値が小さい材質の第2の樹脂層7によって封止樹脂5の端部上を被覆することで、封止樹脂5と第1の樹脂層6との接合界面に応力が集中するのを防ぐことができる。さらに、封止樹脂5および第1の樹脂層6の変形を拘束して、封止樹脂5と第1の樹脂層6との接合界面付近に亀裂が生じるのを防止し、かつ亀裂が開いていくのを抑制することができる。したがって、配線基板1の表面に形成されている第1の樹脂層(ソルダーレジスト)6のクラック損傷や、配線基板1の基材のクラック損傷、導体配線の断線という不良の発生を抑えることができる。
As described above, the end portion of the sealing
続いて、第2の樹脂層7の材質について説明する。まず、第2の樹脂層7の材質が、第1の樹脂層(ソルダーレジスト)6よりも剛性率が低く、2GPa以下である場合について説明する。
Subsequently, the material of the
図6に、第1の樹脂層6よりも剛性率が低く、2GPa以下である第2の樹脂層7の機械特性(「応力−歪み特性」)を示す。図6において、Aは第1の樹脂層6の機械特性を表すグラフ、Bは第2の樹脂層7の機械特性を表すグラフである。また、横軸は歪み変位、縦軸は応力値である。また、「×」は破断したことを表している。
FIG. 6 shows the mechanical characteristics (“stress-strain characteristics”) of the
応力−歪み特性において、グラフの傾きはヤング率(E)を表す。ヤング率(E)と剛性率(G)は比例関係にあり、図6に示すように、第2の樹脂層7は第1の樹脂層6よりも剛性率が小さい。一般に、剛性率の大小は、発生する応力と同じ傾向となっており、ヤング率(剛性率)が小さいほど、同じ変形・歪みを起こしたときに発生する応力が小さい、すなわち“柔らかい“ということになる。
In the stress-strain characteristics, the slope of the graph represents Young's modulus (E). The Young's modulus (E) and the rigidity modulus (G) are in a proportional relationship, and the
したがって、第2の樹脂層7として、第1の樹脂層6よりも剛性率が低く、2GPa以下の柔らかい材質のものを用いることで、封止樹脂材の硬化収縮により歪みが生じたり、封止樹脂5と配線基板1および第1の樹脂層(ソルダーレジスト)6との熱膨張のミスマッチや、封止樹脂5の熱収縮により歪みが生じときに、その歪により発生する応力を第2の樹脂層7にて抑えることができる。つまり、封止樹脂5に発生する応力が、第1の樹脂層6に及ばないようにすることができる。
Therefore, the
続いて、第2の樹脂層7の材質が、第1の樹脂層(ソルダーレジスト)6よりも破断歪みが大きく、3%以上である場合について説明する。図7に、第1の樹脂層6よりも破断歪みが大きく、3%以上である第2の樹脂層7の機械特性(「応力−歪み特性」)を示す。
Subsequently, the case where the material of the
図7において、Aは第1の樹脂層6の機械特性を表すグラフ、Cは第2の樹脂層7の機械特性を表すグラフである。また、横軸は歪み変位、縦軸は応力値である。また、「×」は破断したことを表している。
In FIG. 7, A is a graph representing the mechanical properties of the
一般に、応力−歪み特性を表すグラフが直線形状に近く、延び(水平部)が少ない材質のものは、ある応力で脆性的に壊れ、クラックが生じることになる。図7に示すように、第1、2の樹脂層6、7は同じ剛性で、かつ限界応力(強度)も同じであるが、第1の樹脂層6のグラフAは延び(水平部)が少なく、限界応力で脆性的に壊れる。これに対して第2の樹脂層7のグラフCは限界応力での延び(水平部)が大きく、破断時の歪み(“破断歪み”)が第1の樹脂層6よりも大きい。すなわち、第2の樹脂層7は延性を有している。
In general, a material having a stress-strain characteristic graph that is close to a linear shape and has a small extension (horizontal portion) breaks brittlely with a certain stress, resulting in a crack. As shown in FIG. 7, the first and
このように、第2の樹脂層7として、第1の樹脂層6よりも破断歪みが大きく、3%以上の延性を有する材質のものを用いることで、なかなか第2の樹脂層7自身は破断しないことになる。ただし、グラフCに示す材質の第2の樹脂層7は限界応力が高いため、その応力が隣接する第1の樹脂層6にもかかる懸念は残る。
As described above, the
そこで、第2の樹脂層7として延性を有する材質のものを用いる場合には、第1の樹脂層6よりも破断歪みが大きく、3%以上であることに加えて、さらに、第1の樹脂層6よりも破断時の応力値(限界応力)が小さいものを用いる。図7において、Dはそのような材質の第2の樹脂層7の機械特性を表すグラフである。この場合、隣接する第1の樹脂層6へかかる応力が少なくなり、配線基板1の表面に形成されている第1の樹脂層(ソルダーレジスト)6のクラック損傷や、配線基板1の基材のクラック損傷、導体配線の断線という不良を防止することができる。
Therefore, when a material having ductility is used as the
なお、第2の樹脂層7として、第1の樹脂層(ソルダーレジスト)6よりも柔らかい材質、あるいは延性を有するとともに、第1の樹脂層6よりも破断時の応力値が小さい材質であって、且つ封止樹脂5よりも硬化収縮が小さい材質の樹脂を用いるのが好適である。収縮歪み量が小さくなることによって、隣接する第1の樹脂層6へ影響する応力も低減でき、第1の樹脂層6のクラック等の不良を防止する効果がさらに大きくなる。
The
本発明にかかる半導体装置は、良好な接続信頼性を保ちつつ、ソルダーレジストのクラック故障のない半導体装置を提供でき、BGA/CSPなどのフリップチップ実装タイプの半導体装置に有用である。 INDUSTRIAL APPLICABILITY The semiconductor device according to the present invention can provide a semiconductor device that does not have a solder resist crack failure while maintaining good connection reliability, and is useful for flip-chip mounting type semiconductor devices such as BGA / CSP.
1 配線基板
2 半導体素子
3 第1の基板電極
4 突起電極
5 封止樹脂
5a〜5d 封止樹脂の端面の配線基板側の端部
6 第1の樹脂層
7 第2の樹脂層
8 第2の基板電極
9 ハンダボール
10 配線基板
11 半導体素子
12 基板電極
13 突起電極
14 封止樹脂
15 ソルダーレジスト
16 基板電極
17 ハンダボール
18 成型封止材
19 クラック
DESCRIPTION OF
Claims (15)
前記配線基板に実装された半導体素子と、
前記配線基板上の前記半導体素子が実装された領域を開口して形成された第1の樹脂層と、
前記配線基板と前記半導体素子とを接合する封止樹脂と、
前記封止樹脂の端面の前記配線基板側の端部と前記第1の樹脂層との間に形成された第2の樹脂層と、
を備え、前記第2の樹脂層は、前記第1の樹脂層よりも柔らかい材質、あるいは延性を有するとともに、前記第1の樹脂層よりも破断時の応力値が小さい材質であることを特徴とする半導体装置。 A wiring board;
A semiconductor element mounted on the wiring board;
A first resin layer formed by opening a region where the semiconductor element is mounted on the wiring board;
A sealing resin for bonding the wiring board and the semiconductor element;
A second resin layer formed between the end portion of the end surface of the sealing resin on the wiring board side and the first resin layer;
The second resin layer is made of a material softer than the first resin layer or a material having a ductility and a stress value at breakage smaller than that of the first resin layer. Semiconductor device.
前記配線基板に実装された半導体素子と、
前記配線基板上の前記半導体素子が実装された領域を開口して形成された第1の樹脂層と、
前記配線基板と前記半導体素子とを接合する封止樹脂と、
前記封止樹脂の端面の前記配線基板側の端部上を被覆するように形成された第2の樹脂層と、
を備え、前記第2の樹脂層は、前記第1の樹脂層よりも柔らかい材質、あるいは延性を有するとともに、前記第1の樹脂層よりも破断時の応力値が小さい材質であることを特徴とする半導体装置。 A wiring board;
A semiconductor element mounted on the wiring board;
A first resin layer formed by opening a region where the semiconductor element is mounted on the wiring board;
A sealing resin for bonding the wiring board and the semiconductor element;
A second resin layer formed so as to cover an end portion of the end surface of the sealing resin on the wiring board side;
The second resin layer is made of a material softer than the first resin layer or a material having a ductility and a stress value at breakage smaller than that of the first resin layer. Semiconductor device.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
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JP2007013206A JP2008181984A (en) | 2007-01-24 | 2007-01-24 | Semiconductor device |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
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JP2007013206A JP2008181984A (en) | 2007-01-24 | 2007-01-24 | Semiconductor device |
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Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2008210827A (en) * | 2007-02-23 | 2008-09-11 | Nec Electronics Corp | Semiconductor device and wiring board, and their manufacturing process |
-
2007
- 2007-01-24 JP JP2007013206A patent/JP2008181984A/en active Pending
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