JP2008141051A - Method and apparatus for manufacturing semiconductor device - Google Patents

Method and apparatus for manufacturing semiconductor device Download PDF

Info

Publication number
JP2008141051A
JP2008141051A JP2006327178A JP2006327178A JP2008141051A JP 2008141051 A JP2008141051 A JP 2008141051A JP 2006327178 A JP2006327178 A JP 2006327178A JP 2006327178 A JP2006327178 A JP 2006327178A JP 2008141051 A JP2008141051 A JP 2008141051A
Authority
JP
Japan
Prior art keywords
film
metal nitride
semiconductor device
substrate
nitride film
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP2006327178A
Other languages
Japanese (ja)
Inventor
Kosaku Shibata
耕作 柴田
Higashishin Kin
東信 金
Masanobu Hatanaka
正信 畠中
Harunori Ushigawa
治憲 牛川
Taishiyaku Ri
泰錫 李
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Ulvac Inc
Original Assignee
Ulvac Inc
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Ulvac Inc filed Critical Ulvac Inc
Priority to JP2006327178A priority Critical patent/JP2008141051A/en
Publication of JP2008141051A publication Critical patent/JP2008141051A/en
Pending legal-status Critical Current

Links

Images

Landscapes

  • Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)
  • Electrodes Of Semiconductors (AREA)

Abstract

<P>PROBLEM TO BE SOLVED: To provide a method and apparatus for manufacturing a semiconductor device in which burying capability of an Al film is improved. <P>SOLUTION: A control section coats the surface of a silicon substrate S having a via hole VH with a metal film BM1 (Ti film) and a metal nitride film BM2 (TiN film), and uses a CVD method to form an Al-CVD film P1 in the inside of the via hole VH coated with the metal nitride film BM2. Prior to burying the Al-CVD film P1, the control section sputters a part of the metal nitride film BM2 positioned on the bottom of the via hole VH to form a re-adhesive nitride film BMr on the side wall of the bottom of the via hole VH. <P>COPYRIGHT: (C)2008,JPO&INPIT

Description

本発明は、半導体装置の製造方法及び半導体装置の製造装置に関する。   The present invention relates to a semiconductor device manufacturing method and a semiconductor device manufacturing apparatus.

半導体装置の多層配線技術においては、導体間を結ぶプラグを形成するため、層間絶縁膜に設けられたホールに金属材料を充填させる埋め込み技術が用いられている。アルミニウム(Al)の埋め込み技術は、低い電気抵抗率と高い信頼性を有したプラグを実現させる上において不可欠である。   In the multilayer wiring technology of a semiconductor device, in order to form a plug connecting conductors, a filling technology is used in which a hole provided in an interlayer insulating film is filled with a metal material. Aluminum (Al) embedding technology is indispensable for realizing a plug having low electrical resistivity and high reliability.

Alの埋め込み技術としては、PVD(Physical Vapor Deposition)法の1つである
リフロースパッタ法が知られている。リフロースパッタ法は、ホールを有した基板にAlをスパッタし、その後、同基板を昇温して付着したAlを流動させる。この流動するAlが、埋め込み性の向上を担う。
As an Al embedding technique, a reflow sputtering method which is one of PVD (Physical Vapor Deposition) methods is known. In the reflow sputtering method, Al is sputtered onto a substrate having holes, and then the Al deposited thereon is fluidized by raising the temperature of the substrate. This flowing Al is responsible for improving the embedding property.

しかし、半導体装置の高速化や高集積化の進展に伴い、デザインルールが縮小化すると、ホールのアスペクト比が増大して上記のPVD法ではホールの内部を完全に埋め込むことが困難となる。例えば、ホールの内径が0.18μm以下になる、あるいは、アスペクト比が3以上になるデザインルールの場合、上記のPVD法では、プラグの内部に空隙(以下単に、ボイドという。)を発生させてしまう。   However, when the design rule is reduced with the progress of high speed and high integration of the semiconductor device, the aspect ratio of the hole is increased and it becomes difficult to completely fill the inside of the hole by the PVD method. For example, in the case of a design rule in which the inner diameter of the hole is 0.18 μm or less, or the aspect ratio is 3 or more, in the PVD method, a void (hereinafter simply referred to as a void) is generated inside the plug. End up.

そこで、Alの埋め込み技術においては、従来より、埋め込み性の向上を図るため、CVD(Chemical Vapor Deposition)法を用いる提案がなされている。特許文献1は、ホ
ールの内壁にTi膜、TiN膜、又はTi/TiN膜などの核形成用ライナー膜を成膜し、同核形成用ライナー膜の上にAl−CVD膜とAl−PVD膜を積層させる。核形成用ライナー膜は、Al−CVD膜が成長できる表面を提供するものである。これにより、ホールの埋め込み性と半導体装置の信頼性を向上させる。
特開2002−280387号公報
Therefore, in the Al embedding technique, conventionally, a CVD (Chemical Vapor Deposition) method has been proposed in order to improve the embedding property. In Patent Document 1, a nucleation liner film such as a Ti film, a TiN film, or a Ti / TiN film is formed on the inner wall of a hole, and an Al-CVD film and an Al-PVD film are formed on the nucleation liner film. Laminate. The nucleation liner film provides a surface on which an Al-CVD film can be grown. Thereby, the hole filling property and the reliability of the semiconductor device are improved.
JP 2002-280387A

Al−CVD膜は、その前駆体(例えば、MPA(Methylpyrrolidine Alane))が下
地の表面に付着し、同表面との間の電子授受、すなわち表面反応によって成長する。
一方、TiN膜は、Al−CVD膜(あるいは、前駆体)との間の密着性が乏しく、また同前駆体との間の電子授受を期待できない。そのため、基板の最表面がTiN膜で被覆されている場合、Al−CVD膜は、基板の最表面において成長し難く、たとえ成長する場合であっても、極めて不均一に成長してホールの内部にボイドを形成させる。
In the Al-CVD film, a precursor (for example, MPA (Methylpyrrolidine Alane)) adheres to the surface of the base, and grows by electron transfer, that is, surface reaction with the surface.
On the other hand, the TiN film has poor adhesion to the Al-CVD film (or precursor) and cannot be expected to exchange electrons with the precursor. Therefore, when the outermost surface of the substrate is covered with a TiN film, the Al-CVD film is difficult to grow on the outermost surface of the substrate, and even if it grows, it grows very unevenly and the inside of the hole To form voids.

また、Ti膜は、Al−CVD膜(あるいは、前駆体)との間に高抵抗のTi-Al合
金を形成させる。そのため、ホールの内壁がTi膜である場合、Al−CVD膜は、前駆体の付着確率が高い領域、すなわちホールの開口に近い領域で成長し、ホールの内部を充填する前にホールの開口を閉塞させてしまう。また、Ti膜は、プラグの全周囲にTi-
Al合金を形成するため、デザインルールが広い場合であっても、配線抵抗を増加させてしまう。
In addition, a high resistance Ti—Al alloy is formed between the Ti film and the Al—CVD film (or precursor). Therefore, when the inner wall of the hole is a Ti film, the Al-CVD film grows in a region where the precursor adhesion probability is high, that is, a region close to the hole opening, and the hole opening is filled before filling the hole. It will be blocked. The Ti film has Ti-
Since the Al alloy is formed, the wiring resistance is increased even when the design rule is wide.

これらの結果、特許文献1は、CVD法を利用している一方で、同CVD法に適した下地膜について十分な検討がなされておらず、埋め込み特性を向上させ難いものであった。
本願発明は、上記問題を解決するためになされたものであって、Al膜の埋め込み性を
向上させた半導体装置の製造方法、及び半導体装置の製造装置を提供するものである。
As a result, while Patent Document 1 uses the CVD method, the base film suitable for the CVD method has not been sufficiently studied, and it has been difficult to improve the embedding characteristics.
The present invention has been made to solve the above problems, and provides a method for manufacturing a semiconductor device and an apparatus for manufacturing a semiconductor device, in which the embeddability of an Al film is improved.

本発明者らは、Al−CVD膜の埋め込み性能を検討する中で、Al−CVD膜の埋め込み性能が金属窒化膜の形成方法に大きく依存することを見出した。すなわち、Al−CVD膜を成膜する前に、金属窒化膜の一部をスパッタし、スパッタされた金属窒化膜の一部を金属窒化膜の上に再付着させる。本発明者らは、この再付着した金属窒化膜がAl−CVD膜の核として機能し、Al−CVD膜を成長させることを見出した。   The inventors have found that the Al-CVD film embedding performance greatly depends on the method of forming the metal nitride film, while examining the Al-CVD film embedding performance. That is, before forming the Al-CVD film, a part of the metal nitride film is sputtered, and a part of the sputtered metal nitride film is reattached on the metal nitride film. The present inventors have found that this reattached metal nitride film functions as the nucleus of the Al-CVD film and grows the Al-CVD film.

上記目的を達成するため、請求項1に記載の発明では、凹部を有した基板の表面に金属膜を被覆する工程と、前記金属膜の表面に金属窒化膜を被覆する工程と、前記金属窒化膜に被覆された前記凹部の内部にCVD法を用いて第一アルミニウム膜を埋め込む工程と、を有した半導体装置の製造方法であって、前記第一アルミニウム膜を埋め込む前に、前記凹部の底部に位置する前記金属窒化膜の一部をスパッタし、前記底部に位置する前記金属窒化膜の一部を前記底部の側壁に再付着させること、を要旨とする。   In order to achieve the above object, according to the first aspect of the present invention, a step of coating a metal film on the surface of a substrate having a recess, a step of coating a metal nitride film on the surface of the metal film, and the metal nitriding And embedding a first aluminum film in the concave portion covered with the film using a CVD method, wherein the bottom of the concave portion is embedded before the first aluminum film is embedded. The gist of the present invention is to sputter part of the metal nitride film located on the bottom and reattach part of the metal nitride film located on the bottom to the side wall of the bottom.

この構成によれば、底部の側壁から第一アルミニウム膜が成長する。したがって、第一アルミニウム膜のボトムアップを図ることができ、第一アルミニウム膜の埋め込み性を向上させることができる。   According to this configuration, the first aluminum film grows from the bottom side wall. Therefore, the bottom up of the first aluminum film can be achieved, and the embedding property of the first aluminum film can be improved.

請求項2に記載の発明では、請求項1に記載の半導体装置の製造方法であって、前記金属窒化膜を被覆するときに、前記凹部の底部に位置する前記金属窒化膜の一部をスパッタし、前記底部に位置する前記金属窒化膜の一部を前記底部の側壁に再付着させること、を要旨とする。   According to a second aspect of the present invention, in the method of manufacturing a semiconductor device according to the first aspect, when the metal nitride film is coated, a part of the metal nitride film located at the bottom of the recess is sputtered. Then, a gist is to reattach a part of the metal nitride film located at the bottom to the side wall of the bottom.

この構成によれば、前記金属窒化膜を被覆するときに、金属窒化膜の一部をスパッタさせて金属窒化膜の一部を再付着させることができる。したがって、金属窒化膜の被覆と、金属窒化膜の再付着と、を同時に実行させることができる。この結果、金属窒化膜の被覆と、金属窒化膜の再付着と、を別々に実行させる場合に比べ、処理工程数を削減させることができ、スループットを向上させることができる。   According to this configuration, when coating the metal nitride film, a part of the metal nitride film can be sputtered to reattach a part of the metal nitride film. Therefore, the coating of the metal nitride film and the reattachment of the metal nitride film can be performed simultaneously. As a result, the number of processing steps can be reduced and the throughput can be improved as compared with the case where the coating of the metal nitride film and the reattachment of the metal nitride film are performed separately.

請求項3に記載の発明では、請求項1又は2に記載の半導体装置の製造方法であって、前記凹部の底部に位置する前記金属窒化膜の一部をスパッタし、前記底部に位置する前記金属窒化膜を略平坦にさせること、を要旨とする。   According to a third aspect of the present invention, in the method of manufacturing a semiconductor device according to the first or second aspect, the metal nitride film located at the bottom of the recess is sputtered to be part of the metal nitride film. The gist is to make the metal nitride film substantially flat.

この構成によれば、底部に位置する金属窒化膜の過剰なスパッタを回避させることができ、かつ、金属窒化膜の再付着量を安定させることができる。この結果、より高い再現性の下において凹部を埋め込むことができる。   According to this configuration, excessive sputtering of the metal nitride film located at the bottom can be avoided, and the amount of reattachment of the metal nitride film can be stabilized. As a result, the concave portion can be embedded under higher reproducibility.

請求項4に記載の発明では、請求項1〜3のいずれか1つに記載の半導体装置の製造方法であって、前記第一アルミニウム膜をアニールすること、を要旨とする。
この構成によれば、第一アルミニウム膜と金属窒化膜との間の密着性を向上させることができる。したがって、第一アルミニウム膜の状態を安定させることができ、第一アルミニウム膜の埋め込み性を、より確実に向上させることができる。
The invention according to claim 4 is the manufacturing method of the semiconductor device according to any one of claims 1 to 3, wherein the first aluminum film is annealed.
According to this configuration, the adhesion between the first aluminum film and the metal nitride film can be improved. Therefore, the state of the first aluminum film can be stabilized, and the embedding property of the first aluminum film can be improved more reliably.

請求項5に記載の発明では、請求項1〜4のいずれか1つに記載の半導体装置の製造方法であって、前記第一アルミニウム膜の上に更にPVD法を用いて第二アルミニウム膜を積層すること、を要旨とする。   The invention according to claim 5 is the method for manufacturing a semiconductor device according to any one of claims 1 to 4, wherein the second aluminum film is further formed on the first aluminum film by using a PVD method. The gist is to laminate.

この構成によれば、アルミニウム膜が、埋め込み性に優れたCVD法による第一アルミ
ニウム膜と、処理能力に優れたPVD法による第二アルミニウム膜と、によって形成される。したがって、CVD法を用いて全ての第一アルミニウム膜を形成させる場合に比べて、スループットを向上させることができる。
According to this configuration, the aluminum film is formed by the first aluminum film by the CVD method excellent in embeddability and the second aluminum film by the PVD method excellent in processing capability. Therefore, the throughput can be improved as compared with the case where all the first aluminum films are formed using the CVD method.

請求項6に記載の発明では、請求項1〜5のいずれか1つに記載の半導体装置の製造方法であって、前記金属膜は、チタン、タンタル、ニッケル、コバルトのいずれか1つからなること、前記金属窒化膜は、窒化チタン、窒化タンタル、窒化ニッケル、窒化コバルトのいずれか1つからなること、を要旨とする。   The invention according to claim 6 is the method of manufacturing a semiconductor device according to any one of claims 1 to 5, wherein the metal film is made of any one of titanium, tantalum, nickel, and cobalt. In addition, the gist of the metal nitride film is any one of titanium nitride, tantalum nitride, nickel nitride, and cobalt nitride.

請求項7に記載の発明では、基板の表面に金属膜を被覆し前記金属膜に金属窒化膜を被覆する第一成膜部と、CVD法を用いて前記基板に第一アルミニウム膜を形成する第二成膜部と、前記第一成膜部と前記第二成膜部に前記基板を搬送する搬送部と、前記搬送部と前記第一成膜部を駆動し、前記表面に凹部を有した前記基板を前記第一成膜部に搬送させて前記基板に前記金属膜と前記金属窒化膜を被覆させ、前記搬送部と前記第二成膜部を駆動し、前記金属窒化膜を有した前記基板を第二成膜部に搬送させて前記金属窒化膜に被覆された前記凹部の内部に前記第一アルミニウム膜を形成させる制御部と、を備え、前記制御部は、前記第一成膜部を駆動して前記凹部の底部に位置する前記金属窒化膜の一部をスパッタさせ、前記底部に位置する前記金属窒化膜の一部を前記底部の側壁に再付着させること、を要旨とする。   In a seventh aspect of the present invention, the first aluminum film is formed on the substrate using a CVD method and a first film forming unit that covers the surface of the substrate with a metal film and a metal nitride film on the metal film. A second film forming unit; a transport unit that transports the substrate to the first film forming unit; and the second film forming unit; the transport unit and the first film forming unit are driven; and a recess is formed on the surface. The substrate was transported to the first film forming unit, the metal film and the metal nitride film were coated on the substrate, the transport unit and the second film forming unit were driven, and the metal nitride film was provided A control unit that transports the substrate to a second film forming unit to form the first aluminum film inside the recess covered with the metal nitride film, and the control unit includes the first film forming unit. A portion of the metal nitride film located at the bottom of the concave portion is sputtered to locate the bottom. It is reattached a portion of the metal nitride layer on the sidewalls of the bottom portion, and the gist.

この構成によれば、再付着した金属窒化膜によって、第一アルミニウム膜が底部の側壁から成長する。したがって、第一アルミニウム膜のボトムアップを図ることができ、第一アルミニウム膜の埋め込み性を向上させることができる。   According to this configuration, the first aluminum film grows from the bottom sidewall due to the reattached metal nitride film. Therefore, the bottom up of the first aluminum film can be achieved, and the embedding property of the first aluminum film can be improved.

請求項8に記載の発明では、請求項7に記載の半導体装置の製造装置であって、前記第一成膜部は、前記金属膜の構成元素からなるターゲットを用いた反応性スパッタ法にて前記金属窒化膜を前記基板に被覆するとともに、前記基板にバイアス電圧を印加して前記凹部の底部に位置する前記金属窒化膜の一部をスパッタするチャンバであること、前記制御部は、前記ターゲットをスパッタさせて前記金属窒化膜を被覆させるとき、前記基板にバイアス電圧を印加して前記凹部の底部に位置する前記金属窒化膜の一部をスパッタさせること、を要旨とする。   According to an eighth aspect of the present invention, in the semiconductor device manufacturing apparatus according to the seventh aspect, the first film forming unit is formed by a reactive sputtering method using a target made of a constituent element of the metal film. The chamber is a chamber that coats the metal nitride film on the substrate and applies a bias voltage to the substrate to sputter a part of the metal nitride film located at the bottom of the recess, and the control unit includes the target When the metal nitride film is coated by sputtering, a bias voltage is applied to the substrate to sputter part of the metal nitride film located at the bottom of the recess.

この構成によれば、制御部は、前記金属窒化膜を被覆するときに、金属窒化膜の一部をスパッタさせてスパッタ粒子を底部の側壁に再付着させることができる。したがって、金属窒化膜の被覆と、金属窒化膜の再付着と、を同時に実行させることができる。この結果、金属窒化膜の被覆と、金属窒化膜の再付着と、を別々に実行させる場合に比べ、処理工程を削減させることができ、スループットを向上させることができる。   According to this configuration, when the metal nitride film is coated, the control unit can sputter part of the metal nitride film to reattach the sputtered particles to the bottom sidewall. Therefore, the coating of the metal nitride film and the reattachment of the metal nitride film can be performed simultaneously. As a result, the processing steps can be reduced and the throughput can be improved as compared with the case where the coating of the metal nitride film and the reattachment of the metal nitride film are performed separately.

請求項9に記載の発明では、請求項7又は8に記載の半導体装置の製造装置であって、前記第一成膜部は、前記金属膜の構成元素からなるターゲットを用いた反応性スパッタ法にて前記金属窒化膜を形成するとともに、前記基板にバイアス電圧を印加して前記凹部の底部に位置する前記金属窒化膜の一部をスパッタするチャンバであること、前記制御部は、前記ターゲットをスパッタさせて前記金属窒化膜を被覆させるとき、前記基板にバイアス電圧を印加して前記凹部の底部に位置する前記金属窒化膜の一部をスパッタし、前記底部に位置する前記金属窒化膜を略平坦にさせること、を要旨とする。   The invention according to claim 9 is the semiconductor device manufacturing apparatus according to claim 7 or 8, wherein the first film forming unit is a reactive sputtering method using a target made of a constituent element of the metal film. Forming a metal nitride film and applying a bias voltage to the substrate to sputter a part of the metal nitride film located at the bottom of the recess, and the control unit When the metal nitride film is coated by sputtering, a bias voltage is applied to the substrate to sputter a part of the metal nitride film located at the bottom of the recess, and the metal nitride film located at the bottom is substantially The gist is to make it flat.

この構成によれば、制御部は、底部に位置する金属窒化膜の過剰なスパッタを回避させることができ、かつ、金属窒化膜の再付着量を安定させることができる。この結果、より高い再現性の下において凹部を埋め込むことができる。   According to this configuration, the control unit can avoid excessive sputtering of the metal nitride film located at the bottom, and can stabilize the reattachment amount of the metal nitride film. As a result, the concave portion can be embedded under higher reproducibility.

請求項10に記載の発明では、請求項7〜9のいずれか1つに記載の半導体装置の製造装置であって、前記基板を所定の温度に昇温するアニール部を備え、前記搬送部は、前記アニール部に前記基板を搬送すること、前記制御部は、前記搬送部を駆動して前記第一アルミニウム膜の形成された前記基板を前記アニール部に搬送させ、前記アニール部を駆動して前記基板を前記所定の温度に昇温させ前記第一アルミニウム膜をアニールさせること、を要旨とする。   According to a tenth aspect of the present invention, in the semiconductor device manufacturing apparatus according to any one of the seventh to ninth aspects, the apparatus includes an annealing unit that raises the temperature of the substrate to a predetermined temperature. Transporting the substrate to the annealing unit, the control unit driving the transport unit to transport the substrate on which the first aluminum film is formed to the annealing unit, and driving the annealing unit. The gist is to raise the temperature of the substrate to the predetermined temperature and to anneal the first aluminum film.

この構成によれば、制御部は、第一アルミニウム膜をアニールさせて、同第一アルミニウム膜と金属窒化膜との間の密着性を向上させる。したがって、第一アルミニウム膜の状態を安定させることができ、第一アルミニウム膜の埋め込み性を、より確実に向上させることができる。   According to this configuration, the control unit anneals the first aluminum film to improve the adhesion between the first aluminum film and the metal nitride film. Therefore, the state of the first aluminum film can be stabilized, and the embedding property of the first aluminum film can be improved more reliably.

請求項11に記載の発明では、請求項7〜10のいずれか1つに記載の半導体装置の製造装置であって、PVD法を用いて前記基板に第二アルミニウム膜を被覆する第三成膜部を備え、前記搬送部は、前記第三成膜部に前記基板を搬送すること、前記制御部は、前記搬送部を駆動して前記第一アルミニウム膜の形成された前記基板を前記第三成膜部に搬送させ、前記第三成膜部を駆動して前記第一アルミニウム膜の上に更に前記第二アルミニウム膜を積層させること、を要旨とする。   According to an eleventh aspect of the present invention, there is provided the semiconductor device manufacturing apparatus according to any one of the seventh to tenth aspects, wherein the substrate is coated with a second aluminum film using a PVD method. A transfer unit that transfers the substrate to the third film forming unit, and the control unit drives the transfer unit to transfer the substrate on which the first aluminum film is formed to the third film forming unit. The gist is to transport the film to the film forming unit and drive the third film forming unit to further stack the second aluminum film on the first aluminum film.

この構成によれば、制御部は、埋め込み性に優れたCVD法による第一アルミニウム膜に対し、処理能力に優れたPVD法による第二アルミニウム膜を積層させる。したがって、CVD法を用いて全てのアルミニウム膜を形成させる場合に比べて、スループットを向上させることができる。   According to this configuration, the control unit stacks the second aluminum film by the PVD method having excellent processing capability on the first aluminum film by the CVD method having excellent embedding property. Accordingly, the throughput can be improved as compared with the case where all the aluminum films are formed using the CVD method.

請求項12に記載の発明では、請求項7〜11のいずれか1つに記載の半導体装置の製造装置であって、前記第一成膜部は、チタン、タンタル、ニッケル、コバルトのいずれか1つからなるターゲットを搭載すること、を要旨とする。   The invention according to claim 12 is the semiconductor device manufacturing apparatus according to any one of claims 7 to 11, wherein the first film forming portion is any one of titanium, tantalum, nickel, and cobalt. The gist is to mount a target consisting of three.

上記したように、本発明によれば、Al膜の埋め込み性を向上させた半導体装置の製造方法及び半導体装置の製造装置を提供することができる。   As described above, according to the present invention, it is possible to provide a method for manufacturing a semiconductor device and an apparatus for manufacturing a semiconductor device with improved Al film embedding.

以下、本発明を具体化した一実施形態について説明する。まず、半導体装置の製造装置について説明する。図1は、製造装置としての成膜装置1を模式的に示す平面図である。図2及び図3は、それぞれ成膜装置1に搭載されたバリアメタルチャンバ4及びAl−CVDチャンバ5を示す概略断面図である。   Hereinafter, an embodiment embodying the present invention will be described. First, a semiconductor device manufacturing apparatus will be described. FIG. 1 is a plan view schematically showing a film forming apparatus 1 as a manufacturing apparatus. 2 and 3 are schematic cross-sectional views showing the barrier metal chamber 4 and the Al-CVD chamber 5 mounted on the film forming apparatus 1, respectively.

図1において、成膜装置1は、ロードロックチャンバ(以下単に、LLチャンバ)2と、搬送部を構成するコアチャンバ3とを有する。また、成膜装置1は、第一成膜部としてのバリアメタルチャンバ4と、第二成膜部としてのAl−CVDチャンバ5と、アニール部としてのアニールチャンバ6と、第三成膜部としてのAl−PVDチャンバ7とを有する。   In FIG. 1, a film forming apparatus 1 includes a load lock chamber (hereinafter simply referred to as an LL chamber) 2 and a core chamber 3 that constitutes a transfer unit. The film forming apparatus 1 includes a barrier metal chamber 4 as a first film forming unit, an Al-CVD chamber 5 as a second film forming unit, an annealing chamber 6 as an annealing unit, and a third film forming unit. And an Al-PVD chamber 7.

LLチャンバ2は、減圧可能な内部空間(以下単に、収容室2aという。)を有し、複数のシリコン基板Sを搬出及び搬入可能に収容する。LLチャンバ2は、シリコン基板Sの成膜処理を開始するとき、収容室2aを減圧して複数のシリコン基板Sをそれぞれコアチャンバ3に搬出可能にする。LLチャンバ2は、シリコン基板Sの成膜処理を終了するとき、収容室2aを大気開放して収容するシリコン基板Sを成膜装置1の外部へ搬出可能にする。   The LL chamber 2 has an internal space (hereinafter simply referred to as a storage chamber 2a) that can be decompressed, and stores a plurality of silicon substrates S so that they can be unloaded and loaded. When the film formation process of the silicon substrate S is started, the LL chamber 2 depressurizes the storage chamber 2a so that the plurality of silicon substrates S can be carried out to the core chamber 3, respectively. When the film forming process for the silicon substrate S is completed, the LL chamber 2 opens the storage chamber 2 a to the atmosphere so that the silicon substrate S stored can be carried out of the film forming apparatus 1.

コアチャンバ3は、減圧可能な内部空間(以下単に、搬送室3aという。)を有し、シリコン基板Sを搬送するための搬送ロボット3bを搬送室3aに搭載している。搬送ロボット3bは、シリコン基板Sの成膜処理を開始するとき、成膜処理前のシリコン基板SをLLチャンバ2からコアチャンバ3に搬入する。搬送ロボット3bは、搬入したシリコン基板Sを図1における反時計回りに沿って順次搬送する。すなわち、搬送ロボット3bは、搬入したシリコン基板Sを、バリアメタルチャンバ4、Al−CVDチャンバ5、アニールチャンバ6、Al−PVDチャンバ7の順に搬送する。搬送ロボット3bは、シリコン基板Sの成膜処理を終了するとき、成膜処理後のシリコン基板Sをコアチャンバ3からLLチャンバ2へ搬出する。   The core chamber 3 has an internal space that can be depressurized (hereinafter simply referred to as a transfer chamber 3a), and a transfer robot 3b for transferring the silicon substrate S is mounted on the transfer chamber 3a. When starting the film forming process for the silicon substrate S, the transfer robot 3b carries the silicon substrate S before the film forming process from the LL chamber 2 to the core chamber 3. The transfer robot 3b sequentially transfers the loaded silicon substrates S along the counterclockwise direction in FIG. That is, the transfer robot 3b transfers the loaded silicon substrate S in the order of the barrier metal chamber 4, the Al-CVD chamber 5, the annealing chamber 6, and the Al-PVD chamber 7. When the film forming process of the silicon substrate S is completed, the transfer robot 3b carries out the silicon substrate S after the film forming process from the core chamber 3 to the LL chamber 2.

バリアメタルチャンバ4は、スパッタ法を用いて、シリコン基板Sの上に金属膜を被覆させるためのチャンバである。金属膜としては、例えばチタン(Ti)膜、タンタル(Ta)膜、ニッケル(Ni)膜、コバルト(Co)膜などを用いることができる。また、バリアメタルチャンバ4は、反応性スパッタ法を用いて、シリコン基板Sの上に金属窒化膜を被覆させるためのチャンバである。金属窒化膜としては、例えば窒化チタン(TiN)膜、窒化タンタル(TaN)膜、窒化ニッケル(NiN)膜、窒化コバルト(CoN)膜を用いることができる。   The barrier metal chamber 4 is a chamber for coating a metal film on the silicon substrate S using a sputtering method. As the metal film, for example, a titanium (Ti) film, a tantalum (Ta) film, a nickel (Ni) film, a cobalt (Co) film, or the like can be used. The barrier metal chamber 4 is a chamber for coating a metal nitride film on the silicon substrate S by using a reactive sputtering method. As the metal nitride film, for example, a titanium nitride (TiN) film, a tantalum nitride (TaN) film, a nickel nitride (NiN) film, or a cobalt nitride (CoN) film can be used.

図2において、バリアメタルチャンバ4は、減圧可能な内部空間(以下単に、成膜室4aという。)を備えたチャンバ本体11を有する。チャンバ本体11には、供給配管IL1を介して、アルゴン(Ar)のマスフローコントローラMC1が連結され、また供給配管IL2を介して、窒素(N)のマスフローコントローラMC2が連結されている。各マスフローコントローラMC1,MC2は、それぞれArガスとNガスを所定の流量に調整して成膜室4aに供給する。 In FIG. 2, the barrier metal chamber 4 has a chamber body 11 having an internal space (hereinafter simply referred to as a film forming chamber 4a) that can be decompressed. An argon (Ar) mass flow controller MC1 is connected to the chamber body 11 via a supply pipe IL1, and a nitrogen (N 2 ) mass flow controller MC2 is connected via a supply pipe IL2. Each mass flow controller MC1, MC2 adjusts Ar gas and N 2 gas to a predetermined flow rate and supplies them to the film forming chamber 4a.

チャンバ本体11には、排気配管OL1を介して、ターボ分子ポンプやドライポンプなどからなる排気システム12が連結されている。排気システム12は、成膜室4aに供給されるArガス、あるいはArガスとNガスの混合ガスを排気し成膜室4aを所定の圧力値に減圧させる。 An exhaust system 12 including a turbo molecular pump, a dry pump, and the like is connected to the chamber body 11 via an exhaust pipe OL1. The exhaust system 12 evacuates Ar gas or a mixed gas of Ar gas and N 2 gas supplied to the film forming chamber 4a, and depressurizes the film forming chamber 4a to a predetermined pressure value.

チャンバ本体11には、シリコン基板Sを載置するための基板ホルダ13が配設されている。基板ホルダ13は、コアチャンバ3から搬入されるシリコン基板Sを載置し、成膜室4aの所定の位置にシリコン基板Sを位置決め固定する。   A substrate holder 13 for placing the silicon substrate S is disposed in the chamber body 11. The substrate holder 13 places the silicon substrate S carried in from the core chamber 3, and positions and fixes the silicon substrate S at a predetermined position in the film forming chamber 4a.

基板ホルダ13の内部には、基板電極14が内設されている。基板電極14は、基板バイアス電源G1に接続されて、同基板バイアス電源G1から所定の交流電力を入力される。交流電力を受ける基板電極14は、成膜室4aにプラズマが生成されるとき、プラズマ空間に対して負電位、すなわちカソードとして機能してイオン粒子をシリコン基板Sに引き込み、シリコン基板Sに対するイオン粒子の直進性を向上させる。また、交流電力を受ける基板電極14は、成膜室4aにプラズマが生成されるとき、シリコン基板Sの表面にイオン粒子(例えば、アルゴンイオン)を引き込み、シリコン基板S上の金属膜あるいは金属窒化膜の一部をスパッタさせる。すなわち、バリアメタルチャンバ4は、シリコン基板Sにバイアス電圧を印加させるSIS(Self−Ionized plasma Sputtering)法にて金属
膜あるいは金属窒化膜を成膜する。
A substrate electrode 14 is provided inside the substrate holder 13. The substrate electrode 14 is connected to a substrate bias power supply G1 and receives predetermined AC power from the substrate bias power supply G1. When the plasma is generated in the film forming chamber 4a, the substrate electrode 14 that receives AC power has a negative potential with respect to the plasma space, that is, functions as a cathode and draws ionic particles into the silicon substrate S. Improve the straightness of the. In addition, the substrate electrode 14 that receives AC power draws ion particles (for example, argon ions) into the surface of the silicon substrate S when plasma is generated in the film formation chamber 4a, and a metal film or metal nitride on the silicon substrate S. A part of the film is sputtered. That is, the barrier metal chamber 4 forms a metal film or a metal nitride film by a SIS (Self-Ionized Plasma Sputtering) method in which a bias voltage is applied to the silicon substrate S.

基板ホルダ13の上方には、略円筒状に形成されたシールド15が配設されている。シールド15は、シールド電源G2に接続されて、同シールド電源G2から所定の直流電力を入力される。直流電力を受けるシールド15は、成膜室4aにプラズマが生成されるとき、プラズマ空間に対して正電位、すなわちアノードとして機能し、イオン粒子の進行方
向をシリコン基板Sに向けて偏向させる。
A shield 15 formed in a substantially cylindrical shape is disposed above the substrate holder 13. The shield 15 is connected to the shield power supply G2, and receives predetermined DC power from the shield power supply G2. The shield 15 that receives direct current power functions as a positive potential, that is, an anode with respect to the plasma space when plasma is generated in the film forming chamber 4a, and deflects the traveling direction of the ion particles toward the silicon substrate S.

シールド15の直上には、円盤状に形成されたターゲット16が配設されている。ターゲット16には、上記金属膜の主成分、すなわちTi、Ta、NiあるいはCoを90%以上、好ましくは95%以上含み、残部として、同金属元素以外の金属、例えば銅やケイ素などを含むものを用いることができる。   A target 16 formed in a disk shape is disposed immediately above the shield 15. The target 16 contains 90% or more, preferably 95% or more of the main component of the metal film, that is, Ti, Ta, Ni or Co, and the remainder contains a metal other than the metal element, such as copper or silicon. Can be used.

ターゲット16の上側には、ターゲット電極17が配設されている。ターゲット電極17は、ターゲット電源G3に接続されて、同ターゲット電源G3から所定の直流あるいは交流電力を入力される。直流あるいは交流電力を受けるターゲット電極17は、成膜室4aにプラズマが生成されるとき、プラズマ空間に対して負電位、すなわちカソードとして機能してターゲット16をスパッタさせる。ターゲット電極17は、ターゲット16をシリコン基板Sに対向させて、ターゲット16とシリコン基板Sとの間の距離を、所定の距離(例えば、シリコン基板Sの直径よりも長い距離)に保持させる。   A target electrode 17 is disposed on the upper side of the target 16. The target electrode 17 is connected to the target power supply G3, and receives predetermined direct current or alternating current power from the target power supply G3. When the plasma is generated in the film forming chamber 4a, the target electrode 17 that receives direct current or alternating current power functions as a negative potential with respect to the plasma space, that is, as a cathode and causes the target 16 to be sputtered. The target electrode 17 makes the target 16 face the silicon substrate S and holds the distance between the target 16 and the silicon substrate S at a predetermined distance (for example, a distance longer than the diameter of the silicon substrate S).

ターゲット電極17の上側には、磁気回路18が配設されている。磁気回路18は、ターゲット16の内表面に沿ってマグネトロン磁場を形成させ、成膜室4aにプラズマが生成されるとき、同プラズマを安定させてその密度を増加させる。   A magnetic circuit 18 is disposed above the target electrode 17. The magnetic circuit 18 forms a magnetron magnetic field along the inner surface of the target 16 and stabilizes the plasma to increase its density when plasma is generated in the film forming chamber 4a.

バリアメタルチャンバ4は、シリコン基板Sの表面に金属膜を被覆させるとき、マスフローコントローラMC1によって所定の流量のArガスを供給させ、また排気システム12によって成膜室4aを所定の圧力値に減圧させる。この状態において、バリアメタルチャンバ4は、各電源G1,G2,G3に所定の電力を印加させ、高密度のArプラズマにターゲット16をスパッタさせる。そして、スパッタされた金属粒子をシリコン基板Sの略法線方向に沿ってシリコン基板Sの表面に引き込み、同シリコン基板Sの表面を被覆する。これにより、バリアメタルチャンバ4は、シリコン基板Sの表面に段差被覆性の優れた金属膜を形成する。   When the barrier metal chamber 4 coats the surface of the silicon substrate S with a metal film, the mass flow controller MC1 supplies Ar gas at a predetermined flow rate, and the exhaust system 12 reduces the film forming chamber 4a to a predetermined pressure value. . In this state, the barrier metal chamber 4 applies a predetermined electric power to each of the power supplies G1, G2, and G3, and causes the target 16 to be sputtered on the high-density Ar plasma. Then, the sputtered metal particles are drawn into the surface of the silicon substrate S along the substantially normal direction of the silicon substrate S to cover the surface of the silicon substrate S. Thereby, the barrier metal chamber 4 forms a metal film with excellent step coverage on the surface of the silicon substrate S.

バリアメタルチャンバ4は、シリコン基板Sの表面に金属窒化膜を被覆させるとき、各マスフローコントローラMC1,MC2によってそれぞれ所定の流量のArガスとNガスを供給させ、排気システム12によって成膜室4aを所定の圧力値に減圧させる。この状態において、バリアメタルチャンバ4は、各電源G1,G2,G3に所定の電力を印加させ、高密度のAr/Nプラズマにターゲット16をスパッタさせる。そして、スパッタされた金属粒子をシリコン基板Sの略法線方向に沿ってシリコン基板Sの表面に引き込み、Nプラズマと反応させて金属窒化膜を形成する。これにより、バリアメタルチャンバ4は、シリコン基板Sの表面に段差被覆性の優れた金属窒化膜を形成する。 When the metal nitride film is coated on the surface of the silicon substrate S, the barrier metal chamber 4 supplies Ar gas and N 2 gas at a predetermined flow rate by the mass flow controllers MC1 and MC2, respectively, and the film forming chamber 4a by the exhaust system 12. Is reduced to a predetermined pressure value. In this state, the barrier metal chamber 4 applies a predetermined power to each of the power supplies G1, G2, and G3, and causes the target 16 to be sputtered by high-density Ar / N 2 plasma. Then, the sputtered metal particles are drawn into the surface of the silicon substrate S along the substantially normal direction of the silicon substrate S, and reacted with N 2 plasma to form a metal nitride film. Thereby, the barrier metal chamber 4 forms a metal nitride film having excellent step coverage on the surface of the silicon substrate S.

図1において、Al−CVDチャンバ5は、CVD法を用いて、シリコン基板Sの上に第一アルミニウム膜(以下単に、Al−CVD膜という。)を形成させるためのチャンバである。   In FIG. 1, an Al-CVD chamber 5 is a chamber for forming a first aluminum film (hereinafter simply referred to as an Al-CVD film) on a silicon substrate S using a CVD method.

図3において、Al−CVDチャンバ5は、減圧可能な内部空間(以下単に、成膜室5aという。)を備えたチャンバ本体21を有する。チャンバ本体21には、供給配管IL3を介して、Al−CVD膜の原料物質(以下単に、Al膜原料という。)を成膜室5aに運送するための運送システム22が連結されている。   In FIG. 3, the Al-CVD chamber 5 has a chamber body 21 having an internal space (hereinafter simply referred to as a film forming chamber 5a) that can be decompressed. The chamber main body 21 is connected to a transport system 22 for transporting an Al-CVD film source material (hereinafter simply referred to as an Al film source) to the film forming chamber 5a via a supply pipe IL3.

Al膜原料には、例えばDMAH(Dimethyl Aluminum Hydride)、TMAA(Trimethylamine Alane)、MPA(Methylpyrrolidine Alane))を用いることができる。運送システム22には、例えば上記Al膜原料の流量をキャリアガスの流量によって規定させるバブリングシステム(Bubbling system)を用いることができる。また、運送システム2
2には、気体状態にしたAl膜原料の流量をマスフローコントローラによって制御させる気相流量コントロールシステム(vapor flow control system)や、液体状態のAl膜原
料を直接運送させる液相運送システム(LDS:liquid delivery system)などを用いる
ことができる。
As the Al film raw material, for example, DMAH (Dimethyl Aluminum Hydride), TMAA (Trimethylamine Alane), MPA (Methylpyrrolidine Alane)) can be used. For the transport system 22, for example, a bubbling system that regulates the flow rate of the Al film material by the flow rate of the carrier gas can be used. Transportation system 2
2 includes a vapor flow control system that controls the flow rate of the Al film material in a gaseous state by a mass flow controller, and a liquid phase transport system that directly transports the Al film material in a liquid state (LDS: liquid delivery system) can be used.

チャンバ本体21には、排気配管OL2を介して、ドライポンプを含む排気システム23が連結されている。排気システム23は、成膜室5aに供給される上記Al膜原料やキャリアガスなどを排気して成膜室5aを所定の圧力値に減圧させる。   An exhaust system 23 including a dry pump is connected to the chamber body 21 via an exhaust pipe OL2. The exhaust system 23 exhausts the Al film raw material and the carrier gas supplied to the film forming chamber 5a to reduce the film forming chamber 5a to a predetermined pressure value.

チャンバ本体21には、シリコン基板Sを載置するための基板ホルダ24が配設されている。基板ホルダ24は、コアチャンバ3から搬入されるシリコン基板Sを載置し、成膜室5aの所定の位置にシリコン基板Sを位置決め固定する。基板ホルダ24には、ヒータ電源25に接続される加熱ヒータ26が内設されている。加熱ヒータ26は、シリコン基板Sが載置されるとき、シリコン基板Sを所定の温度に昇温させる。   The chamber body 21 is provided with a substrate holder 24 for placing the silicon substrate S thereon. The substrate holder 24 places the silicon substrate S carried in from the core chamber 3, and positions and fixes the silicon substrate S at a predetermined position in the film forming chamber 5a. The substrate holder 24 is provided with a heater 26 connected to the heater power supply 25. When the silicon substrate S is placed, the heater 26 raises the temperature of the silicon substrate S to a predetermined temperature.

基板ホルダ24の直上には、円盤状に形成されたシャワープレート27が配設されている。シャワープレート27は、シリコン基板Sと相対向する側面に、供給配管IL3に連通する複数のノズル28を有している。各ノズル28は、それぞれ運送システム22から供給されるAl膜原料を成膜室5a、すなわちシリコン基板Sの表面に向けて供給させる。   A shower plate 27 formed in a disk shape is disposed immediately above the substrate holder 24. The shower plate 27 has a plurality of nozzles 28 communicating with the supply pipe IL3 on the side surface facing the silicon substrate S. Each nozzle 28 supplies the Al film raw material supplied from the transport system 22 toward the film formation chamber 5a, that is, the surface of the silicon substrate S.

Al−CVDチャンバ5は、シリコン基板Sの表面にAl−CVD膜を形成させるとき、基板ホルダ24によってシリコン基板Sを所定の温度に昇温させ、また運送システム22によってAl膜原料を成膜室5aに供給させる。成膜室5aに供給されたAl膜原料は、シリコン基板Sの表面に付着し、同表面との間の電子授受、すなわち表面反応によって成長する。   In the Al-CVD chamber 5, when an Al-CVD film is formed on the surface of the silicon substrate S, the temperature of the silicon substrate S is raised to a predetermined temperature by the substrate holder 24, and an Al film material is formed by the transport system 22. 5a is supplied. The Al film raw material supplied to the film forming chamber 5a adheres to the surface of the silicon substrate S and grows by electron transfer, that is, surface reaction with the surface.

ここで、金属膜を下地にした金属窒化膜がシリコン基板Sの表面を構成する場合、Al膜原料は、金属窒化膜との間の密着性が乏しく、また金属窒化膜との間の電子授受の可能性が乏しいため、金属窒化膜上において表面反応を開始し難い。   Here, when the metal nitride film with the metal film as the base constitutes the surface of the silicon substrate S, the Al film raw material has poor adhesion with the metal nitride film, and also exchanges electrons with the metal nitride film. Therefore, it is difficult to initiate a surface reaction on the metal nitride film.

本発明者らは、Al−CVD膜の埋め込み性能を検討する中で、Al−CVD膜の埋め込み性能が金属窒化膜の形成方法に大きく依存することを見出した。すなわち、Al−CVD膜を成膜する前に、金属窒化膜の一部をスパッタし、スパッタされた金属窒化膜の一部を金属窒化膜の上に再付着させる。本発明者らは、再付着した金属窒化膜がAl−CVD膜の核として機能し、Al−CVD膜を成長させることを見出した。以下、上記金属窒化膜において、再付着した金属窒化膜を、「再付着膜」とする。   The inventors have found that the Al-CVD film embedding performance greatly depends on the method of forming the metal nitride film, while examining the Al-CVD film embedding performance. That is, before forming the Al-CVD film, a part of the metal nitride film is sputtered, and a part of the sputtered metal nitride film is reattached on the metal nitride film. The inventors have found that the reattached metal nitride film functions as a nucleus of the Al-CVD film and grows the Al-CVD film. Hereinafter, in the metal nitride film, the reattached metal nitride film is referred to as a “reattachment film”.

図1において、アニールチャンバ6は、シリコン基板Sを高温にて加熱処理するため内部空間(以下単に、アニール室6aという。)を有する。アニールチャンバ6は、コアチャンバ3からシリコン基板Sが搬送されるとき、シリコン基板Sをアニール室6aに収容し、不活性ガス(例えば、Ar)の雰囲気の下で同シリコン基板Sを熱処理させる。   In FIG. 1, the annealing chamber 6 has an internal space (hereinafter simply referred to as annealing chamber 6a) for heat-treating the silicon substrate S at a high temperature. When the silicon substrate S is transferred from the core chamber 3, the annealing chamber 6 accommodates the silicon substrate S in the annealing chamber 6 a and heat-treats the silicon substrate S in an inert gas (for example, Ar) atmosphere.

図1において、Al−PVDチャンバ7は、スパッタ法を用いて、シリコン基板Sの上にアルミニウム膜を形成させるための内部空間(以下単に、成膜室7aという。)を有する。Al−PVDチャンバ7は、コアチャンバ3からシリコン基板Sが搬送されるとき、シリコン基板Sを成膜室7aに収容し、アルミニウム膜を形成させるためのAlターゲットをスパッタし、シリコン基板Sの上にアルミニウム膜を形成させる。なお、Al−PVDチャンバ7によって形成するアルミニウム膜を、第二アルミニウム膜(以下単に、Al−PVD膜)という。   In FIG. 1, an Al-PVD chamber 7 has an internal space (hereinafter simply referred to as a film forming chamber 7a) for forming an aluminum film on a silicon substrate S by using a sputtering method. When the silicon substrate S is transferred from the core chamber 3, the Al-PVD chamber 7 stores the silicon substrate S in the film formation chamber 7 a, sputters an Al target for forming an aluminum film, and Then, an aluminum film is formed. The aluminum film formed by the Al-PVD chamber 7 is referred to as a second aluminum film (hereinafter simply referred to as an Al-PVD film).

次に、上記成膜装置1の電気的構成について説明する。図4は、成膜装置1の電気的構成を示す電気ブロック回路図である。
図4において、制御部31は、成膜装置1に各種の処理動作(例えば、シリコン基板Sの搬送処理やシリコン基板Sの成膜処理など)を実行させるものである。制御部31は、各種の演算処理を実行するためのCPU、各種のデータを格納するためのRAM、各種の制御プログラムを格納するためのROMやハードディスクなどを有する。制御部31は、例えば、ハードディスクに格納された成膜処理プログラムを読み出し、同成膜処理プログラムに従って成膜処理を実行させる。
Next, the electrical configuration of the film forming apparatus 1 will be described. FIG. 4 is an electric block circuit diagram showing an electrical configuration of the film forming apparatus 1.
In FIG. 4, the control unit 31 causes the film forming apparatus 1 to execute various processing operations (for example, a transfer process of the silicon substrate S and a film forming process of the silicon substrate S). The control unit 31 includes a CPU for executing various arithmetic processes, a RAM for storing various data, a ROM for storing various control programs, a hard disk, and the like. For example, the control unit 31 reads a film forming process program stored in the hard disk and causes the film forming process to be executed according to the film forming process program.

制御部31には、入出力部32が接続されている。入出力部32は、起動スイッチや停止スイッチなどの各種操作スイッチと、液晶ディスプレイなどの各種表示装置とを有する。入出力部32は、各種の処理動作に利用するデータを制御部31に入力し、成膜装置1の処理状況に関するデータを出力する。入出力部32は、成膜パタメータ(例えば、ガスの流量、内部空間の圧力値、シリコン基板Sの温度、成膜時間、各電源G1,G2,G3の出力値など)に関するデータを成膜条件データIdとして制御部31に入力する。すなわち、入出力部32は、金属膜、金属窒化膜、Al−CVD膜、Al−PVD膜を成膜するための成膜パラメータ、アニール処理を実行するためのパラメータを成膜条件データIdとして制御部31に入力する。制御部31は、入出力部32から入力される成膜条件データIdを受信し、成膜条件データIdに対応する成膜条件の下で各成膜処理を実行させる。   An input / output unit 32 is connected to the control unit 31. The input / output unit 32 includes various operation switches such as a start switch and a stop switch, and various display devices such as a liquid crystal display. The input / output unit 32 inputs data used for various processing operations to the control unit 31 and outputs data related to the processing status of the film forming apparatus 1. The input / output unit 32 stores data on film formation parameters (for example, gas flow rate, internal space pressure value, silicon substrate S temperature, film formation time, output values of the power supplies G1, G2, and G3). The data is input to the control unit 31 as data Id. That is, the input / output unit 32 controls the film formation parameters for forming the metal film, the metal nitride film, the Al-CVD film, and the Al-PVD film, and the parameters for executing the annealing process as the film formation condition data Id. Input to the unit 31. The control unit 31 receives the film forming condition data Id input from the input / output unit 32, and causes each film forming process to be executed under the film forming condition corresponding to the film forming condition data Id.

制御部31には、LLチャンバ2を駆動制御するためのLLチャンバ駆動回路33が接続されている。LLチャンバ駆動回路33は、LLチャンバ2の状態を検出し、その検出結果を制御部31に入力する。LLチャンバ駆動回路33は、例えば収容室2aの圧力値を検出し、同圧力値に関する検出信号を制御部31に入力する。制御部31は、LLチャンバ駆動回路33から入力される検出信号を利用し、LLチャンバ駆動回路33に対応する駆動制御信号をLLチャンバ駆動回路33に出力する。LLチャンバ駆動回路33は、制御部31からの駆動制御信号に応答し、収容室2aを減圧あるいは大気開放してシリコン基板Sの搬入あるいは搬出を可能にする。   An LL chamber driving circuit 33 for driving and controlling the LL chamber 2 is connected to the control unit 31. The LL chamber drive circuit 33 detects the state of the LL chamber 2 and inputs the detection result to the control unit 31. For example, the LL chamber drive circuit 33 detects the pressure value of the storage chamber 2 a and inputs a detection signal related to the pressure value to the control unit 31. The control unit 31 uses the detection signal input from the LL chamber drive circuit 33 and outputs a drive control signal corresponding to the LL chamber drive circuit 33 to the LL chamber drive circuit 33. The LL chamber drive circuit 33 responds to the drive control signal from the control unit 31 and allows the silicon substrate S to be loaded or unloaded by reducing the pressure in the storage chamber 2a or opening it to the atmosphere.

制御部31には、コアチャンバ3を駆動制御するためのコアチャンバ駆動回路34が接続されている。コアチャンバ駆動回路34は、コアチャンバ3の状態を検出し、検出結果を制御部31に入力する。コアチャンバ駆動回路34は、例えば搬送ロボット3bのアーム位置を検出し、同アーム位置に関する検出信号を制御部31に入力する。制御部31は、コアチャンバ駆動回路34から入力される検出信号を利用し、コアチャンバ駆動回路34に対応する駆動制御信号をコアチャンバ駆動回路34に出力する。コアチャンバ駆動回路34は、制御部31からの駆動制御信号に応答し、シリコン基板SをLLチャンバ2、コアチャンバ3、バリアメタルチャンバ4、Al−CVDチャンバ5、アニールチャンバ6、Al−PVDチャンバ7の順序で搬送する。   A core chamber drive circuit 34 for driving and controlling the core chamber 3 is connected to the control unit 31. The core chamber drive circuit 34 detects the state of the core chamber 3 and inputs the detection result to the control unit 31. The core chamber drive circuit 34 detects the arm position of the transfer robot 3b, for example, and inputs a detection signal related to the arm position to the control unit 31. The control unit 31 uses the detection signal input from the core chamber drive circuit 34 and outputs a drive control signal corresponding to the core chamber drive circuit 34 to the core chamber drive circuit 34. The core chamber drive circuit 34 responds to the drive control signal from the control unit 31, and converts the silicon substrate S into the LL chamber 2, the core chamber 3, the barrier metal chamber 4, the Al-CVD chamber 5, the annealing chamber 6, and the Al-PVD chamber. Transport in the order of 7.

制御部31には、バリアメタルチャンバ4を駆動制御するためのバリアメタルチャンバ駆動回路35が接続されている。バリアメタルチャンバ駆動回路35は、バリアメタルチャンバ4の状態を検出し、その検出結果を制御部31に入力する。バリアメタルチャンバ駆動回路35は、例えば成膜室4aの圧力値、各ガス種の実流量、各電源G1,G2,G3の出力値などを検出し、これらのパラメータに関する検出信号を制御部31に入力する。制御部31は、バリアメタルチャンバ駆動回路35から入力される検出信号を利用し、成膜条件データIdに応じた駆動制御信号をバリアメタルチャンバ駆動回路35に出力する。バリアメタルチャンバ駆動回路35は、制御部31からの駆動制御信号に応答して各マスフローコントローラMC1,MC2、排気システム12、各電源G1,G2,G3な
どを駆動し、成膜条件データIdに対応する成膜条件の下で金属膜及び金属窒化膜の成膜処理を実行する。
A barrier metal chamber drive circuit 35 for driving and controlling the barrier metal chamber 4 is connected to the control unit 31. The barrier metal chamber drive circuit 35 detects the state of the barrier metal chamber 4 and inputs the detection result to the control unit 31. The barrier metal chamber drive circuit 35 detects, for example, the pressure value of the film forming chamber 4a, the actual flow rate of each gas type, the output value of each power source G1, G2, G3, and the like, and sends detection signals regarding these parameters to the control unit 31. input. The control unit 31 uses the detection signal input from the barrier metal chamber drive circuit 35 and outputs a drive control signal corresponding to the film formation condition data Id to the barrier metal chamber drive circuit 35. The barrier metal chamber drive circuit 35 drives each mass flow controller MC1, MC2, exhaust system 12, each power supply G1, G2, G3, etc. in response to a drive control signal from the control unit 31, and corresponds to the film formation condition data Id. The film forming process of the metal film and the metal nitride film is executed under the film forming conditions.

制御部31には、Al−CVDチャンバ5を駆動制御するためのAl−CVDチャンバ駆動回路36が接続されている。Al−CVDチャンバ駆動回路36は、Al−CVDチャンバ5の状態を検出し、その検出結果を制御部31に入力する。Al−CVDチャンバ駆動回路36は、例えば成膜室5aの圧力値、Al膜原料の実流量、シリコン基板Sの実温度などを検出し、これらのパラメータに関する検出信号を制御部31に入力する。制御部31は、Al−CVDチャンバ駆動回路36から入力される検出信号を利用し、成膜条件データIdに応じた駆動制御信号をAl−CVDチャンバ駆動回路36に出力する。Al−CVDチャンバ駆動回路36は、制御部31からの駆動制御信号に応答して運送システム22、排気システム23、ヒータ電源25などを駆動し、成膜条件データIdに対応する成膜条件の下でAl−CVD膜の成膜処理を実行する。   An Al-CVD chamber driving circuit 36 for driving and controlling the Al-CVD chamber 5 is connected to the control unit 31. The Al-CVD chamber drive circuit 36 detects the state of the Al-CVD chamber 5 and inputs the detection result to the control unit 31. The Al-CVD chamber drive circuit 36 detects, for example, the pressure value of the film forming chamber 5a, the actual flow rate of the Al film material, the actual temperature of the silicon substrate S, and the like, and inputs detection signals related to these parameters to the control unit 31. The control unit 31 uses the detection signal input from the Al-CVD chamber drive circuit 36 and outputs a drive control signal corresponding to the film formation condition data Id to the Al-CVD chamber drive circuit 36. The Al-CVD chamber drive circuit 36 drives the transport system 22, the exhaust system 23, the heater power supply 25, etc. in response to the drive control signal from the control unit 31, under the film formation conditions corresponding to the film formation condition data Id. Then, the film forming process of the Al-CVD film is executed.

制御部31には、アニールチャンバ6を駆動制御するためのアニールチャンバ駆動回路37が接続されている。アニールチャンバ駆動回路37は、アニールチャンバ6の状態を検出し、その検出結果を制御部31に入力する。アニールチャンバ駆動回路37は、例えばアニール室6aの圧力値、シリコン基板Sの実温度などを検出し、これらのパラメータに関する検出信号を制御部31に入力する。制御部31は、アニールチャンバ駆動回路37から入力される検出信号を利用し、成膜条件データIdに応じた駆動制御信号をアニールチャンバ駆動回路37に出力する。アニールチャンバ駆動回路37は、制御部31からの駆動制御信号に応答し、成膜条件データIdに対応する成膜条件の下でシリコン基板Sのアニール処理を実行する。   An annealing chamber drive circuit 37 for driving and controlling the annealing chamber 6 is connected to the control unit 31. The annealing chamber drive circuit 37 detects the state of the annealing chamber 6 and inputs the detection result to the control unit 31. The annealing chamber drive circuit 37 detects, for example, the pressure value of the annealing chamber 6a, the actual temperature of the silicon substrate S, and the like, and inputs detection signals regarding these parameters to the control unit 31. The control unit 31 uses the detection signal input from the annealing chamber driving circuit 37 and outputs a driving control signal corresponding to the film forming condition data Id to the annealing chamber driving circuit 37. In response to the drive control signal from the control unit 31, the annealing chamber drive circuit 37 executes the annealing process for the silicon substrate S under the film formation conditions corresponding to the film formation condition data Id.

制御部31には、Al−PVDチャンバ7を駆動制御するためのAl−PVDチャンバ駆動回路38が接続されている。Al−PVDチャンバ駆動回路38は、Al−PVDチャンバ7の状態を検出し、その検出結果を制御部31に入力する。Al−PVDチャンバ駆動回路38は、例えば成膜室7aの圧力値、Alターゲットに印加する電力値を検出し、これらのパラメータに関する検出信号を制御部31に入力する。制御部31は、Al−PVDチャンバ駆動回路38から入力される検出信号を利用し、成膜条件データIdに応じた駆動制御信号をAl−PVDチャンバ駆動回路38に出力する。Al−PVDチャンバ駆動回路38は、制御部31からの駆動制御信号に応答し、成膜条件データIdに対応する成膜条件の下でAl−PVD膜の成膜処理を実行する。   An Al-PVD chamber driving circuit 38 for driving and controlling the Al-PVD chamber 7 is connected to the control unit 31. The Al-PVD chamber drive circuit 38 detects the state of the Al-PVD chamber 7 and inputs the detection result to the control unit 31. The Al-PVD chamber drive circuit 38 detects, for example, the pressure value of the film forming chamber 7 a and the power value applied to the Al target, and inputs detection signals related to these parameters to the control unit 31. The control unit 31 uses the detection signal input from the Al-PVD chamber drive circuit 38 and outputs a drive control signal corresponding to the film formation condition data Id to the Al-PVD chamber drive circuit 38. In response to the drive control signal from the control unit 31, the Al-PVD chamber drive circuit 38 executes the Al-PVD film formation process under the film formation conditions corresponding to the film formation condition data Id.

次に、上記成膜装置1を利用した半導体装置の製造方法について説明する。図5〜図9は、それぞれ半導体装置の製造工程を示す工程図である。
まず、直径200[mm]を有した複数のシリコン基板Sが、LLチャンバ2にセットされる。シリコン基板Sは、図5に示すように、金属配線MLと、金属配線MLの上に積層された層間絶縁膜DLを有している。金属配線MLには、Al配線や銅配線など、各種の金属材料を用いることができる。層間絶縁膜DLには、低誘電率の絶縁膜材料やシリコン酸化膜など、各種の絶縁材料を用いることができる。
Next, a method for manufacturing a semiconductor device using the film forming apparatus 1 will be described. 5 to 9 are process diagrams showing the manufacturing process of the semiconductor device.
First, a plurality of silicon substrates S having a diameter of 200 [mm] are set in the LL chamber 2. As shown in FIG. 5, the silicon substrate S includes a metal wiring ML and an interlayer insulating film DL stacked on the metal wiring ML. Various metal materials such as Al wiring and copper wiring can be used for the metal wiring ML. Various insulating materials such as an insulating film material having a low dielectric constant and a silicon oxide film can be used for the interlayer insulating film DL.

この層間絶縁膜DLの表面(図5における上面)には、金属配線MLまでを貫通する凹部としてのホール(ビアホールVH(Via hole))が形成されている。ビアホールVHの内径Rvhは145[nm]であり、ビアホールVHの深さDvhは600[nm]で形成されている。すなわち、シリコン基板Sの表面は、アスペクト比が4.13のビアホールVHを有している。   On the surface of the interlayer insulating film DL (upper surface in FIG. 5), a hole (via hole VH (Via hole)) as a recess penetrating to the metal wiring ML is formed. The inner diameter Rvh of the via hole VH is 145 [nm], and the depth Dvh of the via hole VH is 600 [nm]. That is, the surface of the silicon substrate S has a via hole VH having an aspect ratio of 4.13.

制御部31は、入出力部32から成膜条件データIdを受信する。また、制御部31は、LLチャンバ駆動回路33及びコアチャンバ駆動回路34を介して、LLチャンバ2及
びコアチャンバ3を駆動し、収容室2aのシリコン基板Sをバリアメタルチャンバ4に搬送する。
The control unit 31 receives the film formation condition data Id from the input / output unit 32. Further, the control unit 31 drives the LL chamber 2 and the core chamber 3 via the LL chamber driving circuit 33 and the core chamber driving circuit 34, and transports the silicon substrate S in the storage chamber 2 a to the barrier metal chamber 4.

シリコン基板Sを成膜室4aに搬入すると、制御部31は、バリアメタルチャンバ駆動回路35を介して、バリアメタルチャンバ4を駆動し、成膜条件データIdに対応する成膜条件の下で金属膜BM1を被覆させる(以下単に、金属膜工程という。)。図5に示すように、この金属膜工程においては、金属膜BM1が、ビアホールVHの内壁の全体にわたり被覆される。すなわち、ビアホールVHの内側は、層間絶縁膜DLと高い密着性を有する金属膜BM1によって覆われる。   When the silicon substrate S is carried into the film forming chamber 4a, the control unit 31 drives the barrier metal chamber 4 via the barrier metal chamber driving circuit 35, and the metal under the film forming conditions corresponding to the film forming condition data Id. The film BM1 is coated (hereinafter simply referred to as a metal film process). As shown in FIG. 5, in this metal film process, the metal film BM1 is covered over the entire inner wall of the via hole VH. That is, the inside of the via hole VH is covered with the metal film BM1 having high adhesion with the interlayer insulating film DL.

上記金属膜工程における成膜条件として、好ましくは以下の条件が挙げられる。
・ターゲット16の主成分:Ti
・Ar流量:5〜100[sccm]
・成膜圧力:1×10−2〜0.5[Pa]
・基板温度:室温〜350[℃]
・基板バイアス電源:0[W]
・成膜速度:10〜200[nm/min]
・成膜膜厚:5〜40[nm](より好ましくは15[nm])
なお、成膜室4aの圧力が10[Pa]より高くなると、スパッタされた金属粒子(Ti粒子)の入射方向がシリコン基板Sの法線方向から大きく傾斜し、金属膜BM1(Ti膜)の段差被覆性が著しく損なわれる。同じく、成膜速度が500[nm/min]よりも高くなる条件においても、Ti膜の段差被覆性が著しく損なわれる。
As the film forming conditions in the metal film step, the following conditions are preferably mentioned.
-Main component of target 16: Ti
Ar flow rate: 5 to 100 [sccm]
Film forming pressure: 1 × 10 −2 to 0.5 [Pa]
-Substrate temperature: Room temperature to 350 [° C]
-Substrate bias power supply: 0 [W]
・ Deposition rate: 10-200 [nm / min]
Film thickness: 5 to 40 [nm] (more preferably 15 [nm])
When the pressure in the film forming chamber 4a is higher than 10 [Pa], the incident direction of the sputtered metal particles (Ti particles) is greatly inclined from the normal direction of the silicon substrate S, and the metal film BM1 (Ti film) The step coverage is significantly impaired. Similarly, the step coverage of the Ti film is significantly impaired even under conditions where the deposition rate is higher than 500 [nm / min].

金属膜BM1を形成すると、制御部31は、バリアメタルチャンバ駆動回路35を介して、バリアメタルチャンバ4を駆動し、成膜条件データIdに対応する成膜条件の下で金属窒化膜BM2を被覆させる(以下単に、金属窒化膜工程という。)。   When the metal film BM1 is formed, the control unit 31 drives the barrier metal chamber 4 via the barrier metal chamber drive circuit 35 and covers the metal nitride film BM2 under the film formation conditions corresponding to the film formation condition data Id. (Hereinafter simply referred to as a metal nitride film process).

図6及び図7に示すように、上記の金属窒化膜工程においては、SIS法を用いる分だけ、金属粒子がビアホールVHの底部にまで到達し、金属窒化膜BM2が金属膜BM1の全体を被覆する。   As shown in FIGS. 6 and 7, in the metal nitride film process, the metal particles reach the bottom of the via hole VH by the amount of using the SIS method, and the metal nitride film BM2 covers the entire metal film BM1. To do.

この際、ビアホールVHに入射する金属粒子は、シャドウイング効果の影響を受け、ビアホールVHの底部において山型の金属窒化膜BM2を形成する。ここで、ビアホールVHの底部に位置する山型の金属窒化膜BM2(図6における二点鎖線部)を、底部窒化膜BMsという。底部窒化膜BMsは、金属窒化膜BM2を成膜する過程において、ビアホールVHに入射するイオン粒子(例えば、Arイオン)によってスパッタされ、ビアホールVHの底部の側壁に再付着する。ここで、スパッタされた底部窒化膜BMsの再付着膜(図6においてグラデーションを付した部分)を、再付着窒化膜BMrという。   At this time, the metal particles incident on the via hole VH are affected by the shadowing effect, and form a mountain-shaped metal nitride film BM2 at the bottom of the via hole VH. Here, the mountain-shaped metal nitride film BM2 (two-dot chain line portion in FIG. 6) located at the bottom of the via hole VH is referred to as a bottom nitride film BMs. In the process of forming the metal nitride film BM2, the bottom nitride film BMs is sputtered by ion particles (for example, Ar ions) incident on the via hole VH and reattached to the bottom side wall of the via hole VH. Here, the reattachment film (the part with gradation in FIG. 6) of the sputtered bottom nitride film BMs is referred to as a reattachment nitride film BMr.

制御部31は、成膜条件データIdに応じた成膜パラメータ(例えば、成膜圧力や基板バイアス電源G1の出力値)によって、ビアホールVHの底部に位置する金属窒化膜BM2が平坦になるように、再付着窒化膜BMrを形成させる。すなわち、制御部31は、底部窒化膜BMsの分だけ再付着窒化膜BMrを形成させ、同再付着窒化膜BMrの膜厚を所定の膜厚に規格化させる。   The control unit 31 makes the metal nitride film BM2 located at the bottom of the via hole VH flat according to the film formation parameters (for example, the film formation pressure and the output value of the substrate bias power supply G1) according to the film formation condition data Id. Then, a reattached nitride film BMr is formed. That is, the control unit 31 forms the redeposited nitride film BMr as much as the bottom nitride film BMs, and normalizes the thickness of the redeposited nitride film BMr to a predetermined film thickness.

上記金属窒化膜工程における成膜条件として、好ましくは以下の条件が挙げられる。
・ターゲット16の主成分:Ti
・Ar流量:5〜100[sccm]
・N流量:5〜100[sccm]
・成膜圧力:5×10−2〜1[Pa]
・基板温度:室温〜350[℃]
・基板バイアス電源:200〜600[W](より好ましくは、600[W])
・成膜速度:10〜200[nm/min]
なお、成膜室4aの圧力が10[Pa]より増加すると、スパッタされた金属粒子(Ti粒子)の入射方向がシリコン基板Sの法線方向から大きく傾斜し、金属窒化膜(TiN膜)の段差被覆性が著しく損なわれる。同じく、成膜速度が500[nm/min]よりも高くなる条件においても、TiN膜の段差被覆性が著しく損なわれる。また、基板バイアス電源G1の出力値が100[W]より小さくなると、底部窒化膜BMsのスパッタが不十分となり再付着窒化膜BMrが形成されなくなる。逆に、基板バイアス電源G1の出力値が800[W]より大きくなると、イオン粒子によるスパッタが過剰となり、ビアホールVHの底部に位置する金属窒化膜BM2やビアホールVHの開口に位置する金属窒化膜BM2の膜厚が不十分となる。
As the film forming conditions in the metal nitride film process, the following conditions are preferably mentioned.
-Main component of target 16: Ti
Ar flow rate: 5 to 100 [sccm]
・ N 2 flow rate: 5 to 100 [sccm]
Film forming pressure: 5 × 10 −2 to 1 [Pa]
-Substrate temperature: Room temperature to 350 [° C]
Substrate bias power source: 200 to 600 [W] (more preferably 600 [W])
・ Deposition rate: 10-200 [nm / min]
When the pressure in the film forming chamber 4a is increased from 10 [Pa], the incident direction of the sputtered metal particles (Ti particles) is greatly inclined from the normal direction of the silicon substrate S, and the metal nitride film (TiN film) The step coverage is significantly impaired. Similarly, the step coverage of the TiN film is significantly impaired even under conditions where the deposition rate is higher than 500 [nm / min]. When the output value of the substrate bias power supply G1 is smaller than 100 [W], the bottom nitride film BMs is not sufficiently sputtered and the reattached nitride film BMr is not formed. Conversely, when the output value of the substrate bias power supply G1 exceeds 800 [W], sputtering by ion particles becomes excessive, and the metal nitride film BM2 located at the bottom of the via hole VH and the metal nitride film BM2 located at the opening of the via hole VH. The film thickness becomes insufficient.

金属窒化膜BM2を形成すると、制御部31は、Al−CVDチャンバ駆動回路36を介して、Al−CVDチャンバ5を駆動し、成膜条件データIdに対応する成膜条件の下でAl−CVD膜P1を形成させる(以下単に、Al−CVD膜工程という。)。   When the metal nitride film BM2 is formed, the control unit 31 drives the Al-CVD chamber 5 via the Al-CVD chamber drive circuit 36 and performs Al-CVD under the film formation conditions corresponding to the film formation condition data Id. A film P1 is formed (hereinafter simply referred to as an Al-CVD film process).

図7に示すように、このAl−CVD膜工程においては、ビアホールVHの底部の側壁にのみ再付着窒化膜BMrが形成されている。そのため、ビアホールVHの底部においてAl−CVD膜P1の核が形成され、Al−CVD膜P1がビアホールVHの底部から成長し始める。一方、ビアホールVHの上部では再付着膜が形成されていないため、Al−CVD膜P1の核が形成されず、金属窒化膜BM2がビアホールVHの開口径を維持し続ける。   As shown in FIG. 7, in this Al-CVD film process, the reattached nitride film BMr is formed only on the side wall at the bottom of the via hole VH. Therefore, the nucleus of the Al-CVD film P1 is formed at the bottom of the via hole VH, and the Al-CVD film P1 starts to grow from the bottom of the via hole VH. On the other hand, since the redeposition film is not formed above the via hole VH, the nucleus of the Al-CVD film P1 is not formed, and the metal nitride film BM2 continues to maintain the opening diameter of the via hole VH.

しかも、Al−CVD膜P1の最表面は、成長する過程において、上方に突出した山型を呈する。このため、Al−CVD膜P1は、ビアホールVHの側壁から張り出すことなく、ボイドの形成し難い形状を呈しながら開口に向けて成長し続ける。   Moreover, the outermost surface of the Al-CVD film P1 exhibits a mountain shape protruding upward in the process of growth. For this reason, the Al-CVD film P1 does not protrude from the side wall of the via hole VH and continues to grow toward the opening while exhibiting a shape in which voids are difficult to form.

この結果、制御部31は、図7に示すように、ビアホールVHの開口を開けた状態を維持しながら、Al−CVD膜P1をボトムアップさせる。そして、制御部31は、図8に示すように、ビアホールVHの内部にのみAl−CVD膜P1を成長させ、ビアホールVHの内部をAl−CVD膜P1によって完全に埋め込み、Al−CVD膜P1の成膜を終了させる。   As a result, as shown in FIG. 7, the control unit 31 bottoms up the Al—CVD film P <b> 1 while maintaining the state where the opening of the via hole VH is opened. Then, as shown in FIG. 8, the control unit 31 grows the Al-CVD film P1 only inside the via hole VH, completely fills the inside of the via hole VH with the Al-CVD film P1, and forms the Al-CVD film P1. Finish the film formation.

上記Al−CVD膜工程における成膜条件として、好ましくは以下の条件が挙げられる。
・MPA流量:1〜100[sccm]
・成膜圧力:5〜1500[Pa]
・基板温度:80〜300[℃](より好ましくは、100[℃])
・成膜速度:10〜300[nm/min]
なお、成膜室5aの圧力が1[Pa]より低下すると、MPAの濃度低下によりAl−CVD膜P1の成膜速度が著しく損なわれる。逆に、成膜室5aの圧力が2000[Pa]より増加すると、MPAの均一性、すなわちAl−CVD膜P1の膜厚均一性が損なわれる。また、基板温度が80[℃]より低下すると、Al−CVD膜P1の成膜速度が著しく損なわれる。
As film formation conditions in the Al-CVD film process, the following conditions are preferable.
・ MPA flow rate: 1 to 100 [sccm]
-Film formation pressure: 5 to 1500 [Pa]
Substrate temperature: 80 to 300 [° C.] (more preferably 100 [° C.])
・ Deposition rate: 10-300 [nm / min]
Note that when the pressure in the film forming chamber 5a falls below 1 [Pa], the film forming speed of the Al-CVD film P1 is significantly impaired due to the decrease in MPA concentration. Conversely, when the pressure in the film forming chamber 5a increases from 2000 [Pa], the uniformity of MPA, that is, the film thickness uniformity of the Al-CVD film P1 is impaired. Moreover, when the substrate temperature falls below 80 [° C.], the deposition rate of the Al-CVD film P1 is significantly impaired.

Al−CVD膜P1を形成すると、制御部31は、アニールチャンバ駆動回路37を介して、アニールチャンバ6を駆動し、成膜条件データIdに対応する成膜条件の下でシリコン基板S、すなわちAl−CVD膜P1をアニールさせる(以下単に、アニール工程という。)。このアニール工程における熱処理条件として、好ましくは以下の条件が挙げら
れる。
・成膜圧力:1×10−5〜500[Pa]
・基板温度:250〜500[℃](より好ましくは、460[℃])
・処理時間:0.1〜10[min]
上記のアニール工程においては、Alと金属窒化膜との間の密着性が高められる。そのため、Al−CVD膜の上に他の膜を積層するとき、同Al−CVD膜のビアホールVHからの流出や剥離を回避させることができる。この結果、後工程においても、ビアホールVHの内部をAl−CVD膜によって完全に充填させ続けることができ、より信頼性の高いビアプラグを形成させることができる。
When the Al-CVD film P1 is formed, the control unit 31 drives the annealing chamber 6 via the annealing chamber driving circuit 37, and the silicon substrate S, that is, Al under the film forming conditions corresponding to the film forming condition data Id. -The CVD film P1 is annealed (hereinafter simply referred to as an annealing step). As the heat treatment conditions in this annealing step, the following conditions are preferable.
Film deposition pressure: 1 × 10 −5 to 500 [Pa]
Substrate temperature: 250 to 500 [° C.] (more preferably, 460 [° C.])
・ Processing time: 0.1-10 [min]
In the annealing step, the adhesion between Al and the metal nitride film is improved. Therefore, when another film is stacked on the Al-CVD film, it is possible to avoid outflow or peeling of the Al-CVD film from the via hole VH. As a result, the via hole VH can be completely filled with the Al-CVD film even in the post-process, and a more reliable via plug can be formed.

アニール工程を終了すると、制御部31は、Al−PVDチャンバ駆動回路38を介して、Al−PVDチャンバ7を駆動し、成膜条件データIdに対応する成膜条件の下でAl−PVD膜P2を形成させる(以下単に、Al−CVD膜工程という。)。Al−PVD膜P2は、Al−CVD膜P1の表面を平坦化させるための犠牲膜であって、平坦化処理においてその殆どが研磨される膜である。そのため、Al−PVD膜工程における成膜条件としては、処理時間を短くさせるため、成膜速度の速い条件(例えば、Alターゲットに印加する電力の大きい条件)が好ましい。   When the annealing step is finished, the control unit 31 drives the Al-PVD chamber 7 via the Al-PVD chamber drive circuit 38, and the Al-PVD film P2 under the film formation conditions corresponding to the film formation condition data Id. (Hereinafter, simply referred to as an Al-CVD film process). The Al-PVD film P2 is a sacrificial film for planarizing the surface of the Al-CVD film P1, and most of it is polished in the planarization process. For this reason, as the film formation conditions in the Al-PVD film process, conditions in which the film formation speed is high (for example, conditions in which electric power applied to the Al target is large) are preferable in order to shorten the processing time.

上記実施形態によれば、以下の効果を奏する。
(1)上記実施形態において、制御部31は、ビアホールVHを有したシリコン基板Sの表面に金属膜BM1(Ti膜)と金属窒化膜BM2(TiN膜)を被覆させ、金属窒化膜BM2に被覆されたビアホールVHの内部にCVD法を用いてAl−CVD膜P1を形成させた。そして、制御部31は、Al−CVD膜P1を埋め込む前に、ビアホールVHの底部に位置する金属窒化膜BM2の一部をスパッタし、ビアホールVHの底部の側壁に再付着窒化膜BMrを形成させた。
According to the said embodiment, there exist the following effects.
(1) In the above embodiment, the controller 31 covers the surface of the silicon substrate S having the via hole VH with the metal film BM1 (Ti film) and the metal nitride film BM2 (TiN film), and covers the metal nitride film BM2. An Al-CVD film P1 was formed inside the formed via hole VH using the CVD method. Then, before embedding the Al-CVD film P1, the control unit 31 sputters a part of the metal nitride film BM2 located at the bottom of the via hole VH to form a reattached nitride film BMr on the side wall of the bottom of the via hole VH. It was.

したがって、ビアホールVHの底部からAl−CVD膜を成長させることができ、かつ、ビアホールVHの開口を開け続けることができる。この結果、Al−CVD膜のボトムアップを図ることができ、Al−CVD膜の埋め込み性を向上させることができる。   Therefore, an Al-CVD film can be grown from the bottom of the via hole VH, and the opening of the via hole VH can be continuously opened. As a result, bottom-up of the Al-CVD film can be achieved, and the embedding property of the Al-CVD film can be improved.

(2)上記実施形態において、制御部31は、金属窒化膜BM2を成膜する過程において底部窒化膜BMsをスパッタし、再付着窒化膜BMrを形成させた。したがって、金属窒化膜BM2の被覆と、再付着窒化膜BMrの形成と、を同時に実行させることができる。この結果、金属窒化膜BM2の被覆と、再付着窒化膜BMrと、を別々に実行させる場合に比べ、ビアプラグの処理工程数を削減させることができ、スループットを向上させることができる。   (2) In the embodiment described above, the control unit 31 sputters the bottom nitride film BMs in the process of forming the metal nitride film BM2, thereby forming the reattached nitride film BMr. Therefore, the coating of the metal nitride film BM2 and the formation of the redeposition nitride film BMr can be performed simultaneously. As a result, the number of via plug processing steps can be reduced and the throughput can be improved as compared with the case where the coating of the metal nitride film BM2 and the reattached nitride film BMr are performed separately.

(3)上記実施形態において、制御部31は、ビアホールVHの底部に位置する金属窒化膜BM2が略平坦になるように底部窒化膜BMsをスパッタさせた。したがって、底部に位置する金属窒化膜BM2の過剰なスパッタを回避させることができ、かつ、再付着窒化膜BMrの再付着量を規格化させることができる。この結果、より高い再現性の下において、Al−CVD膜P1によりビアホールVHを埋め込むことができる。   (3) In the above embodiment, the control unit 31 sputters the bottom nitride film BMs so that the metal nitride film BM2 located at the bottom of the via hole VH is substantially flat. Therefore, excessive sputtering of the metal nitride film BM2 located at the bottom can be avoided, and the reattachment amount of the reattachment nitride film BMr can be normalized. As a result, the via hole VH can be filled with the Al-CVD film P1 under higher reproducibility.

(4)上記実施形態では、制御部31が、Al−CVD膜P1をアニールさせる。したがって、Al−CVD膜P1と金属窒化膜BM2との間の密着性を向上させることができ、Al−CVD膜P1の埋め込み状態を安定させることができる。   (4) In the above embodiment, the control unit 31 anneals the Al-CVD film P1. Therefore, the adhesion between the Al-CVD film P1 and the metal nitride film BM2 can be improved, and the embedded state of the Al-CVD film P1 can be stabilized.

(5)上記実施形態では、制御部31が、Al−CVD膜P1の上に更にPVD法を用いてAl−PVD膜P2を積層させる。したがって、埋め込み性に優れたCVD法によるAl−CVD膜P1と、処理能力に優れたPVD法によるAl−PVD膜P2と、によっ
てビアプラグを形成できる。この結果、CVD法を用いて全てのビアプラグを形成させる場合に比べて、スループットを向上させることができる。
(5) In the said embodiment, the control part 31 laminates | stacks the Al-PVD film | membrane P2 further using the PVD method on the Al-CVD film | membrane P1. Therefore, a via plug can be formed by the Al-CVD film P1 by the CVD method having excellent embedding property and the Al-PVD film P2 by the PVD method having excellent processing ability. As a result, the throughput can be improved as compared with the case where all via plugs are formed using the CVD method.

(6)上記実施形態では、金属膜BM1と金属窒化膜BM2を同一のチャンバ、すなわちバリアメタルチャンバ4によって成膜させることができる。したがって、金属膜BM1と金属窒化膜BM2を異なるチャンバによって被覆させる場合に比べ、成膜装置1の構成を簡単にさせることができる。   (6) In the above embodiment, the metal film BM1 and the metal nitride film BM2 can be formed in the same chamber, that is, the barrier metal chamber 4. Therefore, the configuration of the film forming apparatus 1 can be simplified as compared with the case where the metal film BM1 and the metal nitride film BM2 are covered by different chambers.

尚、上記実施形態は、以下の態様で実施してもよい。
・上記実施形態では、凹部をビアホールVHに具体化した。これに限らず、例えば、凹部をコンタクトホール(Contact hole)に具体化してもよい。また、図10に示すように、ダマシン(Damascene)配線を形成するための溝を、凹部として具体化してもよい。
In addition, you may implement the said embodiment in the following aspects.
In the above embodiment, the concave portion is embodied as the via hole VH. For example, the recess may be embodied as a contact hole. Further, as shown in FIG. 10, a groove for forming a damascene wiring may be embodied as a concave portion.

・上記実施形態では、金属窒化膜BM2をSIS法により成膜し、金属窒化膜BM2を成膜する過程において再付着窒化膜BMrを形成させる構成にした。これに限らず、例えば、基板バイアス電源G1の出力値を0[W]にして金属窒化膜BM2を成膜した後、別途金属窒化膜BM2をスパッタさせて再付着窒化膜BMrを形成させる構成にしてもよい。   In the above embodiment, the metal nitride film BM2 is formed by the SIS method, and the reattached nitride film BMr is formed in the process of forming the metal nitride film BM2. For example, after forming the metal nitride film BM2 with the output value of the substrate bias power supply G1 being 0 [W], the metal nitride film BM2 is sputtered separately to form the reattached nitride film BMr. May be.

・上記実施形態では、バリアメタルチャンバ4を、直流マグネトロン方式のチャンバに具体化した。これに限らず、例えば、バリアメタルチャンバ4を、単なる直流スパッタ法式、交流スパッタ法式、あるいは交流マグネトロン方式のチャンバに具体化してもよい。すなわち、バリアメタルチャンバ4は、底部窒化膜BMsをスパッタし、再付着窒化膜BMrを形成するチャンバであればよい。   In the above embodiment, the barrier metal chamber 4 is embodied as a DC magnetron type chamber. For example, the barrier metal chamber 4 may be embodied as a simple DC sputtering method, AC sputtering method, or AC magnetron chamber. That is, the barrier metal chamber 4 may be any chamber that sputters the bottom nitride film BMs to form the reattached nitride film BMr.

・上記実施形態では、アニール部をアニールチャンバ6に具体化した。これに限らず、例えば、アニール部を、アニール処理を可能とする加熱手段(基板ステージやランプヒータ)として具体化し、Al−PVDチャンバ7の成膜室7aに設ける構成にしてもよい。これによれば、アニールチャンバ6を必要としない分だけ、成膜装置1の構成を簡単にさせることができる。   In the above embodiment, the annealing part is embodied in the annealing chamber 6. For example, the annealing unit may be embodied as a heating unit (substrate stage or lamp heater) that enables annealing, and may be provided in the film forming chamber 7 a of the Al-PVD chamber 7. According to this, the configuration of the film forming apparatus 1 can be simplified as much as the annealing chamber 6 is not required.

・上記実施形態では、第二アルミニウム膜を、Al−PVDチャンバ7によって形成する構成にした。これに限らず、例えば、第二アルミニウム膜を、Al−CVDチャンバ5によって形成する構成にしてもよい。これによれば、Al−PVDチャンバ7を必要としない分だけ、成膜装置1の構成を簡単にさせることができる。   In the above embodiment, the second aluminum film is formed by the Al-PVD chamber 7. For example, the second aluminum film may be formed by the Al-CVD chamber 5. According to this, the configuration of the film forming apparatus 1 can be simplified as much as the Al-PVD chamber 7 is not required.

成膜装置を示す模式的な平面図。1 is a schematic plan view showing a film forming apparatus. バリアメタルチャンバを示す概略断面図。The schematic sectional drawing which shows a barrier metal chamber. Al−CVDチャンバを示す概略断面図。The schematic sectional drawing which shows an Al-CVD chamber. 成膜装置の電気的構成を示す電気ブロック回路図。The electric block circuit diagram which shows the electrical constitution of the film-forming apparatus. 半導体装置の製造方法を示す工程図。Process drawing which shows the manufacturing method of a semiconductor device. 半導体装置の製造方法を示す工程図。Process drawing which shows the manufacturing method of a semiconductor device. 半導体装置の製造方法を示す工程図。Process drawing which shows the manufacturing method of a semiconductor device. 半導体装置の製造方法を示す工程図。Process drawing which shows the manufacturing method of a semiconductor device. 半導体装置の製造方法を示す工程図。Process drawing which shows the manufacturing method of a semiconductor device. 変更例における半導体装置の製造方法を示す工程図。Process drawing which shows the manufacturing method of the semiconductor device in the example of a change.

符号の説明Explanation of symbols

BM1…金属膜、BM2…金属窒化膜、P1…第一アルミニウム膜、P2…第二アルミ
ニウム膜、S…シリコン基板、VH…凹部としてのビアホール、1…半導体装置の製造装置としての成膜装置、3…搬送部としてのコアチャンバ、4…第一成膜部としてのバリアメタルチャンバ、5…第二成膜部としてのAl−CVDチャンバ、6…アニール部としてのアニールチャンバ、7…第三成膜部としてのAl−PVDチャンバ、16…ターゲット、31…制御部。
BM1 ... Metal film, BM2 ... Metal nitride film, P1 ... First aluminum film, P2 ... Second aluminum film, S ... Silicon substrate, VH ... Via hole as a recess, 1 ... Film forming apparatus as a semiconductor device manufacturing apparatus, DESCRIPTION OF SYMBOLS 3 ... Core chamber as a conveyance part, 4 ... Barrier metal chamber as a 1st film-forming part, 5 ... Al-CVD chamber as a 2nd film-forming part, 6 ... Annealing chamber as an annealing part, 7 ... 3rd composition Al-PVD chamber as a film part, 16 ... target, 31 ... control part.

Claims (12)

凹部を有した基板の表面に金属膜を被覆する工程と、
前記金属膜の表面に金属窒化膜を被覆する工程と、
前記金属窒化膜に被覆された前記凹部の内部にCVD法を用いて第一アルミニウム膜を埋め込む工程と、
を有した半導体装置の製造方法であって、
前記第一アルミニウム膜を埋め込む前に、前記凹部の底部に位置する前記金属窒化膜の一部をスパッタし、前記底部に位置する前記金属窒化膜の一部を前記底部の側壁に再付着させること、
を特徴とする半導体装置の製造方法。
Coating a metal film on the surface of the substrate having a recess;
Coating the surface of the metal film with a metal nitride film;
A step of embedding a first aluminum film using a CVD method inside the recess covered with the metal nitride film;
A method of manufacturing a semiconductor device having
Before embedding the first aluminum film, a part of the metal nitride film located at the bottom of the recess is sputtered, and a part of the metal nitride film located at the bottom is reattached to the side wall of the bottom. ,
A method of manufacturing a semiconductor device.
請求項1に記載の半導体装置の製造方法であって、
前記金属窒化膜を被覆するときに、前記凹部の底部に位置する前記金属窒化膜の一部をスパッタし、前記底部に位置する前記金属窒化膜の一部を前記底部の側壁に再付着させること、
を特徴とする半導体装置の製造方法。
A method of manufacturing a semiconductor device according to claim 1,
When coating the metal nitride film, a part of the metal nitride film located at the bottom of the recess is sputtered, and a part of the metal nitride film located at the bottom is reattached to the side wall of the bottom. ,
A method of manufacturing a semiconductor device.
請求項1又は2に記載の半導体装置の製造方法であって、
前記凹部の底部に位置する前記金属窒化膜の一部をスパッタし、前記底部に位置する前記金属窒化膜を略平坦にさせること、
を特徴とする半導体装置の製造方法。
A method of manufacturing a semiconductor device according to claim 1 or 2,
Sputtering a part of the metal nitride film located at the bottom of the recess to make the metal nitride film located at the bottom substantially flat,
A method of manufacturing a semiconductor device.
請求項1〜3のいずれか1つに記載の半導体装置の製造方法であって、
前記第一アルミニウム膜をアニールすること、
を特徴とする半導体装置の製造方法。
It is a manufacturing method of the semiconductor device according to any one of claims 1 to 3,
Annealing the first aluminum film;
A method of manufacturing a semiconductor device.
請求項1〜4のいずれか1つに記載の半導体装置の製造方法であって、
前記第一アルミニウム膜の上に更にPVD法を用いて第二アルミニウム膜を積層すること、
を特徴とする半導体装置の製造方法。
It is a manufacturing method of the semiconductor device according to any one of claims 1 to 4,
A second aluminum film is further laminated on the first aluminum film using a PVD method;
A method of manufacturing a semiconductor device.
請求項1〜5のいずれか1つに記載の半導体装置の製造方法であって、
前記金属膜は、チタン、タンタル、ニッケル、コバルトのいずれか1つからなること、
前記金属窒化膜は、窒化チタン、窒化タンタル、窒化ニッケル、窒化コバルトのいずれか1つからなること、
を特徴とする半導体装置の製造方法。
It is a manufacturing method of the semiconductor device according to any one of claims 1 to 5,
The metal film is made of any one of titanium, tantalum, nickel, and cobalt;
The metal nitride film is made of any one of titanium nitride, tantalum nitride, nickel nitride, and cobalt nitride;
A method of manufacturing a semiconductor device.
基板の表面に金属膜を被覆し前記金属膜に金属窒化膜を被覆する第一成膜部と、
CVD法を用いて前記基板に第一アルミニウム膜を形成する第二成膜部と、
前記第一成膜部と前記第二成膜部に前記基板を搬送する搬送部と、
前記搬送部と前記第一成膜部を駆動し、前記表面に凹部を有した前記基板を前記第一成膜部に搬送させて前記基板に前記金属膜と前記金属窒化膜を被覆させ、前記搬送部と前記第二成膜部を駆動し、前記金属窒化膜を有した前記基板を第二成膜部に搬送させて前記金属窒化膜に被覆された前記凹部の内部に前記第一アルミニウム膜を形成させる制御部と、を備え、
前記制御部は、
前記第一成膜部を駆動して前記凹部の底部に位置する前記金属窒化膜の一部をスパッタさせ、前記底部に位置する前記金属窒化膜の一部を前記底部の側壁に再付着させること、を特徴とする半導体装置の製造装置。
A first film-forming part for coating a metal film on the surface of the substrate and coating the metal film with a metal nitride film;
A second film forming unit that forms a first aluminum film on the substrate using a CVD method;
A transport unit for transporting the substrate to the first film forming unit and the second film forming unit;
Driving the transport unit and the first film forming unit, transporting the substrate having a recess on the surface to the first film forming unit to cover the metal film and the metal nitride film on the substrate; The transporting unit and the second film forming unit are driven, the substrate having the metal nitride film is transported to the second film forming unit, and the first aluminum film is formed inside the recess covered with the metal nitride film. And a control unit for forming
The controller is
Driving the first film forming unit to sputter part of the metal nitride film located at the bottom of the recess, and reattaching part of the metal nitride film located at the bottom to the side wall of the bottom A semiconductor device manufacturing apparatus characterized by the above.
請求項7に記載の半導体装置の製造装置であって、
前記第一成膜部は、
前記金属膜の構成元素からなるターゲットを用いた反応性スパッタ法にて前記金属窒化膜を前記基板に被覆するとともに、前記基板にバイアス電圧を印加して前記凹部の底部に位置する前記金属窒化膜の一部をスパッタするチャンバであること、
前記制御部は、
前記ターゲットをスパッタさせて前記金属窒化膜を被覆させるとき、前記基板にバイアス電圧を印加して前記凹部の底部に位置する前記金属窒化膜の一部をスパッタさせること、
を特徴とする半導体装置の製造装置。
A manufacturing apparatus of a semiconductor device according to claim 7,
The first film forming unit includes:
The metal nitride film is coated on the substrate by a reactive sputtering method using a target composed of the constituent element of the metal film, and a bias voltage is applied to the substrate to be positioned at the bottom of the recess. A chamber for sputtering a part of
The controller is
When the target is sputtered to coat the metal nitride film, a bias voltage is applied to the substrate to sputter a part of the metal nitride film located at the bottom of the recess;
An apparatus for manufacturing a semiconductor device.
請求項7又は8に記載の半導体装置の製造装置であって、
前記第一成膜部は、
前記金属膜の構成元素からなるターゲットを用いた反応性スパッタ法にて前記金属窒化膜を形成するとともに、前記基板にバイアス電圧を印加して前記凹部の底部に位置する前記金属窒化膜の一部をスパッタするチャンバであること、
前記制御部は、
前記ターゲットをスパッタさせて前記金属窒化膜を被覆させるとき、前記基板にバイアス電圧を印加して前記凹部の底部に位置する前記金属窒化膜の一部をスパッタし、前記底部に位置する前記金属窒化膜を略平坦にさせること、
を特徴とする半導体装置の製造装置。
A semiconductor device manufacturing apparatus according to claim 7 or 8,
The first film forming unit includes:
The metal nitride film is formed by a reactive sputtering method using a target composed of the constituent element of the metal film, and a part of the metal nitride film located at the bottom of the concave portion by applying a bias voltage to the substrate A chamber for sputtering,
The controller is
When the target is sputtered to coat the metal nitride film, a bias voltage is applied to the substrate to sputter part of the metal nitride film located at the bottom of the recess, and the metal nitride located at the bottom Making the membrane substantially flat,
An apparatus for manufacturing a semiconductor device.
請求項7〜9のいずれか1つに記載の半導体装置の製造装置であって、
前記基板を所定の温度に昇温するアニール部を備え、
前記搬送部は、前記アニール部に前記基板を搬送すること、
前記制御部は、前記搬送部を駆動して前記第一アルミニウム膜の形成された前記基板を前記アニール部に搬送させ、前記アニール部を駆動して前記基板を前記所定の温度に昇温させ前記第一アルミニウム膜をアニールさせること、
を特徴とする半導体装置の製造装置。
A semiconductor device manufacturing apparatus according to any one of claims 7 to 9,
An annealing portion for raising the temperature of the substrate to a predetermined temperature,
The transport unit transports the substrate to the annealing unit;
The control unit drives the transport unit to transport the substrate on which the first aluminum film is formed to the annealing unit, and drives the annealing unit to raise the temperature of the substrate to the predetermined temperature. Annealing the first aluminum film;
An apparatus for manufacturing a semiconductor device.
請求項7〜10のいずれか1つに記載の半導体装置の製造装置であって、
PVD法を用いて前記基板に第二アルミニウム膜を被覆する第三成膜部を備え、
前記搬送部は、前記第三成膜部に前記基板を搬送すること、
前記制御部は、前記搬送部を駆動して前記第一アルミニウム膜の形成された前記基板を前記第三成膜部に搬送させ、前記第三成膜部を駆動して前記第一アルミニウム膜の上に更に前記第二アルミニウム膜を積層させること、
を特徴とする半導体装置の製造装置。
It is a manufacturing apparatus of the semiconductor device according to any one of claims 7 to 10,
A third film-forming part for covering the substrate with a second aluminum film using a PVD method;
The transport unit transports the substrate to the third film forming unit;
The control unit drives the transport unit to transport the substrate on which the first aluminum film is formed to the third film forming unit, and drives the third film forming unit to drive the first aluminum film. Further laminating the second aluminum film on the top,
An apparatus for manufacturing a semiconductor device.
請求項7〜11のいずれか1つに記載の半導体装置の製造装置であって、
前記第一成膜部は、チタン、タンタル、ニッケル、コバルトのいずれか1つからなるターゲットを搭載すること、
を特徴とする半導体装置の製造装置。
It is a manufacturing apparatus of the semiconductor device according to any one of claims 7-11,
The first film forming unit is equipped with a target made of any one of titanium, tantalum, nickel, and cobalt,
An apparatus for manufacturing a semiconductor device.
JP2006327178A 2006-12-04 2006-12-04 Method and apparatus for manufacturing semiconductor device Pending JP2008141051A (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP2006327178A JP2008141051A (en) 2006-12-04 2006-12-04 Method and apparatus for manufacturing semiconductor device

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP2006327178A JP2008141051A (en) 2006-12-04 2006-12-04 Method and apparatus for manufacturing semiconductor device

Publications (1)

Publication Number Publication Date
JP2008141051A true JP2008141051A (en) 2008-06-19

Family

ID=39602200

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2006327178A Pending JP2008141051A (en) 2006-12-04 2006-12-04 Method and apparatus for manufacturing semiconductor device

Country Status (1)

Country Link
JP (1) JP2008141051A (en)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2011059036A1 (en) * 2009-11-12 2011-05-19 株式会社 アルバック Semiconductor device manufacturing method
JP2013534370A (en) * 2010-08-20 2013-09-02 マイクロン テクノロジー, インク. Semiconductor structure and method for providing a conductive material in an opening

Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH06302543A (en) * 1993-04-09 1994-10-28 Nippon Steel Corp Production of semiconductor device
JPH08250497A (en) * 1995-03-03 1996-09-27 Samsung Electron Co Ltd Formation of metal wiring layer of semiconductor device
JP2002280387A (en) * 2001-03-13 2002-09-27 Samsung Electronics Co Ltd Metal wiring forming method for semiconductor chip
JP2004134498A (en) * 2002-10-09 2004-04-30 Renesas Technology Corp Semiconductor integrated circuit device and its manufacturing method
JP2005514777A (en) * 2001-12-21 2005-05-19 アプライド マテリアルズ インコーポレイテッド Self-ionized and inductively coupled plasmas for sputtering and resputtering.

Patent Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH06302543A (en) * 1993-04-09 1994-10-28 Nippon Steel Corp Production of semiconductor device
JPH08250497A (en) * 1995-03-03 1996-09-27 Samsung Electron Co Ltd Formation of metal wiring layer of semiconductor device
JP2002280387A (en) * 2001-03-13 2002-09-27 Samsung Electronics Co Ltd Metal wiring forming method for semiconductor chip
JP2005514777A (en) * 2001-12-21 2005-05-19 アプライド マテリアルズ インコーポレイテッド Self-ionized and inductively coupled plasmas for sputtering and resputtering.
JP2004134498A (en) * 2002-10-09 2004-04-30 Renesas Technology Corp Semiconductor integrated circuit device and its manufacturing method

Cited By (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2011059036A1 (en) * 2009-11-12 2011-05-19 株式会社 アルバック Semiconductor device manufacturing method
JPWO2011059036A1 (en) * 2009-11-12 2013-04-04 株式会社アルバック Manufacturing method of semiconductor device
JP2013534370A (en) * 2010-08-20 2013-09-02 マイクロン テクノロジー, インク. Semiconductor structure and method for providing a conductive material in an opening
US9177917B2 (en) 2010-08-20 2015-11-03 Micron Technology, Inc. Semiconductor constructions
US10121697B2 (en) 2010-08-20 2018-11-06 Micron Technology, Inc. Semiconductor constructions; and methods for providing electrically conductive material within openings
US10879113B2 (en) 2010-08-20 2020-12-29 Micron Technology, Inc. Semiconductor constructions; and methods for providing electrically conductive material within openings

Similar Documents

Publication Publication Date Title
US10096547B2 (en) Metallic interconnects products
US6518668B2 (en) Multiple seed layers for metallic interconnects
US6924226B2 (en) Methods for making multiple seed layers for metallic interconnects
JP5343369B2 (en) Semiconductor device manufacturing method, semiconductor manufacturing apparatus, and storage medium
US7588667B2 (en) Depositing rhuthenium films using ionized physical vapor deposition (IPVD)
US20050186795A1 (en) Method of forming buried wiring in semiconductor device
WO2005103321A2 (en) Ionized physical vapor deposition (ipvd) process
JP2007043038A (en) Depositing method of metal film, depositing equipment, and storage medium
US20190385908A1 (en) Treatment And Doping Of Barrier Layers
KR20160068668A (en) Copper wiring forming method, film forming system, and storage medium
JP2011091242A (en) Method for manufacturing semiconductor device
KR20150108316A (en) Method of forming copper wiring
US10096548B2 (en) Method of manufacturing Cu wiring
US8721846B2 (en) Method of forming film, film forming apparatus and storage medium
WO2008010371A1 (en) Semiconductor device manufacturing method, semiconductor device manufacturing apparatus, computer program and storage medium
KR101396624B1 (en) Filming method, and treating system
JP4720464B2 (en) Film forming method, film forming apparatus, and storage medium
US6268284B1 (en) In situ titanium aluminide deposit in high aspect ratio features
JP2008141051A (en) Method and apparatus for manufacturing semiconductor device
JP2016174141A (en) METHOD OF MANUFACTURING Cu WIRING
WO2009096095A1 (en) Thin film forming method, plasma film forming apparatus and storage medium
JP2008141050A (en) Method and apparatus for manufacturing semiconductor device
TWI410517B (en) Method for forming tantalum nitride film
TWI397952B (en) Method for forming tantalum nitride film
JPH10233444A (en) Manufacture of semiconductor device

Legal Events

Date Code Title Description
A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20090518

A977 Report on retrieval

Free format text: JAPANESE INTERMEDIATE CODE: A971007

Effective date: 20111125

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20111206

A521 Written amendment

Effective date: 20120123

Free format text: JAPANESE INTERMEDIATE CODE: A523

A02 Decision of refusal

Effective date: 20120306

Free format text: JAPANESE INTERMEDIATE CODE: A02