JP2006242931A - Manufacturing method for oscillation gyro sensor element - Google Patents

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Koji Suzuki
浩二 鈴木
Teruyuki Inaguma
輝往 稲熊
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Abstract

<P>PROBLEM TO BE SOLVED: To restrain a piezoelectric thin film from separated out of an upper layer electrode film, in an oscillation type gyro sensor. <P>SOLUTION: This manufacturing method forms an oscillation type gyro sensor element 100 provided with a cantilever-shaped oscillator 110 comprising a piezoelectric oscillation body formed with a driving electrode 106a and detecting electrodes 106b, 106c, on a surface, by a thin film process. Recrystallization heat treatment is carried out at a temperature lower by 50°C or more than a heat treatment temperature when forming the piezoelectric substance thin film, after forming a lower electrode, a piezoelectric layer and an upper layer electrode pattern. <P>COPYRIGHT: (C)2006,JPO&NCIPI

Description

本発明は、表面に駆動電極と検出電極が形成された圧電セラミクス振動体からなる片持ち梁形状の振動子からなる振動型ジャイロセンサ素子の製造方法に関する。  The present invention relates to a method for manufacturing a vibration type gyro sensor element including a cantilever-shaped vibrator including a piezoelectric ceramic vibrator having a driving electrode and a detection electrode formed on a surface thereof.

近年、ビデオカメラの高ズーム率化や、カメラの小型化に伴う保持性の不足などで録画画像に手ブレが起き易くなり、その対策として、CCDイメージセンサなど撮像板上の画像情報の取り込み位置を変えることなどで手ブレを補正する機構が用いられている。  In recent years, it has been easy for camera shake to occur in recorded images due to the high zoom ratio of video cameras and the lack of retainability associated with the miniaturization of cameras. As a countermeasure, image information capture positions such as CCD image sensors can be captured. A mechanism for correcting camera shake by changing the position of the camera is used.

この補正は、画像の時間軸での位置ズレ自体のマッチングを行い補正する場合もあるが、撮影画像をティルトした際などでの誤動作を防ぐため、実際の手ブレを感知するセンサを用いて補正量を取得し、手ブレによる画像ジッターを補正する手法が主に用いられている。  This correction may be performed by matching the position shift itself on the time axis of the image, but it is corrected using a sensor that detects actual camera shake to prevent malfunctions when the captured image is tilted. A method of acquiring an amount and correcting image jitter due to camera shake is mainly used.

このような用途へのセンサとしては、ジャイロセンサが用いられているが、ジャイロセンサは、たとえばビデオカメラでの保持状態の回転角を検出して、対応する角速度を出力するセンサであり、検出機構としては、振動体を用いたもの、回転体を用いたもの、光を用いたものなどが存在する。そのなかで、振動体を用いたものは、機構が単純で、また起動時間が少ない特徴などから、小型で安価なセンサとして主流となっており、前述のビデオカメラでも多く用いられる。  As a sensor for such applications, a gyro sensor is used. The gyro sensor is a sensor that detects a rotation angle in a holding state of a video camera, for example, and outputs a corresponding angular velocity, and a detection mechanism. As such, there are those using a vibrating body, those using a rotating body, and those using light. Among them, those using a vibrating body have become the mainstream as a small and inexpensive sensor because of their simple mechanism and short start-up time, and are often used in the aforementioned video cameras.

従来、民生用の角速度センサとしては、棒状の振動子を所定の共振周波数で振動させておき、角速度の影響によって生じるコリオリ力を圧電素子等で検出することによって角速度を検出する振動型ジャイロセンサが広く使用されている。  Conventionally, as an angular velocity sensor for consumer use, there is a vibration type gyro sensor that detects an angular velocity by vibrating a rod-like vibrator at a predetermined resonance frequency and detecting a Coriolis force generated by the influence of the angular velocity with a piezoelectric element or the like. Widely used.

特開平10−332379号公報JP-A-10-332379 特開2000−131077号公報JP 2000-131077 A

従来、この振動型ジャイロセンサとしては、圧電材料を機械加工により切り出し、整形を行った振動子を用いていたが、ビデオカメラの小型化に伴い、センサ自体の小型化、高性能化、他用途のセンサとの組み合わせなどの要求が発生している。
しかしながら、小型化により圧電材料や電極をスパッタ膜により形成することにともなって、上層電極膜が剥離する等の問題がある。
Conventionally, as this vibration type gyro sensor, a piezoelectric material was cut out by mechanical processing and shaped, but a vibrator was used. However, along with the downsizing of video cameras, the sensor itself has become smaller, higher performance, and other uses. There is a demand for combination with other sensors.
However, as the piezoelectric material and the electrode are formed of a sputtered film due to downsizing, there is a problem that the upper electrode film is peeled off.

そこで、本発明の目的は、上述の如き従来の問題点に鑑み、振動型ジャイロセンサにおける圧電体薄膜と上層電極膜の剥離を抑制することにある。  Accordingly, an object of the present invention is to suppress peeling of the piezoelectric thin film and the upper electrode film in the vibration type gyro sensor in view of the conventional problems as described above.

本発明の更に他の目的、本発明によって得られる具体的な利点は、以下に説明される実施の形態の説明から一層明らかにされる。  Other objects of the present invention and specific advantages obtained by the present invention will become more apparent from the description of embodiments described below.

上層電極の剥離を抑えるためには、圧電特性の劣化を最小限に保ちつつ、プロセスの中で剥離する要素を排除する必要がある。剥離要素のひとつは圧電体からのPb析出であるが、下部電極、圧電材料、上層電極パターン形成後の再結晶化熱処理温度が、圧電体薄膜成膜時の熱処理温度より50℃以上低温で行うことで回避できる。また、上層電極上のレジストがある際、熱による応力が加わることも剥離要素となるが、これに関してもレジスト形成後の熱処理温度を120°C以上140°C以下に制御することで、剥離は回避できる。  In order to suppress the peeling of the upper layer electrode, it is necessary to eliminate the peeling element in the process while keeping the deterioration of the piezoelectric characteristics to a minimum. One of the peeling elements is Pb deposition from the piezoelectric material, and the recrystallization heat treatment temperature after forming the lower electrode, piezoelectric material, and upper electrode pattern is 50 ° C. or more lower than the heat treatment temperature at the time of forming the piezoelectric thin film. Can be avoided. In addition, when there is a resist on the upper electrode, stress due to heat is also a peeling element, but also in this regard, by controlling the heat treatment temperature after resist formation to 120 ° C. or more and 140 ° C. or less, peeling can be performed. Can be avoided.

そこで、本発明は、梁形状をなす基体となる基板上に下部電極膜、圧電材料、上層電極膜を形成してなる片持ち梁形状の振動子からなる振動型ジャイロセンサ素子の製造方法であって、下部電極、圧電材料、上層電極パターン形成後の再結晶化熱処理を、圧電体薄膜成膜時の熱処理温度より50℃以上低温で行う再結晶化熱処理工程を有することを特徴とする。  Accordingly, the present invention is a method for manufacturing a vibration type gyro sensor element comprising a cantilever-shaped vibrator formed by forming a lower electrode film, a piezoelectric material, and an upper electrode film on a substrate serving as a base having a beam shape. And a recrystallization heat treatment step in which the recrystallization heat treatment after forming the lower electrode, the piezoelectric material, and the upper layer electrode pattern is performed at a temperature lower by 50 ° C. or more than the heat treatment temperature at the time of forming the piezoelectric thin film.

また、本発明に係る振動型ジャイロセンサ素子の製造方法は、上層電極のレジストパターン形成後、120°C以上140°C以下で熱処理を行う熱処理工程を有する。  Moreover, the manufacturing method of the vibration type gyro sensor element according to the present invention includes a heat treatment step of performing heat treatment at 120 ° C. or more and 140 ° C. or less after forming the resist pattern of the upper electrode.

さらに、本発明に係る振動型ジャイロセンサ素子の製造方法は、下部電極のレジストパターン形成後、120°C以上140°C以下で熱処理を行う熱処理工程を有する。  Furthermore, the manufacturing method of the vibration type gyro sensor element according to the present invention includes a heat treatment step of performing heat treatment at 120 ° C. or more and 140 ° C. or less after forming the resist pattern of the lower electrode.

本発明によれば、超小型の振動子を持つ薄膜ジャイロにおいて、圧電特性の劣化を最小限に保持し、且つ上部電極の剥離を回避できる。  According to the present invention, in a thin film gyro having an ultra-small vibrator, deterioration of piezoelectric characteristics can be kept to a minimum, and peeling of the upper electrode can be avoided.

以下、本発明の実施の形態について、図面を参照して詳細に説明する。なお、本発明は以下の例に限定されるものではなく、本発明の要旨を逸脱しない範囲で、任意に変更可能であることは言うまでもない。  Hereinafter, embodiments of the present invention will be described in detail with reference to the drawings. Needless to say, the present invention is not limited to the following examples, and can be arbitrarily changed without departing from the gist of the present invention.

図1は、本発明を適用した角速度センサが備える振動型ジャイロセンサ素子100の外観斜視図である。  FIG. 1 is an external perspective view of a vibration type gyro sensor element 100 provided in an angular velocity sensor to which the present invention is applied.

この振動型ジャイロセンサ素子100は、図1の(A),(B)に示すように、シリコン単結晶基板から切り出されるいわゆる片持ち梁の振動子110を備えている。この振動子110は、長手方向に対して垂直な平面で切断したときの断面形状が直角四辺形となる四角柱状に形成されている。  As shown in FIGS. 1A and 1B, the vibration gyro sensor element 100 includes a so-called cantilever vibrator 110 cut out from a silicon single crystal substrate. The vibrator 110 is formed in a quadrangular prism shape whose cross-sectional shape when cut along a plane perpendicular to the longitudinal direction is a right quadrilateral.

この振動型ジャイロセンサ素子100は、そのおおよその大きさとして、素子厚みt1を300μm、素子長さt2を3mm、素子幅t3を1mmとした。また、実際に振動する振動梁すなわち振動子110の大きさとして、振動梁厚みt4を100μm、振動梁長さt5を2.0mm、振動梁幅t6を100μmとした。この形状で振動梁を振動させた場合の共振周波数はおよそ40kHz前後となる。以上の数値は1例であり使用する周波数、目標とする素子の大きさにより任意に設定可能である。  The vibration type gyro sensor element 100 has an approximate size of an element thickness t1 of 300 μm, an element length t2 of 3 mm, and an element width t3 of 1 mm. Further, as the size of the vibrating beam that actually vibrates, that is, the vibrator 110, the vibrating beam thickness t4 is set to 100 μm, the vibrating beam length t5 is set to 2.0 mm, and the vibrating beam width t6 is set to 100 μm. When the vibrating beam is vibrated in this shape, the resonance frequency is about 40 kHz. The above numerical values are examples, and can be arbitrarily set according to the frequency to be used and the size of the target element.

この振動型ジャイロセンサ素子100の平面図を図2に示す。振動子110は、基準電極104a、圧電体105aが順に積層され、さらに圧電体5a上に駆動電極106aと、駆動電極106aを挟む形で一対の検出電極106b,106cとが、振動子110の長手方向に沿って互いに平行に、且つ接触しないように形成されている。駆動電極106a,検出電極106b,106c、基準電極104aには、それぞれ配線接続端子101A,101B,101C,101Dが設けられている。  A plan view of the vibration gyro sensor element 100 is shown in FIG. In the vibrator 110, a reference electrode 104a and a piezoelectric body 105a are sequentially stacked. Further, a driving electrode 106a and a pair of detection electrodes 106b and 106c sandwiching the driving electrode 106a are arranged on the piezoelectric body 5a. They are formed so as to be parallel to each other and not in contact with each other. The drive electrode 106a, the detection electrodes 106b and 106c, and the reference electrode 104a are provided with wiring connection terminals 101A, 101B, 101C, and 101D, respectively.

圧電体105aは、例えば、チタン酸ジルコン酸鉛(PZT)などの圧電セラミックスや、水晶、LaTaOなどの圧電単結晶などからなる薄膜である。The piezoelectric body 105a is a thin film made of, for example, piezoelectric ceramics such as lead zirconate titanate (PZT), crystal, piezoelectric single crystal such as LaTaO 3, and the like.

この振動型ジャイロセンサ素子100は、図3に示すIC回路40に接続されることで動作し、角速度に応じて発生するコリオリ力を検出する角速度センサ50として機能する。  The vibration type gyro sensor element 100 operates by being connected to the IC circuit 40 shown in FIG. 3, and functions as an angular velocity sensor 50 that detects Coriolis force generated according to the angular velocity.

IC回路40は、加算回路41と、増幅回路42と、移相回路43と、AGC(Automatic Gain Control)44と、差動増幅回路45と、同期検波回路46と、平滑回路47とを備えている。  The IC circuit 40 includes an adder circuit 41, an amplifier circuit 42, a phase shift circuit 43, an AGC (Automatic Gain Control) 44, a differential amplifier circuit 45, a synchronous detection circuit 46, and a smoothing circuit 47. Yes.

振動型ジャイロセンサ素子100の1対の検出電極106b,106cは、それぞれ配線接続端子101B,101Cを介して、加算回路41と、差動増幅回路45に接続される。また、振動型ジャイロセンサ素子100の駆動電極106aは、AGC44の出力端と接続される。  The pair of detection electrodes 106b and 106c of the vibration type gyro sensor element 100 are connected to the adder circuit 41 and the differential amplifier circuit 45 via the wiring connection terminals 101B and 101C, respectively. The drive electrode 106 a of the vibration type gyro sensor element 100 is connected to the output end of the AGC 44.

角速度センサ50では、加算回路41、増幅回路42、移相回路43、AGC44及び振動型ジャイロセンサ素子100によっていわゆる移相発振回路が構成されており、この移相発振回路によって振動型ジャイロセンサ素子100の基準電極104a、駆動電極106a間に電圧が印加され振動子110を自励振動させる。振動子110の振動方向は、当該振動子110の厚み方向となる。  In the angular velocity sensor 50, a so-called phase shift oscillation circuit is configured by the adder circuit 41, the amplifier circuit 42, the phase shift circuit 43, the AGC 44 and the vibration type gyro sensor element 100, and the vibration type gyro sensor element 100 is constituted by this phase shift oscillation circuit. A voltage is applied between the reference electrode 104a and the drive electrode 106a to cause the vibrator 110 to self-oscillate. The vibration direction of the vibrator 110 is the thickness direction of the vibrator 110.

また、角速度センサ50では、1対の検出電極106b,106cが配線接続端子101B,101Cを介して接続された加算回路41、差動増幅回路45の出力端が、同期検波回路46に接続され、この同期検波回路46が平滑回路47に接続されており、これらと、圧電体105aとで、振動子110の角速度を検出する検出部として機能する。  Further, in the angular velocity sensor 50, the output terminal of the adder circuit 41 and the differential amplifier circuit 45 in which the pair of detection electrodes 106b and 106c are connected via the wiring connection terminals 101B and 101C are connected to the synchronous detection circuit 46, The synchronous detection circuit 46 is connected to the smoothing circuit 47, and these and the piezoelectric body 105a function as a detection unit that detects the angular velocity of the vibrator 110.

すなわち、図2に示す角速度センサ50では、振動型ジャイロセンサ素子100の振動子110を上述した移相発振回路で自励振動させている際に、振動子110の長手方向に角速度が加えられることで振動方向に垂直な方向に発生するコリオリ力を、圧電体105aで検出し、検出電極106b,106cから互いに逆極性の信号として出力し、差動増幅回路45に入力する。差動増幅回路45にて増幅された出力は、同期検波回路46に入力され、同期検波が行われる。このとき、同期検波回路46には、同期検波を行うために、加算器41からの出力が同期信号として供給される。そして、同期検波回路46からの出力が、平滑回路47を介して、振動子110に生じたコリオリ力を検出することにより得られた直流信号である角速度信号として出力される。  That is, in the angular velocity sensor 50 shown in FIG. 2, the angular velocity is applied in the longitudinal direction of the vibrator 110 when the vibrator 110 of the vibration type gyro sensor element 100 is self-excited by the phase-shift oscillation circuit described above. The Coriolis force generated in the direction perpendicular to the vibration direction is detected by the piezoelectric body 105 a, output as signals having opposite polarities from the detection electrodes 106 b and 106 c, and input to the differential amplifier circuit 45. The output amplified by the differential amplifier circuit 45 is input to the synchronous detection circuit 46, where synchronous detection is performed. At this time, the output from the adder 41 is supplied to the synchronous detection circuit 46 as a synchronous signal in order to perform synchronous detection. The output from the synchronous detection circuit 46 is output as an angular velocity signal that is a DC signal obtained by detecting the Coriolis force generated in the vibrator 110 via the smoothing circuit 47.

以上のように、角速度センサ50では、圧電体105aを用いて振動子110を振動させるとともに、振動子110に生じるコリオリ力を圧電体105aによって検出し、この圧電体105aによって検出されたコリオリ力に基づいて角速度を検出することができる。  As described above, in the angular velocity sensor 50, the vibrator 110 is vibrated using the piezoelectric body 105a, the Coriolis force generated in the vibrator 110 is detected by the piezoelectric body 105a, and the Coriolis force detected by the piezoelectric body 105a is detected. Based on this, the angular velocity can be detected.

上記振動型ジャイロセンサ素子100は、薄膜プロセスを用いて圧電薄膜センサとして次のようにして製造した。  The vibration gyro sensor element 100 was manufactured as a piezoelectric thin film sensor using a thin film process as follows.

まず、図4及び図5に示すようなSi基板1を用意する。基板1の大きさは所有する薄膜プロセスのラインに応じて任意に設定され、本実施の形態では直径が4インチのウエハーを用いた。基板1の厚みは、作業性や基板の値段により決定されるが、最終的に振動子の厚み以上であれば良く、本実施の形態では300μmの厚みとした。このSi基板1には両面には、異方性湿式エッチングの際の保護マスクとなる熱酸化により形成された熱酸化膜(SiO膜)2A,2Bを形成しておく。熱酸化膜2A、2Bの厚みは任意であるが、本実施の形態では0.3μm程度とした。また、Si基板1に関してはN型を採用しているが、その選択は任意である。ただし、Si基板1の方位面は正確に規定され、図1で示す基板広口面が(100)方位面、基板1の断面となる図4の面が(110)面となるように基板の切り出しを行う必要がある。First, a Si substrate 1 as shown in FIGS. 4 and 5 is prepared. The size of the substrate 1 is arbitrarily set according to the line of the thin film process that is owned, and in this embodiment, a wafer having a diameter of 4 inches is used. Although the thickness of the substrate 1 is determined by workability and the price of the substrate, it may be finally equal to or greater than the thickness of the vibrator, and in this embodiment, the thickness is 300 μm. Thermal oxide films (SiO 2 films) 2A and 2B formed by thermal oxidation serving as protective masks during anisotropic wet etching are formed on both sides of the Si substrate 1. Although the thickness of the thermal oxide films 2A and 2B is arbitrary, it is set to about 0.3 μm in the present embodiment. Further, although the N type is adopted for the Si substrate 1, the selection is arbitrary. However, the azimuth plane of the Si substrate 1 is precisely defined, and the substrate is cut out so that the wide-mouth plane of the substrate shown in FIG. 1 is the (100) azimuth plane and the plane of FIG. Need to do.

次に、図6及び図7に示すように、基板1の裏面の熱酸化膜2Bの一部を除去するために、除去する部分を開口部とするレジストパターン膜3を形成する。  Next, as shown in FIGS. 6 and 7, in order to remove a part of the thermal oxide film 2 </ b> B on the back surface of the substrate 1, a resist pattern film 3 having an opening as a part to be removed is formed.

図7は図6のX−X‘部分の断面図で以下同様である。  FIG. 7 is a cross-sectional view taken along the line X-X ′ of FIG.

形成方法は通常半導体の薄膜工程で用いられるいわゆるフォトリソグラフィーの技術を用いている。レジスト膜3は東京応化社製OFPR−8600を用いたが、レジスト膜3の種類に関しては任意である。フォトリソグラフィーの工程はレジスト膜塗布・プレベーキング・露光・現像という一般的に薄膜工程で用いられる技術であり、ここでは詳細は省略する。また、今後のプロセスに於いてもフォトリソグラフィーの技術を用いているが、特殊な使用方法を除き一般的な工程に関しては省略する。図5で示す開口部のそれぞれが1つの素子となる。  As a forming method, a so-called photolithography technique usually used in a semiconductor thin film process is used. As the resist film 3, OFPR-8600 manufactured by Tokyo Ohka Co., Ltd. was used, but the type of the resist film 3 is arbitrary. The photolithography process is a technique generally used in a thin film process such as resist film coating, pre-baking, exposure, and development, and details thereof are omitted here. Photolithography technology is also used in future processes, but general steps are omitted except for special usage methods. Each of the openings shown in FIG. 5 becomes one element.

開口部の形状は最終的な梁形状と基板1の厚み、および梁形状を形成する際のエッチング幅で決定される。エッチング幅は後に図39〜図41を参照して説明するが、ここでは50μmとする。  The shape of the opening is determined by the final beam shape, the thickness of the substrate 1, and the etching width when the beam shape is formed. The etching width will be described later with reference to FIGS. 39 to 41, but here it is 50 μm.

まず、幅方向(ダイヤフラム幅t9)に関して、必要となる幅は振動梁幅t6+エッチング幅t7×2(左右分)にさらに基板1の厚みが本実施の形態では300μmで振動梁厚みが100μmであり、後述するが湿式エッチングの方法で基板厚み300μmを振動梁厚み100μmまで削る場合、図10で示すように55°の角度を持って削られる特徴があるためその分の幅(300−100)μm×tan55°=140μmを左右足しておく必要がある。結局ダイヤフラム幅t9=t6+t7×2+140×2=100+50×2+140×2=480μmとなる。同様にダイヤフラム長t8=振動梁長t5+梁空間幅t7+140×2=2000+50+140×2=2330μmとなる。  First, with respect to the width direction (diaphragm width t9), the required width is the vibrating beam width t6 + etching width t7 × 2 (left and right), and the thickness of the substrate 1 is 300 μm in this embodiment and the vibrating beam thickness is 100 μm. As will be described later, when a substrate thickness of 300 μm is shaved to 100 μm by a wet etching method, as shown in FIG. 10, there is a feature of being ground at an angle of 55 °, so that width (300-100) μm. Xtan 55 ° = 140 μm needs to be added to the left and right. Eventually, the diaphragm width t9 = t6 + t7 × 2 + 140 × 2 = 100 + 50 × 2 + 140 × 2 = 480 μm. Similarly, diaphragm length t8 = vibrating beam length t5 + beam space width t7 + 140 × 2 = 2000 + 50 + 140 × 2 = 2330 μm.

次に、図8及び図9で示すように、上記の開講部分に相当する部分の熱酸化膜2Bを除去する。除去の方法はイオンエッチング等の物理的エッチングでも湿式エッチングでも構わないが、基板1の界面の平滑性を考慮すると熱酸化膜2Bのみが除去される湿式エッチングが好適である。本実施の形態では湿式エッチングの薬液としてフッ化アンモニウムを用いた。ただし、湿式エッチングの場合長時間エッチングを行うと開口部分の側面からエッチングが進行するいわゆるサイドエッチングが大きくなるため、熱酸化膜2Bの開口部分のみが除去された時点で終了させる必要がある。  Next, as shown in FIGS. 8 and 9, the portion of the thermal oxide film 2 </ b> B corresponding to the opening portion is removed. The removal method may be physical etching such as ion etching or wet etching, but considering the smoothness of the interface of the substrate 1, wet etching in which only the thermal oxide film 2B is removed is suitable. In this embodiment, ammonium fluoride is used as a chemical solution for wet etching. However, in the case of wet etching, when etching is performed for a long time, so-called side etching in which etching proceeds from the side surface of the opening becomes large, and therefore it is necessary to terminate the etching when only the opening of the thermal oxide film 2B is removed.

次に、図10、図11及び図12に示すように、開口部分として露出した基板1に対して湿式エッチングを施すことにより、開口部分の基板1の厚みを所望の振動梁厚t4になるまで削る。本実施の形態ではSiである基板1をエッチングするためTMAH20%溶液を用いている。この際液温度を80°Cに保持し、浸漬エッチングを行っている。図12は図11のA部分を拡大して示したものである。上記の条件でエッチング量(ダイヤフラム深さt10を200μmとするためにはおよそ6時間必要となる。また、このエッチングにより開口部分の基板1の形状は図12に示すように端部が湿式エッチング角度θ1(=55°)を持って形成される。また、このような湿式エッチング薬液としてTMAH以外にKOH等が一般的に使用されるが、本実施の形態では熱酸化膜2A,2Bとのエッチングレートの選択比がより大きくなるTMAHを採用した。  Next, as shown in FIGS. 10, 11, and 12, wet etching is performed on the substrate 1 exposed as an opening portion until the thickness of the substrate 1 in the opening portion reaches a desired vibration beam thickness t4. Sharpen. In this embodiment, a TMAH 20% solution is used to etch the substrate 1 made of Si. At this time, the liquid temperature is kept at 80 ° C. and immersion etching is performed. FIG. 12 is an enlarged view of portion A in FIG. Under the above conditions, the etching amount (approximately 6 hours is required to set the diaphragm depth t10 to 200 μm. Further, the shape of the substrate 1 in the opening portion is wet etching angle as shown in FIG. In addition to TMAH, KOH or the like is generally used as such a wet etching chemical, but in this embodiment, etching with the thermal oxide films 2A and 2B is performed. TMAH, which has a higher rate selection ratio, was adopted.

ところで本実施の形態では振動梁厚みになるまでの基板研削にSiの特徴を活かした湿式エッチングを採用しているが、研削の方法は任意でありこの方法に限定されるものではない。  By the way, in this embodiment, wet etching utilizing the characteristics of Si is employed for substrate grinding until the thickness of the vibrating beam is reached, but the grinding method is arbitrary and is not limited to this method.

上記の方法により上記開口部分の中にダイヤフラムが形成される。湿式エッチングにより残されたダイヤフラム厚みt11が最終的に振動梁厚みt4と等しくなる。  A diaphragm is formed in the opening by the above method. The diaphragm thickness t11 left by wet etching finally becomes equal to the vibrating beam thickness t4.

以降、本実施の形態の振動型ジャイロセンサ素子100の製造方法の説明では、図13及び図14にWで示した1つの素子を拡大して説明する。また図では説明をわかり易くするため、実際の寸法比とは異なる場合もある。  Hereinafter, in the description of the manufacturing method of the vibration type gyro sensor element 100 of the present embodiment, one element indicated by W in FIGS. 13 and 14 will be described in an enlarged manner. Moreover, in order to make the explanation easy to understand in the figure, the actual dimensional ratio may be different.

また、図15及び図16に示すように今後は上記までに形成したダイヤフラムを形成した開口部および熱酸化膜2Bを下方にして説明する。  Further, as shown in FIG. 15 and FIG. 16, the description will be made with the opening formed with the above-described diaphragm and the thermal oxide film 2B facing downward.

次に、図17及び図18に示すように下層電極膜4、圧電膜5、上部電極膜6を形成する。下層電極膜4には圧電膜の特性を向上させるためにTi:50nm+Pt:100nmとした。まず、マグネトロンスパッタ装置でTiを50nm成膜し、上記i上にPtを200nm成膜した。Ti及びPtは、ガス圧0.3Paでそれぞれ1.0kW及び0.1kWのRFパワーで成膜した。次いで、マグネトロンスパッタ装置でPb1+x(Zr0.53Ti0.47)O3−yの酸化物ターゲットを用い、常温、Ar/O2比1/1、ガス圧0.7Pa、RFパワー1.0kWの条件で圧電体薄膜を1μm成膜した。その後、電気炉を用い酸素雰囲気下において700°Cで30分間結晶化熱処理を行った。その後、上記圧電体薄膜表面に上部電極膜としてPtを300nm成膜した。上記Ptはマグネトロンスパッタ装置でガス圧0.3Pa、RFパワー0.3kWの条件で成膜した。  Next, as shown in FIGS. 17 and 18, a lower electrode film 4, a piezoelectric film 5, and an upper electrode film 6 are formed. The lower electrode film 4 is made of Ti: 50 nm + Pt: 100 nm in order to improve the characteristics of the piezoelectric film. First, a Ti film having a thickness of 50 nm was formed by a magnetron sputtering apparatus, and a Pt film having a thickness of 200 nm was formed on the i. Ti and Pt were formed with a gas pressure of 0.3 Pa and RF power of 1.0 kW and 0.1 kW, respectively. Next, using a Pb1 + x (Zr0.53Ti0.47) O3-y oxide target in a magnetron sputtering apparatus, a piezoelectric body under conditions of normal temperature, Ar / O2 ratio 1/1, gas pressure 0.7 Pa, and RF power 1.0 kW. A thin film was formed to 1 μm. Thereafter, crystallization heat treatment was performed at 700 ° C. for 30 minutes in an oxygen atmosphere using an electric furnace. Thereafter, 300 nm of Pt was formed as an upper electrode film on the surface of the piezoelectric thin film. The Pt film was formed by a magnetron sputtering apparatus under conditions of a gas pressure of 0.3 Pa and an RF power of 0.3 kW.

次に、図19及び図20に示すように上部電極6を形成する。上部電極6は図19で示すように3つの部分に分かれる。その中の中心が振動梁を駆動させる動力を発生させるための駆動電極6Aであり、その左右にコリオリ力を検出するための検出電極6B,6Cが設置される。幅方向で駆動部分の中心が振動梁の中心と一致し、左右は対照に置かれる。また、図19のように振動梁の根元と上部電極膜6の直線部分の端部が一致する位置に置かれ、さらにその端部から配線接続部分が設けられている。  Next, as shown in FIGS. 19 and 20, the upper electrode 6 is formed. The upper electrode 6 is divided into three parts as shown in FIG. The center thereof is a drive electrode 6A for generating power for driving the vibrating beam, and detection electrodes 6B and 6C for detecting Coriolis force are provided on the left and right sides thereof. In the width direction, the center of the drive part coincides with the center of the vibrating beam, and the left and right are placed in contrast. Further, as shown in FIG. 19, the base of the vibrating beam and the end of the straight portion of the upper electrode film 6 are placed at the same position, and a wiring connection portion is provided from the end.

本実施の形態では駆動電極幅t13を50μm、検出電極幅t14を10μm、上部電極長t12を1.8mm、駆動電極6Aと検出電極6B,6Cの間は5μmとした。この大きさに関しては任意であるが、最終的な振動梁の大きさの範囲内に納める必要がある。また、後述する配線パターンとの接続部分に関しての形状も任意であり、本実施の形態では接続部幅t16を50μm、接続部長t15を50μmとした。  In this embodiment, the drive electrode width t13 is 50 μm, the detection electrode width t14 is 10 μm, the upper electrode length t12 is 1.8 mm, and the distance between the drive electrode 6A and the detection electrodes 6B and 6C is 5 μm. This size is arbitrary, but it must be within the range of the final vibrating beam size. In addition, the shape of the connection portion with the wiring pattern to be described later is also arbitrary, and in this embodiment, the connection portion width t16 is 50 μm and the connection portion length t15 is 50 μm.

上部電極6の形成方法としてはフォトリソグラフィー技術を用いて所望のレジスト膜パターンを形成した後、130°Cで3分間熱処理を行い、イオンエッチングにより不要な部分の上部電極膜を除去して形成した。レジスト膜パターン形成後の熱処理温度は120°C未満だとレジスト壁面が十分なテーパー角にならず、エッチングバリが発生し、140℃超だとレジストの応力で上層電極の剥がれが発生する。  The upper electrode 6 was formed by forming a desired resist film pattern using a photolithographic technique, then performing a heat treatment at 130 ° C. for 3 minutes, and removing an unnecessary portion of the upper electrode film by ion etching. . If the heat treatment temperature after forming the resist film pattern is less than 120 ° C., the resist wall surface does not have a sufficient taper angle and etching burrs are generated, and if it exceeds 140 ° C., the upper layer electrode is peeled off due to the stress of the resist.

次に図21及び図22に示す圧電膜5の形成を行う。圧電膜5の形状は上部電極膜6を完全に覆う形であれば形状は任意である。本実施の形態では圧電膜長t17を1.85mm、圧電膜幅t18を90μmとした。ここで、圧電膜幅の中心が振動梁の中心と一致し、下方端部を根元ラインに一致させる。圧電膜幅t18は振動梁の幅t4以下の幅である必要がある。また、上部電極膜6の接続部6a,6b,6cの圧電膜5は上部電極膜6の接続部分の外周より5μmの幅を待たせて形成した。この幅に関しては素子全体の形状サイズにより任意に設定される。  Next, the piezoelectric film 5 shown in FIGS. 21 and 22 is formed. The shape of the piezoelectric film 5 is arbitrary as long as it completely covers the upper electrode film 6. In the present embodiment, the piezoelectric film length t17 is 1.85 mm, and the piezoelectric film width t18 is 90 μm. Here, the center of the piezoelectric film width coincides with the center of the vibrating beam, and the lower end portion thereof coincides with the root line. The piezoelectric film width t18 needs to be less than or equal to the width t4 of the vibrating beam. The piezoelectric films 5 of the connection portions 6a, 6b, 6c of the upper electrode film 6 were formed with a width of 5 μm from the outer periphery of the connection portion of the upper electrode film 6. This width is arbitrarily set according to the shape size of the entire element.

以上の圧電部形成方法としては、フォトリソグラフィー技術を用いて圧電部形状のレジスト膜パターンを形成した後、本実施の形態ではフッ硝酸溶液による湿式エッチングにより除去した。除去の方法に関しては任意であり、物理的なイオンエッチングによる除去や、化学的にRIE(Reactive Ion Etching)により除去する方法が考えられる。  As the above piezoelectric part forming method, a resist film pattern having a piezoelectric part shape is formed using a photolithography technique, and then removed by wet etching with a hydrofluoric acid solution in this embodiment. The removal method is arbitrary, and removal by physical ion etching or chemical removal by RIE (Reactive Ion Etching) can be considered.

次に、図23及び図24に示すように下層電極4を形成する。この下層電極4も上記圧電部と同様に圧電膜5を完全に覆う形であれば形状は任意である。本実施の形態では下層電極長t19を1.9mm、下層電極幅t20を94μmとした。ここで、下層電極幅の中心が振動梁の中心と一致し、下方端部を根元ラインに一致させる。下層電極幅t20は振動梁の幅t4以下の幅である必要がある。また、接続部の下層電極4は圧電膜5の接続部分の外周より5μmの幅を待たせて形成した。この幅に関しては素子全体の形状サイズにより任意に設定される。また、下層電極膜4に対して外部との電気的接合を図るため、図23に示すように下層電極接合部分4Aを設ける。下層電極接合部4Aは、この後配線パターンで引き出せる面積を確保する必要があり、下層電極接合部長t21を50μm、下層電極接合部幅t22を100μmとした。  Next, as shown in FIGS. 23 and 24, the lower layer electrode 4 is formed. The shape of the lower electrode 4 is arbitrary as long as it completely covers the piezoelectric film 5 like the piezoelectric portion. In the present embodiment, the lower layer electrode length t19 is 1.9 mm, and the lower layer electrode width t20 is 94 μm. Here, the center of the lower electrode width coincides with the center of the vibrating beam, and the lower end coincides with the root line. The lower electrode width t20 needs to be less than or equal to the width t4 of the vibrating beam. Further, the lower layer electrode 4 of the connection part was formed by waiting for a width of 5 μm from the outer periphery of the connection part of the piezoelectric film 5. This width is arbitrarily set according to the shape size of the entire element. Further, in order to electrically connect the lower electrode film 4 to the outside, a lower electrode bonding portion 4A is provided as shown in FIG. The lower electrode joint portion 4A needs to secure an area that can be subsequently drawn out by the wiring pattern, and the lower electrode joint length t21 is 50 μm and the lower electrode joint width t22 is 100 μm.

以上の下層電極部形成方法としては、フォトリソグラフィー技術を用いて下層電極部形状のレジスト膜パターンを形成した後、イオンエッチングにより不要部分を除去することで形成している。この方法に関しても任意であり、イオンエッチングに限定されるものではない。  As the above lower electrode part formation method, after forming the resist film pattern of a lower electrode part shape using a photolithographic technique, it forms by removing an unnecessary part by ion etching. This method is also arbitrary and is not limited to ion etching.

以上の下層電極部形成方法では、フォトリソグラフィー技術を用いて下層電極部形状のレジスト膜パターンを形成した後、130°Cで3分間熱処理し、イオンエッチングにより不要部分を除去することとした。レジスト膜パターン形成後の熱処理温度は120°C未満だとレジスト壁面が十分なテーパー角にならず、エッチングバリが発生し、140℃超たとレジストの応力で上層電極の剥がれが発生する。  In the above lower electrode portion forming method, a resist film pattern having a lower electrode portion shape is formed by using a photolithography technique, followed by heat treatment at 130 ° C. for 3 minutes, and unnecessary portions are removed by ion etching. When the heat treatment temperature after forming the resist film pattern is less than 120 ° C., the resist wall surface does not have a sufficient taper angle and etching burrs are generated, and when it exceeds 140 ° C., the upper layer electrode peels off due to the stress of the resist.

ここで、エッチングを繰り返したことにより圧電特性の劣化が生じているため、電気炉を用い酸素雰囲気下において再度結晶化熱処理を行った。熱処理は高温の方が望ましいが、圧電体薄膜の成膜時の熱処理温度以上に加熱すると、上層電極が剥離する可能性があるため、本実施の形態では650°Cで30分間熱処理することとした。  Here, since the piezoelectric characteristics were deteriorated by repeating the etching, crystallization heat treatment was performed again in an oxygen atmosphere using an electric furnace. The heat treatment is preferably performed at a high temperature, but if heated above the heat treatment temperature at the time of forming the piezoelectric thin film, the upper electrode may be peeled off. In this embodiment, the heat treatment is performed at 650 ° C. for 30 minutes. did.

次に、図25及び図26に示すように、配線下地膜7を形成する。この目的は、後述する配線膜9の密着性を確保するためであり、絶縁材料が前提となる。配線下地膜7は振動子上、各電極接続部6a,6b,6c、振動子周辺のエッチング領域以外に成膜されていれば、その形状は任意である。本実施の形態では電極膜の密着性向上も兼ねて、上部電極膜6、下層電極膜4のそれぞれと配線下地膜を5μmの重なりを持たせることとした。  Next, as shown in FIGS. 25 and 26, a wiring base film 7 is formed. This purpose is to ensure the adhesion of the wiring film 9 described later, and an insulating material is a prerequisite. If the wiring base film 7 is formed on the vibrator other than the electrode connection portions 6a, 6b, 6c and the etching area around the vibrator, the shape of the wiring base film 7 is arbitrary. In the present embodiment, each of the upper electrode film 6 and the lower electrode film 4 and the wiring base film have an overlap of 5 μm in order to improve the adhesion of the electrode film.

配線下地膜7の形成方法は、フォトリソグラフィー技術により所望の形状を開口部とするレジスト膜パターンを形成した後、配線電極膜をスパッタリングにより成膜し、不要な部分に付着したスパッタリングした膜をレジスト膜の除去と同時に除去するいわゆるリフトオフの手法により形成した。材料はアルミナを選定し、75nm堆積させた。ただし、この配線膜の材料および形成方法は任意であり上記の形成方法および材料に限定されるものではない。  The wiring base film 7 is formed by forming a resist film pattern having an opening with a desired shape by a photolithography technique, forming a wiring electrode film by sputtering, and applying the sputtered film attached to unnecessary portions to the resist. The film was formed by a so-called lift-off method in which the film was removed simultaneously with removal. Alumina was selected as the material, and 75 nm was deposited. However, the material and the forming method of the wiring film are arbitrary and are not limited to the above forming method and material.

次に、図27及び図28に示すように電極接続部6a,6b,6cに平坦化レジスト膜8を設置する。この平坦化レジスト膜8は後述する配線膜9と上部電極膜6との電気的接合を円滑に行うことが目的である。配線膜9と上部電極膜6を物理的に接合する際に、圧電膜5と下層電極膜4の端部を通過せざるを得ないが、圧電膜5に関しては本実施の形態では湿式エッチングにより形成しておりその端部は逆テーパーないしはほぼ垂直状態となっており平坦化レジスト膜8を設置せずに配線を行うとその端部で断線する恐れがある。また、下層電極膜4が露出しているため平坦化レジスト膜により絶縁を取らないと電気的に短絡してしまう。以上の観点から平坦化レジスト膜8を設置している。  Next, as shown in FIGS. 27 and 28, a planarizing resist film 8 is provided on the electrode connecting portions 6a, 6b, 6c. The purpose of the planarizing resist film 8 is to smoothly perform electrical bonding between a wiring film 9 and an upper electrode film 6 described later. When the wiring film 9 and the upper electrode film 6 are physically joined, they must pass through the end portions of the piezoelectric film 5 and the lower electrode film 4, but the piezoelectric film 5 is wet-etched in this embodiment. The formed end portion is reversely tapered or substantially vertical, and if wiring is performed without installing the planarizing resist film 8, there is a risk of disconnection at the end portion. Further, since the lower electrode film 4 is exposed, an electrical short-circuit occurs unless insulation is taken with the planarizing resist film. From the above viewpoint, the planarizing resist film 8 is provided.

平坦化レジスト膜8の形状は、後述する配線膜9を覆う形であれば任意であり、本実施の形態では平坦化レジスト膜幅t23を200μm、平坦化レジスト膜長t24を50μmとした。  The shape of the flattening resist film 8 is arbitrary as long as it covers a wiring film 9 described later. In this embodiment, the flattening resist film width t23 is 200 μm and the flattening resist film length t24 is 50 μm.

平坦化レジスト膜8の形成方法はフォトリソグラフィー技術によりレジスト膜を所望の形状にパターニングを行った後、280〜300°C程度の熱処理を加えることでパターニングを行ったレジスト膜を硬化させる。この際、本実施の形態ではレジスト膜の厚みを2μm程度としたが、この厚みに関しては圧電膜5、下層電極膜4の厚みに応じて変化させ、およそ両者の厚みの合計の厚み以上の厚みを持たせることが望ましい。  The planarizing resist film 8 is formed by patterning the resist film into a desired shape by a photolithography technique and then curing the patterned resist film by applying a heat treatment of about 280 to 300 ° C. At this time, although the thickness of the resist film is about 2 μm in this embodiment, the thickness is changed according to the thickness of the piezoelectric film 5 and the lower electrode film 4 and is approximately equal to or greater than the total thickness of both. It is desirable to have

本実施の形態では上記の平坦化の目的のため、レジスト膜を用いているが、この材料に関してはこれに限定されるものではない。上記の目的に合う非導電性の材料であればその形成方法も含めて任意である。  In this embodiment mode, a resist film is used for the purpose of the above planarization, but this material is not limited to this. Any non-conductive material that meets the above-mentioned purpose is arbitrary including its formation method.

次に、図29及び図30に示すように、上部電極膜6と外部との接続を図るために配線膜9を形成する。これは外部との電気的接続を容易にするためであり、配線膜9は平坦化レジスト膜8の上面を通り上部電極膜6の接合部に接触される。上部電極接続部6a,6b,6cの形状は任意であるが電気的な接触抵抗を減少させるため、5μm四方以上の大きさが望ましい。また本実施の形態では外部との電気的接続に関してはAuバンプ+フリップチップによる接合方法を前提としているため、図29のように各電極に対して電極PAD101a,101b,101c,101dを形成することでAuバンプ領域を確保している。電極PAD101a,101b,101c,101dはAuバンプが可能な面積が必要であり、本実施の形態では電極PAD部長t25を120μm、電極PAD部幅t26を120μmとした。また、上部電極膜6である駆動電極6Aおよび左右の検出電極6B,6C、下層電極4の4つに対してそれぞれ外部との電気的な接合が必要となるため、配線膜9に関してもこれら4つに対して独立していることが必要であり、配線PAD101a,101b,101c,101dの位置については素子エリアAR内にあることが前提である。  Next, as shown in FIGS. 29 and 30, a wiring film 9 is formed in order to connect the upper electrode film 6 to the outside. This is for facilitating electrical connection with the outside, and the wiring film 9 passes through the upper surface of the planarizing resist film 8 and comes into contact with the junction of the upper electrode film 6. The shape of the upper electrode connecting portions 6a, 6b, and 6c is arbitrary, but is preferably 5 μm square or more in order to reduce electrical contact resistance. Further, in this embodiment, the electrical connection with the outside is premised on the bonding method by Au bump + flip chip, so that electrodes PAD101a, 101b, 101c, and 101d are formed on each electrode as shown in FIG. The Au bump area is secured. The electrodes PAD101a, 101b, 101c, and 101d need an area where Au bumps can be formed. In this embodiment, the electrode PAD portion length t25 is 120 μm and the electrode PAD portion width t26 is 120 μm. Further, since the drive electrode 6A, the left and right detection electrodes 6B and 6C, and the lower layer electrode 4 that are the upper electrode film 6 need to be electrically connected to the outside, respectively, the wiring film 9 also has these four. The wiring PADs 101a, 101b, 101c, and 101d are premised on being in the element area AR.

また、この工程において同時に分極レールも形成する。本実施の形態の振動子は、最終的に分極して圧電特性を安定化させるが、その分極作業を効率化するために同列の素子をまとめて行うことにしている。この同時分極を行うためには電圧印加側、GND側の配線を事前に形成しておく必要があり、ここでは、図31のように各分極レール111,112として横一直線に形成している。この時点では素子とレールは独立しているが、後述するCu分極線11の形成で印加側とGND側の配線が接続される。  In this process, a polarization rail is also formed at the same time. The vibrator according to the present embodiment is finally polarized to stabilize the piezoelectric characteristics, but in order to make the polarization work more efficient, the elements in the same row are collectively performed. In order to perform this simultaneous polarization, wirings on the voltage application side and the GND side must be formed in advance. Here, the polarization rails 111 and 112 are formed in a horizontal straight line as shown in FIG. At this time, the element and the rail are independent, but the wiring on the application side and the GND side are connected by the formation of the Cu polarization line 11 described later.

配線膜9の形成方法は、フォトリソグラフィー技術により所望の形状を開口部とするレジスト膜パターンを形成した後、配線電極膜をスパッタリングにより成膜し、不要な部分に付着したスパッタリングした膜をレジスト膜の除去と同時に除去するいわゆるリフトオフの手法により形成した。配線膜の材料としては付着力を向上させるためTiを20nm堆積させた後、Auバンプを容易にするためAuを500nm堆積させた。ただし、この配線膜の材料および形成方法は任意であり上記の形成方法および材料に限定されるものではない。  The wiring film 9 is formed by forming a resist film pattern having an opening with a desired shape by a photolithography technique, then forming a wiring electrode film by sputtering, and applying the sputtered film attached to unnecessary portions to the resist film. It was formed by a so-called lift-off method in which removal was performed at the same time as removal of the film. As a wiring film material, 20 nm of Ti was deposited to improve adhesion, and then 500 nm of Au was deposited to facilitate Au bumps. However, the material and the forming method of the wiring film are arbitrary and are not limited to the above forming method and material.

次に、図32及び33に示すように、振動梁上および配線上に絶縁保護膜10を形成する。この目的は、湿度などの外的要因による電極間リークを防止すること、また、電極膜の酸化を防止することである。振動子上保護膜幅t27は下層電極幅t20よりも広く、振動梁幅t6より狭いことが条件であり、本実施の形態ではt27を98μmとした。振動子上保護膜長t28は下層電極長t19よりも広く、振動子長さt5より狭いことが条件であり、本実施の形態ではt28を1.95mmとした。配線膜9上の保護膜10は、全体を覆うパターンであるが、Auバンプを行う電極PAD4箇所、及びCu配線11との接続部4箇所においては、選択的に保護膜が付かないようにする必要がある。  Next, as shown in FIGS. 32 and 33, the insulating protective film 10 is formed on the vibrating beam and the wiring. The purpose is to prevent leakage between electrodes due to external factors such as humidity, and also to prevent oxidation of the electrode film. The condition is that the vibrator upper protective film width t27 is wider than the lower electrode width t20 and narrower than the vibrating beam width t6, and in this embodiment, t27 is set to 98 μm. The condition is that the vibrator upper protective film length t28 is longer than the lower electrode length t19 and shorter than the vibrator length t5. In this embodiment, t28 is 1.95 mm. The protective film 10 on the wiring film 9 is a pattern that covers the entire surface. However, the protective film is selectively prevented from being attached at the four electrode PAD locations where Au bumps are formed and at the four connection portions with the Cu wiring 11. There is a need.

保護膜10の形成方法は、フォトリソグラフィー技術により所望の形状を開口部とするレジスト膜パターンを形成した後、保護膜をスパッタリングにより成膜し、不要な部分に付着したスパッタリングした膜をレジスト膜の除去と同時に除去するいわゆるリフトオフの手法により形成した。保護膜10の材料としては、付着力を向上させるためAlを50nm堆積させた後、絶縁性の高いSiOを750nm堆積し、最上層にはその後の振動梁形成時のレジスト密着性を向上させるためにAlを50nm堆積させた。絶縁保護膜として機能するSiOは、少なくとも上部電極の厚みの2倍以上は必要であるが、1μm以上の厚みになるとリフトオフ時にバリが発生しやすくなるため、本実施の形態では750nmとしている。また、SiO成膜時は膜密度を高めるため、Ar圧を放電限界の下限である0.4Paで行った。The protective film 10 is formed by forming a resist film pattern having a desired shape as an opening by a photolithography technique, forming a protective film by sputtering, and applying the sputtered film attached to unnecessary portions to the resist film. It was formed by a so-called lift-off method that is removed simultaneously with removal. As a material for the protective film 10, Al 2 O 3 is deposited to a thickness of 50 nm in order to improve adhesion, and then a highly insulating SiO 2 is deposited to a thickness of 750 nm. In order to improve the thickness, Al 2 O 3 was deposited to 50 nm. The SiO 2 functioning as an insulating protective film needs to be at least twice the thickness of the upper electrode. However, when the thickness is 1 μm or more, burrs are likely to occur during lift-off. Moreover, in order to increase the film density during the SiO 2 film formation, the Ar pressure was set at 0.4 Pa, which is the lower limit of the discharge limit.

次に、図34及び図35に示すようにCu配線11を形成する。Cu配線11は上部電極膜6の駆動電極6A、左右検出電極6B,6Cを電圧印加側のレール111に、下層電極4をGND側のレール112にそれぞれ接続する。Cu配線11は、図36に示すようにすべての素子で同様に接続を行う。この配線をCuにする理由は、分極後に湿式エッチングで容易に溶解し、素子にダメージを与えることなく再度素子を独立することができるためである。そのため、素子にダメージを与えることなく容易に消失させることができる導電体であれば、材料は任意である。配線幅は分極時の導通を確保するため、30μm以上が望ましい。  Next, as shown in FIGS. 34 and 35, a Cu wiring 11 is formed. The Cu wiring 11 connects the driving electrode 6A of the upper electrode film 6 and the left and right detection electrodes 6B and 6C to the rail 111 on the voltage application side, and the lower layer electrode 4 to the rail 112 on the GND side. As shown in FIG. 36, the Cu wiring 11 is similarly connected in all elements. The reason why this wiring is made Cu is that it is easily dissolved by wet etching after polarization, and the device can be made independent again without damaging the device. Therefore, any material can be used as long as it is a conductor that can be easily lost without damaging the element. The wiring width is preferably 30 μm or more in order to ensure conduction during polarization.

Cu配線11の形成方法は、フォトリソグラフィー技術により所望の形状を開口部とするレジスト膜パターンを形成した後、Cuをスパッタリングにより成膜し、不要な部分に付着したスパッタリングした膜をレジスト膜の除去と同時に除去するいわゆるリフトオフの手法により形成した。Cu膜厚は分極時の導通を確保するため、400nmとした。この配線膜の形成方法は任意であり上記の形成方法に限定されるものではない。  The Cu wiring 11 is formed by forming a resist film pattern having a desired shape as an opening by a photolithography technique, forming Cu by sputtering, and removing the sputtered film adhering to unnecessary portions by removing the resist film. At the same time, it was formed by a so-called lift-off method. The Cu film thickness was set to 400 nm to ensure conduction during polarization. The method for forming the wiring film is arbitrary and is not limited to the above-described forming method.

次に、図37及び図38に示すように裏面ストッパー膜12を形成する。この目的は、後述の振動梁形成で貫通エッチングをした際、最下面のプラズマ集中によるエッジ形状不良を防止するためである。本実施の形態では裏面全面にSiOを500nm、スパッタリングにより形成した。Next, as shown in FIGS. 37 and 38, the back surface stopper film 12 is formed. The purpose is to prevent edge shape defects due to plasma concentration on the lowermost surface when through etching is performed in the formation of a vibrating beam described later. In this embodiment, SiO 2 is formed with a thickness of 500 nm on the entire back surface by sputtering.

次に、図39、図40及び図41に示すように梁空間を除去して振動梁を形成する。図40は図39のYY’の断面図、図41は図39のXX’の断面図である。  Next, as shown in FIGS. 39, 40 and 41, the beam space is removed to form a vibrating beam. 40 is a cross-sectional view taken along the line YY ′ of FIG. 39, and FIG. 41 is a cross-sectional view taken along the line XX ′ of FIG.

梁空間の形成方法は、貫通部13を開口部とするレジスト膜パターンをフォトリソグラフィー技術により形成し、熱酸化膜(SiO)2Aをイオンエッチングにより除去した後、基板1を貫通するまでエッチングする。熱酸化膜2Aの除去に関しては湿式エッチングでも可能であるが、サイドエッチングによる寸法誤差を考慮するとイオンエッチングが好適である。また基板1のSiを貫通させるためには本実施の形態では振動梁厚みt14(ダイヤフラム厚みt11)が100μmであり、この量をエッチング除去する必要がある。通常のイオンエッチング等ではレジスト膜との選択比がとれない上に垂直な壁面として残すことは困難である。本実施の形態では、MEMS技術で用いられるICP(Inductively Coupled Plasma:誘導結合型プラズマ)を備えた装置に、エッチングと側壁保護膜成膜を繰り返すBoschプロセス(エッチング時SF、成膜時Cガス)を用いることで、垂直な即壁面を持つ振動梁の形成を行った。この垂直にSi材料を研削する技術は一般的に確立されており、本実施の形態でも市販されている装置により行っている。ただし梁空間の除去の方法に関しては任意であり、上記の方法に限定されるものではない。エッチング幅t7はICPでエッチング可能な幅が必要であり、本実施の形態では50μmとした。また、Cu配線ブリッジ幅t29はCu配線のライン上となるため、貫通させないようにする。ただし、本実施の形態の構造では、後述の素子切断にてこのCu配線ブリッジ部に沿ってカッティングすることで素子を分断するため、Cu配線ブリッジ幅t29は切断砥石幅以下であることが条件となる。本実施の形態ではCu配線ブリッジ幅t29を32μmとした。As a method for forming the beam space, a resist film pattern having the through portion 13 as an opening is formed by a photolithography technique, the thermal oxide film (SiO 2 ) 2A is removed by ion etching, and etching is performed until the substrate 1 is penetrated. . The removal of the thermal oxide film 2A can be performed by wet etching, but ion etching is preferable in consideration of a dimensional error due to side etching. In order to penetrate Si of the substrate 1, the vibration beam thickness t14 (diaphragm thickness t11) is 100 μm in this embodiment, and this amount needs to be removed by etching. In normal ion etching or the like, the selectivity with the resist film cannot be obtained, and it is difficult to leave it as a vertical wall surface. In this embodiment, a Bosch process (SF 6 during etching, C 4 during film formation) that repeats etching and sidewall protective film formation in an apparatus equipped with ICP (Inductively Coupled Plasma) used in MEMS technology. F 8 gas) by using, was formed of the vibrating beam with vertical immediate wall. The technology for grinding the Si material vertically is generally established, and this embodiment is also performed by a commercially available apparatus. However, the method for removing the beam space is arbitrary and is not limited to the above method. The etching width t7 needs to be a width that can be etched by ICP, and is 50 μm in this embodiment. Further, since the Cu wiring bridge width t29 is on the line of the Cu wiring, it is prevented from penetrating. However, in the structure of the present embodiment, the element is divided by cutting along the Cu wiring bridge portion in element cutting described later, so that the Cu wiring bridge width t29 is equal to or less than the cutting wheel width. Become. In the present embodiment, the Cu wiring bridge width t29 is set to 32 μm.

ICPでエッチング完了後は、裏面ストッパー膜12を除去する。除去方法は任意であるが、本実施の形態ではフッ化アンモニウムによる湿式エッチングにより除去した。この時ストッパー膜12を除去する前に、貫通パターンのレジストを除去してしまうと、絶縁保護膜10が消失してしまうため、ストッパー膜除去後にレジストを除去することとする。ストッパー膜12、レジスト除去後を図42〜図44に示す。  After completion of etching by ICP, the back surface stopper film 12 is removed. The removal method is arbitrary, but in this embodiment, the removal is performed by wet etching with ammonium fluoride. At this time, if the penetration pattern resist is removed before the stopper film 12 is removed, the insulating protective film 10 disappears. Therefore, the resist is removed after the stopper film is removed. The stopper film 12 and the resist after removal are shown in FIGS.

以上のプロセスにより、圧電薄膜センサの形成に関して、圧電素子形成、形状形成、配線形成の主要工程が終了する。図45に示すように基板1内に圧電薄膜センサとして振動型ジャイロセンサ素子100が複数個形成された状態となる。図45では5×5列で表しているが、設計する素子の大きさおよび列挙するピッチにより個数は決定される。  With the above process, the main steps of piezoelectric element formation, shape formation, and wiring formation are completed with respect to the formation of the piezoelectric thin film sensor. As shown in FIG. 45, a plurality of vibration type gyro sensor elements 100 as piezoelectric thin film sensors are formed in the substrate 1. In FIG. 45, it is represented by 5 × 5 columns, but the number is determined by the size of the element to be designed and the pitch to be listed.

次に、図46及び図47に示す素子に、圧電特性を安定にさせるための分極処理を施す。同列の素子をまとめて分極するため、印加側PAD、GND側PADを介して外部電源に接続する。接続の方法、分極方法は任意であるが、本実施の形態ではワイヤボンディングで外部電源に接続、20Vで10分間の条件で分極処理を施した。  Next, the element shown in FIGS. 46 and 47 is subjected to a polarization process for stabilizing the piezoelectric characteristics. In order to collectively polarize the elements in the same row, they are connected to an external power source via the application side PAD and the GND side PAD. Although the connection method and the polarization method are arbitrary, in this embodiment, the connection is made to an external power source by wire bonding, and the polarization treatment is performed at 20 V for 10 minutes.

次に、図48及び図49に示すように、分極処理後に不要となったCu配線11を除去する。Cu配線11を残したまま素子切断を行うと、切断面でCu配線11と基板1が電気的にリークするため、化学的に除去することが望ましい。本実施の形態では素子にダメージを与えないために、メルテックス社製エンストリップ溶液を用いて湿式エッチングを行い、消失させた。  Next, as shown in FIGS. 48 and 49, the Cu wiring 11 that is no longer necessary after the polarization process is removed. If the element is cut with the Cu wiring 11 left, the Cu wiring 11 and the substrate 1 leak electrically at the cut surface, so it is desirable to remove them chemically. In this embodiment, in order not to damage the element, wet etching was performed using an Enstrip solution manufactured by Meltex Co., and the element was eliminated.

次に図50及び図51に示すように、フリップチップを行うためのAuバンプ14を形成する。Auバンプ14は4箇所の電極PAD上に形成する。  Next, as shown in FIGS. 50 and 51, Au bumps 14 for performing flip chip are formed. The Au bumps 14 are formed on the four electrode PADs.

次に図52及び図53に示すように、基板1上に圧電薄膜センサとして形成された15個の振動型ジャイロセンサ素子100を個々に分断する。分断時はCu配線ブリッジ部の幅32μm以上の砥石で切断する必要があり、本実施の形態では幅40μmの砥石でダイシングによりカッティングした。図53のように素子サイズに従って切断線L1〜L3に沿って切断する。この場合の切断線L1,L2はCu配線ブリッジ部上を切断することが条件となるが、これにより貫通部13と切断面で分断された図54に示す圧電薄膜センサとして振動型ジャイロセンサ素子100が完成し、図53に示すC部が不要部分となる。  Next, as shown in FIGS. 52 and 53, the fifteen vibration type gyro sensor elements 100 formed as piezoelectric thin film sensors on the substrate 1 are individually divided. At the time of cutting, it is necessary to cut with a grindstone having a width of 32 μm or more in the Cu wiring bridge portion, and in this embodiment, cutting is performed by dicing with a grindstone having a width of 40 μm. As shown in FIG. 53, cutting is performed along cutting lines L1 to L3 according to the element size. In this case, the cutting lines L1 and L2 must be cut on the Cu wiring bridge portion. As a result, the vibration type gyro sensor element 100 as the piezoelectric thin film sensor shown in FIG. Is completed, and the portion C shown in FIG. 53 becomes an unnecessary portion.

このように、振動型ジャイロセンサ素子100を薄膜プロセスで形成し、上記薄膜プロセスで形成された薄膜の配線を通して複数個1度に分極処理を行うことによって、大量の薄膜ジャイロを安価に、且つ安定に形成できる。  As described above, the vibration type gyro sensor element 100 is formed by a thin film process, and a plurality of thin film gyroscopes are polarized at a time through the thin film wiring formed by the thin film process, so that a large number of thin film gyroscopes can be manufactured inexpensively and stably. Can be formed.

そして、個々に分断した振動型ジャイロセンサ素子100は、例えば図55に示すように、フリップチップの手法でIC基板に貼り付けられる。IC基板は素子の配置に合わせて電気的結線が完了するようにあらかじめ設計されている。図55の例では、振動型ジャイロセンサ素子100をX方向Y方向に1つずつ貼り付けることにより、2個の振動型ジャイロセンサ素子100X,100Yを備える二軸の加速度センサ150としている。
この加速度センサ150は、図56に示すように、素子および回路と外部との接触をなくすためカバー材15により保護されている。カバー材15の材料は任意であるが外部ノイズの影響を考慮して 金属などシールドの効果のあるものが望ましい。また、カバー材15は振動梁の振動を妨げない形状とされている。
Then, the individually divided vibration type gyro sensor elements 100 are attached to the IC substrate by a flip chip technique, for example, as shown in FIG. The IC substrate is designed in advance so that the electrical connection is completed according to the arrangement of the elements. In the example of FIG. 55, the biaxial acceleration sensor 150 including the two vibration gyro sensor elements 100X and 100Y is formed by attaching the vibration gyro sensor elements 100 one by one in the X direction and the Y direction.
As shown in FIG. 56, the acceleration sensor 150 is protected by a cover material 15 in order to eliminate contact between elements and circuits and the outside. The material of the cover material 15 is arbitrary, but it is desirable to have a shielding effect such as metal in consideration of the influence of external noise. Further, the cover material 15 has a shape that does not hinder the vibration of the vibrating beam.

本発明を実施するための最良の形態として示す振動型ジャイロセンサ素子の斜視図である。It is a perspective view of a vibration type gyro sensor element shown as the best mode for carrying out the present invention. 上記振動型ジャイロセンサ素子の平面図である。It is a top view of the said vibration type gyro sensor element. 上記振動型ジャイロセンサ素子の駆動検出回路の構成を示すブロック図である。It is a block diagram which shows the structure of the drive detection circuit of the said vibration type gyro sensor element. 上記振動型ジャイロセンサ素子を製造する際に用いる単結晶シリコン基板の平面図である。It is a top view of the single crystal silicon substrate used when manufacturing the said vibration type gyro sensor element. 上記単結晶シリコン基板を図5のXX’線で切断した際の断面図である。FIG. 6 is a cross-sectional view of the single crystal silicon substrate taken along line XX ′ in FIG. 5. 上記単結晶シリコン基板にレジスト膜パターンを形成した様子を示す平面図である。It is a top view which shows a mode that the resist film pattern was formed in the said single crystal silicon substrate. 上記単結晶シリコン基板を図6のXX’線で切断した際の断面図である。FIG. 7 is a cross-sectional view of the single crystal silicon substrate taken along line XX ′ in FIG. 6. 上記単結晶シリコン基板の熱酸化膜を除去した際の様子を示す平面図である。It is a top view which shows a mode when the thermal oxide film of the said single crystal silicon substrate is removed. 上記単結晶シリコン基板を図8のXX’線で切断した際の断面図である。FIG. 9 is a cross-sectional view of the single crystal silicon substrate taken along line XX ′ in FIG. 8. 上記単結晶シリコン基板に結晶異方性エッチングを施した様子を示す平面図である。It is a top view which shows a mode that the crystal anisotropic etching was given to the said single crystal silicon substrate. 上記単結晶シリコン基板を図10のXX’線で切断した際の断面図である。FIG. 11 is a cross-sectional view of the single crystal silicon substrate taken along line XX ′ in FIG. 10. 上記単結晶シリコン基板の図11に示す領域Aを拡大して示した断面図である。It is sectional drawing which expanded and showed the area | region A shown in FIG. 11 of the said single crystal silicon substrate. 上記単結晶シリコン基板の表面側の様子を示した平面図である。It is the top view which showed the mode of the surface side of the said single crystal silicon substrate. 上記単結晶シリコン基板を図13のXX’線で切断した際の断面図である。FIG. 14 is a cross-sectional view of the single crystal silicon substrate taken along line XX ′ in FIG. 13. 上記単結晶シリコン基板の裏面側の様子を示した平面図である。It is the top view which showed the mode of the back surface side of the said single crystal silicon substrate. 上記単結晶シリコン基板を図15のXX’線で切断した際の断面図である。FIG. 16 is a cross-sectional view of the single crystal silicon substrate taken along line XX ′ in FIG. 15. 下層電極膜、圧電膜、下層電極膜が形成された上記単結晶シリコン基板の様子を拡大して示す平面図である。It is a top view which expands and shows the mode of the said single crystal silicon substrate in which the lower layer electrode film, the piezoelectric film, and the lower layer electrode film were formed. 上記単結晶シリコン基板を図17のXX’線で切断した際の断面図である。FIG. 18 is a cross-sectional view of the single crystal silicon substrate taken along line XX ′ in FIG. 17. 駆動電極、検出電極が形成された上記単結晶シリコン基板の様子を拡大して示す平面図である。It is a top view which expands and shows the mode of the said single crystal silicon substrate in which the drive electrode and the detection electrode were formed. 上記単結晶シリコン基板を図19のXX’線で切断した際の断面図である。FIG. 20 is a cross-sectional view of the single crystal silicon substrate taken along line XX ′ in FIG. 19. 圧電膜が形成された上記単結晶シリコン基板の様子を拡大して示す平面図である。It is a top view which expands and shows the mode of the said single crystal silicon substrate in which the piezoelectric film was formed. 上記単結晶シリコン基板を図20のXX’線で切断した際の断面図である。FIG. 21 is a cross-sectional view of the single crystal silicon substrate taken along line XX ′ in FIG. 20. 下層電極が形成された上記単結晶シリコン基板の様子を拡大して示す平面図である。It is a top view which expands and shows the mode of the said single crystal silicon substrate in which the lower layer electrode was formed. 上記単結晶シリコン基板を図23のXX’線で切断した際の断面図である。FIG. 24 is a cross-sectional view of the single crystal silicon substrate taken along line XX ′ in FIG. 23. 配線下地膜が形成された単結晶シリコン基板の様子を拡大して示す平面図である。It is a top view which expands and shows the mode of the single crystal silicon substrate in which the wiring base film was formed. 上記単結晶シリコン基板を図25のYY’線で切断した際の断面図である。FIG. 26 is a cross-sectional view of the single crystal silicon substrate taken along line YY ′ of FIG. 25. 平坦化レジスト膜が形成された上記単結晶シリコン基板の様子を拡大して示す平面図である。It is a top view which expands and shows the mode of the said single crystal silicon substrate in which the planarization resist film was formed. 上記単結晶シリコン基板を図27のYY’線で切断した際の断面図である。FIG. 28 is a cross-sectional view of the single crystal silicon substrate taken along line YY ′ of FIG. 27. 配線接続端子が形成された上記単結晶シリコン基板の様子を拡大して示す平面図である。It is a top view which expands and shows the mode of the said single crystal silicon substrate in which the wiring connection terminal was formed. 上記単結晶シリコン基板を図29のYY’線で切断した際の断面図である。FIG. 30 is a cross-sectional view of the single crystal silicon substrate taken along line YY ′ of FIG. 29. 分極レールが形成された上記単結晶シリコン基板全体の様子を示す平面図である。It is a top view which shows the mode of the said single crystal silicon substrate in which the polarization rail was formed. 絶縁保護膜が形成された上記単結晶シリコン基板の様子を拡大して示す平面図である。It is a top view which expands and shows the mode of the said single crystal silicon substrate in which the insulating protective film was formed. 上記単結晶シリコン基板を図32のYY’線で切断した際の断面図である。FIG. 33 is a cross-sectional view of the single crystal silicon substrate taken along line YY ′ of FIG. 32. Cu配線が形成された上記単結晶シリコン基板の様子を拡大して示す平面図である。It is a top view which expands and shows the mode of the said single crystal silicon substrate in which Cu wiring was formed. 上記単結晶シリコン基板を図34のYY’線で切断した際の断面図である。FIG. 35 is a cross-sectional view of the single crystal silicon substrate taken along line YY ′ of FIG. 34. Cu配線が形成された上記単結晶シリコン基板全体の平面図である。It is a top view of the whole said single crystal silicon substrate in which Cu wiring was formed. 裏面ストッパー膜が形成された上記単結晶シリコン基板の様子を拡大して示す平面図である。It is a top view which expands and shows the mode of the said single crystal silicon substrate in which the back surface stopper film | membrane was formed. 上記単結晶シリコン基板を図37のYY’線で切断した際の断面図である。FIG. 38 is a cross-sectional view of the single crystal silicon substrate taken along line YY ′ of FIG. 37. 梁空間を除去して振動梁が形成された上記単結晶シリコン基板の様子を拡大して示す平面図である。It is a top view which expands and shows the mode of the said single crystal silicon substrate from which the beam space was removed and the vibration beam was formed. 上記単結晶シリコン基板を図37のYY’線で切断した際の断面図である。FIG. 38 is a cross-sectional view of the single crystal silicon substrate taken along line YY ′ of FIG. 37. 上記単結晶シリコン基板を図37のXX’線で切断した際の断面図である。FIG. 38 is a cross-sectional view of the single crystal silicon substrate taken along line XX ′ of FIG. 37. ストッパー膜を除去した上記単結晶シリコン基板の様子を拡大して示す平面図である。It is a top view which expands and shows the mode of the said single crystal silicon substrate which removed the stopper film | membrane. 上記単結晶シリコン基板を図42のYY’線で切断した際の断面図である。FIG. 43 is a cross-sectional view of the single crystal silicon substrate taken along line YY ′ of FIG. 42. 上記単結晶シリコン基板を図43のXX’線で切断した際の断面図である。FIG. 44 is a cross-sectional view of the single crystal silicon substrate taken along line XX ′ of FIG. 43. 圧電薄膜センサとして振動型ジャイロセンサ素子が複数個形成された上記単結晶シリコン基板全体の平面図である。It is a top view of the whole said single crystal silicon substrate in which a plurality of vibration type gyro sensor elements were formed as piezoelectric thin film sensors. 圧電特性を安定にさせるための分極処理を施す上記単結晶シリコン基板全体の平面図である。It is a top view of the said single crystal silicon substrate whole which performs the polarization process for stabilizing a piezoelectric characteristic. 圧電特性を安定にさせるための分極処理を施す上記単結晶シリコン基板を拡大して示す平面図である。It is a top view which expands and shows the said single crystal silicon substrate which performs the polarization process for stabilizing a piezoelectric characteristic. 分極処理後に不要となったCu配線を除去した上記単結晶シリコン基板全体の平面図である。It is a top view of the said single crystal silicon substrate whole which removed the Cu wiring which became unnecessary after the polarization process. 上記Cu配線を除去した上記単結晶シリコン基板を拡大して示す平面図である。It is a top view which expands and shows the said single crystal silicon substrate from which the said Cu wiring was removed. フリップチップを行うためのAuバンプが形成された上記単結晶シリコン基板全体の平面図である。It is a top view of the said single crystal silicon substrate whole in which Au bump for performing a flip chip was formed. 上記Auバンプが形成された上記単結晶シリコン基板を拡大して示す平面図である。It is a top view which expands and shows the said single crystal silicon substrate in which the said Au bump was formed. 圧電薄膜センサとして形成された15個の振動型ジャイロセンサ素子を個々に分断する際の切断線を示した上記単結晶シリコン基板全体の平面図である。It is the top view of the said single crystal silicon substrate whole which showed the cutting line at the time of dividing | segmenting 15 vibration type gyro sensor elements formed as a piezoelectric thin film sensor individually. 上記振動型ジャイロセンサ素子を個々に分断するする様子を示す上記単結晶シリコン基板を拡大して示す平面図である。It is a top view which expands and shows the said single-crystal silicon substrate which shows a mode that the said vibration type gyro sensor element is divided | segmented separately. 圧電薄膜センサとして形成された振動型ジャイロセンサ素子の平面図である。It is a top view of a vibration type gyro sensor element formed as a piezoelectric thin film sensor. 振動型ジャイロセンサ素子をIC基板上に貼り付けた際の様子を示す平面図である。It is a top view which shows a mode when a vibration type gyro sensor element is affixed on an IC substrate. 振動型ジャイロセンサ素子を備える角速度センサにカバー材を取り付けた際の様子を示す平面図である。It is a top view which shows a mode when a cover material is attached to the angular velocity sensor provided with a vibration type gyro sensor element.

符号の説明Explanation of symbols

1 基板、2A 熱酸化膜、2B 熱酸化膜、3 レジストパターン膜、4 下層電極、4A 下層電極接合部、5 圧電膜、6 上部電極膜、6A 駆動電極、6B,6C 左右検出電極、6a,6b,6c 上部電極接続部、7 配線下地膜、8 平坦化レジスト膜、9 配線膜、10 絶縁保護膜、11 Cu配線、12 裏面ストッパー膜、13 貫通部、14 Auバンプ、15 カバー材、40 IC回路、41 加算回路、42 増幅回路、43 移相回路、44 AGC、45 差動増幅回路、46 同期検波回路、47 平滑回路、100,100X,100Y 振動型ジャイロセンサ素子、101a,101b,101c,101d 電極PAD、101A,101B,101C,101D 配線接続端子、104a 基準電極、105a 圧電体、106a 駆動電極、106b,106c 検出電極、110 振動子、111 電圧印加側のレール、112 GND側のレール、50,150 加速度センサ、L1〜L3 切断線  DESCRIPTION OF SYMBOLS 1 Board | substrate, 2A thermal oxide film, 2B thermal oxide film, 3 resist pattern film, 4 lower layer electrode, 4A lower layer electrode junction part, 5 piezoelectric film, 6 upper electrode film, 6A drive electrode, 6B, 6C right and left detection electrode, 6a, 6b, 6c Upper electrode connection portion, 7 Wiring base film, 8 Planarization resist film, 9 Wiring film, 10 Insulating protective film, 11 Cu wiring, 12 Back stopper film, 13 Through portion, 14 Au bump, 15 Cover material, 40 IC circuit, 41 adder circuit, 42 amplifier circuit, 43 phase shift circuit, 44 AGC, 45 differential amplifier circuit, 46 synchronous detection circuit, 47 smoothing circuit, 100, 100X, 100Y vibration type gyro sensor element, 101a, 101b, 101c , 101d electrode PAD, 101A, 101B, 101C, 101D wiring connection terminal, 104a reference electrode, 105a pressure Body, 106a drive electrodes, 106b, 106c detection electrode, 110 oscillator, 111 a voltage application side of the rail, 112 GND side of the rail, 50,150 acceleration sensor, L1 to L3 cutting line

Claims (3)

梁形状をなす基体となる基板上に下部電極膜、圧電材料、上層電極膜を形成してなる片持ち梁形状の振動子からなる振動型ジャイロセンサ素子の製造方法であって、
下部電極、圧電材料、上層電極パターン形成後の再結晶化熱処理を圧電体薄膜成膜時の熱処理温度より50℃以上低温で行う再結晶化熱処理工程を有することを特徴とする振動型ジャイロセンサ素子の製造方法。
A method for manufacturing a vibration type gyro sensor element comprising a cantilever-shaped vibrator formed by forming a lower electrode film, a piezoelectric material, and an upper electrode film on a substrate that forms a beam shape,
A vibration type gyro sensor element comprising a recrystallization heat treatment step in which a recrystallization heat treatment after formation of a lower electrode, a piezoelectric material, and an upper electrode pattern is performed at a temperature lower than the heat treatment temperature at the time of forming a piezoelectric thin film by 50 ° C. or more Manufacturing method.
上層電極のレジストパターン形成後、120°C以上140°C以下で熱処理を行う熱処理工程を有することを特徴とする請求項1記載の振動型ジャイロセンサ素子の製造方法。  2. The method of manufacturing a vibration type gyro sensor element according to claim 1, further comprising a heat treatment step of performing heat treatment at 120 ° C. or more and 140 ° C. or less after forming the resist pattern of the upper electrode. 下部電極のレジストパターン形成後、120°C以上140°C以下で熱処理を行う熱処理工程を有することを特徴とする請求項1記載の振動型ジャイロセンサ素子の製造方法。  2. The method of manufacturing a vibration type gyro sensor element according to claim 1, further comprising a heat treatment step of performing heat treatment at 120 ° C. or more and 140 ° C. or less after forming the resist pattern of the lower electrode.
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