JP2005182337A - Signal processor and recording/reproducing device - Google Patents
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Abstract
Description
本発明は、入出力するディジタル信号の暗号・復号処理を行う信号処理装置及びこれを用いた記録再生装置に関する。 The present invention relates to a signal processing device that performs encryption / decryption processing of input / output digital signals and a recording / reproducing device using the same.
近年、家庭用のビデオテープレコーダに代えて、ハードディスクを記録媒体とするいわゆるHDDレコーダが急速に普及しつつある。中でも、DVD−RAM(Digital Versatile Disc Random Access Memory)等の記録型光ディスクへの記録再生を可能とした一体型レコーダの需要が大きい。ハードディスクと記録型光ディスクが組み合わされた場合、ハードディスクには受信した番組を一時的に記録し、記録型光ディスクには、その中でも気に入った番組を保存用として複製または移動し、ハードディスクのデータは消去するといった具合に使い勝手が向上する。 In recent years, instead of home video tape recorders, so-called HDD recorders using a hard disk as a recording medium are rapidly spreading. In particular, there is a great demand for an integrated recorder that can perform recording and reproduction on a recording optical disk such as a DVD-RAM (Digital Versatile Disc Random Access Memory). When a hard disk and a recordable optical disk are combined, the received program is temporarily recorded on the hard disk, and the favorite program among them is copied or moved for storage, and the data on the hard disk is deleted. Usability is improved.
このようなディジタル信号を記録再生する機器は、大容量のディジタル化コンテンツを記録することが可能なため、映像信号等の複製は容易であり、且つ劣化がないため、著作権保護のための技術が必須となる。 A device for recording and reproducing such a digital signal can record a large amount of digitized content, so that a video signal or the like can be easily copied and has no deterioration. Is essential.
著作権保護に用い得る技術としては、コンテンツの暗号化が挙げられる。著作権保護の例として、特許文献1には、コンピュータのバスを転送されるストリームが不正にコピーされることを防止するために、ストリーム中の著作権保護の必要な部分を暗号化してPCIバス上を転送する技術が開示されている。
A technology that can be used for copyright protection is content encryption. As an example of copyright protection,
前述のハードディスクと、記録型光ディスクを組み合わせたディジタルレコーダでは、著作権保護のため、媒体上でのコンテンツの暗号化に加えて、装置内のデータバス上のコンテンツの暗号化が必要になる。2つの媒体間でコンテンツの記録再生を行なう際、暗号・復号化の処理を効率良く行わねばならない。 In the digital recorder combining the hard disk and the recordable optical disc, the content on the data bus in the apparatus needs to be encrypted in addition to the content on the medium for copyright protection. When recording and reproducing content between two media, encryption / decryption processing must be performed efficiently.
本発明は、上記課題を解決し、著作権保護すべきディジタル信号のデータ転送を、効率的に行う装置を提供することを目的とする。 An object of the present invention is to solve the above-described problems and to provide an apparatus that efficiently performs data transfer of a digital signal to be copyright protected.
本発明は、かかる課題を解決するために、ディジタル信号が入力される入力部と、ディジタル信号が出力される出力部と、ディジタル信号および制御信号が入出力される入出力バス部と、前記入力部、前記出力部および前記入出力バス部で入出力される前記ディジタル信号を暗号化および復号化する第一および第二の暗号復号部と、前記ディジタル信号を一時格納するメモリと、前記入力部、前記出力部、前記入出力バス部、前記第一および第二の暗号復号部、および前記メモリと間でディジタル信号を調停し時分割に処理する調停部と、前記入出力バス部に入力された制御信号に基づき、前記第一および第二の暗号復号部、前記調停部、前記入力部、前記出力部および前記入出力バス部を制御する制御部とを備える構成とした。前記調停部は、前記第一および第二の暗号復号部における暗号処理と復号処理を時分割に並列処理するようにした。 In order to solve such problems, the present invention provides an input unit to which a digital signal is input, an output unit to which a digital signal is output, an input / output bus unit to which digital signals and control signals are input and output, and the input A first and second encryption / decryption unit for encrypting and decrypting the digital signal input / output through the output unit and the input / output bus unit, a memory for temporarily storing the digital signal, and the input unit The output unit, the input / output bus unit, the first and second encryption / decryption units, and an arbitration unit that arbitrates a digital signal between the memory and the time division processing, and is input to the input / output bus unit. And a control unit that controls the first and second encryption / decryption units, the arbitration unit, the input unit, the output unit, and the input / output bus unit. The arbitration unit performs the time-division parallel processing of encryption processing and decryption processing in the first and second encryption / decryption units.
本発明によれば、著作権保護すべきディジタル信号のデータ転送を好適に行う装置を提供できる。 According to the present invention, it is possible to provide an apparatus that suitably performs data transfer of a digital signal to be copyright protected.
以下本発明による信号処理装置と、これを用いた記録再生装置の実施形態について説明する。 Embodiments of a signal processing apparatus according to the present invention and a recording / reproducing apparatus using the same will be described below.
図1は本発明による信号処理装置の一実施形態を示すブロック図である。100は信号処理装置であり、101はディジタル信号を入力するための入力端子であり、102はディジタル信号を出力するための出力端子である。111はディジタル信号および制御信号を入出力するための入出力バス端子である。104はディジタル信号を一時格納するメモリである。103はメモリ104への書き込みおよび読み出しを時分割に処理するアービタ(調停部)である。105は入力端子101から入力されたディジタル信号を受け取り、アービタ103に渡す入力インタフェース部、106は、アービタ103から受け取ったディジタル信号を出力端子102に出力する出力インタフェース部である。107は、アービタ103と入出力バス端子111の間でディジタル信号を入出力し、また、図示しないホストからの制御信号を制御部108に入力する入出力バスインタフェース部であり、例えばPCI(Peripheral Component Interconnect)バスが用いられる。109および110は、ディジタル信号の暗号および復号処理を行う暗号復号部、108は入力インタフェース部105、出力インタフェース106、アービタ103、暗号復号部109、暗号復号部110、入出力バスインタフェース部107を制御するための制御部で、具体的にはマイクロコントローラである。
FIG. 1 is a block diagram showing an embodiment of a signal processing apparatus according to the present invention. 100 is a signal processing device, 101 is an input terminal for inputting a digital signal, and 102 is an output terminal for outputting a digital signal.
ここで、入力端子101から入力されるディジタル信号を入出力バス端子111に出力する動作について説明する。前述のように、ホストからの制御信号は、入出力バス端子111を介して入出力バスインタフェース部107から制御部108に供給される。制御部108は、受け取った制御信号を解析し制御を行う。
Here, an operation of outputting a digital signal input from the
まず、入力端子101を介して入力インタフェース部105から入力されるディジタル信号は、アービタ103を介してメモリ104に格納される。ここで、受け取った制御信号が暗号復号部109による暗号化を指示している場合、メモリ104に格納されたディジタル信号は、一旦アービタ103により読み出され、暗号復号部109において暗号化されて再度メモリ104に格納される。続いてアービタ103は、暗号復号部109により暗号化されメモリ104に格納されたディジタル信号を入出力バスインタフェース部107に供給し、ディジタル信号が入出力バス端子111から出力される。
First, a digital signal input from the
また、受け取った制御信号が、暗号復号部110による暗号化を指示している場合、メモリ104に格納されたディジタル信号は、一旦アービタ103により読み出され、暗号復号部110において暗号化されて再度メモリ104に格納される。続いてアービタ103は、暗号復号部110により暗号化されメモリ104に格納されたディジタル信号を入出力バスインタフェース部107に供給し、ディジタル信号が入出力バス端子111から出力される。
When the received control signal instructs encryption by the encryption /
さらに、受け取った制御信号が、暗号化を指示していない場合、入力インタフェース部105から入力されメモリ104に格納されたディジタル信号が、アービタ103から読み出され、入出力バスインタフェース部107に供給され、ディジタル信号が入出力バス端子111から出力される。
Further, when the received control signal does not instruct encryption, the digital signal input from the
次に、入出力バス端子111から入力されるディジタル信号を出力端子102に出力する動作について説明する。前述のように、ホストからの制御信号は、入出力バス端子111を介して入出力バスインタフェース部107から制御部108に供給される。制御部108は、受け取った制御信号を解析し制御を行う。
Next, an operation of outputting a digital signal input from the input /
まず、入出力バス端子111を介して入出力バスインタフェース部107から入力されるディジタル信号は、アービタ103を介してメモリ104に格納される。ここで、受け取った制御信号が暗号復号部109による復号化を指示している場合、メモリ104に格納されたディジタル信号は、一旦アービタ103により読み出され、暗号復号部109において復号化されて再度メモリ104に格納される。続いて、アービタ103は暗号復号部109により復号化されメモリ104に格納されたディジタル信号を出力インタフェース部106に供給し、ディジタル信号が出力端子102から出力される。
First, a digital signal input from the input / output
また、受け取った制御信号が、暗号復号部110による復号化を指示している場合、メモリ104に格納されたディジタル信号は、一旦アービタ103により読み出され、暗号復号部110において復号化されて再度メモリ104に格納される。続いて、アービタ103は暗号復号部110により復号化されメモリ104に格納されたディジタル信号を出力インタフェース部106に供給し、ディジタル信号が出力端子102から出力される。
Further, when the received control signal instructs the decryption by the encryption /
さらに、受け取った制御信号が、復号化を指示していない場合、入出力バスインタフェース部107から入力されメモリ104に格納されたディジタル信号が、アービタ103から読み出され、出力インタフェース102に供給され、ディジタル信号が出力端子102から出力される。
Further, when the received control signal does not instruct decoding, a digital signal input from the input / output
次に、入出力バス端子111から入力されるディジタル信号を復号および暗号化して再度入出力バス端子111に出力する動作について説明する。前述のように、ホストからの制御信号は、入出力バス端子111を介して入出力バスインタフェース部107から制御部108に供給される。制御部108は、受け取った制御信号を解析し制御を行う。
Next, an operation of decrypting and encrypting a digital signal input from the input /
まず、入出力バス端子111を介して入出力バスインタフェース部107から入力されるディジタル信号は、アービタ103を介してメモリ104に格納される。ここで、メモリ104に格納されたディジタル信号は、一旦アービタ103により読み出され、暗号復号部109において復号化されて再度メモリ104に格納される。さらに、暗号復号部109により復号化され格納されたディジタル信号を読み出し、暗号復号部110において暗号化されて再度メモリ104に格納される。続いて、アービタ103は暗号復号部110により暗号化されメモリ104に格納されたディジタル信号を入出力バスインタフェース部107に供給し、ディジタル信号が入出力バス端子111から出力される。
First, a digital signal input from the input / output
また、上述の動作を時分割で並列処理する場合を説明する。ホストからの制御信号が、入出力バス端子111を介して入出力バスインタフェース部107から制御部108に供給されるが、さらに別の制御信号をホストから供給することで、複数の処理を並列処理することが可能である。
A case will be described in which the above-described operations are processed in parallel in a time-sharing manner. A control signal from the host is supplied from the input / output
例えば、前述した暗号復号部109による暗号化を指示する制御信号と、暗号復号部110による復号化を指示する制御信号とを重ねて受け取った場合を説明する。入力端子101を介して入力インタフェース部105から入力されるディジタル信号(以下、第1信号と呼ぶ)がアービタ103を介してメモリ104に格納されると共に、入出力バス端子111を介して入出力バスインタフェース部107から入力されるディジタル信号(以下、第2信号と呼ぶ)がアービタ103を介してメモリ104に格納される。この場合、アービタ103はメモリ104へそれぞれのインタフェース部から入力される第1、第2信号を異なる領域に時分割で格納する。
For example, a case will be described in which the control signal instructing the encryption by the encryption /
次にアービタ103は、メモリ104に格納されたディジタル信号を読み出し、第1信号については暗号復号部109に供給し、該暗号復号部109において暗号化された第1信号を再度メモリ104に格納する。また、第2信号については暗号復号部110に供給し、該暗号復号部110において復号化された第2信号を再度メモリ104に格納する。この場合も、上記とは異なる領域に時分割で格納する。
Next, the
さらにアービタ103は、メモリ104から、暗号復号部109において暗号化された第1信号を入出力バスインタフェース部107に供給し、また、暗号復号部110において復号化された第2信号を出力インタフェース部106に供給する。この場合も時分割に読み出しが行われる。
Further, the
以上のように、本実施例のアービタ103により、暗号化と復号化の複数並列処理を実現することができる。その他、前述した入出力バス端子111から入力されるディジタル信号を復号および暗号化して再度入出力バス端子111に出力する動作をしながら、例えば、入出力バス端子111から入力されるディジタル信号を暗号復号部109により復号し出力インタフェース部106を介し出力端子102からの出力等、同様に並列処理を行うことが可能である。
As described above, a plurality of parallel processes of encryption and decryption can be realized by the
図2は、信号処理装置100をディジタルレコーダに適用した一実施形態を示す。400はディジタルレコーダ、401は映像信号入力端子、402は音声信号入力端子、403は映像信号A/Dコンバータ、404は音声信号A/Dコンバータ、405はコピー制限情報検出回路、407は映像信号圧縮回路、408は音声信号圧縮回路、409はシステムエンコーダ、100は前述の信号処理装置、410はPCIバス、411はバスインタフェースでありいわゆるサウスブリッジ、200は例えばハードディスクドライブなどの記録再生部、300は例えば光ディスクドライブなどの記録再生部、413はCPUインタフェースでありいわゆるノースブリッジ、412はメモリ、421は制御回路でありいわゆるCPU、414はシステムデコーダ、415は映像信号伸張回路、416は音声信号伸張回路、417は映像信号D/Aコンバータ、418は音声信号D/Aコンバータ、419は映像信号出力端子、420は音声信号出力端子である。
FIG. 2 shows an embodiment in which the
まず、記録再生部200、および記録再生部300での記録および再生動作について説明する。映像信号入力端子401から入力された映像信号は、映像信号A/Dコンバータ403においてディジタル信号に変換され、コピー制限情報検出回路405に入力されるとともに、映像信号圧縮回路407に入力される。コピー制限情報検出回路405では、例えば、映像信号の垂直帰線区間に重畳されているコピー制限情報を検出する。コピー制限情報としては、コピー可、一世代コピー可、コピー禁止の意味を持つ情報であり、コピー禁止の場合は、以下の動作は行わない。
First, recording and reproducing operations in the recording / reproducing
映像信号圧縮回路407では、例えば、映像圧縮符号化方式としてISO/IEC13818−2(通称MPEG2Video)MP@ML(Main Profile@Main Level)規格に準拠した圧縮符号化データを生成する。映像圧縮符号化方式としては、これに限定するものではなく、JPEG規格方式などでもよい。生成した圧縮符号化映像データは、システムエンコーダ409に入力される。
The video
また、音声信号入力端子402から入力された音声信号は、音声信号A/Dコンバータ404において所定のサンプリングレートによりアナログ/ディジタル変換が行われる。ディジタル信号に変換された音声信号は、音声信号圧縮回路408に入力される。音声信号圧縮回路408では、例えば、音声圧縮符号化方式としてISO/IEC13818−1(通称MPEG2Audio)規格に準拠した圧縮符号化データを生成する。音声圧縮符号化方式についても特にこれ限定するものではない。生成した圧縮符号化音声データは、システムエンコーダ409に入力される。
The audio signal input from the audio
システムエンコーダ409に入力された圧縮符号化映像データおよび圧縮符号化音声データは、それぞれパケット化および多重化され、一本のシステムストリームに変換された後、信号処理装置100に入力される。システムストリームには、付加情報として、元映像のサイズ、縦横比、システムストリーム中の圧縮符号化映像データおよび圧縮符号化音声データのビットレート、コピー制限情報等が追加される。ここで、コピー制限情報検出回路405で一世代コピー可の検出がされた場合、例えば、システムストリームに追加されるコピー制限情報としては、コピー禁止の情報に変更されて追加される。
The compressed encoded video data and compressed encoded audio data input to the
また、制御回路421はコピー制限情報検出回路405の検出結果をもとに、信号処理装置100に対し、入出力バス端子111を介し制御信号を発行する。一世代コピー可の検出がされた場合、暗号化処理の指示を行う。
The
信号処理装置100に入力されたシステムストリームは、制御回路421から受け取った制御信号に従い処理され、入出力バス端子111からPCIバス410を経由し、バスインタフェース411、CPUインタフェース413を介して一旦メモリ412に格納された後、CPUインタフェース413、バスインタフェース411を介して、記録再生部200、あるいは記録再生部300にて記録される。
The system stream input to the
この際、例えば、記録再生部200で記録する場合は、図1の暗号復号部109により暗号化を行い、記録再生部300で記録する場合は、図1の暗号復号部110により暗号化を行う。信号処理装置100の動作については前述した通りである。
At this time, for example, when recording is performed by the recording / reproducing
なお、信号処理装置100内部の暗号復号部109、暗号復号部110に供給する暗号復号鍵を生成するための鍵情報として、制御回路421が保有している固有情報を用いてもよい。また、暗号復号部110に供給する暗号復号鍵を生成するための鍵情報として、上記に加えて、記録再生部300の光ディスクが持つ固有情報を用いてもよい。
Note that the unique information held by the
ここで、システムストリームが暗号復号部(109,110)において暗号化されるのは、前述のコピー制限情報検出回路405において、例えば一世代コピー可の情報を検出した場合であり、コピー可の場合は暗号化されなくてもよい。
Here, the system stream is encrypted in the encryption / decryption unit (109, 110) when the copy restriction
一方、記録再生部200、あるいは記録再生部300にて再生されるシステムストリームは、バスインタフェース411、CPUインタフェース413を経由してメモリ412に格納される。メモリ412に格納されたシステムストリームは、CPUインタフェース413、バスインタフェース411を介し、PCIバス410を経由して、入出力バス端子111から信号処理装置100に入力される。
On the other hand, a system stream reproduced by the recording / reproducing
信号処理装置100に入力されたシステムストリームは、制御回路421から受け取った制御信号に従い処理され、出力端子102を介してシステムデコーダ414に入力される。信号処理装置100の動作については前述した通りであり、暗号復号部109、あるいは暗号復号部110に供給する暗号復号鍵は記録時と同一のものとなる。
The system stream input to the
システムデコーダ414に入力されたシステムストリームは、圧縮符号化映像データ、および圧縮符号化音声データのパケットにそれぞれ分離され、各々のパケットから取り出した圧縮符号化映像データは映像信号伸張回路415に、また圧縮符号化音声データは音声信号伸張回路416に入力される。伸張が施された映像信号は映像信号D/Aコンバータ417に、音声信号は音声信号D/Aコンバータ418に入力され、アナログ信号に変換され、映像信号出力端子419、音声信号出力端子420から出力される。
The system stream input to the
以上のように、記録する映像音声信号のコピー制限情報に基づいて信号処理装置100において、記録媒体に応じて暗号化、復号化処理が行われ、記録媒体上には暗号化されたシステムストリームが記録されるので記録媒体上での著作権が保護できる。また、PCIバス410上にも暗号化されたシステムストリームが伝送されるので、安全にデータ転送が行える。
As described above, the
次に記録再生部200から記録再生部300へのダビング動作について説明する。記録再生部200から再生されるシステムストリームは、バスインタフェース411、CPUインタフェース413を経由してメモリ412に格納される。メモリ412に格納されたシステムストリームは、CPUインタフェース413、バスインタフェース411を介し、PCIバス410を経由して、入出力バス端子111から信号処理装置100に入力される。
Next, a dubbing operation from the recording / reproducing
信号処理装置100に入力されたシステムストリームは、制御回路421から受け取った制御信号に従い、復号処理、暗号処理がなされ、入出力バス端子111から出力される。信号処理装置100の動作については前述した通りである。出力システムストリームは、入出力バス端子111からPCIバス410を経由し、バスインタフェース411、CPUインタフェース413を介して一旦メモリ412に格納された後、CPUインタフェース413、バスインタフェース411を介して、記録再生部300にて記録される。
The system stream input to the
以上のように、記録媒体間のダビング動作においても、信号処理装置100において、記録媒体に応じて暗号化、復号化処理が行われ、記録媒体上には暗号化されたシステムストリームが記録されるので記録媒体上での著作権が保護できる。また、PCIバス410上にも暗号化されたシステムストリームが伝送されるので、安全にデータ転送が行える。
As described above, also in the dubbing operation between recording media, the
また、記録動作を行いながらの再生動作を行うことも可能である。例えば、記録再生部200にて記録しながら、記録再生部300からの再生を行う場合を説明する。信号処理装置100に入力されるシステムエンコーダ409からのシステムストリームは、制御回路421から受け取った制御信号に従い、入出力バス端子111からPCIバス410を経由し、記録再生部200にて記録される。これととともに、制御回路421から受け取った制御信号に従い、記録再生部300から再生されたシステムストリームを、PCIバス410を経由し、入出力バス端子111から入力して、システムデコーダ414に供給する。これにより、記録再生部200での記録動作とは独立して、記録再生部300での再生動作が実現できる。
It is also possible to perform a reproduction operation while performing a recording operation. For example, a case where reproduction from the recording / reproducing
あるいはまた、記録再生部200から記録再生部300へのダビング動作中に、例えば記録再生部200からダビングしているシステムストリームとは別のシステムストリームの再生動作を行うことも可能である。
これらの動作は、前述の信号処理装置100における並列処理に基づくものである。
Alternatively, during the dubbing operation from the recording /
These operations are based on the parallel processing in the
図3は、信号処理装置100をディジタルレコーダに適用した他の実施形態である。422は、映像信号切り換えスイッチ、423は音声信号切り換えスイッチである。前述のように、記録再生部200、300での記録の場合、映像信号A/Dコンバータ403においてディジタル信号に変換された映像信号は、映像信号切換スイッチ422を介して映像信号圧縮回路407に入力される。また、音声信号A/Dコンバータ404においてディジタル信号に変換された音声信号は、音声信号切り換えスイッチ423を介して音声信号圧縮回路408に入力される。以後の処理は前述の通りである。
FIG. 3 shows another embodiment in which the
記録再生部200から再生されるシステムストリームは、バスインタフェース411、CPUインタフェース413を経由してメモリ412に格納される。メモリ412に格納されたシステムストリームは、CPUインタフェース413、バスインタフェース411を介し、PCIバス410を経由して、入出力バス端子111から信号処理装置100に入力される。
A system stream reproduced from the recording / reproducing
信号処理装置100に入力されたシステムストリームは、制御回路421から受け取った制御信号に従い復号処理がなされ、出力端子102から出力されシステムデコーダ414に入力される。システムデコーダ414に入力されたシステムストリームは、圧縮符号化映像データ、および圧縮符号化音声データのパケットにそれぞれ分離され、各々のパケットから取り出した圧縮符号化映像データは映像信号伸張回路415に、また圧縮符号化音声データは音声信号伸張回路416に入力される。伸張が施された映像信号は映像信号切り換えスイッチ422に、音声信号は音声信号切り換えスイッチ423に入力され、それぞれ映像信号圧縮回路407、音声信号圧縮回路408に入力される。映像信号圧縮回路407、音声信号圧縮回路408では、記録再生部200から再生されるシステムストリームの圧縮符号化映像データ、圧縮符号化音声データより低いビットレートで再度圧縮符号化処理が施され、システムエンコーダ409に入力される。システムエンコーダ409に入力された圧縮符号化映像データおよび圧縮符号化音声データは、それぞれパケット化および多重化され、一本のシステムストリームに変換された後、信号処理装置100に入力される。
The system stream input to the
信号処理装置100に入力されたシステムストリームは、暗号処理がなされ、入出力バス端子111から出力される。信号処理装置100の動作については前述した通りである。出力システムストリームは、入出力バス端子111からPCIバス410を経由し、バスインタフェース411、CPUインタフェース413を介して一旦メモリ412に格納された後、CPUインタフェース413、バスインタフェース411を介して、記録再生部300にて記録される。
The system stream input to the
以上のように、記録レートを変換しながらの記録媒体間のダビング動作においても、信号処理装置100において、記録媒体に応じて暗号化、復号化処理が行われ、記録媒体上には暗号化されたシステムストリームが記録されるので記録媒体上での著作権が保護できる。また、PCIバス410上にも暗号化されたシステムストリームが伝送されるので、安全にデータ転送が行える。
As described above, also in the dubbing operation between the recording media while converting the recording rate, the
100…信号処理装置、101…入力端子、102…出力端子、103…アービタ(調停部)回路、104…メモリ、105…入力インタフェース部、106…出力インタフェース部、107…入出力バスインタフェース部、108…制御部、109,110…暗号復号部,111…入出力バス端子、200,300…記録再生部、400…ディジタルレコーダ、403、404…A/Dコンバータ、405…コピー制限情報検出回路、407…映像信号圧縮回路、408…音声信号圧縮回路、409…システムエンコーダ、410…PCIバス、411…バスインタフェース、412…メモリ、413…CPUインタフェース、414…システムデコーダ、415…映像信号伸張回路、416…音声信号伸張回路、417,418…D/Aコンバータ、421…制御回路。
DESCRIPTION OF
Claims (9)
ディジタル信号が出力される出力部と、
ディジタル信号および制御信号が入出力される入出力バス部と、
前記入力部、前記出力部および前記入出力バス部で入出力される前記ディジタル信号を、暗号化および復号化する第一および第二の暗号復号部と、
前記ディジタル信号を一時格納するメモリと、
前記入力部、前記出力部、前記入出力バス部、前記第一および第二の暗号復号部、および前記メモリとの間でディジタル信号を調停し時分割に処理する調停部と、
前記入出力バス部に入力された制御信号に基づき、前記第一および第二の暗号復号部、前記調停部、前記入力部、前記出力部および前記入出力バス部を制御する制御部と、
を備えたことを特徴とする信号処理装置。 An input unit for inputting a digital signal;
An output unit for outputting a digital signal;
An input / output bus unit for inputting / outputting digital signals and control signals;
First and second encryption / decryption units for encrypting and decrypting the digital signal input / output at the input unit, the output unit, and the input / output bus unit;
A memory for temporarily storing the digital signal;
An arbitration unit that arbitrates a digital signal between the input unit, the output unit, the input / output bus unit, the first and second encryption / decryption units, and the memory;
Based on the control signal input to the input / output bus unit, the first and second encryption / decryption unit, the arbitration unit, the input unit, the output unit, and a control unit for controlling the input / output bus unit,
A signal processing apparatus comprising:
前記調停部と前記制御部は、前記入出力バス部に入力された複数の制御信号に基づき、前記第一および第二の暗号復号部における暗号化と復号化の動作を並列処理することを特徴とする信号処理装置。 The signal processing device according to claim 1,
The arbitration unit and the control unit perform parallel processing of encryption and decryption operations in the first and second encryption / decryption units based on a plurality of control signals input to the input / output bus unit. A signal processing device.
前記入出力バス部に入力された制御信号に基づき、前記入力部に入力されたディジタル信号を、前記第一の暗号復号部または前記第二の暗号復号部のうち指定された一方の暗号復号部にて暗号化し、前記入出力バス部に出力することを特徴とする信号処理装置。 The signal processing device according to claim 1 or 2,
Based on the control signal input to the input / output bus unit, the digital signal input to the input unit is designated as one of the first encryption / decryption unit or the second encryption / decryption unit. A signal processing apparatus characterized in that the data is encrypted and output to the input / output bus unit.
前記入出力バス部に入力された制御信号に基づき、前記入出力バス部に入力されたディジタル信号を、前記第一の暗号復号部または前記第二の暗号復号部にて復号化し、前記出力部に出力することを特徴とする信号処理装置。 The signal processing device according to claim 1 or 2,
Based on the control signal input to the input / output bus unit, the digital signal input to the input / output bus unit is decrypted by the first encryption / decryption unit or the second encryption / decryption unit, and the output unit A signal processing device that outputs to
前記入出力バス部に入力された制御信号に基づき、前記入出力バス部に入力されたディジタル信号を、前記第一の暗号復号部または前記第二の暗号復号部のうち指定された一方の暗号復号部にて復号化し、さらに他方の暗号復号部にて暗号化して、前記入出力バス部に出力することを特徴とする信号処理装置。 The signal processing device according to claim 1 or 2,
Based on the control signal input to the input / output bus unit, the digital signal input to the input / output bus unit is converted into one of the designated encryption units of the first encryption / decryption unit or the second encryption / decryption unit. A signal processing device, wherein the signal processing device is decrypted by a decryption unit, further encrypted by the other encryption / decryption unit, and output to the input / output bus unit.
前記第一および第二の暗号復号部は、互いに異なる暗号アルゴリズムにて暗号化および復号化することを特徴とする信号処理装置。 The signal processing device according to any one of claims 1 to 5,
The signal processing apparatus, wherein the first and second encryption / decryption units perform encryption and decryption using different encryption algorithms.
前記入力部、前記出力部、前記入出力バス部、前記第一および第二の暗号復号部、前記調停部、前記メモリ、および前記制御部を、一つの集積回路に搭載することを特徴とする信号処理装置。 The signal processing device according to claim 1,
The input unit, the output unit, the input / output bus unit, the first and second encryption / decryption units, the arbitration unit, the memory, and the control unit are mounted on one integrated circuit. Signal processing device.
ディジタル信号を復号化する復号部と、
ディジタル信号を一時格納するメモリと、
前記暗号部、前記復号部、および前記メモリとの間でディジタル信号を調停し時分割に処理する調停部と、を有し、
前記調停部は、前記暗号部と前記復号部における暗号化と復号化の動作を並列処理することを特徴とする信号処理装置。 An encryption part for encrypting the digital signal;
A decoding unit for decoding the digital signal;
A memory for temporarily storing digital signals;
An arbitration unit that arbitrates a digital signal between the encryption unit, the decryption unit, and the memory, and processes in a time-sharing manner;
The arbitration unit performs parallel processing of encryption and decryption operations in the encryption unit and the decryption unit.
前記入力部および前記出力部には、記録再生のためのディジタル信号が入出力し、
前記入出力バス部には、バスインターフェースを介して記録媒体への記録再生を行う記録再生部が接続されたことを特徴とする記録再生装置。
A recording / reproducing apparatus including the signal processing apparatus according to claim 1,
Digital signals for recording and reproduction are input to and output from the input unit and the output unit,
A recording / reproducing apparatus, wherein a recording / reproducing unit that performs recording / reproducing on a recording medium is connected to the input / output bus unit via a bus interface.
Priority Applications (1)
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---|---|---|---|
JP2003420324A JP2005182337A (en) | 2003-12-18 | 2003-12-18 | Signal processor and recording/reproducing device |
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JP (1) | JP2005182337A (en) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
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WO2008026457A1 (en) * | 2006-08-29 | 2008-03-06 | Panasonic Corporation | Controller |
-
2003
- 2003-12-18 JP JP2003420324A patent/JP2005182337A/en active Pending
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WO2008026457A1 (en) * | 2006-08-29 | 2008-03-06 | Panasonic Corporation | Controller |
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