JP2005099772A - Electrooptical device, driving method of electrooptical device and electronic equipment - Google Patents
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Abstract
Description
本発明は、電気光学装置などの電子装置、電気光学装置の駆動方法および電子機器に係り、特に、画素回路に電圧を供給する電源線の共通化に関する。 The present invention relates to an electronic device such as an electro-optical device, a driving method of the electro-optical device, and an electronic apparatus, and more particularly to common use of a power supply line for supplying a voltage to a pixel circuit.
近年、有機ＥＬ（Electronic Luminescence）素子を用いたディスプレイが注目されている。有機ＥＬ素子は、自己を流れる駆動電流に応じて輝度が設定される電流駆動型素子の一つである。有機ＥＬ素子を用いた画素へのデータ書込方式には、電流プログラム方式と電圧プログラム方式とがある。電流プログラム方式は、データ線へのデータの供給を電流ベースで行う方式であり、電圧プログラム方式は、データ線へのデータの供給が電圧ベースで行う方式である。 In recent years, a display using an organic EL (Electronic Luminescence) element has attracted attention. The organic EL element is one of current-driven elements whose luminance is set according to the drive current flowing through the organic EL element. There are a current program method and a voltage program method for writing data into a pixel using an organic EL element. The current program method is a method for supplying data to the data line on a current basis, and the voltage program method is a method for supplying data to the data line on a voltage basis.
本発明の目的の一つは、電気光学素子やトランジスタ等の特性の変化や劣化等を防止し、かつ、画素回路に電圧を供給する電源線の本数の低減を図ることである。 One of the objects of the present invention is to prevent changes in characteristics or deterioration of characteristics of electro-optical elements and transistors, and to reduce the number of power supply lines for supplying voltage to the pixel circuit.
かかる課題を解決するために、本発明の第１の電気光学装置は、複数の走査線と、
複数のデータ線と、前記複数のデータ線と交差する方向に延在する複数の電源線と、前記複数の走査線と前記複数のデータ線との交差に対応して複数の画素回路が設けられているとともに、前記複数の画素回路のそれぞれが、前記複数の電源線のうち互いに隣接した一対の電源線に共通接続された画素群と、前記複数の走査線に走査信号を出力することにより、前記走査線を選択する走査線駆動回路と、前記走査線駆動回路による前記走査線の選択と同期して、前記複数の電源線の電圧を可変に設定する電源線制御回路とを有することを特徴とする。
In order to solve this problem, the first electro-optical device of the present invention includes a plurality of scanning lines,
A plurality of pixel circuits are provided corresponding to the intersection of the plurality of data lines, the plurality of power supply lines extending in the direction intersecting with the plurality of data lines, and the plurality of scanning lines and the plurality of data lines. In addition, each of the plurality of pixel circuits outputs a scanning signal to the plurality of scanning lines and a pixel group commonly connected to a pair of adjacent power supply lines among the plurality of power supply lines, A scanning line driving circuit for selecting the scanning line; and a power line control circuit for variably setting the voltages of the plurality of power supply lines in synchronization with the selection of the scanning line by the scanning line driving circuit. And
本発明の第２の電気光学装置において、複数の走査線と、複数のデータ線と、前記複数のデータ線と交差する方向に延在する複数の電源線と、前記複数の走査線と前記複数のデータ線との交差に対応して設けられた複数の画素回路と、を含み、前記複数の電源線のうちの一つの電源線には、前記複数の画素回路のうち、前記複数のデータ線のうち一つのデータ線に沿って相隣接して配置された画素回路が接続されていることを特徴とする。 In the second electro-optical device of the present invention, a plurality of scanning lines, a plurality of data lines, a plurality of power supply lines extending in a direction intersecting with the plurality of data lines, the plurality of scanning lines, and the plurality of the plurality of scanning lines. A plurality of pixel circuits provided corresponding to intersections of the plurality of data lines, and one power line of the plurality of power lines includes the plurality of data lines of the plurality of pixel circuits. Among these, pixel circuits arranged adjacent to each other along one data line are connected.
上記の電気光学装置において、前記複数の電源線のうち隣接する２つの電源線の一方の電源線の電圧値の経時変化は、当該２つの電源線の他方の電源線の電圧値の経時変化に対して所定時間分シフトしていることが好ましい。 In the above electro-optical device, the change with time in the voltage value of one of the two adjacent power supply lines among the plurality of power supply lines is the change with time in the voltage value of the other power supply line of the two power supply lines. On the other hand, it is preferable to shift by a predetermined time.
前記所定時間とは、例えば、水平走査期間であってもよい。 The predetermined time may be, for example, a horizontal scanning period.
上記の電気光学装置において、前記複数の画素回路の各々は、前記複数のデータ線の一つのデータ線を介して供給されたデータ電流またはデータ電圧に応じた電荷を保持するキャパシタと、前記キャパシタに保持された前記電荷に基づいて導通状態が設定される駆動トランジスタと、前記導通状態に応じて輝度が設定される電気光学素子とを有することが好ましい。 In the electro-optical device, each of the plurality of pixel circuits includes a capacitor that holds a charge corresponding to a data current or a data voltage supplied via one data line of the plurality of data lines, and a capacitor. It is preferable to include a driving transistor whose conduction state is set based on the held electric charge and an electro-optic element whose luminance is set according to the conduction state.
上記の電気光学装置において、前記電源線制御回路は、前記複数の電源線のうち、前記複数の画素回路の各々に接続された２つの電源線の電圧値を可変に設定することにより、前記駆動トランジスタに印加されるバイアス方向を変えるようにしてもよい。 In the electro-optical device, the power line control circuit may variably set voltage values of two power lines connected to each of the plurality of pixel circuits among the plurality of power lines. The direction of the bias applied to the transistor may be changed.
上記の電気光学装置において、前記２つの電源線のうちの一方の電源線は、前記駆動トランジスタの一方の端部に接続されて２つの電源線のうちの他方の電源線は、前記駆動トランジスタの他方の端部と前記電気光学素子との間のノードに接続されていることが好ましい。 In the electro-optical device, one power line of the two power lines is connected to one end of the drive transistor, and the other power line of the two power lines is connected to the drive transistor. It is preferable to be connected to a node between the other end and the electro-optic element.
上記の電気光学装置において、前記電源線制御回路は、所定の期間の一部である駆動期間において、前記一方の電源線の電圧を前記所定の電圧よりも高く設定することにより、前記駆動トランジスタに順バイアスを印加するとともに、前記所定の期間の一部であって前記駆動期間とは異なる期間において、前記他方の電源線の電圧を前記一方電源線の電圧よりも高く設定することにより、前記駆動トランジスタに非順バイアスを印加するようにしてもよい。 In the electro-optical device, the power supply line control circuit sets the voltage of the one power supply line higher than the predetermined voltage in the drive period that is a part of the predetermined period, thereby causing the drive transistor to The driving is performed by applying a forward bias and setting the voltage of the other power supply line higher than the voltage of the one power supply line in a part of the predetermined period and different from the driving period. A non-forward bias may be applied to the transistor.
上記の電気光学装置において、前記電源線制御回路は、前記複数の電源線のうち、前記複数の画素回路の各々に接続された２つの電源線の電圧値を可変に設定することにより、前記電気光学素子に印加されるバイアス方向を変えるようにしてもよい。 In the above electro-optical device, the power supply line control circuit variably sets voltage values of two power supply lines connected to each of the plurality of pixel circuits among the plurality of power supply lines, whereby the electric power line control circuit The bias direction applied to the optical element may be changed.
上記の電気光学装置において、前記２つの電源線のうちの一方の電源線は、前記駆動トランジスタの一方の端部に接続されており、前記２つの電源線のうちの他方の電源線は、前記駆動トランジスタの他方の端部と前記電気光学素子との間のノードに接続されているようにしてもよい。 In the electro-optical device, one power line of the two power lines is connected to one end of the driving transistor, and the other power line of the two power lines is the You may make it connect to the node between the other edge part of a drive transistor, and the said electro-optical element.
上記の電気光学装置において、前記電源線制御回路は、所定の期間の一部である駆動期間において、前記一方の電源線の電圧を前記所定の電圧よりも高く設定することにより、前記電気光学素子に順バイアスを印加するとともに、前記所定の期間の一部であって前記駆動期間とは異なる期間において、前記他方の電源線の電圧を前記所定の電圧よりも低く設定することにより、前記電気光学素子に非順バイアスを印加するようにしてもよい。 In the above electro-optical device, the power supply line control circuit sets the voltage of the one power supply line higher than the predetermined voltage in a driving period that is a part of the predetermined period, so that the electro-optical element And applying a forward bias to the electro-optics by setting a voltage of the other power line lower than the predetermined voltage in a part of the predetermined period and different from the driving period. A non-forward bias may be applied to the element.
本発明の電子機器は、上記の電気光学装置を実装したことを特徴とする。 According to another aspect of the invention, there is provided an electronic apparatus including the electro-optical device described above.
本発明の第１の電気光学装置の駆動方法は、複数の走査線と複数のデータ線との交差に対応して、各々が電気光学素子と駆動トランジスタとを含む複数の画素回路が設けられており、前記複数の画素回路のそれぞれが、前記複数の走査線に対応して設けられた複数の電源線のうち互いに隣接した一対の電源線に共通接続された電気光学装置の駆動方法において、前記複数の画素回路の各々に前記複数のデータ線のうちの一つのデータ線を介してデータ信号を供給する第１のステップと、前記データ信号により設定された前記駆動トランジスタの導通状態に応じた順バイアスを前記電気光学素子に印加する第２のステップと、前記電気光学素子に非順バイアス第３のステップと、前記順バイアスの印加による前記駆動トランジスタの特性の変化または劣化を回復させるための第４のステップと、を有することを特徴とする。 According to the first driving method of the electro-optical device of the present invention, a plurality of pixel circuits each including an electro-optical element and a driving transistor are provided corresponding to intersections of the plurality of scanning lines and the plurality of data lines. In the driving method of the electro-optical device in which each of the plurality of pixel circuits is commonly connected to a pair of power supply lines adjacent to each other among the plurality of power supply lines provided corresponding to the plurality of scanning lines, A first step of supplying a data signal to each of a plurality of pixel circuits via one of the plurality of data lines, and an order corresponding to a conduction state of the driving transistor set by the data signal. A second step of applying a bias to the electro-optic element; a non-forward bias third step of applying to the electro-optic element; and a change in characteristics of the drive transistor due to the application of the forward bias. Others and having a, a fourth step for recovering the deterioration.
上記の電気光学装置の駆動方法において、前記第３のステップ及び前記第４のステップは互いに異なる期間を利用して行うようにしてもよい。 In the driving method of the electro-optical device, the third step and the fourth step may be performed using different periods.
上記の電気光学装置の駆動方法において、前記第４のステップは前記電気光学素子と前記駆動トランジスタとの電気的接続を切った状態で行われるようにしてもよい。 In the driving method of the electro-optical device, the fourth step may be performed in a state where the electrical connection between the electro-optical element and the driving transistor is cut off.
上記の電気光学装置の駆動方法において、前記第４ステップにおいて、前記駆動トランジスタには非順バイアスが印加されることが好ましい。 In the driving method of the electro-optical device, it is preferable that a non-forward bias is applied to the driving transistor in the fourth step.
上記の電気光学装置の駆動方法において、前記第２のステップにおいて、前記一方の電源線の電圧を前記所定の電圧よりも高く設定することにより、前記駆動トランジスタに順バイアスを印加し、前記第４のステップにおいて、前記他方の電源線の電圧を前記一方の電源線の電圧よりも高く設定することにより、前記駆動トランジスタに非順バイアスを印加するようにしてもよい。 In the driving method of the electro-optical device, in the second step, by setting a voltage of the one power supply line higher than the predetermined voltage, a forward bias is applied to the driving transistor, and the fourth step In this step, a non-forward bias may be applied to the drive transistor by setting the voltage of the other power supply line higher than the voltage of the one power supply line.
本発明の第２の電気光学装置の駆動方法は、複数の走査線と複数のデータ線との交差に対応して、各々が電気光学素子と駆動トランジスタとを含む複数の画素回路を備えた電気光学装置の駆動方法であって、前記複数の画素回路の各々に前記複数のデータ線のうちの一つのデータ線を介してデータ信号を供給する第１のステップと、前記データ信号により設定された前記駆動トランジスタの導通状態に応じた順バイアスを前記電気光学素子に印加する第２のステップと、前記電気光学素子に非順バイアス第３のステップと、前記駆動トランジスタに非順バイアスを印加する第４のステップとを有することを特徴とする。 According to the second driving method of the electro-optical device of the present invention, an electric device including a plurality of pixel circuits each including an electro-optical element and a driving transistor corresponding to the intersection of the plurality of scanning lines and the plurality of data lines. A method for driving an optical device, comprising: a first step of supplying a data signal to each of the plurality of pixel circuits via one data line of the plurality of data lines; and the data signal is set A second step of applying a forward bias to the electro-optic element in accordance with a conduction state of the driving transistor; a third step of applying a non-forward bias to the electro-optic element; and a second step of applying a non-forward bias to the driving transistor. And 4 steps.
上記の電気光学装置の駆動方法において、前記駆動トランジスタの特性バラツキの補償を行った上で前記駆動トランジスタの導通状態を設定することが好ましい。 In the driving method of the electro-optical device, it is preferable that the conduction state of the driving transistor is set after compensating for the characteristic variation of the driving transistor.
本発明の第３の電気光学装置の駆動方法は、複数の走査線と複数のデータ線との交差に対応して、各々が電気光学素子と駆動トランジスタとを含む複数の画素回路を備えた電気光学装置の駆動方法であって、前記複数の画素回路の各々に前記複数のデータ線のうちの一つのデータ線を介してデータ信号を供給する第１のステップと、前記データ信号により設定された前記駆動トランジスタの導通状態に応じた順バイアスを前記電気光学素子に印加する第２のステップと、前記電気光学素子及び前記駆動トランジスタの少なくともいずれか一方に非順バイアスを印加する第３のステップと、を含み、前記駆動トランジスタの特性バラツキの補償を行った上で前記駆動トランジスタの導通状態設定をすることを特徴とする。 According to a third method of driving an electro-optical device of the present invention, an electric device including a plurality of pixel circuits each including an electro-optical element and a driving transistor corresponding to the intersection of a plurality of scanning lines and a plurality of data lines. A method for driving an optical device, comprising: a first step of supplying a data signal to each of the plurality of pixel circuits via one data line of the plurality of data lines; and the data signal is set A second step of applying a forward bias to the electro-optic element in accordance with a conduction state of the drive transistor; and a third step of applying a non-forward bias to at least one of the electro-optic element and the drive transistor; , And the conduction state of the drive transistor is set after compensating for the characteristic variation of the drive transistor.
なお、本発明において「順バイアス」とは一義に設定されてしまうものばかりではなく、用途等に応じて適宜設定してもよい。また、本発明において「非順バイアス」とは、「順バイアス」の設定に応じて定義され、「順バイアス」と反対方向のバイアスまたは電流が流れない状態を意味している。 In the present invention, the “forward bias” is not limited to being uniquely set, but may be appropriately set according to the application. Further, in the present invention, “non-forward bias” is defined according to the setting of “forward bias” and means a state in which no bias or current flows in the opposite direction to “forward bias”.
本発明の効果の一つは、駆動トランジスタや電気光学素子の特性の変化や劣化を抑制すると同時に電源線の本数を減らすことが可能になる点である。 One of the effects of the present invention is that the number of power supply lines can be reduced while suppressing changes and deterioration of characteristics of the drive transistor and the electro-optic element.
（第１の実施形態）
図１は、本実施形態にかかる電気光学装置のブロック構成図である。表示部１は、例えばＴＦＴ（Thin Film Transistor）によって電気光学素子を駆動するアクティブマトリクス型の表示パネルである。この表示部１には、ｍドット×ｎライン分の画素群がマトリクス状（二次元平面的）に並んでいる。表示部１には、それぞれが水平方向に延在している走査線群Ｙ1〜Ｙnと、それぞれが垂直方向に延在しているデータ線群Ｘ1〜Ｘmとが設けられており、これらの交差に対応して画素２（画素回路）が配置されている。なお、後述する各実施形態にかかる画素回路の構成との関係で、図１に示した１つの走査線Ｙは４本の走査線Ｙａ〜Ｙｄのセットを示している（図２および図８を参照）。また、本実施形態では、１つの画素２を画像の最小表示単位としているが、１つの画素２をＲＧＢの３つのサブ画素で構成してもよい。
(First embodiment)
FIG. 1 is a block diagram of the electro-optical device according to the present embodiment. The
電源線Ｌ1〜Ｌn+1は、走査線Ｙ1〜Ｙnに対応して設けられており、表示部１を構成する各画素２に可変電圧に供給すべく、走査線Ｙ1〜Ｙnの延在方向、換言すれば、データ線Ｘ1〜Ｘmと交差する方向に延在している。ｉ番目（１≦ｉ≦ｎ）の走査線Ｙiに対応するｍドット分の画素行には、ｉ番目の電源線Ｌ(i)と、これと隣接した（ｉ＋１）番目の電源線Ｌ(i+1)とが共通接続されている。このように、上下の隣接した一対の電源線Ｌを１画素行に接続するため、表示部全体として必要な電源線Ｌの本数は、走査線Ｙの本数ｎよりも１つ多くなる。
The power supply lines L1 to Ln + 1 are provided corresponding to the scanning lines Y1 to Yn. In order to supply a variable voltage to each
制御回路５は、図示しない上位装置より入力される垂直同期信号Ｖs、水平同期信号Ｈs、ドットクロック信号ＤＣＬＫおよび階調データＤ等に基づいて、走査線駆動回路３、データ線駆動回路４および電源線制御回路６を同期制御する。この同期制御の下、これらの回路３，４，６は、互いに協働して表示部１の表示制御を行う。
The
走査線駆動回路３は、シフトレジスタ、出力回路等を主体に構成されており、走査線Ｙ1〜Ｙnに走査信号ＳＥＬを出力することによって、走査線Ｙ1〜Ｙnの選択を行う。走査信号ＳＥＬは、高電位レベル（以下「Ｈレベル」という）または低電位レベル（以下「Ｌレベル」という）の２値的な信号レベルをとり、データの書込対象となる画素行に対応する走査線ＹはＨレベル、これ以外の走査線ＹはＬレベルにそれぞれ設定される。これにより、１フレームの画像を表示する期間（１Ｆ）毎に、所定の選択順序で（一般的には最上から最下に向かって）、それぞれの走査線Ｙを順番に選択する順次走査が行われる。 The scanning line driving circuit 3 is mainly composed of a shift register, an output circuit and the like, and selects the scanning lines Y1 to Yn by outputting a scanning signal SEL to the scanning lines Y1 to Yn. The scanning signal SEL takes a binary signal level of a high potential level (hereinafter referred to as “H level”) or a low potential level (hereinafter referred to as “L level”), and corresponds to a pixel row to which data is to be written. The scanning line Y is set to the H level, and the other scanning lines Y are set to the L level. As a result, for each period (1F) for displaying an image of one frame, sequential scanning for selecting each scanning line Y in order is performed in a predetermined selection order (generally from the top to the bottom). Is called.
データ線駆動回路４は、シフトレジスタ、ラインラッチ回路、出力回路等を主体に構成されている。データ線駆動回路４は、１本の走査線Ｙを選択する期間に相当する１水平走査期間（１Ｈ）において、今回データを書き込む画素行に対するデータの一斉出力と、次の１Ｈで書き込みを行う画素行に関するデータの点順次的なラッチとを同時に行う。ある１Ｈにおいて、データ線Ｘの本数に相当するｍ個のデータが順次ラッチされる。そして、次の１Ｈにおいて、ラッチされたｍ個のデータは、データ電流Ｉdataとして、対応するデータ線Ｘ1〜Ｘmに対して一斉に出力される。本実施形態は電流プログラム方式に関するものであり、この方式を採用する場合、データ線駆動回路４は、画素２の表示階調に相当するデータ（データ電圧Ｖdata）をデータ電流Ｉdataへと変換する可変電流源を含む。一方、後述する第２の実施形態のように、電圧プログラム方式を採用する場合、このような可変電流源をデータ線駆動回路４が備える必要はなく、画素２の階調を規定する電圧レベルのデータ電圧Ｖdataがデータ線Ｘ1〜Ｘmに出力される。
The data line driving circuit 4 is mainly composed of a shift register, a line latch circuit, an output circuit, and the like. The data line driving circuit 4 outputs the data simultaneously to the pixel row in which the current data is written and the pixel to be written in the next 1H in one horizontal scanning period (1H) corresponding to the period for selecting one scanning line Y. Dot-sequential latching of data about rows at the same time. In a certain 1H, m pieces of data corresponding to the number of data lines X are sequentially latched. In the next 1H, the latched m pieces of data are simultaneously output to the corresponding data lines X1 to Xm as the data current Idata. The present embodiment relates to a current programming method. When this method is employed, the data line drive circuit 4 is a variable that converts data (data voltage Vdata) corresponding to the display gradation of the
一方、電源線制御回路６は、シフトレジスタ、出力回路等を主体に構成されている。電源線Ｌ1〜Ｌn+1の電圧は、走査線駆動回路３による走査線Ｙの選択と同期して可変に設定され、基準電圧Ｖss（例えば０Ｖ）よりも高い電源電圧Ｖddまたは基準電圧Ｖssよりも低い電圧Ｖrvsのいずれかに設定される。 On the other hand, the power supply line control circuit 6 is mainly composed of a shift register, an output circuit, and the like. The voltages of the power supply lines L1 to Ln + 1 are variably set in synchronization with the selection of the scanning line Y by the scanning line driving circuit 3, and are higher than the power supply voltage Vdd or the reference voltage Vss higher than the reference voltage Vss (for example, 0V). One of the low voltages Vrvs is set.
図２は、本実施形態にかかるボルテージフォロワ型電流プログラム方式の画素回路図である。ｉ番目の画素行における１つの画素回路には、ｉ番目の走査線Ｙiを構成する４本の走査線Ｙａ〜Ｙｄ、この走査線Ｙiに対応するｉ番目の電源線Ｌ(i)および（ｉ＋１）番目の電源線Ｌ(i+1)が接続されている。ここで、ｉ番目および（ｉ＋１）番目は、表示部１の配置上において物理的に隣接しているが、線順次走査の順序においても隣接している。
FIG. 2 is a pixel circuit diagram of a voltage follower type current programming method according to the present embodiment. One pixel circuit in the i-th pixel row includes four scanning lines Ya to Yd constituting the i-th scanning line Yi, i-th power supply lines L (i) and (i + 1) corresponding to the scanning line Yi. ) Th power line L (i + 1) is connected. Here, the i-th and (i + 1) -th are physically adjacent on the arrangement of the
この画素回路は、電流駆動型素子の一形態である有機ＥＬ素子OLED、６つのトランジスタＴ1〜Ｔ6、およびデータを保持するキャパシタＣ1によって構成されている。本実施形態では、アモルファスシリコンによってＴＦＴが形成されているため、トランジスタＴ1〜Ｔ6のチャネル型はすべてｎ型になっているが、チャネル型はこれに限定されるものではない（後述する第２の実施形態についても同様）。また、本明細書では、ソース、ドレインおよびゲートを備える三端子型素子であるトランジスタに関して、ソースまたはドレインの一方を「一方の端子」、他方を「他方の端子」とそれぞれ呼ぶ。 This pixel circuit is composed of an organic EL element OLED which is a form of a current driven element, six transistors T1 to T6, and a capacitor C1 for holding data. In this embodiment, since the TFT is formed of amorphous silicon, the channel types of the transistors T1 to T6 are all n-type, but the channel type is not limited to this (the second type described later). The same applies to the embodiment). In this specification, regarding a transistor which is a three-terminal element including a source, a drain, and a gate, one of the source and the drain is referred to as “one terminal” and the other is referred to as “the other terminal”.
スイッチングトランジスタＴ1は、そのゲートが第１の走査信号ＳＥＬ1が供給される第１の走査線Ｙａに接続されており、この走査信号ＳＥＬ1によって導通制御される。このスイッチングトランジスタＴ1の一方の端子は、データ電流Ｉdataが供給されるデータ線Ｘに接続されており、その他方の端子は、ノードＮ3に接続されている。このノードＮ3には、スイッチングトランジスタＴ1以外にも、スイッチングトランジスタＴ6の一方の端子と、駆動トランジスタＴ3の一方の端子とが共通接続されている。このスイッチングトランジスタＴ6は、その他方の端子が電源線Ｌ(i)に接続され、そのゲートが第４の走査信号ＳＥＬ4が供給される第４の走査線Ｙｄに接続されているとともに、この走査信号ＳＥＬ4によって導通制御される。一方、スイッチングトランジスタＴ2は、そのゲートが第１の走査信号ＳＥＬ1が供給される第１の走査線Ｙａに接続されており、スイッチングトランジスタＴ1と同様、この走査信号ＳＥＬ1によって導通制御される。このスイッチングトランジスタＴ2の一方の端子は、データ線Ｘに接続され、その他方の端子は、ノードＮ1に接続されている。このノードＮ1には、スイッチングトランジスタＴ2以外にも、キャパシタＣ1の一方の電極と、駆動トランジスタＴ3のゲートとが共通接続されている。キャパシタＣ1の他方の電極は、ノードＮ2に接続されている。このノードＮ2には、キャパシタＣ1以外にも、駆動トランジスタＴ3の他方の端子と、スイッチングトランジスタＴ4の一方の端子と、スイッチングトランジスタＴ5の一方の端子とが共通接続されている。駆動トランジスタＴ3のソース，ゲートに相当するノードＮ1，Ｎ2の間にキャパシタＣ1を設けることにより、ボルテージフォロワ型の回路が構成される。スイッチングトランジスタＴ4は、その他方の端子が電源線Ｌ(i+1)に接続され、そのゲートが第２の走査信号ＳＥＬ2が供給される第２の走査線Ｙｂに接続されているとともに、この走査信号ＳＥＬ2によって導通制御される。スイッチングトランジスタＴ5は、その他方の端子が有機ＥＬ素子OLEDのアノード（陽極）に接続され、そのゲートが第３の走査信号ＳＥＬ3が供給される第３の走査線Ｙｃに接続されているとともに、この走査信号ＳＥＬ3によって導通制御される。この有機ＥＬ素子OLEDのカソード（陰極）、すなわち、対向電極には、基準電圧Ｖssが固定的に印加されている。 The gate of the switching transistor T1 is connected to the first scanning line Ya to which the first scanning signal SEL1 is supplied, and the conduction of the switching transistor T1 is controlled by the scanning signal SEL1. One terminal of the switching transistor T1 is connected to the data line X to which the data current Idata is supplied, and the other terminal is connected to the node N3. In addition to the switching transistor T1, one terminal of the switching transistor T6 and one terminal of the driving transistor T3 are commonly connected to the node N3. The switching transistor T6 has the other terminal connected to the power supply line L (i) and the gate connected to the fourth scanning line Yd to which the fourth scanning signal SEL4 is supplied. The conduction is controlled by SEL4. On the other hand, the gate of the switching transistor T2 is connected to the first scanning line Ya to which the first scanning signal SEL1 is supplied, and the conduction of the switching transistor T2 is controlled by the scanning signal SEL1 as in the switching transistor T1. One terminal of the switching transistor T2 is connected to the data line X, and the other terminal is connected to the node N1. In addition to the switching transistor T2, one electrode of the capacitor C1 and the gate of the driving transistor T3 are commonly connected to the node N1. The other electrode of the capacitor C1 is connected to the node N2. In addition to the capacitor C1, the other terminal of the driving transistor T3, one terminal of the switching transistor T4, and one terminal of the switching transistor T5 are commonly connected to the node N2. By providing a capacitor C1 between nodes N1 and N2 corresponding to the source and gate of the driving transistor T3, a voltage follower type circuit is formed. The other terminal of the switching transistor T4 is connected to the power supply line L (i + 1), and its gate is connected to the second scanning line Yb to which the second scanning signal SEL2 is supplied. The conduction is controlled by the signal SEL2. The other terminal of the switching transistor T5 is connected to the anode (anode) of the organic EL element OLED and the gate thereof is connected to the third scanning line Yc to which the third scanning signal SEL3 is supplied. The conduction is controlled by the scanning signal SEL3. The reference voltage Vss is fixedly applied to the cathode (cathode) of the organic EL element OLED, that is, the counter electrode.
図３は、図２に示した画素回路の動作タイミングチャートである。上述した１Ｆに相当する期間ｔ0〜ｔ4における一連の動作プロセスは、最初の期間ｔ0〜ｔ1におけるデータ書込プロセス、期間ｔ1〜ｔ2における駆動プロセス、期間ｔ2〜ｔ3における第１の逆バイアスの印加プロセス、および期間ｔ3〜ｔ4における第２の逆バイアスの印加プロセスに大別される。 FIG. 3 is an operation timing chart of the pixel circuit shown in FIG. A series of operation processes in the period t0 to t4 corresponding to 1F described above are a data writing process in the first period t0 to t1, a driving process in the period t1 to t2, and a first reverse bias application process in the period t2 to t3. And a second reverse bias application process in the period t3 to t4.
まず、データ書込期間ｔ0〜ｔ1では、図４に示す動作によって、キャパシタＣ1に対するデータの書き込みが行われる。具体的には、第１の走査信号ＳＥＬ1がＨレベルになって、スイッチングトランジスタＴ1，Ｔ2が共にオンする。これにより、駆動トランジスタＴ3のドレインに相当するノードＮ3と、データ線Ｘとが電気的に接続される。それとともに、駆動トランジスタＴ3は、トランジスタＴ1，Ｔ2とデータ線Ｘとを介して、自己のゲートと自己のドレインとが電気的に接続されたダイオード接続となる。また、第２の走査信号ＳＥＬ2がＬレベル、第３の走査信号ＳＥＬ3がＨレベルであるから、スイッチングトランジスタＴ4がオフし、スイッチングトランジスタＴ5がオンする。これにより、電源線Ｌ(i+1)を介したノードＮ2に対する電圧ＶL(i+1)（＝Ｖrvs）の供給が停止するとともに、ノードＮ2と有機ＥＬ素子OLEDのアノードとが電気的に接続される。さらに、第４の走査信号ＳＥＬ4がＬレベルであるから、スイッチングトランジスタＴ6がオフする。これにより、電源線Ｌ(i)を介したノードＮ3に対する電圧ＶL(i)の供給が停止する。その結果、同図において矢印で示したように、データ線Ｘから基準電圧Ｖssに向って、トランジスタＴ1，Ｔ3，Ｔ5、有機ＥＬ素子OLEDの順序で流れるデータ電流Ｉdataの経路が形成される。駆動トランジスタＴ3は、データ線Ｘより供給されたデータ電流Ｉdataを自己のチャネルに流し、このデータ電流Ｉdataに応じたゲート電圧ＶgをノードＮ1に発生する。これにより、キャパシタＣ1には、発生したゲート電圧Ｖgに応じた電荷が蓄積され、蓄積された電荷量に相当するデータが書き込まれる。このように、データ書込期間ｔ0〜ｔ1において、駆動トランジスタＴ3は、キャパシタＣ1にデータを書き込むプログラミングトランジスタとして機能する。なお、データ電流Ｉdataの経路中に有機ＥＬ素子OLEDが含まれるため、このデータ書込プロセスにおいて、有機ＥＬ素子OLEDが発光し始める。 First, in the data writing period t0 to t1, data is written to the capacitor C1 by the operation shown in FIG. Specifically, the first scanning signal SEL1 becomes H level, and both the switching transistors T1 and T2 are turned on. As a result, the node N3 corresponding to the drain of the driving transistor T3 and the data line X are electrically connected. At the same time, the driving transistor T3 has a diode connection in which its own gate and its own drain are electrically connected via the transistors T1 and T2 and the data line X. Further, since the second scanning signal SEL2 is L level and the third scanning signal SEL3 is H level, the switching transistor T4 is turned off and the switching transistor T5 is turned on. As a result, the supply of the voltage VL (i + 1) (= Vrvs) to the node N2 via the power supply line L (i + 1) is stopped, and the node N2 and the anode of the organic EL element OLED are electrically connected. Is done. Further, since the fourth scanning signal SEL4 is at L level, the switching transistor T6 is turned off. As a result, the supply of the voltage VL (i) to the node N3 via the power supply line L (i) is stopped. As a result, as indicated by an arrow in the figure, a path of the data current Idata flowing in the order of the transistors T1, T3, T5 and the organic EL element OLED from the data line X toward the reference voltage Vss is formed. The drive transistor T3 causes the data current Idata supplied from the data line X to flow through its own channel, and generates a gate voltage Vg corresponding to the data current Idata at the node N1. Thereby, charges corresponding to the generated gate voltage Vg are accumulated in the capacitor C1, and data corresponding to the accumulated charge amount is written. Thus, in the data writing period t0 to t1, the drive transistor T3 functions as a programming transistor for writing data to the capacitor C1. Since the organic EL element OLED is included in the path of the data current Idata, the organic EL element OLED starts to emit light in this data writing process.
つぎに、駆動期間ｔ1〜ｔ2では、図５に示す動作によって、駆動電流Ｉoledが有機ＥＬ素子OLEDを流れ、有機ＥＬ素子OLEDが発光する。１Ｈ（すなわち、１本の走査線Ｙが選択される選択期間）に相当する書込期間ｔ0〜ｔ1が経過すると、第１の走査信号ＳＥＬ1がＬレベルに立ち下がって、スイッチングトランジスタＴ1，Ｔ2が共にオフする。これにより、データ電流Ｉdataが供給されるデータ線ＸとノードＮ3とが電気的に分離され、駆動トランジスタＴ3のダイオード接続も解除される。ただし、このダイオード接続が解除された後も、駆動トランジスタＴ3のゲートに相当するノードＮ1には、キャパシタＣ1に保持されているデータに応じたゲート電圧Ｖgが印加され続ける。そして、第１の走査信号ＳＥＬ1がＬレベルになるのと「同期」して、第４の走査信号ＳＥＬ4がＨレベルに立ち上がって、スイッチングトランジスタＴ6がオンする。本明細書では、「同期」という用語を、同一タイミングである場合のみならず、設計上のマージン等の理由で若干の時間的なオフセットを許容する意味で用いている。これにより、電源線Ｌ(i)の電圧ＶL(i)、すなわち、基準電圧Ｖssよりも高い電源電圧ＶddがノードＮ3に供給される。なお、先のデータ書込期間ｔ0〜ｔ1と同様、この期間ｔ1〜ｔ2でも、スイッチングトランジスタＴ4はオフ、スイッチングトランジスタＴ5はオンのままである。その結果、駆動トランジスタＴ3および有機ＥＬ素子OLEDの双方に順バイアスが印加され、ＶL(i)＝Ｖddに設定された電源線Ｌ(i)から対向電極側の基準電圧Ｖssに向かって、トランジスタＴ6，Ｔ3，Ｔ5、有機ＥＬ素子OLEDの順序で流れる駆動電流Ｉoledの経路が形成される。有機ＥＬ素子OLEDを流れる駆動電流Ｉoledは、駆動トランジスタＴ3のチャネル電流に相当し、その電流レベルは、キャパシタＣ1の蓄積電荷（保持データ）に起因したゲート電圧Ｖgによって設定される。有機ＥＬ素子OLEDは、駆動トランジスタＴ3が発生した駆動電流Ｉoledに応じた輝度で発光し、これによって、画素２の階調が設定される。
Next, in the driving period t1 to t2, the driving current Ioled flows through the organic EL element OLED and the organic EL element OLED emits light by the operation shown in FIG. When a writing period t0 to t1 corresponding to 1H (that is, a selection period in which one scanning line Y is selected) elapses, the first scanning signal SEL1 falls to the L level, and the switching transistors T1 and T2 are turned on. Turn off both. As a result, the data line X to which the data current Idata is supplied and the node N3 are electrically separated, and the diode connection of the driving transistor T3 is also released. However, even after the diode connection is released, the gate voltage Vg corresponding to the data held in the capacitor C1 is continuously applied to the node N1 corresponding to the gate of the drive transistor T3. Then, in synchronization with the first scanning signal SEL1 being at the L level, the fourth scanning signal SEL4 rises to the H level, and the switching transistor T6 is turned on. In this specification, the term “synchronization” is used not only for the same timing but also for allowing a slight time offset for reasons such as a design margin. As a result, the voltage VL (i) of the power supply line L (i), that is, the power supply voltage Vdd higher than the reference voltage Vss is supplied to the node N3. Note that the switching transistor T4 remains off and the switching transistor T5 remains on during this period t1 to t2, similarly to the previous data writing period t0 to t1. As a result, a forward bias is applied to both the drive transistor T3 and the organic EL element OLED, and the transistor T6 moves from the power supply line L (i) set to VL (i) = Vdd toward the reference voltage Vss on the counter electrode side. , T3, T5, and the organic EL element OLED are formed in the order of the drive current Ioled. The drive current Ioled flowing through the organic EL element OLED corresponds to the channel current of the drive transistor T3, and the current level is set by the gate voltage Vg caused by the accumulated charge (retained data) of the capacitor C1. The organic EL element OLED emits light with a luminance corresponding to the drive current Ioled generated by the drive transistor T3, and thereby the gradation of the
続く第１の逆バイアス印加期間ｔ2〜ｔ3では、図６に示す動作によって、駆動トランジスタＴ3に対して非順バイアス、すなわち、駆動期間ｔ1〜ｔ2における順バイアスとは異なる方向のバイアスが印加される。具体的には、第３の走査信号ＳＥＬ3がＬレベルに立ち下がるとともに、これと同期して、第２の走査信号ＳＥＬ2がＨレベルに立ちがある。これにより、ノードＮ2と有機ＥＬ素子OLEDのアノードとが電気的に分離され、ＶL(i+1)＝Ｖddに設定された電源線Ｌ(i+1)によってノードＮ2の電圧Ｖ2がＶddに設定される。また、この期間ｔ2〜ｔ3でも、スイッチングトランジスタＴ6はオンのままであるが、電源線Ｌ(i)の電圧ＶL(i)は、先の駆動期間ｔ1〜ｔ2におけるＶL(i)＝Ｖddとは異なり、基準電圧Ｖssよりも低い電圧Ｖrvsに設定されている。したがって、ノードＮ2の電圧Ｖ2は電源線Ｌ(i)の電圧ＶL(i)（＝Ｖrvs）よりも高いＶddになる。その結果、駆動トランジスタＴ3に作用するバイアス（ノードＮ2，Ｎ3間の電圧関係）は、先の駆動期間ｔ1〜ｔ2のそれとは逆になる。このように、駆動トランジスタＴ3に逆バイアス（非順バイアスの一形態）を印加することにより、駆動トランジスタＴ3のＶthシフト、すなわち、同一方向のバイアスのみが印加し続けることで、駆動トランジスタＴ3のしきい値Ｖthが経時変化してしまう現象等の特性の変化や劣化を抑制できる。 In the subsequent first reverse bias application period t2 to t3, the operation shown in FIG. 6 applies a non-forward bias to the drive transistor T3, that is, a bias in a direction different from the forward bias in the drive period t1 to t2. . Specifically, the third scanning signal SEL3 falls to the L level, and the second scanning signal SEL2 rises to the H level in synchronization therewith. Thereby, the node N2 and the anode of the organic EL element OLED are electrically separated, and the voltage V2 of the node N2 is set to Vdd by the power supply line L (i + 1) set to VL (i + 1) = Vdd. Is done. Also, the switching transistor T6 remains on during this period t2 to t3, but the voltage VL (i) of the power supply line L (i) is equal to VL (i) = Vdd in the previous driving period t1 to t2. In contrast, the voltage Vrvs is set lower than the reference voltage Vss. Therefore, the voltage V2 at the node N2 becomes Vdd higher than the voltage VL (i) (= Vrvs) of the power supply line L (i). As a result, the bias acting on the driving transistor T3 (the voltage relationship between the nodes N2 and N3) is opposite to that in the previous driving period t1 to t2. In this way, by applying a reverse bias (a form of non-forward bias) to the drive transistor T3, only the bias in the same direction continues to be applied by driving the Vth shift of the drive transistor T3. Changes in characteristics such as a phenomenon in which the threshold value Vth changes with time can be suppressed.
最後に、第２の逆バイアス印加期間ｔ3〜ｔ4では、図７に示す動作によって、有機ＥＬ素子OLEDに対して非順バイアス、すなわち、駆動期間ｔ1〜ｔ2における順バイアスとは異なる方向のバイアスが印加される。具体的には、第４の走査信号ＳＥＬ4がＬレベルに立ち下がるとともに、これと同期して、第３の走査信号ＳＥＬ3がＨレベルに立ちがある。これにより、ノードＮ3と電源線Ｌ(i)とが電気的に分離され、ノードＮ2と有機ＥＬ素子OLEDのアノードとが電気的に接続される。また、この期間ｔ3〜ｔ4でも、スイッチングトランジスタＴ4はオンのままであるが、電源線Ｌ(i+1)の電圧ＶL(i+1)は、先の期間ｔ2〜ｔ3におけるＶL(i+1)＝Ｖddとは異なりＶrvsに設定されている。したがって、ノードＮ2の電圧Ｖ2は対向電極の基準電圧Ｖssよりも低いＶrvsになる。その結果、有機ＥＬ素子OLEDに作用するバイアスは、駆動期間ｔ1〜ｔ2のそれとは逆になる。このように、有機ＥＬ素子OLEDに逆バイアスを印加することにより、有機ＥＬ素子OLEDの長寿命化を図ることが可能になる。 Finally, in the second reverse bias application period t3 to t4, the operation shown in FIG. 7 causes a non-forward bias to the organic EL element OLED, that is, a bias in a direction different from the forward bias in the drive period t1 to t2. Applied. Specifically, the fourth scanning signal SEL4 falls to the L level, and the third scanning signal SEL3 rises to the H level in synchronization therewith. Thereby, the node N3 and the power supply line L (i) are electrically separated, and the node N2 and the anode of the organic EL element OLED are electrically connected. In addition, the switching transistor T4 remains on during this period t3 to t4, but the voltage VL (i + 1) of the power supply line L (i + 1) is VL (i + 1) in the previous period t2 to t3. ) = Vrvs unlike Vdd. Therefore, the voltage V2 at the node N2 becomes Vrvs lower than the reference voltage Vss of the counter electrode. As a result, the bias acting on the organic EL element OLED is opposite to that in the driving periods t1 to t2. Thus, by applying a reverse bias to the organic EL element OLED, it is possible to extend the life of the organic EL element OLED.
図３に示した電源線Ｌ(i+1)の電圧ＶL(i+1)の経時変化は、電源線Ｌ(i)それに対して１Ｈ分オフセットしている。そして、（i+1）番目の画素行に関しては、タイミングｔ0から１Ｈが経過したタイミングｔ1を始点として、電源線Ｌ(i+1)，Ｌ(i+2)を用いた動作プロセスが上述したプロセスと同様に行われる（それ以降の画素行についても同様）。 The change over time of the voltage VL (i + 1) of the power supply line L (i + 1) shown in FIG. 3 is offset by 1H with respect to the power supply line L (i). For the (i + 1) th pixel row, the operation process using the power supply lines L (i + 1) and L (i + 2) is described above, starting from the timing t1 when 1H has elapsed from the timing t0. The same process is performed (the same applies to the subsequent pixel rows).
このように、本実施形態では、隣接した一対の電源線Ｌ(i)，Ｌ(i+1)を画素回路に共通接続し、これらの電圧ＶL(i)，ＶL(i+1)を走査線Ｙの選択と同期して可変に設定する。これらの電圧ＶL(i)，ＶL(i+1)は、同一波形であり、所定期間分（ここでは１Ｈ分）オフセットさせた関係になっている。そして、（i+1）番目の画素行の動作プロセスで本来使用すべき電源線Ｌ(i+1)をｉ番目の画素行の動作プロセスでも使用する。このように、電源線Ｌの共通化を図ることで、電源線Ｌの本数を減らすことが可能になる。 Thus, in this embodiment, a pair of adjacent power supply lines L (i) and L (i + 1) are connected in common to the pixel circuit, and these voltages VL (i) and VL (i + 1) are scanned. It is set to be variable in synchronization with the selection of the line Y. These voltages VL (i) and VL (i + 1) have the same waveform and are offset by a predetermined period (here, 1H). The power supply line L (i + 1) that should be used in the operation process of the (i + 1) th pixel row is also used in the operation process of the i-th pixel row. Thus, by sharing the power supply lines L, the number of power supply lines L can be reduced.
また、本実施形態によれば、電源線Ｌ(i)，Ｌ(i+1)の電圧ＶL(i)，ＶL(i+1)を可変に設定することにより、駆動トランジスタＴ3に非順バイアスを印加するとともに、有機ＥＬ素子OLEDにも非順バイアスを印加する。駆動トランジスタＴ3に非順バイアスを印加することにより、駆動トランジスタＴ3におけるＶthシフト等の特性の変化を有効に抑制することが可能になる。また、有機ＥＬ素子OLEDに非順バイアスを印加することにより、有機ＥＬ素子OLEDの長寿命化を図ることができる。電源線Ｌ(i)，Ｌ(i+1)の電圧ＶL(i)，ＶL(i+1)を振る手法は、対向電極の電圧Ｖcaを振る手法と比較して、回路負担を軽減でき、フレーム設定等を行う上でも有利になる。 In addition, according to the present embodiment, the voltages VL (i) and VL (i + 1) of the power supply lines L (i) and L (i + 1) are variably set so that the drive transistor T3 is non-forward biased. And a non-forward bias is also applied to the organic EL element OLED. By applying a non-forward bias to the drive transistor T3, it is possible to effectively suppress changes in characteristics such as a Vth shift in the drive transistor T3. Moreover, the lifetime of the organic EL element OLED can be extended by applying a non-forward bias to the organic EL element OLED. Compared with the method of oscillating the voltage Vca of the counter electrode, the method of oscillating the voltages VL (i) and VL (i + 1) of the power lines L (i) and L (i + 1) can reduce the circuit burden. This is also advantageous for frame setting and the like.
（第２の実施形態）
図８は、本実施形態にかかるボルテージフォロワ型電圧プログラム方式の画素回路図である。ｉ番目の画素行における１つの画素回路には、ｉ番目の走査線Ｙiを構成する４本の走査線Ｙａ〜Ｙｄ、この走査線Ｙiに対応するｉ番目の電源線Ｌ(i)、および、これと隣接した（i+1）番目の電源線Ｌ(i+1)が接続されている。この画素回路は、有機ＥＬ素子OLED、５つのトランジスタＴ1〜Ｔ5、およびデータを保持するキャパシタＣ1，Ｃ2によって構成されている。
(Second Embodiment)
FIG. 8 is a pixel circuit diagram of a voltage follower type voltage program system according to the present embodiment. One pixel circuit in the i-th pixel row includes four scanning lines Ya to Yd constituting the i-th scanning line Yi, an i-th power supply line L (i) corresponding to the scanning line Yi, and The (i + 1) th power line L (i + 1) adjacent to this is connected. This pixel circuit includes an organic EL element OLED, five transistors T1 to T5, and capacitors C1 and C2 for holding data.
スイッチングトランジスタＴ1は、そのゲートが第１の走査信号ＳＥＬ1が供給される第１の走査線Ｙａに接続されており、この走査信号ＳＥＬ1によって導通制御される。このスイッチングトランジスタＴ1の一方の端子は、データ電圧Ｖdataが供給されるデータ線Ｘに接続されており、その他方の端子は、第１のキャパシタＣ1の一方の電極に接続されている。このキャパシタＣ1の他方の電極は、ノードＮ1に接続されている。このノードＮ1には、第１のキャパシタＣ1以外に、駆動トランジスタＴ3のゲート、スイッチングトランジスタＴ2の一方の端子、および第２のキャパシタＣ2の一方の電極が共通接続されている。駆動トランジスタＴ3の一方の端子は、電源線Ｌ(i)に接続されており、その他方の端子は、ノードＮ2に接続されている。このノードＮ2には、駆動トランジスタＴ3以外に、スイッチングトランジスタＴ2の他方の端子、第２のキャパシタＣ2の他方の電極、スイッチングトランジスタＴ4の一方の端子、およびスイッチングトランジスタＴ5の一方の端子が共通接続されている。駆動トランジスタＴ3のソース，ゲートに相当するノードＮ1，Ｎ2の間にキャパシタＣ2を設けることにより、ボルテージフォロワ型の回路が構成される。スイッチングトランジスタＴ4は、その他方の端子が電源線Ｌ(i+1)に接続され、そのゲートが第３の走査信号ＳＥＬ3が供給される第３の走査線Ｙｃに接続されているとともに、この走査信号ＳＥＬ3によって導通制御される。スイッチングトランジスタＴ5は、その他方の端子が有機ＥＬ素子OLEDのアノード（陽極）に接続され、そのゲートが第４の走査信号ＳＥＬ4が供給される第４の走査線Ｙｄに接続されているとともに、この走査信号ＳＥＬ4によって導通制御される。この有機ＥＬ素子OLEDのカソード（陰極）、すなわち対向電極には、基準電圧Ｖssが固定的に印加されている。 The gate of the switching transistor T1 is connected to the first scanning line Ya to which the first scanning signal SEL1 is supplied, and the conduction of the switching transistor T1 is controlled by the scanning signal SEL1. One terminal of the switching transistor T1 is connected to the data line X to which the data voltage Vdata is supplied, and the other terminal is connected to one electrode of the first capacitor C1. The other electrode of the capacitor C1 is connected to the node N1. In addition to the first capacitor C1, the node N1 is connected in common to the gate of the drive transistor T3, one terminal of the switching transistor T2, and one electrode of the second capacitor C2. One terminal of the driving transistor T3 is connected to the power supply line L (i), and the other terminal is connected to the node N2. In addition to the driving transistor T3, the other terminal of the switching transistor T2, the other electrode of the second capacitor C2, one terminal of the switching transistor T4, and one terminal of the switching transistor T5 are commonly connected to the node N2. ing. By providing a capacitor C2 between nodes N1 and N2 corresponding to the source and gate of the driving transistor T3, a voltage follower type circuit is configured. The other terminal of the switching transistor T4 is connected to the power supply line L (i + 1), and its gate is connected to the third scanning line Yc to which the third scanning signal SEL3 is supplied. The conduction is controlled by the signal SEL3. The other terminal of the switching transistor T5 is connected to the anode (anode) of the organic EL element OLED, and its gate is connected to the fourth scanning line Yd to which the fourth scanning signal SEL4 is supplied. The conduction is controlled by the scanning signal SEL4. A reference voltage Vss is fixedly applied to the cathode (cathode) of the organic EL element OLED, that is, the counter electrode.
図９は、図８に示した画素回路の動作タイミングチャートである。本実施形態において、１Ｆに相当する期間ｔ0〜ｔ5における一連の動作プロセスは、期間ｔ0〜ｔ1における初期化プロセス、期間ｔ1〜ｔ2におけるデータ書込プロセス、駆動期間ｔ2〜ｔ3における駆動プロセス、期間ｔ3〜ｔ4における逆バイアスの印加プロセス、および期間ｔ4〜ｔ5における待機プロセスに大別される。 FIG. 9 is an operation timing chart of the pixel circuit shown in FIG. In the present embodiment, a series of operation processes in the period t0 to t5 corresponding to 1F are an initialization process in the period t0 to t1, a data writing process in the period t1 to t2, a driving process in the driving period t2 to t3, and a period t3. Are roughly divided into a reverse bias application process at t4 and a standby process at periods t4 to t5.
まず、初期化期間ｔ0〜ｔ1では、図１０に示す動作によって、駆動トランジスタＴ3に対する非順バイアスの印加とＶth補償とが同時に行われる。具体的には、走査信号ＳＥＬ1，ＳＥＬ4がＬレベルになって、スイッチングトランジスタＴ1，Ｔ5が共にオフする。これにより、第１のキャパシタＣ1とデータ線Ｘとが電気的に分離されるとともに、有機ＥＬ素子OLEDとノードＮ2とが電気的に分離される。また、第２の走査信号ＳＥＬ2がＨレベルになって、スイッチングトランジスタＴ2がオンする。さらに、初期化期間ｔ0〜ｔ1の一部期間（前半）において、第３の走査信号ＳＥＬ3がＨレベルになって、スイッチングトランジスタＴ4がオンする。ここで、電源線Ｌ(i)はＶL(i)＝Ｖrvsに設定されており、ノードＮ2の電圧Ｖ2は、電源線Ｌ(i+1)を介した電圧Ｖddの供給によって、電源線Ｌ(i)の電圧ＶL(i)、すなわちＶrvsよりも高い電圧になっている。このような電圧関係より、駆動トランジスタＴ3には、駆動電流Ｉoledが流れる方向とは逆方向のバイアスが印加され、自己のゲートと自己のドレイン（ノードＮ2側の端子）とが順方向に接続されたダイオード接続となる。その後、第３の走査信号ＳＥＬ3がＬレベルに立ち下がって、スイッチングトランジスタＴ4がオフすると、ノードＮ2の電圧Ｖ2（およびこれと直結したノードＮ1の電圧Ｖ1）がオフセット電圧（Ｖrvs＋Ｖth）に設定される。ノードＮ1に接続されたキャパシタＣ1，Ｃ2は、データの書き込みに先立ち、ノードＮ1の電圧Ｖ1がオフセット電圧（Ｖrvs＋Ｖth）になるような電荷状態に設定される。このように、データの書き込みに先立ち、ノードＮ1の電圧をオフセット電圧（Ｖrvs＋Ｖth）にオフセットさせておくことにより、駆動トランジスタＴ3のしきい値Ｖthを補償することが可能になる。 First, in the initialization period t0 to t1, non-forward bias is applied to the driving transistor T3 and Vth compensation is simultaneously performed by the operation shown in FIG. Specifically, the scanning signals SEL1 and SEL4 become L level, and both the switching transistors T1 and T5 are turned off. Thereby, the first capacitor C1 and the data line X are electrically separated, and the organic EL element OLED and the node N2 are electrically separated. Further, the second scanning signal SEL2 becomes H level, and the switching transistor T2 is turned on. Furthermore, in a partial period (first half) of the initialization period t0 to t1, the third scanning signal SEL3 becomes H level and the switching transistor T4 is turned on. Here, the power supply line L (i) is set to VL (i) = Vrvs, and the voltage V2 at the node N2 is supplied by the supply of the voltage Vdd via the power supply line L (i + 1). The voltage VL (i) of i) is higher than Vrvs. Due to this voltage relationship, a bias in the direction opposite to the direction in which the drive current Ioled flows is applied to the drive transistor T3, and its own gate and its own drain (terminal on the node N2 side) are connected in the forward direction. Diode connection. Thereafter, when the third scanning signal SEL3 falls to the L level and the switching transistor T4 is turned off, the voltage V2 at the node N2 (and the voltage V1 at the node N1 directly connected thereto) is set to the offset voltage (Vrvs + Vth). . The capacitors C1 and C2 connected to the node N1 are set to a charge state such that the voltage V1 of the node N1 becomes an offset voltage (Vrvs + Vth) prior to data writing. As described above, the threshold voltage Vth of the drive transistor T3 can be compensated by offsetting the voltage of the node N1 to the offset voltage (Vrvs + Vth) prior to data writing.
つぎに、データ書込期間ｔ1〜ｔ2では、図１１に示す動作によって、初期化期間ｔ0〜ｔ1にて設定されたオフセット電圧（Ｖss＋Ｖth）を基準に、キャパシタＣ1，Ｃ2に対するデータの書き込みが行われる。具体的には、第２の走査信号ＳＥＬ2がＬレベルに立ち下がって、スイッチングトランジスタＴ2がオフし、駆動トランジスタＴ3のダイオード接続が解除される。この走査信号ＳＥＬ2の立ち下がりと同期して、第１の走査信号ＳＥＬ1がＨレベルに立ち上がって、スイッチングトランジスタＴ1がオンする。これにより、データ線Ｘと第１のキャパシタＣ1とが電気的に接続される。そして、タイミングｔ1から所定の時間が経過した時点で、データ線Ｘの電圧Ｖxが基準電圧Ｖrvsからデータ電圧Ｖdataに立ち上がる。データ線ＸおよびノードＮ1は、第１のキャパシタＣ1を介して容量結合している。そのため、このノードＮ1の電圧Ｖ1は、数式１に示すように、データ線Ｘの電圧変化量ΔＶdata（＝Ｖdata−Ｖss）に応じて、オフセット電圧（Ｖrvs＋Ｖth）を基準としてα・ΔＶdata分だけ上昇する。なお、同数式において、係数αは、第１のキャパシタＣ1の容量Ｃａと第２のキャパシタＣ2の容量Ｃｂとの容量比によって一義的に特定される係数である（α＝Ｃａ／（Ｃａ＋Ｃｂ））。
Next, in the data writing period t1 to t2, data is written to the capacitors C1 and C2 based on the offset voltage (Vss + Vth) set in the initialization period t0 to t1 by the operation shown in FIG. . Specifically, the second scanning signal SEL2 falls to the L level, the switching transistor T2 is turned off, and the diode connection of the driving transistor T3 is released. In synchronization with the fall of the scanning signal SEL2, the first scanning signal SEL1 rises to H level and the switching transistor T1 is turned on. As a result, the data line X and the first capacitor C1 are electrically connected. When a predetermined time elapses from the timing t1, the voltage Vx of the data line X rises from the reference voltage Vrvs to the data voltage Vdata. The data line X and the node N1 are capacitively coupled via the first capacitor C1. Therefore, the voltage V1 of the node N1 rises by α · ΔVdata by using the offset voltage (Vrvs + Vth) as a reference according to the voltage change amount ΔVdata (= Vdata−Vss) of the data line X as shown in
（数式１）
Ｖ1＝Ｖrvs＋Ｖth＋α・ΔＶdata
＝Ｖrvs＋Ｖth＋α（Ｖdata−Ｖss）
(Formula 1)
V1 = Vrvs + Vth + α ・ ΔVdata
= Vrvs + Vth + α (Vdata−Vss)
キャパシタＣ1，Ｃ2には、数式１より算出される電圧Ｖ1に相当する電荷がデータとして書き込まれる。この期間ｔ1〜ｔ2において、ノードＮ2の電圧Ｖ2は、ノードＮ1の電圧変動の影響を受けることなく、ほぼＶrvs＋Ｖthに維持される。なぜなら、これらのノードＮ1，Ｎ2は、第２のキャパシタＣ2を介して容量結合しているものの、通常、このキャパシタＣ2の容量は有機ＥＬ素子OLEDの自己容量よりも十分に小さいからである。なお、この期間ｔ1〜ｔ2において、電源線Ｌ(i)をＶL＝Ｖssにする理由は、駆動電流Ｉoledを流さないことで、有機ＥＬ素子OLEDの発光を規制するためである。なお、この期間ｔ1〜ｔ2において、スイッチングトランジスタＴ5がオフしているので、駆動電流Ｉoledが流れず、有機ＥＬ素子OLEDは発光しない。
In the capacitors C1 and C2, charges corresponding to the voltage V1 calculated from
そして、駆動期間ｔ2〜ｔ3では、図１２に示す動作によって、駆動トランジスタＴ3のチャネル電流に相当する駆動電流Ｉoledが有機ＥＬ素子OLEDに供給され、有機ＥＬ素子OLEDが発光する。具体的には、第１の走査信号ＳＥＬ1がＬレベルに立ち下がって、スイッチングトランジスタＴ1がオフする。これにより、データ電圧Ｖdataが供給されるデータ線Ｘと第１のキャパシタＣ1とが電気的に分離されるが、駆動トランジスタＴ3のゲートＮ1には、キャパシタＣ1，Ｃ2に保持されているデータに応じた電圧が印加され続ける。そして、第１の走査信号ＳＥＬ1の立ち下がりと同期して、第４の走査信号ＳＥＬ4がＨレベルに立ち上がり、スイッチングトランジスタＴ5がオンするとともに、電源線Ｌ(i)の電圧ＶL(i)もＶrvsからＶddに立ち上がる。その結果、電源線Ｌ(i)から対向電極の基準電圧Ｖssに向かう方向に駆動電流Ｉoledの経路が形成される。駆動トランジスタＴ3が飽和領域で動作することを前提として、有機ＥＬ素子OLEDを流れる駆動電流Ｉoled（駆動トランジスタＴ3のチャネル電流Ｉds）は、数式２に基づいて算出される。同数式において、Ｖgsは、駆動トランジスタＴ3のゲート−ソース間電圧である。また、利得係数βは、駆動トランジスタＴ3のキャリアの移動度μ、ゲート容量Ａ、チャネル幅Ｗ、チャネル長Ｌより一義的に特定される係数である（β＝μＡＷ／Ｌ）。
In the driving period t2 to t3, the driving current Ioled corresponding to the channel current of the driving transistor T3 is supplied to the organic EL element OLED by the operation shown in FIG. 12, and the organic EL element OLED emits light. Specifically, the first scanning signal SEL1 falls to the L level, and the switching transistor T1 is turned off. As a result, the data line X to which the data voltage Vdata is supplied is electrically separated from the first capacitor C1, but the gate N1 of the driving transistor T3 is connected to the data held in the capacitors C1 and C2. The applied voltage continues to be applied. Then, in synchronization with the fall of the first scanning signal SEL1, the fourth scanning signal SEL4 rises to H level, the switching transistor T5 is turned on, and the voltage VL (i) of the power supply line L (i) is also Vrvs. To Vdd. As a result, a path of the drive current Ioled is formed in the direction from the power supply line L (i) toward the reference voltage Vss of the counter electrode. Assuming that the drive transistor T3 operates in the saturation region, the drive current Ioled (channel current Ids of the drive transistor T3) flowing through the organic EL element OLED is calculated based on
（数式２）
Ｉoled＝Ｉds
＝β/2（Ｖgs−Ｖth）2
(Formula 2)
Ioled = Ids
= Β / 2 (Vgs−Vth) 2
ここで、駆動トランジスタＴ3のゲート電圧Ｖgとして数式１で算出されたＶ1を代入すると、数式２は数式３のように変形できる。
Here, when V1 calculated by
（数式３）
Ｉoled＝β/2（Ｖg−Ｖs−Ｖth）2
＝β/2｛(Ｖrvs＋Ｖth＋α・ΔＶdata)−Ｖs−Ｖth｝2
＝β/2（Ｖrvs＋α・ΔＶdata−Ｖs）2
(Formula 3)
Ioled = β / 2 (Vg−Vs−Vth) 2
= Β / 2 {(Vrvs + Vth + α · ΔVdata) −Vs−Vth} 2
= Β / 2 (Vrvs + α · ΔVdata−Vs) 2
数式３において留意すべき点は、駆動トランジスタＴ3が発生する駆動電流Ｉoledは、Ｖthの相殺によって、駆動トランジスタＴ3のしきい値Ｖthに依存しない点である。したがって、キャパシタＣ1，Ｃ2に対するデータの書き込みをＶthを基準に行えば、製造バラツキや経時変化等によってＶthにバラツキが生じたととしても、その影響を受けることなく駆動電流Ｉoledを生成できる。 The point to be noted in Formula 3 is that the drive current Ioled generated by the drive transistor T3 does not depend on the threshold value Vth of the drive transistor T3 due to cancellation of Vth. Therefore, if data writing to the capacitors C1 and C2 is performed with reference to Vth, the drive current Ioled can be generated without being affected by variations in Vth due to manufacturing variations or changes with time.
有機ＥＬ素子OLEDの発光輝度は、データ電圧Ｖdata（電圧変化量ΔＶdata）に応じた駆動電流Ｉoledにより決定され、これによって、画素２の階調が設定される。なお、図１２に示した経路で駆動電流Ｉoledが流れると、駆動トランジスタＴ3のソース電圧Ｖ2は、有機ＥＬ素子OLEDの自己抵抗に起因した電圧降下Ｖelに応じて、当初のＶrvs＋Ｖthよりも上昇する。しかしながら、駆動トランジスタＴ3のゲートＮ1とソースＮ2とは第２のキャパシタＣ2を介して容量結合しており、ソース電圧Ｖ2の上昇にともないゲート電圧Ｖ1も上昇するので、結果的に、ゲート−ソース間電圧Ｖgsはほぼ一定に維持される。
The light emission luminance of the organic EL element OLED is determined by the drive current Ioled corresponding to the data voltage Vdata (voltage change amount ΔVdata), and thereby the gradation of the
続く逆バイアス期間ｔ3〜ｔ4では、図１３に示す動作によって、有機ＥＬ素子OLEDの長寿命化を図るべく、有機ＥＬ素子OLEDに対して非順バイアスが印加される。具体的には、第３の走査信号ＳＥＬ3がＨレベルに立ち上がるとともに、電源線Ｌ(i)の電圧ＶL(i)がＶddからＶrvsになっている。また、この期間ｔ3〜ｔ4では、電源線Ｌ(i+1)がＶL(i+1)＝Ｖrvsになっている。したがって、ノードＮ2に電源線Ｌ(i+1)の電圧Ｖrvsが直接印加され、Ｖ2＝Ｖrvsになるので、有機ＥＬ素子OLEDに非順バイアスの一形態である逆バイアスが印加される。 In the subsequent reverse bias period t3 to t4, a non-forward bias is applied to the organic EL element OLED in order to extend the life of the organic EL element OLED by the operation shown in FIG. Specifically, the third scanning signal SEL3 rises to the H level, and the voltage VL (i) of the power supply line L (i) is changed from Vdd to Vrvs. In this period t3 to t4, the power supply line L (i + 1) is VL (i + 1) = Vrvs. Therefore, since the voltage Vrvs of the power supply line L (i + 1) is directly applied to the node N2 and V2 = Vrvs, a reverse bias, which is a form of non-forward bias, is applied to the organic EL element OLED.
待機期間ｔ4〜ｔ5は、図９に示した電圧ＶL(i)，ＶL(i+1)を所定期間分（ここでは１Ｈ分）オフセットさせた同一波形にしたことに伴い生じる、タイミングを調整するための期間である。なお、上述したｉ番目の画素行に続いて選択される（i+1）番目の画素行に関しては、１Ｈ分オフセットしたタイミングで、電源線Ｌ(i+1)，Ｌ(i+2)を用いた動作プロセスが上述したプロセスと同様に行われる（それ以降の画素行についても同様）。 The standby periods t4 to t5 adjust the timing that occurs when the voltages VL (i) and VL (i + 1) shown in FIG. 9 have the same waveform offset by a predetermined period (here, 1H). It is a period for. For the (i + 1) -th pixel row selected following the i-th pixel row, the power supply lines L (i + 1) and L (i + 2) are connected at a timing offset by 1H. The operation process used is performed in the same manner as described above (the same applies to the subsequent pixel rows).
このように、本実施形態によれば、第１の実施形態と同様の理由で、電源線Ｌの本数を減らすことができる。それとともに、駆動トランジスタＴ3に非順バイアスを印加することによるＶthシフトの抑制と、有機ＥＬ素子OLEDに非順バイアスを印加することによる有機ＥＬ素子OLEDの長寿命化とを図れる。 Thus, according to the present embodiment, the number of power supply lines L can be reduced for the same reason as in the first embodiment. At the same time, it is possible to suppress the Vth shift by applying a non-forward bias to the driving transistor T3 and to extend the life of the organic EL element OLED by applying a non-forward bias to the organic EL element OLED.
なお、本実施例において、駆動トランジスタのゲート電圧をオフセット電圧に設定する際には、駆動トランジスタのゲートに接続されたキャパシタの一方の電極に対向する他方のキャパシタの電極の電位を所定値に設定することが好ましい。これにより、容量カップリングにより前記駆動トランジスタのゲート電圧を正確に設定することができる。 In this embodiment, when the gate voltage of the driving transistor is set to the offset voltage, the potential of the electrode of the other capacitor facing the one electrode of the capacitor connected to the gate of the driving transistor is set to a predetermined value. It is preferable to do. Thereby, the gate voltage of the drive transistor can be accurately set by capacitive coupling.
例えば、図９に示したタイミングチャートのように、スイッチングトランジスタT２とスイッチングトランジスタT1とがともにオン状態となる期間を設け、さらにこの期間内の電圧Vxを、Vss等の所定値に設定することにより、ノードN1がオフセット電圧に設定される際にノードN1に接続されたキャパシタC1の電極とは反対側の電極の電位が正確に設定され、このため、データ電圧Vdataを供給して容量カップリングにより行う、ノードN1の電圧レベルの設定も正確に行うことができる。 For example, as shown in the timing chart of FIG. 9, by providing a period in which both the switching transistor T2 and the switching transistor T1 are turned on, and further setting the voltage Vx in this period to a predetermined value such as Vss When the node N1 is set to the offset voltage, the potential of the electrode on the side opposite to the electrode of the capacitor C1 connected to the node N1 is accurately set. For this reason, the data voltage Vdata is supplied and capacitive coupling is performed. The voltage level of the node N1 can also be set accurately.
なお、上述した実施形態では、電気光学素子として有機ＥＬ素子OLEDを用いた例について説明した。しかしながら、本発明はこれに限定されるものではなく、駆動電流に応じて輝度が設定される電気光学素子（無機ＬＥＤ表示装置、フィールド・エミッション表示装置等）、或いは、駆動電流に応じた透過率・反射率を呈する電気光学装置（エレクトロクロミック表示装置、電気泳動表示装置等）に対しても広く適用可能である。 In the above-described embodiment, the example in which the organic EL element OLED is used as the electro-optical element has been described. However, the present invention is not limited to this, and an electro-optical element (inorganic LED display device, field emission display device, etc.) whose luminance is set according to the drive current, or transmittance according to the drive current. -Widely applicable to electro-optical devices (electrochromic display devices, electrophoretic display devices, etc.) exhibiting reflectivity.
また、上述した実施形態にかかる電気光学装置は、例えば、テレビ、プロジェクタ、携帯電話機、携帯端末、モバイル型コンピュータ、パーソナルコンピュータ等を含む様々な電子機器に実装可能である。これらの電子機器に上述した電気光学装置を実装すれば、電子機器の商品価値を一層高めることができ、市場における電子機器の商品訴求力の向上を図ることができる。 Further, the electro-optical device according to the above-described embodiment can be mounted on various electronic devices including, for example, a television, a projector, a mobile phone, a mobile terminal, a mobile computer, a personal computer, and the like. When the above-described electro-optical device is mounted on these electronic devices, the commercial value of the electronic devices can be further increased, and the product appeal of electronic devices in the market can be improved.
本発明の電気光学装置以外の応用としては、例えば、本発明の画素回路の構成はバイオチップ等の電子装置の電子回路としても採用可能である。 As an application other than the electro-optical device of the present invention, for example, the configuration of the pixel circuit of the present invention can be adopted as an electronic circuit of an electronic device such as a biochip.
１ 表示部
２ 画素
３ 走査線駆動回路
４ データ線駆動回路
５ 制御回路
６ 電源線制御回路
Ｔ1〜Ｔ6 トランジスタ
Ｃ1〜Ｃ2 キャパシタ
OLED 有機ＥＬ素子
Ｎ1〜Ｎ3 ノード
DESCRIPTION OF
OLED organic EL elements N1 to N3 nodes
Claims (19)
複数のデータ線と、
前記複数のデータ線と交差する方向に延在する複数の電源線と、
前記複数の走査線と前記複数のデータ線との交差に対応して複数の画素回路が設けられているとともに、前記複数の画素回路のそれぞれが、前記複数の電源線のうち互いに隣接した一対の電源線に共通接続された画素群と、
前記複数の走査線に走査信号を出力することにより、前記走査線を選択する走査線駆動回路と、
前記走査線駆動回路による前記走査線の選択と同期して、前記複数の電源線の電圧を可変に設定する電源線制御回路とを有することを特徴とする電気光学装置。 A plurality of scan lines;
Multiple data lines,
A plurality of power supply lines extending in a direction intersecting with the plurality of data lines;
A plurality of pixel circuits are provided corresponding to intersections of the plurality of scanning lines and the plurality of data lines, and each of the plurality of pixel circuits is a pair of adjacent ones of the plurality of power supply lines. A group of pixels commonly connected to a power line;
A scanning line driving circuit for selecting the scanning line by outputting a scanning signal to the plurality of scanning lines;
An electro-optical device comprising: a power supply line control circuit that variably sets voltages of the plurality of power supply lines in synchronization with selection of the scanning line by the scanning line driving circuit.
複数のデータ線と、
前記複数のデータ線と交差する方向に延在する複数の電源線と、
前記複数の走査線と前記複数のデータ線との交差に対応して設けられた複数の画素回路と、を含み、
前記複数の電源線のうちの一つの電源線には、前記複数の画素回路のうち、前記複数のデータ線の一つのデータ線に沿って相隣接して配置された画素回路が接続されていることを特徴とする電気光学装置。 A plurality of scan lines;
Multiple data lines,
A plurality of power supply lines extending in a direction intersecting with the plurality of data lines;
A plurality of pixel circuits provided corresponding to intersections of the plurality of scanning lines and the plurality of data lines,
One power line of the plurality of power lines is connected to a pixel circuit arranged adjacent to one another along one data line of the plurality of data lines. An electro-optical device.
前記複数のデータ線の一つのデータ線を介して供給されたデータ電流またはデータ電圧に応じた電荷を保持するキャパシタと、
前記キャパシタに保持された前記電荷に基づいて導通状態が設定される駆動トランジスタと、
前記導通状態に応じて輝度が設定される電気光学素子とを有することを特徴とする請求項１乃至３いずれかに記載された電気光学装置。 Each of the plurality of pixel circuits is
A capacitor for holding a charge corresponding to a data current or a data voltage supplied via one data line of the plurality of data lines;
A drive transistor whose conduction state is set based on the charge held in the capacitor;
The electro-optical device according to claim 1, further comprising an electro-optical element whose luminance is set according to the conduction state.
前記２つの電源線のうちの他方の電源線は、前記駆動トランジスタの他方の端部と前記電気光学素子との間のノードに接続された請求項８に記載された電気光学装置。 One of the two power lines is connected to one end of the drive transistor,
The electro-optical device according to claim 8, wherein the other power line of the two power lines is connected to a node between the other end of the driving transistor and the electro-optical element.
前記複数の画素回路の各々に前記複数のデータ線のうちの一つのデータ線を介してデータ信号を供給する第１のステップと、
前記データ信号により設定された前記駆動トランジスタの導通状態に応じた順バイアスを前記電気光学素子に印加する第２のステップと、
前記電気光学素子に非順バイアス第３のステップと、
前記順バイアスの印加による前記駆動トランジスタの特性の変化または劣化を回復させるための第４のステップと、
を有することを特徴とする電気光学装置の駆動方法。 A plurality of pixel circuits each including an electro-optic element and a driving transistor are provided corresponding to the intersections of the plurality of scanning lines and the plurality of data lines, and each of the plurality of pixel circuits includes the plurality of pixel circuits. In the driving method of the electro-optical device commonly connected to a pair of power supply lines adjacent to each other among the plurality of power supply lines provided corresponding to the scanning lines,
A first step of supplying a data signal to each of the plurality of pixel circuits via one of the plurality of data lines;
A second step of applying a forward bias to the electro-optic element in accordance with a conduction state of the drive transistor set by the data signal;
A non-forward bias third step on the electro-optic element;
A fourth step for recovering a change or deterioration in characteristics of the driving transistor due to the application of the forward bias;
A method for driving an electro-optical device.
前記第３のステップ及び前記第４のステップは互いに異なる期間を利用して行うこと、
ことを特徴とする電気光学装置の駆動方法。 The driving method of the electro-optical device according to claim 12,
The third step and the fourth step are performed using different periods;
A driving method for an electro-optical device.
前記第４のステップは前記電気光学素子と前記駆動トランジスタとの電気的接続を切った状態で行われることを特徴とする電気光学装置の駆動方法。 The method of driving an electro-optical device according to claim 12 or 13,
The method of driving an electro-optical device, wherein the fourth step is performed in a state where the electrical connection between the electro-optical element and the driving transistor is cut off.
前記第４ステップにおいて、前記駆動トランジスタには非順バイアスが印加されることことを特徴とする電気光学装置の駆動方法。 The method for driving an electro-optical device according to claim 12,
In the fourth step, a non-forward bias is applied to the driving transistor.
前記第２のステップにおいて、前記一方の電源線の電圧を所定の電圧よりも高く設定することにより、前記駆動トランジスタに順バイアスを印加し、
前記第４のステップにおいて、前記他方の電源線の電圧を前記一方の電源線の電圧よりも高く設定することにより、前記駆動トランジスタに非順バイアスを印加することを特徴とする電気光学装置の駆動方法。 The method for driving an electro-optical device according to claim 12,
In the second step, a forward bias is applied to the driving transistor by setting the voltage of the one power line higher than a predetermined voltage;
In the fourth step, the non-forward bias is applied to the drive transistor by setting the voltage of the other power supply line higher than the voltage of the one power supply line. Method.
前記複数の画素回路の各々に前記複数のデータ線のうちの一つのデータ線を介してデータ信号を供給する第１のステップと、
前記データ信号により設定された前記駆動トランジスタの導通状態に応じた順バイアスを前記電気光学素子に印加する第２のステップと、
前記電気光学素子に非順バイアス第３のステップと、
前記駆動トランジスタに非順バイアスを印加する第４のステップと、
を有することを特徴とする電気光学装置の駆動方法。 A driving method of an electro-optical device including a plurality of pixel circuits each including an electro-optical element and a driving transistor corresponding to the intersection of a plurality of scanning lines and a plurality of data lines,
A first step of supplying a data signal to each of the plurality of pixel circuits via one of the plurality of data lines;
A second step of applying a forward bias to the electro-optic element in accordance with a conduction state of the drive transistor set by the data signal;
A non-forward bias third step on the electro-optic element;
A fourth step of applying a non-forward bias to the drive transistor;
A method for driving an electro-optical device.
前記駆動トランジスタの特性バラツキの補償を行った上で前記駆動トランジスタの導通状態を設定することを特徴とする電気光学装置の駆動方法。 The method of driving an electro-optical device according to claim 12,
A driving method of an electro-optical device, wherein a conduction state of the driving transistor is set after compensating for variation in characteristics of the driving transistor.
前記複数の画素回路の各々に前記複数のデータ線のうちの一つのデータ線を介してデータ信号を供給する第１のステップと、
前記データ信号により設定された前記駆動トランジスタの導通状態に応じた順バイアスを前記電気光学素子に印加する第２のステップと、
前記電気光学素子及び前記駆動トランジスタの少なくともいずれか一方に非順バイアスを印加する第３のステップと、を含み、
前記駆動トランジスタの特性バラツキの補償を行った上で前記駆動トランジスタの導通状態設定をすることを特徴とする電気光学装置の駆動方法。
A driving method of an electro-optical device including a plurality of pixel circuits each including an electro-optical element and a driving transistor corresponding to the intersection of a plurality of scanning lines and a plurality of data lines,
A first step of supplying a data signal to each of the plurality of pixel circuits via one of the plurality of data lines;
A second step of applying a forward bias to the electro-optic element in accordance with a conduction state of the drive transistor set by the data signal;
Applying a non-forward bias to at least one of the electro-optic element and the driving transistor, and
A driving method of an electro-optical device, wherein the conduction state of the driving transistor is set after compensating for the characteristic variation of the driving transistor.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2004244833A JP5162807B2 (en) | 2003-08-29 | 2004-08-25 | Electro-optical device and electronic apparatus |
Applications Claiming Priority (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2003306803 | 2003-08-29 | ||
| JP2003306803 | 2003-08-29 | ||
| JP2004244833A JP5162807B2 (en) | 2003-08-29 | 2004-08-25 | Electro-optical device and electronic apparatus |
Related Child Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2008294162A Division JP2009048212A (en) | 2003-08-29 | 2008-11-18 | Electrooptical device, driving method of the electrooptical device, and electronic equipment |
Publications (3)
| Publication Number | Publication Date |
|---|---|
| JP2005099772A true JP2005099772A (en) | 2005-04-14 |
| JP2005099772A5 JP2005099772A5 (en) | 2008-12-25 |
| JP5162807B2 JP5162807B2 (en) | 2013-03-13 |
Family
ID=34467381
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2004244833A Expired - Fee Related JP5162807B2 (en) | 2003-08-29 | 2004-08-25 | Electro-optical device and electronic apparatus |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP5162807B2 (en) |
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Also Published As
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|---|---|
| JP5162807B2 (en) | 2013-03-13 |
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Legal Events
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| S531 | Written request for registration of change of domicile |
Free format text: JAPANESE INTERMEDIATE CODE: R313531 |
|
| R350 | Written notification of registration of transfer |
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Free format text: JAPANESE INTERMEDIATE CODE: R313113 |
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| R360 | Written notification for declining of transfer of rights |
Free format text: JAPANESE INTERMEDIATE CODE: R360 |
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| R360 | Written notification for declining of transfer of rights |
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| R350 | Written notification of registration of transfer |
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