JP2005039029A - Semiconductor device - Google Patents
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Abstract
Description
本発明は、半導体基板の一面に形成された保護膜から開口するアルミニウム電極の表面に対してはんだ付け用の金属電極を形成してなる半導体装置に関する。 The present invention relates to a semiconductor device in which a metal electrode for soldering is formed on the surface of an aluminum electrode that opens from a protective film formed on one surface of a semiconductor substrate.
半導体基板の一面にアルミニウム電極を形成し、このアルミニウム電極に対してヒートシンク等をはんだ付けするようにした半導体装置が提案されている(例えば、特許文献1、特許文献2参照)。
There has been proposed a semiconductor device in which an aluminum electrode is formed on one surface of a semiconductor substrate and a heat sink or the like is soldered to the aluminum electrode (see, for example,
このような半導体装置の場合、バンプ電極技術(例えば、特許文献3参照)を応用して、半導体基板の一面上において、アルミニウム電極の上に保護膜を形成し、この保護膜に開口部を形成した後、この開口部から臨むアルミニウム電極の表面上に、はんだ付け用の金属電極をメッキ等により形成することが考えられる。
本発明者らは、この種の半導体装置について試作検討を行った。図4は、本発明者らの試作品としての半導体装置の要部を示す概略断面図である。 The inventors of the present invention conducted a trial production of this type of semiconductor device. FIG. 4 is a schematic cross-sectional view showing a main part of a semiconductor device as a prototype of the present inventors.
半導体基板1の一面上にはアルミニウム(以下、Alという)からなるAl電極11が形成され、Al電極11の上にはポリイミド等からなる保護膜12が形成されている。
An
この保護膜12には開口部12aが形成されており、この開口部12aから臨むAl電極11の表面上には、はんだ付け用の金属電極13がメッキ等により形成されている。ここでは、金属電極13は無電解Ni/Auメッキにより形成され、下側からNiメッキ層13a、金メッキ層13bが積層されたものである。
An opening 12a is formed in the
しかしながら、試作したものにおいては、図4に示すように、保護膜12の開口部12aにおける内周端面12bが垂直に近くなり、図中の破線に示すように、はんだバンプ等のはんだ部材60を形成した場合、はんだ部材60が当該内周端面12bに接触してしまう問題が発生した。
However, in the prototype, as shown in FIG. 4, the inner
はんだ部材60が内周端面12bに接触すると、はんだ部材60に応力が加わり、はんだ部材60の変形が生じ、はんだ部材60と金属電極13との密着性に悪影響を及ぼすという問題が生じることが判明した。
When the
本発明は上記問題に鑑み、半導体基板の一面に形成された保護膜から開口するAl電極の表面に対してはんだ付け用の金属電極を形成してなる半導体装置において、はんだ部材と保護膜とが接触しないようにすることを目的とする。 In view of the above problems, the present invention provides a semiconductor device in which a metal electrode for soldering is formed on the surface of an Al electrode that opens from a protective film formed on one surface of a semiconductor substrate. The purpose is to prevent contact.
上記目的を達成するため、請求項1に記載の発明では、半導体基板(1)の一面上にAlからなるAl電極(11)を形成し、Al電極の上に保護膜(12)を形成し、Al電極の一部が保護膜上に臨むように保護膜に開口部(12a)を形成した後、開口部から臨むAl電極の表面上にはんだ付け用の金属電極(13)を形成し、金属電極にはんだからなるはんだ部材(60)を接合してなる半導体装置において、保護膜の開口部における内周端面(12b)が、はんだリフロー後のはんだ部材の形状におけるはんだ接触角(θ1)の補角(θ2)よりも小さいテーパ角度(θ3)を有するテーパ形状となっており、金属電極は保護膜よりも薄いものであり、金属電極の上面は開口部の中に位置していることを特徴としている。 In order to achieve the above object, according to the first aspect of the present invention, an Al electrode (11) made of Al is formed on one surface of a semiconductor substrate (1), and a protective film (12) is formed on the Al electrode. After forming the opening (12a) in the protective film so that a part of the Al electrode faces the protective film, a metal electrode (13) for soldering is formed on the surface of the Al electrode facing from the opening, In a semiconductor device in which a solder member (60) made of solder is joined to a metal electrode, the inner peripheral end surface (12b) in the opening of the protective film has a solder contact angle (θ1) in the shape of the solder member after solder reflow. The taper shape has a taper angle (θ3) smaller than the complementary angle (θ2), the metal electrode is thinner than the protective film, and the upper surface of the metal electrode is located in the opening. It is a feature.
本発明では、金属電極(13)は保護膜(12)よりも薄く、金属電極(13)の上面は開口部(12a)の中に位置しているため、はんだ部材(60)の下部も開口部(12a)の中に位置している。 In the present invention, since the metal electrode (13) is thinner than the protective film (12) and the upper surface of the metal electrode (13) is located in the opening (12a), the lower part of the solder member (60) is also opened. It is located in the part (12a).
また、保護膜(12)の開口部(12a)における内周端面(12b)が、はんだリフロー後のはんだ部材(60)の形状におけるはんだ接触角(θ1)の補角(θ2)よりも小さいテーパ角度(θ3)を有するテーパ形状となっている。 Further, the inner peripheral end face (12b) in the opening (12a) of the protective film (12) has a taper smaller than the complementary angle (θ2) of the solder contact angle (θ1) in the shape of the solder member (60) after the solder reflow. The taper shape has an angle (θ3).
そのため、本発明では、開口部(12a)の中にはんだ部材(60)が位置していても、はんだ部材(60)と保護膜(12)とが接触しないようにすることができる。 Therefore, in this invention, even if the solder member (60) is located in the opening part (12a), it can prevent a solder member (60) and a protective film (12) from contacting.
また、請求項2に記載の発明では、半導体基板(1)の一面上にAlからなるAl電極(11)を形成し、Al電極の上に保護膜(12)を形成し、Al電極の一部が保護膜上に臨むように保護膜に開口部(12a)を形成した後、開口部から臨むAl電極の表面上にはんだ付け用の金属電極を形成し、金属電極にはんだからなるはんだ部材(60)を接合してなる半導体装置において、金属電極は保護膜よりも厚いものであり、金属電極の上面は開口部の上方に位置していることを特徴としている。 According to the second aspect of the present invention, an Al electrode (11) made of Al is formed on one surface of the semiconductor substrate (1), a protective film (12) is formed on the Al electrode, and one Al electrode is formed. After forming the opening (12a) in the protective film so that the part faces the protective film, a metal electrode for soldering is formed on the surface of the Al electrode facing from the opening, and the solder member made of solder on the metal electrode In the semiconductor device formed by bonding (60), the metal electrode is thicker than the protective film, and the upper surface of the metal electrode is located above the opening.
本発明では、金属電極(13)は保護膜(12)よりも厚く、金属電極の(13)上面が開口部(12a)の上方に位置している。それによって、本発明では、そもそも、はんだ部材(60)の全体が開口部(12a)の上方の外部に位置した形となるため、はんだ部材(60)と保護膜(12)とが接触しないようにすることができる。 In the present invention, the metal electrode (13) is thicker than the protective film (12), and the upper surface of the metal electrode (13) is located above the opening (12a). Accordingly, in the present invention, since the entire solder member (60) is positioned outside the opening (12a), the solder member (60) and the protective film (12) do not come into contact with each other. Can be.
ここで、請求項3に記載の発明のように、金属電極(13)は、メッキにより形成された膜にすることができる。 Here, as in the third aspect of the invention, the metal electrode (13) can be a film formed by plating.
さらに、請求項4に記載の発明のように、メッキ膜としての金属電極(13)としては、Al電極(11)の表面側からニッケルメッキ層(13a)、金メッキ層(13b)が順次無電解メッキにより形成され積層されてなる膜にすることができる。 Further, as the metal electrode (13) as the plating film, the nickel plating layer (13a) and the gold plating layer (13b) are sequentially electrolessly formed from the surface side of the Al electrode (11). A film formed by plating and laminated can be formed.
また、請求項5に記載の発明では、金属電極(13)は、鉛フリーはんだを用いてはんだ付けされたものであることを特徴とする。 Further, the invention according to claim 5 is characterized in that the metal electrode (13) is soldered using lead-free solder.
鉛を含有しない鉛フリーはんだは、環境に優しいが、従来用いられてきた鉛入りのはんだに比べて硬い。そのため、金属電極に加わる応力も大きくなり、従来の半導体装置ではAl電極と金属電極との剥離が生じやすい。そのような鉛フリーはんだを用いた半導体装置において、本発明は有効に作用する。 Lead-free solders that do not contain lead are environmentally friendly, but are harder than conventional lead-containing solders. For this reason, the stress applied to the metal electrode also increases, and in the conventional semiconductor device, the Al electrode and the metal electrode are easily separated. In the semiconductor device using such lead-free solder, the present invention works effectively.
さらに、請求項6に記載の発明では、金属電極(13)は鉛フリーはんだを介して金属製のヒートシンク(20)と接合されていることを特徴とする。 Furthermore, the invention according to claim 6 is characterized in that the metal electrode (13) is joined to the metal heat sink (20) via lead-free solder.
上述したように、本発明者らの検討によれば、金属電極の上にヒートシンクをはんだ付けする場合、Al電極と金属電極との剥離の問題が顕著になるが、そのようなヒートシンクとはんだ付けされた半導体装置に対して、本発明は有効に作用する。 As described above, according to the study by the present inventors, when the heat sink is soldered on the metal electrode, the problem of peeling between the Al electrode and the metal electrode becomes significant. The present invention effectively operates on the manufactured semiconductor device.
ここで、請求項7に記載の発明のように、保護膜(12)としては、ポリイミド系樹脂からなるものを採用することができる。 Here, as in the invention described in claim 7, as the protective film (12), one made of a polyimide resin can be adopted.
なお、上記各手段の括弧内の符号は、後述する実施形態に記載の具体的手段との対応関係を示す一例である。 In addition, the code | symbol in the bracket | parenthesis of each said means is an example which shows a corresponding relationship with the specific means as described in embodiment mentioned later.
以下、本発明を図に示す実施形態について説明する。図1は、本発明の実施形態に係る半導体装置S1の全体構成を示す概略断面図であり、図2は図1中のエミッタ電極2の近傍部構成の一例を示す拡大断面図である。 DESCRIPTION OF THE PREFERRED EMBODIMENTS Embodiments shown in the drawings will be described below. FIG. 1 is a schematic cross-sectional view showing the overall configuration of a semiconductor device S1 according to an embodiment of the present invention, and FIG. 2 is an enlarged cross-sectional view showing an example of the configuration of the vicinity of the emitter electrode 2 in FIG.
図1に示すように、本実施形態では、半導体装置としてIGBT(絶縁ゲート型バイポーラトランジスタ)が形成された半導体チップ10を、その両面にはんだ付けされたヒートシンク20、30、40によって挟み込み、さらに、樹脂50にてモールドした構成のものを採用している。以下、この構成を両面はんだ付けモールド構造ということにする。
As shown in FIG. 1, in this embodiment, a
半導体チップ10は、シリコン半導体等の半導体基板1を本体として構成されており、この半導体基板1の厚みは約250μm以下と薄いものとしている。以下、半導体チップ10すなわち半導体基板1の外表面のうち、図1中の上面側に相当する素子形成面側の面を表面1aといい、表面1aとは反対側の面を裏面1bという。
The
そして、半導体チップ10の表面1aにはエミッタ電極2およびゲート電極3が形成されており、裏面1bにはコレクタ電極4が形成されている。ここで、
エミッタ電極2には、はんだ部材60を介して第1のヒートシンク20が接合されており、さらに、第1のヒートシンク20の外側には、はんだ部材60を介して第2のヒートシンク30が接合されている。
An emitter electrode 2 and a
A
また、ゲート電極3にはボンディングワイヤ70が接続されており、このボンディングワイヤ70を介して、ゲート電極3と半導体チップ10の周辺に設けられた外部接続用のリード80とが結線され電気的に接続されている。
A
また、コレクタ電極4は、はんだ部材60を介して第3のヒートシンク40と接合されている。ここで、はんだ部材60としては、鉛フリーはんだが用いられるが、例えば、鉛フリーはんだとしては、Sn−Ag−Cu系はんだやSn−Ni−Cu系はんだ等を採用することができる。
The collector electrode 4 is joined to the
また、ヒートシンク20、30、40は銅(Cu)等の熱伝導性に優れた材料からなるものである。ボンディングワイヤ70は、一般的なAlや金(Au)等からなるワイヤをワイヤボンディング法により形成したものである。
The heat sinks 20, 30, and 40 are made of a material having excellent thermal conductivity such as copper (Cu). The bonding
ここで、エミッタ電極2の詳細な構成の一例は図2に示される。図2に示すように、半導体基板1の一面すなわち表面1a上に、AlからなるAl電極11が形成されている。Al電極11は蒸着やスパッタ等の物理的気相成長法(PVD)により形成されたAlの膜であり、例えば膜厚は1μm程度とすることができる。
Here, an example of a detailed configuration of the emitter electrode 2 is shown in FIG. As shown in FIG. 2, an
このAl電極11の上には、電気絶縁性材料からなる保護膜12が形成されている。この保護膜12は、例えばポリイミド系樹脂等の電気絶縁性材料を用いたスピンコート法により成膜することができる。ここでは、保護膜12の厚さは例えば3μm程度にすることができる。
A
また、この保護膜12には、Al電極11の表面が臨むように開口した開口部12aが形成されている。この開口部12aは、例えばフォトリソグラフ技術を用いたエッチングを行うことにより形成することができる。
The
そして、開口部12aから臨むAl電極11の表面上には、はんだ付け用の金属電極13が形成されている。本実施形態では、金属電極13はメッキにより形成された膜であり、例えば、Ni/Auの積層メッキ膜、Cuメッキ膜、あるいはNi−Fe合金のメッキ膜等を採用することができる。なお、金属電極13はPVD等にて形成された膜であってもよい。
A
本例では、金属電極13は、Al電極11の表面側からニッケル(Ni)メッキ層13a、金(Au)メッキ層13bが順次無電解メッキにより形成され積層されてなる膜すなわち無電解Ni/Auメッキ膜としている。
In this example, the
このように、本実施形態では、エミッタ電極2は、Al電極11と金属電極13との積層膜として構成されている。なお、ボンディングワイヤ70と接続されるゲート電極3も、はんだ付けではないものの電極構成はエミッタ電極2と同様の構成を採用することができる。
Thus, in this embodiment, the emitter electrode 2 is configured as a laminated film of the
このような開口部12を含むエミッタ電極2の形成方法について述べる。まず、半導体基板1の表面1aにPVDによりAl電極11を形成する。このAl電極11の上に保護膜12をスピンコート法等を用いて形成し、フォトエッチング等により保護膜12に開口部12aを形成する。
A method for forming the emitter electrode 2 including the
そして、開口部12aから臨むAl電極11の表面上に、メッキやPVD等により金属膜13を形成する。本例では、無電解メッキにより金属膜13として無電解Ni/Auメッキ膜を形成する。こうして、Al電極11および金属電極13より構成されるエミッタ電極2ができあがる。
Then, a
ここにおいて、図2に示すエミッタ電極2では、保護膜12の開口部12aにおける内周端面12bが、はんだリフロー後のはんだ部材60の形状におけるはんだ接触角θ1の補角θ2よりも小さいテーパ角度θ3を有するテーパ形状となっている。例えば、この補角θ2は50°程度にすることができる。
Here, in the emitter electrode 2 shown in FIG. 2, the inner
さらに、この図2に示す例では、金属電極13は保護膜12よりも薄く、金属電極13の上面(本例では、金メッキ層13bの上面)は開口部12a中に位置している。つまり、図2において、金属電極13の上面は保護膜12の上面よりも低い位置にあるため、はんだ部材60の下部も開口部12aの中に位置している。
Further, in the example shown in FIG. 2, the
ここで、保護膜12において上記テーパ形状を有する開口部12aを形成するには、上記した保護膜12のフォトエッチングにおいて、例えば、次のような工程を採用すればよい。
Here, in order to form the
保護膜12に用いる材料として、非感光性ポリイミドを用いる。工程としては、半導体基板1上に当該ポリイミドをスピンコーティングして塗布する。その後は、通常のベーク温度よりも低温でベークを行うか、またはベークの処理時間を通常よりも短くしてベークを行う。
As a material used for the
次に、非感光性ポリイミドのマスクとなるレジスト材を塗布し、露光・現像を行う。こうして、上記テーパ形状を有する開口部12aが形成される。
Next, a resist material serving as a non-photosensitive polyimide mask is applied, and exposure and development are performed. Thus, the
なお、上記図1において、半導体基板1の裏面1bに形成され第3のヒートシンク40とはんだ付けされているコレクタ電極4は、半導体基板1の裏面1bの略全面にスパッタ等により形成されている。
In FIG. 1, the collector electrode 4 formed on the
例えば、このコレクタ電極4は、半導体基板1の裏面1b側から順次、Ti(チタン)層、Ni層、Au層がスパッタにより積層形成されたTi/Ni/Au膜とすることができる。
For example, the collector electrode 4 can be a Ti / Ni / Au film in which a Ti (titanium) layer, a Ni layer, and an Au layer are sequentially formed from the
また、図1において、樹脂50は第2のヒートシンク30と第3のヒートシンク40との間に充填され、当該ヒートシンク30、40間に位置する構成部品を封止している。ここで、リード80については、ボンディングワイヤ70との接続部が樹脂50にて封止されている。樹脂50としてはエポキシ系樹脂等、通常のモールド材料を採用することができる。
In FIG. 1, the
このようにして、本実施形態の半導体装置S1が構成されている。この半導体装置S1では、半導体チップ10からの発熱を熱伝導性にも優れたはんだ60を介して各ヒートシンク20、30、40に伝え、放熱を行うことができるようになっている。つまり、本実施形態では、半導体チップ10の両面1a、1bからの放熱が可能となっている。
Thus, the semiconductor device S1 of this embodiment is configured. In the semiconductor device S1, the heat generated from the
また、各ヒートシンク20、30、40は半導体チップ10との電気的な経路となっている。つまり、第1および第2のヒートシンク20、30を介して半導体チップ10のエミッタ電極2の導通が図られ、第3のヒートシンク40を介して半導体チップ10のコレクタ電極4の導通が図られるようになっている。
Each
次に、上記構成の半導体装置S1の組み付け方法について、簡単に述べておく。各電極2、3、4が形成された半導体チップ10を用意し、当該各電極2〜4の表面にはんだ60を配設する。
Next, a method for assembling the semiconductor device S1 having the above configuration will be briefly described. A
そして、半導体チップ10に対してはんだ60を介して第1および第3のヒートシンク20、40を接合する。その後、ワイヤボンディングを行って半導体チップ10のゲート電極3とリード80とをボンディングワイヤ70により電気的に接続する。
Then, the first and
そして、第1のヒートシンク20の外側に第2のヒートシンク30をはんだ60を介して接合する。続いて、樹脂50によるモールドを行う。こうして、上記半導体装置S1が完成する。
Then, the
ところで、上記図2に示す例では、エミッタ電極2は、保護膜12の開口部12aにおける内周端面12bが、はんだリフロー後のはんだ部材60の形状におけるはんだ接触角θ1の補角θ2よりも小さいテーパ角度θ3を有するテーパ形状となっており、さらに、金属電極13は保護膜12よりも薄く、金属電極13の上面は開口部12a中に位置している、という独自の構成を採用している。
By the way, in the example shown in FIG. 2, the emitter electrode 2 has an inner
この図2に示す例では、はんだがリフローの際に表面張力により球形になろうとする性質を持つことに着目している。はんだリフロー後のはんだ部材60の形状は、はんだリフロー時に液状となったはんだ部材60の形状をほぼ継承している。
In the example shown in FIG. 2, attention is paid to the fact that the solder has the property of becoming spherical due to surface tension during reflow. The shape of the
そのため、保護膜12の開口部12aにおける内周端面12bをテーパ面とし、そのテーパ角度θ3を、はんだリフロー時のはんだ部材60の形状におけるはんだ接触角θ1の補角θ2よりも小さくすることにより、リフロー時において、はんだ部材60と保護膜12の開口部12aの内周端面12bとが接触しにくく(つまり、干渉しにくく)することができる。
Therefore, the inner
言い換えれば、保護膜12の開口部12aにおける内周端面12bが、はんだ部材60の濡れ角度に相当する補角θ2よりも小さいテーパ角度θ3を持つテーパ形状となっている。そのため、図2に示す例では、開口部12aの中にはんだ部材60が位置していても、はんだ部材60と保護膜12とが接触しないようにすることができる。
In other words, the inner
また、本実施形態において、はんだ部材60と保護膜12とが接触しないようなエミッタ電極2の構成としては、図3のような構成を採用することもできる。図3(a)および(b)は、図1中に示されるエミッタ電極2の近傍部構成のもう一つの例を示す拡大断面図である。
In the present embodiment, as the configuration of the emitter electrode 2 so that the
図3(a)、(b)に示す例では、金属電極13を保護膜12よりも厚いものとし、金属電極13の上面を開口部12aの上方に位置させた構成としている。また、ここでは、保護膜12の開口部12aにおける内周端面12bを、垂直もしくは垂直に近いものとしている。
3A and 3B, the
このような構成は、上述した開口部12を含むエミッタ電極2の形成方法に準じて容易に形成することができる。なお、図3において(a)は保護膜12を例えば3μm以上と比較的厚くし、(b)は保護膜12を例えば2μm以下と比較的薄くすることで、本構成を実現している。
Such a configuration can be easily formed according to the method for forming the emitter electrode 2 including the
これらの例では、金属電極13は保護膜12よりも厚く、図3において、金属電極13上面を、開口部12aの上方すなわち保護膜12の上面よりも、上方に位置させることによって、そもそも、はんだ部材60全体が開口部12aの上方の外部に位置した形となる。
In these examples, the
そのため、図3に示す例では、保護膜12の開口部12aにおける内周端面12bが垂直もしくは垂直に近いものであっても、はんだ部材60と保護膜12とが接触しないようにすることができる。なお、この図3の例においても、保護膜12の開口部12aにおける内周端面12bを、上記図2に示したようなテーパ形状としてよい。
Therefore, in the example shown in FIG. 3, even if the inner
いずれにせよ、本実施形態では、はんだ付けされるエミッタ電極2の構成を工夫し、はんだ部材60の根元部が保護膜12により拘束されない形状とすることで、はんだ部材60と保護膜12とが接触しないようにしている。
In any case, in this embodiment, the structure of the emitter electrode 2 to be soldered is devised so that the root portion of the
その結果、本実施形態では、はんだ部材60に応力が加わり、はんだ部材60の変形が生じ、はんだ部材60金属電極13との密着性に悪影響を及ぼすという問題を防止することができる。
As a result, in the present embodiment, it is possible to prevent the problem that stress is applied to the
また、本実施形態では、金属電極13は、鉛フリーはんだからなるはんだ60を用いてはんだ付けされたものとしている。
In the present embodiment, the
鉛を含有しない鉛フリーはんだは、環境に優しいが、従来用いられてきた鉛入りのはんだに比べて硬い。そのため、金属電極に加わる応力も大きくなり、従来の半導体装置ではAl電極と金属電極との剥離が生じやすい。本実施形態では、そのような鉛フリーはんだを用いた本半導体装置S1において、上記したような密着性向上の効果が有効に発揮される。 Lead-free solders that do not contain lead are environmentally friendly, but are harder than conventional lead-containing solders. For this reason, the stress applied to the metal electrode also increases, and in the conventional semiconductor device, the Al electrode and the metal electrode are easily separated. In the present embodiment, the effect of improving the adhesion as described above is effectively exhibited in the semiconductor device S1 using such lead-free solder.
また、本実施形態では、金属電極13は鉛フリーはんだを介して金属製のヒートシンク20と接合されている。
In the present embodiment, the
上述したように、本発明者らの検討によれば、金属電極の上にヒートシンクをはんだ付けする場合、半導体基板を構成するSiとヒートシンクを構成するCu等の金属との線膨張係数の差により、高い応力が界面に発生するため、Al電極と金属電極との剥離の問題が顕著になる。 As described above, according to the study by the present inventors, when soldering a heat sink on a metal electrode, due to the difference in linear expansion coefficient between Si constituting the semiconductor substrate and a metal such as Cu constituting the heat sink. Since a high stress is generated at the interface, the problem of peeling between the Al electrode and the metal electrode becomes significant.
本実施形態では、そのようなヒートシンク20とはんだ付けされた半導体装置S1に対して、上記した密着性向上の効果が有効に発揮される。
In the present embodiment, the above-described effect of improving the adhesion is effectively exhibited with respect to the semiconductor device S1 soldered to the
また、本実施形態では、半導体基板1の厚さが250μm以下であることが好ましい。これは、半導体基板1をこの程度に薄くすることにより、応力緩和が可能となり、より高い信頼性が得られるためである。
In the present embodiment, the thickness of the
なお、本発明は、上記した両面はんだ付けモールド構造の半導体装置に限定されるものではなく、半導体基板の一面上にAl電極を形成し、該Al電極の上に保護膜を形成し、該Al電極の一部が該保護膜上に臨むように該保護膜に開口部を形成した後、該開口部から臨む該Al電極の表面上にはんだ付け用の金属電極を形成し、該金属電極にはんだからなるはんだ部材を接合してなる半導体装置ならば、適用可能である。 The present invention is not limited to the above-described semiconductor device having a double-sided soldering mold structure, but an Al electrode is formed on one surface of a semiconductor substrate, a protective film is formed on the Al electrode, and the Al After forming an opening in the protective film so that a part of the electrode faces the protective film, a metal electrode for soldering is formed on the surface of the Al electrode facing the opening, and the metal electrode Any semiconductor device formed by joining solder members made of solder can be applied.
1…半導体基板、11…Al電極、12…保護膜、12a…開口部、
13…金属電極、13a…ニッケルメッキ層、13b…金メッキ層、
20…ヒートシンク、60…はんだ部材、θ1…はんだ接触角、
θ2…はんだ接触角の補角、θ3…テーパ角度。
DESCRIPTION OF
13 ... Metal electrode, 13a ... Nickel plating layer, 13b ... Gold plating layer,
20 ... heat sink, 60 ... solder member, θ1 ... solder contact angle,
θ2: Complement angle of solder contact angle, θ3: Taper angle.
Claims (7)
前記保護膜の前記開口部における内周端面(12b)が、はんだリフロー後の前記はんだ部材の形状におけるはんだ接触角(θ1)の補角(θ2)よりも小さいテーパ角度(θ3)を有するテーパ形状となっており、
前記金属電極は前記保護膜よりも薄いものであり、前記金属電極の上面は前記開口部の中に位置していることを特徴とする半導体装置。 An aluminum electrode (11) made of aluminum is formed on one surface of the semiconductor substrate (1), a protective film (12) is formed on the aluminum electrode, and a part of the aluminum electrode faces the protective film. After forming an opening (12a) in the protective film, a metal electrode (13) for soldering is formed on the surface of the aluminum electrode facing the opening, and a solder member made of solder on the metal electrode ( 60) in a semiconductor device formed by bonding,
An inner peripheral end surface (12b) in the opening of the protective film has a tapered shape (θ3) having a smaller taper angle (θ3) than a complementary angle (θ2) of the solder contact angle (θ1) in the shape of the solder member after solder reflow. And
2. The semiconductor device according to claim 1, wherein the metal electrode is thinner than the protective film, and an upper surface of the metal electrode is located in the opening.
前記金属電極は前記保護膜よりも厚いものであり、前記金属電極の上面は前記開口部の上方に位置していることを特徴とする半導体装置。 An aluminum electrode (11) made of aluminum is formed on one surface of the semiconductor substrate (1), a protective film (12) is formed on the aluminum electrode, and a part of the aluminum electrode faces the protective film. After forming an opening (12a) in the protective film, a metal electrode for soldering is formed on the surface of the aluminum electrode facing the opening, and a solder member (60) made of solder is formed on the metal electrode. In a semiconductor device formed by bonding,
The semiconductor device, wherein the metal electrode is thicker than the protective film, and an upper surface of the metal electrode is located above the opening.
The semiconductor device according to claim 1, wherein the protective film is made of a polyimide resin.
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Application Number | Priority Date | Filing Date | Title |
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- 2003-07-14 JP JP2003273932A patent/JP2005039029A/en active Pending
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