JP2004104027A - Mram memory cell and method for accelerating inversion of spontaneous magnetization - Google Patents
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- 230000005415 magnetization Effects 0.000 title claims abstract description 71
- 230000002269 spontaneous effect Effects 0.000 title claims abstract description 67
- 238000000034 method Methods 0.000 title description 7
- 230000005294 ferromagnetic effect Effects 0.000 claims abstract description 162
- 239000000758 substrate Substances 0.000 claims abstract description 38
- 239000010410 layer Substances 0.000 claims description 182
- 230000005291 magnetic effect Effects 0.000 claims description 38
- 239000011229 interlayer Substances 0.000 claims description 17
- 230000002441 reversible effect Effects 0.000 claims description 16
- 239000000696 magnetic material Substances 0.000 claims description 3
- 230000000694 effects Effects 0.000 description 5
- 239000012141 concentrate Substances 0.000 description 4
- 230000003993 interaction Effects 0.000 description 4
- 238000013459 approach Methods 0.000 description 3
- 239000004020 conductor Substances 0.000 description 3
- 238000013500 data storage Methods 0.000 description 3
- 230000007423 decrease Effects 0.000 description 3
- 230000007246 mechanism Effects 0.000 description 2
- 230000004048 modification Effects 0.000 description 2
- 238000012986 modification Methods 0.000 description 2
- 229910052755 nonmetal Inorganic materials 0.000 description 2
- 230000009467 reduction Effects 0.000 description 2
- 229910018072 Al 2 O 3 Inorganic materials 0.000 description 1
- PNEYBMLMFCGWSK-UHFFFAOYSA-N aluminium oxide Inorganic materials [O-2].[O-2].[O-2].[Al+3].[Al+3] PNEYBMLMFCGWSK-UHFFFAOYSA-N 0.000 description 1
- 230000008859 change Effects 0.000 description 1
- 239000003302 ferromagnetic material Substances 0.000 description 1
- 238000004519 manufacturing process Methods 0.000 description 1
- 230000000149 penetrating effect Effects 0.000 description 1
- 229910000889 permalloy Inorganic materials 0.000 description 1
- 230000035699 permeability Effects 0.000 description 1
- 230000001737 promoting effect Effects 0.000 description 1
- 238000004088 simulation Methods 0.000 description 1
- 125000006850 spacer group Chemical group 0.000 description 1
- 239000000126 substance Substances 0.000 description 1
- 230000001629 suppression Effects 0.000 description 1
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- Semiconductor Memories (AREA)
- Hall/Mr Elements (AREA)
- Mram Or Spin Memory Techniques (AREA)
Abstract
Description
【0001】
【発明の属する技術分野】
本発明は,磁気ランダムアクセスメモリ(Magnetic Random Access Memory:以下、「MRAM」という。)のメモリセルに関する。本発明は,特に,MRAMのメモリセルにデータを書き込むのに必要な書き込み電流の大きさを低減する技術に関する。
【0002】
【従来の技術】
MRAMは,高速書き込みが可能であり,且つ,大きな書き換え回数を有する不揮発性メモリとして注目を集めている。典型的なMRAMのメモリセルは,図9に示されているように,固定された自発磁化を有する固定強磁性層101と,反転可能な自発磁化を有する自由強磁性層102と,固定強磁性層101と自由強磁性層102との間に介設された非磁性のスペーサ層103とにより構成される磁気抵抗素子104を含む。自由強磁性層102は,その自発磁化の向きが,固定強磁性層層101の自発磁化の向きと平行,又は反平行に向くことが許されるように,反転可能に形成される。
【0003】
メモリセルは,1ビットのデータを,自由強磁性層102の自発磁化の方向として記憶する。メモリセルは,自由強磁性層102の自発磁化と固定強磁性層101の自発磁化とが平行である”平行”状態と,自由強磁性層102の自発磁化と固定強磁性層101の自発磁化とが反平行である”反平行”状態の2つの状態を取り得る。メモリセルは,”平行”状態と,”反平行”状態とのうちの一方を”0”に,他方を”1”に対応付けることにより,1ビットのデータを記憶する。
【0004】
メモリセルからのデータの読み出しは,磁気抵抗効果によるメモリセルの抵抗の変化を検知することによって行われる。固定強磁性層101及び自由強磁性層102の自発磁化の方向は,メモリセルの抵抗に影響を及ぼす。固定強磁性層101と自由強磁性層102との自発磁化の向きが平行である場合には,メモリセルの抵抗は,第1値Rとなり,反平行である場合には,メモリセルの抵抗は,第2値R+ΔRになる。固定強磁性層101及び自由強磁性層102の自発磁化の方向,即ち,メモリセルに記憶されているデータは,メモリセルの抵抗を検知することにより判別することができる。
【0005】
メモリセルへのデータの書き込みは,メモリセルアレイに配設されるワード線及びビット線に書き込み電流を流し,該書き込み電流により生じる磁場によって自由強磁性層102の自発磁化の方向を反転させることによって行われる。
【0006】
データの書き込みに必要な書き込み電流の低減は,MRAMの消費電力の低減の観点から重要である。書き込み電流を低減するための構造を有するMRAMが,特許文献1に開示されている。特許文献1に開示されたMRAMでは,書き込み電流が流される信号線に高飽和磁化ソフト磁性材料,又は金属−非金属ナノグラニュラ膜が接合されている。高飽和磁化ソフト磁性材料,及び金属−非金属ナノグラニュラ膜は,磁場を磁気抵抗素子に集中させる。このため,より小さな書き込み電流でデータの書き込みを行うことが可能になる。
【0007】
書き込み電流を低減するための構造を有する他のMRAMが,特許文献2に開示されている。特許文献2に開示されたMRAMでは,書き込み電流が流される配線としてコイルが使用され,磁気抵抗素子は,該コイルの中に挿入されている。磁気抵抗素子に印加される磁場は,該コイルのターン数に比例するため,より小さな書き込み電流でデータの書き込みを行うことが可能になる。
【0008】
書き込み電流を低減するための構造を有する更に他のMRAMが,米国特許公報である特許文献3と,その日本出願である特許文献4とに開示されている。特許文献3に開示されたMRAMでは,書き込み電流が流される導体の幅が,データ記憶層の幅よりも狭くされている。書き込み電流が流される導体の幅を小さくすることで,導体とデータ記憶層との間のミスアライメントが排除され,書き込み電流によって生成される磁場の漏れが低減され,従って,より小さな書き込み電流でデータの書き込みを行うことが可能になる。
【0009】
【特許文献1】
特開2002−110938号公報(図4)
【特許文献2】
米国特許第5,742,016号公報
【特許文献3】
米国特許第6,236,590号公報
【特許文献4】
特開2002−118239号公報
【0010】
【発明が解決しようとする課題】
本発明の目的は,MRAMメモリセルへのデータの書き込みを,より小さな書き込み電流で行うことを可能にするための他の技術を提供することにある。
【0011】
【課題を解決するための手段】
以下に,[発明の実施の形態]で使用される番号・符号を用いて,目的を達成するための手段を説明する。これらの番号・符号は,[特許請求の範囲]の記載と[発明の実施の形態]の記載との対応関係を明らかにするために付加されている。但し,付加された番号・符号は,[特許請求の範囲]に記載されている発明の技術的範囲の解釈に用いてはならない。
【0012】
本発明によるMRAMメモリセルは,基板(1)と,基板(1)の主面(1a)側に設けられ,反転可能な自発磁化を有する自由強磁性層(9)と,基板(1)と実質的に平行な第1方向(y軸方向)に延設され,前記自発磁化の反転に使用される第1書き込み電流が流される第1配線(12)とを備えている。自由強磁性層(9)は,第1方向(y軸方向)に実質的に平行で,且つ,基板(1)に実質的に垂直な第1対称面(9c)に対して実質的に鏡面対称である。第1配線(12)の第1中心線(12a)は,積極的に,第1対称面(9c)の上に位置しないように配置されている。
【0013】
第1書き込み電流が流される第1配線(12)は,中心線(12a)の近傍において最も大きな書き込み磁場を発生する。第1配線(12)の第1中心線(12a)を,自由強磁性層(9)の第1対称面(9c)からずらして配置することにより,最も大きな書き込み磁場が発生される位置である第1配線(12)の第1中心線(12a)が,自由強磁性層(9)の外縁部に近づく。第1中心線(12a)が,自由強磁性層(9)の外縁部に近づくと,自由強磁性層(9)の外縁部のドメインを反転させるために必要な書き込み電流が小さくなる。自由強磁性層(9)の外縁部のドメインを反転させると,ドメインの反転が自由強磁性層(9)の外縁部から中心部に伝搬し,自由強磁性層(9)の自発磁化は完全に反転する。ゆえに,第1配線(12)の第1中心線(12a)を,自由強磁性層(9)の第1対称面(9c)からずらして配置することにより,自由強磁性層(9)の自発磁化を反転するのに必要な書き込み電流を小さくすることができる。
【0014】
第1配線(12)の第1中心線(12a)と第1対称面(9c)との距離をd,第1対称面(9c)に垂直な第2方向における自由強磁性層(9)の長さをLとし,オフセット量pを
p=d/L,
で定義したとき,オフセット量pは,0.1以上0.5以下であることが好適である。このような条件を満足する配線(12)の配置は,自由強磁性層(9)の自発磁化を反転するのに必要な書き込み電流を小さくする。
【0015】
第1配線(12)は,基板(1)に垂直な方向からみたとき,第1対称面(9c)に垂直な第2方向(x軸方向)における自由強磁性層(9)の端から第2方向(x軸方向)にはみ出して自由強磁性層(9)に重ならない部分を有していることが好ましい。このような構造は,第1配線(12)の中心線(12a)を自由強磁性層(9)の外縁部に一層に近づけ,自由強磁性層(9)の自発磁化を反転するのに必要な書き込み電流を一層に小さくする。
【0016】
第1対称面(9c)に垂直な第2方向(x軸方向)における第1配線(12)の幅(W)は,自由強磁性層(9)の第2方向(x軸方向)における長さ(L)よりも狭いことが好ましい。このような構造は,第1配線(12)が発生する磁場を,自由強磁性層(9)の外縁部に集中させ,自由強磁性層(9)の自発磁化を反転するのに必要な書き込み電流を一層に小さくする。
【0017】
第1配線(12)の幅(W)は,自由強磁性層(9)の長さ(L)の0.3倍以上0.7倍以下であることが好適である。
【0018】
自由強磁性層(9)の自発磁化の方向は,第2方向(x軸方向)に平行であることがある。
【0019】
当該MRAMメモリセルは,第1配線(12)に接合され,磁性体で形成された磁性体層(13)を備えることが好適である。
【0020】
当該MRAMメモリセルが,更に,第2方向(x軸方向)に延設され,前記自発磁化の反転に使用される第2書き込み電流が流される第2配線(3)を備え,且つ,自由強磁性層(9)が,第2方向(x軸方向)に実質的に平行で,且つ,基板(1)に実質的に垂直な第2対称面(9d)に対して実質的に鏡面対称である場合,第2配線(3)の第2中心線(3a)は,積極的に,第2対称面(9d)の上に位置しないように配置されていることが好適である。このような構造は,第2配線(3)が発生する磁場を,自由強磁性層(9)の外縁部に集中させ,自由強磁性層(9)の自発磁化を反転するのに必要な書き込み電流を一層に小さくする。
【0021】
本発明によるMRAMメモリセルは,反転可能な自発磁化を有する自由強磁性層(9)を含み,前記自発磁化の方向に応じて抵抗が変化する磁気抵抗素子(6)と,第1方向(y軸方向)に延設され,磁気抵抗素子(6)に電気的に接続される第1配線(15)と,第1方向(y軸方向)に延設され,磁気抵抗素子(6)から電気的に絶縁され,且つ,前記自発磁化を反転させる書き込み電流が流される第2配線(16)とを備えている。自由強磁性層(9)は,第1方向(y軸方向)に実質的に平行で,且つ,基板(1)に実質的に垂直な第1対称面(9c)に対して実質的に鏡面対称である。第2配線(16)の中心線(16a)は,積極的に,第1対称面(9c)の上に位置しないように配置されている。第2配線(16)の中心線(16a)が積極的に,第1対称面(9c)の上に位置しないように配置することにより,データの書き込みに必要な書き込み電流の大きさを小さくすることができる。更に,第2配線(16)の中心線(16a)を第1対称面(9c)からずらして配置することにより,磁気抵抗素子(6)の上方(又は下方)には,第1配線(15)を形成するための空間が生まれ,第1配線(15)と第2配線(16)とを一の配線層により形成することが可能になる。即ち,かかる配置により,第1配線(12)と第2配線(16)との両方を磁気抵抗素子(6)を被覆する一の層間絶縁膜(10)の上に形成することが可能になる。
【0022】
本発明によるMRAMメモリセルは,基板(1)と,基板(1)の主面(1a)側に設けられ,反転可能な自発磁化を有する自由強磁性層(9)と,基板(1)と実質的に平行な第1方向(y軸方向)に延設され,自発磁化の反転に使用される第1書き込み電流が流される第1配線(12)とを備えている。自由強磁性層(9)は,第1方向(y軸方向)に実質的に平行で,且つ,基板(1)に実質的に垂直な第1対称面(9c)に対して実質的に鏡面対称である。第1書き込み電流が発生する磁場が最も強くなる位置は,積極的に,第1対称面(9c)の上に位置しないように配置されている。このような構造は,最も大きな書き込み磁場が発生される位置を,自由強磁性層(9)の外縁部に近づけ,自由強磁性層(9)の自発磁化を反転するのに必要な書き込み電流を小さくする。
【0023】
本発明による自発磁化反転促進方法は,基板(1)の主面(1a)に実質的に垂直な第1対称面(9c)に対して実質的に鏡面対称であるように,反転可能な自発磁化を有する自由強磁性層(9)を設けることと,
前記自発磁化の反転に使用される書き込み電流が流される配線(12)を,前記基板(1)と実質的に平行な第1方向(y軸方向)に延伸するように設けることと,
配線(12)の中心線(12a)を,積極的に,第1対称面(9c)の上に位置しないように配置すること
とを備えている。当該自発磁化反転促進方法は,最も大きな書き込み磁場が発生される位置である配線(12)の中心線(12a)を,自由強磁性層(9)の外縁部に近づける。これにより,自由強磁性層(9)の外縁部のドメインの反転に必要な書き込み電流の大きさは小さくなる。自由強磁性層(9)の外縁部のドメインが反転すると,ドメインの反転は,自由強磁性層(9)の中心部に伝搬するから,自由強磁性層(9)の自発磁化が完全に反転する。ゆえに,配線(12)の中心線(12a)を,自由強磁性層(9)の外縁部に近づけることにより,自由強磁性層(9)の自発磁化の反転に必要な電流の大きさを低減できる。
【0024】
【発明の実施の形態】
以下,添付図面を参照しながら,本発明による磁気メモリ用メモリセルの実施の形態を説明する。
【0025】
(実施の第1形態)
図1は,本発明による磁気メモリ用メモリセルの実施の第1形態を示す。実施の第1形態では,基板1の主面1a側に層間絶縁膜2が形成されている。ワード線3が,層間絶縁膜2の上に形成されている。ワード線3は,基板1の主面1aに実質的に平行なx軸方向に延伸するように設けられている。ワード線3は,層間絶縁膜4で被覆されている。層間絶縁膜4には,層間絶縁膜4を貫通してワード線3に到達する導電性のコンタクト5が形成されている。層間絶縁膜4の上には,磁気抵抗素子6が形成されている。
【0026】
磁気抵抗素子6は,固定強磁性層7とトンネル絶縁層8と自由強磁性層9とを含む。固定強磁性層7は,コンタクト5を介してワード線3に電気的に接続されている。固定強磁性層7は,x軸方向に固定された自発磁化を有し,自由強磁性層9は,x軸方向に平行に自在に反転可能な自発磁化を有している。自由強磁性層9の自発磁化は,固定強磁性層7の自発磁化と同一の向きを向く”平行”状態と,逆の向きを向く”反平行”状態とをとることを許されている。実施の第1形態のメモリセルは,自由強磁性層9の自発磁化の向きとしてデータを記憶する。トンネル絶縁層8は,アルミナ(Al2O3)のような絶縁体で形成され,トンネル絶縁層8の厚さは,厚さ方向にトンネル電流が流れる程度に薄い。トンネル絶縁層8の厚さ方向の抵抗(即ち,磁気抵抗素子6の抵抗)は,自由強磁性層9の自発磁化の向きに応じて変化し,磁気抵抗素子6の抵抗の変化によって,磁気抵抗素子6に記憶されているデータは判別可能である。
【0027】
図2に示されているように,磁気抵抗素子6の自由強磁性層9は,基板1の主面1aに垂直な方向からみたとき,実質的に楕円形を有している。楕円形を有する自由強磁性層9は,x軸方向に長軸9aを有し,基板1の主面1aに実質的に平行で,且つ,x軸方向に実質的に垂直なy軸方向に短軸9bを有する。自由強磁性層9の自発磁化は,長軸9aに平行な方向を向いている。このような形状を有する自由強磁性層9は,基板1の主面1aに垂直で,且つ,短軸9bがその上にある対称面9cに対して実質的に鏡面対称である。「実質的に」とは,製造バラツキなどによって発生する微細な非対称性は考慮しないということを意味している。
【0028】
図1に示されているように,磁気抵抗素子6は,層間絶縁膜10によって被覆されている。層間絶縁膜10には,自由強磁性層9に到達する導電性のコンタクト11が形成されている。層間絶縁膜10の上には,ビット線12が形成されている。ビット線12は,y軸方向に延設されている。
【0029】
図2に示されているように,ビット線12の中心線12aは,自由強磁性層9の対称面9cからx軸方向にずれて配置されている。更にビット線12は,基板1の主面1aに垂直な方向からみたとき,自由強磁性層9の長軸9aの一端からx軸方向にはみ出し,自由強磁性層9に重ならない部分を有している。更に,x軸方向のビット線12の幅Wは,自由強磁性層9の長軸9aの長さ(即ち,x軸方向における自由強磁性層9の長さ)よりも狭い。
【0030】
当該メモリセルに対してデータの書き込みが行われる場合,ワード線3には,x軸方向に書き込み電流が流され,ビット線12には,書き込まれるべきデータに応じてy軸方向に書き込み電流が流される。ワード線3に流された書き込み電流は,自由強磁性層9にy軸方向に磁場を印加する。y軸方向に磁場が印加されることにより,自由強磁性層9の抗磁場は小さくなり,自由強磁性層9の反転が容易化される。この状態でビット線12に書き込み電流が流されると,該書き込み電流は,x軸方向に磁場を発生し,自由強磁性層9の自発磁化を,書き込まれるべきデータに応じた方向に反転する。
【0031】
上述されたビット線12の配置は,より小さな書き込み電流で,データの書き込みを行うことを可能にする。図3及び図4は,書き込み電流の抑制の効果を示している。図3は,データを書き込むためにビット線12に流すことが要求される書き込み電流の大きさの,ビット線12の中心線12aと自由強磁性層9の対称面9cとのオフセット量pに対する依存性を示している。オフセット量pは,ビット線12の中心線12aと,対称面9cとの距離をdとして,
p=d/L,
と定義されている。p=0は,ビット線12の中心線12aと,自由強磁性層9の対称面9cとが重なっている場合であり,相対位置pが大きいほど,ビット線12の中心線12aは,自由強磁性層9の対称面9cから大きくオフセットしている。図3のグラフは,ビット線12の幅Wは,自由強磁性層9の長さLの半分であるという条件で行われたシミュレーションによって得られている。
【0032】
図3に示されているように,ビット線12の中心線12aが自由強磁性層9の対称面9cに位置的に整合する(即ち,pが0である)よりも,ビット線12の中心線12aが自由強磁性層9の対称面9cからオフセットしている方が,より小さい書き込み電流でデータを書き込むことが可能である。オフセット量pが0.375の近傍であるとき,必要な書き込み電流の大きさは最小になる。この理由は,以下のように推定される。
【0033】
自由強磁性層9に含まれるドメインには,隣接するドメインの磁化方向を揃えようとする交換相互作用が働いている。この交換相互作用に起因して,自由強磁性層9の自発磁化の反転は,自由強磁性層9の外縁部のドメインから開始され,その後中心部のドメインに伝搬する振る舞いを示す。自由強磁性層9の中心部のドメインは,その周囲に存在する全てのドメインから交換相互作用をうけ,その反転を妨げられる。一方,自由強磁性層9の外縁部のドメインは,ドメインに隣接していない領域を有しているため,周囲のドメインから受ける交換相互作用が小さく,比較的に小さな磁場によって反転する。外縁部のドメインが反転すると,そのドメインに隣接するドメインの反転も容易化されて反転する。このように,ドメインの反転は自由強磁性層9の外縁部から開始され,中心部に伝搬する。
【0034】
ビット線12の中心線12aを自由強磁性層9の対称面9cからオフセットさせることにより,ビット線12が発生する磁場が最大となる位置は,自由強磁性層9の外縁部に近づき,より小さな書き込み電流で自由強磁性層9の外縁部にあるドメインの反転を発生させることが可能になる。自由強磁性層9の外縁部にあるドメインを反転させれば,ドメインの反転は外縁部から中心部に伝搬し,自由強磁性層9の自発磁化が完全に反転する。ゆえに,ビット線12の中心線12aを自由強磁性層9の対称面9cからオフセットさせ,ビット線12の中心線12aを自由強磁性層9の外縁部に近づけることにより,自由強磁性層9の自発磁化をより少ない書き込み電流で反転することができる。
【0035】
但し,オフセット量pがあまりにも大きくなると,自由強磁性層9に鎖交する磁場が小さくなり,逆に書き込み電流が増大する。このため,オフセット量pは,0.1以上0.5以下であることが好ましい。
【0036】
基板1の主面1aに垂直な方向からみたときに自由強磁性層9の長軸9aの一端からx軸方向にはみ出し,自由強磁性層9に重ならない部分を有するようなビット線12の配置は,一層に少ない書き込み電流で自由強磁性層9の自発磁化を反転可能にする点で好適である。ビット線12が自由強磁性層9に対してx軸方向にはみ出すビット線12の配置は,ビット線12が発生する磁場が最大となる位置を,一層に自由強磁性層9の外縁部に近づける。従って,自由強磁性層9の外縁部のドメインの反転に必要な書き込み電流が小さくなり,結果として自由強磁性層9の自発磁化の反転に必要な書き込み電流の大きさも小さくなる。
【0037】
従来の技術に記載された特許文献3(米国特許第6,236,590号公報)及び特許文献4(特開2002−118239号公報)には,データの書き込み電流が流される配線と,データ記憶層(本実施の形態の自由強磁性層9に相当)との間のミスアラインメントは,磁場の漏れを発生させ,書き込み電流を増大させると開示されている。しかし,この考察は,強磁性体の自発磁化の反転のメカニズムの詳細な検討を欠いており,該考察は誤りである。
【0038】
x軸方向におけるビット線12の幅Wが,x軸方向における自由強磁性層9の長さLよりも狭いことは,一層に少ない書き込み電流で自由強磁性層9の自発磁化を反転可能にする点で好適である。図4は,データを書き込むためにビット線12に流すことが要求される書き込み電流の大きさの,W/Lに対する依存性を示している。図4の曲線Aに示されているように,ビット線12の中心線12aが自由強磁性層9の短軸9bに対してオフセットしていない場合には,ビット線12の幅Wが狭くなることによる書き込み電流の減少の効果は大きくない。一方,図4の曲線Bに示されているように,ビット線12の中心線12aが自由強磁性層9の対称面9cに対してオフセットしている場合には,ビット線12の幅Wが減少すると,書き込み電流を顕著に減少することが可能である。
【0039】
この効果は,ビット線12の幅Wが狭くなると,ビット線12が発生する磁場が自由強磁性層9の外縁部のドメインに集中することに起因すると考えられる。ビット線12が発生する磁場が自由強磁性層9の外縁部のドメインに集中することにより,自由強磁性層9の外縁部のドメインの反転に必要な書き込み電流が小さくなる。その結果,自由強磁性層9の自発磁化の反転に必要な書き込み電流の大きさも小さくなると考えられる。
【0040】
但し,ビット線12の幅Wがあまりにも小さいことは,エレクトロマイグレーションに対する耐性を劣化させるため好ましくない。このような観点から,ビット線12の幅Wは,自由強磁性層9の長さLの0.3倍以上,0.7倍以下であることが好適である。
【0041】
以上に説明されているように,本実施の形態のMRAMメモリセルでは,ビット線12の中心線12aは,自由強磁性層9の対称面9cに対してx軸方向にずれて配置されている。更に,ビット線12は,自由強磁性層9の長軸9aの一端からx軸方向にはみ出し,自由強磁性層9に重ならない部分を有している。更に,x軸方向のビット線12の幅Wは,自由強磁性層9の長軸9aの長さ(即ち,x軸方向における自由強磁性層9の長さ)よりも狭い。このようなビット線12の配置により,データの書き込みの時にビット線12に流すことが必要な書き込み電流の大きさが抑制されている。
【0042】
本実施の形態において,ビット線12と同様の手法を採用することにより,ワード線3の書き込み電流の抑制が可能である。図5に示されているように,自由強磁性層9は,基板1の主面1aに垂直で,且つ,長軸9aがその上にある対称面9dに対して実質的に鏡面対称であるが,ワード線3の中心線3aを,自由強磁性層9の対称面9dからy軸方向にオフセットして配置することにより,ワード線3の書き込み電流を抑制することが可能である。このようなワード線3の配置は,上述のビット線12による書き込み電流の抑制と同様のメカニズムにより,データの書き込みの時にワード線3に流すことが必要な書き込み電流の大きさを小さくする。このとき,ワード線3が,自由強磁性層9の短軸9bの一端からy軸方向にはみ出し,自由強磁性層9に重ならない部分を有していることは,データの書き込みのためにワード線3に流すことが必要な書き込み電流の大きさを一層に小さくする点で好適である。更に,y軸方向のワード線3の幅W’が,自由強磁性層9の短軸9bの長さ(即ち,y軸方向における自由強磁性層9の幅)L’よりも狭いことは,データの書き込みのためにワード線3に流すことが必要な書き込み電流の大きさを一層に小さくする点で好適である。
【0043】
更に図6に示されているように,ビット線12の上面及び側面に透磁率が高い磁性体層13が形成されることが好適である。磁性体層13は,典型的には,パーマロイで形成される。このような構造は,ビット線12によって発生される磁場を自由強磁性層9に集中し,データの書き込みの時にワード線3に流すことが必要な書き込み電流の大きさを一層に小さくする。
【0044】
(実施の第2形態)
図7は,本発明によるMRAMメモリセルの実施の第2形態を示す。実施の第2形態では,データの読み出しに使用される読み出しビット線15とは別に,データの書き込みに使用される書き込みビット線16がメモリセルに設けられる。読み出しビット線15と書き込みビット線16とは,いずれも,層間絶縁膜10の上に形成される。読み出しビット線15は,層間絶縁膜10を貫通して自由強磁性層9に到達するコンタクト14によって,磁気抵抗素子6の自由強磁性層9に電気的に接続されている。書き込みビット線16は,磁気抵抗素子6から電気的に絶縁されている。
【0045】
更に,実施の第2形態では,コンタクト5が除去され,ワード線3と固定強磁性層7とは,電気的に絶縁される。固定強磁性層7は,x軸方向に延設され,固定強磁性層7が読み出しワード線に兼用される。ワード線3は,データの書き込みに専用に使用される。
【0046】
当該メモリセルからデータが読み出される場合,読み出しワード線として使用される固定強磁性層7と,読み出しビット線15との間に所定の電圧が印加される。磁気抵抗素子6の抵抗値は,自由強磁性層9の自発磁化の向き,即ち,当該メモリセルに記憶されているデータに応じて変化するから,磁気抵抗素子6を流れる電流は,当該メモリセルに記憶されているデータに応じて変化する。磁気抵抗素子6を流れる電流から,当該メモリセルに記憶されているデータが判別される。
【0047】
当該メモリセルに対してデータの書き込みが行われる場合,ワード線3には,x軸方向に書き込み電流が流され,書き込みビット線16には,書き込まれるべきデータに応じてy軸方向に書き込み電流が流される。ワード線3に流された書き込み電流は,自由強磁性層9にy軸方向に磁場を印加する。y軸方向に磁場が印加されることにより,自由強磁性層9の抗磁場は小さくなり,自由強磁性層9の反転が容易化される。書き込みビット線16に流される書き込み電流は,x軸方向に磁場を発生し,自由強磁性層9の自発磁化を,書き込まれるべきデータに応じた方向に反転する。
【0048】
書き込みビット線16が読み出しビット線15と電気的に絶縁されて設けられ,ワード線3が読み出しワード線として機能する固定強磁性層7と電気的に絶縁されて設けられていることは,データの読み出しと書き込みとを同時的に行うことが可能である点で好適である。更に,かかる構成は,読み出しビット線15を選択するセレクタ(図示されない)と書き込みビット線16を選択するセレクタとを別に設けることが可能であり,書き込みワード線を選択するセレクタと,読み出しワード線を選択するセレクタとを別に設けることができ,これらのセレクタに含まれる回路を簡略化できる点でも好適である。
【0049】
実施の第1形態のビット線12と同様に,書き込みビット線16の中心線16aは,自由強磁性層9の対称面9cに対してx軸方向にオフセットして配置されている。書き込みビット線16は,基板1の主面1aに垂直な方向からみたとき,自由強磁性層9の長軸9aの一端からx軸方向にはみ出し,自由強磁性層9に重ならない部分を有している。更に,x軸方向の書き込みビット線16の幅Wは,自由強磁性層9の長軸9aの長さ(即ち,x軸方向における自由実施の第1形態のビット線12と同様に,強磁性層9の長さ)よりも狭い。このような書き込みビット線16の配置は,実施の第1形態のビット線11と同様に,一層に少ない書き込み電流でデータの書き込みを行うことを可能にする。
【0050】
書き込みビット線16の中心線16aが,自由強磁性層9の対称面9cに対してx軸方向にオフセットして配置されていることは,読み出しビット線15と書き込みビット線16との両方を層間絶縁膜10の上に形成する,即ち,一の配線層によって読み出しビット線15と書き込みビット線16とを形成可能にする点で好適である。書き込みビット線16の中心線16aが,自由強磁性層9の対称面9cに対してx軸方向にオフセットして配置されていることにより,層間絶縁膜10の上には,磁気抵抗素子6の上方に書き込みビット線15を配置する空間が生まれる。この空間に書き込みビット線15を配置することにより,読み出しビット線15と書き込みビット線16とは,一の配線層によって形成可能である。読み出しビット線15と書き込みビット線16とが,一の配線層によって形成されることは,工数の削減の点で好ましい。
【0051】
【発明の効果】
本発明により,MRAMメモリセルへのデータの書き込みを,より小さな書き込み電流で行うことを可能にする技術が提供される。
【図面の簡単な説明】
【図1】図1は,本発明によるMRAMメモリセルの実施の第1形態を示す断面図である。
【図2】図2は,本発明によるMRAMメモリセルの実施の第1形態を示す平面図である。
【図3】図3は,ビット線12に流す必要がある書き込み電流の大きさの,オフセット量pに対する依存性を示している。
【図4】図4は,ビット線12に流す必要がある書き込み電流の大きさの,ビット線12の幅Wに対する依存性を示している。
【図5】図5は,本発明によるMRAMメモリセルの実施の第1形態の変形例を示す平面図である。
【図6】図6は,本発明によるMRAMメモリセルの実施の第1形態の他の変形例を示す断面図である。
【図7】図7は,本発明によるMRAMメモリセルの実施の第2形態を示す断面図である。
【図8】図8は,本発明によるMRAMメモリセルの実施の第2形態を示す平面図である。
【図9】図9は,従来のMRAMを示す。
【符号の説明】
1:基板
2:層間絶縁膜
3:ワード線
4:層間絶縁膜
5:コンタクト
6:磁気抵抗素子
7:固定強磁性層
8:トンネル絶縁層
9:自由強磁性層
10:層間絶縁膜
11:コンタクト
12:ビット線
13:磁性体層
14:コンタクト
15:読み出しビット線
16:書き込みビット線[0001]
TECHNICAL FIELD OF THE INVENTION
The present invention relates to a memory cell of a magnetic random access memory (MRAM). The present invention particularly relates to a technique for reducing the magnitude of a write current required for writing data to a memory cell of an MRAM.
[0002]
[Prior art]
MRAM has attracted attention as a non-volatile memory capable of high-speed writing and having a large number of rewrites. A typical MRAM memory cell includes a fixed
[0003]
The memory cell stores 1-bit data as the direction of spontaneous magnetization of the free
[0004]
Reading data from a memory cell is performed by detecting a change in resistance of the memory cell due to the magnetoresistance effect. The direction of the spontaneous magnetization of the fixed
[0005]
Data is written to a memory cell by applying a write current to a word line and a bit line provided in a memory cell array and inverting the direction of spontaneous magnetization of the free
[0006]
Reduction of the write current required for writing data is important from the viewpoint of reducing the power consumption of the MRAM.
[0007]
Another MRAM having a structure for reducing a write current is disclosed in
[0008]
Still another MRAM having a structure for reducing a write current is disclosed in U.S. Pat. In the MRAM disclosed in
[0009]
[Patent Document 1]
JP-A-2002-110938 (FIG. 4)
[Patent Document 2]
U.S. Pat. No. 5,742,016
[Patent Document 3]
US Patent No. 6,236,590
[Patent Document 4]
JP-A-2002-118239
[0010]
[Problems to be solved by the invention]
An object of the present invention is to provide another technique for enabling data to be written to an MRAM memory cell with a smaller write current.
[0011]
[Means for Solving the Problems]
The means for achieving the object will be described below using the numbers and symbols used in [Embodiments of the Invention]. These numbers and symbols are added to clarify the correspondence between the description in [Claims] and the description in [Embodiment of the Invention]. However, the added numbers and symbols shall not be used for interpreting the technical scope of the invention described in [Claims].
[0012]
An MRAM memory cell according to the present invention comprises a substrate (1), a free ferromagnetic layer (9) provided on the main surface (1a) side of the substrate (1) and having reversible spontaneous magnetization, and a substrate (1). A first wiring (12) extending in a substantially parallel first direction (y-axis direction) and through which a first write current used for reversing the spontaneous magnetization flows. The free ferromagnetic layer (9) is substantially parallel to the first direction (y-axis direction) and is substantially mirrored with respect to a first symmetry plane (9c) substantially perpendicular to the substrate (1). It is symmetric. The first center line (12a) of the first wiring (12) is positively arranged so as not to be located on the first symmetry plane (9c).
[0013]
The first wiring (12) through which the first write current flows generates the largest write magnetic field near the center line (12a). By disposing the first center line (12a) of the first wiring (12) from the first symmetry plane (9c) of the free ferromagnetic layer (9), this is a position where the largest write magnetic field is generated. The first center line (12a) of the first wiring (12) approaches the outer edge of the free ferromagnetic layer (9). As the first center line (12a) approaches the outer edge of the free ferromagnetic layer (9), the write current required to reverse the domain of the outer edge of the free ferromagnetic layer (9) becomes smaller. When the domain of the outer edge of the free ferromagnetic layer (9) is inverted, the domain inversion propagates from the outer edge of the free ferromagnetic layer (9) to the center, and the spontaneous magnetization of the free ferromagnetic layer (9) is completely Flip to Therefore, by disposing the first center line (12a) of the first wiring (12) from the first symmetry plane (9c) of the free ferromagnetic layer (9), the spontaneous generation of the free ferromagnetic layer (9) is achieved. The write current required to reverse the magnetization can be reduced.
[0014]
The distance between the first center line (12a) of the first wiring (12) and the first symmetry plane (9c) is d, and the free ferromagnetic layer (9) in a second direction perpendicular to the first symmetry plane (9c). Let L be the length and offset p
p = d / L,
It is preferable that the offset amount p is not less than 0.1 and not more than 0.5. The arrangement of the wiring (12) that satisfies such conditions reduces the write current required to reverse the spontaneous magnetization of the free ferromagnetic layer (9).
[0015]
When viewed from a direction perpendicular to the substrate (1), the first wiring (12) extends from an end of the free ferromagnetic layer (9) in a second direction (x-axis direction) perpendicular to the first symmetry plane (9c). It is preferable to have a portion that protrudes in two directions (x-axis direction) and does not overlap with the free ferromagnetic layer (9). Such a structure is necessary for bringing the center line (12a) of the first wiring (12) closer to the outer edge of the free ferromagnetic layer (9) and reversing the spontaneous magnetization of the free ferromagnetic layer (9). Write current is further reduced.
[0016]
The width (W) of the first wiring (12) in the second direction (x-axis direction) perpendicular to the first symmetry plane (9c) is the length of the free ferromagnetic layer (9) in the second direction (x-axis direction). It is preferable that the width is smaller than the length (L). Such a structure concentrates the magnetic field generated by the first wiring (12) on the outer edge of the free ferromagnetic layer (9), and performs writing necessary for reversing the spontaneous magnetization of the free ferromagnetic layer (9). Make the current even smaller.
[0017]
The width (W) of the first wiring (12) is preferably not less than 0.3 times and not more than 0.7 times the length (L) of the free ferromagnetic layer (9).
[0018]
The direction of the spontaneous magnetization of the free ferromagnetic layer (9) may be parallel to the second direction (x-axis direction).
[0019]
The MRAM memory cell preferably includes a magnetic layer (13) joined to the first wiring (12) and formed of a magnetic substance.
[0020]
The MRAM memory cell further includes a second wiring (3) extending in a second direction (x-axis direction), through which a second write current used for reversing the spontaneous magnetization flows, and having a free strength. The magnetic layer (9) is substantially mirror-symmetric with respect to a second symmetry plane (9d) substantially parallel to the second direction (x-axis direction) and substantially perpendicular to the substrate (1). In some cases, it is preferable that the second center line (3a) of the second wiring (3) is positively arranged so as not to be located on the second symmetry plane (9d). Such a structure concentrates the magnetic field generated by the second wiring (3) on the outer edge of the free ferromagnetic layer (9), and performs writing necessary to reverse the spontaneous magnetization of the free ferromagnetic layer (9). Make the current even smaller.
[0021]
An MRAM memory cell according to the present invention includes a free ferromagnetic layer (9) having reversible spontaneous magnetization, a magnetoresistive element (6) whose resistance changes according to the direction of the spontaneous magnetization, and a first direction (y). A first wiring (15) extending in the axial direction) and electrically connected to the magnetoresistive element (6); and a first wiring (15) extending in the first direction (y-axis direction) and electrically connected to the magnetoresistive element (6). And a second wiring (16) through which a write current for inverting the spontaneous magnetization flows. The free ferromagnetic layer (9) is substantially parallel to the first direction (y-axis direction) and is substantially mirrored with respect to a first symmetry plane (9c) substantially perpendicular to the substrate (1). It is symmetric. The center line (16a) of the second wiring (16) is positively arranged so as not to be located on the first symmetry plane (9c). By arranging the center line (16a) of the second wiring (16) so as not to be positioned on the first symmetry plane (9c), the magnitude of the write current required for writing data is reduced. be able to. Further, by disposing the center line (16a) of the second wiring (16) from the first symmetry plane (9c), the first wiring (15) is provided above (or below) the magnetoresistive element (6). ) Is formed, and the first wiring (15) and the second wiring (16) can be formed by one wiring layer. That is, with such an arrangement, both the first wiring (12) and the second wiring (16) can be formed on one interlayer insulating film (10) covering the magnetoresistive element (6). .
[0022]
An MRAM memory cell according to the present invention comprises a substrate (1), a free ferromagnetic layer (9) provided on the main surface (1a) side of the substrate (1) and having reversible spontaneous magnetization, and a substrate (1). A first wiring (12) extending in a substantially parallel first direction (y-axis direction) and through which a first write current used for reversal of spontaneous magnetization flows. The free ferromagnetic layer (9) is substantially parallel to the first direction (y-axis direction) and is substantially mirrored with respect to a first symmetry plane (9c) substantially perpendicular to the substrate (1). It is symmetric. The position where the magnetic field generated by the first write current is the strongest is positively arranged so as not to be located on the first symmetry plane (9c). In such a structure, the position where the largest write magnetic field is generated is brought closer to the outer edge of the free ferromagnetic layer (9), and the write current required to reverse the spontaneous magnetization of the free ferromagnetic layer (9) is reduced. Make it smaller.
[0023]
The method for promoting spontaneous magnetization reversal according to the present invention includes a reversible spontaneous magnetization that is substantially mirror-symmetric with respect to a first symmetry plane (9c) substantially perpendicular to the main surface (1a) of the substrate (1). Providing a free ferromagnetic layer (9) having magnetization;
Providing a wiring (12) through which a write current used for reversing the spontaneous magnetization flows, in a first direction (y-axis direction) substantially parallel to the substrate (1);
The center line (12a) of the wiring (12) is positively arranged so as not to be located on the first symmetry plane (9c).
And According to the spontaneous magnetization reversal promotion method, the center line (12a) of the wiring (12) where the largest write magnetic field is generated is brought closer to the outer edge of the free ferromagnetic layer (9). As a result, the magnitude of the write current required for inverting the domain at the outer edge of the free ferromagnetic layer (9) is reduced. When the domain at the outer edge of the free ferromagnetic layer (9) is inverted, the domain inversion propagates to the center of the free ferromagnetic layer (9), so that the spontaneous magnetization of the free ferromagnetic layer (9) is completely inverted. I do. Therefore, by bringing the center line (12a) of the wiring (12) closer to the outer edge of the free ferromagnetic layer (9), the magnitude of the current required for reversing the spontaneous magnetization of the free ferromagnetic layer (9) is reduced. it can.
[0024]
BEST MODE FOR CARRYING OUT THE INVENTION
Hereinafter, embodiments of a memory cell for a magnetic memory according to the present invention will be described with reference to the accompanying drawings.
[0025]
(First embodiment)
FIG. 1 shows a first embodiment of a memory cell for a magnetic memory according to the present invention. In the first embodiment, the
[0026]
The
[0027]
As shown in FIG. 2, the free
[0028]
As shown in FIG. 1, the
[0029]
As shown in FIG. 2, the
[0030]
When data is written to the memory cell, a write current is applied to the
[0031]
The arrangement of the bit lines 12 described above enables data to be written with a smaller write current. 3 and 4 show the effect of suppressing the write current. FIG. 3 shows the dependence of the magnitude of the write current required to flow through the
p = d / L,
It is defined as When p = 0, the
[0032]
As shown in FIG. 3, the
[0033]
In the domains included in the free
[0034]
By offsetting the
[0035]
However, if the offset amount p is too large, the magnetic field interlinking with the free
[0036]
The arrangement of the bit lines 12 that protrudes from one end of the
[0037]
Patent Document 3 (US Pat. No. 6,236,590) and Patent Document 4 (JP-A-2002-118239) described in the prior art disclose a wiring through which a data write current flows and a data storage. It is disclosed that misalignment between the layers (corresponding to the free
[0038]
When the width W of the
[0039]
This effect is considered to be due to the fact that when the width W of the
[0040]
However, it is not preferable that the width W of the
[0041]
As described above, in the MRAM memory cell of the present embodiment, the
[0042]
In this embodiment, the write current of the
[0043]
Further, as shown in FIG. 6, a
[0044]
(Second embodiment)
FIG. 7 shows a second embodiment of the MRAM memory cell according to the present invention. In the second embodiment, a
[0045]
Further, in the second embodiment, the contact 5 is removed, and the
[0046]
When data is read from the memory cell, a predetermined voltage is applied between the fixed
[0047]
When data is written to the memory cell, a write current flows through the
[0048]
The fact that the
[0049]
Similarly to the
[0050]
The fact that the
[0051]
【The invention's effect】
According to the present invention, a technique is provided that enables data to be written to an MRAM memory cell with a smaller write current.
[Brief description of the drawings]
FIG. 1 is a sectional view showing a first embodiment of an MRAM memory cell according to the present invention.
FIG. 2 is a plan view showing an MRAM memory cell according to a first embodiment of the present invention;
FIG. 3 shows the dependence of the magnitude of a write current that needs to flow through a
FIG. 4 shows the dependence of the magnitude of a write current that needs to flow through the
FIG. 5 is a plan view showing a modification of the first embodiment of the MRAM memory cell according to the present invention;
FIG. 6 is a sectional view showing another modification of the first embodiment of the MRAM memory cell according to the present invention;
FIG. 7 is a sectional view showing an MRAM memory cell according to a second embodiment of the present invention;
FIG. 8 is a plan view showing a second embodiment of the MRAM memory cell according to the present invention.
FIG. 9 shows a conventional MRAM.
[Explanation of symbols]
1: substrate
2: interlayer insulating film
3: Word line
4: interlayer insulating film
5: Contact
6: magnetoresistive element
7: Fixed ferromagnetic layer
8: Tunnel insulating layer
9: Free ferromagnetic layer
10: interlayer insulating film
11: Contact
12: bit line
13: Magnetic layer
14: Contact
15: Read bit line
16: Write bit line
Claims (12)
前記基板の主面側に設けられ,反転可能な自発磁化を有する自由強磁性層と,
前記基板と実質的に平行な第1方向に延設され,前記自発磁化の反転に使用される第1書き込み電流が流される第1配線
とを備え,
前記自由強磁性層は,前記第1方向に実質的に平行で,且つ,前記基板に実質的に垂直な第1対称面に対して実質的に鏡面対称であり,
前記第1配線の第1中心線は,積極的に,前記第1対称面の上に位置しないように配置されている
MRAMメモリセル。Board and
A free ferromagnetic layer provided on the main surface side of the substrate and having reversible spontaneous magnetization;
A first wiring extending in a first direction substantially parallel to the substrate and through which a first write current used for reversing the spontaneous magnetization flows;
The free ferromagnetic layer is substantially mirror-symmetric with respect to a first symmetry plane substantially parallel to the first direction and substantially perpendicular to the substrate;
An MRAM memory cell, wherein a first center line of the first wiring is positively arranged so as not to be located on the first symmetry plane.
前記第1配線は,前記基板に垂直な方向からみたとき,前記第1対称面に垂直な第2方向における前記自由強磁性層の端から前記第2方向にはみ出して前記自由強磁性層に重ならない部分を有している
MRAMメモリセル。2. The MRAM memory cell according to claim 1, wherein
When viewed from a direction perpendicular to the substrate, the first wiring protrudes from an end of the free ferromagnetic layer in a second direction perpendicular to the first symmetry plane in the second direction and overlaps with the free ferromagnetic layer. An MRAM memory cell having a portion that is not required.
前記第1配線の前記第1中心線と前記第1対称面との距離をd,前記第1対称面に垂直な第2方向における前記自由強磁性層の長さをLとし,オフセット量pを
p=d/L,
で定義したとき,
前記pは,0.1以上0.5以下である
MRAMメモリセル。2. The MRAM memory cell according to claim 1, wherein
The distance between the first center line of the first wiring and the first symmetry plane is d, the length of the free ferromagnetic layer in a second direction perpendicular to the first symmetry plane is L, and the offset amount p is p = d / L,
When defined in
An MRAM memory cell wherein p is 0.1 or more and 0.5 or less.
前記第1対称面に垂直な第2方向における前記第1配線の幅は,前記自由強磁性層の前記第2方向における長さよりも狭い
MRAMメモリセル。2. The MRAM memory cell according to claim 1, wherein
An MRAM memory cell, wherein a width of the first wiring in a second direction perpendicular to the first symmetry plane is smaller than a length of the free ferromagnetic layer in the second direction.
前記第1配線の前記幅は,前記自由強磁性層の前記長さの0.3倍以上0.7倍以下である
MRAMメモリセル。The MRAM memory cell according to claim 4,
The MRAM memory cell, wherein the width of the first wiring is 0.3 to 0.7 times the length of the free ferromagnetic layer.
前記自発磁化の方向は,前記第2方向に平行である
MRAMメモリセル。The MRAM memory cell according to any one of claims 1 to 5,
The MRAM memory cell, wherein the direction of the spontaneous magnetization is parallel to the second direction.
更に,前記第1配線に接合され,磁性体で形成された磁性体層
とを備えた
MRAMメモリセル。The MRAM memory cell according to any one of claims 1 to 6,
An MRAM memory cell further comprising a magnetic layer formed of a magnetic material, the MRAM memory cell being joined to the first wiring.
更に,
前記第2方向に延設され,前記自発磁化の反転に使用される第2書き込み電流が流される第2配線
を備え,
前記自由強磁性層は,前記第2方向に実質的に平行で,且つ,前記基板に実質的に垂直な第2対称面に対して実質的に鏡面対称であり,
前記第2配線の第2中心線は,積極的に,前記第2対称面の上に位置しないように配置されている
MRAMメモリセル。2. The MRAM memory cell according to claim 1, wherein
Furthermore,
A second wiring extending in the second direction and passing a second write current used for reversing the spontaneous magnetization;
The free ferromagnetic layer is substantially mirror-symmetric to a second plane of symmetry substantially parallel to the second direction and substantially perpendicular to the substrate;
The MRAM memory cell, wherein the second center line of the second wiring is positively arranged so as not to be located on the second symmetry plane.
第1方向に延設され,前記磁気抵抗素子に電気的に接続される第1配線と,
前記第1方向に延設され,前記磁気抵抗素子から電気的に絶縁され,且つ,前記自発磁化を反転させる書き込み電流が流される第2配線
とを備え,
前記自由強磁性層は,前記第1方向に実質的に平行で,且つ,前記基板に実質的に垂直な第1対称面に対して実質的に鏡面対称であり,
前記第2配線の中心線は,積極的に,前記第1対称面の上に位置しないように配置されている
MRAMメモリセル。A magnetoresistive element including a free ferromagnetic layer having a reversible spontaneous magnetization and having a resistance that changes according to a direction of the spontaneous magnetization;
A first wiring extending in a first direction and electrically connected to the magnetoresistive element;
A second wiring extending in the first direction, electrically insulated from the magnetoresistive element, and passing a write current for reversing the spontaneous magnetization;
The free ferromagnetic layer is substantially mirror-symmetric with respect to a first symmetry plane substantially parallel to the first direction and substantially perpendicular to the substrate;
An MRAM memory cell, wherein a center line of the second wiring is positively arranged so as not to be located on the first symmetry plane.
更に,前記磁気抵抗素子を被覆する層間絶縁膜を備え,
前記第1配線と前記第2配線とは,前記層間絶縁膜の上に形成されている
MRAMメモリセル。The MRAM memory cell according to claim 9,
Further, an interlayer insulating film covering the magnetoresistive element is provided,
An MRAM memory cell, wherein the first wiring and the second wiring are formed on the interlayer insulating film.
前記基板の主面側に設けられ,反転可能な自発磁化を有する自由強磁性層と,
前記基板と実質的に平行な第1方向に延設され,前記自発磁化の反転に使用される第1書き込み電流が流される第1配線
とを備え,
前記自由強磁性層は,前記第1方向に実質的に平行で,且つ,前記基板に実質的に垂直な第1対称面に対して実質的に鏡面対称であり,
前記第1書き込み電流が発生する磁場が最も強くなる位置は,積極的に,前記第1対称面の上に位置しないように配置されている
MRAMメモリセル。Board and
A free ferromagnetic layer provided on the main surface side of the substrate and having reversible spontaneous magnetization;
A first wiring extending in a first direction substantially parallel to the substrate and through which a first write current used for reversing the spontaneous magnetization flows;
The free ferromagnetic layer is substantially mirror-symmetric with respect to a first symmetry plane substantially parallel to the first direction and substantially perpendicular to the substrate;
The position where the magnetic field generated by the first write current is the strongest is an MRAM memory cell arranged so as not to be located on the first symmetry plane.
前記自発磁化の反転に使用される書き込み電流が流される配線を,前記基板と前記第1対称面とに実質的に平行な方向に延伸するように設けることと,
前記配線の中心線を,積極的に,前記第1対称面の上に位置しないように配置すること
とを備えた
自発磁化反転促進方法。Providing a free ferromagnetic layer having reversible spontaneous magnetization so as to be substantially mirror-symmetric with respect to a first plane of symmetry substantially perpendicular to the main surface of the substrate;
Providing a wiring through which a write current used for reversing the spontaneous magnetization flows so as to extend in a direction substantially parallel to the substrate and the first symmetry plane;
Positively arranging the center line of the wiring so as not to be located on the first symmetry plane.
Priority Applications (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2002267188A JP4264967B2 (en) | 2002-09-12 | 2002-09-12 | MRAM memory cell |
US10/659,437 US7064974B2 (en) | 2002-09-12 | 2003-09-11 | Magnetic random access memory and method for manufacturing the same |
US11/380,962 US7254054B2 (en) | 2002-09-12 | 2006-05-01 | Magnetic random access memory and method for manufacturing the same |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2002267188A JP4264967B2 (en) | 2002-09-12 | 2002-09-12 | MRAM memory cell |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2004104027A true JP2004104027A (en) | 2004-04-02 |
JP4264967B2 JP4264967B2 (en) | 2009-05-20 |
Family
ID=32265784
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2002267188A Expired - Fee Related JP4264967B2 (en) | 2002-09-12 | 2002-09-12 | MRAM memory cell |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP4264967B2 (en) |
Cited By (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2005086016A (en) * | 2003-09-09 | 2005-03-31 | Sony Corp | Magnetic memory |
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-
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Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
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JP4521354B2 (en) * | 2005-11-15 | 2010-08-11 | 株式会社東芝 | Magnetic random access memory |
Also Published As
Publication number | Publication date |
---|---|
JP4264967B2 (en) | 2009-05-20 |
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