JP2004023572A - Cell switch and cell switching method - Google Patents
Cell switch and cell switching method Download PDFInfo
- Publication number
- JP2004023572A JP2004023572A JP2002177725A JP2002177725A JP2004023572A JP 2004023572 A JP2004023572 A JP 2004023572A JP 2002177725 A JP2002177725 A JP 2002177725A JP 2002177725 A JP2002177725 A JP 2002177725A JP 2004023572 A JP2004023572 A JP 2004023572A
- Authority
- JP
- Japan
- Prior art keywords
- cell
- unit
- speed
- input
- line
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
Images
Landscapes
- Data Exchanges In Wide-Area Networks (AREA)
Abstract
Description
【0001】
【発明の属する技術分野】
この発明は、ATM通信方式にあって、データを一定の長さ(セル単位)で交換するセルスイッチ及びセル交換方法に係り、特に入力バッファ型セルスイッチの構成と制御に関する。
【0002】
【従来の技術】
多様な通信形態に対応するATM通信方式にあって、例えば特開平9−321768号公報には、従来の入力バッファ型セルスイッチのブロック構成及び交換動作が開示されている。このような従来例を図7に示しており、図7において、セルスイッチ(ATMスイッチ)は、入線10(10a,10b,10cを指す)から入力された固定長データであるセルを宛先出線13(13a,13b,13cを指す)別に格納する入力バッファ部2(2a,2b,2cを指す)、入力バッファ部2内にあって宛先出線13別に実際にセルを格納する仮想出力キュー3(3a,3b,3cを指す)、入力バッファ部2から通知された全ての仮想出力キュー3内のセル蓄積情報を基に所定のアルゴリズムに従って仮想出力キュー3間の出力調停(次にセル送出許可を与える仮想出力キュー3を選択すること)を行うアービタ部41、アービタ部41からの交換情報に従って入力バッファ部2から入力されたセルを宛先出線13へ転送するスイッチ部5を有する。
【0003】
このような構成の入力バッファ型セルスイッチにおいて、各入線10からのセルは、セルヘッダ内の宛先情報に従って、所望の宛先出線13に対応した仮想出力キュー3に格納される。例えば、出線#1宛のセル(図7では「to#1」と書かれたセル)は、各入力バッファ部2内の出線#1に対応した仮想出力キュー3(図7では各入力バッファ部2内の最上段のキュー)に格納される。同様に出線#2、#3宛のセルは、2段目、3段目の各キューに格納される。
【0004】
アービタ部41は、全ての仮想出力キュー3の状態(セル蓄積情報)を監視して、転送待ちのセルが蓄積されている仮想出力キュー3の中から「入線同士/出線同士が重ならない複数のセル転送パスの組み合せ」を一組抽出し、当該セル転送パスに対応する仮想出力キュー3に対してセルの送出を許可(仮想出力キュー調停情報を出力)する。図7では、入線#1→出線#2、入線#2→出線#1、入線#3→出線#3の3つのセル転送パスが1回の調停で抽出されている。なお、上記交換動作(セル転送パス抽出動作)は、1セルの転送にかかる時間(「セル時間」)(=セル長/伝送速度)に1回行われる。
【0005】
入力バッファ型セルスイッチは上述のような構成及び動作となっているため、出力バッファ型セルスイッチ等には必要のないアービタ部41の搭載が必要となり、この部分の動作速度が入力バッファ型セルスイッチの交換容量の上限を決める主要因となっている。ここで、交換容量とは「収容回線速度(伝送速度)×収容回線数(入線または出線数)」を意味する。
【0006】
一方、セル長は一定なので、伝送速度に反比例して1セル時間である全体の調停時間が小すなわち短くなり、収容回線数に反比例して1回線(出線)当りの調停時間(=セル時間/収容回線数)が小すなわち短くなる。そして、この調停時間とアービタ部41を搭載しているデバイス(LSI)の動作速度の関係から、当該入力バッファ型セルスイッチの理論的な最大交換容量が決定されることになる。
【0007】
図8は、収容回線数の増加に伴うLSIのピン数不足等による実装上の問題を回避するためのブロック構成(スイッチ構成例)を示しており、例えば特開平10−126419号公報に開示される。図8において、セルスイッチ(ATMスイッチ)は、図7に示す構成の外に、低速な複数の入線10を高速な入力ポート11(11a,11b,11cを指す)へ多重する多重化部1(1a,1b,1cを指す)、高速な出力ポート12(12a,12b,12c)から出力されたセルを低速な出線13に振り分ける分離部61(61a,61b,61cを指す)、分離部61内において宛先出線13別にセルを格納し出力ポート12と出線13の間の物理伝送速度の違いを吸収するための大容量速度変換バッファ71(71a,71b,71cを指す)を更に有する。なおこの場合、入線10の伝送速度が出線13の伝送速度より高速という特殊なケースには、多重化部1が省略される構成も考えられ、図8の構成において、入線10の伝送速度が出線13の伝送速度の丁度4倍の場合、多重化部1が省略され、入力ポート11に入線10が直接収容される構成となる。
【0008】
【発明が解決しようとする課題】
上述のようなセルスイッチにおいて、実際のアプリケーションでは、セルスイッチに対して伝送速度の異なる回線(例えば10Gbps回線と2.4Gbps回線)を同時に収容する機能(異速度回線収容機能)が、ユーザから求められる場合が多い。この場合、図8に示すようにセルスイッチの入力ポート11と出力ポート12の伝送速度を高速回線と等しくし、高速回線はそのままとする一方低速回線は前段の多重化部1で高速回線の伝送速度に多重化してからセルスイッチに収容するという構成が考えられる。あるいは、低速回線だけをセルスイッチに多数収容する場合でも、前記LSIのピン数不足等による実装上の問題を回避するために、図8に示す構成とするのが得策と考えられる。なお、図8では、低速回線と高速回線(入出力ポート)の伝送速度比が丁度4倍の例(仮想出力キュー#1A〜#Dに対して例えば入線(出線)#1A〜#1Dのような例)を示している。
【0009】
各入力バッファ部2内の仮想出力キュー3の数は、出線13の数に比例して増加する。このため、図8に示した構成例では、低速回線収容時の仮想出力キュー3の数は高速回線収容時の4倍となる。つまり、高速回線収容時よりも低速回線収容時の方が、調停の対象となる仮想出力キュー3(=セル転送パス)が1出力ポート12当り4倍となるため、アービタ部41のハードウェア規模が大きくなり、それが原因でデバイス(LSI)の動作速度ネックが生じる可能性がある。さらに、図8に示す構成では、後段の分離部61に対して各出線13宛のセルが不規則に入力される。このため、分離部61においてセルを宛先出線13別に正確に分離するには、セルヘッダを参照して振り分ける必要がある上、セルが不規則に入力されてもバッファ溢れを起こさない容量を有する大容量速度変換バッファ71も備えなければならないという問題点があった。
【0010】
この発明は上記に鑑みてなされたもので、低速回線収容時にもアービタ部41の(デバイスの)動作速度ネックの発生を抑えること、さらに大容量速度変換バッファを用いずに従来方式と同等の低速回線収容機能を実現することを得るセルスイッチ及びセル交換方法の提供を目的とする。
【0011】
【課題を解決するための手段】
上記目的を達成するため、この発明にかかるセルスイッチは、入力ポートから入力されたセルを宛先出線別に用意された複数の仮想出力キューへ格納する入力バッファ部と、前記入力バッファ部からのセル蓄積情報を基に前記仮想出力キュー間の出力調停を行うアービタ部と、前記入力バッファ部から入力されたセルを宛先出線を収容する出力ポートへ転送するスイッチ部と、高速な前記出力ポートから入力されたセルを低速な宛先出線に振り分ける分離部を備えたセルスイッチにおいて、前記入力バッファ部内の前記仮想出力キューについて複数のグループ分けをし、前記アービタ部は複数のグループの内各グループごとに時分割動作にて順番に調停の対象とすると共に調停の対象となったグループ内の前記仮想出力キューに対してのみセルの出力を許可することを特徴とする。
【0012】
この発明によれば、グループ分けした時分割動作によってセル転送パス数を見掛け上高速回線収容時と同数にすることができ、つまり、調停時の条件(調停時間とセル転送パス数)を高速回線収容時と同一にすることができ、アービタ部の(デバイスの)動作速度ネックの発生を抑えられる。
【0013】
つぎの発明にかかるセルスイッチは、上記の発明において、分離部にて時分割動作を行うことを特徴とする。
【0014】
この発明によれば、グループ分けした時分割動作をこの分離部でも実行することによってセルヘッダを参照して振り分ける機能が不要となる上、分離部に入力される各グループ宛のセルレートは低速回線(出線)上のセルレートと同一かつ一定となるため、速度変換バッファを大容量にする必要がなくなり、小容量速度変換バッファを用意するだけで済む。
【0015】
つぎの発明にかかるセルスイッチは、上記の発明において、低速な複数の入線を高速な入力ポートへ多重化する多重化部を備えたことを特徴とする。
【0016】
この発明によれば、低速な入線を高速にできることで、異速度回線収容機能が得られる。
【0017】
つぎの発明にかかるセルスイッチは、上記の発明において、セルヘッダを利用して、時分割動作のタイムスロット情報を入力バッファ部−アービタ部間、入力バッファ部−スイッチ部間、及びスイッチ部−分離部間の少なくとも一つの間にて伝送することを特徴とする。
【0018】
この発明によれば、別線(制御線)を追加することなくグループの誤認識を回避すると共に、システム全体が正常に連携して動作する。
【0019】
つぎの発明にかかるセルスイッチは、上記の発明において、セル伝送用のデータ線とは別に設けられた制御線を利用して、時分割動作のタイムスロット情報を入力バッファ部−アービタ部間、入力バッファ部−スイッチ部間、及びスイッチ部−分離部間の少なくとも一つの間にて伝送することを特徴とする。
【0020】
この発明によれば、時分割動作のタイムスロット情報を制御線によってデータとは別に管理することになり、セルヘッダ内の情報エリアの一部をタイムスロット情報用に占有する必要が無くなり、他の情報用に転用できる。
【0021】
つぎの発明にかかるセルスイッチは、上記の発明において、タイムスロット情報生成手段を有し、前記タイムスロット情報生成手段から分配されたタイムスロット情報に従って時分割動作を行うことを特徴とする。
【0022】
この発明によれば、各部の時分割動作の基準となるタイムスロット情報をタイムスロット情報生成部が一元的に管理/分配することにより、各入力バッファ部から入力された複数のセルのグループ名を一つに揃えることができ、スイッチ部における同一グループが全て揃うまでの待ち合わせ時間を最小限に抑えることができる。
【0023】
つぎの発明にかかるセルスイッチは、上記の発明において、特定のタイムスロットを示すフラグ情報をタイムスロット情報として利用することを特徴とする。
【0024】
この発明によれば、グループの誤認識を回避すると共に、システム全体が正常に連携して動作できる。
【0025】
つぎの発明にかかるセルスイッチは、上記の発明において、タイムスロット番号をタイムスロット情報として利用することを特徴とする。
【0026】
この発明によれば、グループの誤認識を回避すると共に、システム全体が正常に連携して動作できる。
【0027】
つぎの発明にかかるセルスイッチは、上記の発明において、アービタ部の時分割動作の動作/停止を出力ポート単位に選択可能なことを特徴とする。
【0028】
この発明によれば、出力ポート単位に収容出線の伝送速度(または分離部の有無)を設定でき、高速回線と低速回線をセルスイッチに自由に混在収容できる。
【0029】
つぎの発明にかかるセル交換方法は、入力ポートから入力されたセルを宛先出線別に用意された複数の仮想出力キューへ格納するセル格納工程と、前記セル格納工程により格納されたセルの蓄積情報を基に前記仮想出力キュー間の出力調停を行う調停工程と、前記仮想出力キューから入力されたセルを宛先出線を収容する出力ポートへ転送する交換工程と、高速な前記出力ポートから入力されたセルを低速な宛先出線に振り分ける分離工程を備えたセル交換方法において、前記仮想出力キューについて複数のグループ分けをし、前記調停工程は複数のグループの内各グループごとに時分割動作にて順番に調停の対象とすると共に調停の対象となったグループ内の前記仮想出力キューに対してのみセルの出力を許可することを特徴とする。
【0030】
この発明によれば、グループ分けした時分割動作によって調停時の条件(調停時間とセル転送パス数)を高速回線収容時と同一にすることができ、アービタ部の(デバイスの)動作速度ネックの発生を抑えられる。
【0031】
つぎの発明にかかるセル交換方法は、上記の発明において、分離工程にて時分割動作を行うことを特徴とする。
【0032】
この発明によれば、グループ分けした時分割動作をこの分離工程でも実行することによってセルヘッダを参照して振り分ける工程が不要となる上、分離工程に入力される各グループ宛のセルレートは低速回線(出線)上のセルレートと同一かつ一定となるため、速度変換バッファを大容量にする必要がなくなり、小容量速度変換バッファを用意するだけで済む。
【0033】
つぎの発明にかかるセル交換方法は、上記の発明において、低速な複数の入線を高速な入力ポートへ多重する多重化工程を備えたことを特徴とする。
【0034】
この発明によれば、低速な入線を高速にできることで、異速度回線収容機能が得られる。
【0035】
【発明の実施の形態】
以下に添付図1〜6を参照して、この発明にかかる好適な実施の形態を詳細に説明する。なお図において、図7、8と同一部分には同符号を付す。
【0036】
実施の形態1.
図1はこの発明の実施の形態1であるセルスイッチの構成例を示す図である。図1において、1は低速な複数の入線10を高速な入力ポート11へ多重する多重化部、2は入力ポート11から入力されたセルを宛先出線13別に格納する入力バッファ部、3は入力バッファ部2内において宛先出線13別に実際にセルを格納する仮想出力キュー、4は入力バッファ部2から通知された全ての仮想出力キュー3内のセル蓄積情報を基に、所定のアルゴリズムに従って仮想出力キュー3間の出力調停(次にセル送出許可を与える仮想出力キュー3を選択すること)を行うアービタ部、5はアービタ部4からの交換情報に従って入力バッファ部2から入力されたセルを宛先出線13へ転送するスイッチ部、6は高速な出力ポート12から入力されたセルを低速な出線13に振り分ける分離部、7は分離部6内において宛先出線13別にセルを格納し出力ポート12と出線13の間の物理伝送速度の違いを吸収するための小容量速度変換バッファである。
【0037】
上述並びに図1に示すように、この発明の実施の形態1の基本的なブロック構成は、図8に示した従来例とほぼ同じであるが、アービタ部4の動作と分離部6の動作が従来例とは異なる。
【0038】
上述のセルスイッチにおいて、各入線10から入力されたセルは、まず多重化部1において入力ポート11の伝送速度に多重化される。次に入力ポート11から入力バッファ部2に入力されたセルは、そのヘッダ内の宛先情報に従って、所望の宛先出線13に対応した仮想出力キュー3に格納される。例えば、出線#1A宛のセルは、各入力バッファ部2内の出線#1Aに対応した仮想出力キュー3に格納される。
【0039】
ここで、仮想出力キュー3は、4つのグループ(グループA〜D)に分類されている。従来方式にはこのようなグループ分けの概念はなく、従来方式のアービタ部41は常に全ての仮想出力キュー3を調停の対象とするが、この実施の形態1によるアービタ部4は一度に1つのグループしか調停の対象としない。さらに、アービタ部4は、調停の対象となるグループをセル時間(タイムスロット)単位に1つずつ変化(例えば、A→B→C→D→A→・・・=4セル時間で一巡)させるものである。
【0040】
アービタ部4は、当該セル時間(タイムスロット)に調停の対象となったグループに属する仮想出力キュー3の状態(セル蓄積情報)のみを監視して、転送待ちのセルが蓄積されている当該グループに属する仮想出力キュー3の中から「入線同士/出線同士が重ならない複数のセル転送パスの組み合せ」を一組抽出し、当該セル転送パスに対応する仮想出力キュー3に対してセルの送出を許可(仮想出力キュー調停情報を出力)する。
【0041】
図1に示したセルスイッチの構成例を、論理的な動作に着目して書き直すと図2に示すような構成となる。つまり、論理的には、高速回線収容時と同じ構成の入力バッファ部2を持つ独立した4つのセルスイッチが、1セル時間(タイムスロット)毎に順番に動作しているのと等しくなっている。但し、物理的には、アービタ部4もスイッチ部5も図1に示した通り1つずつしか存在していない。
【0042】
このような時分割動作により、各セル時間(タイムスロット)において調停の対象となる仮想出力キュー3の数(=セル転送パス数)を全体の1/4に減らし、見掛け上高速回線収容時と同数にすることができる。つまり、調停時の条件(調停時間とセル転送パス数)を高速回線収容時と同一にすることができ、アービタ部4の(デバイスの)動作速度ネックの発生を抑えられるという効果を得る。
【0043】
ちなみに、常に全ての仮想出力キュー3を調停の対象とする従来方式の方が、若干セルスイッチとしての性能(セル廃棄特性等)が良くなるが、これは過剰品質とも言える。この実施の形態1による方式でも、各セル時間(タイムスロット)内の動作は高速回線収容時と論理的に全く同一となるため、高速回線収容時の性能が十分であれば、低速回線収容時の性能も十分である。
【0044】
また、上記時分割動作により、後段の分離部6に対しては、グループA〜Dに属する低速出線13宛のセルが1セル時間(タイムスロット)毎に順番に入力されることになる。1つのグループに着目すると、分離部6に入力される当該グループ宛のセルレートは、低速回線(出線)上のセルレートと同一かつ一定となるため、分離部6には大容量速度変換バッファ71を搭載する必要がなくなり、物理伝送速度を高速回線から低速回線に変換する1〜2セル分程度の小容量速度変換バッファ7を用意するだけで済む(小容量でもバッファ溢れは起きない)という効果が得られる。
【0045】
上記時分割動作において、グループの誤認識を回避すると共に、システム全体が正常に連携して動作するためには、各部間を伝送されるセルのグループ名を何らかの方法で明示する必要がある。つまり、セルの受信側で、当該セルのグループ名を判別できるようにしておく必要がある。ここで、グループ名の明示方式の代表的なものとして、2通りの方式を図4及び図5に示す。図4に示した「フラグ情報方式」では、タイムスロット情報として、例えばグループAに属するセルの時は’1’、それ以外のグループに属するセルの時は’0’となるようなフラグ情報を使用する。一方、図5に示した「タイムスロット番号方式」では、タイムスロット情報としてタイムスロット番号(=グループ名)を使用する。
【0046】
なお、図4及び図5では、フラグ情報またはタイムスロット番号をセルヘッダを利用して伝送する方式を示したが、これらの情報はセルヘッダではなく、セル伝送用のデータ線とは別に設けられた制御線を利用して伝送してもよい。
【0047】
実施の形態2.
つぎに、この発明の実施の形態2について説明する。図3はこの発明の実施の形態2であるセルスイッチの構成例を示す図である。実施の形態2のセルスイッチの各構成要素は、図1に示す実施の形態1のセルスイッチの各構成要素と基本的に同じ動作となる。ここで、実施の形態2では、伝送速度が高速な出線(高速回線)と低速な出線(低速回線)が混在している点に特徴があり、各部に分配された出線伝送速度設定情報により、出力ポート12単位に収容出線13の伝送速度(または分離部6の有無)を設定できるようになっている。入力バッファ部2内の仮想出力キュー3の構成は、入線10の伝送速度に依存せず、出線13の伝送速度にのみ依存する。ここで、低速な出線13を収容した出力ポート12に対しては、仮想出力キュー3を4グループ分用意するが、高速な出線13を収容した出力ポート12に対しては、仮想出力キュー3を1グループ分しか用意する必要がない。
【0048】
このような実施の形態2の構成にあって、アービタ部4は、低速な出線13宛の仮想出力キュー3については実施の形態1と同様に時分割動作によりグループ単位に順番に調停の対象とするが、高速な出線13宛の仮想出力キュー3については常に調停の対象とする。つまり、高速な出線13宛の仮想出力キュー3の扱いは従来方法と同じであり、ここにグループ分けの概念は存在しない。この動作は、「高速な出線13を収容した出力ポート12については、アービタ部4は時分割動作を停止する」という説明をすることができる。
【0049】
このような動作により、高速回線と低速回線をセルスイッチに自由に混在収容できる(異速度回線収容機能の実現)という効果が得られる。
【0050】
実施の形態3.
次に、この発明の実施の形態3について説明する。図6はこの発明の実施の形態3であるセルスイッチの構成例の一部を示す図である。図6では、煩雑になるのを避けるため簡略図とし、実施の形態3の動作説明に不要な多重化部1、仮想出力キュー3、小容量速度変換バッファ7の表記を省略しているが、基本的には存在する。実施の形態3のセルスイッチの各構成要素は、図1に示す実施の形態1または図3に示す実施の形態2のセルスイッチの各構成要素と基本的に同じ動作となる。但し、実施の形態3では、新たな構成要素としてタイムスロット情報生成部8が追加されており、そこから各部(多重化部1、アービタ部4、スイッチ部5、分離部6)に対してタイムスロット情報14が分配されている。
【0051】
このような図6の構成において、セルの基本的な交換動作そのものは、実施の形態1または実施の形態2と同一である。但し、実施の形態3では、各部の時分割動作の基準となるタイムスロット情報を、タイムスロット情報生成部8が一元的に管理・分配している点に特徴がある。例えば、スイッチ部5では、同じセル時間にアービタ部4において調停されたセル同士(同じグループのセル同士)で交換を行う必要がある。もし、各入力バッファ部2からスイッチ部5に同時に入力された複数のセルのグループ名がそれぞれ異なる場合は、スイッチ部5内の遅延調整用バッファメモリ(図示せず)を利用して、同じグループのセルが全て揃うまで待ち合わせを行う必要がある。ここで、タイムスロット情報生成部8から各入力バッファ部2に同じタイムスロット情報を分配し、全入力バッファ部2の動作タイミングを統一することによって、各入力バッファ部2から入力された複数のセルのグループ名を一つに揃えることができ、スイッチ部5における上記待ち合わせ時間を最小限に抑える効果が得られる。
【0052】
また、システム全体の動作タイミングを一元的に管理することで、各部間を伝送されるセルのグループ名をタイムスロット情報生成部8からのタイムスロット情報より特定できるため、セルヘッダまたはセル伝送用のデータ線とは別に設けられた制御線を利用してセルのグループ名を明示する機能を削除することも可能となる。
【0053】
実施の形態1〜3では、出力ポート12と出線13の数を3本としたが、これらの本数について特に制限はなく、どのような本数としてもよい。
【0054】
実施の形態1〜3では、多重化部1と分離部6における多重数(時分割動作のタイムスロット数)を4としたが、これらの数について特に制限はなく、どのような数としてもよい。
【0055】
【発明の効果】
以上説明したように、この発明によれば、入力ポートから入力されたセルを宛先出線別に用意された複数の仮想出力キューへ格納する入力バッファ部と、前記入力バッファ部からのセル蓄積情報を基に前記仮想出力キュー間の出力調停を行うアービタ部と、前記入力バッファ部から入力されたセルを宛先出線を収容する出力ポートへ転送するスイッチ部と、高速な前記出力ポートから入力されたセルを低速な宛先出線に振り分ける分離部を備えたセルスイッチにおいて、前記入力バッファ部内の前記仮想出力キューについて複数のグループ分けをし、前記アービタ部は複数のグループの内各グループごとに時分割動作にて順番に調停の対象とすると共に調停の対象となったグループ内の前記仮想出力キューに対してのみセルの出力を許可することにより、グループ分けした時分割動作によってセル転送パス数を見掛け上高速回線収容時と同数にすることができ、つまり、調停時の条件(調停時間とセル転送パス数)を高速回線収容時と同一にすることができ、アービタ部の(デバイスの)動作速度ネックの発生を抑えられる。
【0056】
つぎの発明によれば、分離部にて時分割動作を行うことにより、グループ分けした時分割動作をこの分離部でも実行することによってセルヘッダを参照して振り分ける機能が不要となる上、分離部に入力される各グループ宛のセルレートは低速回線(出線)上のセルレートと同一かつ一定となるため、速度変換バッファを大容量にする必要がなくなり、小容量速度変換バッファを用意するだけで済む。
【0057】
つぎの発明によれば、低速な複数の入線を高速な入力ポートへ多重化する多重化部を備えたことにより、低速な入線を高速にできることで、異速度回線収容機能が得られる。
【0058】
つぎの発明によれば、セルヘッダを利用して、時分割動作のタイムスロット情報を入力バッファ部−アービタ部間、入力バッファ部−スイッチ部間、及びスイッチ部−分離部間の少なくとも一つの間にて伝送することにより、別線(制御線)を追加することなくグループの誤認識を回避すると共に、システム全体が正常に連携して動作する。
【0059】
つぎの発明によれば、セル伝送用のデータ線とは別に設けられた制御線を利用して、時分割動作のタイムスロット情報を入力バッファ部−アービタ部間、入力バッファ部−スイッチ部間、及びスイッチ部−分離部間の少なくとも一つの間にて伝送することにより、時分割動作のタイムスロット情報を制御線によってデータとは別に管理することになり、セルヘッダ内の情報エリアの一部をタイムスロット情報用に占有する必要が無くなり、他の情報用に転用できる。
【0060】
つぎの発明によれば、タイムスロット情報生成手段を有し、前記タイムスロット情報生成手段から分配されたタイムスロット情報に従って時分割動作を行うことにより、各入力バッファ部から入力された複数のセルのグループ名を一つに揃えることができ、スイッチ部における同一グループが全て揃うまでの待ち合わせ時間を最小限に抑えることができる。
【0061】
つぎの発明によれば、特定のタイムスロットを示すフラグ情報をタイムスロット情報として利用することにより、グループの誤認識を回避すると共に、システム全体が正常に連携して動作できる。
【0062】
つぎの発明によれば、タイムスロット番号をタイムスロット情報として利用することにより、グループの誤認識を回避すると共に、システム全体が正常に連携して動作できる。
【0063】
つぎの発明によれば、アービタ部の時分割動作の動作/停止を出力ポート単位に選択可能なことにより、出力ポート単位に収容出線の伝送速度(または分離部の有無)を設定でき、高速回線と低速回線をセルスイッチに自由に混在収容できる。
【0064】
つぎの発明によれば、入力ポートから入力されたセルを宛先出線別に用意された複数の仮想出力キューへ格納するセル格納工程と、前記セル格納工程により格納されたセルの蓄積情報を基に前記仮想出力キュー間の出力調停を行う調停工程と、前記仮想出力キューから入力されたセルを宛先出線を収容する出力ポートへ転送する交換工程と、高速な前記出力ポートから入力されたセルを低速な宛先出線に振り分ける分離工程を備えたセル交換方法において、前記仮想出力キューについて複数のグループ分けをし、前記調停工程は複数のグループの内各グループごとに時分割動作にて順番に調停の対象とすると共に調停の対象となったグループ内の前記仮想出力キューに対してのみセルの出力を許可することにより、グループ分けした時分割動作によって調停時の条件(調停時間とセル転送パス数)を高速回線収容時と同一にすることができ、アービタ部の(デバイスの)動作速度ネックの発生を抑えられる。
【0065】
つぎの発明によれば、グループ分けした時分割動作をこの分離工程でも実行することによってセルヘッダを参照して振り分ける工程が不要となる上、分離工程に入力される各グループ宛のセルレートは低速回線(出線)上のセルレートと同一かつ一定となるため、速度変換バッファを大容量にする必要がなくなり、小容量速度変換バッファを用意するだけで済む。
【0066】
つぎの発明によれば、低速な複数の入線を高速な入力ポートへ多重する多重化工程を備えたことにより、低速な入線を高速にできることで、異速度回線収容機能が得られる。
【図面の簡単な説明】
【図1】この発明の実施の形態1であるセルスイッチの構成を示すブロック図である。
【図2】図1に示したブロック図と論理的に等価のブロック図である。
【図3】この発明の実施の形態2であるセルスイッチの構成を示すブロック図である。
【図4】フラグ情報をセルヘッダを利用して伝送する方式の説明図である。
【図5】タイムスロット番号をセルヘッダを利用して伝送する方式の説明図である。
【図6】この発明の実施の形態3であるセルスイッチの構成を示す簡略ブロック図である。
【図7】一従来例のセルスイッチの構成を示すブロック図である。
【図8】他の従来例のセルスイッチの構成を示すブロック図である。
【符号の説明】
1 多重化部、2 入力バッファ部、3 仮想出力キュー、4 アービタ部、5 スイッチ部、6 分離部、7 小容量速度変換バッファ、8 タイムスロット情報生成部、10 入線、11 入力ポート、12 出力ポート、13 出線、14 タイムスロット情報。[0001]
TECHNICAL FIELD OF THE INVENTION
The present invention relates to a cell switch and a cell switching method for exchanging data in a fixed length (in units of cells) in an ATM communication system, and more particularly to a configuration and control of an input buffer type cell switch.
[0002]
[Prior art]
In an ATM communication system corresponding to various communication modes, for example, Japanese Patent Application Laid-Open No. 9-321768 discloses a block configuration and a switching operation of a conventional input buffer type cell switch. FIG. 7 shows such a conventional example. In FIG. 7, a cell switch (ATM switch) transfers a cell which is fixed-length data input from an input line 10 (indicating 10a, 10b, 10c) to a destination output line. 13 (indicating 13a, 13b, 13c), an input buffer unit 2 (indicating 2a, 2b, 2c), and a
[0003]
In the input buffer type cell switch having such a configuration, the cell from each
[0004]
The arbiter unit 41 monitors the states (cell storage information) of all the
[0005]
Since the input buffer type cell switch has the above-described configuration and operation, it is necessary to mount the arbiter unit 41 which is not necessary for the output buffer type cell switch and the like, and the operation speed of this part is reduced. Is the main factor that determines the upper limit of the exchange capacity. Here, the exchange capacity means "accommodated line speed (transmission speed) x number of accommodated lines (number of incoming lines or outgoing lines)".
[0006]
On the other hand, since the cell length is fixed, the overall arbitration time, which is one cell time, is inversely proportional to the transmission rate, ie, becomes shorter, and the arbitration time per line (outgoing line) is inversely proportional to the number of accommodated lines (= cell time). / Number of accommodated lines) is small, that is, short. The theoretical maximum exchange capacity of the input buffer type cell switch is determined from the relationship between the arbitration time and the operation speed of the device (LSI) equipped with the arbiter unit 41.
[0007]
FIG. 8 shows a block configuration (an example of a switch configuration) for avoiding a mounting problem due to a shortage of LSI pins due to an increase in the number of accommodated lines, and is disclosed in, for example, JP-A-10-126419. You. 8, in addition to the configuration shown in FIG. 7, a cell switch (ATM switch) is a multiplexing unit 1 (multiplexing a plurality of low-
[0008]
[Problems to be solved by the invention]
In the above-described cell switch, in an actual application, a function (accommodation function for accommodating different speed lines) that simultaneously accommodates lines having different transmission speeds (for example, a 10 Gbps line and a 2.4 Gbps line) for the cell switch is required by the user. Often. In this case, as shown in FIG. 8, the transmission speed of the input port 11 and the output port 12 of the cell switch is made equal to that of the high-speed line, and the high-speed line is kept as it is. A configuration is conceivable in which the data is multiplexed to the speed and then accommodated in the cell switch. Alternatively, even when a large number of low-speed lines are accommodated in the cell switch, the configuration shown in FIG. 8 is considered to be a good measure to avoid a mounting problem due to a shortage of the number of pins of the LSI. In FIG. 8, an example in which the transmission speed ratio between the low-speed line and the high-speed line (input / output port) is just four times (for example, for the virtual
[0009]
The number of
[0010]
The present invention has been made in view of the above, and suppresses the occurrence of an operation speed bottleneck (device) of the arbiter unit 41 even when a low-speed line is accommodated. It is an object of the present invention to provide a cell switch and a cell switching method capable of realizing a line accommodation function.
[0011]
[Means for Solving the Problems]
In order to achieve the above object, a cell switch according to the present invention includes an input buffer unit that stores cells input from an input port in a plurality of virtual output queues prepared for each destination and output line, and a cell from the input buffer unit. An arbiter unit that performs output arbitration between the virtual output queues based on accumulated information, a switch unit that transfers cells input from the input buffer unit to an output port that accommodates a destination outgoing line, and a high-speed output port. In a cell switch including a separation unit that sorts input cells to a low-speed destination outgoing line, the virtual output queue in the input buffer unit is divided into a plurality of groups, and the arbiter unit is provided for each of the plurality of groups. In the time division operation, arbitration is sequentially performed and only the virtual output queue in the group that has been arbitrated is set to be arbitrated. And permits the output of.
[0012]
According to the present invention, the number of cell transfer paths can be apparently made the same as that when the high-speed line is accommodated by the time-sharing operation divided into groups, that is, the conditions at the time of arbitration (arbitration time and the number of cell transfer paths) are changed to the high-speed line. It can be made the same as the case of accommodation, and the occurrence of an operation speed bottleneck of the arbiter unit (device) can be suppressed.
[0013]
A cell switch according to the next invention is characterized in that, in the above invention, the separation unit performs a time division operation.
[0014]
According to the present invention, the function of distributing by referring to the cell header is not required by executing the time-sharing operation of grouping in this separation unit, and the cell rate addressed to each group input to the separation unit is set to the low-speed line (outgoing). Since the cell rate on the line is the same and constant, there is no need to increase the capacity of the speed conversion buffer, and only a small-capacity speed conversion buffer needs to be prepared.
[0015]
A cell switch according to the next invention is characterized in that, in the above invention, a multiplexing unit for multiplexing a plurality of low-speed input lines to a high-speed input port is provided.
[0016]
According to the present invention, a low-speed incoming line can be made high-speed, so that a different-speed line accommodating function can be obtained.
[0017]
The cell switch according to the next invention is the cell switch according to the above invention, wherein the time slot information of the time division operation is input using the cell header, between the input buffer unit and the arbiter unit, between the input buffer unit and the switch unit, and between the switch unit and the separation unit. The transmission is performed during at least one of the intervals.
[0018]
According to the present invention, erroneous group recognition is avoided without adding a separate line (control line), and the entire system operates normally in cooperation.
[0019]
In the cell switch according to the next invention, the time slot information of the time-division operation is input between the input buffer unit and the arbiter unit using the control line provided separately from the data line for cell transmission. Transmission is performed between the buffer unit and the switch unit and between at least one of the switch unit and the separation unit.
[0020]
According to the present invention, the time slot information of the time division operation is managed separately from the data by the control line, and it is not necessary to occupy a part of the information area in the cell header for the time slot information. Can be diverted for use.
[0021]
A cell switch according to the next invention is characterized in that in the above invention, the cell switch has a time slot information generating means, and performs a time division operation according to the time slot information distributed from the time slot information generating means.
[0022]
According to the present invention, the time slot information generation unit centrally manages / distributes the time slot information serving as a reference for the time division operation of each unit, so that the group name of a plurality of cells input from each input buffer unit can be obtained. The waiting time until all the same groups in the switch unit are completed can be minimized.
[0023]
A cell switch according to the next invention is characterized in that, in the above invention, flag information indicating a specific time slot is used as time slot information.
[0024]
According to the present invention, erroneous recognition of a group can be avoided, and the entire system can operate normally in cooperation.
[0025]
A cell switch according to the next invention is characterized in that, in the above invention, a time slot number is used as time slot information.
[0026]
According to the present invention, erroneous recognition of a group can be avoided, and the entire system can operate normally in cooperation.
[0027]
A cell switch according to the next invention is characterized in that, in the above invention, the operation / stop of the time division operation of the arbiter unit can be selected for each output port.
[0028]
According to the present invention, the transmission speed of the accommodated output line (or the presence or absence of the separation unit) can be set for each output port, and the high-speed line and the low-speed line can be freely mixed and accommodated in the cell switch.
[0029]
A cell switching method according to the next invention comprises a cell storing step of storing cells input from an input port in a plurality of virtual output queues prepared for each destination and an outgoing line; and a storage information of the cells stored in the cell storing step. An arbitration step of performing output arbitration between the virtual output queues based on the above, a switching step of transferring a cell input from the virtual output queue to an output port accommodating a destination outgoing line, and a high-speed input from the output port. A plurality of groups for the virtual output queue, wherein the arbitration step is performed by a time-sharing operation for each group of the plurality of groups. The arbitration is sequentially performed, and the cell output is permitted only to the virtual output queue in the arbitrated group.
[0030]
According to the present invention, the conditions at the time of arbitration (arbitration time and the number of cell transfer paths) can be made the same as those at the time of accommodating the high-speed line by the time-sharing operation divided into groups, and the operation speed (device) of the arbiter unit becomes a bottleneck. The occurrence can be suppressed.
[0031]
A cell exchange method according to the next invention is characterized in that in the above invention, a time division operation is performed in the separation step.
[0032]
According to the present invention, by executing the grouped time-sharing operation also in this separation step, the step of distributing with reference to the cell header becomes unnecessary, and the cell rate addressed to each group input to the separation step is reduced by the low-speed line (outgoing). Since the cell rate on the line is the same and constant, there is no need to increase the capacity of the speed conversion buffer, and only a small-capacity speed conversion buffer needs to be prepared.
[0033]
The cell switching method according to the next invention is characterized in that, in the above invention, a multiplexing step of multiplexing a plurality of low-speed incoming lines to a high-speed input port is provided.
[0034]
According to the present invention, a low-speed incoming line can be made high-speed, so that a different-speed line accommodating function can be obtained.
[0035]
BEST MODE FOR CARRYING OUT THE INVENTION
Hereinafter, preferred embodiments of the present invention will be described in detail with reference to the accompanying
[0036]
FIG. 1 is a diagram showing a configuration example of a cell switch according to a first embodiment of the present invention. In FIG. 1,
[0037]
As described above and shown in FIG. 1, the basic block configuration of the first embodiment of the present invention is almost the same as that of the conventional example shown in FIG. 8, but the operation of
[0038]
In the above-described cell switch, cells input from each
[0039]
Here, the
[0040]
The
[0041]
If the example of the configuration of the cell switch shown in FIG. 1 is rewritten focusing on the logical operation, the configuration becomes as shown in FIG. In other words, it is logically equivalent to four independent cell switches having the
[0042]
By such a time-sharing operation, the number of
[0043]
By the way, the conventional method, in which all
[0044]
Further, by the above-described time division operation, the cells belonging to the groups A to D and destined for the low-speed outgoing line 13 are sequentially input to the separation unit 6 at every one cell time (time slot). Focusing on one group, the cell rate addressed to the group input to the demultiplexing unit 6 is the same and constant as the cell rate on the low-speed line (outgoing line). There is no need to mount the buffer, and it is only necessary to prepare a small-capacity speed conversion buffer 7 of about 1 to 2 cells for converting the physical transmission speed from a high-speed line to a low-speed line (the buffer overflow does not occur even with a small capacity). can get.
[0045]
In the time-sharing operation, in order to avoid erroneous group recognition and to operate the entire system normally in cooperation, it is necessary to specify the group name of the cell transmitted between the units by some method. That is, it is necessary to be able to determine the group name of the cell on the receiving side of the cell. Here, FIGS. 4 and 5 show two typical methods of the explicit method of the group name. In the "flag information method" shown in FIG. 4, as time slot information, for example, flag information such as "1" for cells belonging to group A and "0" for cells belonging to other groups is used. use. On the other hand, in the “time slot number system” shown in FIG. 5, a time slot number (= group name) is used as time slot information.
[0046]
Although FIGS. 4 and 5 show a method of transmitting flag information or a time slot number using a cell header, such information is not a cell header but a control provided separately from a data line for cell transmission. Transmission may be performed using a line.
[0047]
Next, a second embodiment of the present invention will be described. FIG. 3 is a diagram showing a configuration example of the cell switch according to the second embodiment of the present invention. Each component of the cell switch according to the second embodiment operates basically in the same manner as each component of the cell switch according to the first embodiment shown in FIG. Here, the second embodiment is characterized in that an outgoing line having a high transmission speed (high-speed line) and an outgoing line having a low transmission speed (low-speed line) are mixed, and the outgoing line transmission speed setting distributed to each section is provided. According to the information, the transmission speed of the accommodated output line 13 (or the presence or absence of the separation unit 6) can be set for each output port 12. The configuration of the
[0048]
In such a configuration of the second embodiment, the
[0049]
By such an operation, the effect that the high-speed line and the low-speed line can be freely mixed and accommodated in the cell switch (realization of the different-speed line accommodating function) can be obtained.
[0050]
Next, a third embodiment of the present invention will be described. FIG. 6 is a diagram showing a part of a configuration example of the cell switch according to the third embodiment of the present invention. In FIG. 6, the
[0051]
In the configuration shown in FIG. 6, the basic cell exchange operation itself is the same as in the first or second embodiment. However, the third embodiment is characterized in that the time slot
[0052]
Also, by centrally managing the operation timing of the entire system, the group name of the cell transmitted between the units can be specified from the time slot information from the time slot
[0053]
In the first to third embodiments, the number of the output ports 12 and the number of the outgoing lines 13 is three, but the number is not particularly limited, and may be any number.
[0054]
In the first to third embodiments, the multiplexing number (the number of time slots for the time division operation) in the
[0055]
【The invention's effect】
As described above, according to the present invention, an input buffer unit for storing cells input from an input port in a plurality of virtual output queues prepared for each destination and outgoing line, and cell storage information from the input buffer unit An arbiter unit that performs output arbitration between the virtual output queues, a switch unit that transfers cells input from the input buffer unit to an output port that accommodates a destination outgoing line, and a high-speed input port that is input from the output port. In a cell switch having a separation unit for distributing cells to a low-speed destination outgoing line, the virtual output queue in the input buffer unit is divided into a plurality of groups, and the arbiter unit is time-divided for each of the plurality of groups. In operation, arbitration is sequentially performed, and cell output is permitted only to the virtual output queue in the group that has been arbitrated. Thus, the number of cell transfer paths can be apparently made the same as that when the high-speed line is accommodated by the group-divided time-sharing operation. That is, the arbitration conditions (arbitration time and the number of cell transfer paths) are the same as when the high-speed line is accommodated. It can be made the same, and the occurrence of the operation speed bottleneck (of the device) of the arbiter unit can be suppressed.
[0056]
According to the next invention, by performing the time-sharing operation in the separation unit, the function of sorting by referring to the cell header by executing the grouped time-sharing operation also in this separation unit becomes unnecessary. Since the cell rate to be input to each group is the same and constant as the cell rate on the low-speed line (outgoing line), it is not necessary to increase the capacity of the speed conversion buffer, and it is only necessary to prepare a small-capacity speed conversion buffer.
[0057]
According to the next invention, by providing a multiplexing unit for multiplexing a plurality of low-speed incoming lines to a high-speed input port, a low-speed incoming line can be made high-speed, so that a function of accommodating a different speed line is obtained.
[0058]
According to the next invention, using the cell header, the time slot information of the time-division operation is input between the input buffer unit and the arbiter unit, between the input buffer unit and the switch unit, and between at least one of the switch unit and the separation unit. In this way, erroneous group recognition is avoided without adding a separate line (control line), and the entire system operates normally in cooperation.
[0059]
According to the next invention, by using a control line provided separately from the data line for cell transmission, the time slot information of the time division operation is input between the input buffer unit and the arbiter unit, between the input buffer unit and the switch unit, And transmission between at least one of the switch unit and the separation unit, the time slot information of the time division operation is managed separately from the data by the control line, and a part of the information area in the cell header is timed. There is no need to occupy slot information, and it can be used for other information.
[0060]
According to the next invention, a time slot information generating unit is provided, and a time division operation is performed in accordance with the time slot information distributed from the time slot information generating unit, whereby a plurality of cells input from each input buffer unit are The group names can be made one, and the waiting time until all the same groups in the switch unit are made can be minimized.
[0061]
According to the next invention, by using the flag information indicating a specific time slot as the time slot information, erroneous recognition of a group can be avoided and the entire system can operate normally in cooperation.
[0062]
According to the next invention, by using the time slot number as the time slot information, erroneous recognition of the group can be avoided and the entire system can operate normally in cooperation.
[0063]
According to the next invention, since the operation / stop of the time-division operation of the arbiter unit can be selected for each output port, the transmission speed of the accommodated output line (or the presence or absence of the separation unit) can be set for each output port, and high speed Lines and low-speed lines can be freely accommodated in cell switches.
[0064]
According to the next invention, a cell storage step of storing cells input from an input port in a plurality of virtual output queues prepared for each destination outgoing line, and based on accumulated information of the cells stored in the cell storage step An arbitration step of performing output arbitration between the virtual output queues, an exchange step of transferring a cell input from the virtual output queue to an output port accommodating a destination outgoing line, and a high-speed cell input from the output port. In the cell switching method provided with a separation step of distributing to a low-speed destination outgoing line, the virtual output queue is divided into a plurality of groups, and the arbitration step is arbitrated in order by time division operation for each of the plurality of groups. By allowing cells to be output only to the virtual output queues within the group targeted for arbitration, Arbitration when conditions (arbitration time and the cell number of transfer path) can be the same as during high-speed line container by suppressing the generation of (the device) the operating speed neck of the arbiter portion.
[0065]
According to the next invention, by performing the time-sharing operation of grouping also in this separation step, the step of distributing by referring to the cell header becomes unnecessary, and the cell rate to each group input to the separation step is set to the low-speed line ( Since the cell rate on the outgoing line is the same and constant, there is no need to increase the capacity of the speed conversion buffer, and only a small capacity speed conversion buffer needs to be prepared.
[0066]
According to the next invention, by providing a multiplexing step of multiplexing a plurality of low-speed incoming lines to a high-speed input port, a low-speed incoming line can be made high-speed, so that a function of accommodating a different speed line can be obtained.
[Brief description of the drawings]
FIG. 1 is a block diagram showing a configuration of a cell switch according to a first embodiment of the present invention.
FIG. 2 is a block diagram logically equivalent to the block diagram shown in FIG. 1;
FIG. 3 is a block diagram showing a configuration of a cell switch according to a second embodiment of the present invention.
FIG. 4 is an explanatory diagram of a method of transmitting flag information using a cell header.
FIG. 5 is an explanatory diagram of a method of transmitting a time slot number using a cell header.
FIG. 6 is a simplified block diagram showing a configuration of a cell switch according to a third embodiment of the present invention.
FIG. 7 is a block diagram showing a configuration of a conventional cell switch.
FIG. 8 is a block diagram showing a configuration of another conventional cell switch.
[Explanation of symbols]
1 multiplexing unit, 2 input buffer unit, 3 virtual output queue, 4 arbiter unit, 5 switch unit, 6 demultiplexing unit, 7 small capacity speed conversion buffer, 8 time slot information generation unit, 10 input lines, 11 input ports, 12 outputs Port, 13 outgoing line, 14 time slot information.
Claims (12)
前記入力バッファ部内の前記仮想出力キューについて複数のグループ分けをし、前記アービタ部は複数のグループの内各グループごとに時分割動作にて順番に調停の対象とすると共に調停の対象となったグループ内の前記仮想出力キューに対してのみセルの出力を許可することを特徴とするセルスイッチ。An input buffer for storing cells input from an input port in a plurality of virtual output queues prepared for each destination line, and output arbitration between the virtual output queues based on cell accumulation information from the input buffer. An arbiter unit, a switch unit for transferring cells input from the input buffer unit to an output port accommodating a destination outgoing line, and a separating unit for distributing cells input from the high-speed output port to a low-speed destination outgoing line. In the equipped cell switch,
The virtual output queue in the input buffer unit is divided into a plurality of groups, and the arbiter unit is subjected to arbitration sequentially and time-divisionally for each of the plurality of groups, and the arbitration target group Wherein the cell output is permitted only to the virtual output queue in the cell switch.
前記仮想出力キューについて複数のグループ分けをし、前記調停工程は複数のグループの内各グループごとに時分割動作にて順番に調停の対象とすると共に調停の対象となったグループ内の前記仮想出力キューに対してのみセルの出力を許可することを特徴とするセル交換方法。A cell storing step of storing cells input from an input port into a plurality of virtual output queues prepared for each destination line, and an output between the virtual output queues based on accumulated information of the cells stored in the cell storing step An arbitration step of performing arbitration; a switching step of transferring cells input from the virtual output queue to an output port accommodating a destination output line; and distributing cells input from the high-speed output port to a low-speed destination output line. In a cell exchange method including a separation step,
The virtual output queue is divided into a plurality of groups, and the arbitration step is to sequentially perform arbitration in a time-sharing operation for each group among the plurality of groups and to perform the virtual output in the group to be arbitrated. A cell switching method, wherein cell output is permitted only to a queue.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2002177725A JP3880890B2 (en) | 2002-06-18 | 2002-06-18 | Cell switch and cell replacement method |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2002177725A JP3880890B2 (en) | 2002-06-18 | 2002-06-18 | Cell switch and cell replacement method |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2004023572A true JP2004023572A (en) | 2004-01-22 |
JP3880890B2 JP3880890B2 (en) | 2007-02-14 |
Family
ID=31175678
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2002177725A Expired - Fee Related JP3880890B2 (en) | 2002-06-18 | 2002-06-18 | Cell switch and cell replacement method |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP3880890B2 (en) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2013005158A (en) * | 2011-06-15 | 2013-01-07 | Nippon Telegr & Teleph Corp <Ntt> | Packet switch and packet scheduling method |
-
2002
- 2002-06-18 JP JP2002177725A patent/JP3880890B2/en not_active Expired - Fee Related
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2013005158A (en) * | 2011-06-15 | 2013-01-07 | Nippon Telegr & Teleph Corp <Ntt> | Packet switch and packet scheduling method |
Also Published As
Publication number | Publication date |
---|---|
JP3880890B2 (en) | 2007-02-14 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
JP2618327B2 (en) | Wideband input buffer ATM switch | |
EP1045558B1 (en) | Very wide memory TDM switching system | |
US7023841B2 (en) | Three-stage switch fabric with buffered crossbar devices | |
EP1779607B1 (en) | Network interconnect crosspoint switching architecture and method | |
JP2788577B2 (en) | Frame conversion method and apparatus | |
US7161906B2 (en) | Three-stage switch fabric with input device features | |
US6633580B1 (en) | N×N crossbar packet switch | |
US6137807A (en) | Dual bank queue memory and queue control system | |
US6781986B1 (en) | Scalable high capacity switch architecture method, apparatus and system | |
US9602436B2 (en) | Switching device | |
US7995472B2 (en) | Flexible network processor scheduler and data flow | |
US7324537B2 (en) | Switching device with asymmetric port speeds | |
JP2000261506A (en) | Large capacity rate-controlled packet switch of multi- class | |
US7352766B2 (en) | High-speed memory having a modular structure | |
KR20040038028A (en) | Multiple Input/Output-Queued Switch | |
US7126959B2 (en) | High-speed packet memory | |
EP1070408A1 (en) | Ampic dram system in a telecommunication switch | |
WO2010004257A1 (en) | Switching device, method and computer program | |
US7218638B2 (en) | Switch operation scheduling mechanism with concurrent connection and queue scheduling | |
EP0982898B1 (en) | Switching apparatus comprising at least one switch core access element for the attachment of various protocol adapters | |
US5757799A (en) | High speed packet switch | |
JP3880890B2 (en) | Cell switch and cell replacement method | |
KR970002817B1 (en) | Link sharing control unit by vp in atm network | |
WO1996005558A1 (en) | A network switch | |
WO2010040983A1 (en) | Switching device |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20050524 |
|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20061101 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20061107 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20061108 |
|
R150 | Certificate of patent or registration of utility model |
Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20091117 Year of fee payment: 3 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20101117 Year of fee payment: 4 |
|
LAPS | Cancellation because of no payment of annual fees |