JP2003169470A - Power supply unit and feeding system - Google Patents
Power supply unit and feeding systemInfo
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Abstract
Description
【0001】[0001]
【発明の属する技術分野】本発明は、特に複写機/プリ
ンタ等の画像形成装置に代表される電子機器に用いられ
もので、一つの電源装置にて、複数の負荷に電源電圧を
供給する集中型給電を行う電源装置及び給電システムに
関する。BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention is used for an electronic apparatus represented by an image forming apparatus such as a copying machine / printer, in which one power supply unit supplies power supply voltage to a plurality of loads. The present invention relates to a power supply device and a power supply system that perform mold power supply.
【0002】[0002]
【従来の技術】近年、複写機/プリンタ等の画像形成装
置において、デジタル化、ネットワーク化が進んでい
る。これらの装置においては、画像処理を司る為のボー
ド、画像形成を司る為のボード、通信を司る為のボード
等、複数のボードで構成される事が多い。また、半導体
微細加工技術の進歩によりCPU/ASIC等のデジタ
ル素子の高集積化が進み、電源電圧も、低電圧化が一層
進んでいる。低電圧化が進み、電源の絶対電圧精度要求
(±50mV等)も厳しくなってきている。2. Description of the Related Art In recent years, image forming apparatuses such as copying machines / printers have been digitized and networked. These devices are often composed of a plurality of boards such as a board for controlling image processing, a board for controlling image formation, and a board for controlling communication. Further, due to advances in semiconductor microfabrication technology, high integration of digital elements such as CPU / ASIC is progressing, and power supply voltage is further decreasing. As the voltage is becoming lower, the absolute voltage accuracy requirement (± 50 mV, etc.) of the power supply is becoming stricter.
【0003】従来は、図5に示すように、単純に複数の
負荷ボード(負荷1〜負荷4)に対して束線により並列
接続していて問題なかったが、近年の低電圧化傾向の状
況下で、束線による電圧降下が問題視されるようになっ
た。Conventionally, as shown in FIG. 5, there was no problem in simply connecting in parallel to a plurality of load boards (load 1 to load 4) with a bundled wire, but in recent years the trend of low voltage Below, the voltage drop due to the bundling became problematic.
【0004】(1)そこで、図5に示すように、Z0〜
Z4で記した束線/コネクタ等のインピーダンスを低減
するために束線をより太く短くすることで、電圧降下を
防ぐ工夫をしている。(1) Therefore, as shown in FIG.
In order to reduce the impedance of the bundled wire / connector, etc. indicated by Z4, the bundled wire is made thicker and shorter to prevent voltage drop.
【0005】(2)また、図6に示すように、最も電圧
精度要求の厳しい負荷ボード負荷1の入力部の電圧を検
出して、そこの電圧が一定になるようにDC電源の出力
電圧を制御するリモートセンス技術を用いる方法も行わ
れている。(2) Further, as shown in FIG. 6, the voltage of the input portion of the load board load 1 for which the highest voltage accuracy is required is detected, and the output voltage of the DC power supply is adjusted so that the voltage becomes constant. Methods using remote sense technology to control are also practiced.
【0006】(3)更にまた、図7に示すように、各負
荷ボード上またはその入力部に独立のDC/DCコンバ
ータを配置して、ボード毎に独立して電源電圧を制御す
る方法も用いられている。(3) Furthermore, as shown in FIG. 7, a method is also used in which an independent DC / DC converter is arranged on each load board or on its input section and the power supply voltage is independently controlled for each board. Has been.
【0007】[0007]
【発明が解決しようとする課題】然しながら上述の従来
例において、上記(1)においては、各負荷ボードの電
装に大きな制約が発生したり、束線加工/配線のコスト
がアップし、また、実装面積が大きくなる等の欠点があ
る。However, in the above-mentioned conventional example, in the above-mentioned (1), there are great restrictions on the electrical equipment of each load board, the cost of wire bundle processing / wiring increases, and There are drawbacks such as an increase in area.
【0008】上記(2)においては、負荷1の入力電圧
のみは保証されるが、他の負荷(負荷2〜負荷4)につ
いては全く保証されない事になる。In the above (2), only the input voltage of the load 1 is guaranteed, but the other loads (load 2 to load 4) are not guaranteed at all.
【0009】上記(3)においては、コスト、実装面積
において不利である。The above item (3) is disadvantageous in cost and mounting area.
【0010】本発明は、上述の事情に鑑みて成されたも
ので、各負荷ボードの入力部の電圧をそれぞれ検出する
為の電圧検出線を設け、それぞれの電圧検出値を基に、
最適なDC電源出力(Vo)を決定・制御可能な小型・
低コストの電源装置及び給電システムを提供することを
目的とする。The present invention has been made in view of the above circumstances and is provided with a voltage detection line for detecting the voltage of the input section of each load board, and based on each voltage detection value,
Small size that can determine and control the optimum DC power output (Vo)
An object is to provide a low-cost power supply device and power supply system.
【0011】[0011]
【課題を解決するための手段】本発明は、下記構成を備
えることにより上記課題を解決できるものである。The present invention can solve the above-mentioned problems by providing the following constitutions.
【0012】(1)複数の負荷ボードに共通の電源電圧
を供給する電源装置であって、複数の負荷装置の入力部
の電圧を検出する複数のリモート検出手段と、該リモー
ト検出手段により得られた複数の検出値より、前記電源
装置の出力電圧を決定し、出力する出力手段と、該出力
手段に定電圧制御を行う定電圧制御手段と、を備えたこ
とを特徴とする電源装置。(1) A power supply device for supplying a common power supply voltage to a plurality of load boards, which is obtained by a plurality of remote detecting means for detecting a voltage of an input portion of the plurality of load devices and the remote detecting means. A power supply device comprising: output means for determining and outputting the output voltage of the power supply device based on a plurality of detected values; and constant voltage control means for performing constant voltage control on the output means.
【0013】(2)前項(1)記載の電源装置におい
て、前記複数の検出値の平均値を計算し、該計算値が、
予め決めておいた値となるように電源装置の出力電圧を
決定することを特徴とする電源装置。(2) In the power supply device described in (1) above, an average value of the plurality of detected values is calculated, and the calculated value is
A power supply device, characterized in that the output voltage of the power supply device is determined so as to be a predetermined value.
【0014】(3)前項(1)記載の電源装置におい
て、前記複数の検出値とそれぞれ予め決めておいた目標
値との差の自乗和(=分散σ)を計算し、該計算値が、
予め決めておいた値以下となるように、電源装置の出力
電圧を決定することを特徴とする電源装置。(3) In the power supply device described in (1) above, the sum of squares (= variance σ) of the differences between the plurality of detected values and the predetermined target values is calculated, and the calculated values are
A power supply device characterized in that the output voltage of the power supply device is determined so as to be equal to or less than a predetermined value.
【0015】(4)前項(1)記載の電源装置におい
て、前記複数の検出値とそれぞれ予め決めておいた目標
値との差の自乗に予め決めておいた重み付け係数倍した
値の和を(=重み付き分散σ′)を計算し、該計算値
が、予め決めておいた値以下となるように、電源装置の
出力電圧を決定することを特徴とする電源装置。(4) In the power supply device described in the above item (1), the sum of squares of differences between the plurality of detected values and predetermined target values multiplied by a predetermined weighting coefficient is calculated as = Weighted variance σ ') is calculated, and the output voltage of the power supply device is determined such that the calculated value is equal to or less than a predetermined value.
【0016】(5)複数の負荷ボードに共通の電源電圧
を供給する給電システムであって、複数の負荷装置の入
力部の電圧を検出する複数のリモート検出手段と、該リ
モート検出手段により得られた複数の検出値より、前記
電源装置の出力電圧を決定し、出力する出力手段と、該
出力手段に定電圧制御を行う定電圧制御手段と、を備
え、前記複数の検出値の平均値を計算し、該計算値が、
予め決めておいた値となるように電源装置の出力電圧を
決定するか、または前記複数の検出値とそれぞれ予め決
めておいた目標値との差の自乗和(=分散σ)を計算
し、該計算値が、予め決めておいた値以下となるよう
に、電源装置の出力電圧を決定するか、または前記複数
の検出値とそれぞれ予め決めておいた目標値との差の自
乗に予め決めておいた重み付け係数倍した値の和を(=
重み付き分散σ′)を計算し、該計算値が、予め決めて
おいた値以下となるように、電源装置の出力電圧を決定
することを特徴とする給電システム。(5) A power supply system for supplying a common power supply voltage to a plurality of load boards, wherein a plurality of remote detection means for detecting a voltage of an input portion of a plurality of load devices and a remote detection means are provided. The output voltage of the power supply device is determined from a plurality of detected values and output, and a constant voltage control means for performing a constant voltage control on the output means, and an average value of the plurality of detected values. And the calculated value is
Determine the output voltage of the power supply device so as to be a predetermined value, or calculate the sum of squares (= variance σ) of the difference between each of the plurality of detected values and a predetermined target value, The output voltage of the power supply device is determined so that the calculated value is less than or equal to a predetermined value, or the difference between the plurality of detection values and the predetermined target value is squared. The sum of the multiplied weighting factors ((=
A power supply system, characterized in that a weighted variance σ ′) is calculated, and the output voltage of the power supply device is determined so that the calculated value is equal to or less than a predetermined value.
【0017】即ち、図1に示すように、各負荷ボード
(負荷1〜負荷4)の入力部の電圧V1〜V4をそれぞ
れ検出し、その値より最適なDC電源出力電圧Voを決
定し定電圧制御する。That is, as shown in FIG. 1, the voltages V1 to V4 at the input portions of the respective load boards (load 1 to load 4) are detected, and the optimum DC power supply output voltage Vo is determined from the detected values to determine the constant voltage. Control.
【0018】[0018]
【発明の実施の形態】以下、本発明の電源装置及び給電
システムの実施の形態を説明する。BEST MODE FOR CARRYING OUT THE INVENTION Embodiments of a power supply device and a power feeding system of the present invention will be described below.
【0019】図1は、実施例1における電源装置の全体
構成を示すブロック図、図2は、実施例1における電源
装置の詳細構成例を示すブロック図、図3は、実施例1
における給電システムの動作を示すフローチャート(メ
インルーチン)、図4は、実施例1における給電システ
ムの動作を示すフローチャート(サブルーチン1)、図
5は、従来例1における電源装置の構成例を示すブロッ
ク図、図6は、従来例2における電源装置の構成例を示
すブロック図、図7は、従来例3における電源装置の構
成例を示すブロック図、図8は、実施例2における給電
システムの動作を示すフローチャート(サブルーチ
ン)、図9は、実施例2における給電システムの動作を
示すフローチャート(サブルーチン)である。FIG. 1 is a block diagram showing the overall configuration of a power supply device according to the first embodiment, FIG. 2 is a block diagram showing a detailed configuration example of the power supply device according to the first embodiment, and FIG.
4 is a flowchart (main routine) showing the operation of the power supply system in FIG. 4, FIG. 4 is a flowchart showing the operation of the power supply system in the first embodiment (subroutine 1), and FIG. 5 is a block diagram showing a configuration example of the power supply device in the first conventional example. FIG. 6 is a block diagram showing a configuration example of a power supply device in Conventional Example 2, FIG. 7 is a block diagram showing a configuration example of a power supply device in Conventional Example 3, and FIG. 8 is an operation of the power supply system in Example 2. 9 is a flowchart (subroutine) showing the operation of the power supply system in the second embodiment.
【0020】最適なDC電源出力電圧Voの決定方法と
して、
(1) V1〜V2の平均値が、所定の値となるように
する。
(2) 各負荷ボードの電源電圧許容中心値からのバラ
ツキが最小となるようにする(分散最小化)。
(3) 各負荷ボードの電圧精度要求が異なる場合など
に、負荷ボード毎に要求精度に応じた重み付けをして、
電源電圧許容中心値からの分散が最小になるようにする
(重み付き分散最小化)、等の方法が考えられる。As a method for determining the optimum DC power supply output voltage Vo, (1) the average value of V1 and V2 is set to a predetermined value. (2) Minimize the variation from the power supply voltage allowable center value of each load board (dispersion minimization). (3) When the voltage accuracy requirements of each load board are different, weighting is performed according to the required accuracy for each load board,
A method such as minimizing the variance from the power supply voltage allowable center value (minimization of weighted variance) can be considered.
【0021】(実施例1)図2において、T1は、スイ
ッチング電源トランスであり、一次巻線N11、二次巻
線N21より構成される。商用電源Vin(AC)をダ
イオードブリッジDB1により整流し、平滑コンデンサ
C1により平滑して直流電圧Vin(DC)を得る。電
解効果トランジスタ(FET)Q1により、平滑コンデ
ンサC1に充電された直流電圧Vin(DC)を高周波
スイッチングしてトランス一次巻線N11に印加する。
すると、トランス二次巻線N21には、前記電解効果ト
ランジスタQ1によりN11巻線に印加した高周波パル
スと同期したパルス電圧が発生する。これを、ダイオー
ドD11,D12、チョークコイルL11,平滑コンデ
ンサC11で整流平滑して直流電圧Voを得る。(Embodiment 1) In FIG. 2, T1 is a switching power supply transformer, which is composed of a primary winding N11 and a secondary winding N21. The commercial power source Vin (AC) is rectified by the diode bridge DB1 and smoothed by the smoothing capacitor C1 to obtain the DC voltage Vin (DC). The DC voltage Vin (DC) charged in the smoothing capacitor C1 is high-frequency switched by the field effect transistor (FET) Q1 and applied to the transformer primary winding N11.
Then, a pulse voltage synchronized with the high frequency pulse applied to the N11 winding by the field effect transistor Q1 is generated in the transformer secondary winding N21. This is rectified and smoothed by the diodes D11 and D12, the choke coil L11, and the smoothing capacitor C11 to obtain the DC voltage Vo.
【0022】選択手段51は、DSP(Digital Signal
Processor)55からの検出点選択信号に応じて、Vo
または、後述する電圧検出線1〜4のいずれかを選択し
てフィルタ回路52に接続する。フィルタ回路52の出
力は、サンプル・ホールド回路53を通して、A/Dコ
ンバータ54にてデジタルデータに変換され、DSP5
5に入力される。The selection means 51 is a DSP (Digital Signal).
Vo) in response to the detection point selection signal from the processor 55.
Alternatively, one of the voltage detection lines 1 to 4 described below is selected and connected to the filter circuit 52. The output of the filter circuit 52 is converted into digital data by the A / D converter 54 through the sample and hold circuit 53, and the DSP 5
Input to 5.
【0023】尚、DSP55内での動作アルゴリズム
は、後述する。The operation algorithm in the DSP 55 will be described later.
【0024】DSP55にて生成されたPWM信号によ
り、トランジスタQ21,トランスT21を用いて前記
電解効果トランジスタ(FET)Q1のスイッチングの
オン/オフ時比率(デューティー)を制御することで、
前記Voを所定の電圧に定電圧制御する事を実現する。By controlling the ON / OFF time ratio (duty) of switching of the field effect transistor (FET) Q1 by using the transistor Q21 and the transformer T21 by the PWM signal generated by the DSP 55,
A constant voltage control of the Vo to a predetermined voltage is realized.
【0025】次に、前記電圧検出線1〜4について、図
1を用いて説明する。Next, the voltage detection lines 1 to 4 will be described with reference to FIG.
【0026】図1において、DC電源は、前述の図2で
説明したスイッチング電源を表す。In FIG. 1, the DC power supply represents the switching power supply described in FIG.
【0027】DC電源の出力は配線材などを用いて、負
荷1〜負荷4で表す4枚のプリント板ユニット(CPU
ボード等)に接続される。The output of the DC power source uses a wiring material or the like to represent four printed board units (CPU 1 to load 4).
Board).
【0028】図においてZ0〜Z4は、配線、接続コネ
クタ等によるラインインピーダンスを表しており、特に
Z0は共通インピーダンスであり、Z1は、負荷1への
配線などのみに起因するラインインピーダンスである。
Z2〜Z4についても同様である。In the figure, Z0 to Z4 represent line impedances due to wirings, connecting connectors, etc. In particular, Z0 is a common impedance, and Z1 is a line impedance resulting only from wiring to the load 1.
The same applies to Z2 to Z4.
【0029】負荷1の電源入力点での電圧V1を電圧検
出線1によりDC電源に取り込み、図2の選択手段51
に接続する。負荷2〜負荷4についても同様に、電源入
力点での電圧V2〜V4を電圧検出線2〜4によりDC
電源に取り込み、図2の選択手段51に接続する。The voltage V1 at the power source input point of the load 1 is taken into the DC power source through the voltage detection line 1, and the selection means 51 of FIG.
Connect to. Similarly, for the loads 2 to 4, the voltages V2 to V4 at the power source input point are converted to DC by the voltage detection lines 2 to 4.
It is taken into the power source and connected to the selection means 51 of FIG.
【0030】次に、前記DSP55内の動作アルゴリズ
ムの一例について、図3を用いて説明する。Next, an example of the operation algorithm in the DSP 55 will be described with reference to FIG.
【0031】(1)各負荷ボード入力部の電圧の平均値
Dが、RefA<D<RefBとなるように、DC電源
の出力電圧Voの制御下限電圧Ref1、上限電圧Re
f2を決定する。(1) The control lower limit voltage Ref1 and the upper limit voltage Re of the output voltage Vo of the DC power supply are set so that the average value D of the voltage of each load board input section becomes RefA <D <RefB.
Determine f2.
【0032】先ず、ステップS301で、カウンタリセ
ット(X=0、Y=0、Z=0)し、ステップS302
でカウントアップ(Z=Z+1)を開始し、ステップS
303で、カウンタZが、予め決めておいた値Z0より
大きい場合には、ステップS304へ進み、サブルーチ
ン1(Ref1、Ref2の決定)へ移行する。First, in step S301, the counter is reset (X = 0, Y = 0, Z = 0), and step S302.
Starts counting up (Z = Z + 1) with step S
If the counter Z is larger than the predetermined value Z0 in 303, the process proceeds to step S304 and the subroutine 1 (determination of Ref1 and Ref2) is performed.
【0033】サブルーチン1の動作について、図4を参
照して説明する。The operation of the subroutine 1 will be described with reference to FIG.
【0034】選択手段51により電圧検出線1〜電圧検
出線4を順次選択して、各負荷ボード入力部の電圧V1
〜V4をフィルタ回路52、サンプル・ホールド回路5
3を通して、A/Dコンバータ54に取り込み、デジタ
ルデータD1〜D4とする。D=1/4*(D1+D2
+D3+D4)を計算して各負荷ボード入力部電圧の平
均値Dを得る。The voltage detecting line 1 to the voltage detecting line 4 are sequentially selected by the selecting means 51, and the voltage V1 of each load board input portion is selected.
~ V4 is a filter circuit 52, a sample and hold circuit 5
3 through 3, it is taken into the A / D converter 54 and converted into digital data D1 to D4. D = 1/4 * (D1 + D2
+ D3 + D4) is calculated to obtain the average value D of each load board input voltage.
【0035】RefA≧Dならば、Ref1=Ref1
+1として、DC電源の出力電圧Vo1の制御下限電圧
Ref1をカウントアップし、Ref2=Ref2+1
として、DC電源の出力電圧Vo1の制御上限電圧Re
f2をカウントアップする。If RefA ≧ D, Ref1 = Ref1
The control lower limit voltage Ref1 of the output voltage Vo1 of the DC power supply is counted up as +1 and Ref2 = Ref2 + 1.
Is the control upper limit voltage Re of the output voltage Vo1 of the DC power supply.
Count up f2.
【0036】D≧RefBならば、Ref1=Ref1
−1として、DC電源の出力電圧Vo1の制御下限電圧
Ref1をカウントダウンし、Ref2=Ref2−1
として、DC電源の出力電圧Vo1の制御上限電圧Re
f2をカウントダウンする。If D ≧ RefB, Ref1 = Ref1
As -1, the control lower limit voltage Ref1 of the output voltage Vo1 of the DC power source is counted down, and Ref2 = Ref2-1.
Is the control upper limit voltage Re of the output voltage Vo1 of the DC power supply.
Count down f2.
【0037】RefA<D<RefBならば、Ref1
=Ref1として、DC電源の出力電圧Vo1の制御下
限電圧Ref1を保持し、Ref2=Ref2として、
DC電源の出力電圧Vo1の制御上限電圧Ref2を保
持する。上記による制御電圧下限Ref1、上限Ref
2を決定するプロセスを繰り返すことで、RefA<D
<RefBとなるように、DC電源の出力電圧Voの制
御下限電圧Ref1、上限電圧Ref2が決定される。If RefA <D <RefB, Ref1
= Ref1 holds the control lower limit voltage Ref1 of the output voltage Vo1 of the DC power supply, and Ref2 = Ref2 holds
The control upper limit voltage Ref2 of the output voltage Vo1 of the DC power supply is held. Control voltage lower limit Ref1 and upper limit Ref based on the above
By repeating the process of determining 2, RefA <D
The control lower limit voltage Ref1 and the upper limit voltage Ref2 of the output voltage Vo of the DC power supply are determined so that <RefB.
【0038】(2)そして、Ref1<Vo1<Ref
2となるような、前記電解効果トランジスタ(FET)
Q1のスイッチングのオン時間Ton、オフ時Toff
を決定する。(2) And Ref1 <Vo1 <Ref
2, the field effect transistor (FET)
Q1 switching on time Ton, off time Toff
To decide.
【0039】一方、ステップS303で、カウンタZ
が、予め決めておいた値Z0より小さい場合には、前記
選択手段51により、DC電源出力電圧Vo1を選択す
る(ステップS306)。フィルタ回路52、サンプル
・ホールド回路53を通して、A/Dコンバータ54に
取り込み(ステップS307)、デジタルデータD0
(ステップS308)とする。On the other hand, in step S303, the counter Z
Is smaller than a predetermined value Z0, the selecting means 51 selects the DC power output voltage Vo1 (step S306). The digital data D0 is taken into the A / D converter 54 through the filter circuit 52 and the sample and hold circuit 53 (step S307).
(Step S308).
【0040】D0とRef1を比較し(ステップS30
9)、D0≦Ref1ならば、カウンタXをカウントア
ップする(ステップS310)。カウンタXの値が予め
決めておいた値X0以下であれば(ステップS31
1)、再びD0を取り込む。カウンタXの値が予め決め
ておいた値Xoより大きければ、Tonを一つカウント
アップし、Toffを一つカウントダウンする(ステッ
プS312)。D0 and Ref1 are compared (step S30
9) If D0 ≦ Ref1, counter X is incremented (step S310). If the value of the counter X is less than or equal to a predetermined value X0 (step S31
1), D0 is taken in again. If the value of the counter X is larger than the predetermined value Xo, Ton is incremented by 1 and Toff is decremented by 1 (step S312).
【0041】ステップS309で、D0>Ref1であ
れば、ステップS313で、D0とRef2を比較す
る。D0≧Ref2であれば、カウンタYをカウントア
ップする(ステップS314)。カウンタYの値が予め
決めておいた値Y0以下であれば(ステップS31
5)、再びD0を取り込む。カウンタYの値が予め決め
ておいた値Y0より大きければ、ステップS316で、
Tonを一つカウントダウンし、Toffを一つカウン
トアップする。If D0> Ref1 in step S309, D0 and Ref2 are compared in step S313. If D0 ≧ Ref2, the counter Y is incremented (step S314). If the value of the counter Y is less than or equal to a predetermined value Y0 (step S31
5) Take D0 again. If the value of the counter Y is larger than the predetermined value Y0, in step S316,
Count down one Ton and count up Toff one.
【0042】Ref1<D0<Ref2であれば、To
n、Toffをそのままに保持する。If Ref1 <D0 <Ref2, To
Hold n and Toff as they are.
【0043】上記により決めたTon、ToffにてP
WMパルス信号を作成し(ステップS317)、それに
より、Q21,T21を用いて、前記電解効果トランジ
スタ(FET)Q1のスイッチングのオン/オフ時比率
(デューティー)を制御することで、前記選択されたV
oを所定の電圧に定電圧制御する。P at Ton and Toff determined above
A WM pulse signal is generated (step S317), and thereby the on / off time ratio (duty) of switching of the field effect transistor (FET) Q1 is controlled by using Q21 and T21. V
Constant voltage control of o to a predetermined voltage.
【0044】以上のように構成することで、各負荷ボー
ド入力部の電圧の平均値Dが、RefA<D<RefB
となるように、制御できる。With the above configuration, the average value D of the voltage of each load board input section is RefA <D <RefB.
Can be controlled so that
【0045】(実施例2)実施例2を図8に示す。Example 2 Example 2 is shown in FIG.
【0046】実施例2では、各負荷ボードの電源電圧許
容中心値からのバラツキが最小となるようにする(分散
最小化)。In the second embodiment, the variation from the power supply voltage allowable center value of each load board is minimized (dispersion minimization).
【0047】CPUやASIC等によっては入力電源の
電圧推奨値が異なる事がある。その場合には、単に平均
値をとるのではなく、各負荷ボード1〜4の推奨電圧を
Vs1〜Vs4として、以下の分散値σが最小になるよ
うに、DC電源出力電圧Voを設定する事が望ましい。The recommended voltage value of the input power source may differ depending on the CPU or ASIC. In that case, the DC power supply output voltage Vo should be set so that the following dispersion values σ are minimized by setting the recommended voltages of the load boards 1 to 4 as Vs1 to Vs4, instead of simply taking the average value. Is desirable.
【0048】σ=(V1−Vs1)2+(V2−Vs
2)2+(V3−Vs3)2+(V4−Vs4)2
以下に、サブルーチンのアルゴリズム例を記す(その他
は、実施例1と同一であり省略する)。Σ = (V1-Vs1) 2 + (V2-Vs
2) 2 + (V3-Vs3) 2 + (V4-Vs4) 2 Below, an algorithm example of the subroutine will be described (others are the same as in Example 1 and omitted).
【0049】各負荷ボード入力部の電圧の分散値σが、
予め決めておいた値RefCに対して、σ<RefCと
なるように、DC電源の出力電圧Voの制御下限電圧R
ef1、上限電圧Ref2を決定する。The variance value σ of the voltage of each load board input section is
The control lower limit voltage R of the output voltage Vo of the DC power supply is set so that σ <RefC with respect to a predetermined value RefC.
ef1 and the upper limit voltage Ref2 are determined.
【0050】サブルーチンの動作について、図8を参照
して説明する。The operation of the subroutine will be described with reference to FIG.
【0051】選択手段51により電圧検出線1〜電圧検
出線4を順次選択して、各負荷ボード入力部の電圧V1
〜V2をフィルタ回路52、サンプル・ホールド回路5
3を通して、A/Dコンバータ54に取り込み、デジタ
ルデータD1〜D4とする。各負荷ボード1〜4の推奨
電圧をVs1〜Vs4のデジタル表現値をDs1〜Ds
4として、記憶しておく。The voltage detecting line 1 to the voltage detecting line 4 are sequentially selected by the selecting means 51, and the voltage V1 of each load board input portion is selected.
~ V2 is a filter circuit 52, a sample and hold circuit 5
3 through 3, it is taken into the A / D converter 54 and converted into digital data D1 to D4. The recommended voltage of each load board 1 to 4 is the digital expression value of Vs1 to Vs4 is Ds1 to Ds.
It is stored as 4.
【0052】σ=(D1−Ds1)2+(D2−Ds
2)2+(D3−Ds3)2+(D4−Ds4)2
を計算し、RefCと比較する。Σ = (D1-Ds1) 2 + (D2-Ds
2) 2 + (D3-Ds3 ) 2 + (D4-Ds4) 2 was calculated and compared with RefC.
【0053】(a)σ≦RefCならば、Ref1=R
ef1として、DC電源の出力電圧Voの制御下限電圧
Ref1を保持し、Ref2=Ref2として、DC電
源の出力電圧Voの制御上限電圧Ref2を保持する。(A) If σ ≦ RefC, Ref1 = R
The control lower limit voltage Ref1 of the output voltage Vo of the DC power supply is held as ef1, and the control upper limit voltage Ref2 of the output voltage Vo of the DC power supply is held as Ref2 = Ref2.
【0054】(b)RefC<σならば、前回の分散計
算値σ−と今回の分散計算値σを比較する(ステップS
804)(ただし初回においては、σ−=σとする)。(B) If RefC <σ, the previous dispersion calculation value σ− is compared with the current dispersion calculation value σ (step S
804) (however, σ− = σ is set in the first time).
【0055】σ≦σ−の場合:Ref1=Ref1+
P、Ref2=Ref2+P、P=1、σ−=σ(ステ
ップS805)
σ>σ−の場合:Ref1=Ref1−P、Ref2=
Ref2−P、P=−1、σ−=σ(ステップS80
6)
(ただし初回においては、P=0とする)。When σ ≦ σ−: Ref1 = Ref1 +
P, Ref2 = Ref2 + P, P = 1, σ− = σ (step S805) When σ> σ−: Ref1 = Ref1-P, Ref2 =
Ref2-P, P = -1, σ- = σ (step S80
6) (However, P = 0 at the first time).
【0056】上記により得られた新しいRef1、Re
f2を採用して、メインループに戻り、実施例1と同様
にDC電源電圧Vo1を定電圧制御する。その後また、
適切なタイミングで、上記サブルーチンへ移行し、Re
f1、Ref2を再設定する。これを繰り返すことで、
分散値σがσ≦RefCを満足できるRef1、Ref
2を設定できる。The new Ref1, Re obtained as described above
By using f2, the process returns to the main loop, and the DC power supply voltage Vo1 is controlled to a constant voltage as in the first embodiment. Then again
At the appropriate timing, move to the above subroutine and execute Re
Reset f1 and Ref2. By repeating this,
Ref1 and Ref whose dispersion value σ satisfies σ ≦ RefC
2 can be set.
【0057】(実施例3)実施例3を図9に示す。(Embodiment 3) Embodiment 3 is shown in FIG.
【0058】実施例3では、各ボードの電圧精度要求が
違う場合などに、ボード毎に要求精度に応じた重み付け
をして、電源電圧許容中心値からの分散が最小になるよ
うにする(重み付き分散最小化)。In the third embodiment, when the voltage accuracy requirement of each board is different, weighting is performed according to the required accuracy for each board so that the variance from the power supply voltage allowable center value is minimized (weighting). Variance minimization).
【0059】CPUやASIC等によっては入力電源の
電圧推奨値が異なり、更に、その電圧精度の許容値も異
なる事がある。Depending on the CPU, ASIC, etc., the recommended voltage value of the input power supply may differ, and the allowable value of the voltage accuracy may also differ.
【0060】その場合には、単に実施例2で説明した分
散値σをとるのではなく、各負荷ボード1〜4の推奨電
圧をVs1〜Vs4としそれぞれのボードの電圧許容精
度をQ1〜Q4として、以下の重み付き分散値σ′が最
小になるように、DC電源出力電圧Voを設定する事が
望ましい。In that case, instead of simply taking the variance value σ described in the second embodiment, the recommended voltages of the load boards 1 to 4 are set to Vs1 to Vs4, and the voltage tolerance accuracy of each board is set to Q1 to Q4. , It is desirable to set the DC power supply output voltage Vo so that the following weighted dispersion value σ ′ is minimized.
【0061】σ′=Q12*(V1−Vs1)2+Q22
*(V2−Vs2)2+Q32*(V3−Vs3)2+Q
42*(V4−Vs4)2
以下に、サブルーチンのアルゴリズム例を記す(その他
は、実施例1と同一であり省略する)。Σ '= Q1 2 * (V1-Vs1) 2 + Q2 2
* (V2-Vs2) 2 + Q3 2 * (V3-Vs3) 2 + Q
4 2 * (V4-Vs4) 2 Below is an example of the algorithm of the subroutine (others are the same as in Example 1 and will be omitted).
【0062】各負荷ボード入力部の電圧の重み付き分散
値σ′が、予め決めて置いた値RefCに対して、σ′
<RefCとなるように、DC電源の出力電圧Voの制
御下限電圧Ref1、上限電圧Ref2を決定する。The weighted variance value σ ′ of the voltage of each load board input section is σ ′ with respect to a predetermined value RefC.
The control lower limit voltage Ref1 and the upper limit voltage Ref2 of the output voltage Vo of the DC power supply are determined so that <RefC is satisfied.
【0063】サブルーチンの動作について、図9を参照
して説明する。The operation of the subroutine will be described with reference to FIG.
【0064】選択手段51により電圧検出線1〜電圧検
出線4を順次選択して、各負荷ボード入力部の電圧V1
〜V2をフィルタ回路52、サンプル・ホールド回路5
3を通して、A/Dコンバータ54に取り込み、デジタ
ルデータD1〜D4とする。各負荷ボード1〜4の推奨
電圧をVs1〜Vs4のデジタル表現値をDs1〜Ds
4とし、Q1〜Q4のデジタル表現値をq1〜q4とし
て、記憶しておく。The voltage detecting line 1 to the voltage detecting line 4 are sequentially selected by the selecting means 51, and the voltage V1 of each load board input portion is selected.
~ V2 is a filter circuit 52, a sample and hold circuit 5
3 through 3, it is taken into the A / D converter 54 and converted into digital data D1 to D4. The recommended voltage of each load board 1 to 4 is the digital expression value of Vs1 to Vs4 is Ds1 to Ds.
4, and the digital expression values of Q1 to Q4 are stored as q1 to q4.
【0065】σ′=q12*(D1−Ds1)2+q22
*(D2−Ds2)2+q32*(D3−Ds3)2+q
42*(D4−Ds4)2
を計算し、RefCと比較する。Σ '= q1 2 * (D1-Ds1) 2 + q2 2
* (D2-Ds2) 2 + q3 2 * (D3-Ds3) 2 + q
Calculate 4 2 * (D4-Ds4) 2 and compare with RefC.
【0066】(a)σ′≦RefCならば、Ref1=
Ref1として、DC電源の出力電圧Voの制御下限電
圧Ref1を保持し、Ref2=Ref2として、DC
電源の出力電圧Voの制御上限電圧Ref2を保持す
る。(A) If σ ′ ≦ RefC, Ref1 =
The control lower limit voltage Ref1 of the output voltage Vo of the DC power source is held as Ref1, and the DC is set as Ref2 = Ref2.
The control upper limit voltage Ref2 of the output voltage Vo of the power supply is held.
【0067】(b)RefC<σ′ならば、前回の分散
計算値σ−′と今回の分散計算値σ′を比較する(ステ
ップS903)(ただし初回においては、σ−′=σ′
とする)。(B) If RefC <σ ′, the previous dispersion calculation value σ− ′ and the current dispersion calculation value σ ′ are compared (step S903) (however, at the first time, σ − ′ = σ ′).
And).
【0068】σ′≦σ−′の場合:Ref1=Ref1
+P、Ref2=Ref2+P、P=1、σ−′=σ′
(ステップS904)
σ′>σ−′の場合:Ref1=Ref1−P、Ref
2=Ref2−P、P=−1、σ−′=σ′(ステップ
S905)
(ただし初回においては、P=0とする)。When σ ′ ≦ σ− ′: Ref1 = Ref1
+ P, Ref2 = Ref2 + P, P = 1, σ − ′ = σ ′
(Step S904) When σ ′> σ− ′: Ref1 = Ref1-P, Ref
2 = Ref2-P, P = −1, σ − ′ = σ ′ (step S905) (However, P = 0 at the first time).
【0069】上記により得られた新しいRef1、Re
f2を採用して、メインループに戻り、実施例1と同様
にDC電源電圧Vo1を定電圧制御する。その後また、
適切なタイミングで、上記サブルーチンへ移行し、Re
f1、Ref2を再設定する。これを繰り返すことで、
重み付き分散値σ′がσ′≦RefCを満足できるRe
f1、Ref2を設定できる。The new Ref1, Re obtained as described above
By using f2, the process returns to the main loop, and the DC power supply voltage Vo1 is controlled to a constant voltage as in the first embodiment. Then again
At the appropriate timing, move to the above subroutine and execute Re
Reset f1 and Ref2. By repeating this,
Re with weighted variance σ ′ satisfying σ ′ ≦ RefC
f1 and Ref2 can be set.
【0070】尚、サブルーチンを示すフローチャート、
図4、図8、図9において、同一動作を表すステップに
ついては、同一符号を付した。A flow chart showing a subroutine,
4, FIG. 8, and FIG. 9, steps that represent the same operation are assigned the same reference numerals.
【0071】[0071]
【発明の効果】以上説明したように、各負荷ボードの入
力部の電圧をそれぞれ検出する為の電圧検出線を設け、
それぞれの電圧検出値を基に、最適なDC電源出力(V
o)を決定・制御可能な小型・低コストの電源装置及び
給電システムを提供出来る。As described above, the voltage detection line for detecting the voltage of the input portion of each load board is provided,
The optimum DC power output (V
It is possible to provide a small-sized and low-cost power supply device and power supply system capable of determining and controlling o).
【図1】 実施例1における電源装置の全体構成を示す
ブロック図FIG. 1 is a block diagram showing an overall configuration of a power supply device according to a first embodiment.
【図2】 実施例1における電源装置の詳細構成例を示
すブロック図FIG. 2 is a block diagram illustrating a detailed configuration example of a power supply device according to the first embodiment.
【図3】 実施例1における給電システムの動作を示す
フローチャート(メインルーチン)FIG. 3 is a flowchart (main routine) showing the operation of the power supply system in the first embodiment.
【図4】 実施例1における給電システムの動作を示す
フローチャート(サブルーチン1)FIG. 4 is a flowchart showing the operation of the power feeding system in the first embodiment (subroutine 1).
【図5】 従来例1における電源装置の構成例を示すブ
ロック図FIG. 5 is a block diagram showing a configuration example of a power supply device in Conventional Example 1.
【図6】 従来例2における電源装置の構成例を示すブ
ロック図FIG. 6 is a block diagram showing a configuration example of a power supply device in Conventional Example 2.
【図7】 従来例3における電源装置の構成例を示すブ
ロック図FIG. 7 is a block diagram showing a configuration example of a power supply device in Conventional Example 3.
【図8】 実施例2における給電システムの動作を示す
フローチャート(サブルーチン)FIG. 8 is a flowchart (subroutine) showing the operation of the power supply system in the second embodiment.
【図9】 実施例2における給電システムの動作を示す
フローチャート(サブルーチン)FIG. 9 is a flowchart (subroutine) showing the operation of the power supply system in the second embodiment.
Q1 電解効果トランジスタ(FET) C1、C11 平滑コンデンサ T1 スイッチング電源トランス D11 整流ダイオード D12 フライホイールダイオード L11 チョークコイル N11 1次巻線 N21 2次巻線 Q1 Field effect transistor (FET) C1, C11 smoothing capacitors T1 switching power transformer D11 Rectifier diode D12 flywheel diode L11 choke coil N11 primary winding N21 secondary winding
フロントページの続き Fターム(参考) 5G065 AA08 FA01 GA04 HA04 JA01 JA07 LA01 5H730 AA12 AS01 BB23 BB57 CC01 DD04 DD22 EE02 EE08 EE10 EE61 FD01 FF09 FF18 FG05 FG11 FG25 Continued front page F-term (reference) 5G065 AA08 FA01 GA04 HA04 JA01 JA07 LA01 5H730 AA12 AS01 BB23 BB57 CC01 DD04 DD22 EE02 EE08 EE10 EE61 FD01 FF09 FF18 FG05 FG11 FG25
Claims (5)
給する電源装置であって、 複数の負荷装置の入力部の電圧を検出する複数のリモー
ト検出手段と、 該リモート検出手段により得られた複数の検出値より、
前記電源装置の出力電圧を決定し、出力する出力手段
と、 該出力手段に定電圧制御を行う定電圧制御手段と、を備
えたことを特徴とする電源装置。1. A power supply device for supplying a common power supply voltage to a plurality of load boards, comprising: a plurality of remote detection means for detecting a voltage of an input portion of the plurality of load devices; and a plurality of remote detection means. From multiple detection values,
A power supply device comprising: an output unit that determines and outputs an output voltage of the power supply unit; and a constant voltage control unit that performs constant voltage control on the output unit.
複数の検出値の平均値を計算し、該計算値が、予め決め
ておいた値となるように電源装置の出力電圧を決定する
ことを特徴とする電源装置。2. The power supply device according to claim 1, wherein an average value of the plurality of detected values is calculated, and the output voltage of the power supply device is determined so that the calculated value becomes a predetermined value. Power supply device characterized by.
複数の検出値とそれぞれ予め決めておいた目標値との差
の自乗和(=分散σ)を計算し、該計算値が、予め決め
ておいた値以下となるように、電源装置の出力電圧を決
定することを特徴とする電源装置。3. The power supply device according to claim 1, wherein a sum of squares (= dispersion σ) of differences between the plurality of detected values and respective predetermined target values is calculated, and the calculated values are predetermined. A power supply device, characterized in that the output voltage of the power supply device is determined so as to be equal to or less than a preset value.
複数の検出値とそれぞれ予め決めておいた目標値との差
の自乗に予め決めておいた重み付け係数倍した値の和を
(=重み付き分散σ′)を計算し、該計算値が、予め決
めておいた値以下となるように、電源装置の出力電圧を
決定することを特徴とする電源装置。4. The power supply device according to claim 1, wherein a sum of values obtained by multiplying a square of a difference between each of the plurality of detected values and a predetermined target value by a predetermined weighting coefficient (= weight). Power supply device, wherein the output voltage of the power supply device is determined so that the calculated dispersion σ ′) is equal to or less than a predetermined value.
給する給電システムであって、 複数の負荷装置の入力部の電圧を検出する複数のリモー
ト検出手段と、 該リモート検出手段により得られた複数の検出値より、
前記電源装置の出力電圧を決定し、出力する出力手段
と、 該出力手段に定電圧制御を行う定電圧制御手段と、を備
え、 前記複数の検出値の平均値を計算し、該計算値が、予め
決めておいた値となるように電源装置の出力電圧を決定
するか、または前記複数の検出値とそれぞれ予め決めて
おいた目標値との差の自乗和(=分散σ)を計算し、該
計算値が、予め決めておいた値以下となるように、電源
装置の出力電圧を決定するか、または前記複数の検出値
とそれぞれ予め決めておいた目標値との差の自乗に予め
決めておいた重み付け係数倍した値の和を(=重み付き
分散σ′)を計算し、該計算値が、予め決めておいた値
以下となるように、電源装置の出力電圧を決定すること
を特徴とする給電システム。5. A power supply system for supplying a common power supply voltage to a plurality of load boards, comprising: a plurality of remote detection means for detecting a voltage of an input part of a plurality of load devices; and a plurality of remote detection means. From multiple detection values,
An output unit that determines and outputs the output voltage of the power supply device and a constant voltage control unit that performs constant voltage control on the output unit are provided, and an average value of the plurality of detection values is calculated, and the calculated value is , Determine the output voltage of the power supply device so as to be a predetermined value, or calculate the sum of squares (= variance σ) of the differences between the plurality of detection values and the respective predetermined target values. , The output voltage of the power supply device is determined so that the calculated value is equal to or less than a predetermined value, or the square of the difference between the plurality of detection values and the predetermined target value is calculated in advance. A sum of values determined by multiplying a predetermined weighting coefficient is calculated (= weighted variance σ ′), and the output voltage of the power supply device is determined so that the calculated value is equal to or less than a predetermined value. Power supply system characterized by.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2001368701A JP2003169470A (en) | 2001-12-03 | 2001-12-03 | Power supply unit and feeding system |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
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JP2001368701A JP2003169470A (en) | 2001-12-03 | 2001-12-03 | Power supply unit and feeding system |
Publications (1)
Publication Number | Publication Date |
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ID=19178249
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- 2001-12-03 JP JP2001368701A patent/JP2003169470A/en not_active Withdrawn
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