JP2002164329A - Plasma treatment apparatus - Google Patents

Plasma treatment apparatus

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JP2002164329A
JP2002164329A JP2001204884A JP2001204884A JP2002164329A JP 2002164329 A JP2002164329 A JP 2002164329A JP 2001204884 A JP2001204884 A JP 2001204884A JP 2001204884 A JP2001204884 A JP 2001204884A JP 2002164329 A JP2002164329 A JP 2002164329A
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electrode
electrode plate
plasma
shield ring
processing apparatus
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JP2001204884A
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Japanese (ja)
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Toshifumi Nagaiwa
利文 永岩
Masahiro Ogasawara
正宏 小笠原
Kazuya Kato
和也 加藤
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Tokyo Electron Ltd
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Tokyo Electron Ltd
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Abstract

PROBLEM TO BE SOLVED: To provide a plasma treatment apparatus, in which the distribution of a plasma is uniform, whose degradation due to an aged deterioration is small and which can perform micromachining operations. SOLUTION: In the plasma treatment apparatus 1 which executes a plasma treatment to a substrate W to be treated, an upper electrode 21 which faces a susceptor 5 as a lower electrode is provided with an electrode support 22 and an electrode plate 23, and a cavity 62 whose dimensions are decided, in such a way that resonance is generated at the frequency of supplied high-frequency electric power and that an electric field at right angles with respect to the electrode plate 23 is generated is installed, in the central part on the side of the electrode support 23 at the boundary part between both. A shielding ring which surrounds the electrode plate 23 has a shape, whose rear surface is flush with the electrode plate 23, and it is formed of a blank which is hardly eroded by the plasma.

Description

【発明の詳細な説明】DETAILED DESCRIPTION OF THE INVENTION

【0001】[0001]

【発明の属する技術分野】本発明は,半導体基板等の基
板にプラズマ処理を施す,プラズマ処理装置,およびそ
れに用いられる電極,シールドリングに関する。
[0001] 1. Field of the Invention [0002] The present invention relates to a plasma processing apparatus for performing plasma processing on a substrate such as a semiconductor substrate, and an electrode and a shield ring used therein.

【0002】従来から例えば半導体製造プロセスにおい
ては,半導体ウエハなどの表面の絶縁膜をエッチングし
て,例えばコンタクトホールを形成するための装置とし
てプラズマ装置が使用されている。
Conventionally, for example, in a semiconductor manufacturing process, a plasma device has been used as a device for etching an insulating film on a surface of a semiconductor wafer or the like to form a contact hole, for example.

【0003】中でもとりわけ処理室内の上下に電極を配
置した平行平板型のプラズマ装置は,均一性に優れ,大
口径ウエハの処理が可能で,装置構成も比較的簡易であ
ることからプラズマ装置の主流となっている。
[0003] Above all, a parallel plate type plasma apparatus in which electrodes are arranged above and below the processing chamber has excellent uniformity, can process a large-diameter wafer, and has a relatively simple apparatus configuration. It has become.

【0004】従来の平行平板型のエッチング装置は,例
えば特願2000−116304号において開示されて
いるように,処理室内の上下に電極が対向して設けられ
ており,被処理基板である半導体ウエハは下側の電極に
載置され,この処理室内にエッチングガスを導入すると
共に,高周波電力を下部電極に供給して上下電極間にプ
ラズマを発生させ,エッチングガスの解離によって生じ
たエッチャント成分によって,半導体ウエハの絶縁膜を
エッチングするように構成されている。
In a conventional parallel plate type etching apparatus, for example, as disclosed in Japanese Patent Application No. 2000-116304, electrodes are provided on the upper and lower sides of a processing chamber so as to face each other. Is mounted on the lower electrode, an etching gas is introduced into the processing chamber, and high-frequency power is supplied to the lower electrode to generate plasma between the upper and lower electrodes, and an etchant component generated by dissociation of the etching gas causes It is configured to etch an insulating film of a semiconductor wafer.

【0005】図3は,特願2000―116304号に
おける,上部電極およびシールドリングを模式的に示し
た図である。図3に示すように,上部電極121は,電
極板123,その上部に位置する電極支持体122,お
よび両者の境界部に設けられた空洞162を有する。
FIG. 3 is a diagram schematically showing an upper electrode and a shield ring in Japanese Patent Application No. 2000-116304. As shown in FIG. 3, the upper electrode 121 has an electrode plate 123, an electrode support 122 located above the electrode plate 123, and a cavity 162 provided at a boundary between the two.

【0006】さらに,上部電極121の周囲は,絶縁材
125により,プラズマ装置の処理室上部に固定される
構造になっており,絶縁材125の下部には,シールド
リング155が配置されている。
Further, the periphery of the upper electrode 121 is fixed to the upper part of the processing chamber of the plasma apparatus by an insulating material 125, and a shield ring 155 is arranged below the insulating material 125.

【0007】このように,処理の微細化,処理速度の向
上,処理の均一性の要求に対応するため,上部電極12
1の周囲に,上部電極面より下部電極側に突出したシー
ルドリング155を設けてプラズマを閉じ込め,さら
に,電極板123と電極支持体122との境界部に,空
洞162を設け,プラズマの均一化を図っている。
As described above, in order to meet the demands for finer processing, improved processing speed, and uniform processing, the upper electrode 12
1, a shield ring 155 protruding from the upper electrode surface to the lower electrode side is provided to confine the plasma, and further, a cavity 162 is provided at the boundary between the electrode plate 123 and the electrode support 122 to homogenize the plasma. Is being planned.

【0008】[0008]

【発明が解決しようとする課題】しかしながら,特願2
000−116304号において開示された技術では,
プラズマ閉じ込めの役割を果たす下部電極側に突出した
シールドリングの凸部が,経時変化により削れ,プラズ
マの分布が変化してしまうという問題が生じることがわ
かった。
[Problems to be solved by the invention]
000-116304, the technique disclosed in
It has been found that the projection of the shield ring protruding toward the lower electrode, which plays a role of confining the plasma, is abraded due to aging and the plasma distribution changes.

【0009】本発明は,従来のプラズマ装置が有する上
記問題点に鑑みてなされたものであり,本発明の目的
は,プラズマの分布が均一で,経時変化による劣化が少
なく,微細加工の可能な,新規かつ改良されたプラズマ
装置を提供することである。
SUMMARY OF THE INVENTION The present invention has been made in view of the above-mentioned problems of the conventional plasma apparatus, and an object of the present invention is to provide a uniform plasma distribution, a small deterioration due to aging, and a fine processing. , To provide a new and improved plasma device.

【0010】[0010]

【課題を解決するための手段】上記の課題を解決するた
め,本発明によれば,処理室と,処理室内において被処
理体を載置可能な第1電極と,処理室内において第1電
極に対向配置された第2電極と,処理室内に処理ガスを
導入可能な処理ガス供給系と,処理室内を真空排気可能
な排気系と,第1および第2電極のすくなくともいずれ
か一方に高周波電力を印加して処理ガスをプラズマ化し
被処理体に対して所定のプラズマ処理を施す高周波電力
供給系とを備えたプラズマ処理装置において,第2電極
は,第1電極に対向するように設けられた導電体または
半導体で構成された電極板と,この電極板の処理室内と
は反対側の面に儲けられ電極板を支持する導電性支持体
と,この支持体の中央部に設けられた空胴部とを備えて
おり,第2電極の周囲には処理室内側に電極板と同一面
を有するシールドリングが配されていることを特徴とす
るプラズマ処理装置が提供される。
According to the present invention, there is provided a processing chamber, a first electrode on which an object to be processed can be placed in the processing chamber, and a first electrode in the processing chamber. A second electrode disposed in opposition, a processing gas supply system capable of introducing a processing gas into the processing chamber, an exhaust system capable of evacuating the processing chamber, and supplying high-frequency power to at least one of the first and second electrodes. In a plasma processing apparatus having a high-frequency power supply system for applying a predetermined plasma process to an object to be processed into plasma by applying a process gas to plasma, the second electrode is a conductive material provided to face the first electrode. An electrode plate made of a body or a semiconductor, a conductive support provided on the surface of the electrode plate opposite to the processing chamber to support the electrode plate, and a cavity provided at the center of the support And the second electrode The enclosed plasma processing apparatus characterized by shield ring having an electrode plate in the same plane into the processing chamber side are arranged is provided.

【0011】電極板を支持する支持体の中央部に空洞部
を設けない構造でもよい。また,シールドリングの抵抗
値は,電極板の抵抗値よりも低い材料,または同一材料
から構成されることが好ましい。それらの材料は,例え
ばシリコンやSiCが適用できる。
A structure in which a hollow portion is not provided at the center of the support for supporting the electrode plate may be used. Further, it is preferable that the resistance value of the shield ring is made of a material lower than the resistance value of the electrode plate or the same material. For example, silicon or SiC can be applied to those materials.

【0012】シールドリングの抵抗値は,1〜10Ωc
m,電極板の抵抗値は,65〜85Ωcmとすることが
できる。また,電極板の外径は,第1電極の外径よりも
大きくしてもよい。
The resistance value of the shield ring is 1 to 10Ωc.
m, the resistance value of the electrode plate can be 65-85 Ωcm. Further, the outer diameter of the electrode plate may be larger than the outer diameter of the first electrode.

【0013】かかる構成によれば,中央部の電界が強く
なることを抑制してプラズマの分布を均一化し,電極面
と面一なシールドリングの採用によって経時変化による
劣化が少なく,微細加工の可能な,新規かつ改良された
プラズマ装置を提供できる。
According to such a configuration, the distribution of the plasma is made uniform by suppressing the electric field at the central portion from becoming strong, and the use of a shield ring flush with the electrode surface minimizes deterioration due to aging and enables fine processing. A new and improved plasma device can be provided.

【0014】[0014]

【発明の実施の形態】以下に添付図面を参照しながら,
本発明にかかるプラズマ装置の好適な実施の形態につい
て詳細に説明する。なお,本明細書及び図面において,
実質的に同一の機能構成を有する構成要素については,
同一の符号を付することにより重複説明を省略する。
BRIEF DESCRIPTION OF THE DRAWINGS FIG.
A preferred embodiment of the plasma device according to the present invention will be described in detail. In this specification and drawings,
For components having substantially the same functional configuration,
Repetitive description will be omitted by giving the same reference numerals.

【0015】(第1の実施の形態)図1は,本発明の第
1の実施形態にかかるプラズマ装置1の構成を示す断面
図である。プラズマ装置1における処理室2は,例えば
酸化アルマイト処理されたアルミニウムなどからなる円
筒形状の処理容器として形成され,接地されている。
(First Embodiment) FIG. 1 is a sectional view showing a configuration of a plasma apparatus 1 according to a first embodiment of the present invention. The processing chamber 2 in the plasma apparatus 1 is formed as a cylindrical processing container made of, for example, aluminum that has been subjected to anodized aluminum and is grounded.

【0016】処理室2内の底部にはセラミックなどの絶
縁支持板3が設けられており,この絶縁支持板3の上部
に,被処理基板,例えば直径8インチの半導体ウエハW
を載置するための略円柱状のサセプタ支持台4が設けら
れている。さらにサセプタ支持台4の上に,下部電極を
構成するサセプタ5が設けられており,ハイパスフィル
ター(HPF)6が接続されている。
An insulating support plate 3 made of ceramic or the like is provided at the bottom of the processing chamber 2, and a substrate to be processed, for example, a semiconductor wafer W having a diameter of 8 inches, is provided on the insulating support plate 3.
A susceptor support 4 having a substantially cylindrical shape for mounting the susceptor is provided. A susceptor 5 constituting a lower electrode is provided on the susceptor support 4, and a high-pass filter (HPF) 6 is connected to the susceptor 5.

【0017】サセプタ支持台4の内部には熱交換室7が
設けられ,外部から熱交換媒体が熱交換媒体導入管8お
よび熱交換媒体排出管9を介して循環し,サセプタ5を
介して半導体ウエハWを所定温度に維持することが可能
なように構成されている。またかかる温度は,温度セン
サ(図示せず),温度制御機構(図示せず)によって自
動的に制御される構成となっている。
A heat exchange chamber 7 is provided inside the susceptor support 4, and a heat exchange medium circulates from outside through a heat exchange medium introduction pipe 8 and a heat exchange medium discharge pipe 9, and the semiconductor is exchanged through the susceptor 5. The wafer W is configured to be maintained at a predetermined temperature. The temperature is automatically controlled by a temperature sensor (not shown) and a temperature control mechanism (not shown).

【0018】またサセプタ5上には,半導体ウエハWを
吸着保持するための静電チャック11が設けられてい
る。この静電チャック11は,例えば導電性の薄膜電極
12をポリイミド系の樹脂によって上下から挟持した構
成を有し,処理室2の外部に設置されている直流電源1
3から例えば1.5kVの電圧が電極12に印加される
と,そのクーロン力によってウエハWは,静電チャック
11の上面に吸着保持されるようになっている。もちろ
んそのような静電チャックに拠らず,機械的クランプに
よってウエハWの周縁部を押圧するようにして,サセプ
タ5上にウエハWを保持する構成としてもよい。
On the susceptor 5, an electrostatic chuck 11 for holding the semiconductor wafer W by suction is provided. The electrostatic chuck 11 has a configuration in which, for example, a conductive thin-film electrode 12 is sandwiched from above and below by a polyimide resin, and a DC power source 1 installed outside the processing chamber 2.
When a voltage of, for example, 1.5 to 1.5 kV is applied to the electrode 12, the Coulomb force causes the wafer W to be suction-held on the upper surface of the electrostatic chuck 11. Needless to say, a configuration in which the wafer W is held on the susceptor 5 by pressing the peripheral portion of the wafer W by a mechanical clamp without depending on such an electrostatic chuck may be employed.

【0019】さらに,絶縁板3,サセプタ支持台4,サ
セプタ5,および静電チャック11には,半導体ウエハ
Wの裏面に例えばHeガスなどを供給するためのガス通
路14が形成されており,このHeガスなどの伝熱媒体
を介して半導体ウエハWが所定の温度に維持される。
Further, the insulating plate 3, the susceptor support 4, the susceptor 5, and the electrostatic chuck 11 are formed with a gas passage 14 for supplying, for example, He gas to the back surface of the semiconductor wafer W. The semiconductor wafer W is maintained at a predetermined temperature via a heat transfer medium such as He gas.

【0020】サセプタ5上の周辺には,静電チャック1
1を囲むようにして,略環状のフォーカスリング15が
設けられている。フォーカスリング15は例えば導電性
のシリコンからなり,プラズマ中のイオンを効果的に半
導体ウエハWに入射させる機能を有している。
At the periphery on the susceptor 5, the electrostatic chuck 1
A substantially annular focus ring 15 is provided so as to surround the focus ring 1. The focus ring 15 is made of, for example, conductive silicon and has a function of effectively causing ions in the plasma to enter the semiconductor wafer W.

【0021】処理室2内の上部には,絶縁部材25およ
びシールドリング55を介して,上部電極21が支持さ
れている。上部電極21は,例えば表面がアルマイト処
理されたアルミニウムからなる電極支持体22および,
サセプタ5と平行に対向し,多数の吐出孔24を備えた
電極板23を有している。サセプタ5と上部電極21と
は,例えば10〜60mm程度離間している。上部電極
21およびシールドリング55の詳細な構成は後述す
る。
An upper electrode 21 is supported above the processing chamber 2 via an insulating member 25 and a shield ring 55. The upper electrode 21 includes, for example, an electrode support 22 made of aluminum whose surface is anodized, and
It has an electrode plate 23 facing in parallel with the susceptor 5 and having a large number of discharge holes 24. The susceptor 5 and the upper electrode 21 are separated, for example, by about 10 to 60 mm. Detailed configurations of the upper electrode 21 and the shield ring 55 will be described later.

【0022】電極支持体22には,ガス導入口26が設
けられ,ガス供給管27に接続されている。さらに,バ
ルブ28およびマスフローコントローラ29を介して処
理ガス供給源30に接続され,エッチングガスやその他
の処理ガスが処理室2内に導入される。
The electrode support 22 is provided with a gas inlet 26 and is connected to a gas supply pipe 27. Further, it is connected to a processing gas supply source 30 via a valve 28 and a mass flow controller 29, and an etching gas and other processing gases are introduced into the processing chamber 2.

【0023】処理ガスとしては,例えば,フロロカーボ
ンガス(C),ハイドロフロロカーボンガス(C
)等の,ハロゲン元素を含有するガスを用い
ることができる。
Examples of the processing gas include fluorocarbon gas (C x F y ) and hydrofluorocarbon gas (C
p H q F r), such as, it is possible to use a gas containing a halogen element.

【0024】処理室2の下部には,真空ポンプなどの排
気装置35に通ずる排気管31が接続されている。排気
装置35は,ターボ分子ポンプなどの真空ポンプを備え
ており,処理室2内は,例えば10mTorr〜100
0mTorrの任意の減圧度にまで真空引きすることが
可能となっている。
An exhaust pipe 31 leading to an exhaust device 35 such as a vacuum pump is connected to a lower portion of the processing chamber 2. The exhaust device 35 is provided with a vacuum pump such as a turbo molecular pump, and the inside of the processing chamber 2 is, for example, 10 mTorr to 100 mTorr.
It is possible to evacuate to an arbitrary degree of reduced pressure of 0 mTorr.

【0025】処理室2の側壁には,ゲートバルブ32が
設けられ,ゲートバルブ32を開にした状態で半導体ウ
エハWを,隣接するロードロック室(図示せず)との間
で搬送させるようになっている。
A gate valve 32 is provided on the side wall of the processing chamber 2 so that the semiconductor wafer W can be transferred between an adjacent load lock chamber (not shown) with the gate valve 32 opened. Has become.

【0026】次にこのプラズマ装置1の高周波電力の供
給系について説明する。まず上部電極21に対しては,
整合器41および給電棒33を介して,周波数が例えば
27〜150MHzの周波数の高周波電力を出力する第
1の高周波電源40からの電力が供給される構成となっ
ている。また,上部電極21にはローパスフィルター
(LPF)42が接続されている。
Next, a high-frequency power supply system of the plasma apparatus 1 will be described. First, for the upper electrode 21,
Power is supplied from a first high-frequency power supply 40 that outputs high-frequency power having a frequency of, for example, 27 to 150 MHz via a matching unit 41 and a power supply rod 33. Further, a low-pass filter (LPF) 42 is connected to the upper electrode 21.

【0027】このように高い周波数を印加することによ
り,処理室2内に,好ましい解離状態でかつ高密度のプ
ラズマを形成でき,低圧条件下のプラズマ処理が可能と
なる。本実施の形態では,高周波電源40として,60
MHzのものを用いている。
By applying such a high frequency, a high-density plasma can be formed in the processing chamber 2 in a preferable dissociated state, and plasma processing under low-pressure conditions becomes possible. In the present embodiment, as the high-frequency power supply 40, 60
MHz.

【0028】一方下部電極となるサセプタ5に対して
は,周波数が例えば800KHz〜4MHz程度の高周
波電力を出力する高周波電源50からの電力が,整合器
51を介して供給される構成となっている。このような
範囲の周波数を印加することで,半導体ウエハWに対し
てダメージを与えることなく適切なイオン作用を与える
ことができる。
On the other hand, the susceptor 5 serving as the lower electrode is supplied with power from a high frequency power supply 50 that outputs high frequency power having a frequency of, for example, about 800 KHz to 4 MHz via a matching unit 51. . By applying a frequency in such a range, an appropriate ion action can be given without damaging the semiconductor wafer W.

【0029】次に,上部電極21およびシールドリング
55の構成について詳細に説明する。図2は,上部電極
21およびシールドリング55を模式的に示す断面図で
ある。
Next, the configuration of the upper electrode 21 and the shield ring 55 will be described in detail. FIG. 2 is a sectional view schematically showing the upper electrode 21 and the shield ring 55.

【0030】図2に示すように,電極板23の上部に設
けられた電極支持台22の中央部に,電極板23と接す
るように空洞62が設けられている。この空洞62は,
上部電極21に供給される高周波電力の周波数において
共振が生じ,かつその中に電極板23に対して直交する
電界が生ずるように,すなわち,電極板23において高
周波電力が供給される部分の電極板表面からの厚さが,
電極板23よりも大きくなるように寸法が決定される。
As shown in FIG. 2, a cavity 62 is provided at the center of the electrode support base 22 provided above the electrode plate 23 so as to be in contact with the electrode plate 23. This cavity 62
The resonance occurs at the frequency of the high-frequency power supplied to the upper electrode 21 and an electric field orthogonal to the electrode plate 23 is generated therein, that is, the electrode plate of the electrode plate 23 to which the high-frequency power is supplied. The thickness from the surface is
The dimensions are determined so as to be larger than the electrode plate 23.

【0031】このように空洞62に共振が生じて電極板
23に対して直交する電界が生じる場合には,空洞62
の電界と電極板23の電界とが結合し,空洞62の電界
によって,電極板23における空洞62直下の,電極中
心部の電界を制御できる。よって,より均一なプラズマ
分布を実現できる。
When resonance occurs in the cavity 62 and an electric field orthogonal to the electrode plate 23 is generated, the cavity 62
The electric field of the electrode plate 23 and the electric field of the electrode plate 23 are combined, and the electric field of the electrode plate 23 can be controlled by the electric field of the electrode plate 23 just below the cavity 62 in the electrode plate 23. Therefore, a more uniform plasma distribution can be realized.

【0032】また,図3に示すように従来のシールドリ
ング155は,上部電極と半導体ウエハとの間の距離よ
りも短いギャップを構成してプラズマ閉じ込めの効果を
得るために,半導体ウエハ側である下部に突出して構成
されていた。また,通常石英で形成されており,下部に
突出していることでプラズマによって削られやすかっ
た。
As shown in FIG. 3, the conventional shield ring 155 is on the semiconductor wafer side in order to form a gap shorter than the distance between the upper electrode and the semiconductor wafer to obtain the effect of confining plasma. It was configured to protrude downward. In addition, it is usually made of quartz, and because it protrudes downward, it is easily cut by plasma.

【0033】このため,本実施の形態にかかるシールド
リング55は,図2に示すように電極板23と下部が面
一に構成されている。抵抗値は,電極板23の抵抗値よ
りも低く設定し,また,電極板23と同一材料としても
よい。電極板23およびシールドリング55に用いる材
料としては,シリコンが適用できる。
For this reason, as shown in FIG. 2, the shield ring 55 according to the present embodiment has the lower portion flush with the electrode plate 23. The resistance value may be set lower than the resistance value of the electrode plate 23, and may be made of the same material as the electrode plate 23. As a material used for the electrode plate 23 and the shield ring 55, silicon can be used.

【0034】また,下部電極および上部電極間の電界分
布等を考慮して,シールドリング55および電極板23
の抵抗値は,それぞれ1〜10Ωcm,65〜85Ωc
mが適当である。
In consideration of the electric field distribution between the lower electrode and the upper electrode, the shield ring 55 and the electrode plate 23
Are 1 to 10 Ωcm and 65 to 85 Ωc, respectively.
m is appropriate.

【0035】図4は,従来のシールドリング155を用
いたプラズマ装置におけるエッチングレート,図5は,
本実施の形態にかかるシールドリング55を用いたプラ
ズマ装置におけるエッチングレートを示す図である。
FIG. 4 is an etching rate in a plasma apparatus using the conventional shield ring 155, and FIG.
FIG. 4 is a diagram showing an etching rate in a plasma device using the shield ring 55 according to the present embodiment.

【0036】図4および図5は両図とも,シールドリン
グの材料および構造以外は同一条件で,同一時間処理を
行った際のエッチングレートの平均(nm/min.)
を,半導体ウエハの中心からの距離(mm)に対して直
交する2方向(XおよびY方向)について測定した結果
である。ここで,シールドリング155は,石英製であ
り,シールドリング55は,抵抗値が約2Ωのシリコン
製のものを用いている。
FIGS. 4 and 5 show the average (nm / min.) Of the etching rates when processing is performed under the same conditions and for the same time except for the material and structure of the shield ring.
Are measured in two directions (X and Y directions) orthogonal to the distance (mm) from the center of the semiconductor wafer. Here, the shield ring 155 is made of quartz, and the shield ring 55 is made of silicon having a resistance value of about 2Ω.

【0037】図4および5に示すように,従来のシール
ドリング155を用いると,中心からの距離が100m
mを超える範囲で,明らかにエッチングレートの低下が
見られる。一方,低抵抗のシールドリング55部分に流
れる高周波電流は,より抵抗の高いシールドリング15
5を用いた場合に比べ大きくなるので,その部分のプラ
ズマ密度が上がり,半導体ウエハ全面におけるプラズマ
の均一性を向上させることができる。
As shown in FIGS. 4 and 5, when the conventional shield ring 155 is used, the distance from the center is 100 m.
In the range exceeding m, the etching rate clearly decreases. On the other hand, the high-frequency current flowing through the low-resistance shield ring 55 is reduced by the higher-resistance shield ring 15.
5, the plasma density in that portion is increased, and the uniformity of the plasma over the entire surface of the semiconductor wafer can be improved.

【0038】さらに,従来のシールドリング155の材
料および構成によると,突出部はプラズマに常にさらさ
れ,削られて経時変化し,本来のプラズマ閉じ込め効果
を発揮しなくなると考えられる。複数回の処理を重ねれ
ば,さらにこの傾向は顕著になることは,自明である。
Further, according to the material and configuration of the conventional shield ring 155, it is considered that the protruding portion is constantly exposed to the plasma, is shaved, changes with time, and does not exhibit the original plasma confinement effect. It is obvious that this tendency becomes more remarkable when the processing is repeated a plurality of times.

【0039】また,本実施の形態においては,電極23
上部の空洞62により電界の制御が可能であり,プラズ
マの分布は十分均一に保たれる。よって,シールドリン
グ55を合わせて採用することで,より信頼性の高いプ
ラズマ装置1を実現できる。
In the present embodiment, the electrode 23
The electric field can be controlled by the upper cavity 62, and the distribution of the plasma can be kept sufficiently uniform. Therefore, by employing the shield ring 55 together, a more reliable plasma device 1 can be realized.

【0040】逆に,シールドリング55を採用すること
でプラズマの分布は十分均一に保たれるので,電極板2
3上部に空洞62を設けない構造でも同様の効果を得ら
れる。さらにプラズマ分布を均一にするため,電極板2
3の径を,下部電極であるサセプタ5の径よりも大きく
構成することも有用である。
Conversely, by employing the shield ring 55, the plasma distribution can be kept sufficiently uniform.
A similar effect can be obtained even with a structure in which the cavity 62 is not provided in the upper part of the third embodiment. In order to further uniform the plasma distribution, the electrode plate 2
It is also useful to make the diameter of 3 larger than the diameter of the susceptor 5 as the lower electrode.

【0041】(第2の実施の形態)次に,第2の実施の
形態にかかるシールドリングについて説明する。図6
は,本実施の形態にかかるシールドリング255周辺を
示す概略断面図,図7は,図6のA部分の拡大図,図8
は,従来のシールドリング155周辺を示す概略断面
図,図9は,図8のB部分の拡大図である。
(Second Embodiment) Next, a shield ring according to a second embodiment will be described. FIG.
FIG. 7 is a schematic sectional view showing the periphery of the shield ring 255 according to the present embodiment, FIG. 7 is an enlarged view of a portion A in FIG.
Is a schematic cross-sectional view showing the periphery of the conventional shield ring 155, and FIG. 9 is an enlarged view of a portion B in FIG.

【0042】図8および9に示すように,従来のシール
ドリング155は,例えばウエハWと,上部電極の電極
板23との間隔が20mmの場合,例えば約7mm下部
に突出して段差を生じ,ウエハ面との間隔が13mmと
狭められていた。
As shown in FIGS. 8 and 9, when the distance between the wafer W and the electrode plate 23 of the upper electrode is, for example, 20 mm, the conventional shield ring 155 protrudes downward, for example, by about 7 mm, and a step is formed. The distance from the surface was reduced to 13 mm.

【0043】しかしながら,このような段差があると,
プラズマに曝される時間が長くなるに従いシールドリン
グ155表面は消耗し,ウエハW上のガス圧力が下が
る。このため,エッチングレートが下がり,コンタクト
ホールの抜け性が変化してしまう。この経時変化を緩和
するため,図6および7に示すように,シールドリング
255は,電極板23と面一に構成されている。
However, when there is such a step,
As the time of exposure to the plasma increases, the surface of the shield ring 155 is consumed, and the gas pressure on the wafer W decreases. For this reason, the etching rate decreases, and the removability of the contact hole changes. As shown in FIGS. 6 and 7, the shield ring 255 is formed flush with the electrode plate 23 in order to alleviate this temporal change.

【0044】図10は,経時変化によるエッチレート低
下率を示す図,図11は,エッチレート変化量のウエハ
面内での比較を示す図である。これらは,第1の実施の
形態にかかるプラズマ処理装置1において,上部電極用
高周波電源40より,27,12MHz,下部電極用高
周波電源50より800KHzの電力を供給してプラズ
マ処理を行った結果である。
FIG. 10 is a diagram showing the rate of decrease in the etch rate due to a change with time, and FIG. 11 is a diagram showing a comparison of the amount of change in the etch rate within the wafer surface. These are the results of performing plasma processing by supplying 27,12 MHz power from the high frequency power supply for upper electrode 40 and 800 KHz from the high frequency power supply 50 for the lower electrode in the plasma processing apparatus 1 according to the first embodiment. is there.

【0045】電極板23は,単結晶シリコン製,抵抗
は,1〜10Ω・cm,シールドリング155(従来
型),シールドリング255(改良型)とも石英製で,
絶縁性(〜1016Ω・cm)である。その他の処理条
件は,それぞれのシールドリングに対して最適化したも
のを用いた。
The electrode plate 23 is made of single crystal silicon, the resistance is 1 to 10 Ω · cm, and the shield ring 155 (conventional type) and the shield ring 255 (improved type) are both made of quartz.
Insulating (-1016 Ω · cm). Other processing conditions were optimized for each shield ring.

【0046】すなわち,従来型シールドリング155に
対しては,圧力40mTorr,上部電極供給電力/下
部電極供給電力=2000/1400W,電極板23と
ウエハWの間隔=17mm,処理ガス流量C/A
r/O=21/510/11sccm,ウエハセンタ
ー裏面冷却ガス圧力/ウエハエッジ裏面冷却ガス圧力=
10/35Torr,下部電極温度/上部電極温度/処
理室側壁温度=−20/30/50℃である。
That is, for the conventional shield ring 155, the pressure is 40 mTorr, the power supplied to the upper electrode / the power supplied to the lower electrode = 2000/1400 W, the distance between the electrode plate 23 and the wafer W is 17 mm, and the processing gas flow rate is C 4 F 8. / A
r / O 2 = 21/510/11 sccm, wafer center backside cooling gas pressure / wafer edge backside cooling gas pressure =
10/35 Torr, lower electrode temperature / upper electrode temperature / processing chamber side wall temperature = −20 / 30/50 ° C.

【0047】改良型シールドリング255に対しては,
圧力50mTorr,上部電極供給電力/下部電極供給
電力=2000/1400W,電極板23とウエハWの
間隔=17mm,処理ガス流量C/Ar/O
21/450/10sccm,ウエハセンター裏面冷却
ガス圧力/ウエハエッジ裏面冷却ガス圧力=12/25
Torr,下部電極温度/上部電極温度/処理室側壁温
度=0/30/50℃である。
For the improved shield ring 255,
Pressure 50 mTorr, upper electrode supply power / lower electrode supply power = 2000/1400 W, interval between electrode plate 23 and wafer W = 17 mm, processing gas flow rate C 4 F 8 / Ar / O 2 =
21/450/10 sccm, wafer center backside cooling gas pressure / wafer edge backside cooling gas pressure = 12/25
Torr, lower electrode temperature / upper electrode temperature / processing chamber side wall temperature = 0/30/50 ° C.

【0048】図10において,横軸はプラズマ処理時
間,縦軸は,エッチングレートの変化率を表す。プラズ
マ処理時間100時間後のエッチングレートの低下は,
従来段差型のシールドリング155では約8%であった
ものが,電極板23との段差をなくした改良フラット型
シールドリング255を用いると,約4%とすることが
できた。
In FIG. 10, the horizontal axis represents the plasma processing time, and the vertical axis represents the rate of change of the etching rate. The decrease in the etching rate after 100 hours of the plasma processing time is as follows.
In contrast to the conventional step-type shield ring 155, which was about 8%, the use of the improved flat shield ring 255 in which the step with the electrode plate 23 was eliminated could be reduced to about 4%.

【0049】図11においては,ウエハW面上の中心,
中間部,周縁部における,プラズマ処理100時間後の
エッチングレート変化率を縦軸に表している。このよう
に,改良型シールドリング255では,ウエハ中央部お
よび中間部での変化量はほぼゼロとなり,周縁部では,
従来型シールドリング155で約1000Å/min.
変化していたものが,約500Å/min.と低減され
た。
In FIG. 11, the center on the wafer W surface,
The vertical axis represents the rate of change of the etching rate in the middle part and the peripheral part after 100 hours of the plasma processing. As described above, in the improved shield ring 255, the amount of change at the central portion and the intermediate portion of the wafer is almost zero, and at the peripheral portion,
Approximately 1000 Å / min.
What changed was about 500 ° / min. And reduced.

【0050】次に,上記のようにエッチングレート変化
率が低減された理由を,図12を用いて説明する。図1
2は,ウエハ上の圧力経時変化を示した図である。図1
2(a)および(b)はそれぞれ,従来型シールドリング1
55を用いた初期状態および100時間のプラズマ処理
後,図(c)および(d)はそれぞれ,改良型シールドリ
ング255を用いた初期状態および100時間のプラズ
マ処理後である。横軸は,設定圧力,縦軸は,ウエハ上
のそれぞれの位置(右,上,ノッチ,中心)で測定された
圧力と設定圧力との差を表す。
Next, the reason why the etching rate change rate is reduced as described above will be described with reference to FIG. FIG.
FIG. 2 is a diagram showing a temporal change in pressure on a wafer. FIG.
2 (a) and (b) respectively show a conventional shield ring 1
(C) and (d) show the initial state using the improved shield ring 255 and after the plasma processing for 100 hours, respectively. The horizontal axis represents the set pressure, and the vertical axis represents the difference between the pressure measured at each position (right, top, notch, center) on the wafer and the set pressure.

【0051】シールドリングの消耗は,従来型,改良型
共に約2mm/100時間であった。しかし,従来型シ
ールドリング155においては,設定圧力と測定された
圧力の差が処理前後で変化している。また,その圧力差
の絶対値も,改良型に比べ大きくなっている。
The consumption of the shield ring was about 2 mm / 100 hours for both the conventional type and the improved type. However, in the conventional shield ring 155, the difference between the set pressure and the measured pressure changes before and after the processing. Also, the absolute value of the pressure difference is larger than that of the improved type.

【0052】これは,シールドリング155の段差が圧
力変動を起こしているためであると考えられる。圧力差
がウエハ上の場所によって異なると,コンタクトホール
の抜け性が均一でなくなり,歩留まりを悪化させる危険
性がある。また,圧力経時変化により,上述したエッチ
レートの低下,および加工ホールの抜け性の変化が生じ
ることがわかる。
It is considered that this is because the step of the shield ring 155 causes a pressure fluctuation. If the pressure difference differs depending on the location on the wafer, the removability of the contact hole will not be uniform, and there is a risk that the yield will deteriorate. Further, it can be seen that the change with time in the pressure causes a decrease in the etch rate and a change in the removability of the processed hole.

【0053】以上詳細に説明したように,第2の実施形
態にかかるシールドリングによれば,ウエハ上のガス圧
力を均一化し,またプラズマ処理後のシールドリングの
消耗による,ウエハ上のガス圧力の経時変化を緩和し
て,経時変化によるエッチングレートの低下を低減し,
加工ホールの抜け性およびそのウエハ内での均一性を向
上させることで,より微細な加工の可能な高性能の成膜
処理装置を提供できる。
As described in detail above, according to the shield ring of the second embodiment, the gas pressure on the wafer is made uniform, and the gas pressure on the wafer is reduced due to the consumption of the shield ring after the plasma processing. Reduces aging and reduces the decrease in etching rate due to aging.
By improving the removability of a processing hole and its uniformity in a wafer, a high-performance film forming apparatus capable of performing finer processing can be provided.

【0054】以上,添付図面を参照しながら本発明にか
かるプラズマ装置の好適な実施形態について説明した
が,本発明はかかる例に限定されない。当業者であれ
ば,特許請求の範囲に記載された技術的思想の範疇内に
おいて各種の変更例または修正例に想到し得ることは明
らかであり,それらについても当然に本発明の技術的範
囲に属するものと了解される。
Although the preferred embodiment of the plasma apparatus according to the present invention has been described with reference to the accompanying drawings, the present invention is not limited to this example. It is clear that a person skilled in the art can conceive various changes or modifications within the scope of the technical idea described in the claims, and those modifications naturally fall within the technical scope of the present invention. It is understood to belong.

【0055】例えばシールドリングの形状は,本実施の
形態で述べた例に限定されず,上部電極と,下面が面一
であるものならば,他の形状でも構わない。また,被処
理基板として半導体ウエハを用い,これにエッチングを
施す場合について示したが,処理対象としては,たとえ
ば液晶表示装置基板等の他の基板でもよく,プラズマ処
理もエッチングに限らずスパッタリング,CVD等,他
の処理でもよい。
For example, the shape of the shield ring is not limited to the example described in the present embodiment, but may be any other shape as long as the upper electrode and the lower surface are flush with each other. Although the case where a semiconductor wafer is used as a substrate to be processed and the substrate is etched is shown, the target to be processed may be another substrate such as a liquid crystal display device substrate. Other processing may be used.

【0056】[0056]

【発明の効果】以上説明したように,本発明によれば,
プラズマの分布が均一で,経時変化による劣化が少な
く,微細加工の可能な,新規かつ改良されたプラズマ装
置を提供できる。
As described above, according to the present invention,
It is possible to provide a new and improved plasma apparatus in which plasma distribution is uniform, deterioration due to aging is small, and fine processing is possible.

【図面の簡単な説明】[Brief description of the drawings]

【図1】本発明の一実施の形態にかかるプラズマ装置1
の構成を示す断面図である。
FIG. 1 shows a plasma apparatus 1 according to an embodiment of the present invention.
It is sectional drawing which shows a structure of.

【図2】上部電極21およびシールドリング55を模式
的に示す断面図である。
FIG. 2 is a cross-sectional view schematically showing an upper electrode 21 and a shield ring 55.

【図3】従来のプラズマ装置における上部電極およびシ
ールドリングを模式的に示した図である。
FIG. 3 is a diagram schematically showing an upper electrode and a shield ring in a conventional plasma device.

【図4】従来のシールドリング155を用いたプラズマ
装置におけるエッチングレートを示す図である。
FIG. 4 is a diagram showing an etching rate in a plasma device using a conventional shield ring 155.

【図5】本実施の形態にかかるシールドリング55を用
いたプラズマ装置におけるエッチングレートを示す図で
ある。
FIG. 5 is a diagram showing an etching rate in a plasma device using the shield ring 55 according to the present embodiment.

【図6】本実施の形態にかかるシールドリング255周
辺を示す概略断面図である。
FIG. 6 is a schematic sectional view showing the periphery of a shield ring 255 according to the present embodiment.

【図7】図6のA部分の拡大図である。FIG. 7 is an enlarged view of a portion A in FIG. 6;

【図8】従来のシールドリング155周辺を示す概略断
面図である。
FIG. 8 is a schematic sectional view showing the periphery of a conventional shield ring 155.

【図9】図8のB部分の拡大図である。FIG. 9 is an enlarged view of a portion B in FIG. 8;

【図10】経時変化によるエッチレート低下率を示す図
である。
FIG. 10 is a diagram showing an etch rate decrease rate due to a change with time.

【図11】エッチレート変化量のウエハ面内での比較を
示す図である。
FIG. 11 is a diagram showing a comparison of a change amount of an etch rate in a wafer surface.

【図12】ウエハ上の圧力経時変化を示した図である。FIG. 12 is a diagram showing a change over time in pressure on a wafer.

【符号の説明】[Explanation of symbols]

21 上部電極 22 電極支持体 23 電極板 33 給電棒 55 シールドリング 62 空洞 DESCRIPTION OF SYMBOLS 21 Upper electrode 22 Electrode support 23 Electrode plate 33 Power supply rod 55 Shield ring 62 Cavity

───────────────────────────────────────────────────── フロントページの続き (72)発明者 加藤 和也 東京都港区赤坂五丁目3番6号 TBS放 送センター 東京エレクトロン株式会社内 Fターム(参考) 4G075 AA30 AA42 AA61 BC02 BC04 BC06 BD14 CA25 CA47 CA65 DA02 EA05 EB01 EB41 EC13 EC21 FB04 FB06 FC11 FC15 FC20 5F004 AA16 BA06 BB11 BB29 DA00 DA23 DA26  ────────────────────────────────────────────────── ─── Continuation of front page (72) Inventor Kazuya Kato FBS term in Tokyo Electron Co., Ltd. 5-3-6 Akasaka, Minato-ku, Tokyo 4G075 AA30 AA42 AA61 BC02 BC04 BC06 BD14 CA25 CA47 CA65 DA02 EA05 EB01 EB41 EC13 EC21 FB04 FB06 FC11 FC15 FC20 5F004 AA16 BA06 BB11 BB29 DA00 DA23 DA26

Claims (13)

【特許請求の範囲】[Claims] 【請求項1】 処理室と;前記処理室内において被処理
体を載置可能な第1電極と;前記処理室内において前記
第1電極に対向配置された第2電極と;前記処理室内に
処理ガスを導入可能な処理ガス供給系と;前記処理室内
を真空排気可能な排気系と;前記第1および第2電極の
すくなくともいずれか一方に高周波電力を印加して前記
処理ガスをプラズマ化し前記被処理体に対して所定のプ
ラズマ処理を施す高周波電力供給系と;前記を備えたプ
ラズマ処理装置において:前記第2電極は,前記第1電
極に対向するように設けられた導電体または半導体で構
成された電極板と,この電極板の前記処理室内とは反対
側の面に儲けられ電極板を支持する導電性の支持体と,
この支持体の中央部に設けられた空胴部とを備えてお
り;前記第2電極の周囲には前記処理室内側に前記電極
板と同一面を有するシールドリングが配されていること
を特徴とする,プラズマ処理装置。
A processing chamber; a first electrode on which an object to be processed can be placed in the processing chamber; a second electrode opposed to the first electrode in the processing chamber; and a processing gas in the processing chamber. A processing gas supply system capable of introducing a gas; an exhaust system capable of evacuating the processing chamber; and applying a high-frequency power to at least one of the first and second electrodes to convert the processing gas into plasma to form the processing target. A high-frequency power supply system for performing predetermined plasma processing on the body; and a plasma processing apparatus having the same: the second electrode is made of a conductor or a semiconductor provided so as to face the first electrode. An electrode plate, a conductive support provided on the surface of the electrode plate opposite to the processing chamber to support the electrode plate,
A cavity provided in the center of the support; a shield ring having the same surface as the electrode plate is disposed around the second electrode in the processing chamber. A plasma processing apparatus.
【請求項2】 前記シールドリングの抵抗値は,前記電
極板の抵抗値よりも低いことを特徴とする,請求項1に
記載のプラズマ処理装置。
2. The plasma processing apparatus according to claim 1, wherein a resistance value of the shield ring is lower than a resistance value of the electrode plate.
【請求項3】 前記シールドリングと前記電極板とは,
同一材料から構成されることを特徴とする,請求項2に
記載のプラズマ処理装置。
3. The shield ring and the electrode plate,
3. The plasma processing apparatus according to claim 2, wherein the plasma processing apparatus is made of the same material.
【請求項4】 前記シールドリングと前記電極板とは,
シリコンから構成されることを特徴とする,請求項3に
記載のプラズマ処理装置。
4. The shield ring and the electrode plate,
The plasma processing apparatus according to claim 3, wherein the plasma processing apparatus is made of silicon.
【請求項5】 前記シールドリングの抵抗値は,1〜1
0Ωcmであることを特徴とする,請求項2に記載のプ
ラズマ処理装置。
5. The resistance value of said shield ring is 1 to 1
3. The plasma processing apparatus according to claim 2, wherein the value is 0 Ωcm.
【請求項6】 前記電極板の抵抗値は,65〜85Ωc
mであることを特徴とする,請求項2に記載のプラズマ
処理装置。
6. The electrode plate has a resistance value of 65 to 85 Ωc.
3. The plasma processing apparatus according to claim 2, wherein m is m.
【請求項7】 前記電極板の外径は,前記第1電極の外
径よりも大きいことを特徴とする,請求項1,2,3,
4,5または6のいずれかに記載のプラズマ処理装置。
7. The method of claim 1, wherein an outer diameter of the electrode plate is larger than an outer diameter of the first electrode.
7. The plasma processing apparatus according to any one of 4, 5, and 6.
【請求項8】 処理室と;前記処理室内において被処理
体を載置可能な第1電極と;前記処理室内において前記
第1電極に対向配置された第2電極と;前記処理室内に
処理ガスを導入可能な処理ガス供給系と;前記処理室内
を真空排気可能な排気系と;前記第1および第2電極の
すくなくともいずれか一方に高周波電力を印加して前記
処理ガスをプラズマ化し前記被処理体に対して所定のプ
ラズマ処理を施す高周波電力供給系と;前記を備えたプ
ラズマ処理装置において:前記第2電極は,前記第1電
極に対向するように設けられた導電体または半導体で構
成された電極板と,この電極板の前記処理室内とは反対
側の面に儲けられ電極板を支持する導電性の支持体とを
備えており;前記第2電極の周囲には前記処理室内側に
前記電極板と同一面を有するシールドリングが配されて
おり,前記シールドリングの抵抗値は前記電極板の抵抗
値よりも低いことを特徴とする,プラズマ処理装置。
8. A processing chamber; a first electrode on which an object to be processed can be placed in the processing chamber; a second electrode disposed opposite to the first electrode in the processing chamber; and a processing gas in the processing chamber. A processing gas supply system capable of introducing a gas; an exhaust system capable of evacuating the processing chamber; and applying a high-frequency power to at least one of the first and second electrodes to convert the processing gas into plasma to form the processing target. A high-frequency power supply system for performing predetermined plasma processing on the body; and a plasma processing apparatus having the same: the second electrode is made of a conductor or a semiconductor provided so as to face the first electrode. An electrode plate and a conductive support provided on the surface of the electrode plate opposite to the processing chamber to support the electrode plate; Same surface as the electrode plate A plasma processing apparatus, comprising: a shield ring having a resistance value, wherein a resistance value of the shield ring is lower than a resistance value of the electrode plate.
【請求項9】 前記シールドリングと前記電極板とは,
同一材料から構成されることを特徴とする,請求項8に
記載のプラズマ処理装置。
9. The shield ring and the electrode plate,
The plasma processing apparatus according to claim 8, wherein the plasma processing apparatus is made of the same material.
【請求項10】 前記シールドリングと前記電極板と
は,シリコンから構成されることを特徴とする,請求項
9に記載のプラズマ処理装置。
10. The plasma processing apparatus according to claim 9, wherein the shield ring and the electrode plate are made of silicon.
【請求項11】 前記シールドリングの抵抗値は,1〜
10Ωcmであることを特徴とする,請求項8に記載の
プラズマ処理装置。
11. The resistance value of the shield ring is 1 to
9. The plasma processing apparatus according to claim 8, wherein the pressure is 10 Ωcm.
【請求項12】 前記電極板の抵抗値は,65〜85Ω
cmであることを特徴とする,請求項1に記載のプラズ
マ処理装置。
12. A resistance value of said electrode plate is 65-85Ω.
The plasma processing apparatus according to claim 1, wherein the diameter is cm.
【請求項13】 前記電極板の外径は,前記第1電極の
外径よりも大きいことを特徴とする,請求項8,9,1
0,11または12のいずれかに記載のプラズマ処理装
置。
13. The device according to claim 8, wherein an outer diameter of the electrode plate is larger than an outer diameter of the first electrode.
13. The plasma processing apparatus according to any one of 0, 11 and 12.
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