JP2001501769A - Shielded field emission display - Google Patents
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Abstract
Description
【発明の詳細な説明】 シールド電界放出ディスプレイ 本発明は、Advanced Research Projects Agency(ARPA)によって授与され た契約第DABT-63-93-C-0025号の下で政府の支援により行われたものである。政 府は、この発明において特定の権利を有する。発明の分野 本発明は、一般に電界放出ディスプレイ(field emission displays)に関 し、より特定的には、電界放出ディスプレイにおける駆動回路構造に関する。発明の背景 フラットパネルディスプレイは、コンピュータディスプレイを含む、種々 のアプリケーションに幅広く用いられている。そのようなフラットパネルディス プレイに適する一つの型のデバイスは、電界放出ディスプレイである。 電界放出ディスプレイは、一般に、ディスプレイ画面の下に概して平面( 二次元)のエミッタを含む。放出パネルは、上部表面から突出している表面不連 続のアレイを有している基板である。多くの場合、表面不連続は、円錐突出、ま たは基板と一体になる“エミッタ”である。一般に、エミッタは、エミッタセッ トにおけるエミッタのベースが共有して接続されるエミッタセットにグループ分 けされる。導電抽出グリッドは、エミッタの上に配置されかつ約30V−120 Vの電圧で駆動される。次いで、エミッタセットは、エミッタのベースとグラウ ンドとの間に電流路を供給することによって抽出グリッドからエミッタまで拡張 する電界を発生するために選択的に起動される。電界に応答して、エミッタセッ トは、電子を放出する。 ディスプレイ画面は、抽出グリッドの直ぐ上に取り付けられ、かつそれは 、約1−2kVにバイアスされたアノードを形成すべく透明導電材料で被覆され る。アノードは、放出された電子を引き寄せて、電子に抽出グリッドを通過させ る。カソードルミネッセンス層は、アノードを覆いかつそれらがアノードの1− 2kV電位に向かって移動するときに電子をインターセプト(阻止)すべく抽 出グリッドに対向する。電子は、カソードルミネッセンス層に衝突してカソード ルミネッセンス層に衝突場所で光を放出させる。次いで、放出された光は、それ が観察者に対して可視であるアノード及びディスプレイ画面を通過する。 放出された電子に応答して発生された光の輝度は、部分的に、電子がカソ ードルミネッセンス層に衝突するレートに依存し、それは、エミッタセットに電 子を供給するために利用可能な電流の大きさに依存する。次いで、各エリアの輝 度は、対応エミッタセットへの電流の流れを制御することによって制御すること ができる。それゆえに、エミッタセットへの電流の流れを選択的に制御すること によって、ディスプレイの各エリアからの光は、制御することができかつ画像を 生成することができる。それゆえに、エリアのそれぞれから放出された光は、絵 の要素または“画素”の全てまたは一部になる。 そのような電界放出ディスプレイにおける一つの問題は、エミッタへの電 流の安定した制御であり、特に駆動回路がエミッタと同じ基板に集積されるとこ ろにある。そのような集積駆動回路は、エミッタをグラウンドに選択的に接続す べく外部信号によって駆動される電界効果トランジスタを一般に含む。 そのようなトランジスタの高インピーダンスは、トランジスタの電流漏洩 をほとんど許容しない。その結果、基板にまたは基板から漏洩している電流は、 集積駆動回路によって拡散されない電荷累積をもたらしうる。そのような電荷累 積は、電界放出ディスプレイのオペレーションに対して不利益な効果を有しうる 。例えば、集積トランジスタがOFFであることを意図しているところで、チャー ジビルドアップは、電流にトランジスタチャネルを通ってブリードすることを許 容すべくトランジスタのバイアシングに影響を及ぼしうる。トランジスタを通っ てブリードするそのような電流は、エミッタに電子を供給しかつ光の不要な放出 をもたらしうる。発明の目的及び概要 電界放出ディスプレイは、基板の上部表面に複数のエミッタを有している 基板から形成されたエミッタパネルを含む。絶縁層は、エミッタを取り囲みかつ 抽出グリッドを支持する。抽出グリッドは、エミッタを取り囲みかつ抽出グリ ッドとエミッタとの間に電界を確立するためにグリッド電圧を供給する導電層で ある。エミッタと抽出グリッドとの間の電圧差(電位差)が十分に高いならば、 結果として得られる電界は、エミッタに電子を放出させる。 透明導電被覆によって覆われた透明プレートは、アノードを形成する。ア ノードは、エミッタの上に配置されかつそれに放出された電子を引き寄せさせる ように1−2kVの大きさの正電圧がアノードに印加される。カソードルミネッ セント層は、アノードに向かって移動する電子がカソードルミネッセント層に衝 突するように透明導電アノードを覆う。それに応答して、カソードルミネッセン ト層は、観察者によって見られるべく透明プレートを通過する光を放出する。 エミッタに対する電流の制御は、エミッタを担持する同じ基板に集積され た駆動回路素子によって達成される。集積駆動回路素子は、基板に集積されかつ 絶縁層によって覆われた複数のトランジスタを含む。 電荷シールド(charge shield)は、駆動回路に対する保護障壁を供給すべ く集積駆動回路の上の絶縁層を覆う。不活性化層は、電荷シールドを保護しかつ 絶縁するために電荷シールドを覆う。電荷シールドは、グラウンドへ電荷をブリ ードするために不活性化層と絶縁層との間に導電接地プレーンを供給し、それゆ えに、電荷が集積駆動回路素子に影響を及ぼことを防ぐ。更に、電荷シールドは 、不活性化層内で電界を終結させる導電プレーンを形成する。電界を終結させる ことによって、電荷シールドは、さもなければ集積駆動回路素子に結合しうる表 面電荷における過渡電荷(transient charges)の影響を低減する。図面の簡単な説明 図1は、電荷シールドがない従来の電界放出ディスプレイの一部の断面に おける側面図である。 図2は、図1の電界放出ディスプレイの一部の部分的に概略な、部分図で ある。 図3は、電荷シールドを含む、本発明による電界放出ディスプレイの一部 の断面における側面図である。実施例 図1に示すように、通常の電界放出ディスプレイ100の一部は、画面1 04の下にエミッティングパネル102のセクションを含む。エミッティングパ ネル102は、基板106の上部表面から上方に突出している一対のエミッタ1 08を有する単結晶のp−型シリコンの基板106の上に形成される。エミッタ 108は、電界放出ディスプレイのための既知の電子エミッティング構造であり かつ通常の製造技術により製造される。当業者は、たった二つのエミッタ108 が説明の明瞭化のために示されているが、エミッタ108の数は、2よりも一般 的に多いということを理解するであろう。 エミッタ108の下には、第1のn+領域110がn−領域112内の基 板106に形成される。n領域110、112は、以下に説明するように、エミ ッタ108のベースへの電気的接続を許容する。誘電材料の絶縁層114は、基 板106の上に被着される。絶縁層114は、対応するエミッタ108を取り囲 む開口113を有して形成される。絶縁層114の上部表面は、導電抽出グリッ ド116を担持する。絶縁層114及び抽出グリッド11は、既知の製造技術に より形成される。不活性化層120は、抽出グリッド116を保護しかつ電気的 に絶縁するために抽出グリッド116を覆う。不活性化層120内には、抽出グ リッド電圧VGにグリッド116を接続する導電線118がある。 一般的なように、画面104は、エミッタ108及びグリッド116の上 にある。画面104は、アノード152を形成すべく導電性の透明材料で被覆さ れた内側表面を有するガラスプレート150を含む。カソードルミネッセンス層 154は、アノード152の露光表面を被覆する。 オペレーションでは、抽出グリッド116は、約30−120Vのグリッ ド電圧VGでバイアスされ、かつアノード52は、1−2kVのような、高電圧 VAでバイアスされる。エミッタ108が、グラウンドのような、グリッド電圧 よりもさらに低い電圧に接続されたならば、グリッド116とエミッタ108の 間の電圧差(電位差)は、Fowler-Nordheim関係式によりエミッタ108に電子 を放出させるべくエミッタ108と抽出グリッドの間に十分に強力な電界を発 生する。放出された電子は、高アノード電圧VAにより引き寄せられかつアノー ド152に向かって移動してそこで電子がカソードルミネッセンス層154に衝 突してカソードルミネッセンス層154に衝突した場所の回りで光を放出させる 。放出された光は、観察者に対してそれが可視である透明なアノード152及び ガラスプレート150を通過する。 カソードルミネッセンス層154によって放出された光の強度は、エミッ タ108によって放出される電子がカソードルミネッセンス層154に衝突する レートに依存する。エミッタ108が電子を放出するレートは、次いで、エミッ タ108への電流の流れを制御することによって制御される。それゆえに、放出 された光の強度は、エミッタ108への電流の流れを制御することによって制御 することができる。 エミッタ108への電流の流れは、基板106に集積された駆動回路10 9によって制御される。駆動回路109は、次いで、駆動回路109に対する更 なる保護を供給すべく不活性化層164によって覆われる絶縁層114の下の基 板106に組込まれる。不活性化層164は、通常的に形成される絶縁保護層で ある。 以下に説明するように、エミッタ108の下のn+領域110及びn−領 域112は、エミッタ108への導電路を供給することに加えて、トランジスタ ドレーンも形成しそれゆえに駆動回路109の一部である。n−領域112の右 側には、基板106を覆っているポリ層123の一部が絶縁層122の上に配置 された電界効果トランジスタ126のゲート125を形成すべく第2のn+領域 124に拡張する。トランジスタ126のドレーンは、n−型領域110,11 2によって形成されかつエミッタ108のベースに直接接続される。トランジス タ126のソースは、第2のn+領域124によって形成され、かつ抵抗のよう な、通常の電流制限回路素子(図示省略)に接続される。ゲート電圧は、絶縁層 114に組込まれた導電線128及び導電バイア130を通ってゲート125に 印加される。トランジスタ126及びエミッタ108に対する等価回路は、図2 に示されている。 図1に戻ると、導電線128は、第1のバイア130から第2のバイア 132まで拡張して導電線128を第3のn+領域134に接続する。ポリ層1 23の第2のセクションは、第3のn+領域134から第4のn+領域138ま で拡張する。ゲート125を形成する第1の部分によるように、ポリ層123の 第2のセクションは、絶縁層137の上に配置された第2の電界効果トランジス タ140のゲート136を形成する。第3のn+領域134は、第2のトランジ スタ140のソースでありかつ第4のn+領域138は、ドレーンである。p+ 型材料の埋込分離領域149は、第1のトランジスタ126のソースが第2のト ランジスタ140のソースから電気的に分離されるように第3のn+領域134 から第2のn+領域124を電気的に分離する。第2のトランジスタ140のソ ースは、導電トレース128及びバイア130、132を通って第1のトランジ スタ126のゲート125に電気的に接続される。トランジスタ126、140 のカップリングは、図2の回路図において明らかであろう。 再び図1に戻ると、外部的に供給されるロー(row)電圧VRは、導電バイア 142及び第2の埋込線144を通って第2のトランジスタ140のゲート13 6に印加される。第2のトランジスタ140のトレーンである、第4のn+領域 138は、第3の埋込線146によって画像信号VIに接続される。 図2から分かるように、ロー電圧VRが高い場合には、トランジスタ14 0は、ONでありかつ画像信号VIを第1のトランジスタ126のゲートに供給 する。次いで、エミッタ108へ流れる電流の大きさは、第2のトランジスタ1 40のドレーンに印加される画像信号VIの振幅に対応する。ロー電圧VRが低い 場合には、第2のトランジスタ140は、OFFでありかつ初期的に転送された 画像信号VI電圧は、第2のと40のソースに保持されて電圧を第1のトランジ スタの126のゲートに連続的に印加させる。ゲート電圧が十分に高いならば、 第1のトランジスタ126は、エミッタ108に電流を連続的に供給して、光を 放出させる。ゲート電圧が低いならば、第1のトランジスタ126は、OFFで ありかつ光は放出されない。それゆえに、ロー電圧VRが高い場合、光放出の強 度は、画像信号VIによって制御される;そして、ロー電圧VRが低い場合、光は 、ロー電圧VRが低くなる直前の画像信号VIの電圧に対応するレベルで放出され る。一般的なアプリケーションでは、画像信号VIは、ビデオ画像信号の サンプルである。 上記説明は、エミッタ108から放出された電子のトランジスタ126、 140への可能な影響及び高アノード電圧VAの影響を考慮していない。エミッ タ108から放出された電子は、不活性化層164に衝突しかつ不活性化層16 4を負に帯電することができる。不活性化層164の電子二次放出係数が電子衝 突エネルギーに対するものよりも大きいならば、不活性化層は、正に帯電するこ とができる。電子は、また、アノード152と抽出グリッド116の間の間隙ま たはアノード152の表面のいずれかにおいて粒子の電子衝突イオン化をもたら すこともできる。次いで、これらのイオンは、不活性化層120及び164上で 収集されてそれを正に帯電させる。従って、電子は、不活性化層164上に電荷 を直接的または間接的に蓄積させる。この電荷は、駆動回路109のオペレーシ ョンに影響を及ぼす電界を発生する。 更に、電荷蓄積の結果として、電界E1は、不活性化層164及び絶縁層 114内で生成される。電界E1は、絶縁層114を通して、自由電了またはイ オン不純物のような、電荷の移動をもたらしうる。これらの電荷は、特に、金属 層に覆われていない基板106の領域において、基板106へのまたはそれから の電荷漏洩をもたらしうる。例えば、バイア132によって覆われていないまま の134における第3のn+領域の一部は、絶縁層114を通して電荷浮遊に露 出される。 電界E1は、トランジスタ140がOFFであることを意図している場合 に第3のn+領域134において特に問題となる。この条件では、第2のトラン ジスタ140は、非常に高いインピーダンスを示す。その結果、第3のn+領域 134から電流を素早くブリードするための経路が存在しない。電流が第3のn +領域134に漏洩するならば、第3のn+領域134は、変化して、第1のト ランジスタ126のゲート電圧を上昇させる。それに応じて、第1のトランジス タ126は、もはや真にOFFではなく、ある電流をエミッタ108に流させて 、それにより光を放出させる。 第3のn+領域134への電荷漏洩が不要な光放出をもたらさなくとも、 n+領域134の電圧における結果として得られる増大は、有害でありうる。 例えば、延長したオペレーションの間に、電圧は、集積されたコンポーネントの エージングまたは破損をもたらしうる。 不活性化層164への表面電荷の更なる影響は、表面電荷が動的に変化す る場合に生起される。ローカルエミッタセット108の起動による電子の増加の ような、過渡条件は、表面電荷密度における動的変化をもたらしうる。表面電荷 密度におけるそのような変化は、不活性化層164及び絶縁層114における電 界変化をもたらし、それらは集積駆動回路に影響を及ぼす。それに応じて、トラ ンジスタ126のゲートにおける電圧は、変化して、エミッタ108への電流の 流れにおける変化をもたらす。 本発明は、図3に示した電界放出ディスプレイ200の部分で実施したよ うに、絶縁層114における電界及び基板106への電荷漏洩の問題に取り組む 。図3の多数の構成要素は、図1のディスプレイ100の構成要素に直接対応し かつ同様に番号付けされている。例えば、画面104、抽出グリッド116、エ ミッタ108及び駆動回路109は、図1の通常のディスプレイのものと同一で ある。 図3のディスプレイ200は、不活性化層164と絶縁層114との間の 電荷シールド162の使用において図1の従来技術のディスプレイ100とは主 に異なる。電荷シールド162は、絶縁層114の上に被着される、金属被覆層 のような、導電材料から通常の集積回路製造技術により形成される。電荷シール ド162の追加は、構成要素の相互接続を変えない。従って、図2の等価回路は 、図1及び図3のディスプレイに同様に適用される。 電荷シールド162は、グラウンドに接続されて不活性化層164上の表面 電荷蓄積の下に連続グラウンドプレーンを供給する。電荷シールド162のグラ ウンドプレーンは、不活性化層164の表面上の電荷蓄積によってもたらされる 電界E2を終結する。それゆえに、電界E2が高くても、基板106と電荷シール ド162との間の絶縁層114の電界E3は、非常に小さい。 電荷シールド162が電界E2をブロックするので、電界E2によってもたら された不活性化層164内の電荷浮遊は、グラウンドにブリードされる。電荷シ ールド162の下の絶縁層114内では、電荷移動は、電荷シールド162と 基板106との間の電界E3の低い強度により最小化される。 電荷浮遊の影響を低減することに加えて、電荷シールド162は、また、電 界E2を終結することによって表面電荷における動的変化の影響も低減する。不 活性化層164内の表面電荷における動的変化は、電界E2だけに影響を及ぼし 、絶縁層114の電界E3は、実質的に影響を受けない。その結果、電界E2にお ける変化の影響は、駆動回路109ではなく、電荷シールド162のグラウンド プレーンに向けられる。 上述したように、本発明の例示的実施例が説明のためにここに説明されたけ れども、種々の変更が本発明の精神及び範疇から逸脱することなくなされうると いうことが理解できるであろう。例えば、エミッタ電流を制御するための種々の 代替駆動回路が電荷シールド162の効果から利益を得るであろう。更に、好ま しい実施例は、不活性化層164を含んで説明されたが、あるアプリケーション では不活性化層164は、削除されうる。次いで、露光コンダクタは、表面上の あらゆる電荷の除去のための経路を供給する。また、電荷シールド162は、好 ましい実施例ではグラウンドに接続されるように説明されたが、電荷シールド1 62は、また、異なる電圧にも接続されうる。従って、本発明は、請求の範囲に よって示されたもの以外には限定されるものではない。This invention was made with Government support under Contract No. DABT-63-93-C-0025 awarded by the Advanced Research Projects Agency (ARPA). is there. The government has certain rights in this invention. FIELD OF THE INVENTION The present invention relates generally to field emission displays, and more particularly, to drive circuitry in field emission displays. Background of the Invention Flat panel displays are widely used in a variety of applications, including computer displays. One type of device suitable for such a flat panel display is a field emission display. Field emission displays generally include a generally planar (two-dimensional) emitter below the display screen. Emission panels are substrates having an array of surface discontinuities protruding from the top surface. Often, surface discontinuities are conical protrusions, or "emitters" that become integral with the substrate. Generally, the emitters are grouped into emitter sets to which the bases of the emitters in the emitter set are connected in common. The conductive extraction grid is located above the emitter and is driven at a voltage of about 30V-120V. The emitter set is then selectively activated to generate an electric field that extends from the extraction grid to the emitter by providing a current path between the base of the emitter and ground. In response to the electric field, the emitter set emits electrons. The display screen is mounted just above the extraction grid, and it is coated with a transparent conductive material to form an anode biased at about 1-2 kV. The anode attracts the emitted electrons and allows them to pass through the extraction grid. The cathodoluminescent layer covers the anode and faces the extraction grid to intercept electrons as they move toward the anode's 1-2 kV potential. The electrons collide with the cathodoluminescent layer causing the cathodoluminescent layer to emit light at the location of the collision. The emitted light then passes through the anode and the display screen where it is visible to the viewer. The brightness of the light generated in response to the emitted electrons depends, in part, on the rate at which the electrons impinge on the cathodoluminescent layer, which is the magnitude of the current available to supply the electrons to the emitter set. Depends on. The brightness of each area can then be controlled by controlling the current flow to the corresponding emitter set. Therefore, by selectively controlling the flow of current to the emitter set, the light from each area of the display can be controlled and produce an image. Thus, the light emitted from each of the areas becomes all or part of a picture element or "pixel". One problem in such a field emission display is the stable control of the current to the emitter, especially where the drive circuit is integrated on the same substrate as the emitter. Such integrated drive circuits generally include a field effect transistor driven by an external signal to selectively connect the emitter to ground. The high impedance of such a transistor allows very little current leakage of the transistor. As a result, current leaking into or out of the substrate can result in charge accumulation that is not diffused by the integrated drive circuit. Such charge accumulation can have a detrimental effect on the operation of the field emission display. For example, where the integrated transistor is intended to be OFF, charge buildup can affect transistor biasing to allow current to bleed through the transistor channel. Such current bleeding through the transistor can supply electrons to the emitter and cause unwanted emission of light. Objects and Summary of the Invention A field emission display includes an emitter panel formed from a substrate having a plurality of emitters on a top surface of the substrate. An insulating layer surrounds the emitter and supports the extraction grid. The extraction grid is a conductive layer surrounding the emitter and supplying a grid voltage to establish an electric field between the extraction grid and the emitter. If the voltage difference (potential difference) between the emitter and the extraction grid is high enough, the resulting electric field will cause the emitter to emit electrons. The transparent plate covered by the transparent conductive coating forms the anode. The anode is located above the emitter and a positive voltage of 1-2 kV is applied to the anode to attract the emitted electrons. The cathodoluminescent layer covers the transparent conductive anode such that electrons traveling toward the anode impinge on the cathodoluminescent layer. In response, the cathodoluminescent layer emits light that passes through the transparent plate to be viewed by an observer. Control of the current to the emitter is achieved by drive circuit elements integrated on the same substrate carrying the emitter. An integrated drive circuit element includes a plurality of transistors integrated on a substrate and covered by an insulating layer. A charge shield covers the insulating layer over the integrated drive circuit to provide a protective barrier for the drive circuit. The passivation layer covers the charge shield to protect and insulate the charge shield. The charge shield provides a conductive ground plane between the passivation layer and the insulating layer to bleed the charge to ground, thus preventing the charge from affecting integrated drive circuit elements. In addition, the charge shield forms a conductive plane that terminates the electric field in the passivation layer. By terminating the electric field, the charge shield reduces the effects of transient charges on surface charges that could otherwise couple to integrated drive circuit elements. BRIEF DESCRIPTION OF THE DRAWINGS FIG. 1 is a side view in cross section of a portion of a conventional field emission display without a charge shield. FIG. 2 is a partially schematic, partial view of a portion of the field emission display of FIG. FIG. 3 is a side view in cross section of a portion of a field emission display according to the present invention, including a charge shield. EXAMPLE As shown in FIG. 1, a portion of a typical field emission display 100 includes a section of an emitting panel 102 below a screen 104. The emitting panel 102 is formed on a single crystal p-type silicon substrate 106 having a pair of emitters 108 projecting upward from the upper surface of the substrate 106. Emitter 108 is a known electron emitting structure for a field emission display and is manufactured by conventional manufacturing techniques. One skilled in the art will appreciate that although only two emitters 108 are shown for clarity of explanation, the number of emitters 108 is generally greater than two. Under the emitter 108, a first n + region 110 is formed on the substrate 106 in the n- region 112. The n regions 110, 112 allow for electrical connection of the emitter 108 to the base, as described below. An insulating layer 114 of a dielectric material is deposited over the substrate 106. The insulating layer 114 is formed having an opening 113 surrounding the corresponding emitter 108. The upper surface of the insulating layer 114 carries a conductive extraction grid 116. The insulating layer 114 and the extraction grid 11 are formed by a known manufacturing technique. Passivation layer 120 covers extraction grid 116 to protect and electrically isolate extraction grid 116. The passivation layer 120, there is a conductive line 118 that connects the grid 116 to the extraction grid voltage V G. As is typical, screen 104 is above emitter 108 and grid 116. Screen 104 includes a glass plate 150 having an inner surface coated with a conductive transparent material to form anode 152. The cathodoluminescent layer 154 covers the exposed surface of the anode 152. In operation, the extraction grid 116 is biased at a grid voltage V G of about 30-120V, and the anode 52, such as 1-2KV, is biased at a high voltage V A. If the emitter 108 is connected to a voltage lower than the grid voltage, such as ground, the voltage difference (potential difference) between the grid 116 and the emitter 108 causes electrons to be emitted to the emitter 108 by the Fowler-Nordheim relation. A sufficiently strong electric field is generated between the emitter 108 and the extraction grid to cause this. The emitted electrons are attracted by the high anode voltage VA and move toward the anode 152 where they collide with the cathodoluminescent layer 154 and emit light around where it collided with the cathodoluminescent layer 154. The emitted light passes through the transparent anode 152 and the glass plate 150 where it is visible to the viewer. The intensity of the light emitted by the cathodoluminescent layer 154 depends on the rate at which electrons emitted by the emitter 108 strike the cathodoluminescent layer 154. The rate at which emitter 108 emits electrons is then controlled by controlling the flow of current to emitter 108. Therefore, the intensity of the emitted light can be controlled by controlling the current flow to the emitter 108. The flow of current to the emitter 108 is controlled by a drive circuit 109 integrated on the substrate 106. The drive circuit 109 is then incorporated into the substrate 106 under the insulating layer 114 covered by the passivation layer 164 to provide further protection for the drive circuit 109. The passivation layer 164 is a normally formed insulating protection layer. As described below, the n + region 110 and n− region 112 under the emitter 108, in addition to providing a conductive path to the emitter 108, also form a transistor drain, and thus are part of the driver circuit 109. is there. To the right of the n- region 112, a portion of the poly layer 123 covering the substrate 106 extends to a second n + region 124 to form a gate 125 of a field effect transistor 126 disposed on the insulating layer 122. I do. The drain of transistor 126 is formed by n-type regions 110, 112 and is connected directly to the base of emitter 108. The source of transistor 126 is formed by second n + region 124 and is connected to a normal current limiting circuit element (not shown), such as a resistor. A gate voltage is applied to gate 125 through conductive lines 128 and conductive vias 130 embedded in insulating layer 114. An equivalent circuit for the transistor 126 and the emitter 108 is shown in FIG. Returning to FIG. 1, conductive line 128 extends from first via 130 to second via 132 to connect conductive line 128 to third n + region 134. The second section of the poly layer 123 extends from the third n + region 134 to the fourth n + region 138. The second section of the poly layer 123 forms the gate 136 of the second field effect transistor 140 disposed on the insulating layer 137, as by the first part forming the gate 125. Third n + region 134 is the source of second transistor 140 and fourth n + region 138 is the drain. A buried isolation region 149 of p + type material electrically connects third n + region 134 to second n + region 124 such that the source of first transistor 126 is electrically isolated from the source of second transistor 140. To separate. The source of second transistor 140 is electrically connected to gate 125 of first transistor 126 through conductive trace 128 and vias 130,132. The coupling of transistors 126, 140 will be apparent in the circuit diagram of FIG. Returning to FIG. 1 again, an externally supplied row voltage V R is applied to the gate 136 of the second transistor 140 through the conductive via 142 and the second buried line 144. A train of the second transistor 140, a fourth n + region 138 is connected to the image signal V I by the third buried line 146. As it can be seen from Figure 2, when a low voltage V R is high, transistor 14 0 supplies it and the image signal V I is ON to the gate of the first transistor 126. Then, the magnitude of the current flowing to the emitter 108 corresponds to the amplitude of the image signal V I applied to the drain of the second transistor 1 40. When the low voltage V R is low, the second transistor 140 is OFF and the initially transferred image signal V I voltage is held at the sources of the second and forty to reduce the voltage to the first. The voltage is continuously applied to the gate of 126 of the transistor. If the gate voltage is high enough, the first transistor 126 continuously supplies current to the emitter 108 to emit light. If the gate voltage is low, the first transistor 126 is off and no light is emitted. Therefore, when a low voltage V R is high, the intensity of light emission is controlled by the image signal V I; When low voltage V R is low, the light, the image signal immediately before the low voltage V R is lower It is released at a level corresponding to the voltage of V I. In a typical application, the image signal V I is the sample of the video image signal. The above description does not take into account the possible effects of the electrons emitted from the emitter 108 on the transistors 126, 140 and the effect of the high anode voltage VA . The electrons emitted from the emitter 108 can collide with the passivation layer 164 and charge the passivation layer 164 negatively. If the electron secondary emission coefficient of passivation layer 164 is greater than for electron impact energy, passivation layer can be positively charged. Electrons can also cause electron impact ionization of particles at either the gap between anode 152 and extraction grid 116 or at the surface of anode 152. These ions are then collected on passivation layers 120 and 164, making it positively charged. Thus, the electrons cause the charge to accumulate directly or indirectly on passivation layer 164. This charge generates an electric field that affects the operation of the drive circuit 109. Furthermore, as a result of the charge accumulation, an electric field E 1 is generated in the passivation layer 164 and the insulating layer 114. The electric field E 1 can cause charge transfer, such as free charge or ionic impurities, through the insulating layer 114. These charges can result in charge leakage to and from the substrate 106, particularly in those areas of the substrate 106 that are not covered by the metal layer. For example, a portion of the third n + region at 134 that is left uncovered by via 132 is exposed to charge floating through insulating layer 114. Electric field E 1 is particularly problematic in third n + region 134 when transistor 140 is intended to be off. Under this condition, the second transistor 140 has a very high impedance. As a result, there is no path for rapidly bleeding current from third n + region 134. If current leaks into the third n + region 134, the third n + region 134 changes to increase the gate voltage of the first transistor 126. In response, the first transistor 126 is no longer truly OFF, causing a current to flow through the emitter 108, thereby emitting light. Even though charge leakage to the third n + region 134 does not result in unwanted light emission, the resulting increase in voltage of the n + region 134 can be detrimental. For example, during extended operation, the voltage can cause aging or breakage of the integrated components. A further effect of surface charge on passivation layer 164 occurs when the surface charge changes dynamically. Transient conditions, such as an increase in electrons due to activation of the local emitter set 108, can result in dynamic changes in surface charge density. Such changes in surface charge density result in electric field changes in passivation layer 164 and insulation layer 114, which affect integrated drive circuits. Accordingly, the voltage at the gate of transistor 126 changes, resulting in a change in current flow to emitter 108. The present invention addresses the problem of electric fields in the insulating layer 114 and charge leakage to the substrate 106, as implemented in the portion of the field emission display 200 shown in FIG. The many components of FIG. 3 correspond directly to the components of display 100 of FIG. 1 and are similarly numbered. For example, the screen 104, the extraction grid 116, the emitter 108, and the driving circuit 109 are the same as those of the normal display of FIG. The display 200 of FIG. 3 differs primarily from the prior art display 100 of FIG. 1 in the use of a charge shield 162 between the passivation layer 164 and the insulating layer 114. The charge shield 162 is formed from a conductive material, such as a metallization layer, deposited over the insulating layer 114 by conventional integrated circuit manufacturing techniques. The addition of the charge shield 162 does not change the interconnection of the components. Thus, the equivalent circuit of FIG. 2 applies equally to the displays of FIGS. 1 and 3. The charge shield 162 is connected to ground to provide a continuous ground plane under the surface charge accumulation on the passivation layer 164. Ground plane of the charge shield 162 terminates the electric field E 2 caused by charge accumulation on the surface of the passivation layer 164. Therefore, even if the electric field E 2 is high, the electric field E 3 of the insulating layer 114 between the substrate 106 and the charge shield 162 is very small. The charge shield 162 blocks the electric field E 2, charges floating in brought the passivation layer 164 by an electric field E 2 is bleed to ground. In the insulating layer 114 beneath the charge shield 162, the charge transfer is minimized due to the low strength of the electric field E 3 between the charge shield 162 and the substrate 106. In addition to reducing the influence of the charge floating charge shield 162 also reduces the influence of the dynamic changes in the surface charge by terminating the electric field E 2. Dynamic changes in the surface charge of the passivation layer 164 affects only the electric field E 2, the electric field E 3 of the insulating layer 114 is substantially unaffected. As a result, the effect of the change in the electric field E 2 is directed to the ground plane of the charge shield 162 instead of the drive circuit 109. As noted above, while exemplary embodiments of the invention have been described herein by way of illustration, it will be understood that various changes can be made without departing from the spirit and scope of the invention. For example, various alternative drive circuits for controlling the emitter current would benefit from the effect of the charge shield 162. Further, while the preferred embodiment has been described including passivation layer 164, in some applications passivation layer 164 may be omitted. The exposure conductor then provides a path for removal of any charge on the surface. Also, while the charge shield 162 has been described as being connected to ground in the preferred embodiment, the charge shield 162 may also be connected to different voltages. Accordingly, the invention is not limited except as by the appended claims.
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