JP2001119770A - Monitor signal control signal transfer system for overhang device - Google Patents

Monitor signal control signal transfer system for overhang device

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JP2001119770A
JP2001119770A JP29790899A JP29790899A JP2001119770A JP 2001119770 A JP2001119770 A JP 2001119770A JP 29790899 A JP29790899 A JP 29790899A JP 29790899 A JP29790899 A JP 29790899A JP 2001119770 A JP2001119770 A JP 2001119770A
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signal
bits
bit
subscriber
section
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JP29790899A
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Japanese (ja)
Inventor
Seiichi Nishiyama
誠一 西山
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Toyo Communication Equipment Co Ltd
Original Assignee
Toyo Communication Equipment Co Ltd
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Abstract

PROBLEM TO BE SOLVED: To provide a monitor signal control signal transfer system for an overhang device where no exclusive TS is required for transfer of a monitor control signal through a subscriber line between overhang devices. SOLUTION: A 2B1Q package 5 connected to a 6M multiplex conversion section and a 6M demultiplex conversion section 7 consists of a 1st port 14 comprising a 2W/4W conversion section 8 accommodating a line, a 2B1Q termination generating section 9 that terminates a 2B1Q transmission line signal and converts it into an in-device signal or generates a 2B1Q transmission line signal, an M-bit insertion section 10 that inserts M-bits to the in-device signal, a 2M/6M conversion section 11 that conducts velocity conversion, a 6M/2M conversion section 12, and a M-bit extract section 13 that extracts M-bits required for the 2B1Q transmission signal from the in-device signal, a 2nd port 15 having the same functions as those of the 1st port 14, a monitor control interface section 16 that sends/receives a monitor control signal between the central monitor control section and a 2B1Q package, and a CPU 17 that controls each section in the inside of the package.

Description

【発明の詳細な説明】DETAILED DESCRIPTION OF THE INVENTION

【0001】[0001]

【発明の属する技術分野】本発明は張り出し装置の監視
制御信号転送方式に関し、2B1Qエコーキャンセラ伝
送方式において使用されている監視制御のためのMビッ
トを、回線途中に設けた張り出し装置等により中継する
際に、張り出し装置間においてもMビット転送を可能と
する張り出し装置の監視制御信号転送方式。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a monitoring control signal transfer system for an overhanging device, and relays M bits for monitoring and control used in a 2B1Q echo canceller transmission system by an overhanging device provided in the middle of a line. In this case, an overhanging device monitoring control signal transfer method that enables M-bit transfer between overhanging devices.

【0002】[0002]

【従来の技術】ディジタル通信化した加入者回線の通信
方式は各種標準化され運用されているが、その中の一つ
の方式として2B1Qエコーキャンセラ伝送方式があ
る。2B1Qとは4値符号化を意味し、2B1Qエコー
キャンセラ伝送方式とは2線式の加入者回線を用い、送
受信分離点での送受信信号間の回り込みを防止するため
にエコーキャンセラを用いて4値符号化信号通信を行う
方式である。
2. Description of the Related Art Various types of communication systems for digital subscriber lines are standardized and operated, and one of them is a 2B1Q echo canceller transmission system. 2B1Q means quaternary coding, and the 2B1Q echo canceller transmission method uses a two-wire subscriber line, and uses a four-valued echo canceller to prevent a sneak path between transmission and reception signals at a transmission and reception separation point. This is a method for performing coded signal communication.

【0003】次に、2B1Qエコーキャンセラ伝送方式
に加入者回線を有効に使用するために張り出し装置を設
け、複数の加入者回線を多重し、任意の地点に張り出す
ような機能拡張した伝送システムについて説明する。
[0003] Next, a transmission system with an extended function in which an overhanging device is provided to effectively use a subscriber line in the 2B1Q echo canceller transmission system, a plurality of subscriber lines are multiplexed, and overhangs at an arbitrary point. explain.

【0004】図6は、従来の張り出し装置を設けた伝送
システムの構成例であって、2B1Qインタフェースを
備えた交換機1と、2B1Qインターフェースを任意伝
送路に対応したインターフェースに変換する張り出し装
置2及び3と、ユーザ側に設置するディジタルサービス
ユニット(以降、DSUと称す)4とにより構成する。
以下、張り出し装置の一例として多重化装置を想定し、
図6の動作を説明する交換機1は、収容する加入者回線
のインタフェースとして2B1Qエコーキャンセラ伝送
方式を備えており、所定の加入者回線を複数接続する。
本構成例においては、A局に設置した多重化装置から成
る張り出し装置2により、交換機1が収容する2B1Q
エコーキャンセラ伝送方式による加入者回線を複数多重
化し、多重化装置から成る張り出し装置3を介してB局
に張り出すものである。従って、張り出し装置2は、2
B1Qエコーキャンセラ伝送方式の回線を終端し、受信
信号を構成するタイムスロット(以降、TSと称す)の
識別分離を行い、分離した2B1Qエコーキャンセラ伝
送方式の監視制御信号であるMビットと張り出し装置2
及び3間において必要な監視制御ビットを主信号に付加
し、複数の加入者回線を多重して所定の伝送路多重化信
号を生成しB局に設置した張り出し装置3に出力する。
張り出し装置3においては、受信した伝送路多重化信号
を終端し、識別分離すると共に分離した信号を基に所定
の2B1Q伝送信号を生成し、ユーザ宅に設置したDS
U4に出力する。そこで、ユーザは、DSU4に接続し
た各種の端末機を使用して通信を行う。
FIG. 6 shows an example of the configuration of a transmission system provided with a conventional overhanging device, which includes an exchange 1 having a 2B1Q interface and overhanging devices 2 and 3 for converting the 2B1Q interface into an interface corresponding to an arbitrary transmission line. And a digital service unit (hereinafter referred to as DSU) 4 installed on the user side.
Hereinafter, assuming a multiplexing device as an example of the overhanging device,
The exchange 1 for explaining the operation of FIG. 6 has a 2B1Q echo canceller transmission system as an interface of a subscriber line to be accommodated, and connects a plurality of predetermined subscriber lines.
In this configuration example, 2B1Q accommodated by the exchange 1 is
A plurality of subscriber lines based on the echo canceller transmission system are multiplexed, and are extended to the B station via the extension device 3 composed of a multiplexing device. Therefore, the overhanging device 2 is 2
The line of the B1Q echo canceller transmission system is terminated, a time slot (hereinafter, referred to as a TS) constituting a received signal is discriminated and separated, and the M bit, which is a monitoring control signal of the separated 2B1Q echo canceller transmission system, and the overhanging device 2
And a required supervisory control bit is added to the main signal, and a plurality of subscriber lines are multiplexed to generate a predetermined transmission line multiplexed signal, which is output to the overhanging device 3 installed in the B station.
The overhanging device 3 terminates the received transmission path multiplexed signal, identifies and separates it, generates a predetermined 2B1Q transmission signal based on the separated signal, and sets the DS2 installed at the user's home.
Output to U4. Therefore, the user performs communication using various terminals connected to the DSU4.

【0005】[0005]

【発明が解決しようとする課題】しかしながら、従来の
張り出し装置の監視制御信号転送方式は、下記のような
問題点が生じていた。すなわち、2B1Qエコーキャン
セラ伝送方式においては、3TSを専有する主信号2B
+Dと、交換機とDSU間で必要な2B1Q伝送路上の
起動表示や試験制御等を行う監視制御信号であるMビッ
トを伝送しているが、張り出し装置においては、Mビッ
トの伝送に1TSを割り当て、主信号と共に計4TSを
1回線で専有させている。図7は、従来の張り出し装置
間にて用いられる6Mb/sの伝送速度による主信号の
フレーム構成を示す図である。同図は、張り出し装置と
して6M多重化装置を一例としたもので、125μse
c間に8ビット構成のTSを96多重可能であるが、2
B1Qエコーキャンセラ伝送方式の回線を1回線伝送す
るために4TSを専有すると、6M多重化装置としては
2B1Qエコーキャンセラ伝送方式の回線が24回線し
か収容出来ず、6M伝送路の有効な活用を妨げている。
However, the conventional monitoring control signal transfer method of the overhanging device has the following problems. That is, in the 2B1Q echo canceller transmission system, the main signal 2B exclusively occupying 3TS
+ D and M bits, which are monitoring control signals for performing start-up display and test control on the 2B1Q transmission line required between the exchange and the DSU, are transmitted. In the overhanging apparatus, 1 TS is allocated to the transmission of M bits. A total of 4 TSs are occupied by one line together with the main signal. FIG. 7 is a diagram showing a frame configuration of a main signal at a transmission rate of 6 Mb / s used between conventional overhanging devices. The figure shows an example of a 6M multiplexing device as an overhanging device.
96 multiplexes of 8-bit TS can be multiplexed between c.
If 4TS is occupied in order to transmit one line of the B1Q echo canceller transmission system, only 24 lines of the 2B1Q echo canceller transmission system can be accommodated as a 6M multiplexing device, preventing effective use of the 6M transmission line. I have.

【0006】本発明は、上述したような従来の張り出し
装置の監視制御信号転送方式の問題を解決するためにな
されたものであって、2B1Qエコーキャンセラ伝送方
式を張り出し装置により張り出す際に、対向する張り出
し装置間において監視制御信号であるMビットの転送に
専用のTSを要しない張り出し装置の監視制御信号転送
方式を提供することを目的とする。
SUMMARY OF THE INVENTION The present invention has been made to solve the above-described problem of the conventional supervisory control signal transfer system of an overhanging device. When the 2B1Q echo canceller transmission system is overhanged by the overhanging device, a countermeasure is required. It is an object of the present invention to provide a method for transferring a supervisory control signal of an overhanging device which does not require a dedicated TS for transferring the M-bit monitoring control signal between the overhanging devices.

【0007】[0007]

【課題を解決するための手段】上記目的を達成するため
に本発明に係る張出装置の監視制御信号転送方式は以下
の構成をとる。
In order to achieve the above object, a monitoring control signal transfer method for an overhanging apparatus according to the present invention has the following configuration.

【0008】請求項1記載の張出装置の監視制御信号転
送方式は、交換機に収容された加入者回線を中継しディ
ジタルサービスユニットに加入者伝送路信号を入出力す
る張り出し装置において、前記交換機或いはディジタル
サービスユニットより受信した加入者伝送路信号の同期
を確立することにより該加入者伝送路信号を終端し、該
加入者伝送路信号を構成している制御チャネルに設けた
監視制御ビットを分離して、張り出し装置間を伝送する
主信号であるユーザーデータチャネルの2B+Dを構成
するDチャネルの空きビットに前記加入者伝送路信号の
監視制御ビットを付加し対向する張り出し装置に転送
し、該対向する張り出し装置においては、受信したユー
ザチャネルの2B+Dを構成するDチャネルの空きビッ
トに付加された加入者伝送路信号の監視制御ビットを抽
出し、加入者伝送路信号を構成している制御チャネルに
付加して加入者伝送路信号のフレームを再構築し前記デ
ィジタルサービスユニット或いは交換機に出力するよう
構成する。
According to a first aspect of the present invention, there is provided an overhang apparatus for transmitting and receiving a subscriber transmission line signal to / from a digital service unit by relaying a subscriber line accommodated in an exchange. Terminating the subscriber line signal by establishing the synchronization of the subscriber line signal received from the digital service unit, and separating the supervisory control bits provided in the control channel constituting the subscriber line signal. The supervisory control bit of the subscriber transmission path signal is added to the vacant bits of the D channel constituting 2B + D of the user data channel, which is the main signal transmitted between the overhanging devices, and transferred to the overhanging device. In the overhanging device, the subscription added to the vacant bits of the D channel constituting 2B + D of the received user channel A monitoring control bit of the transmission line signal is extracted and added to the control channel constituting the subscriber transmission line signal to reconstruct a frame of the subscriber transmission line signal and to output the frame to the digital service unit or the exchange. .

【0009】請求項2記載の張出装置の監視制御信号転
送方式は、前記加入者伝送路信号が2B1Qエコーキャ
ンセラ伝送信号であるよう構成する。
According to a second aspect of the present invention, there is provided a system for transmitting a supervisory control signal of an overhanging apparatus, wherein the subscriber transmission path signal is a 2B1Q echo canceller transmission signal.

【0010】請求項3記載の張出装置の監視制御信号転
送方式は、前記張り出し装置が多重化装置であるよう構
成する。
[0010] According to a third aspect of the present invention, the overhanging device monitoring control signal transfer system is configured such that the overhanging device is a multiplexing device.

【0011】[0011]

【発明の実施の形態】以下、図示した実施例に基づいて
本発明を詳細に説明する。
DETAILED DESCRIPTION OF THE PREFERRED EMBODIMENTS Hereinafter, the present invention will be described in detail based on illustrated embodiments.

【0012】図1は本発明に係る監視制御信号転送方式
を実施する装置の構成例を示す図である。同図は、張り
出し装置として6M多重化装置を一実施例としたもの
で、6M多重化装置の加入者回線側或いは交換機回線側
に接続する2B1Qインタフェースを備えた2B1Q終
端パッケージ5を示し、複数の2B1Q終端パッケージ
が、6M多重変換部6及び6M分離変換部7に接続す
る。
FIG. 1 is a diagram showing an example of the configuration of an apparatus for implementing a supervisory control signal transfer method according to the present invention. The figure shows a 6M multiplexer as an embodiment of an overhanging apparatus, and shows a 2B1Q termination package 5 having a 2B1Q interface connected to a subscriber line side or a switching line side of the 6M multiplexer. The 2B1Q termination package connects to the 6M multiplex conversion unit 6 and the 6M separation conversion unit 7.

【0013】2B1Qパッケージ5は第一のポート1
4、第二のポート15、装置内に設けた集中監視制御部
と2B1Qパッケージ5との間で監視制御信号の送受信
を行う監視制御インタフェース部16と、2B1Q終端
パッケージ5内の制御を行うCPU17とにより構成す
る。
The 2B1Q package 5 is the first port 1
4, a second port 15, a monitor and control interface 16 for transmitting and receiving a monitor and control signal between the centralized monitor and control unit provided in the device and the 2B1Q package 5, and a CPU 17 for controlling the inside of the 2B1Q terminal package 5. It consists of.

【0014】前記第一のポート14はU点インタフェー
スである加入者回線或いは交換機回線を収容する2W/
4W変換部8と、2B1Q伝送信号を終端し装置内信号
に変換、或いは2B1Q伝送信号を生成する2B1Q終
端生成部9と、2B1Q伝送信号に必要な監視制御信号
であるMビットを装置内信号に挿入するMビット挿入部
10と、装置内信号を6M多重変換部6に入力するため
に速度変換を行う2M/6M変換部11と、6M分離変
換部7により分離した装置内信号を2B1Qパッケージ
内処理速度に適した信号に速度変換する6M/2M変換
部12と、装置内信号から2B1Q伝送信号に必要なM
ビットを抽出するMビット抽出部13とからなり、第二
のポート15も第一のポート14と同一の機能を備えて
いる。
The first port 14 is a 2W / port for accommodating a subscriber line or an exchange line which is a U point interface.
A 4W conversion unit 8, a 2B1Q termination generation unit 9 for terminating the 2B1Q transmission signal and converting it to an internal signal, or generating a 2B1Q transmission signal, and converting an M bit, which is a supervisory control signal required for the 2B1Q transmission signal, into an internal signal An M-bit insertion unit 10 for insertion, a 2M / 6M conversion unit 11 for performing speed conversion for inputting the internal signal to the 6M multiplex conversion unit 6, and an internal signal separated by the 6M separation conversion unit 7 in a 2B1Q package. A 6M / 2M conversion unit 12 for converting the speed into a signal suitable for the processing speed;
The second port 15 has the same function as the first port 14.

【0015】次に第一のポートの動作を主体に説明す
る。まず、U点インタフェースを備えた2W/4W変換
部8は、2線式回線である加入者回線或いは交換機回線
を介して伝送速度160kb/sの2B1Q伝送信号を
入力し、ハイブリッドトランスを用いて2B1Q終端パ
ッケージ5の内部処理に必要な4線式回線信号に変換
し、2B1Q終端生成部9に出力する。
Next, the operation of the first port will be mainly described. First, the 2W / 4W conversion unit 8 having the U point interface inputs a 2B1Q transmission signal at a transmission rate of 160 kb / s via a two-line subscriber line or an exchange line, and uses a hybrid transformer to perform 2B1Q transmission. The signal is converted into a 4-wire line signal necessary for internal processing of the terminal package 5 and output to the 2B1Q terminal generating unit 9.

【0016】2B1Q終端生成部9においては、先ず、
2W/4W変換部8における4線式回線側での送信信号
の受信側への回り込みを防ぐため、エコーキャンセル処
理を行い、更に、2B1Q伝送信号の同期を確立するこ
とにより2B1Q伝送信号を終端し、主信号とMビット
を分離する。終端処理は、2B1Q終端回路の動作効率
を上げるため2Mb/sの処理速度で行われるが、処理
速度を2B1Q伝送信号速度160kb/sに比較し2
Mb/sと高速にした理由は、2B1Q終端生成部9を
構成している回路には、メモリを使用しており処理速度
を高速とするとメモリ容量が低減出来るからである。従
って、2B1Q終端生成部9の出力は、2Mb/sの装
置内信号速度となる。
In the 2B1Q termination generator 9, first,
In order to prevent the transmission signal on the 4-wire line side from wrapping around to the reception side in the 2W / 4W conversion unit 8, echo cancellation processing is performed, and furthermore, the 2B1Q transmission signal is terminated by establishing synchronization of the 2B1Q transmission signal. , The main signal and M bits are separated. The termination processing is performed at a processing speed of 2 Mb / s in order to increase the operation efficiency of the 2B1Q termination circuit, but the processing speed is compared with the 2B1Q transmission signal speed of 160 kb / s.
The reason why the speed is set as high as Mb / s is that a memory constituting the 2B1Q termination generating unit 9 uses a memory, and the memory capacity can be reduced by increasing the processing speed. Therefore, the output of the 2B1Q termination generator 9 has a signal speed in the device of 2 Mb / s.

【0017】終端処理を行った後、分離した2Mb/s
の伝送速度となった主信号2B+Dを、8ビット×3=
24ビットから成る3TS構成として2B1Q終端生成
部9は次段のMビット挿入部10に出力すると共に、該
2B1Q終端生成部9にて分離したMビットはCPU1
7に出力する。2B1Q終端生成部9が出力する主信号
は、2B+Dを構成するTS3のDチャネルが2ビット
のみ使用されており、残り6ビットが空き領域となって
いるのでその内4ビットを使用し、Mビット挿入部10
において、2B1Q終端生成部9にて分離され、CPU
17を介して入力するMビットを所定の8マルチフレー
ム構成に従って定められたタイミング信号により主信号
に挿入する。
After termination processing, the separated 2 Mb / s
The main signal 2B + D having the transmission speed of 8 bits × 3 =
The 2B1Q termination generation unit 9 outputs the data to the next-stage M-bit insertion unit 10 as a 3TS configuration of 24 bits, and the M bits separated by the 2B1Q termination generation unit 9
7 is output. The main signal output by the 2B1Q termination generating unit 9 uses only 2 bits of the D channel of TS3 forming 2B + D, and the remaining 6 bits are free areas, so 4 bits are used among them and M bits are used. Insertion section 10
In the 2B1Q termination generation unit 9, the
The M bits input through 17 are inserted into the main signal by a timing signal determined according to a predetermined 8-multiframe configuration.

【0018】更に、Mビット挿入部10出力は2M/6
M変換部11において装置内に備えた6M多重変換部6
に入力するため、6Mb/sに速度変換し出力する。
Further, the output of the M bit insertion unit 10 is 2M / 6
6M multiplex conversion section 6 provided in the apparatus in M conversion section 11
In order to input the data, the speed is converted to 6 Mb / s and output.

【0019】図2に2B1Q伝送信号のフレーム構成図
を示す。同図(a)は、2B1Q伝送信号のフレーム構
成を示し、1フレームは1.5msecで、120の4
値符号、即ち240ビットを伝送することから、2B1
Q伝送信号は、伝送速度160kb/sにて通信を行
う。1フレームは8ビットから成るフレームワードと、
18ビット(2B+D:B=8ビット、D=2ビット)
から成る2B+Dの主信号12組と、6ビットから成る
監視制御に使用するMビットとにより構成する。図2
(b)は、2B1Q伝送信号のマルチフレーム構成を示
し、1フレーム以上にまたがってMビットの割り当てを
可能とするため8フレームをマルチフレームとして使用
している。マルチフレームの開始は、フレームワードを
反転させることにより決定し、Mビットは48ビットに
より構成する。MビットのM1〜M3は試験用の制御ビ
ットを示し、M4は回線保守ビットを、M5、M6はエ
ラービットチェック用のCRCビットである。
FIG. 2 shows a frame configuration diagram of the 2B1Q transmission signal. FIG. 3A shows the frame structure of a 2B1Q transmission signal, where one frame is 1.5 msec and 4
By transmitting the value code, ie, 240 bits, 2B1
The Q transmission signal performs communication at a transmission speed of 160 kb / s. One frame is composed of a frame word composed of 8 bits,
18 bits (2B + D: B = 8 bits, D = 2 bits)
, And 12 sets of 2B + D main signals, and M bits used for supervisory control consisting of 6 bits. FIG.
(B) shows a multi-frame configuration of a 2B1Q transmission signal, in which eight frames are used as multi-frames so that M bits can be allocated over one or more frames. The start of the multiframe is determined by inverting the frame word, and the M bits are constituted by 48 bits. M bits M1 to M3 indicate test control bits, M4 indicates a line maintenance bit, and M5 and M6 are CRC bits for checking error bits.

【0020】図3は、本発明に係る2B1Q終端パッケ
ージの出力信号である6Mb/sの伝送速度による主信
号のフレーム構成を示す図である。同図を説明すると、
主信号は96のTSを有しているが、2B+Dの情報は
TS1〜TS3にのみ書き込まれており、残りのTSは
空きである。そこでMビットは、TS3のDチャネルで
空きビットとなっているビットの4ビットを使用して8
マルチフレームにより構成する。フレーム6は、張り出
し装置に必要な保守ビットを、7、8フレームは、マル
チフレームを確定するための同期フレームを夫々示す。
又、図2(b)に示した2B1Q伝送信号のマルチフレ
ームを構成するM5、M6に示したCRCチェックビッ
トは、2B1Q終端生成部9において処理するため6M
多重化装置間では転送しない。
FIG. 3 is a diagram showing a frame structure of a main signal at a transmission rate of 6 Mb / s, which is an output signal of the 2B1Q terminal package according to the present invention. Referring to FIG.
Although the main signal has 96 TSs, information of 2B + D is written only in TS1 to TS3, and the remaining TSs are empty. Therefore, the M bits are set to 8 using the four bits that are empty bits in the D channel of TS3.
It is composed of multiple frames. Frame 6 indicates a maintenance bit required for the overhang apparatus, and frames 7 and 8 indicate a synchronization frame for determining a multi-frame.
The CRC check bits M5 and M6 forming the multi-frame of the 2B1Q transmission signal shown in FIG.
It is not transferred between multiplexers.

【0021】一方、装置内インターフェースから入力
し、6M分離変換部7により分離した6Mb/sの装置
内信号は、2B1Q終端生成部9の処理速度に合わせ2
Mb/sに速度変換する。2Mb/sとした装置内信号
は、Mビット抽出部13において3TS構成した主信号
のD領域のビット3〜ビット6を、Mビットとして所定
のタイミング信号に従って抽出する。抽出したMビット
は2B1Q伝送信号の生成時に使用するためCPU17
に出力する。2B1Q終端生成部9においては、2Mb
/sの装置内信号から成る3TSの主信号と、Mビット
抽出部13にて抽出されCPU17を介して供給される
Mビットとを処理し図2に示した2B1Q伝送信号を構
成するフレームを構築する。構築した2B1Q伝送信号
は、2W/4W変換部8に入力し2線式回線である交換
機回線或いは加入者回線に出力する。
On the other hand, the 6 Mb / s internal signal input from the internal interface and separated by the 6 M separation / conversion unit 7 is processed according to the processing speed of the 2B1Q termination generating unit 9.
The speed is converted to Mb / s. As for the internal signal of 2 Mb / s, the M-bit extracting section 13 extracts bits 3 to 6 of the D region of the main signal composed of 3TS as M bits according to a predetermined timing signal. The extracted M bits are used when generating the 2B1Q transmission signal.
Output to In the 2B1Q termination generation unit 9, 2Mb
/ S, which processes the main signal of 3TS composed of the in-device signal and the M bits extracted by the M bit extraction unit 13 and supplied via the CPU 17, to construct a frame constituting the 2B1Q transmission signal shown in FIG. I do. The constructed 2B1Q transmission signal is input to the 2W / 4W conversion unit 8 and output to a switching line or a subscriber line which is a two-wire type line.

【0022】監視制御インタフェース部16は、2B1
Q終端パッケージ5と、6M多重化装置に備えた集中制
御監視部との監視制御信号に関する通信を行うもので、
所定の手順に従って実行する。又、CPU17は、2B
1Qの終端機能、Mビットの挿入抽出機能、監視制御機
能等を制御する。
The supervisory control interface unit 16 includes 2B1
The Q termination package 5 communicates with a centralized control monitoring unit provided in a 6M multiplexer with respect to a monitoring control signal.
Execute according to a predetermined procedure. The CPU 17 has 2B
It controls the 1Q termination function, M-bit insertion / extraction function, monitoring control function, and the like.

【0023】次に、本発明に係るMビットの挿入機能及
び抽出機能について、更に詳しく説明する。
Next, the function of inserting and extracting M bits according to the present invention will be described in more detail.

【0024】図4は、本発明に係るMビット挿入部の一
実施例を示す構成図である。同図は、2B1Q終端生成
部が2B1Q伝送信号より分離しCPUを介して入力し
たMビットを構成するEOCa1〜EOCdmの各ビッ
トを、ビット保持信号の動作タイミングで保持するビッ
ト保持部18と、保持したMビットをビット選択信号の
動作タイミングで1ビット毎にシリアルデータに変換し
て出力する第一のSEL部19と、前記両者により構成
するビット選択部20aと、Mビットを構成するEOC
i1〜EOCi4の各ビットをビット選択部20aと同
様に処理するビット選択部20bと、Mビットを構成す
るEOCi5〜EOCi8の各ビットをビット選択部2
0aと同様に処理するビット選択部20cと、Mビット
を構成するM40〜M43の各ビットをビット選択部2
0aと同様に処理するビット選択部20dと、Mビット
を構成するM44〜M47の各ビットをビット選択部2
0aと同様に処理するビット選択部20eと、Mビット
を構成するSTART〜DEADの各ビットをビット選
択部20aと同様に処理するビット選択部20fと、M
ビットを構成する1、0の固定パターンの各ビットをビ
ット選択部20aと同様に処理するビット選択部20
g、20hと、8回路のビット選択部の出力をフレーム
選択信号の動作タイミングで1ビット毎にシリアルデー
タに変換して出力する第二のSEL部21と、第二のS
EL部21の出力を主信号とMビット選択信号の動作タ
イミングにより主信号に付加する第三のSEL部22と
により構成する。
FIG. 4 is a block diagram showing an embodiment of the M-bit insertion unit according to the present invention. FIG. 2 shows a bit holding unit 18 that holds each bit of EOCa1 to EOCdm constituting M bits input from the 2B1Q transmission signal through the CPU by the 2B1Q termination generation unit at the operation timing of the bit holding signal; A first SEL unit 19 that converts the M bits into serial data bit by bit at the operation timing of the bit selection signal and outputs the serial data, a bit selection unit 20a composed of the two, and an EOC that configures the M bits
The bit selector 20b processes the bits i1 to EOCi4 in the same manner as the bit selector 20a, and the bit selector EOCi5 to EOCi8 configure the M bits.
0a, and each bit of M40 to M43 forming M bits is assigned to the bit selection unit 2c.
0a, and each bit of M44 to M47 constituting M bits is assigned to the bit selection unit 2d.
0a, a bit selector 20f that processes each bit of START to DEAD constituting M bits in the same manner as the bit selector 20a,
A bit selection unit 20 that processes each bit of a fixed pattern of 1 and 0 constituting a bit in the same manner as the bit selection unit 20a
g, 20h, a second SEL unit 21 that converts the output of the bit selection unit of the eight circuits into serial data for each bit at the operation timing of the frame selection signal, and outputs the serial data.
The output of the EL section 21 is constituted by a main signal and a third SEL section 22 which adds the output to the main signal according to the operation timing of the M-bit selection signal.

【0025】図4の動作を説明すると、ビット選択部に
おいては、2B1Q終端生成部にて分離しCPUを介し
て入力したMビットを、8フレームの間保持しておくた
めにビット保持信号により保持した後、フレーム毎に4
ビットをビット選択信号の動作タイミングで1ビットず
つ出力する。ビット選択部20aにおいては、EOCa
1、EOCa2、EOCa3及びEOCdmの各ビット
をを所定のタイミングで順次出力する。2B1Q終端パ
ッケージで生成するビット選択信号は、2ビットの信号
から成り、4ビットのデータを選択する。そこで、2ビ
ットのビット選択信号が“00”であるとEOCa1
を、“01”であるとEOCa2を、“10”であると
EOCa3を、“11”であるとEOCdmを夫々選択
する。更にビット選択部20b〜20hにおいても同様
に入力したMビットを、フレーム毎に4ビットをビット
選択信号の動作タイミングで1ビットずつ出力する。次
に、ビット選択部20a〜20hの出力を第二のSEL
部21に入力し、フレーム選択信号の動作タイミングで
Mビットを構成する8マルチフレームに従って1フレー
ム単位に4ビット毎で選択出力する。2B1Q終端パッ
ケージで生成するフレーム選択信号は、3ビットの信号
から成り、8フレームを選択する。そこで、3ビットの
フレーム選択信号が“000”であるとフレーム1を構
成するためビット選択部20aが出力する4ビットを選
択し、“001”であるとフレーム2を構成するためビ
ット選択部20bが出力する4ビットを選択する。以
降、同様に3ビットのフレーム選択信号が“111”と
なるフレーム8を構成するビット選択部20hまで順次
選択する。従って、32ビット構成としたMビットをフ
レーム1の第一ビットからフレーム8の第四ビットまで
シリアルデータとして得ることになる。更に、本シリア
ルデータを第三のSEL部22に入力し、1ビットから
成る主信号のD領域を選択する主信号とMビット選択信
号の動作タイミングで、1フレーム毎に主信号に付加す
ることにより主信号のTS3に設けたD領域の空きビッ
トである第三ビット〜第六ビットに4ビットずつフレー
ム毎に挿入する。
The operation of FIG. 4 will be described. In the bit selection unit, M bits separated by the 2B1Q termination generation unit and input via the CPU are held by a bit holding signal to hold for 8 frames. And then 4 per frame
Bits are output one by one at the operation timing of the bit selection signal. In the bit selection unit 20a, EOCa
Each bit of 1, EOCa2, EOCa3, and EOCdm is sequentially output at a predetermined timing. The bit selection signal generated by the 2B1Q termination package is made up of a 2-bit signal and selects 4-bit data. Therefore, if the 2-bit bit selection signal is "00", EOCa1
Is selected, EOCa2 is set to "01", EOCa3 is set to "10", and EOCdm is set to "11". Further, in the bit selection units 20b to 20h, similarly, the input M bits, 4 bits per frame, are output one bit at a time at the operation timing of the bit selection signal. Next, the outputs of the bit selection units 20a to 20h are output to the second SEL.
The signal is input to the section 21 and is selectively output in units of 4 bits per frame in accordance with 8 multiframes forming M bits at the operation timing of the frame selection signal. The frame selection signal generated by the 2B1Q termination package is composed of a 3-bit signal, and selects 8 frames. Therefore, if the 3-bit frame selection signal is "000", the bit selection unit 20a selects 4 bits output from the bit selection unit 20a to configure the frame 1, and if the frame selection signal is "001", the bit selection unit 20b configures the frame 2. Selects the 4 bits to be output. Thereafter, similarly, the selection is sequentially performed up to the bit selection unit 20h configuring the frame 8 in which the 3-bit frame selection signal is “111”. Therefore, M bits having a 32-bit configuration are obtained as serial data from the first bit of frame 1 to the fourth bit of frame 8. Further, this serial data is input to the third SEL unit 22 and added to the main signal for each frame at the operation timing of the main signal for selecting the D region of the 1-bit main signal and the M-bit selection signal. Thus, 4 bits are inserted for each frame into the third to sixth bits, which are empty bits in the D area provided in the TS3 of the main signal.

【0026】図5は、本発明に係るMビット抽出部の一
実施例を示す構成図である。同図は、クロック信号とビ
ット選択信号及びフレーム選択信号とを用いてMビット
を選択する信号を生成する選択パルス生成部23a〜2
3dと、Mビット選択信号が動作するタイミングにより
所定のMビットを保持抽出するフリップフロップ部(以
降、F/F部と称す)24a〜24dと、前記両者によ
り構成するビット抽出部25aと、同じくMビット選択
信号を生成し所定のMビットを保持抽出するビット抽出
部25b〜25hとにより構成する。
FIG. 5 is a block diagram showing an embodiment of the M-bit extracting unit according to the present invention. The figure shows selection pulse generators 23a to 23a-2 that generate a signal for selecting M bits using a clock signal, a bit selection signal, and a frame selection signal.
3d, flip-flop units (hereinafter, referred to as F / F units) 24a to 24d that hold and extract a predetermined M bits according to the timing at which the M-bit selection signal operates, and a bit extraction unit 25a configured by the two. It is composed of bit extraction units 25b to 25h that generate an M-bit selection signal and hold and extract predetermined M bits.

【0027】図5の動作を説明すると、選択パルス生成
部23a〜23dにおいて、受信した主信号に付加され
ているMビットを構成する各ビットを識別抽出するため
に選択パルス信号を生成する。そこで、Mビットの各フ
レームを構成する4ビットを夫々選択する2ビット構成
によるビット選択信号と、Mビットの8マルチフレーム
を構成する各フレームを選択する3ビット構成によるフ
レーム選択信号信号と、2Mクロック信号とを組み合わ
せ、Mビットを構成する32ビットの夫々のビットを特
定する選択パルス信号を生成する。Mビットを構成する
フレーム1の第一ビットであるEOCa1については、
選択パルス生成部23aが出力する選択パルス信号のビ
ット選択信号が“00”であって、フレーム選択信号が
“000”である時に特定し受信した主信号よりF/F
部24aに抽出し、CPUを介して2B1Q終端生成部
に出力する。以降同様に、Mビットを構成するフレーム
1の第二ビットであるEOCa2については、選択パル
ス生成部23bが出力する選択パルス信号のビット選択
信号が“01”であって、フレーム選択信号が“00
0”である時に特定し受信した主信号よりF/F部24
bに抽出し、Mビットを構成するフレーム1の第三ビッ
トであるEOCa3については、選択パルス生成部23
cが出力する選択パルス信号のビット選択信号が“1
0”であって、フレーム選択信号が“000”である時
に特定し受信した主信号よりF/F部24cに抽出し、
Mビットを構成する第一フレームの第四ビットであるE
OCdmについては、選択パルス生成部23dが出力す
る選択パルス信号のビット選択信号が“11”であっ
て、フレーム選択信号が“000”である時に特定し受
信した主信号よりF/F部24dに抽出し、夫々CPU
を介して2B1Q終端生成部に出力する。更に、フレー
ム2〜8のビットを抽出するビット抽出部25b〜25
hについても同様、Mビットを選択するために所定の選
択パルス信号を生成し、得られたタイミングにより主信
号の所定のビットをF/F部により保持することでMビ
ットを抽出する。
The operation of FIG. 5 will be described. In the selection pulse generators 23a to 23d, a selection pulse signal is generated in order to identify and extract each bit constituting M bits added to the received main signal. Therefore, a bit selection signal having a 2-bit configuration for selecting 4 bits constituting each frame of M bits, a frame selection signal signal having a 3-bit configuration for selecting each frame constituting 8 M-frames of M bits, and 2M A selection pulse signal for specifying each of the 32 bits forming the M bits is generated by combining with the clock signal. Regarding EOCa1 which is the first bit of frame 1 constituting M bits,
When the bit selection signal of the selection pulse signal output from the selection pulse generation unit 23a is “00” and the frame selection signal is “000”, the F / F is determined based on the main signal specified and received.
The data is extracted by the unit 24a and output to the 2B1Q termination generating unit via the CPU. Similarly, for EOCa2, which is the second bit of frame 1 that constitutes M bits, the bit selection signal of the selection pulse signal output by the selection pulse generation unit 23b is “01” and the frame selection signal is “00”.
When the signal is "0", the F / F 24
b, and EOCa3, which is the third bit of frame 1 forming M bits, is selected by the selection pulse generator 23.
The bit selection signal of the selection pulse signal output by c is "1"
0 ", and extracted from the received main signal to the F / F section 24c when the frame selection signal is" 000 ",
E, which is the fourth bit of the first frame constituting M bits
Regarding OCdm, the main signal specified and received when the bit selection signal of the selection pulse signal output by the selection pulse generation unit 23d is “11” and the frame selection signal is “000” is transmitted to the F / F unit 24d. Extract and CPU respectively
To the 2B1Q termination generation unit via Further, bit extraction units 25b to 25 for extracting bits of frames 2 to 8
Similarly, for h, a predetermined selection pulse signal is generated to select M bits, and the predetermined bits of the main signal are held by the F / F unit at the obtained timing to extract the M bits.

【0028】以上により、Mビットの挿入、抽出が実行
出来、2B1Q伝送信号のMビットを張り出し装置間に
おいて転送可能となる。
As described above, M bits can be inserted and extracted, and the M bits of the 2B1Q transmission signal can be transferred between the overhanging devices.

【0029】[0029]

【発明の効果】本発明は上述したように、請求項1、2
及び3共に、2B1Q伝送路において使用されている監
視制御信号であるMビットを、張り出し装置などにより
中継する際に、主信号を構成する2B+DのDチャネル
の空きビットに付加して転送するため、専用のTSを必
要とせず張り出し装置間における回線使用効率が上が
り、張り出し装置を運用する上で大きな効果を発揮する
ことが可能である。
According to the present invention, as described above, claims 1 and 2
In both cases 3 and 3, when relaying M bits, which is a monitoring control signal used in the 2B1Q transmission line, to an empty bit of the 2B + D D channel constituting the main signal when relaying by an overhanging device or the like, This eliminates the need for a dedicated TS, increases the line use efficiency between the overhanging devices, and can exert a great effect in operating the overhanging device.

【図面の簡単な説明】[Brief description of the drawings]

【図1】本発明に係る張り出し装置の監視制御信号転送
方式の一実施例を示す構成図である。
FIG. 1 is a configuration diagram showing an embodiment of a monitoring control signal transfer method for an overhang device according to the present invention.

【図2】2B1Q伝送信号のフレーム構成図を示す。FIG. 2 shows a frame configuration diagram of a 2B1Q transmission signal.

【図3】本発明に係る2B1Q終端パッケージの出力信
号であるの6Mb/sの伝送速度による主信号のフレー
ム構成を示す図である。
FIG. 3 is a diagram illustrating a frame configuration of a main signal at a transmission rate of 6 Mb / s, which is an output signal of a 2B1Q termination package according to the present invention.

【図4】本発明に係るMビット挿入部の一実施例を示す
構成図である。
FIG. 4 is a configuration diagram illustrating an embodiment of an M-bit insertion unit according to the present invention.

【図5】本発明に係るMビット抽出部の一実施例を示す
構成図である。
FIG. 5 is a configuration diagram showing an embodiment of an M-bit extraction unit according to the present invention.

【図6】従来の張り出し装置を設けた伝送システムの構
成例である。
FIG. 6 is a configuration example of a transmission system provided with a conventional overhanging device.

【図7】従来の張り出し装置間にて用いられる6Mb/
sの伝送速度による主信号のフレーム構成を示す図であ
る。
FIG. 7: 6 Mb / s used between conventional overhangers
It is a figure which shows the frame structure of the main signal by the transmission rate of s.

【符号の説明】[Explanation of symbols]

1・・交換機、 2、3・・張出装置、 4・・DSU、 5・・2B1Q終端パッケージ、 6・・6M多重変換部、 7・・6M分離変換部、 8・・2W/4W変換部、 9・・2B1Q終端生成部、 10・・Mビット挿入部、 11・・2M/6M変換部、 12・・6M/2M変換部、 13・・Mビット抽出部、 14・・第一のポート、 15・・第二のポート、 16・・監視制御インタフェース部、 17・・CPU、 18・・ビット保持部、 19・・第一のSEL部、 20a、20b、20c、20d、20e、20f、2
0g、20h・・ビット選択部、 21・・第二のSEL部、 22・・第三のSEL部、 23a、23b、23c、23d・・選択パルス生成
部、 24a、24b、24c、24d・・F/F部、 25a、25b、25c、25d、25e、25f、2
5g、25h・・ビット抽出部
1. Switch, 2, 3, overhanging device, 4. DSU, 5. 2B1Q termination package, 6. 6M multiplex conversion unit, 7. 6M separation conversion unit, 8. 2W / 4W conversion unit , 9 ·· 2B1Q termination generation unit, 10 ·· M bit insertion unit, 11 ·· 2M / 6M conversion unit, 12 ·· 6M / 2M conversion unit, 13 ·· M bit extraction unit, 14 ··· first port , 15 second port, 16 monitor control interface section, 17 CPU, 18 bit storage section, 19 first SEL section, 20a, 20b, 20c, 20d, 20e, 20f, 2
0g, 20h bit selection section, 21 second SEL section, 22 third SEL section, 23a, 23b, 23c, 23d selection pulse generation section, 24a, 24b, 24c, 24d. F / F section, 25a, 25b, 25c, 25d, 25e, 25f, 2
5g, 25h bit extraction unit

Claims (3)

【特許請求の範囲】[Claims] 【請求項1】交換機に収容された加入者回線を中継しデ
ィジタルサービスユニットに加入者伝送路信号を入出力
する張り出し装置において、 前記交換機或いはディジタルサービスユニットより受信
した加入者伝送路信号の同期を確立することにより該加
入者伝送路信号を終端し、該加入者伝送路信号を構成し
ている制御チャネルに設けた監視制御ビットを分離し
て、張り出し装置間を伝送する主信号であるユーザーデ
ータチャネルの2B+Dを構成するDチャネルの空きビ
ットに前記加入者伝送路信号の監視制御ビットを付加し
対向する張り出し装置に転送し、該対向する張り出し装
置においては、受信したユーザチャネルの2B+Dを構
成するDチャネルの空きビットに付加された加入者伝送
路信号の監視制御ビットを抽出し、加入者伝送路信号を
構成している制御チャネルに付加して加入者伝送路信号
のフレームを再構築し前記ディジタルサービスユニット
或いは交換機に出力したことを特徴とする張り出し装置
の監視制御信号転送方式。
An overhang apparatus for relaying a subscriber line accommodated in an exchange and inputting / outputting a subscriber transmission line signal to / from a digital service unit, wherein synchronization of the subscriber transmission line signal received from the exchange or the digital service unit is performed. By establishing, the subscriber transmission path signal is terminated, the supervisory control bit provided in the control channel constituting the subscriber transmission path signal is separated, and user data which is a main signal transmitted between the overhanging devices. The supervisory control bit of the subscriber's transmission path signal is added to the vacant bits of the D channel constituting 2B + D of the channel and transferred to the opposing pier, and the opposing pier constitutes the received user channel 2B + D. The monitoring control bits of the subscriber transmission path signal added to the vacant bits of the D channel are extracted and transmitted to the subscriber. A surveillance control signal transfer method for an overhanging device, wherein a frame of a subscriber transmission line signal is reconstructed by adding it to a control channel constituting a transmission line signal and output to the digital service unit or the exchange.
【請求項2】前記加入者伝送路信号が2B1Qエコーキ
ャンセラ伝送信号であることを特徴とする張り出し装置
の監視制御信号転送方式。
2. A surveillance device supervisory control signal transfer system according to claim 2, wherein said subscriber transmission line signal is a 2B1Q echo canceller transmission signal.
【請求項3】前記張り出し装置が多重化装置であること
を特徴とする張り出し装置の監視制御信号転送方式。
3. An overhang apparatus monitoring and control signal transfer system, wherein the overhang apparatus is a multiplexing apparatus.
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