JP2000246938A - Recording head driving device - Google Patents

Recording head driving device

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JP2000246938A
JP2000246938A JP5123499A JP5123499A JP2000246938A JP 2000246938 A JP2000246938 A JP 2000246938A JP 5123499 A JP5123499 A JP 5123499A JP 5123499 A JP5123499 A JP 5123499A JP 2000246938 A JP2000246938 A JP 2000246938A
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JP
Japan
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shift register
drive
image data
driving
groups
Prior art date
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Pending
Application number
JP5123499A
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Japanese (ja)
Inventor
Makoto Miyamoto
誠 宮本
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Kyocera Corp
Original Assignee
Kyocera Corp
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Publication date
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Abstract

PROBLEM TO BE SOLVED: To effectively prevent an erroneous operation of a driver IC due to a surge voltage by a method wherein the surge voltage generated on a power source line is markedly reduced even when multiple recording elements are simultaneously driven in a mode such as a solid printing mode. SOLUTION: This recording head driving device comprises multiple recording elements 2, a shift register 6 that serially transports image data by each one bit and multiple driving circuits 8 for driving the recording elements 2 in accordance with the image data from the shift register while a strobe signal is supplied thereto from an external section. The multiple driving circuits 8 are divided into a plurality of groups. A delay circuit 9 for delaying the input timing of a strobe signal is provided to the previous stage of the driving circuits 8 in the groups which are driven at least secondary or later so that drive timings for the recording elements 2 by the driving circuits 8 are shifted by 0.01-50.00 μsec by each of the groups and the driving periods for the groups are overlapped with each other.

Description

【発明の詳細な説明】DETAILED DESCRIPTION OF THE INVENTION

【0001】[0001]

【発明の属する技術分野】本発明はファクシミリやワー
ドプロセッサ等のプリンタ機構として組み込まれる記録
ヘッド駆動装置に関するものである。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a recording head driving device incorporated as a printer mechanism such as a facsimile or a word processor.

【0002】[0002]

【従来の技術】従来より、ファクシミリ等のプリンタ機
構として組み込まれる記録ヘッドとして、サーマルヘッ
ドやLEDアレイヘッド,インクジェットヘッド等が使
用されている。
2. Description of the Related Art Conventionally, a thermal head, an LED array head, an ink jet head, and the like have been used as a recording head incorporated as a printer mechanism of a facsimile or the like.

【0003】かかる記録ヘッドは、例えばサーマルヘッ
ドの場合、アルミナセラミックス等から成る基板上に、
所定のドット密度で直線状に配列された多数の発熱素子
と、これら全ての発熱素子の一端に共通接続される共通
電極と、各発熱素子の他端に個別に接続される多数の個
別電極と、発熱素子を個々に選択的にジュール発熱させ
るドライバーICとをそれぞれ取着した構造を有してお
り、前記ドライバーICの駆動に伴い個別電極及び共通
電極間に所定の電力を印加し、発熱素子を画像データに
基づいて個々に選択的にジュール発熱させるとともに、
該発熱した熱を感熱紙等の記録媒体に伝導させ、記録媒
体に所定の印画を形成することによって記録ヘッドとし
て機能する。
In the case of a thermal head, for example, such a recording head is formed on a substrate made of alumina ceramics or the like.
A large number of heating elements linearly arranged at a predetermined dot density, a common electrode commonly connected to one end of all these heating elements, and a large number of individual electrodes individually connected to the other end of each heating element; And a driver IC that selectively causes the heating elements to individually generate Joule heat, and applies a predetermined power between the individual electrodes and the common electrode in accordance with the driving of the driver IC. Selectively and individually generate Joule heat based on the image data,
The generated heat is conducted to a recording medium such as thermal paper, and a predetermined print is formed on the recording medium to function as a recording head.

【0004】尚、前記ドライバーICには画像データを
格納するためのラッチ回路や発熱素子への通電を制御す
るための駆動回路等が設けられており、該ドライバーI
Cは、外部(プリンタ本体)よりストローブ信号が供給
されている間、ラッチ回路内の画像データに基づいて対
応する発熱素子に対し所定の出力を発するようになって
いる。
The driver IC is provided with a latch circuit for storing image data, a drive circuit for controlling energization to a heating element, and the like.
C outputs a predetermined output to a corresponding heating element based on image data in the latch circuit while a strobe signal is supplied from the outside (printer main body).

【0005】[0005]

【発明が解決しようとする課題】ところで上述のサーマ
ルヘッドにおいて1個の発熱素子を発熱させるには数10
mA程度の電流で足りるが、全黒印字のように全ての発
熱素子を同時に発熱させる場合には、共通電極に極めて
大きな電流が流れる。例えば、幅256mm(B4サイ
ズ用)、8dot/mmのサーマルヘッドを用いて全黒
印字を行なう場合、全ての発熱素子を4つのブロックに
分けて駆動したとしても各ブロックの駆動時に共通電極
に流れる電流は、 256mm×8dot/mm×50mA÷4=25.6
〔A〕 となり、極めて大きな電流が瞬時に流れることとなる
(但し、上式では発熱素子1個当りの電流は50mAと
して計算した)。
By the way, in order to make one heating element generate heat in the above-mentioned thermal head, several tens of elements are required.
Although a current of about mA is sufficient, an extremely large current flows through the common electrode when all the heating elements are heated at the same time as in all black printing. For example, when performing all black printing using a thermal head having a width of 256 mm (for B4 size) and 8 dots / mm, even if all the heating elements are driven in four blocks, they flow to the common electrode when each block is driven. The current is 256 mm × 8 dots / mm × 50 mA ÷ 4 = 25.6
[A], and an extremely large current flows instantaneously (however, in the above formula, the current per heating element was calculated as 50 mA).

【0006】このとき、基板上の回路には等価的にイン
ダクタンスが存在するので、このインダクタンスによっ
てドライバーICのスイッチオン時とスイッチオフ時に
共通電極から電源へとつながる電源線に、図4に示す如
き大きなサージ電圧があらわれる。このサージ電圧は変
化する電流の大きさに比例するため、全黒印字の場合に
は極めて大きな値となる。そのため、サージ電圧によっ
てドライバーICが誤動作を起したり、該ICの出力ト
ランジスタを破壊したり、更にはサーマルヘッドを搭載
したファクシミリ等の回路を誤動作させる等の欠点を有
していた。
At this time, since the circuit on the substrate has an equivalent inductance, the inductance causes the power supply line connected from the common electrode to the power supply when the driver IC is switched on and off, as shown in FIG. A large surge voltage appears. Since this surge voltage is proportional to the magnitude of the changing current, it takes an extremely large value in all black printing. Therefore, the driver IC has a drawback that the surge voltage causes a malfunction of the driver IC, destroys an output transistor of the IC, and malfunctions a circuit such as a facsimile equipped with a thermal head.

【0007】また一方、上記欠点を解消するためにサー
マルヘッドの共通電極と電源とをつなぐ電源線上にサー
ジ吸収用のコンデンサを設けたものが知られている。
On the other hand, there is known a thermal head in which a capacitor for absorbing surge is provided on a power supply line connecting a common electrode of a thermal head and a power supply in order to solve the above-mentioned drawbacks.

【0008】しかしながら、大きなサージ電圧に耐え得
るコンデンサは極めて大型であることから、これを組み
込んだ装置も大型化することとなり、またサージ電圧は
高周波成分をも含むので高周波特性の良好なコンデンサ
が必要で、該高周波特性の良好なコンデンサは非常に高
価であり、従ってこれを組み込んだ装置も高価なものと
なる欠点を有している。
However, since a capacitor capable of withstanding a large surge voltage is extremely large, the size of a device in which the capacitor is incorporated is also increased, and a capacitor having good high-frequency characteristics is required because the surge voltage includes a high-frequency component. However, a capacitor having good high-frequency characteristics is very expensive, so that a device incorporating the capacitor has a disadvantage of being expensive.

【0009】[0009]

【課題を解決するための手段】本発明は上記欠点に鑑み
案出されたもので、本発明の記録ヘッド駆動装置は、多
数の記録素子と、多数の直列接続されたシフトレジスタ
セルから成り、隣り合うシフトレジスタセル間で画像デ
ータを1ビットずつシリアル転送するとともに画像デー
タを所定のシフトレジスタセルに格納するシフトレジス
タと、前記シフトレジスタセルに対応して設けられ、ス
トローブ信号が供給されている間、前記シフトレジスタ
の画像データに基づいて記録素子を駆動する多数の駆動
回路と、を備えた記録ヘッド駆動装置であって、前記多
数の駆動回路を複数のグループに区分するとともに、各
グループの駆動回路による前記記録素子の駆動タイミン
グを0.01μsec〜50.00μsecずつずら
し、且つ各々のグループの駆動期間が相互にオーバーラ
ップするように、少なくとも2番目以降に駆動するグル
ープの駆動回路の前段にストローブ信号の入力タイミン
グを遅らせる遅延回路を設けたことを特徴とするもので
ある。
SUMMARY OF THE INVENTION The present invention has been made in view of the above-mentioned drawbacks, and a recording head driving device according to the present invention comprises a large number of recording elements and a large number of serially connected shift register cells. A shift register that serially transfers image data bit by bit between adjacent shift register cells and stores the image data in predetermined shift register cells, and a strobe signal is provided corresponding to the shift register cells and provided. A plurality of drive circuits for driving print elements based on the image data of the shift register, wherein the plurality of drive circuits are divided into a plurality of groups, and The drive timing of the printing element by the drive circuit is shifted by 0.01 μsec to 50.00 μsec, and each group is shifted. A delay circuit for delaying the input timing of the strobe signal is provided at the preceding stage of the drive circuits of the groups that are driven at least for the second and subsequent groups so that the drive periods of the groups overlap each other.

【0010】また本発明の記録ヘッド駆動装置は、多数
の記録素子と、多数の直列接続されたシフトレジスタセ
ルから成り、隣り合うシフトレジスタセル間で画像デー
タを1ビットずつシリアル転送するとともに画像データ
を所定のシフトレジスタセルに格納するシフトレジスタ
と、前記多数のシフトレジスタセルの画像データをラッ
チ信号に同期してパラレルに受け取り保持する多数のラ
ッチ回路と、前記ラッチ回路に対応して設けられ、スト
ローブ信号が供給されている間、前記ラッチ回路の画像
データに基づいて記録素子を駆動する多数の駆動回路
と、を備えた記録ヘッド駆動装置であって、前記多数の
駆動回路を複数のグループに区分するとともに、各グル
ープの駆動回路による前記記録素子の駆動タイミングを
0.01μsec〜50.00μsecずつずらし、且
つ各々のグループの駆動期間が相互にオーバーラップす
るように、少なくとも2番目以降に駆動するグループの
駆動回路の前段にストローブ信号の入力タイミングを遅
らせる遅延回路を設けたことを特徴とするものである。
The recording head driving apparatus according to the present invention comprises a large number of recording elements and a large number of serially connected shift register cells, and serially transfers image data between adjacent shift register cells one bit at a time. A shift register that stores the image data in a predetermined shift register cell, a number of latch circuits that receive and hold the image data of the number of shift register cells in parallel in synchronization with a latch signal, and are provided corresponding to the latch circuit. A plurality of drive circuits that drive recording elements based on image data of the latch circuit while the strobe signal is being supplied, wherein the plurality of drive circuits are grouped into a plurality of groups. And the drive timing of the printing elements by the drive circuits of each group is set to 0.01 μsec. A delay circuit for delaying the input timing of the strobe signal is provided at the preceding stage of the drive circuits of the groups to be driven at least the second and subsequent groups so that the drive periods of the groups are shifted by 0.00 μsec and the drive periods of the groups overlap each other. It is a feature.

【0011】更に本発明の記録ヘッド駆動装置は、前記
遅延回路がバッファ及び/又はインバータから成ること
を特徴とするものである。
Further, in the recording head driving device according to the present invention, the delay circuit comprises a buffer and / or an inverter.

【0012】[0012]

【発明の実施の形態】以下、本発明を添付図面に基づい
て詳細に説明する。図1は本発明の記録ヘッド駆動装置
をサーマルヘッドに適用した形態を示す平面図、図2は
図1のサーマルヘッドの電気的構成を部分的に示す等価
回路図であり、1 は基板、2 は発熱素子、3 は共通電
極、4 は個別電極、5 はドライバーIC、6 はシフトレ
ジスタ、7 はラッチ回路、8 は駆動回路、9a,9b,9cは遅
延回路である。
DETAILED DESCRIPTION OF THE PREFERRED EMBODIMENTS Hereinafter, the present invention will be described in detail with reference to the accompanying drawings. FIG. 1 is a plan view showing an embodiment in which a recording head driving device of the present invention is applied to a thermal head, and FIG. 2 is an equivalent circuit diagram partially showing an electrical configuration of the thermal head of FIG. Is a heating element, 3 is a common electrode, 4 is an individual electrode, 5 is a driver IC, 6 is a shift register, 7 is a latch circuit, 8 is a drive circuit, and 9a, 9b and 9c are delay circuits.

【0013】同図に示すサーマルヘッドは、アルミナセ
ラミックス等から成る基板1 の上面に、直線状に配列さ
れた多数の発熱素子2 と、これら全ての発熱素子2 の一
端に共通接続される共通電極3 と、各発熱素子2 の他端
に個別に接続される多数の個別電極4 と、前記発熱素子
2 への通電を制御する複数のドライバーIC5 とをそれ
ぞれ取着した構造を有している。
The thermal head shown in FIG. 1 has a large number of heating elements 2 linearly arranged on an upper surface of a substrate 1 made of alumina ceramic or the like, and a common electrode commonly connected to one end of all the heating elements 2. 3, a number of individual electrodes 4 individually connected to the other end of each heating element 2,
A plurality of driver ICs 5 for controlling energization of the power supply 2 are mounted.

【0014】前記発熱素子2 は例えば8dot/mmの
ドット密度で配列されており、かかるドット密度でA4
サイズのサーマルヘッドを構成する場合、1728個の
発熱素子2 が127μmのピッチで直線状に配列される
こととなる。
The heating elements 2 are arranged at a dot density of, for example, 8 dots / mm.
When a thermal head having a size is formed, 1,728 heating elements 2 are linearly arranged at a pitch of 127 μm.

【0015】前記発熱素子2 は、Ta系抵抗材料やTi
系抵抗材料,Nb系抵抗材料,ポリシリコン(p−S
i)系抵抗材料等を従来周知の薄膜手法、具体的にはス
パッタリングやフォトリソグラフィー、エッチング等に
よって所定パターンに被着・形成して成り、それ自体が
所定の電気抵抗値を有しているため、ドライバーIC5
の駆動に伴い所定の電力が印加されるとジュール発熱を
起こし、感熱紙等の記録媒体に印画を形成するのに必要
な温度となる。
The heating element 2 is made of a Ta-based resistance material or Ti
-Based resistance material, Nb-based resistance material, polysilicon (p-S
i) It is formed by applying and forming a system resistance material or the like in a predetermined pattern by a conventionally known thin film method, specifically, sputtering, photolithography, etching, or the like, which itself has a predetermined electric resistance value. , Driver IC5
When a predetermined electric power is applied in association with the drive, Joule heat is generated, and the temperature is required to form an image on a recording medium such as thermal paper.

【0016】尚、各発熱素子2 の両端に接続される共通
電極3 及び個別電極4 は、外部電源からの電力を発熱素
子2 に供給するためのものであり、例えば共通電極3 は
24Vの電位に保持されている外部電源のプラス(+)
側の端子に、一方、個別電極4 は後述するドライバーI
C5 のスイッチングトランジスタ8bを介して基準電位
(例えば0Vの電位)に保持されている外部電源のマイ
ナス(−)側の端子に電気的に接続される。
The common electrodes 3 and the individual electrodes 4 connected to both ends of each heating element 2 are for supplying power from an external power supply to the heating element 2. For example, the common electrode 3 has a potential of 24V. (+) Of the external power source held in
On the other hand, the individual electrode 4 is connected to a driver I to be described later.
It is electrically connected to a negative (-) terminal of an external power supply held at a reference potential (eg, a potential of 0 V) via a switching transistor 8b of C5.

【0017】これら共通電極3 及び多数の個別電極4 は
アルミニウムや銅等から成り、かかる電極3,4 も先に述
べた発熱素子2 と同様に従来周知の薄膜手法等によって
所定パターンをなすように被着・形成される。
The common electrode 3 and a large number of individual electrodes 4 are made of aluminum, copper, or the like, and the electrodes 3 and 4 are also formed in a predetermined pattern by a well-known thin-film method or the like similarly to the heating element 2 described above. It is attached and formed.

【0018】また、前記複数のドライバーIC5 は、そ
の各々が発熱素子2 を所定数ずつ担当してこれらを個々
に選択的にジュール発熱させる作用を為し、その回路形
成面には、外部からの画像データをクロック信号に同期
させてシリアルに転送するための所定ビット数のシフト
レジスタ6 、これら画像データをラッチ信号のタイミン
グでシフトレジスタから受け取って該画像データを保持
・格納する複数のラッチ回路7 、各発熱素子2 への通電
を外部からのストローブ信号及びラッチ回路7内の画像
データに基づいて制御するための複数の駆動回路8 、こ
れら駆動回路8へのストローブ信号の入力タイミングを
複数の駆動回路8 毎に少しずつ遅らせるための複数の遅
延回路9a,9b,9c等を有している。
Each of the plurality of driver ICs 5 is responsible for a predetermined number of the heating elements 2 and functions to individually and selectively generate Joule heat. A shift register 6 having a predetermined number of bits for serially transferring image data in synchronization with a clock signal; a plurality of latch circuits 7 receiving these image data from the shift register at the timing of a latch signal and holding and storing the image data A plurality of driving circuits 8 for controlling the energization of each heating element 2 based on an external strobe signal and image data in the latch circuit 7, and a plurality of driving timings for inputting the strobe signal to these driving circuits 8. Each circuit 8 has a plurality of delay circuits 9a, 9b, 9c, etc. for delaying little by little.

【0019】例えば1個のドライバーIC5 で64個の
発熱素子2 を担当する場合、A4サイズ、8dot/m
mのサーマルヘッドを構成するには27個のドライバー
ICが必要となり、個々のドライバーIC5 の回路形成
面には64ビットのシフトレジスタ6 、64個のラッチ
回路7 、64個の駆動回路8 、3個の遅延回路9a,9b,9c
がそれぞれ設けられる。尚、図1は基板1 上に搭載され
るドライバーIC5 の個数を4個として図面を簡略化し
たものである。
For example, when one driver IC 5 is responsible for 64 heating elements 2, an A4 size, 8 dots / m
In order to construct a thermal head of length m, 27 driver ICs are required, and a 64-bit shift register 6, 64 latch circuits 7, 64 drive circuits 8, 3 Delay circuits 9a, 9b, 9c
Are respectively provided. FIG. 1 is a simplified drawing in which the number of driver ICs 5 mounted on the substrate 1 is four.

【0020】前記駆動回路8 はアンドゲート8aとスイッ
チングトランジスタ8bとで構成されている。
The driving circuit 8 comprises an AND gate 8a and a switching transistor 8b.

【0021】前記アンドゲート8aには外部からのストロ
ーブ信号と、対応するラッチ回路7内の画像データとが
供給されるようになっており、この2つの信号の論理積
に基づいてスイッチングトランジスタ8bに向けて所定の
出力を発する。尚、前記ストローブ信号は、各印画ライ
ンにおける発熱素子2 の通電時間を決定するための信号
であり、全ての駆動回路8 に対して印画ライン毎に単一
のパルスで供給される。例えば全体を4ブロックに分け
て分割駆動する際は4つのパルスが相互にオーバーラッ
プすることなく順番に供給されることとなる。
The AND gate 8a is supplied with a strobe signal from the outside and image data in the corresponding latch circuit 7. The AND gate 8a supplies a switching transistor 8b based on the logical product of these two signals. It emits a predetermined output toward it. The strobe signal is a signal for determining the energizing time of the heating element 2 in each printing line, and is supplied to all the driving circuits 8 in a single pulse for each printing line. For example, when the whole is divided into four blocks and divided and driven, four pulses are supplied sequentially without overlapping each other.

【0022】一方、前記スイッチングトランジスタ8bは
前述したアンドゲート8aからの出力信号に基づいて発熱
素子2 への通電のオン・オフを制御するようになってお
り、アンドゲート8aからの出力信号が供給されている
間、ドライバーIC5 の出力端子及び個別電極4 を介し
て対応する発熱素子2 に所定の出力を発し、発熱素子2
を画像データに基づいて個々に選択的に発熱・駆動させ
る。
On the other hand, the switching transistor 8b controls on / off of energization to the heating element 2 based on the output signal from the AND gate 8a described above, and the output signal from the AND gate 8a is supplied. During this time, a predetermined output is generated to the corresponding heating element 2 via the output terminal of the driver IC 5 and the individual electrode 4 to generate the heating element 2
Are individually selectively heated and driven based on image data.

【0023】そして前記ドライバーIC5 の遅延回路9
a,9b,9cは、64個の駆動回路8 を16個の駆動回路8
を一単位とした4つのグループに区分するとともに、こ
れら4つのグループのうち、ストローブ信号の入力側
(以下、信号入力側と略記する)より2つめ以降のグル
ープの駆動回路の前段に1個ずつ設けられる。
The delay circuit 9 of the driver IC 5
a, 9b, 9c are 64 drive circuits 8 and 16 drive circuits 8
Are grouped into four groups, and one of these four groups is provided in front of the drive circuits of the second and subsequent groups from the strobe signal input side (hereinafter abbreviated as signal input side). Provided.

【0024】具体的には、アンドゲート8aにストローブ
信号を供給するためのストローブ信号線10上で、且つ信
号入力側より17〜32番目の駆動回路8 の前段と、3
3〜48番目の駆動回路8 の前段と、49〜64番目の
駆動回路8 の前段に1個ずつ設けられる。
More specifically, on the strobe signal line 10 for supplying a strobe signal to the AND gate 8a, and before the 17th to 32nd drive circuits 8 from the signal input side, 3
One circuit is provided before the third to 48th drive circuits 8 and one before the 49th to 64th drive circuits 8.

【0025】前記遅延回路9a,9b,9cは、発熱素子2 の駆
動タイミングを、前述のグループ毎に0.01μsec
〜50.00μsecずつずらす作用を為し、これによ
り各グループに供給されるストローブ信号の立ち上がり
と立ち下がりのタイミングが信号入力側より0.01μ
sec〜50.00μsecの範囲内で順次ずれていく
ことになる。
The delay circuits 9a, 9b, and 9c set the drive timing of the heating element 2 for 0.01 μsec for each of the groups.
The strobe signal supplied to each group has a rising and falling timing of 0.01 μsec from the signal input side.
It will shift sequentially within the range of 5 sec to 50.00 μsec.

【0026】かかる遅延回路9a,9b,9cとしてはインバー
タやバッファ, 或いはインバータとバッファを組み合わ
せたもの等が使用され、例えばインバータのみを使用す
る場合は出力AC特性が0.005μsec〜25.0
0μsecのものを偶数個、組み合わせて使用し、また
バッファのみを使用する場合は出力AC特性が0.01
μsec〜50.00μsecのものを用いる。
As the delay circuits 9a, 9b, 9c, inverters, buffers, or a combination of inverters and buffers are used. For example, when only an inverter is used, the output AC characteristic is 0.005 μsec to 25.0.
When an even number of 0 μsec are used in combination and only the buffer is used, the output AC characteristic becomes 0.01
Use the one of μsec to 50.00 μsec.

【0027】また前述の駆動回路8 に供給されるストロ
ーブ信号は個々のドライバーIC5にそれぞれ並列的に
供給されるようになっており、そのパルス幅は100μ
sec〜50000μsecに設定される。従って、ス
トローブ信号のパルス幅は上述した発熱素子2 の駆動タ
イミングのずれ幅w1 (0.01μsec〜50.00
μsec)に比し極めて大きく、それ故、遅延回路9a,9
b,9cによって区分されている4つのグループの駆動期間
は相互にオーバーラップすることとなる。このオーバー
ラップ時間w2 は例えば50μsec〜50000μs
ecに設定される。
The strobe signal supplied to the drive circuit 8 is supplied to each driver IC 5 in parallel, and the pulse width thereof is 100 μm.
sec to 50,000 μsec. Thus, deviation of the driving timing of the heat generating element 2 pulse width of the strobe signal as described above w 1 (0.01μsec~50.00
μsec), so that the delay circuits 9a, 9
The drive periods of the four groups divided by b and 9c overlap each other. This overlap time w 2, for example 50μsec~50000μs
ec.

【0028】このように、各ドライバーIC5 内の多数
の駆動回路8 を複数のグループに区分するとともに、こ
れら駆動回路8 による発熱素子2 の駆動タイミングをグ
ループ毎に0.01μsec〜50.00μsecずつ
ずらし、且つ各々のグループの駆動期間が相互にオーバ
ーラップするように、信号入力側より少なくとも2番目
以降に駆動するグループの駆動回路8 の前段にストロー
ブ信号の入力タイミングを遅らせる遅延回路9a,9b,9cを
設けたことにより、全黒印字のように全ての発熱素子2
を同時に発熱させる場合に共通電極3 に極めて大きな電
流が流れたとしても、ドライバーIC5 のスイッチオン
時とスイッチオフ時に共通電極3 から外部電源へとつな
がる電源線にあらわれるサージ電圧は極めて小さなもの
となる(図3参照)。これは、駆動タイミングをずらす
ことによって一度に変化する電流量が小さくなるからで
あり、これによって大きなサージ電圧に起因するドライ
バーIC5 が誤動作やサーマルヘッドが搭載されるファ
クシミリ等の回路の誤動作が有効に防止される。
As described above, a large number of driving circuits 8 in each driver IC 5 are divided into a plurality of groups, and the driving timing of the heating elements 2 by these driving circuits 8 is shifted by 0.01 μsec to 50.00 μsec for each group. And delay circuits 9a, 9b, 9c for delaying the input timing of the strobe signal before the driving circuit 8 of the group that is driven at least second from the signal input side so that the driving periods of the respective groups overlap each other. All heating elements 2
Even if an extremely large current flows through the common electrode 3 when the heat is generated simultaneously, the surge voltage that appears on the power supply line from the common electrode 3 to the external power supply when the driver IC 5 is switched on and off is extremely small. (See FIG. 3). This is because shifting the drive timing reduces the amount of current that changes at one time, which effectively prevents the driver IC 5 from malfunctioning due to a large surge voltage and malfunctioning of a facsimile or other circuit equipped with a thermal head. Is prevented.

【0029】またこの場合、電源線にあらわれるサージ
電圧は上述したように極めて小さく、サージ電圧がドラ
イバーIC等に与える影響を無視し得る程度に抑えるこ
とができるため、サージ吸収用の大型で高価なコンデン
サ等は一切不要であり、サーマルヘッド駆動装置を小型
化することができるとともに、製品としてのサーマルヘ
ッドを安価になすことが可能である。
In this case, the surge voltage appearing on the power supply line is extremely small as described above, and the influence of the surge voltage on the driver IC and the like can be suppressed to a negligible level. No capacitor or the like is required at all, and the thermal head driving device can be reduced in size, and the thermal head as a product can be manufactured at low cost.

【0030】尚、前述したグループ毎の駆動タイミング
のずれ幅w1 は、ストローブ信号のパルス幅をグループ
数で除した値よりも小さく設定されていさえすれば各グ
ループの駆動期間が相互にオーバーラップすることにな
るわけであるが、このずれ幅w1 が0.01μsecよ
りも短いとサージ電圧を十分に低く抑えることが困難で
あり、逆にずれ幅w1 が50.00μsecよりも大き
いと印画速度が遅くなって近時の高速印画の要求に対応
しきれなくなる恐れがある。従ってグループ毎の駆動タ
イミングのずれ幅w1 は0.01μsec〜50.00
μsecの範囲内に特定される。
It is to be noted that, as long as the aforementioned drive timing shift width w 1 for each group is set to be smaller than the value obtained by dividing the pulse width of the strobe signal by the number of groups, the drive periods of the groups overlap each other. However, if the shift width w 1 is shorter than 0.01 μsec, it is difficult to sufficiently suppress the surge voltage. Conversely, if the shift width w 1 is larger than 50.00 μsec, printing is performed. There is a possibility that the speed will become slow and it will not be possible to respond to the recent demand for high-speed printing. Shift width w 1 of the drive timing of each group is therefore 0.01μsec~50.00
It is specified within the range of μsec.

【0031】また上述した4つのグループの駆動期間の
オーバーラップ時間w2 は、印画速度の高速化やサージ
電圧の十分な低減という2つの観点から、ストローブ信
号のパルス幅の90.0%〜99.9%の範囲内に設定
するのが好ましい。
The overlap time w 2 of the driving periods of the four groups is 90.0% to 99% of the pulse width of the strobe signal from the two viewpoints of increasing the printing speed and sufficiently reducing the surge voltage. It is preferably set within the range of 0.9%.

【0032】尚、前記複数のドライバーIC5 は、従来
周知のフェースダウンボンディング等を採用することに
よって基板1 の上面に、発熱素子2 の配列とほぼ平行な
一列状をなすように取着・搭載される。
The plurality of driver ICs 5 are attached and mounted on the upper surface of the substrate 1 in a line substantially parallel to the arrangement of the heating elements 2 by employing conventionally known face-down bonding or the like. You.

【0033】次に上述したサーマルヘッドにおけるサー
ジ電圧の低減作用について図3のタイミングチャートを
用いて説明する。
Next, the action of reducing the surge voltage in the above-described thermal head will be described with reference to the timing chart of FIG.

【0034】同図に示す4つのストローブ信号a,b,
c,dはもともとドライバーIC5に入力される時点で
は1つの信号であったものがストローブ信号線上に設け
た3つの遅延回路9a,9b,9cによって派生的に生成された
ものである。
The four strobe signals a, b,
The signals c and d are originally one signal at the time of input to the driver IC5, but are generated by three delay circuits 9a, 9b and 9c provided on the strobe signal line.

【0035】ストローブ信号aはドライバーIC5 の入
力端子を介して入力されるストローブ信号の波形と全く
同じであり、信号入力側より1〜16番目の駆動回路8
にそのまま入力される。
The strobe signal a has exactly the same waveform as the strobe signal input via the input terminal of the driver IC5, and the first to sixteenth drive circuits 8 from the signal input side.
Is input as is.

【0036】ストローブ信号bは遅延回路9aにより生成
された信号であり、ストローブ信号aよりも例えば1μ
secだけ遅れて立ち上がり、1μsecだけ遅れて立
ち下がる。該ストローブ信号bは17〜32番目の駆動
回路8 のアンドゲート8aと遅延回路9bにそれぞれ入力さ
れる。
The strobe signal b is a signal generated by the delay circuit 9a, and is, for example, 1 μm smaller than the strobe signal a.
It rises with a delay of sec and falls with a delay of 1 μsec. The strobe signal b is input to the AND gate 8a and the delay circuit 9b of the 17th to 32nd drive circuits 8, respectively.

【0037】またストローブ信号cは2つの遅延回路9
a,9b を経て生成された信号であり、ストローブ信号a
よりも例えば2μsecだけ遅れて立ち上がり、2μs
ecだけ遅れて立ち下がる。該ストローブ信号cは33
〜48番目の駆動回路8 のアンドゲート8aと遅延回路9c
にそれぞれ入力される。
The strobe signal c is supplied to two delay circuits 9
a, 9b, and a strobe signal a
Rises with a delay of, for example, 2 μsec.
It falls with a delay of ec. The strobe signal c is 33
AND gate 8a and delay circuit 9c of the ~ 48th drive circuit 8
Respectively.

【0038】そしてストローブ信号dは3つの遅延回路
9a,9b,9cを経て生成された信号であり、ストローブ信号
aよりも例えば3μsecだけ遅れて立ち上がり、3μ
secだけ遅れて立ち下がる。該ストローブ信号dは4
9〜64番目の駆動回路8 のアンドゲート8aに入力され
る。
The strobe signal d is supplied to three delay circuits.
9a, 9b, 9c, and rises with a delay of, for example, 3 μsec from the strobe signal a.
It falls with a delay of sec. The strobe signal d is 4
It is input to the AND gate 8a of the 9th to 64th drive circuits 8.

【0039】尚、これらのストローブ信号a,b,c,
dはいずれもローレベルで有効となる信号である。
Note that these strobe signals a, b, c,
d is a signal that is valid at a low level.

【0040】印画動作が始まると、まずドライバーIC
5 のシフトレジスタ6 に第1ラインの画像データがクロ
ック信号に同期して1ビットずつシリアルに入力され
る。
When the printing operation starts, first, the driver IC
The first line of image data is serially input to the 5th shift register 6 bit by bit in synchronization with the clock signal.

【0041】次に外部より供給されるラッチ信号のタイ
ミングでシフトレジスタ6 内の画像データがラッチ回路
7 にパラレルに転送され、これによって画像データがラ
ッチ回路7 内で保持・格納される。
Next, the image data in the shift register 6 is transferred to the latch circuit at the timing of the latch signal supplied from outside.
7, the image data is held and stored in the latch circuit 7.

【0042】次に外部よりストローブ信号が入力され、
このストローブ信号が有効となっている間、ラッチ回路
7 内の画像データに基づいて駆動回路8 から対応する発
熱素子2 に所定の出力が発せられる。これにより、発熱
素子2 が画像データに基づいて個々に選択的にジュール
発熱を起こし、該発熱した熱を感熱紙等の記録媒体に伝
導させるとともに記録媒体に所定パターンの印画ドット
を形成することによって第1ラインの印画が完了する。
尚、各々の印画ラインを分割駆動する場合は、先に述べ
た如く、相互にオーバーラップすることのない複数のス
トローブ信号が順次入力されるようにする。
Next, a strobe signal is input from the outside,
While this strobe signal is valid, the latch circuit
A predetermined output is generated from the drive circuit 8 to the corresponding heat generating element 2 based on the image data in 7. As a result, the heating elements 2 individually generate Joule heat selectively based on the image data, and the generated heat is conducted to a recording medium such as thermal paper, and a printing dot of a predetermined pattern is formed on the recording medium. Printing of the first line is completed.
When each print line is divided and driven, as described above, a plurality of strobe signals that do not overlap each other are sequentially input.

【0043】このとき、ドライバーIC5 に入力される
ストローブ信号は、図3のタイミングチャートに示す如
く、3つの遅延回路9a,9b,9cによって立ち上がり及び立
ち下がりのタイミングが0.01μsec〜50.00
μsec(w1 )ずつずれた4つのストローブ信号a,
b,c,dに分岐しており、これら4つのストローブ信
号a〜dが前述のグループ分けによって区分された4つ
の駆動回路群にそれぞれ供給されるようになっているの
で、前述した如く、全黒印字のように多数の発熱素子2
を同時に発熱させる場合であっても、ドライバーIC5
のスイッチオン時とスイッチオフ時に共通電極3 から外
部電源へとつながる電源線にあらわれるサージ電圧は極
めて小さく、該サージ電圧に起因するドライバーIC5
の誤動作等が有効に防止されることとなる。
At this time, as shown in the timing chart of FIG. 3, the strobe signal input to the driver IC 5 has the rising and falling timings of 0.01 μsec to 50.00 by the three delay circuits 9a, 9b and 9c.
The four strobe signals a, shifted by μsec (w 1 )
b, c, and d, and these four strobe signals a to d are respectively supplied to the four driving circuit groups divided by the above-described grouping. Many heating elements 2 like black print
Even if they generate heat simultaneously,
The surge voltage appearing on the power supply line from the common electrode 3 to the external power supply at the time of switch-on and switch-off is extremely small, and the driver IC 5
Will be effectively prevented.

【0044】その後、上述した第1ラインの印画動作と
同様にして、第2ライン、第3ライン…と各ラインの印
画動作を順番に繰り返すことによって一連の印画動作が
行われ、記録媒体に所定の印画が形成される。
Thereafter, in a manner similar to the printing operation of the first line described above, the printing operation of the second line, the third line,... Is sequentially repeated to perform a series of printing operations. Is formed.

【0045】尚、本発明は上述した形態に限定されるも
のではなく、本発明の要旨を逸脱しない範囲において種
々の変更、改良等が可能である。
The present invention is not limited to the above-described embodiment, and various changes and improvements can be made without departing from the gist of the present invention.

【0046】例えば上述の形態ではシフトレジスタセル
6 と駆動回路8 の間にラッチ回路5を介在させ、ラッチ
回路5 で一旦保持した画像データを駆動回路8 に供給す
るように構成したが、この構成からラッチ回路を省き、
シフトレジスタセル6 内の画像データを駆動回路8 に直
接供給するようにしても構わない。
For example, in the above embodiment, the shift register cell
The latch circuit 5 is interposed between the drive circuit 8 and the drive circuit 8, and the image data once held by the latch circuit 5 is supplied to the drive circuit 8.However, the latch circuit is omitted from this configuration.
The image data in the shift register cell 6 may be directly supplied to the drive circuit 8.

【0047】また上述の形態では1個のドライバーIC
内に3つの遅延回路を設けるようにしたが、1個のドラ
イバーICに設ける遅延回路の個数は1個でも、2個で
も、或いは、4個以上でも良く、該遅延回路によるスト
ローブ信号の遅延時間が0.01μsec〜50.00
μsecの範囲内に設定されている限り上述の形態と同
様の効果を得ることができる。
In the above embodiment, one driver IC is used.
Are provided, but the number of delay circuits provided in one driver IC may be one, two, or four or more. The delay time of the strobe signal by the delay circuit Is 0.01 μsec to 50.00
As long as the time is set within the range of μsec, the same effect as in the above embodiment can be obtained.

【0048】更に上述の形態では本発明の記録ヘッド駆
動装置をサーマルヘッドに適用した形態を例にとって説
明したが、他の記録ヘッド、例えばLEDアレイヘッド
やインクジェットヘッド等にも本発明は適用可能であ
り、そのような場合においても上述の形態と全く同様の
効果が得られる。
Further, in the above embodiment, the embodiment in which the recording head driving device of the present invention is applied to a thermal head has been described as an example. However, the present invention can be applied to other recording heads such as an LED array head and an ink jet head. In such a case, the same effect as in the above embodiment can be obtained.

【0049】[0049]

【発明の効果】本発明によれば、記録素子を駆動する多
数の駆動回路を複数のグループに区分するとともに、こ
れら駆動回路による記録素子の駆動タイミングをグルー
プ毎に0.01μsec〜50.00μsecずつずら
し、且つ各々のグループの駆動期間が相互にオーバーラ
ップするように、少なくとも2番目以降に駆動するグル
ープの駆動回路の前段にストローブ信号の入力タイミン
グを遅らせる遅延回路を設けたことにより、全黒印字の
ように多数の記録素子を同時に駆動させる場合であって
も、電源線にあらわれるサージ電圧は極めて小さく、該
サージ電圧に起因するドライバーIC等の誤動作が有効
に防止される。
According to the present invention, a large number of driving circuits for driving the recording elements are divided into a plurality of groups, and the driving timing of the recording elements by these driving circuits is set to 0.01 μsec to 50.00 μsec for each group. All black printing is provided by providing a delay circuit for delaying the input timing of the strobe signal at the preceding stage of the drive circuit of the group that is driven at least after the second so that the drive periods of the groups are shifted and the drive periods of each group overlap each other. Even when a large number of recording elements are driven simultaneously as described above, the surge voltage appearing on the power supply line is extremely small, and malfunctions of the driver IC and the like due to the surge voltage are effectively prevented.

【0050】また本発明によれば、上述した如く電源線
にあらわれるサージ電圧を極めて小さくして、その影響
力を無視し得る程度に抑えることができるため、サージ
吸収用の大型で高価なコンデンサ等は一切不要であり、
記録ヘッド駆動装置を小型化するとともに、安価になす
ことが可能である。
Further, according to the present invention, as described above, the surge voltage appearing on the power supply line can be made extremely small and its influence can be suppressed to a negligible level. Is completely unnecessary,
It is possible to reduce the size and cost of the recording head drive device.

【図面の簡単な説明】[Brief description of the drawings]

【図1】本発明の記録ヘッド駆動装置をサーマルヘッド
に適用した形態を示す平面図である。
FIG. 1 is a plan view showing an embodiment in which a recording head driving device of the present invention is applied to a thermal head.

【図2】図1のサーマルヘッドの電気的構成を部分的に
示す等価回路図である。
FIG. 2 is an equivalent circuit diagram partially showing an electrical configuration of the thermal head of FIG. 1;

【図3】図1のサーマルヘッドを用いて印画を行なう場
合に発生するサージ電圧の波形を示すタイミングチャー
トである。
FIG. 3 is a timing chart showing a waveform of a surge voltage generated when printing is performed using the thermal head of FIG. 1;

【図4】従来のサーマルヘッドを用いて印画を行なった
場合に発生するサージ電圧の波形を示すタイミングチャ
ートである。
FIG. 4 is a timing chart showing a waveform of a surge voltage generated when printing is performed using a conventional thermal head.

【符号の説明】[Explanation of symbols]

1・・・基板、2 ・・・発熱素子(記録素子)、3 ・・
・共通電極、4 ・・・個別電極、5 ・・・ドライバーI
C、6 ・・・シフトレジスタ、7 ・・・ラッチ回路、8
・・・駆動回路、8a・・・アンドゲート、8b・・・スイ
ッチングトランジスタ、9a,9b,9c・・・遅延回路
1 ... substrate, 2 ... heating element (printing element), 3 ...
・ Common electrode, 4 ・ ・ ・ Individual electrode, 5 ・ ・ ・ Driver I
C, 6: shift register, 7: latch circuit, 8
... Drive circuit, 8a ... And gate, 8b ... Switching transistor, 9a, 9b, 9c ... Delay circuit

Claims (3)

【特許請求の範囲】[Claims] 【請求項1】多数の記録素子と、 多数の直列接続されたシフトレジスタセルから成り、隣
り合うシフトレジスタセル間で画像データを1ビットず
つシリアル転送するとともに画像データを所定のシフト
レジスタセルに格納するシフトレジスタと、 前記シフトレジスタセルに対応して設けられ、ストロー
ブ信号が供給されている間、前記シフトレジスタの画像
データに基づいて記録素子を駆動する多数の駆動回路
と、を備えた記録ヘッド駆動装置であって、 前記多数の駆動回路を複数のグループに区分するととも
に、各グループの駆動回路による前記記録素子の駆動タ
イミングを0.01μsec〜50.00μsecずつ
ずらし、且つ各々のグループの駆動期間が相互にオーバ
ーラップするように、少なくとも2番目以降に駆動する
グループの駆動回路の前段にストローブ信号の入力タイ
ミングを遅らせる遅延回路を設けたことを特徴とする記
録ヘッド駆動装置。
The present invention comprises a number of recording elements and a number of shift register cells connected in series, and serially transfers image data bit by bit between adjacent shift register cells and stores the image data in predetermined shift register cells. And a plurality of drive circuits provided corresponding to the shift register cells and driving a print element based on image data of the shift register while a strobe signal is supplied. A drive device, wherein the plurality of drive circuits are divided into a plurality of groups, the drive timing of the printing elements by the drive circuits of each group is shifted by 0.01 μsec to 50.00 μsec, and the drive period of each group is Groups that drive at least the second and subsequent ones so that And a delay circuit for delaying the input timing of the strobe signal at a stage preceding the drive circuit of (1).
【請求項2】多数の記録素子と、 多数の直列接続されたシフトレジスタセルから成り、隣
り合うシフトレジスタセル間で画像データを1ビットず
つシリアル転送するとともに画像データを所定のシフト
レジスタセルに格納するシフトレジスタと、 前記多数のシフトレジスタセルの画像データをラッチ信
号に同期してパラレルに受け取り保持する多数のラッチ
回路と、 前記ラッチ回路に対応して設けられ、ストローブ信号が
供給されている間、前記ラッチ回路の画像データに基づ
いて記録素子を駆動する多数の駆動回路と、を備えた記
録ヘッド駆動装置であって、 前記多数の駆動回路を複数のグループに区分するととも
に、各グループの駆動回路による前記記録素子の駆動タ
イミングを0.01μsec〜50.00μsecずつ
ずらし、且つ各々のグループの駆動期間が相互にオーバ
ーラップするように、少なくとも2番目以降に駆動する
グループの駆動回路の前段にストローブ信号の入力タイ
ミングを遅らせる遅延回路を設けたことを特徴とする記
録ヘッド駆動装置。
2. A printing apparatus comprising: a plurality of recording elements; and a number of serially connected shift register cells. Serially transferring image data bit by bit between adjacent shift register cells and storing the image data in predetermined shift register cells. A plurality of shift registers, a plurality of latch circuits for receiving and holding image data of the plurality of shift register cells in parallel in synchronization with a latch signal, and a plurality of latch circuits provided corresponding to the latch circuits, while the strobe signal is supplied. A plurality of drive circuits for driving print elements based on image data of the latch circuit, wherein the plurality of drive circuits are divided into a plurality of groups, and each group is driven. The drive timing of the printing element by the circuit is shifted by 0.01 μsec to 50.00 μsec, and A print head driving device, wherein a delay circuit for delaying the input timing of a strobe signal is provided at a stage preceding a driving circuit of at least a second driving group so that driving periods of the respective groups overlap each other. .
【請求項3】前記遅延回路がバッファ及び/又はインバ
ータから成ることを特徴とする請求項1又は請求項2に
記載の記録ヘッド駆動装置。
3. The recording head driving device according to claim 1, wherein said delay circuit comprises a buffer and / or an inverter.
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