FR2716031A1 - Cyclic image display method using LEDs - Google Patents
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Abstract
Description
PROCEDE ET DISPOSITIF D'AFFICHAGE D'IMAGES
La présente invention se rapporte au procédé et au dispositif pour la mise en oeuvre de ce procédé, permettant à un observateur de visualiser une image à côté d'un alignement vertical d'éléments lumineux, pendant une très courte durée lors du déplacement de son regard dans le champ d'action visuelle de ces éléments lumineux.IMAGE DISPLAY METHOD AND DEVICE
The present invention relates to the method and to the device for implementing this method, allowing an observer to visualize an image next to a vertical alignment of light elements, for a very short time during the movement of his gaze. in the visual field of action of these light elements.
La plupart des systèmes connus affichent des images sur une surface de taille équivalente à celle des images. Most known systems display images on a surface area equivalent in size to the images.
L'invention permet d'afficher une image à partir d'une colonne de points lumineux, et ceci pendant un très bref instant, ce qui crée un effet d'étonnement à l'observateur.The invention makes it possible to display an image from a column of luminous points, and this for a very brief instant, which creates an effect of astonishment on the observer.
En effet, si un observateur regarde cette colonne de manière fixe, il ne verra qu'une colonne lumineuse. Par contre s'il en écarte son regard, lorsqu'il le dirigera de nouveau vers cette colonne lumineuse, il verra apparaître très brièvement une image à côté de cette colonne. Cet effet d'optique est particulièrement attractif, décoratif et intéressant.Indeed, if an observer looks at this column in a fixed way, he will only see a luminous column. On the other hand, if he dismisses his gaze, when he directs him again towards this luminous column, he will very briefly see an image appear next to this column. This optical effect is particularly attractive, decorative and interesting.
Selon l'invention il est, en particulier, proposé un procédé d'affichage d'images caractérisé en ce qu'il consiste à composer une matrice à points de (L) lignes et (C) colonnes correspondant au dessin d'une image à afficher, à afficher en un lieu géographiquement fixe, successivement et chronologiquement en un temps t, toutes les colonnes de cette matrice, ou certaines de ces colonnes, de façon cyclique, pour faire apparaître cette image à un observateur immobile ou en mouvement, pendant une très courte durée du balayage de son regard vers le lieu où sont affichées les colonnes, en utilisant la caractéristique de rémanence de la rétine de l'oeil. According to the invention, there is in particular proposed a method for displaying images, characterized in that it consists in composing a dot matrix of (L) rows and (C) columns corresponding to the drawing of an image to display, to display in a geographically fixed place, successively and chronologically in a time t, all the columns of this matrix, or some of these columns, in a cyclic fashion, to make this image appear to a motionless or moving observer, during a very short duration of the scanning of its gaze towards the place where the columns are displayed, using the retentivity characteristic of the retina of the eye.
En effet, lorsque les éléments constituant la rétine de l'oeil captent une information lumineuse 'il' à l'instant 'tl', ils conservent cette information lumineuse 'il' jusqu'à l'instant 't2', phénomène connu en soi et appelé "persistance ou rémanence de la rétine", sur lequel est fondé le cinéma. Si avant l'instant 't2', une information lumineuse 'i2' est captée, la rétine conservera au moins jusqu'à l'instant 't2' les deux informations lumineuses 'il' et 'i2' simultanément. Si de plus, avant l'instant 't2', l'oeil s'est déplacé, la rétine conservera ces deux informations lumineuses 'il' et 'i2', mais cette fois, décalées en position l'une par rapport à l'autre, proportionnellement au déplacement de l'oeil. Indeed, when the elements constituting the retina of the eye capture light information 'it' at the instant 'tl', they keep this light information 'it' until the instant 't2', phenomenon known in itself and called "persistence or remanence of the retina", on which the cinema is based. If before time 't2', light information 'i2' is received, the retina will keep at least until time 't2' the two light information 'il' and 'i2' simultaneously. If in addition, before the instant 't2', the eye has moved, the retina will keep these two pieces of light information 'il' and 'i2', but this time, shifted in position one relative to the other, in proportion to the displacement of the eye.
Un observateur, immobile ou en mouvement, déplaçant son regard horizontalement vers le lieu d'affichage des colonnes, imprimera et conservera successivement sur la rétine de ses yeux les colonnes composant le dessin. Chaque colonne affichée s imprime sur la rétine de ses yeux, horizontalement décalée en position par rapport à la colonne précédemment affichée. Ce décalage horizontal de position est proportionnel à la vitesse de déplacement de son regard et à l'intervalle de temps séparant l'affichage de deux colonnes consécutives. Cet observateur verra alors apparaître l'image représentative du dessin, reconstituée sur la rétine de ses yeux, à côté de l'endroit où toutes les colonnes ont été affichées.An observer, motionless or in motion, moving his gaze horizontally towards the place where the columns are displayed, will successively print and keep on the retina of his eyes the columns composing the drawing. Each displayed column prints on the retina of its eyes, horizontally shifted in position relative to the previously displayed column. This horizontal position offset is proportional to the speed of movement of his gaze and to the time interval between the display of two consecutive columns. This observer will then see the representative image of the drawing appear, reconstructed on the retina of his eyes, next to the place where all the columns were displayed.
Selon l'invention il est également proposé un dispositif d'affichage d'images mettant en oeuvre ce procédé caractérisé en ce qu'il comporte une unité d'affichage constituée d'un alignement vertical de (L) éléments lumineux égal en nombre à celui des lignes de la matrice à points représentative du dessin de l'image à afficher et de circuits pour les faire fonctionner, une unité de commande constituée d'une mémoire, modifiable et interchangeable, dans laquelle sont préprogrammées à des adresses connues les informations de la matrice à points représentative du dessin de 1 image à afficher, et de circuits permettant de lire les informations dans la mémoire et les transmettre à une vitesse réglable à l'unité d'affichage afin d'en sélecter les éléments lumineux correspondant pour que s'affiche successivement et chronologiquement toutes les colonnes de la matrice. Le mémoire peut contenir des informations relatives à plusieurs dessins d'images à afficher. According to the invention there is also proposed an image display device implementing this method characterized in that it comprises a display unit consisting of a vertical alignment of (L) light elements equal in number to that lines of the dot matrix representative of the design of the image to be displayed and of circuits for operating them, a control unit consisting of a memory, modifiable and interchangeable, in which are preprogrammed at known addresses the information of the dot matrix representative of the drawing of 1 image to be displayed, and of circuits making it possible to read the information in the memory and transmit it at an adjustable speed to the display unit in order to select the corresponding light elements so that successively and chronologically displays all the columns of the matrix. The memory can contain information relating to several drawings of images to be displayed.
La présente invention sera mieux comprise et d'autres caractéristiques apparaîtront à l'aide de la description ci apres et des figures s'y rapportant qui représentent
- la figure 1, un schéma destiné à illustrer le procédé selon l'invention,
- la figure 2, un schéma d'une matrice à points,
- la figure 3, un schéma d'un dispositif d'affichage,
- la figure 4, un schéma de la partie de commande du dispositif,
- la figure 5, un schéma de la partie affichage du dispositif.The present invention will be better understood and other characteristics will appear with the aid of the description below and of the figures relating thereto which represent
FIG. 1, a diagram intended to illustrate the method according to the invention,
- Figure 2, a diagram of a dot matrix,
FIG. 3, a diagram of a display device,
FIG. 4, a diagram of the control part of the device,
- Figure 5, a diagram of the display part of the device.
Dans les différentes figures les éléments correspondants sont désignés par les mêmes références. Dans les différents schémas électroniques les dispositifs de synchronisation précise, relevant de la technologie courante, n'ont pas été représentés en vue de rendre les dessins plus clairs et de simplifier l'exposé. In the various figures, the corresponding elements are designated by the same references. In the various electronic diagrams, the precise synchronization devices, which are part of current technology, have not been shown in order to make the drawings clearer and to simplify the description.
La figure 1 est un schéma illustrant le procédé selon l'invention
L'observateur (1) déplaçant son regard (2) de gauche à droite vers le dispositif (3) de mise en oeuvre du procédé, voit apparaître pendant une très courte durée le dessin (4) à coté du dispositif (3).Figure 1 is a diagram illustrating the method according to the invention
The observer (1) moving his gaze (2) from left to right towards the device (3) for implementing the process, sees for a very short time the drawing (4) next to the device (3).
La figure 2 représente la constitution d'une matrice à points de (L) lignes et (C) colonnes. FIG. 2 represents the constitution of a dot matrix of (L) rows and (C) columns.
La figure 3 représente le schéma-bloc de ce dispositif de façon non limitative
Ce dispositif est constitué d'une unité de commande (5) et d'une unité d'affichage (6). L'unité d'affichage (6) est une colonne de points lumineux, notamment des diodes électroluminescentes, ayant des temps d'allumage et d'extinction très courts en comparaison avec d'autres types d'éléments lumineux. L'allumage sélectif de ces diodes, commandé par l'unité de commande (5), permet de reconstituer successivement sur cette colonne de points lumineux les différentes colonnes composant le dessin représentatif de l'image à faire apparaître. Un signal d'horloge (CLK) généré par l'unité de commande (5) est transmis à l'unité d'affichage (6). L'unité d'affichage (6) génère un signal (DISP) à la fin de chaque cycle d'affichage d'une colonne. Figure 3 shows the block diagram of this device without limitation
This device consists of a control unit (5) and a display unit (6). The display unit (6) is a column of light points, in particular light-emitting diodes, having very short on and off times compared with other types of light elements. The selective lighting of these diodes, controlled by the control unit (5), makes it possible to reconstruct successively on this column of light points the different columns making up the drawing representative of the image to be displayed. A clock signal (CLK) generated by the control unit (5) is transmitted to the display unit (6). The display unit (6) generates a signal (DISP) at the end of each column display cycle.
La figure 4 représente le schéma-bloc de l'unité de commande
L'unité de commande est composée d'un circuit d'horloge (8), d'un compteur d'adresses (9), d'une mémoire (11) et d'un circuit de gestion de compteur (12). Le circuit d'horloge (8) génère un signal d'horloge (CLK) régulier et réglable pilotant le compteur d'adresses (9). Ce compteur d'adresses (9) est initialisé à l'adresse "0" à la mise sous tension du dispositif et s'incrémente d'une unité à chaque impulsion du signal d'horloge (CLK). Ces adresses sont transmises à la mémoire (11) par l'intermédiaire du bus d'adresses (10).Figure 4 shows the block diagram of the control unit
The control unit is composed of a clock circuit (8), an address counter (9), a memory (11) and a counter management circuit (12). The clock circuit (8) generates a regular and adjustable clock signal (CLK) driving the address counter (9). This address counter (9) is initialized at address "0" when the device is powered up and is incremented by one at each pulse of the clock signal (CLK). These addresses are transmitted to the memory (11) via the address bus (10).
Lorsque la mémoire (11) reçoit une adresse sur ses entrées d'adresses, elle lit le contenu de l'emplacement mémoire correspondant à cette adresse et le transmet à l'unité d'affichage par l'intermédiaire du bus de données (7). Le circuit de gestion de compteur (12) est utilisé pour permettre à un utilisateur de ce dispositif de régler le nombre de répétition du cycle d'affichage d'un dessin, dans le cas où la mémoire contient plusieurs dessins. Ce circuit de gestion de compteur (12) compte le nombre d'impulsions reçues par le signal (DISP), chaque impulsion correspondant à l'affichage d'une colonne par l'unité d'affichage. A la première impulsion du cycle d'affichage d'un dessin, il mémorise dans un registre-tampon l'adresse se trouvant sur le bus d'adresses, en tant qu'adresse de début de cycle d'affichage de ce dessin. Lorsque ce circuit de gestion de compteur (12) aura reçu (C) impulsions, il repositionnera le compteur (9) à l'adresse de début de cycle mémorisée du dessin à afficher, afin de renouveler l'affichage du même dessin, et ceci un nombre de fois x, réglable par l'utilisateur. A l'impulsion du signal d'horloge (CLK) suivant les x répétitions du cycle d'affichage, le circuit de gestion de compteur mémorise l'adresse se trouvant sur le bus d'adresses (10), considérant celle-ci comme nouvelle adresse de début de cycle pour le dessin suivant qui s'affiche également x fois. Ce processus se répète jusqu'au dernier dessin, puis une remise à zéro du compteur (9) est effectuée afin de renouveler l'affichage de tous les dessins. Ce circuit de gestion de compteur est utilisé dans un mode de réalisation du dispositif destiné à afficher plusieurs dessins. Etant facilement réalisable avec des circuits courants en électronique et afin de ne pas alourdir la description, ce circuit n'est pas plus détaillé.When the memory (11) receives an address on its address entries, it reads the content of the memory location corresponding to this address and transmits it to the display unit via the data bus (7) . The counter management circuit (12) is used to allow a user of this device to set the number of repetitions of the display cycle of a drawing, in the case where the memory contains several drawings. This counter management circuit (12) counts the number of pulses received by the signal (DISP), each pulse corresponding to the display of a column by the display unit. At the first pulse of the display cycle of a drawing, it stores the address on the address bus in a buffer register, as the address for the start of the display cycle of this drawing. When this counter management circuit (12) has received (C) pulses, it will reposition the counter (9) at the stored cycle start address of the drawing to be displayed, in order to renew the display of the same drawing, and this a number of times x, adjustable by the user. Upon the pulse of the clock signal (CLK) according to the x repetitions of the display cycle, the counter management circuit stores the address on the address bus (10), considering it as new. cycle start address for the next drawing which is also displayed x times. This process is repeated until the last drawing, then a reset of the counter (9) is carried out in order to renew the display of all the drawings. This counter management circuit is used in an embodiment of the device intended to display several drawings. Being easily achievable with current circuits in electronics and in order not to burden the description, this circuit is not more detailed.
La figure 5 illustre le fonctionnement de l'unité d'affichage
L'unité d'affichage est constituée d'un registre à décalage (16) de type série-parallèle et d'un nombre "n" de blocs d'affichage, tous identiques, référencés (13) pour le premier, (14) pour le deuxième et (15) pour le énième.Figure 5 illustrates the operation of the display unit
The display unit consists of a shift register (16) of series-parallel type and of a number "n" of display blocks, all identical, referenced (13) for the first, (14) for the second and (15) for the umpteenth.
Chaque bloc d'affichage est constitué de deux registrestampon identiques (17) et (18) et d'un ensemble (19) de huit éléments lumineux (20). Les huit sorties de données du registre-tampon (17) sont respectivement connectées aux huit entrées de données du registre-tampon (18) par l'intermédiaire d'un bus (21). Les huit sorties de données du registre-tampon (18) sont respectivement connectées aux huit éléments lumineux (20). Le bus de données (7) est connecté aux huit entrées du registre-tampon (17) de tous les blocs d'affichage.Each display unit consists of two identical registrestampon (17) and (18) and a set (19) of eight light elements (20). The eight data outputs of the buffer register (17) are respectively connected to the eight data inputs of the buffer register (18) via a bus (21). The eight data outputs of the buffer register (18) are respectively connected to the eight light elements (20). The data bus (7) is connected to the eight inputs of the buffer register (17) of all faceplates.
Le registre à décalage (16) comprend 1,n+l" sorties. Le signal d'horloge (CLK) provenant du circuit d'horloge (8) de l'unité de commande est connecté à l'entrée d'horloge du registre à décalage (16). La première sortie du registre à décalage (16) est connectée à l'entrée de validation (CE1) du registre-tampon (17) du premier bloc d'affichage (13), la deuxième sortie du registre à décalage (16) est connectée à l'entrée de validation (CE1) du registre-tampon (17) du deuxième bloc d'affichage (14), et ainsi de suite, jusqu'à la énième sortie du registre à décalage (16) qui est connectée à l'entrée de validation (CE1) du registre-tampon (17) du énième bloc d'affichage (15). La (n+l)ième sortie du registre à décalage (16) est connectée à l'entrée de validation (CE2) du registre-tampon (18) de tous les blocs d'affichage. Le signal d'horloge (CLK) est également connecté à l'entrée d'horloge de tous les registres-tampon, ceci n'étant pas représenté sur la figure 5 pour plus de clarté. A chaque impulsion du signal d'horloge (CLK), les registres-tampon utilisés mémorisent les huit données présentes sur leurs huit entrées de données. Ces huit données sont transférées sur les huit sorties de données du registre-tampon dès que son entrée de validation (CE) reçoit un signal passant du niveau logique "0" au niveau logique "1", ci-après nommé "front montant", et resteront présentes jusqu'à la réception d'un nouveau front montant. Lors de la mise sous tension du dispositif, tous les signaux sont mis au niveau logique "0".The shift register (16) includes 1, n + 1 "outputs. The clock signal (CLK) from the clock circuit (8) of the control unit is connected to the clock input of the register The first output of the shift register (16) is connected to the validation input (CE1) of the buffer register (17) of the first display block (13), the second output of the register to shift (16) is connected to the validation input (CE1) of the buffer register (17) of the second display block (14), and so on, up to the umpteenth output of the shift register (16) which is connected to the validation input (CE1) of the buffer register (17) of the umpteenth display block (15). The (n + l) th output of the shift register (16) is connected to the input validation (CE2) of the buffer register (18) of all the display blocks. The clock signal (CLK) is also connected to the clock input of all the buffer registers, this not being represented s for more clarity in Figure 5. At each pulse of the clock signal (CLK), the buffer registers used memorize the eight data present on their eight data inputs. These eight data are transferred to the eight data outputs of the buffer register as soon as its validation input (CE) receives a signal passing from logic level "0" to logic level "1", hereinafter called "rising edge", and will remain present until the reception of a new rising edge. When the device is powered up, all signals are set to logic level "0".
Dans cet esprit, lors de la première impulsion du signal d'horloge (CLK), la donnée lue à la première adresse de la mémoire est présente sur les huit entrées de données du registre-tampon (17) de tous les blocs d'affichage. A ce même moment, la première sortie du registre à décalage (16) passe du niveau logique "o" au niveau logique "1", envoyant ainsi un front montant sur l'entrée de validation (CE1) du registre-tampon (17) du premier bloc d'affichage (13). Cette première donnée est donc transférée sur les sorties de données de ce registre-tampon (17), se trouvant ainsi présente sur les entrées de données du registre-tampon (18) et mémorisée jusqu'à réception d'un front montant sur son entrée de validation (CE2). Par le même processus, lors de la deuxième impulsion du signal d'horloge (CLK), la donnée se trouvant à la deuxième adresse de la mémoire sera conservée dans le registre-tampon (18) du deuxième bloc d'affichage (15), et ainsi de suite, lors de la énième impulsion du signal d'horloge (CLK), la donnée se trouvant à la énième adresse de la mémoire sera conservée dans le registre-tampon (18) du énième bloc d'affichage (15). Lors de la (n+l)ième impulsion du signal d'horloge (CLK), la (n+l)ième sortie du registre à décalage (16) passera du niveau logique "0" au niveau logique "1", envoyant un front montant sur l'entrée de validation (CE2) du registre-tampon (18) de tous les blocs d'affichage. Ainsi, les "n" données mémorisées dans les "n" registres-tampon (18), correspondant à la première colonne de la matrice, seront simultanément transférées vers leurs "n" ensembles (19) respectifs d'éléments lumineux (20). De même, la (n+l)ième sortie du registre à décalage (16) enverra un front montant sur son entrée de remise à zéro (RST), remettant ainsi toutes ses sorties au niveau logique "0". La première colonne composant la matrice sera donc affichée. Ce cycle se répétera jusqu'à la dernière adresse mémoire de la zone de données du premier dessin afin d'afficher successivement les "n" colonnes de ce dessin. In this spirit, during the first pulse of the clock signal (CLK), the data read at the first address of the memory is present on the eight data inputs of the buffer register (17) of all the display blocks . At this same moment, the first output of the shift register (16) goes from logic level "o" to logic level "1", thus sending a rising edge to the validation input (CE1) of the buffer register (17) of the first display unit (13). This first data is therefore transferred to the data outputs of this buffer register (17), thus being present on the data inputs of the buffer register (18) and memorized until receipt of a rising edge on its input. validation (CE2). By the same process, during the second pulse of the clock signal (CLK), the data located at the second address of the memory will be kept in the buffer register (18) of the second display block (15), and so on, during the umpteenth pulse of the clock signal (CLK), the data located at the umpteenth address of the memory will be kept in the buffer register (18) of the umpteenth display block (15). During the (n + l) th pulse of the clock signal (CLK), the (n + l) th output of the shift register (16) will pass from logic level "0" to logic level "1", sending a rising edge on the validation input (CE2) of the buffer register (18) of all faceplates. Thus, the "n" data stored in the "n" buffer registers (18), corresponding to the first column of the matrix, will be simultaneously transferred to their respective "n" sets (19) of light elements (20). Likewise, the (n + 1) th output of the shift register (16) will send a rising edge to its reset input (RST), thereby putting all of its outputs back to logic level "0". The first column making up the matrix will therefore be displayed. This cycle will repeat until the last memory address in the data area of the first drawing in order to successively display the "n" columns of this drawing.
Il est à noter que dans l'exemple selon la figure 1, l'observateur (1) peut être en mouvement. It should be noted that in the example according to FIG. 1, the observer (1) can be in motion.
Il est également à noter que dans l'exemple selon la figure 5, les éléments lumineux (20) peuvent être constitués de diodes électroluminescentes émettant des couleurs différentes afin d'afficher des images en couleur. It should also be noted that in the example according to FIG. 5, the light elements (20) may consist of light-emitting diodes emitting different colors in order to display color images.
La présente invention n'est pas limitée aux exemples décrits. The present invention is not limited to the examples described.
Claims (6)
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
FR9401492A FR2716031A1 (en) | 1994-02-10 | 1994-02-10 | Cyclic image display method using LEDs |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
FR9401492A FR2716031A1 (en) | 1994-02-10 | 1994-02-10 | Cyclic image display method using LEDs |
Publications (1)
Publication Number | Publication Date |
---|---|
FR2716031A1 true FR2716031A1 (en) | 1995-08-11 |
Family
ID=9459952
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
FR9401492A Pending FR2716031A1 (en) | 1994-02-10 | 1994-02-10 | Cyclic image display method using LEDs |
Country Status (1)
Country | Link |
---|---|
FR (1) | FR2716031A1 (en) |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4470044A (en) * | 1981-05-15 | 1984-09-04 | Bill Bell | Momentary visual image apparatus |
EP0386269A1 (en) * | 1988-09-02 | 1990-09-12 | TOKIMOTO, Toyotaro | N-dimensional scan type display system and its apparatus |
-
1994
- 1994-02-10 FR FR9401492A patent/FR2716031A1/en active Pending
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