FR2690274A1 - Boîtier pour dispositif à semiconducteur et procédé de formation de boîtier pour dispositif à semiconducteur. - Google Patents

Boîtier pour dispositif à semiconducteur et procédé de formation de boîtier pour dispositif à semiconducteur. Download PDF

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Abstract

L'invention concerne un boîtier pour dispositif à semiconducteur et un procédé de formation de boîtier pour dispositif à semiconducteur. Le boîtier comprend une première puce semiconductrice (14), par exemple une puce de puissance, une puce semiconductrice de commande (16) servant à commander la première puce semiconductrice, et une grille de connexion (2). La grille de connexion (2) comprend une première partie de liaison de puce (4, 5) sur laquelle la première puce semiconductrice est montée et une deuxième partie de liaison de puce (6) sur laquelle la puce semiconductrice de commande est montée. La première partie de liaison de puce (4, 5) s'étend depuis le boîtier de dispositif à semiconducteur pour dissiper la chaleur venant de la première puce semiconductrice. La grille de connexion est conçue de façon que la première partie de liaison de puce soit électriquement isolée de la deuxième partie de liaison de puce.

Description

La présente invention concerne un boîtier pour dispositif à semiconducteur et un procédé de formation de bottier pour dispositif à semiconducteur. L'invention concerne plus particulièrement, mais non exclusivement, des bottiers pour dispositifs à semiconducteurs s'appliquant aux dispositifs de puissance.
Certaines applications électroniques, notamment dans le domaine industriel et celui des automobiles, impliquent la nécessité de pouvoir commander des courants intenses dans un circuit afin d'ajuster La puissance de ce circuit. On effectue cela ordinairement en utilisant des transistors de puissance qui sont commandés par des circuits discrets ou des circuits intégrés. Dès lors qu'on utilise des composants discrets, ceux-ci occupent nécessairement une place importante, ce qui augmente le coût de mise en oeuvre de ces circuits de commande de puissance.
La demande de brevet européen EP-A-O 381 054 indique comment il est possible d'incorporer une puce pour courant intense et une puce pour courant faible dans un unique boîtier en montant
La puce pour courant intense sur un Flot de substrat et la puce pour courant faible sur une région dalot distincte formée à partir de ce que l'on appelle un cadre de montage ou une grille de connexion. Ces bottiers exigent des opérations de traitement supplémentaires pour le montage de la puce pour courant intense sur la région d'îlot du substrat si bien que, malgré leur taille plus petite que celle des circuits discrets de commande puissance, ils sont plus complexes à fabriquer.
On peut également effectuer la commande des courants intenses à L'aide d'une nouvelle génération de puces, récemment mises au point, par exemple des puces de la famille SMARTMOS de la société Motorola. Ces puces incorporent le transistor de puissance et son dispositif de commande sur la même puce. Elles sont plus petites que leur équivalent en composants discrets, mais sont toutefois extrêmement coûteuses.
Selon un premier aspect de l'invention, il est proposé un boîtier pour dispositif à semiconducteur comprenant une première puce semiconductrice ; une puce semiconductrice de commande servant à commander La première puce semiconductrice ; et une grille de connexion comprenant une première partie de liaison de puce sur laqueLle la première puce semiconductrice est montée, la première partie de liaison de puce se prolongeant depuis le bottier de dispositif à semiconducteur pour dissiper la chaleur émanant de la première puce semiconductrice, et une deuxième partie de liaison de puce sur laquelle la puce semiconductrice de commande est montée, La grille de connexion étant conçue de façon que la première partie de liaison de puce soit électriquement isolée vis-à-vis de la deuxième partie de Liaison de puce.
Un avantage de cette structure est que la puce semiconductrice, par exemple un transistor de puissance, peut être montée dans le même bottier que la puce semiconductrice de commande sans qu'il soit nécessaire d'ajouter des structrures, comme un îlot de substrat. Les deux puces peuvent être liées à la même grille de connexion.
De préférence, la première partie de liaison de puce se trouve dans un plan parallèle différent de ce lui de la deuxième partie de liaison de puce. Cette structure préférée a pour avantage que, lorsqu'on a encapsulé dans un bottier la première puce semiconductrice et la puce de commande, celles-ci sont complètement isolées L'une de l'autre.
Dans un mode de réalisation préféré, le boîtier de dispositif à semiconducteur est un boîtier à une seule rangée de broches (SIP) et ta grille de connexion comprend plusieurs fils conducteurs qui forment les bornes externes du bottier de dispositif à semiconducteur. Les différents fils conducteurs sont disposés en une seule rangée dans le même plan que la deuxième partie de liaison de puce.
La première puce semiconductrice peut être un transistor de puissance.
Selon un deuxième aspect de l'invention, il est proposé un procédé de formation d'un boîtier pour dispositif à semiconducteur, comprenant les opérations suivantes former une grille de connexion possédant une première partie de liaison de puce qui s'étend depuis le boîtier de dispositif semiconducteur, une deuxième partie de liaison de puce et plusieurs fils conducteurs destinés à former les bornes externes du boîtier ; réaliser la liaison d'une première puce semiconductrice sur la première partie de liaison de puce de la grille de connexion, la première partie de liaison de puce dissipant la chaleur produite par la première puce semiconductrice ; réaliser la liaison d'une puce de commande sur la deuxième partie de liaison de puce de la grille de connexion ; former des liaisons par fils entre La puce semiconductrice, la puce de commande et les fils conducteurs qui leur sont respectivement associés parmi les différents fils conducteurs ; et encapsuler la première puce semiconductrice et la puce de commande dans un boîtier afin de former un boîtier de dispositif à semiconducteur dans lequel La première puce semiconductrice est électriquement isolée de la puce de commande.
La description, conçue à titre d'illustration de l'invention, vise à donner une meilleure compréhension de ses caractéristiques et avantages ; elle s'appuie sur les dessins annexés, parmi lesquels :
la figure 1 représente la grille de connexion d'un boîtier de dispositif à semiconducteur selon l'invention ;
la figure 2 représente la grille de connexion de la figure 1, à laquelle une puce de puissance et une puce de commande ont été liées ;
la figure 3 est une vue en section droite simplifiée de la figure 2 ; et
la figure 4 représente un deuxième mode de réalisation du boîtier de dispositif à semiconducteur selon l'invention.
On va décrire l'invention en relation avec un dispositif à semiconducteur du type à boîtier à une seule rangée de broches (SIP). On comprendra toutefois que l'invention peut être appliquée de manière analogue à un boîtier à double rangée de broches (DIP) ou à un autre boîtier à semiconducteur du type possédant des grilles de connexion.
Les SIP sont bien connus dans la technique. Ces boîtiers possèdent une grille de connexion, que l'on appelle également cadre de montage, comprenant une unique rangée de fils conducteurs qui s'étendent depuis un côté du boîtier et un radiateur se présentant sous la forme d'une ai lette métallique qui s'étend depuis le boîtier du côté opposé à celui des fils conducteurs. Les fils conducteurs de la rangée de fils conducteurs sont coup lés à la puce contenue dans le boîtier et forment les bornes externes de la puce.
On se reporte d'abord à la figure 1. Une grille de connexion 2 pour SIP selon l'invention comprend plusieurs fils conducteurs 8 disposés en une seule rangée, une première partie 4, 5 de liaison de puce qui forme le radiateur du SIP et une deuxième partie 6 de liaison de puce. Dans le mode de réalisation préféré présentement décrit, la grille de connexion représentée possède 11 fils conducteurs. On comprendra toutefois que le nombre des fils conducteurs n'est pas une particularité importante de l'invention et qu'il dépend de l'application considérée.
La figure 1 représente la grille de connexion 2 après qu'a été effectuée la première opération de traitement consistant à découper ou graver la grille de connexion dans une feuille d'alliage de cuivre. La grille de connexion 2 peut être faite à partir de n'importe quel alliage de cuivre, ou matériau analogue, convenant pour la fabrication de boîtiers électroniques. Les rails latéraux 10a et 10b et Le rail terminal 10c sont retirés au cours d'opérations de traitement ultérieures.
Une extrémité de chacun des fils conducteurs 8 est réunie à une barre commune 12 perpendiculaire. La première partie de liaison de puce 4, 5 et la deuxième partie de liaison de puce sont connectées à la barre commune 12 du côté opposé à celui des fils conducteurs 8 et elles sont électriquement isolées L'une de l'autre. La première partie de liaison de puce 4, 5 est conçue de manière à présenter La forme d'un T, qui comprend une partie inférieure 4 et une partie supérieure 5. La partie inférieure est destinée à recevoir une puce de puissance (puce pour courants intenses). La partie supérieure 5 de la première partie de liaison de puce en forme de T s'étend vers l'extérieur depuis la partie inférieure 4 et, de plus, dans une direction parallèle à La barre commune 12 de manière à se trouver dans une région adjacente à la deuxième partie de liaison de puce 6, mais sans contact avec celle-ci. On décrira de manière plus détaillée, ci-après, les dispositions respectives des première et deuxième parties de liaison de puce, en relation avec la figure 3. La partie supérieure 5 de ta première partie de liaison de puce forme le radiateur du
SIP. On peut connecter La partie supérieure 5 de la première partie de liaison de puce à un radiateur externe pour améliorer la dissipation thermique.
Après avoir découpé La grille de connexion suivant la forme voulue, on lui applique un plaquage de nickel et on réa lise un point argenté (non représenté) sur la deuxième partie de liaison de puce 6.
Comme représenté également sur la figure 2, après avoir retiré Les rails 10a à 10c, on réalise la liaison d'une puce de puissance 14, par exemple une puce transistor de puissance, à la première partie de Liaison de puce 14, et on réa lise la liaison d'une puce de commande 16 à la deuxième partie de liaison de puce 6 sensiblement dans la région du point argenté (non représenté). Les composants qui sont identiques à ceux de la figure 1 sont désignés par les mêmes numéros de référence.
Dans le mode de réalisation préféré, la liaison de la puce de puissance 14 et de la puce de commande 16 comprend deux opérations : on lie par soudage La puce de puissance 14 à la première partie de liaison de puce 4, puis on lie par époxy la puce de commande 16 à la deuxième partie de Liaison de puce 6. D'autres procédés de liaison bien connus dans la technique peuvent être utilisés, par exemple une Liaison par soudure des deux puces en une seule opération. Ceci n'est possible que si la puce de puissance et la puce de commande possède La même métalisation arrière.
La forme de La deuxième partie de liaison de puce 6 dépend de la géométrie de la puce de commande. Le fait que la première partie de liaison de puce 4, 5 soit formée à partir d'une grille de connexion en alliage de cuivre aide beaucoup à la dissipation de la puissance produite par la puce de puissance 14.
La puce de puissance 14 et la puce de commande 16 sont connectées à des fils conducteurs 8 respectifs par soudage de fils.
On utilise des fils d'aluminium 15 pour coupler la puce de puissance 14 à certains des fils conducteurs 8, et on utilise des fils fins en or 17 pour coupler la puce de commande 16 à différents fils conducteurs 8. Pour que la puce de commande 16 puisse commander la puce de puissance 14, deux fils conducteurs 9 d'interconnexion coup Lent les deux puces 14 et 16.
Une fois effectuée l'opération de liaison, on encapsule les puces 14 et 16 dans un boîtier, qui est indiqué par la région hachurée 18 sur la figure 2. Cette opération d'encapsulation est bien connue dans La technique et peut consister par exemple en une opération d'encapsulage dans une résine époxy par La technique de moulage sous pression.
On plaque ensuite avec de L'étain les parties des fils conducteurs 8 qui dépassent du boîtier. On retire ensuite la barre commune 12.
La figure 3 est une vue en section droite du SIP selon un mode de réalisation préféré de l'invention. Les composants qui sont identiques à ceux des figures 1 et 2 sont désignés par les mêmes numéros de référence. La grille de connexion 2 est infléchie dans la région de la première partie de liaison de puce 4, 5 de façon que les parties inférieure 4 et supérieure 5 de la première partie de liaison de puce se trouvent dans un plan qui est parallèle à celui de la deuxième partie de liaison de puce 6, mais au-dessous de ce plan. Puisque Les parties inférieure 4 et supérieure 5 de la première partie de liaison de puce sont en creux par rapport à la deuxième partie de Liaison de puce 6, la puce de commande 16 est complètement isolée de la puce de puissance 14 dès que les puces ont été encapsulées dans la résine époxy. Ceci est une particularité de l'invention.
Alors que l'invention a été décrite en relation avec un
SIP pour une puce de puissance 14 unique et sa puce de commande 16, il est possible de concevoir la grille de connexion 2 de façon qu'elle loge plus d'une puce de puissance. Un exemple de grille de connexion pouvant loger deux puces de puissance est représenté sur la figure 4. La figure 4 montre un boîtier DIP 30 possédant deux puces de puissance 34 et 34' qui sont montées sur des radiateurs respectifs 38 et 38', formées à partir de la grille de connexion 32 et placées à chaque extrémité du DIP 30, et qui sont respectivement commandées par deux puces de commande 36 et 36'.
D'autres types de puces pour courants intenses peuvent être montés sur la première partie de Liaison de puce 4, 5 à la place de la puce transistor de puissance, par exemple une puce de régulation de tension.
Les SIP connus comprennent une ai lette de radiateur et une grille de connexion faits en différents matériaux possédant des épaisseurs différentes, que l'on couple ensemble ensuite. Un avantage de l'invention est que la grille de connexion et le radiateur peuvent être faits à partir de la même feuillue de matériau et en une seule opération de découpage. Ceci simplifie considérablement le processus de formation de la grille de connexion du SIP.
Le boîtier décrit dans EP-A-O 381 054 souffre d'un autre inconvénient, en ce qu'il serait difficile de monter ce boîtier sur un radiateur externe permettant la dissipation de puissances élevées. Au contraire, Le boîtier selon l'invention peut être facilement boulonné à un radiateur externe, par exemple à l'aide d'un trou 7 formé dans la partie radiateur 5 (voir les figures 1 et 2).
Bien entendu, L'homme de l'art sera en mesure d'imaginer, à partir du dispositif et du procédé dont la description vient d'être donnée à titre simplement illustratif et nullement limitatif, diverses variantes et modifications ne sortant pas du cadre de l'invention.

Claims (10)

REVENDICATIONS
1. Boîtier pour dispositif à semiconducteur, caractérisé en ce qu'il comprend une première puce semiconductrice (14) ; une puce semiconductrice de commande (16) servant à commander la première puce semiconductrice ; et une grille de connexion (2) comprenant une première partie de liaison de puce (4, 5) sur laquelle la première puce semiconductri ce est montée, la première partie de liaison de puce s'étendant depuis le boîtier de dispositif à semiconducteur afin de dissiper la chaleur émanant de la première puce semiconductrice, et une deuxième partie de liaison de puce (6) sur laquelle La puce semiconductrice de commande est montée, la grille de connexion étant conçue de façon que la première partie de liaison de puce soit électriquement isolée vis-à-vis de la deuxième partie de Liaison de puce.
2. Boîtier selon la revendication 1, caractérisé en ce que la première partie de liaison de puce est dans un plan parallèle différent de ce lui de la deuxième partie de liaison de puce.
3. Boîtier selon la revendication 1 ou 2, caractérisé en ce que le boîtier est un boîtier à une seule rangée de broches (SIP).
4. Boîtier selon la revendication 1, 2 ou 3, caractérisé en ce que la grille de connexion comprend plusieurs fils conducteurs (8) qui s'étendent depuis le boîtier de dispositif à semiconducteur afin de former les bornes externes du boîtier de dispositif à semiconducteur.
5. Boîtier selon les revendications 2, 3 et 4, caractérisé en ce que les fils conducteurs sont disposés suivant une seule rangée dans le même plan que la deuxième partie de liaison de puce.
6. Boîtier selon L'une quelconque des revendications 1 à 5, caractérisé en ce que la première partie de liaison de puce possède la forme d'un T, comprenant une partie inférieure (4) sur laquelle La première puce semiconductrice est montée et une partie supérieure (5) qui s'étend, depuis le boîtier de dispositif à semiconducteur, dans une direction perpendiculaire à la direction de la partie inférieure (5).
7. Boîtier selon L'une quelconque des revendications 1 à 6, caractérisé en ce que la première puce semiconductrice est un transistor de puissance.
8. Procédé de formation d'un boîtier pour dispositif à semiconducteur, caractérisé en ce qu'il comprend les opérations suivantes former une grille de connexion possédant une première partie de liaison de puce qui s'étend depuis le boîtier de dispositif à semiconducteur, une deuxième partie de liaison de puce et plusieurs fils conducteurs destinés à former les bornes externes du boîtier ; lier une première puce semiconductrice à la première partie de liaison de puce de la grille de connexion, la première partie de liaison de puce dissipant la chaleur créée par la première puce semiconductrice ; lier une puce de commande à La deuxième partie de liaison de puce de la grille de connexion ; former des liaison par fils entre la première puce semiconductrice, la puce de commande et les fils conducteurs qui leur sont respectivement associés parmi les différents fils conducteurs ; et encapsuler la première puce semiconductrice et la puce de commande dans un boîtier de manière à former un boîtier de dispositif à semiconducteur dans lequel la première puce semiconductrice est électriquement isolée vis-à-vis de la puce de commande.
9. Procédé selon la revendication 8, caractérisé en ce que l'opération de formation d'une grille de connexion comprend l'opération consistant à découper Les fils conducteurs et les première et deuxième parties de liaison de puce dans une feuille d'alliage de cuivre, ou un matériau analogue, les fils conducteurs et les première et deuxième parties de liaison de puce étant connectés par une barre commune, le procédé comprenant en outre
l'opération consistant à retirer, après l'opération d'encapsulation, la barre commune, de façon que la première partie de liaison de puce soit électriquement isolée vis-à-vis de la deuxième partie de Liaison de puce.
10. Boîtier pour dispositif à semiconducteur selon L'une quelconque des revendications 1 à 7 ou procédé de formation d'un boîtier pour dispositif à semiconducteur selon la revendication 8 ou 9, où la puce de commande est un circuit intégré.
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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP0910121A1 (fr) * 1996-11-28 1999-04-21 Mitsubishi Denki Kabushiki Kaisha Dispositif a semi-conducteur

Citations (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP0262530A1 (fr) * 1986-09-23 1988-04-06 Siemens Aktiengesellschaft Composants semi-conducteurs comprenant un MOSFET de puissance et un circuit de commande
EP0270069A2 (fr) * 1986-12-02 1988-06-08 Anton Piller GmbH & Co. KG Module comprenant des éléments de circuits de puissance à semi-conducteur
EP0292059A2 (fr) * 1987-05-18 1988-11-23 STMicroelectronics S.r.l. Circuit modulaire encapsulé en résine à plusieurs puces et son procédé de fabrication
FR2618944A1 (fr) * 1987-07-28 1989-02-03 Sgs Thomson Microelectronics Dispositif a semi-conducteur encapsule dans un boitier comprenant un support metallique et un corps en resine synthetique
DE4031051A1 (de) * 1989-11-14 1991-05-16 Siemens Ag Modul mit mindestens einem halbleiterschaltelement und einer ansteuerschaltung
EP0465084A2 (fr) * 1990-06-26 1992-01-08 Harris Semiconductor Patents, Inc. Refroidissement et boîtier de grille de conducteurs avec coussinet multiple de montage pour des puces et procédé pour isoler électriquement ces puces semi-conductrices

Patent Citations (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP0262530A1 (fr) * 1986-09-23 1988-04-06 Siemens Aktiengesellschaft Composants semi-conducteurs comprenant un MOSFET de puissance et un circuit de commande
EP0270069A2 (fr) * 1986-12-02 1988-06-08 Anton Piller GmbH & Co. KG Module comprenant des éléments de circuits de puissance à semi-conducteur
EP0292059A2 (fr) * 1987-05-18 1988-11-23 STMicroelectronics S.r.l. Circuit modulaire encapsulé en résine à plusieurs puces et son procédé de fabrication
FR2618944A1 (fr) * 1987-07-28 1989-02-03 Sgs Thomson Microelectronics Dispositif a semi-conducteur encapsule dans un boitier comprenant un support metallique et un corps en resine synthetique
DE4031051A1 (de) * 1989-11-14 1991-05-16 Siemens Ag Modul mit mindestens einem halbleiterschaltelement und einer ansteuerschaltung
EP0465084A2 (fr) * 1990-06-26 1992-01-08 Harris Semiconductor Patents, Inc. Refroidissement et boîtier de grille de conducteurs avec coussinet multiple de montage pour des puces et procédé pour isoler électriquement ces puces semi-conductrices

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP0910121A1 (fr) * 1996-11-28 1999-04-21 Mitsubishi Denki Kabushiki Kaisha Dispositif a semi-conducteur
EP0910121A4 (fr) * 1996-11-28 2000-12-06 Mitsubishi Electric Corp Dispositif a semi-conducteur

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