FR2469030A1 - Delay circuit for warning lamp activation - uses preset counter and clock with count enable controlled by fault to prevent normal fluctuations generating alarm - Google Patents
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Abstract
Description
La présente invention concerne un dispositif de tem- porisation pour lampe-témoin reliée à un détecteur de défauts, plus particulièrement dans un régulateur de tension pour alternateur destiné à la charge d'une batterie de véhicule automobile et comprenant, de façon connue - un amplificateur de régulation de tension, recevant à ses entrées la tension de la batterie et une tension de référence, et ayant sa sortie reliée à un générateur de puissance, tel que transistor, apte à alimenter le bobinage d'excitation de l'alternateur, et ~ un détecteur de défauts branché sur au joins l'une des phases de l'alternateur et/ou recevant la tension de la batterie,pour déclencher l'allumage d'une lampe-témoin en cas de défaut. The present invention relates to a timing device for a control lamp connected to a fault detector, more particularly in a voltage regulator for an alternator intended for charging a motor vehicle battery and comprising, in known manner - an amplifier voltage regulation, receiving at its inputs the battery voltage and a reference voltage, and having its output connected to a power generator, such as a transistor, capable of supplying the excitation winding of the alternator, and ~ a fault detector connected to one of the alternator phases and / or receiving the battery voltage, to trigger the ignition of a warning lamp in the event of a fault.
On détecte ainsi directement une tension entre phase ses ou par l'intermédiaire d'un pont triphasé à diodes et/ ou à résistances branchues sur les phases, et aussi de préférence la tension aux bornes de la batterie, pour sigaaler par l'allumagne de la lampe-témoin des défauts tels que : coupure de la courroie d'entraînement de lEl- ternateur à partir du moteur, coupure de l'excitation de l'alternateur, tension excessive ou insuffisante aux bornes de la batterie,... A phase-to-phase voltage is thus detected directly or by means of a three-phase bridge with diodes and / or resistances connected to the phases, and also preferably the voltage at the terminals of the battery, to signal by the ignition of the warning lamp for faults such as: cut of the alternator drive belt from the engine, cut of the alternator excitation, excessive or insufficient voltage at the battery terminals, ...
Il a été constaté cependant que les détecteurs de dé fauts actuels pouvaient, dans certaines circonstances qui ne constituent pas des défaits réels,provoquer l'allumage de la lampe-témoin
Ainsi,lorsque la batterie est bien chargée, et en l'absence de consommation auxiliaire, la fréquence de régulation (c'est-à-dire la fréquence de commutation du transistor qui alimente ltenrouleaent d'excitation) peut devenir très lente,par exemple I Hz, ce qui a pour eftet de faire disparaître momentanément la tension entre phases et de déclencher, par l'intermédiaire du détecteur de défauts, l'allumage de la mampe-témoin, ou du moins un scintillenent de celle-ci.It has been noted, however, that the current fault detectors could, in certain circumstances which do not constitute real failures, cause the indicator lamp to light up.
Thus, when the battery is fully charged, and in the absence of auxiliary consumption, the regulation frequency (i.e. the switching frequency of the transistor which supplies the excitation coil) can become very slow, for example I Hz, which has the effect of temporarily removing the voltage between phases and triggering, via the fault detector, the ignition of the indicator lamp, or at least a flicker thereof.
Le meale genre de phénomène peut se produire lors d-'un " délestage de charge " : si l'on coupe brusquement l'alimentation d'un accessoire gros consommateur de courant et que la batterie se trouve bien chargée,l'énergie emmagasinée dans l'alternateur fait augmenter la tension de la batterie. Le régulateur coupe alors l'excitation, mais il peut s'écouler plusieurs secondes avant que la tension de la batterie revienne à une valeur inférieure à la tension due référence, d'où une disparition momentanée de la tension entre phases, provoquant également l'allumage de la lampe-témoin. The same kind of phenomenon can occur during a "load shedding": if the power to an accessory that consumes a lot of power is suddenly cut off and the battery is well charged, the energy stored in the alternator increases the battery voltage. The regulator then cuts the excitation, but it can take several seconds before the battery voltage returns to a value lower than the reference voltage, resulting in a momentary disappearance of the voltage between phases, also causing the ignition of the indicator lamp.
Plus généralesent, il peut apparaître des défauts fugitifs ou des états transitoires qui provoquent l'allumage de la lampe-témoin, alors qu'il n'existe, en réalité, aucune anomalie nécessitant d'alerter le conducteur du véhicule. More generally, there may appear transient faults or transient states which cause the pilot lamp to light, while in reality there is no anomaly requiring the driver of the vehicle to be alerted.
On comprend qu'il est souhaitable d'éviter l'allu- mage intempestif de la lampe-témoin dans les circonstances évoquées ci-dessus. Une idée de solution consiste à ne pas modifier le détecteur de défauts lui-neme,mais à lui adJoindre une temporisation qui allume la lampe-té ioin seulement si le détecteur de défauts délivre un signal suffisamment prolongé, correspondant de façon certaine à ui defaut réel et persistant et ne pouvant, en aucun cas, provenir d'un défaut fugitif ou d'un état transitoi rg. Toutefois l'utilisation d'un circuit à " constante de temps n classique, avec résistance et condensateur, copte tenu de la temporisation à obtenir dans l'applica- tion ici considérée, conduirait à des capacités importantes, difficiles et coûteuses à réaliser, particulièrement dans le cas de circuits intégrés. It is understood that it is desirable to avoid inadvertent lighting of the pilot lamp in the circumstances mentioned above. An idea of solution consists in not modifying the fault detector itself, but in adding a time delay which turns on the lamp only if the fault detector delivers a sufficiently prolonged signal, corresponding in a certain way to a real fault. and persistent and cannot, in any case, come from a fugitive defect or from a transitory state rg. However, the use of a circuit with a conventional time constant n, with resistance and capacitor, copte given the time delay to be obtained in the application considered here, would lead to large capacities, difficult and expensive to produce, particularly in the case of integrated circuits.
La présente invention vise à reaédier à l'ensemble dos inconvénients signalés ci-dessus. The present invention aims to remedy all of the drawbacks mentioned above.
 cet effet, elle a essentiellement pour objet un dispositif de temporisation pour lampe-témoin reliée à un détecteur de défaut,plusparticulièrement dans un régulateur de tension du genre rappelé en introduction, dans lequel la sortie du détecteur de défauts est reliée à un compteur d'impulsions piloté par une horloge, et un circuit logique combine le signal de sortie du détecteur de défauts et le signal de sortie du compteur, de manière à provoquer l'allumage de la lampe-témoin seulement dans le cas où le signal de sortie du détecteur de défauts a une durée supérieure à une durée prédéterminée, correspondant à un nombre maximal d'impulsions d'horloge prises en compte par le compteur. To this end, it essentially relates to a time delay device for a control lamp connected to a fault detector, more particularly in a voltage regulator of the type mentioned in the introduction, in which the output of the fault detector is connected to a counter. pulses controlled by a clock, and a logic circuit combines the output signal of the fault detector and the output signal of the counter, so as to cause the indicator lamp to light up only in the event that the output signal from the fault detector has a duration greater than a predetermined duration, corresponding to a maximum number of clock pulses taken into account by the counter.
Une temporisation précise est ainsi assurée par des moyens numériques et logiques, sans recourir à un circuit à constante de temps classique, ce qui permet une réalisation aisée ous la forme de circuits intégrés.Le résultat recherché est bien obtenu, car le signal de. sortie du détecteur de défauts n'est transais vers la lampetémoin, par le circuit logique, que s'il est encore présent à la fin de la durée de comptage du compteur,ce qui bloque la transmission des signaux trop brefs,correspondant à des défauts fugitifs ou à des états transitoires. Precise timing is thus ensured by digital and logical means, without resorting to a conventional time constant circuit, which allows easy realization or in the form of integrated circuits. The desired result is well obtained, because the signal. output of the fault detector is only transferred to the indicator lamp by the logic circuit if it is still present at the end of the counting time of the counter, which blocks the transmission of signals that are too short, corresponding to faults fugitives or transient states.
Suivant une forme de réalisation particulière de ce dispositif de temporisation, la sortie du détecteur de défauts est reliée d'une part à l'entrée d'autorisation du compteur piloté par l'horloge ainsi qu'à son entrée de remise à zéro, d'autre part à une entrée d'un circuit logique ET dont l'autre entrée reçoit le signal de sortie du compteur, la sortie du circuit logique ET étant reliée, par l'intermédiaire d'un amplificateur, à la lampe-témoin. According to a particular embodiment of this timing device, the output of the fault detector is connected on the one hand to the authorization input of the counter controlled by the clock as well as to its reset input, d on the other hand to an input of an AND logic circuit, the other input of which receives the output signal from the counter, the output of the AND logic circuit being connected, by means of an amplifier, to the indicator lamp.
La détection de tout " défaut ", réel ou non, persistant ou fugitif, se traduit par un signal de niveau logique 1 à une entrée du circuit ET. le compteur délivre un signal de niveau logique 1 à la fin de sa durée de comptage. Si le défaut se prolonge jusqu'à la fin de cette durée de comptage, le circuit ET, recevant deux signaux de niveau logique 1 à ses entrées, déclenche l'allumage de la lampe-témoin, par l'intermédiaire de l'amplificateur. Si le défaut ne se prolonge pas jusqu'à la fin de la durée de comptage, le niveau logique à l'une des entrées du circuit ET est retombé à O et l'allumage de la lampe-té moin n'est pas déclenché. La remise à zéro du compteur évite toute perturbation du fonctionnement dans le cas de deux défauts successifs très rapprochés.The detection of any "fault", real or not, persistent or fugitive, results in a signal of logic level 1 at an input of the AND circuit. the counter delivers a logic level 1 signal at the end of its counting time. If the fault continues until the end of this counting time, the AND circuit, receiving two signals of logic level 1 at its inputs, triggers the lighting of the indicator lamp, via the amplifier. If the fault does not continue until the end of the counting time, the logic level at one of the inputs of the AND circuit has dropped back to O and the lighting of the warning lamp is not triggered. Resetting the counter prevents any disturbance of the operation in the case of two successive faults very close together.
De toute façon, l'invention sera mieux comprise à l'aide de la description qui suit, en référence au dessin schématique annexé représentant, à titre d'exemple non limitatif, une forme de réalisation de ce dispositif de temporisation, et illustrant son fonctionnement. In any case, the invention will be better understood with the aid of the description which follows, with reference to the appended diagrammatic drawing representing, by way of nonlimiting example, an embodiment of this timing device, and illustrating its operation .
Figure 1 est un schéma-bloc électrique du dispositif de temporisation conforme à l'invention;
Figure 2 est un diagramme représestant les signaux émis par les diverses parties de ce dispositif.Figure 1 is an electrical block diagram of the timing device according to the invention;
Figure 2 is a diagram representing the signals emitted by the various parts of this device.
Sur la figure 1, le repère 1 désigne, dans son ensemble,le détecteur de défauts à partir duquel est déclenché, en cas dedéfaut,l'allumage d'une lampe-témoin 2. In FIG. 1, the reference 1 designates, as a whole, the fault detector from which is triggered, in the event of a fault, the lighting of a warning lamp 2.
le manière connue, le détecteur de défauts peut être constitué par un double comparateur 3,4 dans lequel - un-premier comparateur 3 reçoit, à ses entrées,la tension aux bornes de la batterie Ub et une tension de référence Ur, et - un second comparateur 4 rçoit, à ses entrées,laten- sion de phase UE de l'alternateur et une autre tension de référence U'r.in known manner, the fault detector can be constituted by a double comparator 3,4 in which - a first comparator 3 receives, at its inputs, the voltage across the terminals of the battery Ub and a reference voltage Ur, and - a second comparator 4 receives, at its inputs, phase lag UE of the alternator and another reference voltage U'r.
Ainsi le détecteur 1 délivre à sa sortie un signal logique S, dont le niveau est par exemple 0 en l'absence de défaut, et 1 en présence d'un défaut tel que tension excessive (ou insuffisante) Ub aux bornes de la batterie, ou tension de phase Uq insuffisante. Thus the detector 1 delivers at its output a logic signal S, the level of which is for example 0 in the absence of a fault, and 1 in the presence of a fault such as excessive (or insufficient) voltage Ub at the terminals of the battery, or insufficient phase voltage Uq.
Be dispositif de temporisation, faisant plus particulièrement I'objetde l'invention, comprend essentiellement une horloge 5 délivrant un signal périodique H, un compteur 6, et un circuit logique (ou " porte" ) ET 7. The timing device, more particularly the object of the invention, essentially comprises a clock 5 delivering a periodic signal H, a counter 6, and a logic circuit (or "gate") AND 7.
Un amplificateur 8 est, en outre, intercalé entre la sortie du circuit ET 7 et la lampe-témoin 2.An amplifier 8 is, moreover, interposed between the output of the AND circuit 7 and the indicator lamp 2.
L'horloge 5 délivre un signal H permanent forné d'inpulsions (voir aussi la première ligne du diagraue de la figure 2) de fréquence fixe prédéterminée,qui pi lote le compteur 6. Pour des raisons constructives,cette horloge 5 pBt être constituée par la.combinaison d'un oscillateur à frequence plus élevée, et d'un diviseur de fréquence. The clock 5 delivers a permanent signal H formed of pulses (see also the first line of the diagram in FIG. 2) of predetermined fixed frequency, which operates the counter 6. For constructive reasons, this clock 5 pBt be constituted by the combination of a higher frequency oscillator and a frequency divider.
Le compteur 6 est conçu de manière à compter les impulsions qu'il reçoit de l'horloge 5, et à délivrer un signal de sortie C après comptage d'un nombre maximal N d'impulsions du signal d'horloge H. La sortie du détecteur de défauts î est reliée à l'entrée d'autorisation 9 du compteur 6, ainsi qu'à son entrée de remise à Léro 10
l'a sortie du détecteur de défauts 1 est reliée aussi à l'une des deux entrées du circuit ET 7. L'autre entrée de ce circuit ET 7 regoit le signal de sortie O du compteur 6.Le circuit ET 7 transmet, vers 1 amplificateur 8, un signal logique L de niveau 1 qui déclenche l'allumage de la lampe-témoin 2 seulement si les niveaux logiques des signaux S et C, présents à ses deux entrées, sont l'un et l'autre égaux à 1.The counter 6 is designed so as to count the pulses it receives from the clock 5, and to deliver an output signal C after counting a maximum number N of pulses of the clock signal H. The output of the fault detector î is connected to the authorization input 9 of the counter 6, as well as to its reset input at Léro 10
the output of the fault detector 1 is also connected to one of the two inputs of the AND circuit 7. The other input of this AND circuit 7 receives the output signal O of the counter 6. The AND circuit 7 transmits, to 1 amplifier 8, a logic signal L of level 1 which triggers the lighting of the control lamp 2 only if the logic levels of the signals S and C, present at its two inputs, are both equal to 1 .
Le fonctionnement d'ensemble du dispositif ,illustré par le diagramme de la figure 2, s'établit comme suit
Dans un premier cas à envisager, le détecteur de défauts 1 est sollicité par un défaut fugitif ou par un état transitoire,de sorte que son signal de sortie SI reste au niveau logique 1 seulement pendant une durée courte t, inférieure à la durée prédéterminée T correspondant au nombre maximal N d'impulsions pouvant être prises en compte par le compteur 6. Au moment où le signal SI a son front montant, le compteur 6 commence à compter des impul- sions Il;; pendant toute la durée g durant laquelle ces impulsions I7 sont comptées, la sortie CI du compteur 6 reste au niveau logique 0, de sorte que la sortie L1 du circuit EX 7 reste aussi au niveau 0. A la fin de la durée T, la sortie CI du compteur 6 passe au niveau logique 1, mais le signal SI est déJà retombé au niveau 0, de sorte que la sortie L1 du circuit ET 7 est toujours maintenue au niveau 0. Il en-resulte que la lampe-témoin 2 ne s'allu- mera à aucun moment. The overall operation of the device, illustrated by the diagram in FIG. 2, is established as follows
In a first case to be considered, the fault detector 1 is requested by a fugitive fault or by a transient state, so that its output signal SI remains at logic level 1 only for a short duration t, less than the predetermined duration T corresponding to the maximum number N of pulses that can be taken into account by the counter 6. When the signal SI has its rising edge, the counter 6 begins to count pulses Il; throughout the duration g during which these pulses I7 are counted, the output CI of the counter 6 remains at logic level 0, so that the output L1 of the circuit EX 7 also remains at level 0. At the end of the duration T, the CI output of counter 6 goes to logic level 1, but the signal SI has already dropped to level 0, so that the output L1 of the AND circuit 7 is always maintained at level 0. It follows that the indicator lamp 2 does not will never light up.
Dans un second cas à envisager, le détenteur de défauts 1 est sollicité par un défaut réel et persistant, de sorte que son signal de sortie S2 reste au niveau logique i pendant une durée supérieure à la durée prédéterminée T. Comme dans le premier cas, au ioment où le signal de sortie 52 a son front montant, donc dès l'apparition du défaut, le compteur 6 se met à compter des impulsions I2 et, pendant toute la durée T, la sortie C2 du compteur, restant au niveau logique 0, maintient aussi la sortie L2 du circuit EX 7 au niveau 0.A la fin de la durée T,la sortie C1 du compteur 6 passe au niveau-logique 1, et à cet instant le signal S2 se trouve aussi au niveau 1. Il en résulte que la sortie L2 du circuit EU 7 passe au niveau 1, ce qui déclenche, par l'intermédiire de l'amplificateur 8, l'allumage de la lampe-témoin 2, laquelle signalera le défaut détecté. In a second case to be considered, the defect holder 1 is requested by a real and persistent fault, so that its output signal S2 remains at logic level i for a duration greater than the predetermined duration T. As in the first case, at the time when the output signal 52 has its rising edge, therefore as soon as the fault appears, the counter 6 starts to count pulses I2 and, throughout the duration T, the output C2 of the counter, remaining at logic level 0 , also maintains the output L2 of the circuit EX 7 at level 0. At the end of the duration T, the output C1 of the counter 6 goes to logic level 1, and at this instant the signal S2 is also at level 1. It As a result, the output L2 of the circuit EU 7 passes to level 1, which triggers, through the amplifier 8, the lighting of the indicator lamp 2, which will signal the detected fault.
le dispositif de temporisation précédemment décrit s'applique plus particulièrement dans un régulateur de tension pour alternateur destiné à la charge d'une batterie de véhicule autonoblle. il est utilisable avec des détecteurs de défauts 1 qui effectuent une comparaison de la tension de la batterie Ub et/ou de la tension de phase Up avec une ou plusieurs tensions de référence.En- fin, horloge 5 de ce dispositif peut être commune avec d'autres systèmes de contrôle incorporés au régulateur et utilisant des impulsions périodiques. the previously described timing device applies more particularly in a voltage regulator for an alternator intended for charging a self-contained vehicle battery. it can be used with fault detectors 1 which compare the voltage of the battery Ub and / or the phase voltage Up with one or more reference voltages. Finally, clock 5 of this device can be common with other control systems incorporated in the regulator and using periodic pulses.
Comme il va de soi, et conne il résulte déåà de ce qui précède, l'invention ne se limite pas à la seule forme de réalisation de ce dispositif de temporisation pour lampe-témoin reliée à un détecteur de défauts qui a été décrite ci-dessus-,-à titre d'exemple; elle en embrasse,au contraire, toutes les variantes conçues suivant le m8me principe, et c'est ainsi notamment que les,circuits logiques décrits peuvent être remplacés par des équivalents sans que l'on s'éloigne du cadre de l'invention. As it goes without saying, and as it follows from the foregoing, the invention is not limited to the only embodiment of this time delay device for control lamp connected to a fault detector which has been described below. above -, - as an example; on the contrary, it embraces all the variants designed according to the same principle, and it is thus in particular that the logic circuits described can be replaced by equivalents without departing from the scope of the invention.
Claims (2)
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| FR7927390A FR2469030A1 (en) | 1979-10-30 | 1979-10-30 | Delay circuit for warning lamp activation - uses preset counter and clock with count enable controlled by fault to prevent normal fluctuations generating alarm |
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| Application Number | Priority Date | Filing Date | Title |
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| FR7927390A FR2469030A1 (en) | 1979-10-30 | 1979-10-30 | Delay circuit for warning lamp activation - uses preset counter and clock with count enable controlled by fault to prevent normal fluctuations generating alarm |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| FR2469030A1 true FR2469030A1 (en) | 1981-05-08 |
| FR2469030B1 FR2469030B1 (en) | 1982-10-29 |
Family
ID=9231358
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| FR7927390A Granted FR2469030A1 (en) | 1979-10-30 | 1979-10-30 | Delay circuit for warning lamp activation - uses preset counter and clock with count enable controlled by fault to prevent normal fluctuations generating alarm |
Country Status (1)
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| FR (1) | FR2469030A1 (en) |
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1979
- 1979-10-30 FR FR7927390A patent/FR2469030A1/en active Granted
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|---|---|
| FR2469030B1 (en) | 1982-10-29 |
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