DE2842069C2 - Analog-to-digital converter - Google Patents
Analog-to-digital converterInfo
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- H03—ELECTRONIC CIRCUITRY
- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M1/00—Analogue/digital conversion; Digital/analogue conversion
- H03M1/12—Analogue/digital converters
- H03M1/34—Analogue value compared with reference values
- H03M1/38—Analogue value compared with reference values sequentially only, e.g. successive approximation type
- H03M1/42—Sequential comparisons in series-connected stages with no change in value of analogue signal
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Description
Dieser Auswahl des jeweils höchstwertigen Bits des Signals s zur Aktivierung eines entsprechend gestuften Anpaßwiderstandes liegt die Oberlegimg zugrunde, daß sich der Wert der Meßspannung Ux immer zwischen dem einfachen und dem doppelten Wert des jeweils höchstwertigen Bits des Digitalsignals s bewegt, wenn sich die Werte benachbarter Bits jeweils um den Faktor 2 unterscheiden. Ordnet man dem höchstwertigen Bit des Digital-Analogwandlers 12 den analogen Spannungswert Unab und dessen niedrigstwertigen Bit den Spannungswert Uu> zu, dann endet der maximale Meßbereich bei 2 - Uaab—Uisb- Der Widerstandswert des dem höchstwertigen Bit zugeordneten Widerstandes Rg des Anpaßnetzwerkes 1 wird dann zuThis selection of the most significant bit of the signal s in each case to activate a correspondingly graded matching resistor is based on the rule that the value of the measurement voltage U x always moves between the single and double value of the most significant bit of the digital signal s when the values of adjacent ones Different bits by a factor of 2. If one assigns the most significant bit of the digital to analog converter 12 to analog voltage value Unab and its least significant bit voltage value Uu> to, the maximum measuring range with 2 ends - Uaab-Uisb- The resistance value of the associated the most significant bit resistance Rg of the matching network 1 is then to
gewählt, wobei t die Meßzeit des Umsetzers ()
die maximale Ausgangsspannung bei Nennaussteuerung des Integrators 3 und C die Kapazität seines Gegenkopplungskondensators
bedeuten. Di ί Widerstandswerte der den niedrigerwertigen Bits zijgeordneten
Widerständen des Anpaßnetzwerkes 1 sind dann jeweils um den Faktor 2 kleiner als der dem jeweils
benachbarten höherwertigen Bit zugeordnete Widerstand,
so daß giltselected, where t is the measuring time of the converter ()
the maximum output voltage at the nominal level of the integrator 3 and C the capacitance of its negative feedback capacitor. The resistance values of the resistances of the matching network 1 assigned to the lower-order bits are then each smaller by a factor of 2 than the resistance assigned to the respective adjacent higher-order bit, so that the following applies
R9: R9.R 9 : R 9 .
:Äo=512:256:...:2:l: Ao = 512: 256: ...: 2: l
Die Widerstände ft» bis Ro verhalten sich also genauso wie die Wertigkeiten der ihnen zugeordneten Bits. Damit bewegt sich die Ausgangsspannung £/w des Integrators 3 stets zwischen halber und voller Nennaussteuerung. Der Faktor, mit dem der durch den Zähler 5 digitalisierte Wert m der Integratorspannung Um jeweils zu wichten ist, um zum tatsächlichen Wert der Meßspannung Ux zu kommen, ergibt sich aus dem Wert des jeweils aktivierten Widerstandes Rn bzw. des ihm zugeordneten und von der Prioritiierungsstufe 17 ausgewählten höchstwertigen Bits 2", welches vom Digital-Analogwandler 12 zur digitalen Darstellung der Meßspannung Ux ausgegeben wurde. So ist beim dargestellten BeispielThe resistors ft »to Ro behave in exactly the same way as the valences of the bits assigned to them. The output voltage £ / w of the integrator 3 thus always moves between half and full nominal modulation. The factor with which the value m of the integrator voltage Um digitized by the counter 5 is to be weighted in each case in order to arrive at the actual value of the measurement voltage U x , results from the value of the respectively activated resistor R n or the value assigned to it and from the priority level 17 selected most significant bits 2 ″, which was output by the digital-to-analog converter 12 for the digital representation of the measurement voltage U x . This is the case in the example shown
2-tu-(45)-2-tu- (45) -
bertenden Momentanwert-Analogumsetzers 12 ein logarithmisch arbeitender Analog-Digitalumsetzer 12' eingesetzt ist Ein solcher Umsetzer gleicht in seinem Aufbau grundsätzlich dem in F i g. 1 dargestellten Umsetzers IZ der einzige Unterschied besteht darin, daß anstelle eines linear gestuften Digital-Analogumseizers 14 ein exponentiell gestufter D/A-Umsetzer vorgesehen ist Als solcher Umsetzer kann beispielsweise der in der DE-Zeitschrift »Elektronik« 1976, Heft 9, Seite 105 erwähnte Baustein DAC-76 verwendet werden, welcher mit recht guter Näherung die in dem mit 12' bezeicnneten Blocksymbol angedeutete Beziehung zwischen normiertem analogem Eingangssignal u und normiertem digitalem Ausgangssignal sTransmitting instantaneous value analog converter 12, a logarithmically operating analog-digital converter 12 'is used. Such a converter is basically the same in its structure as that in FIG. 1 converter IZ shown the only difference is that instead of a linearly stepped digital-to-analog converter 14, an exponentially stepped D / A converter is provided The DAC-76 module mentioned above can be used which, with a very good approximation, shows the relationship between the standardized analog input signal u and the standardized digital output signal s indicated in the block symbol denoted by 12 '
u=2^- u = 2 ^ -
nachbildet An drei seiner Ausgänge entsteht ein binärcodiertes digitales Signal Λ, welches sich — ausgehend
von einem Maximalwert bei maxin'.-·; möglicher Meßspannung
Ux — jeweils stufenweise usi' /g dieses Wertes
verringert, wenn die analoge Meßspannung sich jeweils um die Hälfte verringert hat Dieses Signal h wird
von einem Verschlüßler 19 so umgesetzt daß jeder der 8 möglichen Werte des Signals h auf einer von acht Ausgangsleitungen
ein Signal erscheinen lassen kann, mit dem dann entsprechende Eingangswiderstände des Anpaßnetzwerkes
1 aktiviert werden können.
Die Steuerung des Anpaßnetzwerkes 1 und des integrierenden Analog-Digitalumsetzers 2 erfolgt in analoger
Weise wie im Zusammenhang mit F i g. 1 beschrieben worden ist Bei der F i g. 2 dargestellten Variante
entfällt die Prioritiierungsstufe 17, und es läßt sich infolge der exponentiellen Kennlinie des im Umsetzer 12'
enthaltenen D/A-Wandlers bei gleicher Bitzahl ein wesentlich größerer Zahlenbereich verarbeiten als bei der
Variante gemäß F i g. 1.simulated A binary-coded digital signal Λ arises at three of its outputs, which - starting from a maximum value at maxin '.- ·; possible measurement voltage U x - each stepwise usi '/ g of this value reduced when the analog measurement voltage has been reduced by half. This signal h is converted by an encoder 19 so that each of the 8 possible values of the signal h on one of eight output lines a signal can appear with which the corresponding input resistances of the matching network 1 can then be activated.
The matching network 1 and the integrating analog-digital converter 2 are controlled in an analogous manner as in connection with FIG. 1 has been described in FIG. In the variant shown in FIG. 2, the prioritization stage 17 is omitted, and as a result of the exponential characteristic of the D / A converter contained in the converter 12 ', with the same number of bits, a significantly larger number range can be processed than in the variant according to FIG. 1.
Hierzu 1 Blatt Zeichnungen1 sheet of drawings
9/1+19/1 + 1
wobei stets gilt:where always applies:
0,5 <0.5 <
Der Exponent n+1 =h in obigem Term läßt sich auf einfache Weise aus dem Ausgangssignal der Prioritiierungsstufe 17 erhalten, wenn deren zehn Ausgangsleitungen mit den Eingängen einer BCD-Codiereinrichlung 18 verbunden werden. Mit den Ausgangsgrößen der Codiereinrichtung 18 und des Zählers 5 kann also die auf Spannungswert U^b des niedrigstwertigen Bits bezogene Meßspannung ÜxIUub=ux in einem für die Verarbeitung in einem Digitalrechner vorteilhaften ülcilkommawcrt, bestehend aus der normalisierten Mantisse m/mmix und dem der Bais 2 zugeordneten Exponenten h abgebildet werden.The exponent n + 1 = h in the above term can be obtained in a simple manner from the output signal of the prioritization stage 17 if its ten output lines are connected to the inputs of a BCD coding device 18. With the output variables of the coding device 18 and the counter 5, the measurement voltage U x IUub = u x, which is related to the voltage value U ^ b of the least significant bit, can be used in an advantageous value for processing in a digital computer, consisting of the normalized mantissa m / m mix and are mapped to the exponent h assigned to base 2.
F i g. 2 zeigt eine andere Variante des erfindungsgemäßen A/D-Umsetzers, wobei im Gegensatz zu der in Fiel dargestellten Anordnung anstelle eine linear ar-F i g. FIG. 2 shows another variant of the A / D converter according to the invention, in which, in contrast to that in FIG Instead of a linear ar-
Claims (3)
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
DE2842069A DE2842069C2 (en) | 1978-09-27 | 1978-09-27 | Analog-to-digital converter |
JP12308179A JPS5545298A (en) | 1978-09-27 | 1979-09-25 | Analoggtoodigital converter |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
DE2842069A DE2842069C2 (en) | 1978-09-27 | 1978-09-27 | Analog-to-digital converter |
Publications (2)
Publication Number | Publication Date |
---|---|
DE2842069A1 DE2842069A1 (en) | 1980-04-10 |
DE2842069C2 true DE2842069C2 (en) | 1986-01-02 |
Family
ID=6050606
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE2842069A Expired DE2842069C2 (en) | 1978-09-27 | 1978-09-27 | Analog-to-digital converter |
Country Status (2)
Country | Link |
---|---|
JP (1) | JPS5545298A (en) |
DE (1) | DE2842069C2 (en) |
Families Citing this family (2)
Publication number | Priority date | Publication date | Assignee | Title |
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JPS603913A (en) * | 1983-06-22 | 1985-01-10 | Sumitomo Metal Ind Ltd | Extrusion method of titanium alloy |
JPH0683874B2 (en) * | 1987-11-16 | 1994-10-26 | 三菱製鋼株式会社 | Titanium alloy hot forming equipment |
Family Cites Families (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE2132513A1 (en) * | 1971-06-30 | 1973-01-11 | Licentia Gmbh | ANALOG-DIGITAL CONVERTER ACCORDING TO THE DOUBLE INTEGRATION PROCESS |
-
1978
- 1978-09-27 DE DE2842069A patent/DE2842069C2/en not_active Expired
-
1979
- 1979-09-25 JP JP12308179A patent/JPS5545298A/en active Pending
Also Published As
Publication number | Publication date |
---|---|
JPS5545298A (en) | 1980-03-29 |
DE2842069A1 (en) | 1980-04-10 |
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