DE1801381B2 - Data display device for displaying characters in rows on a screen - Google Patents
Data display device for displaying characters in rows on a screenInfo
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Description
Die vorliegende Erfindung betrifft ein Datensichtgerät zum reihenweisen Anzeigen von Zeichen auf einem Bildschirm, die in einem Umlaufverzögerungsspeicher gespeichert sind, dessen Zeichenkapazität gleich der Anzahl der Zeichenplätze auf dem Bildschirm ist, mit einem Schieberegister, das eine Kapazität von einem Zeichen besitzt und den Eingang sowie den Ausgang des Speichers verbindet; einer Taktgeberschaltung zum Erzeugen von Taktsignalen, um den Zeichenumlauf im Speicher über das Schieberegister während eines vorbestimmten Umlauf-Taktzyklus zu steuern; einer Decodierschaltung zum einzelnen Decodieren des im Schieberegister gespeicherten Zeichens und zum Aktivieren der Zeilen und Spalten einer Matrix, um ein Muster zu erzeugen, das dem im Schieberegister gespeicherten Zeichen entspricht und das durch die Kreuzpunkte der Matrix definiert wird, die durch die Schnittstellen der durch die Decodierschaltung aktivierten Zeilen und Spalten gebildet werden; einer Abtastschaltung zum aufeinanderfolgenden Freigeben der Zeilen der Matrix, um für jede freigegebene Zeile die Übertragung einer Information in ein mit den Spalten der Matrix in Verbindung stehendes Ausgaberegister zu steuern, die diejenigen Kreuzpunkte identifiziert, welche den der freigegebenen Zeile zugeordneten Teil des Musters definieren; und einer Schaltungsanordnung zum Steuern der Anzeige auf dem Bildschirm in Übereinstimmung mit der im Ausgaberegister gespeicherten Information, wobei die Schaltungsanordnung für die Ablenksteuerung des Bildschirms durch die Taktgebereinrichtung mit dem Umlauf der Zeichen im Speicher synchronisiert ist und eine Einrichtung zum zeilenweisen Abtasten des Bildschirms enthält, wobei jede Zeichenreihe des Bildschirms aus einer Vielzahl von Zeilen gebildet wird, deren Anzahl gleich der der Zeilen der Matrix ist.The present invention relates to a data display device for displaying characters on a row by row Screen stored in a round-trip memory whose character capacity is equal to Number of character spaces on the screen is, with a shift register that has a capacity of one Has characters and connects the input and output of the memory; a clock circuit for Generate clock signals to circulate characters in memory via the shift register during a control predetermined round trip clock cycle; a decoding circuit for individually decoding the im Shift register stored character and to activate the rows and columns of a matrix to a Generate pattern that corresponds to the character stored in the shift register and that by the Crosspoints of the matrix is defined by the interfaces of the activated by the decoding circuit Rows and columns are formed; a sampling circuit for sequential enabling of the rows of the matrix in order to transfer information into a with the for each released row Columns of the matrix related output registers control those cross points identifies which define the portion of the pattern associated with the released line; and one Circuitry for controlling the display on the screen in accordance with that in the output register stored information, the circuit arrangement for the deflection control of the screen is synchronized by the clock device with the circulation of the characters in the memory and a Includes means for line-by-line scanning of the screen, each row of characters from the screen a plurality of rows is formed, the number of which is equal to that of the rows of the matrix.
Es ist bereits ein Sichtgerät bekannt, das eine Matrix, eine Symbol-Auswahl-Logik, eine Schaltung zum Abtasten der Spalten und der Zeilen der Matrix und eine Kathodenstrahlröhre zum Anzeigen der von Zeit zu Zeit in die Matrix eingespeicherten Zeichen aufweist (Proceedings of the IRE, 1961, Seite 185-195). Diese Einrichtung benötigt zu ihrem Betrieb eine Eingabeschaltung zur Eingabe der anzuzeigenden Zeichen in dieA display device is already known which has a matrix, a symbol selection logic, a circuit for Scanning the columns and rows of the matrix and a cathode ray tube to display the time to come Time has characters stored in the matrix (Proceedings of the IRE, 1961, pages 185-195). These The device requires an input circuit for entering the characters to be displayed in the operation
Matrix und zur Synchronisierung der eingegebenen Zeichen mit der Abtastfrequenz der Röhre, da dieses Gerät in einer Zeichen-für-Zeichen-Weise arbeitet.Matrix and to synchronize the entered characters with the sampling frequency of the tube, as this Device works in a character-by-character fashion.
Es ist ferner ein weiteres Anzeigegerät bekannt (GB-PS 1045 929), bei dem der Bildspeicher eine Zeichenkapazität aufweist, die gleich der Anzahl der darzustellenden Zeichen auf dem Bildschirm ist. Bei diesem bekannten Sichtgerät ist der Speicher mit der Strahlablenkung synchronisiert.There is also another display device known (GB-PS 1045 929), in which the image memory a Has character capacity which is equal to the number of characters to be displayed on the screen. at In this known viewing device, the memory is synchronized with the beam deflection.
Die bekannten Sichtgeräte benötigen einen besonderen komplexen Schaltkreis für die Adressierung der auf dem Bildschirm anzuzeigenden Zeichen. Demgegenüber liegt der Erfindung die Aufgabe zugrunde, daß die Steuerung eines Datensichtgeräts ohne besonderen Aufwand für die Adressierung der Zeichen des Bildspeichers erfolgt. Für die Lösung dieser Aufgabe werden erfindungsgemäß die im kennzeichnenden Teil des Patentanspruchs 1 angegebenen Mittel vorgeschlagen. Auf diese Weise gelingt es, für ein Datensichtgerät eine Steuereinheit zu schaffen, die keine besonderen zum Adressieren der anzuzeigenden Zeichen geeigneten Taktgeberschaltungen benötigt.The known display devices require a special complex circuit for addressing the characters to be displayed on the screen. In contrast, the invention has the object that the Control of a data display device without any special effort for addressing the characters of the Image storage takes place. For the solution of this object, according to the invention, those in the characterizing part of claim 1 specified means proposed. In this way it is possible for a data display device to provide a control unit which does not have any special ones suitable for addressing the characters to be displayed Clock circuits needed.
Weiterbildungen der Erfindung sind in den Unteransprüchen angegeben.Further developments of the invention are given in the subclaims.
Einzelheiten der Erfindung sind nachstehend anhand eines in der Zeichnung dargestellten Ausführungsbeispiels näher erläutert. Es zeigtDetails of the invention are given below with reference to an embodiment shown in the drawing explained in more detail. It shows
Fig. 1 ein Blockdiagramm für den Zeichengenerator und die visuelle Anzeige,Fig. 1 is a block diagram for the character generator and visual display;
Fig. 2 einen Teil des Abtastmodus der visuellen Anzeige undFig. 2 shows part of the scanning mode of the visual display and
F i g. 3 ein Zeitdiagramm hinsichtlich der Arbeitsweise des Speichers.F i g. 3 is a timing diagram showing the operation of the memory.
In der Zeit der visuellen Wiedergabe wirkt das Register 51 wie ein Eingangsregister für die Anzeigeeinrichtung; das im Register gegenwärtige Zeichen wird durch einen Decoder 54 decodiert, der mit derselben Zahl von Ausgaugsleitungen (Zeichenleitungen) gebildet wird, wie alphabetische Zeichen vorhanden sind, Dezimalziffern (10) und zugehörige Vorzeichen, wie Plus, Minus, Punkt usw. Der Decoder 54 speist eine Matrix 55, bestehend aus 7 Zeilen und 5 Spalten von Magnetkernen. Die vorgenannten Zeichenleitungen sind mit den Kernen der Matrix in der Weise verbunden, daß bei Aktivierung einer gegebenen Zeichenleitung durch den Decoder 54 alle, und nur solche Kerne, die räumliche Form der Zeichen angeben, die im Zustand 1 vorliegen. Danach wird in der Matrix 55 jedes Zeichen durch eine räumliche Verteilung von 7 · 5 = 35 Bits wiedergegeben.At the time of visual reproduction, the register 51 acts as an input register for the display device; the character present in the register is decoded by a decoder 54 associated with the same Number of output lines (character lines) is formed, how alphabetical characters are present, Decimal digits (10) and associated signs, such as plus, minus, point, etc. The decoder 54 feeds a Matrix 55, consisting of 7 rows and 5 columns of magnetic cores. The aforementioned sign lines are connected to the cores of the matrix in such a way that when a given character line is activated through the decoder 54 all, and only those kernels, which specify the spatial form of the characters which are in state 1 are present. Thereafter, in the matrix 55, each character is represented by a spatial distribution of 7 * 5 = 35 bits reproduced.
Jeder vom Speicher 3 über die Steuerschaltung 23 abgelesene Start eines Zeitberechnungssignals CS veranlaßt einen Zeilenzähler 56, um einen Schritt fortzuschreiten, wobei der Zähler die 7 Zeilen der Matrix wiederholt umlaufend auszählt. Dabei macht der Zähler 56 nach jedem Speicherumlauf einen Schritt vorwärts. Each start of a time calculation signal CS read from the memory 3 via the control circuit 23 causes a line counter 56 to advance one step, the counter repeatedly counting the 7 lines of the matrix in a revolving manner. The counter 56 advances one step after each memory cycle.
Der Zeilenzähler 56 wird durch einen Decoder 57 decodiert, der nacheinander die Zeilen der Kernmatrix aktiviert, wobei jede Zeile für einen kompletten Umlauf des Verzögerungsleitungsspeichers mit Energie versorgt ist, d. h., bis zum nächsten Anlauf der Zeitberechnung CS, bei dem die nächste Zeile aktiviert wird. Jeder Ausgang des Decoders 57 ist mit einer separaten Abfrageleitung mit allen Kernen der betreffenden Zeile verbunden.The line counter 56 is decoded by a decoder 57 which successively activates the lines of the core matrix, each line being supplied with energy for one complete cycle of the delay line memory, that is, until the next start of the time calculation CS, in which the next line is activated. Each output of the decoder 57 is connected to a separate interrogation line with all cores of the relevant row.
Die in den Zustand 1 versetzten Kerne der Matrix 55 geben das im Bitpunkt D1 des Schieberegisters 51The cores of the matrix 55, which have been set to state 1, give this in bit point D 1 of the shift register 51
gegenwärtige Zeichen wieder, wobei dieser Zustand erhalten bleibt, bis der Bitpunkt D 10 unmittelbar folgt und bei dem darauf unmittelbar folgenden Bitpunkt D 1 werden die Kerne der Matrix in den Zustand gebracht, bei dem das im Speicher folgende Zeichen wiedergegeben wird. Wie aus F i g. 1 hervorgeht, wird jede Zeilenleitung der Kernmatrix bei jedem der 256 D 10-Signale wirksam, die während des Speicherumlaufs aufeinanderfolgen, bei dem die vorliegende Zeile durch den Decoder 57 abgefragt wird. Danach werden über die fünf Leseleitungen der Matrix, von denen jede mit allen Kernen einer Reihe verbunden ist, die Inhalte der abgefragten Kernzeilen zu einem Register 59 übertragen, was bei jedem der Ziffernpunkte D10 durchgeführt wird. Auf diese Weise wird während jedes Speicherumlaufs das Register 59 nacheinander mit 256 Gruppen von 5 Bits gefüllt, die eine äquivalente Zahl von horizontalen Abschnitten der Wiedergabe in der Matrix 55 der 256 im Speicher enthaltenen Zeichen darstellen. Ähnlich werden beim nächsten Speicherumlauf in das Register 59 die 256 Gruppen der Bits nacheinander eingegeben, die den nächsten horizontalen Abschnitt der 256 Zeichen darstellen usw. für die verbleibenden Speicherurnläufe bis zum siebten.current characters again, this state being maintained until the bit point D 10 immediately follows and at the bit point D 1 immediately following it, the kernels of the matrix are brought into the state in which the character following in the memory is reproduced. As shown in FIG. 1, each row line of the core matrix takes effect on each of the 256 D 10 signals which follow one another during the memory circulation in which the present row is interrogated by the decoder 57. Thereafter, the contents of the interrogated core lines are transmitted to a register 59 via the five read lines of the matrix, each of which is connected to all cores of a row, which is carried out at each of the digit points D 10. In this way, during each memory circulation, the register 59 is successively filled with 256 groups of 5 bits which represent an equivalent number of horizontal sections of the display in the matrix 55 of the 256 characters contained in the memory. Similarly, on the next memory circulation, the 256 groups of bits are sequentially entered into register 59 which represent the next horizontal portion of the 256 characters, and so on for the remaining memory rotations up to the seventh.
Das Register 59 ist ein Schieberegister, bei dem die Übertragung der Verschiebeimpulse MS während der Bitpunkte D 2 bis D 6 eines jeden Ziffernpunktes die Reihenausgänge auf der Leitung 77 der 5 Bits veranlaßt, daß diese aus dem Register ausgegeben werden, und zwar während des unmittelbar vorangehenden DlO-Bitpunktes. Die auf die Leitung 77 gegebenen Binärsignale steuern direkt die Beleuchtung der Kathodenstrahlröhre 98 der Anzeigeeinrichtung 8.The register 59 is a shift register in which the transmission of the shift pulses MS during the bit points D 2 to D 6 of each digit point causes the row outputs on the line 77 of the 5 bits to be output from the register during the immediately preceding one DlO bit point. The binary signals given on the line 77 directly control the illumination of the cathode ray tube 98 of the display device 8.
Der Bildschirm der Kathodenstrahlröhre (Fig. 2) ist in 8 Bänder RG 1 bis RGS eingeteilt, von denen jedes aus 7 Linien besteht. Jedes Band kann 32 Zeichen aufnehmen, so daß der ganze Bildschirm insgesamt 256 Zeichen enthalten kann gleich den Inhalten in der Verzögerungsleitung 3. In Fig. 2 sind die Linien des ersten Bandes mit L 11 bis L 17 bezeichnet, diejenigen des zweiten Bandes mit L 21 bis L 27 usw., wobei die erste Zahl nach dem Buchstaben L die Zeile und die zweite Zahl die Linie angibt. Der Strahl tastet zunächst die erste Linie L 11 im ersten Band RG 1 ab, dann die erste Linie L 21 im zweiten Band RG 2 usw., wobei die Abtastung von links für jede Linie beginnt. Hat die Abtastung die erste Linie L 81 des achten Bandes RGS beendet, dann beginnt der Strahl die zweite Linie L 12 des ersten Bandes RG1 abzutasten und danach in Reihenfolge alle zweiten Linien, worauf sich das Verfahren in aufeinanderfolgenden Abtastungen kontinuierlich fortsetzt.The screen of the cathode ray tube (Fig. 2) is divided into 8 bands RG 1 to RGS , each of which consists of 7 lines. Each band can hold 32 characters, so that the entire screen can contain a total of 256 characters equal to the contents in delay line 3. In FIG. 2, the lines of the first band are labeled L 11 to L 17, those of the second band L 21 to L 27 etc., where the first number after the letter L indicates the line and the second number indicates the line. The beam first scans the first line L 11 in the first band RG 1, then the first line L 21 in the second band RG 2 and so on, with the scan starting from the left for each line. When the scanning has ended the first line L 81 of the eighth band RGS , the beam begins to scan the second line L 12 of the first band RG 1 and then in sequence all the second lines, whereupon the process continues in successive scans.
Zur Durchführung dieses Abtastverfahrens wird der Strahl über eine Ablenkungsregelschaltung 60 mit einem Zeichenzähler 61 gesteuert, der am Ende jeder Gruppe von 32 Ziffernpunkten das Signal FIRI liefert und nach 256 Ziffernpunkten das Signal FIME Die Abtastung wird bei jedem CS-Signal begonnen, das den Start eines Speicherumlaufs anzeigt. Daraus folgt, daß die Bildschirmabtastung synchron mit dem Datenumlauf im Speicher ist, d. h., vollständig in 7 Speicherumläufen und dann in den folgenden Umläufen jeweils wiederholt. Naturgemäß ist die 7 Speicherumläufen entsprechende Zeit sehr viel geringer als die Dauer der Abbildung auf dem Bildschirm und auf der Netzhaut des Auges. Aus dem vorhergesagten ergibt sich, daß die 256 im Speicher umlaufenden Zeichen in der visuellen Wiedergabe auf dem Bildschirm methodisch angezeigt werden, und zwarTo carry out this scanning method, the beam is controlled by a deflection control circuit 60 with a character counter 61, which delivers the signal FIRI at the end of each group of 32 digit points and the signal FIME after 256 digit points Memory circulation. It follows that the screen scanning is synchronous with the circulation of data in the memory, that is, it is completely repeated in 7 memory circulations and then repeated in each of the following circulations. Naturally, the time corresponding to 7 memory cycles is much less than the duration of the image on the screen and on the retina of the eye. It follows from the foregoing that the 256 characters circulating in memory are methodically displayed in the visual display on the screen
von links nach rechts laufend, sowie oben beginnend und unten endend.running from left to right, starting at the top and ending at the bottom.
Bei der Buchung auf der Tastatur für die Speicherzelle enthält in jedem Fall das letzte gebuchte Zeichen das Bit »i>s«, das das letzte, in den Speicher eingeschriebene Zeichen anzeigt. Auf dem visuell anzeigenden Bildschirm erscheint somit ein Erkennungsvorzeichen in der dem Bit »£>s« entsprechenden Stellung. Wenn der Zähler 56 die siebte Zeile L 7 der Matrix aktiviert und wenn zur selben Zeit die Stufe RU9 das Bit »bs« = 1 beinhaltenWhen booking on the keyboard for the memory cell, the last character booked always contains the bit "i>s", which indicates the last character written in the memory. An identification sign thus appears on the visually displaying screen in the position corresponding to the "£>s" bit. If the counter 56 activates the seventh row L 7 of the matrix and if the stage RU9 contains the bit "bs" = 1 at the same time
würde, dann wurden über das Tor 80 5 Bits = 1 direkt ir das Register 59 eingegeben werden, die im Registei verschoben werden, wobei auf dem Bildschirm eir horizontaler Hilfsstrich erscheint, der die Stellung de: tatsächlich letzten, im Speicher gegenwärtigen Zeichen; anzeigt. Auf diese Weise bietet der Bildschirm eine vollständige visuelle Wiedergabe der Inhalte des Verzögerungsleitungsspeichers, wobei eine genaue Übereinstimmung zwischen der Verzögerungsleitung und dem Bildschirm erreicht wird.then 5 bits = 1 were directly ir the register 59 can be entered, which are moved in the register, with eir on the screen horizontal tick appears indicating the position de: actually the last character currently in the memory; indicates. In this way, the screen offers a complete visual representation of the contents of the Delay line memory, with an exact match between the delay line and the screen is reached.
Hierzu 2 Blatt ZeichnungenFor this purpose 2 sheets of drawings
Claims (3)
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
IT5322267 | 1967-10-03 |
Publications (3)
Publication Number | Publication Date |
---|---|
DE1801381A1 DE1801381A1 (en) | 1969-05-08 |
DE1801381B2 true DE1801381B2 (en) | 1978-03-30 |
DE1801381C3 DE1801381C3 (en) | 1978-11-09 |
Family
ID=11280975
Family Applications (3)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE1801381A Expired DE1801381C3 (en) | 1967-10-03 | 1968-10-02 | Data display device for displaying characters in rows on a screen |
DE19681801382 Pending DE1801382A1 (en) | 1967-10-03 | 1968-10-02 | Data transmission system between a connection device with screen display and a central data processor |
DE19681801377 Pending DE1801377A1 (en) | 1967-10-03 | 1968-10-02 | Device for writing data into a holding memory |
Family Applications After (2)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE19681801382 Pending DE1801382A1 (en) | 1967-10-03 | 1968-10-02 | Data transmission system between a connection device with screen display and a central data processor |
DE19681801377 Pending DE1801377A1 (en) | 1967-10-03 | 1968-10-02 | Device for writing data into a holding memory |
Country Status (3)
Country | Link |
---|---|
US (1) | US3611303A (en) |
DE (3) | DE1801381C3 (en) |
FR (1) | FR1587102A (en) |
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1968
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- 1968-10-02 DE DE1801381A patent/DE1801381C3/en not_active Expired
- 1968-10-02 DE DE19681801382 patent/DE1801382A1/en active Pending
- 1968-10-02 DE DE19681801377 patent/DE1801377A1/en active Pending
- 1968-10-03 US US764709A patent/US3611303A/en not_active Expired - Lifetime
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Publication number | Publication date |
---|---|
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DE1801382A1 (en) | 1969-04-30 |
US3611303A (en) | 1971-10-05 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
C3 | Grant after two publication steps (3rd publication) | ||
8339 | Ceased/non-payment of the annual fee |