DE102021120264A1 - semiconductor device - Google Patents
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Abstract
Eine Halbleitervorrichtung (100) weist auf: einen Kühlkörper (5), eine isolierende Schicht (4), welche sich auf einer oberen Fläche des Kühlkörpers (5) befindet, einen Anschlussrahmen (1), welcher an einer oberen Fläche der isolierenden Schicht (4) befestigt ist, ein Halbleiterelement (2), welches auf einer oberen Fläche des Anschlussrahmens (1) montiert ist, ein Versiegelungsharz (6), welches den Kühlkörper (5) und das Halbleiterelement (2) versiegelt, wobei eine untere Fläche (10) des Kühlkörpers (5) freiliegt. Die untere Fläche (10) des Kühlkörpers (5) weist an einem peripheren Randabschnitt davon einen gestuften Abschnitt (7) auf, welcher in gestufter Weise vertieft ist, wobei der gestufte Abschnitt (7) der unteren Fläche eine Vertiefung (11) aufweist, die nach oben vertieft ist und nicht vom Versiegelungsharz (6) freiliegt, und wobei die obere Fläche des Kühlkörpers (5) eine Vertiefung (12) aufweist, die nach unten vertieft ist.A semiconductor device (100) comprises: a heatsink (5), an insulating layer (4) located on an upper surface of the heatsink (5), a lead frame (1) attached to an upper surface of the insulating layer (4 ) is fixed, a semiconductor element (2) mounted on an upper surface of the lead frame (1), a sealing resin (6) sealing the heat sink (5) and the semiconductor element (2), a lower surface (10) of the heat sink (5) is exposed. The bottom surface (10) of the heat sink (5) has a stepped portion (7) at a peripheral edge portion thereof which is recessed in a stepped manner, the bottom surface stepped portion (7) having a recess (11) which is recessed upward and is not exposed from the sealing resin (6), and wherein the upper surface of the heat sink (5) has a recess (12) which is recessed downward.
Description
Hintergrund der ErfindungBackground of the Invention
Gebiet der Erfindungfield of invention
Die vorliegende Offenbarung betrifft eine Halbleitervorrichtung, welche einen Kühlkörper aufweist.The present disclosure relates to a semiconductor device having a heat sink.
Beschreibung des Standes der TechnikDescription of the prior art
Es existiert eine Halbleitervorrichtung, welche einen Kühlkörper, ein Halbleiterelement, und ein Versiegelungsharz aufweist, welches den Kühlkörper und das Halbleiterelement versiegelt, wobei eine untere Fläche des Kühlkörpers freiliegt. In einer solchen Halbleitervorrichtung weist die untere Fläche des Kühlkörpers einen gestuften Abschnitt auf.There is a semiconductor device that includes a heatsink, a semiconductor element, and a sealing resin that seals the heatsink and the semiconductor element with a lower surface of the heatsink exposed. In such a semiconductor device, the bottom surface of the heat sink has a stepped portion.
Zum Beispiel offenbart die Japanische Patentanmeldungs-Offenlegungs-Nr. 2003-7933 eine Technik zum Aushärten eines Versiegelungsharzes, welches einen gestuften Abschnitt umhüllt, um einen Harzhaken auszubilden, wodurch verhindert wird, dass der Kühlkörper aus dem Versiegelungsharz herausfällt. Der Harzhaken bezieht sich auf eine Struktur des ausgehärteten Harzes, welche an einer Unregelmäßigkeit eines Elements wie ein Haken zum Verhindern eines Herausfallens des Elements hängenbleibt. Der Kühlkörper ist typischerweise aus einem Material ausgebildet, das exzellente Wärmeableitungseigenschaften aufweist, wie AI und Cu.For example, Japanese Patent Application Laid-Open No. 2003-7933 discloses a technique of curing a sealing resin covering a stepped portion to form a resin hook, thereby preventing the heat sink from falling out of the sealing resin. The resin hook refers to a structure of the cured resin which is caught on an irregularity of a member like a hook for preventing the member from falling out. The heatsink is typically formed from a material that has excellent heat dissipation properties, such as Al and Cu.
In einer herkömmlichen Halbleitervorrichtung tritt jedoch wahrscheinlich eine Beanspruchungskonzentration auf, wenn eine thermische Beanspruchung und dergleichen auf eine Ecke des gestuften Abschnitts der unteren Fläche des Kühlkörpers einwirkt, sodass eine Trennung an einer Schnittstelle zwischen dem Versiegelungsharz und dem Kühlkörper auftritt. Falls die Trennung entlang einer Seitenfläche des Kühlkörpers bis zu einer Schnittstelle zwischen dem Kühlkörper und einer isolierenden Schicht fortschreitet, welche sich auf einer oberen Fläche des Kühlkörpers befindet, können sich Isolationseigenschaften der Halbleitervorrichtung verschlechtern.However, in a conventional semiconductor device, stress concentration is likely to occur when thermal stress and the like acts on a corner of the stepped portion of the lower surface of the heatsink, so that separation occurs at an interface between the sealing resin and the heatsink. If the separation progresses along a side surface of the heatsink to an interface between the heatsink and an insulating layer located on a top surface of the heatsink, insulating properties of the semiconductor device may deteriorate.
ZusammenfassungSummary
Es ist eine Aufgabe der vorliegenden Offenbarung in einer Halbleitervorrichtung, welche einen Kühlkörper aufweist, eine Technik bereitzustellen, die eine Unterdrückung eines Fortschreitens einer Trennung an einer Schnittstelle zwischen einem Versiegelungsharz und dem Kühlkörper bis zu einer Schnittstelle zwischen dem Kühlkörper und einer isolierenden Schicht ermöglicht, welche auf einer oberen Fläche des Kühlkörpers angeordnet ist.It is an object of the present disclosure, in a semiconductor device having a heatsink, to provide a technique that enables suppression of propagation of separation at an interface between a sealing resin and the heatsink to an interface between the heatsink and an insulating layer, which is arranged on a top surface of the heat sink.
Eine Halbleitervorrichtung gemäß der vorliegenden Offenbarung weist einen Kühlkörper, eine isolierende Schicht, einen Anschlussrahmen, ein Halbleiterelement, und ein Versiegelungsharz auf. Die isolierende Schicht befindet sich auf einer oberen Fläche des Kühlkörpers. Der Anschlussrahmen ist an einer oberen Fläche der isolierenden Schicht befestigt. Das Halbleiterelement ist auf einer oberen Fläche de Anschlussrahmens montiert. Das Versiegelungsharz versiegelt den Kühlkörper und das Halbleiterelement, wobei eine untere Fläche des Kühlkörpers freiliegt. Die untere Fläche des Kühlkörpers weist an einem peripheren Randabschnitt davon einen gestuften Abschnitt der unteren Fläche auf, welcher in gestufter Weise vertieft ist. Der gestufte Abschnitt der unteren Fläche weist eine erste Vertiefung auf, die nach oben vertieft ist und nicht vom Versiegelungsharz freiliegt. Die obere Fläche des Kühlkörpers weist eine zweite Vertiefung auf, die nach unten vertieft ist.A semiconductor device according to the present disclosure includes a heat sink, an insulating layer, a lead frame, a semiconductor element, and a sealing resin. The insulating layer is on a top surface of the heatsink. The lead frame is attached to a top surface of the insulating layer. The semiconductor element is mounted on a top surface of the lead frame. The sealing resin seals the heat sink and the semiconductor element with a lower surface of the heat sink being exposed. The bottom surface of the heat sink has, at a peripheral edge portion thereof, a bottom surface stepped portion which is recessed in a stepped manner. The stepped portion of the bottom surface has a first indentation which is recessed upward and is not exposed from the sealing resin. The top surface of the heatsink has a second indentation that is recessed downward.
Das Versiegelungsharz, mit welchen die erste Vertiefung gefüllt wird, kann ein übermäßiges Verziehen des Kühlkörpers bei einer hohen Temperatur unterdrücken, so dass ein Fortschreiten einer Trennung an der Schnittstelle zwischen dem Versiegelungsharz und dem Kühlkörper ausgehend von einer Ecke der unteren Fläche des gestuften Abschnitts unterdrückt werden kann. Fall darüber hinaus die Trennung an der Schnittstelle zwischen dem Versiegelungsharz und dem Kühlkörper fortschreitet, kann die zweite Vertiefung das Fortschreiten der Trennung an der Schnittstelle zwischen dem Versiegelungsharz und dem Kühlkörper bis zur Schnittstelle zwischen der isolierenden Schicht und dem Kühlkörper unterbinden.The sealing resin with which the first recess is filled can suppress excessive warping of the heatsink at a high temperature, so that progress of separation at the interface between the sealing resin and the heatsink from a corner of the bottom surface of the stepped portion can be suppressed can. In addition, if the separation progresses at the interface between the sealing resin and the heatsink, the second recess can suppress the progress of separation at the interface between the sealing resin and the heatsink to the interface between the insulating layer and the heatsink.
Diese und weitere Aufgaben, Merkmale, Aspekte und Vorteile der vorliegenden Erfindung werden anhand der nachfolgenden detaillierten Beschreibung der vorliegenden Erfindung in Verbindung mit den begleitenden Figuren deutlicher.These and other objects, features, aspects and advantages of the present invention will become more apparent from the following detailed description of the present invention in conjunction with the accompanying figures.
Figurenlistecharacter list
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1 ist eine Querschnittsansicht einer Halbleitervorrichtung gemäß Ausführungsform 1.1 13 is a cross-sectional view of a semiconductor device according toEmbodiment 1. -
2 ist eine Unteransicht eines Kühlkörpers der Halbleitervorrichtung gemäß Ausführungsform 1.2 12 is a bottom view of a heat sink of the semiconductor device according toEmbodiment 1. -
3 ist eine Unteransicht eines Kühlkörpers einer Halbleitervorrichtung gemäß Ausführungsform 2.3 14 is a bottom view of a heat sink of a semiconductor device according toEmbodiment 2. -
4 ist eine Unteransicht eines Kühlkörpers einer Halbleitervorrichtung gemäß einer Modifikation 1 von Ausführungsform 2.4 14 is a bottom view of a heat sink of a semiconductor device according toModification 1 ofEmbodiment 2. -
5 ist eine Unteransicht eines Kühlkörpers einer Halbleitervorrichtung gemäß einer Modifikation 2 von Ausführungsform 2.5 14 is a bottom view of a heat sink of a semiconductor device according toModification 2 ofEmbodiment 2. -
6 ist eine vergrößerte Querschnittsansicht einer Halbleitervorrichtung gemäß Ausführungsform 3.6 14 is an enlarged cross-sectional view of a semiconductor device according toEmbodiment 3. -
7 ist eine Querschnittsansicht, welche ein Verziehen einer Halbleitervorrichtung veranschaulicht, wenn ein gestufter Abschnitt der unteren Fläche keine Vertiefung aufweist.7 14 is a cross-sectional view illustrating warping of a semiconductor device when a stepped portion of the bottom surface has no recess.
Beschreibung der bevorzugten AusführungsformenDescription of the Preferred Embodiments
<Ausführungsform 1 ><
Ausführungsform 1 wird nachfolgend mit Bezug zu den Figuren beschrieben.
Wie in
Der Kühlkörper 5 ist aus einem Material ausgebildet, welches exzellente Wärmeableitungseigenschaften aufweist, wie AI und Cu. Die isolierende Schicht 4 befindet sich über einer oberen Fläche des Kühlkörpers 5. Die Anschlussrahmen 1 sind an einer oberen Fläche der isolierenden Schicht 4 befestigt. Die Halbleiterelemente 2 sind an oberen Flächen des Anschlussrahmens 1 mittels Verbindungsmaterialien 3 wie Lot befestigt. Die Halbleiterelemente 2 sind am Anschlussrahmen 1 oder an anderen Halbleiterelementen 2 mittels Metalldrähten 14 verbunden.The
Das Versiegelungsharz 6 versiegelt den Kühlkörper 5 und die Halbleiterelemente 2, wobei eine untere Fläche 10 des Kühlkörpers 5 freiliegt. Die isolierende Schicht 4 und das Versiegelungsharz 6 sind aus einem Harz mit exzellenten Isolationseigenschaften ausgebildet wie einem Epoxidharz und einem Phenolharz, und Additiven.The
Die Struktur des Kühlkörpers 5 wird als Nächstes beschrieben. Wie in den
Der gestufte Abschnitt (7) der unteren Fläche weist in einem äußeren peripheren Abschnitt davon eine nutähnliche Vertiefung (11) als eine erste Vertiefung auf, die aufwärts vertieft ist und entlang des äußeren peripheren Abschnitts durchgehend angeordnet ist.The lower surface stepped portion (7) has, in an outer peripheral portion thereof, a groove-like indentation (11) as a first indentation which is indented upward and is continuous along the outer peripheral portion.
Die Vertiefung 11 ist mit dem Versiegelungsharz 6 gefüllt, und liegt nicht vom Versiegelungsharz 6 frei. Der gestufte Abschnitt 7 der unteren Fläche weist die Vertiefung 11 im äußeren peripheren Abschnitt davon auf, das heißt, um eine Ecke davon herum, so dass das Versiegelungsharz 6, mittels welchem die Vertiefung 11 gefüllt ist, das Verziehen des Kühlkörpers 5 bei einer hohen Temperatur unterbinden kann. Ein Fortschreiten einer Trennung an einer Schnittstelle zwischen dem Versiegelungsharz 6 und dem Kühlkörper 5 kann dadurch unterbunden werden.The
Die Vertiefung 11 wird mittels Stanzen ausgebildet. Wenn die Vertiefung 11 mittels Stanzen ausgebildet wird, wird der äußere periphere Abschnitt des gestuften Abschnitts 7 der unteren Fläche gestanzt, so dass eine Seitenfläche 9 um den gestanzten Abschnitt herum sich vorwölbend plastisch verformt. Die an der Ecke des gestuften Abschnitts 7 der unteren Fläche verursachte Trennung schreitet wahrscheinlich entlang der Seitenfläche 9 fort, wenn die Seitenfläche 9 glatt ist, aber in Ausführungsform 1 ist es weniger wahrscheinlich, dass die Trennung fortschreitet, da die Seitenfläche 9 deformiert ist.The
Die obere Fläche des Kühlkörpers 5 weist eine nutähnliche Vertiefung 12 als eine zweite Vertiefung auf, die nach unten vertieft ist und entlang eines äußeren peripheren Abschnitts der oberen Fläche durchgehend angeordnet ist. Ein Abschnitt der isolierenden Schicht 4, welcher der Vertiefung 12 gegenüberliegt, ragt nach unten hervor, um in die Vertiefung 12 einzugreifen. Die obere Fläche des Kühlkörpers 5 weist die Vertiefung 12 auf, so dass ein Fortschreiten der Trennung an der Schnittstelle zwischen dem Versiegelungsharz 6 und dem Kühlkörper 5 bis zur isolierenden Schicht 4 unterbunden werden kann. Das heißt, das Fortschreiten der Trennung an der Schnittstelle zwischen dem Versiegelungsharz 6 und dem Kühlkörper 5 bis zur isolierenden Schicht 4 kann unterbunden werden, bevor die Trennung an der Schnittstelle zwischen dem Versiegelungsharz 6 und dem Kühlkörper 5 entlang der Seitenfläche 9 des Kühlkörpers 5 fortschreitet, was zu der Trennung an der Schnittstelle zwischen der isolierenden Schicht 4 und dem Kühlkörper 5 führt.The top surface of the
Die Vertiefung 12 kann eine Vertiefung sein, die nicht durchgehend angeordnet ist, stattdessen kann sie eine Vielzahl von Vertiefungen sein, die mit Unterbrechungen angeordnet sind. Es wird ein hinsichtlich des Unterdrückens der Trennung ein stärkerer Effekt erreicht, wenn die Vertiefung 12 im äußeren peripheren Abschnitt der oberen Fläche des Kühlkörpers 5 angeordnet ist, als wenn die Vertiefung 12 in der Mitte der oberen Fläche des Kühlkörpers 5 angeordnet ist.The
Der Effekt der Halbleitervorrichtung 100 wird als Nächstes durch einen Vergleich mit einem Fall beschrieben, in welchem der gestufte Abschnitt 7 der unteren Fläche die Vertiefung 11 nicht aufweist.
Der Kühlkörper 5 weist typischerweise einen größeren linearen Wärmeausdehnungskoeffizienten auf, als das Versiegelungsharz 6, und daher verzieht sich die Halbleitervorrichtung 101 bei einer hohen Temperatur im Ganzen derart, dass die untere Fläche 10 des Kühlkörpers 5 wie in
Im Gegensatz dazu weist die Halbleitervorrichtung 100 gemäß Ausführungsform 1 auf: den Kühlkörper 5, die isolierende Schicht 4, welche sich auf der oberen Fläche des Kühlkörpers 5 befindet, die Anschlussrahmen 1, welche an der oberen Fläche der isolierenden Schicht 4 befestigt sind, die Halbleiterelemente 2, welche auf den oberen Flächen der Anschlussrahmen 1 montiert sind, und das Versiegelungsharz 6, welches den Kühlkörper 5 und die Halbleiterelemente 2 versiegelt, wobei die untere Fläche 10 des Kühlkörpers 5 freiliegt, wobei die untere Fläche 10 des Kühlkörpers 5 am peripheren Randabschnitt davon den gestuften Abschnitt 7 aufweist, der in gestufter Weise vertieft ist, wobei der gestufte Abschnitt 7 der unteren Fläche die Vertiefung 11 aufweist, welche nach oben vertieft ist und nicht vom Versiegelungsharz 6 freiliegt, und wobei die obere Fläche des Kühlkörpers 5 die Vertiefung 12 aufweist, die nach unten vertieft ist.In contrast, the
Folglich kann das Versiegelungsharz 6, mit welchem die Vertiefung 11 gefüllt ist, ein übermäßiges Verziehen des Kühlkörpers 5 bei der hohen Temperatur unterbinden, sodass das Fortschreiten der Trennung an der Schnittstelle zwischen dem Versiegelungsharz 6 und dem Kühlkörper 5 ausgehend von der Ecke des gestuften Abschnitts 7 der unteren Fläche unterbunden werden kann. Falls die Trennung an der Schnittstelle zwischen dem Versiegelungsharz 6 und dem Kühlkörper 5 fortschreitet, kann die Vertiefung 12 ferner das Fortschreiten der Trennung an der Schnittstelle zwischen dem Versiegelungsharz 6 und dem Kühlkörper 5 bis zur Schnittstelle zwischen der isolierenden Schicht 4 und dem Kühlkörper 5 unterbinden. Die ermöglicht eine Langzeitverwendung der Halbleitervorrichtung 100.Consequently, the sealing
Der Effekt der Unterdrückung des Fortschreitens der Trennung nimmt zu, da sich die Vertiefung 12 in dem äußeren peripheren Abschnitt der oberen Fläche des Kühlkörpers 5 befindet.The effect of suppressing the progress of disconnection increases because the
Die Trennung im äußeren peripheren Abschnitt des gestuften Abschnitts 7 der unteren Fläche kann im Ganzen unterdrückt werden, da die Vertiefung 11 entlang des äußeren peripheren Abschnitts des gestuften Abschnitts 7 der unteren Fläche angeordnet ist.The separation in the outer peripheral portion of the lower surface stepped
<Ausführungsform 2><
Die Halbleitervorrichtung 100 gemäß Ausführungsform 2 wird als Nächstes beschrieben.
Wie in
Wie in
Wie in
Wie oben beschrieben, ist die Vertiefung 11 in Ausführungsform 2 durchgehend angeordnet, so dass eine Prozessierungseffizienz beim Ausbilden der Vertiefung 11 im Vergleich zu jener in Ausführungsform 1 verbessert werden kann, während der Effekt der Unterdrückung des Fortschreitens der Trennung erreicht wird.As described above, in
<Ausführungsform 3><
Die Halbleitervorrichtung 100 gemäß Ausführungsform 3 wird als Nächstes beschrieben.
Wie in
Wie oben beschrieben, weist die Seitenfläche 9 des Kühlkörpers 5 die Vertiefung 13 in Ausführungsform 3 auf, so dass ein Fortschreiten einer Trennung, welche ausgehend von der Ecke des gestuften Abschnitts 7 der unteren Fläche entlang der Seitenfläche 9 verursacht wird, unterdrückt werden kann. Ein Fortschreiten der Trennung bis zur Schnittstelle zwischen der isolierenden Schicht 4 und dem Kühlkörper 5 kann dadurch unterbunden werden.As described above, the
Die obere Fläche des Kühlkörpers 5 kann ebenfalls die Vertiefung 12 in Ausführungsform 3 aufweisen. Das Fortschreiten der Trennung bis zur Schnittstelle der isolierenden Schicht 4 und des Kühlkörpers 5 kann dadurch unterbunden werden im Vergleich zu einem Fall, in dem die Vertiefung 12 nicht bereitgestellt ist.The top surface of the
Ausführungsformen können frei miteinander kombiniert werden, und können in geeigneter Weise modifiziert oder ausgelassen werden.Embodiments can be freely combined with each other, and can be modified or omitted as appropriate.
Während die Erfindung im Detail gezeigt und beschrieben wurde, ist die vorstehende Beschreibung in allen Aspekten veranschaulichend und nicht einschränkend. Es versteht sich daher, dass zahlreiche Modifikation und Variationen erdacht werden können, ohne vom Schutzbereich der Erfindung abzuweichen.While the invention has been shown and described in detail, the foregoing description is in all aspects illustrative and not restrictive. It is therefore understood that numerous modifications and variations can be devised without departing from the scope of the invention.
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Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5041902A (en) | 1989-12-14 | 1991-08-20 | Motorola, Inc. | Molded electronic package with compression structures |
WO1996027903A1 (en) | 1995-03-06 | 1996-09-12 | National Semiconductor Corporation | Heat sink for integrated circuit packages |
US6159764A (en) | 1997-07-02 | 2000-12-12 | Micron Technology, Inc. | Varied-thickness heat sink for integrated circuit (IC) packages and method of fabricating IC packages |
US20080048304A1 (en) | 2006-08-22 | 2008-02-28 | Advanced Semiconductor Engineering, Inc. | Heat slug for package structure |
Family Cites Families (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2001035985A (en) | 1999-07-19 | 2001-02-09 | Denso Corp | Semiconductor device sealed with resin |
JP5153684B2 (en) | 2009-02-27 | 2013-02-27 | 三菱電機株式会社 | Semiconductor device and manufacturing method of semiconductor device |
JP5593864B2 (en) | 2010-06-10 | 2014-09-24 | トヨタ自動車株式会社 | Semiconductor device cooler |
CN104137253A (en) | 2012-02-24 | 2014-11-05 | 三菱电机株式会社 | Semiconductor device and method for manufaturing same |
DE112012006656B4 (en) | 2012-07-05 | 2021-08-05 | Mitsubishi Electric Corporation | Semiconductor device |
-
2020
- 2020-09-09 JP JP2020151004A patent/JP7407679B2/en active Active
-
2021
- 2021-08-04 DE DE102021120264.7A patent/DE102021120264A1/en active Granted
- 2021-09-03 CN CN202111031125.7A patent/CN114242666A/en active Pending
Patent Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5041902A (en) | 1989-12-14 | 1991-08-20 | Motorola, Inc. | Molded electronic package with compression structures |
WO1996027903A1 (en) | 1995-03-06 | 1996-09-12 | National Semiconductor Corporation | Heat sink for integrated circuit packages |
US6159764A (en) | 1997-07-02 | 2000-12-12 | Micron Technology, Inc. | Varied-thickness heat sink for integrated circuit (IC) packages and method of fabricating IC packages |
US20080048304A1 (en) | 2006-08-22 | 2008-02-28 | Advanced Semiconductor Engineering, Inc. | Heat slug for package structure |
Also Published As
Publication number | Publication date |
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