DE102011054399A1 - Electronic control unit for use in electrical servo steering device to support vehicle steering operation, has CPU testing whether bit corresponds to bus lines to be tested and bit of other lines maintain different values from each other - Google Patents
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Abstract
Description
Die vorliegende Erfindung bezieht sich auf eine elektronische Steuereinheit, die eine zentrale Verarbeitungseinheit und Speicher, die durch einen Adressbus und einen Datenbus mit der zentralen Verarbeitungseinheit verbunden sind, aufweist, ein elektronisches Steuerverfahren und eine elektrische Servolenkvorrichtung, die die elektronische Steuereinheit verwendet.The present invention relates to an electronic control unit having a central processing unit and memories connected to the central processing unit through an address bus and a data bus, an electronic control method, and an electric power steering apparatus using the electronic control unit.
Eine herkömmliche elektronische Steuereinheit (ECU; ECU = electronic control unit) hat eine zentrale Verarbeitungseinheit (CPU; CPU = central processing unit), Speicher, wie zum Beispiel einen ROM und einen RAM, einen Adressbus und einen Datenbus und erfasst eine Verbindung des Adressbusses oder des Datenbusses mit Masse oder einer Leistungsversorgungsleitung und ein anderes Kurzschließen. Eine elektronische Steuereinheit, die beispielsweise in der
Die Zahl der Bit des Prüfwerts entspricht der Zahl der Busleitungen des Adressbusses oder des Datenbusses, der zu prüfen ist. Wenn beispielsweise die Zahl der Busleitungen 4 ist, wird ein Prüfwert von 4 oder mehr Bit verwendet. Es sei bemerkt, dass eine fehlerhafte Verbindung der Busleitung mit der Masse ein Fehler bedeutet, bei dem ein Bitwert fest auf „0” eingestellt ist, obwohl derselbe „1” sein sollte. Es sei ferner bemerkt, dass eine fehlerhafte Verbindung der Busleitung mit der Leistungsversorgungsleitung ein Fehler bedeutet, bei dem ein Bitwert fest auf „1” eingestellt ist, obwohl derselbe „0” sein sollte. Es sei ferner bemerkt, dass ein Kurzschließen der Busleitung ein Fehler bedeutet, bei dem ein Bitwert der untersuchten Busleitung auf den gleichen Bitwert der anderen Busleitungen eingestellt ist, das heißt, bei dem die Busleitungen keine zueinander unterschiedlichen Bitwerte aufrechterhalten können.The number of bits of the test value corresponds to the number of bus lines of the address bus or data bus to be tested. For example, if the number of bus lines is 4, a check value of 4 or more bits is used. It should be noted that an erroneous connection of the bus line to the ground means an error in which a bit value is fixed to "0", although it should be "1". It should be further noted that a faulty connection of the bus line to the power supply line means an error in which a bit value is fixed to "1" although it should be "0". It is further noted that shorting the bus line means an error in which one bit value of the bus line under test is set to the same bit value of the other bus lines, that is, the bus lines can not maintain mutually different bit values.
Gemäß der elektronischen Steuervorrichtung, auf die im Vorhergehenden Bezug genommen ist, sind beispielsweise „0001” und „1110” als die Prüfwerte zum Erfassen der fehlerhaften Verbindung mit der Leistungsversorgungsleitung bzw. der fehlerhaften Verbindung mit Masse verwendet, wenn der Adressbus oder der Datenbus, die zu untersuchen sind, vier Bit hat. Eine solche fehlerhafte Verbindung kann durch Prüfen bestimmt werden, ob der Wert jedes Bit nicht auf „1” und „0” fixiert ist. Es ist jedoch notwendig, 4 Prüfwerte, beispielsweise „0001”, „0010”, „0100” und „1000”, zu verwenden, um den Kurzschlussfehler zu erfassen.For example, according to the electronic control apparatus referred to above, "0001" and "1110" are used as the check values for detecting the erroneous connection to the power supply line and the erroneous connection to ground, respectively, when the address bus or the data bus to examine, it has four bits. Such a faulty connection can be determined by checking whether the value of each bit is not fixed to "1" and "0". However, it is necessary to use 4 test values, for example "0001", "0010", "0100" and "1000", to detect the short circuit fault.
Es ist somit notwendig, die gleiche oder eine größere Zahl von Prüfwerten wie oder als die Zahl von Busleitungen zu verwenden, um den Kurzschlussfehler zu erfassen. Ein Minimum von 32 Werten muss beispielsweise zum Prüfen des Adressbusses mit 32 Bit wiedergewonnen werden. Ein Minimum von 32 Malen eines Schreibens und Wiedergewinnens muss zum Prüfen des Datenbusses mit 32 Bit durchgeführt werden. 128 Male an Prüfungen werden ähnlicherweise für den Bus mit 128 Bit benötigt. Da sich somit die Zahl von Prüfungen im Verhältnis zu der Zahl von Bit erhöht, wird die elektronische Steuereinheit mit einer stärkeren Verarbeitung belastet.It is thus necessary to use the same or a larger number of check values as or as the number of bus lines to detect the short circuit fault. For example, a minimum of 32 values must be retrieved to check the 32-bit address bus. A minimum of 32 times of writing and retrieving must be done to check the data bus with 32 bits. 128 times of tests are similarly needed for the 128-bit bus. Thus, as the number of tests increases in proportion to the number of bits, the electronic control unit is burdened with more processing.
Gemäß der elektronischen Steuereinheit, auf die im Vorhergehenden Bezug genommen ist, ist die Prüfsumme verwendet, um in dem Adressbus einen Fehler zu erfassen. Die Prüfsumme ist verwendet, um die elektronische Steuereinheit davon zu befreien, in dem Fall einer Erhöhung der Zahl von Prüfungen durch Prüfen eines Gesamtwerts (einer Prüfsumme) von einzelnen Werten und nicht Prüfen von einzelnen Werten schwer belastet zu sein. Gemäß dem Verfahren eines Verwendens einer Prüfsumme wird der Fehler nicht bestimmt werden, wenn Werte der gleichen Bit der Werte von einer Adresse wiedergewonnen werden und von der anderen Adresse wiedergewonnen werden. Es sei beispielsweise angenommen, dass ein Wert, der von einer Adresse „0001” wiedergewonnen wird, „00101010” ist, und ein Wert, der von der anderen Adresse „0010” wiedergewonnen wird, „11010101” ist, wobei der logische Pegel jedes Bit zu demselben von „00101010” umgekehrt bzw. entgegengesetzt ist. Aufgrund eines Fehlers in dem Adressbus wird der Wert, der von der Adresse „0001” wiedergewonnen wird, „00101000”, und der Wert, der von der Adresse „0010” wiedergewonnen wird, wird „11010111”, das heißt „0” und „1” in dem ersten Bit der zweiten Ziffer einer hexadezimalen Zahl werden ausgetauscht, wobei die Prüfsummenwerte gleich sind, unabhängig davon, ob der Fehler anwesend ist oder nicht. Es ist daher nicht möglich, einen Fehler zu erfassen.According to the electronic control unit referred to above, the checksum is used to detect an error in the address bus. The checksum is used to free the electronic control unit from being heavily loaded in the event of an increase in the number of checks by checking a total value (a checksum) of individual values rather than checking individual values. According to the method of using a checksum, the error will not be determined if values of the same bits of the values are retrieved from one address and retrieved from the other address. For example, assume that a value retrieved from an address "0001" is "00101010" and a value retrieved from the other address "0010" is "11010101", the logical level of each bit to the same of "00101010" is reversed or opposite. Due to an error in the address bus, the value retrieved from the address "0001" becomes "00101000", and the value retrieved from the address "0010" becomes "11010111", that is, "0" and " 1 "in the first bit of the second digit of a hexadecimal number are exchanged, and the checksum values are the same regardless of whether the error is present or not. It is therefore not possible to detect an error.
Eine Aufgabe der vorliegenden Erfindung besteht daher darin, eine elektronische Steuereinheit zu schaffen, die einen Fehler in einem Adressbus und einem Datenbus mit einer reduzierten Zahl von Prüfwerten, die für einen Fehlerprüfungsbetrieb erforderlich sind, erfasst.It is therefore an object of the present invention to provide an electronic control unit which detects an error in an address bus and a data bus having a reduced number of Test values required for error checking operation are recorded.
Gemäß der vorliegenden Erfindung weist eine elektronische Steuereinheit eine CPU, einen ROM, einen RAM und einen Adressbus und einen Datenbus, der die CPU mit dem ROM und dem RAM verbindet, auf.According to the present invention, an electronic control unit includes a CPU, a ROM, a RAM and an address bus, and a data bus connecting the CPU with the ROM and the RAM.
Bei einem ersten Aspekt berechnet die CPU basierend auf Werten, die von dem ROM, der durch eine Mehrzahl von Adressbusprüfadressen, die einer Adressbusprüfung dienen, adressiert wird, wiedergewonnen werden, einen Prüfwert, vergleicht einen berechneten Prüfwert mit einem korrekten Wert, der einer Adressbusprüfung dient, und bestimmt einen Adressbusfehler, wenn der berechnete Prüfwert und der korrekte Wert nicht übereinstimmen. Die Mehrzahl von Adressbusprüfadressen ist ein Wert mit mindestens 4 Bit, der den mindestens 4 Busleitungen entspricht und „0” in mindestens 2 Bit sowie „1” in mindestens 2 Bit aufweist. Die CPU prüft, ob Bit, die zu prüfenden Busleitungen entsprechen, und Bit von anderen Busleitungen voneinander unterschiedliche Werte aufrechterhalten, um dadurch zwischen der Mehrzahl von Busleitungen Kurzschlussfehler gleichzeitig zu erfassen.In a first aspect, the CPU calculates a check value based on values retrieved from the ROM addressed by a plurality of address bus check addresses that are for address bus testing, and compares a computed check value to a correct value that serves an address bus check , and determines an address bus error if the calculated check value and the correct value do not match. The plurality of address bus check addresses is a value of at least 4 bits corresponding to the at least 4 bus lines and having "0" in at least 2 bits and "1" in at least 2 bits. The CPU checks whether bits corresponding to bus lines to be tested and bits of other bus lines keep different values from each other, thereby simultaneously detecting short circuit errors among the plurality of bus lines.
Bei einem zweiten Aspekt berechnet die CPU basierend auf einer Mehrzahl von Werten, die von dem ROM wiedergewonnen werden, einen Prüfwert, vergleicht einen berechneten Prüfwert mit einem korrekten Wert, der für eine Datenbusprüfung vorberechnet wird, und bestimmt einen Datenbusfehler, wenn der berechnete Prüfwert und der korrekte Wert nicht übereinstimmen. Die Mehrzahl von Datenbusprüfwerten ist ein Wert mit mindestens 4 Bit, die den mindestens vier Busleitungen entsprechen und „0” in mindestens 2 Bit sowie „1” in mindestens 2 Bit aufweisen. Die CPU prüft, ob die Bit, die zu prüfenden Busleitungen entsprechen, und die Bit von anderen Busleitungen voneinander unterschiedliche Werte aufrechterhalten, um dadurch zwischen der Mehrzahl von Busleitungen Kurzschlussfehler gleichzeitig zu erfassen.In a second aspect, based on a plurality of values retrieved from the ROM, the CPU calculates a check value, compares a calculated check value with a correct value precalculated for a data bus check, and determines a data bus error when the calculated check value and the correct value do not match. The plurality of data bus check values is a value of at least 4 bits corresponding to the at least four bus lines and having "0" in at least 2 bits and "1" in at least 2 bits. The CPU checks whether the bits corresponding to bus lines to be tested and the bits of other bus lines keep different values from each other, thereby simultaneously detecting short circuit errors among the plurality of bus lines.
Bei einem dritten Aspekt schreibt die CPU eine Mehrzahl von Datenbusprüfwerten in einen Datenbusprüfbereich des RAM, gewinnt eine Mehrzahl von Datenbusprüfwerten von dem gleichen Datenbusprüfbereich wieder, vergleicht wiedergewonnene Datenbusprüfwerte mit geschriebenen Datenbusprüfwerten und bestimmt einen Datenbusfehler, wenn die verglichenen Datenbusprüfwerte nicht übereinstimmen. Die Mehrzahl von Datenbusprüfwerten ist ein Wert mit mindestens 4 Bit, die den mindestens 4 Busleitungen entsprechen und „0” in mindestens 2 Bit sowie „1” in mindestens 2 Bit aufweisen. Die CPU prüft, ob Bit, die zu prüfenden Busleitungen entsprechen, und Bit anderer Busleitungen voneinander unterschiedliche Werte aufrechterhalten, um dadurch zwischen der Mehrzahl von Busleitungen Kurzschlussfehler gleichzeitig zu erfassen.In a third aspect, the CPU writes a plurality of data bus check values to a data bus check area of the RAM, retrieves a plurality of data bus check values from the same data bus check area, compares recovered data bus check values with written data bus check values, and determines a data bus error if the compared data bus check values do not match. The plurality of data bus check values is a value of at least 4 bits corresponding to the at least 4 bus lines and having "0" in at least 2 bits and "1" in at least 2 bits. The CPU checks whether bits corresponding to bus lines to be tested and bits of other bus lines keep different values from each other, thereby simultaneously detecting short circuit errors among the plurality of bus lines.
Bei jedem Aspekt sind jeweils die Mehrzahl von Adressbusprüfadressen oder die Mehrzahl von Datenbusprüfwerten ein Wert von N Bit, der den N Busleitungen entspricht und „0” in N/2 Bit sowie „1” in N/2 Bit aufweist.In each aspect, each of the plurality of address bus check addresses or the plurality of data bus check values is a value of N bits corresponding to the N bus lines and having "0" in N / 2 bits and "1" in N / 2 bits.
Die vorhergehenden und andere Aufgaben, Merkmale und Vorteile der vorliegenden Erfindung sind aus der folgenden detaillierten Beschreibung, die unter Bezugnahme auf die beigefügten Zeichnungen vorgenommen ist, offensichtlicher. Es zeigen:The foregoing and other objects, features and advantages of the present invention will become more apparent from the following detailed description made with reference to the accompanying drawings. Show it:
Eine elektronische Steuereinheit (ECU) gemäß der vorliegenden Erfindung ist im Detail im Folgenden unter Bezugnahme auf Ausführungsbeispiele beschrieben, bei denen die ECU in einer elektrischen Servolenkvorrichtung zum Unterstützen eines Lenkbetriebs eines Fahrzeugs enthalten ist.An electronic control unit (ECU) according to the present invention will be described in detail below with reference to embodiments in which the ECU is included in an electric power steering apparatus for assisting a steering operation of a vehicle.
Bezug nehmend auf
Wenn ein Fahrer das Lenkrad
Die elektrische Servolenkvorrichtung
Wie in
Die I/O
Der Adressbus
Die ECU
Bezug nehmend auf ein Flussdiagramm, das in
Bei S13 wird der Prüfwert Vj mit einem korrekten Wert Vt verglichen, der für eine Adressbusprüfung geliefert und vorberechnet wird, um dadurch zu prüfen, ob der Prüfwert Vj und der korrekte Wert Vt übereinstimmen oder gleich sind. Wenn sich bei S13 JA ergibt, wird bei S14 bestimmt, dass der Adressbus
Wenn ein Fehler in dem Adressbus
Bezug nehmend auf
Wenn ein Fehler in dem Datenbus
Das vorliegende Ausführungsbeispiel ist durch eine Bedingung einer Auswahl der Prüfadresse Ad für eine Adressbusprüfung oder des Prüfwerts Md für eine Datenbusprüfung charakterisiert. Sowohl die Prüfadresse Ad als auch der Prüfwert Md werden eine Mehrzahl von Malen in Entsprechung zu der Zahl der Busleitungen, die zu prüfen sind, geliefert.The present embodiment is characterized by a condition of selecting the check address Ad for an address bus check or the check value Md for a data bus check. Both the test address Ad and the test value Md are supplied a plurality of times in accordance with the number of bus lines to be tested.
Die Prüfadresse Ad zum Erfassen eines Fehlers in dem Adressbus
Der Busleitungsfehler entsteht bei drei Fehlerarten (1) bis (3).The bus line error occurs with three error types (1) to (3).
(1) Fehler einer fixierten 0(1) Error of a fixed 0
Bei dieser Fehlerart ist ein Wert eines Bit, das einer Busleitung entspricht, auf „0” fixiert, obwohl derselbe „1” sein sollte. Dieser Fehler entsteht, wenn die Busleitung mit Masse verbunden ist, oder bei einer Trennung der Busleitung, wodurch der Wert des Bit „0” wird.In this type of error, a value of one bit corresponding to one bus line is fixed at "0" although it should be "1". This error occurs when the bus line is connected to ground, or when the bus line is disconnected, causing the value of the bit to become "0".
(2) Fehler einer fixierten 1(2) Error of a fixed 1
Bei dieser Fehlerart ist ein Wert eines Bit, das einer Busleitung entspricht, auf „1” fixiert, obwohl derselbe „0” sein sollte. Dieser Fehler entsteht, wenn die Busleitung mit einer Leistungsversorgungsleistung verbunden ist, oder bei einer Trennung der Busleitung, wodurch der Wert des Bit „1” wird.In this type of error, a value of one bit corresponding to one bus line is fixed at "1" although it should be "0". This error occurs when the bus line is connected to a power supply power or when the bus line is disconnected, causing the value of the bit to become "1".
(3) Kurzschlussfehler(3) Short-circuit fault
Bei dieser Fehlerart wird ein Wert eines Bit, das einer Busleitung entspricht, gleich einem Wert eines Bit, das der anderen Busleitung entspricht, das heißt zwischen zwei Busleitungen werden keine unterschiedlichen Werte aufrechterhalten. Dieser Fehler entsteht, wenn Busleitungen miteinander kurzgeschlossen sind.In this type of fault, a value of one bit corresponding to one bus line becomes equal to a value of one bit corresponding to the other bus line, that is, different values are not maintained between two bus lines. This error occurs when bus lines are shorted together.
Prüfwerte D zum Erfassen der im Vorhergehenden beschriebenen Fehler werden wie folgt bestimmt.
- (1) Zum Erfassen eines Fehlers einer fixierten 0 wird ein Wert eines Bit, das einer Busleitung entspricht, die zu prüfen ist, auf „1” eingestellt.
- (2) Zum Erfassen eines Fehlers einer fixierten 1 wird ein Wert eines Bit, das einer Busleitung entspricht, die zu prüfen ist, auf „0” eingestellt.
- (3) Zum Erfassen eines Kurzschlussfehlers wird ein Wert eines Bit, das einer Busleitung entspricht, die zu prüfen ist, auf einen sich zu demselben der anderen Busleitungen unterscheidenden Wert eingestellt. Das heißt für jedes von allen Bit von Busleitungen wird ein Wert eines Bit, das zu prüfen ist, auf „0” eingestellt, und Werte der anderen Bit werden auf „1” eingestellt, oder ein Wert eines Bit, das zu prüfen ist, wird auf „1” eingestellt, und Werte der anderen Bit werden auf „0” eingestellt. Die Zahl von Kombinationen der Kurzschlussfehlererfassung gleicht der Zahl von Kombinationen eines Auswählen von zwei Bit aus Gesamtbit. Wenn die Zahl der Gesamtbit N ist, muss eine Mehrzahl von Kombinationen (NC2) von Prüfwerten D geliefert werden.
- (1) For detecting a fixed-zero error, a value of a bit corresponding to a bus line to be tested is set to "1".
- (2) For detecting a fixed-1 error, a value of a bit corresponding to a bus line to be checked is set to "0".
- (3) For detecting a short-circuit fault, a value of one bit corresponding to one bus line to be tested is set to a value different from that of the other bus lines. That is, for each of every bit of Bus lines, a value of one bit to be checked is set to "0", and values of the other bits are set to "1", or a value of a bit to be checked is set to "1", and values the other bits are set to "0". The number of combinations of the short-circuit fault detection equals the number of combinations of selecting two bits of total bits. When the number of total bits is N, a plurality of combinations ( N C 2 ) of check values D must be supplied.
Beispiele der Prüfwerte D sind im Folgenden hinsichtlich unterschiedlicher Zahlen von Prüfobjektbit, die zu prüfende Objektbis sind, beschrieben. Für den Prüfwert D von N Bit ist das niederwertigste als Bit Nr. 0 (nulltes Bit) bezeichnet, das zweitniederwertigste Bit ist als das Bit Nr. 1 (erstes Bit) bezeichnet, und das höchstwertige Bit ist als das Bit Nr. N-1 (Nte Bit) von Bit Nr. 2 bis Bit Nr. N-2 bezeichnet. Eine hexadezimale Zahl ist durch Beifügen von „h” an dem Ende der Zahl bezeichnet.Examples of the test values D are described below with respect to different numbers of test object bits which are objects to be tested. For the check value D of N bits, the least significant one is designated as bit # 0 (zeroth bit), the second least significant bit is designated as the bit # 1 (first bit), and the most significant bit is as the bit # N-1 (Nth bit) from
(Beispiel mit 2 Bit)(Example with 2 bits)
Ein Beispiel mit 2 Bit ist in
(Beispiel mit 4 Bit)(Example with 4 bits)
Ein Beispiel mit 4 Bit ist in
Bei diesem Beispiel ist die Zahl der Prüfwerte, die für eine Kurzschlussfehlererfassung erforderlich ist, log2 4, das heißt 2. Einer dieser zwei Prüfwerte D wird ferner verwendet, um entweder einen Fehler einer fixierten 0 oder einen Fehler einer fixierten 1 zu erfassen. Durch Hinzufügen von einem weiteren Erfassungswert D zum Erfassen des anderen von entweder dem Fehler einer fixierten 0 oder dem Fehler einer fixierten 1 können alle im Vorhergehenden beschriebenen drei Typen von Fehlern erfasst werden. Aus diesem Grund ist die Zahl der Erfassungswerte, die für eine Fehlererfassung erforderlich ist, log2 4 + 1, das heißt 3.In this example, the number of test values required for short circuit fault detection is
Gemäß dem Stand der Technik, der einen Prüfwert verwendet, der „1” oder „0” in lediglich einem von allen Bit hat, benötigt das Prüfen von 4 Bit ein Minimum von 4 Werten, beispielsweise 01h (00000001), 02h (00000010), 04h (00000100) und 08h (00001000). Dies liegt daran, dass in einer Mehrzahl von Busleitungen basierend auf einem Prüfwert nicht gleichzeitig ein Kurzschlussfehler erfasst werden kann. Gemäß dem vorliegenden Ausführungsbeispiel kann jedoch in einer Mehrzahl von Busleitungen basierend auf einem Prüfwert der Kurzschlussfehler gleichzeitig erfasst werden. Als ein Resultat kann die Zahl der Prüfwerte reduziert werden.According to the prior art, which uses a check value having "1" or "0" in only one of all bits, testing of 4 bits requires a minimum of 4 values, for example, 01h (00000001), 02h (00000010), 04h (00000100) and 08h (00001000). This is because in a plurality of bus lines based on a test value, a short circuit fault can not be detected at the same time. According to the present embodiment, however, in a plurality of bus lines based on a check value, the short-circuit failure may be detected simultaneously. As a result, the number of test values can be reduced.
(Beispiel mit 8 Bit)(Example with 8 bits)
Ein Beispiel mit 8 Bit ist in
Bei diesem Beispiel ist die Zahl der Prüfwerte D, die für eine Kurzschlussfehlererfassung notwendig ist log2 8, das heißt 3. Die Zahl der Prüfwerte D, die für eine Fehlererfassung erforderlich ist, ist log2 8 + 1, das heißt 4.In this example, the number of test values D necessary for short-circuit fault detection is
Gemäß dem Stand der Technik benötigt eine Prüfung mit 8 Bit ein Minimum von 8 Prüfwerten. Gemäß dem vorliegenden Ausführungsbeispiel kann jedoch die Zahl der Prüfwerte auf eine Hälfte reduziert werden.In the prior art, an 8-bit test requires a minimum of 8 test values. According to the present embodiment can However, the number of test values can be reduced to one half.
Die Reihen in dem ROM-Bereich entsprechen dem Bit Nr. 0 bis zu dem Bit Nr. 3, und die Zeilen in dem ROM-Bereich entsprechen dem Bit Nr. 4 bis zu dem Bit Nr. 7. Vier Adressen FCh bis FFh sind verwendet, um den korrekten Wert Vt für die Adressbusprüfung zu speichern. Der korrekte Wert Vt kann jedoch in anderen Adressen gespeichert sein.The rows in the ROM area correspond to bit # 0 through
Die Adressen nahe einem maximalen Adresswert FFh in dem ROM-Bereich sind oftmals als ein Speicherungsverbotsbereich, der für jede Vorrichtung spezifisch ist, bezeichnet. Aus diesem Grund wird bevorzugt, solche Adressen als die Prüfadressen Ad für eine Adressbusprüfung nicht zu verwenden. Gemäß dem Stand der Technik muss ein Adresswert FEh (11111110), bei dem lediglich das Bit Nr. 0 „0” ist, verwendet werden. Gemäß dem vorliegenden Ausführungsbeispiel kann. die Prüfadresse für eine Adressbusprüfung beliebig ausgewählt sein. Als ein Resultat ist es nicht leicht, Adressen, wie zum Beispiel FEh zu verwenden, für die es wahrscheinlich ist, dass dieselben in dem verbotenen Bereich umfasst sind.The addresses near a maximum address value FFh in the ROM area are often referred to as a storage prohibition area specific to each device. For this reason, it is preferable not to use such addresses as the check addresses Ad for an address bus check. According to the prior art, an address value FEh (11111110) in which only bit # 0 is "0" must be used. According to the present embodiment can. the test address may be arbitrarily selected for an address bus test. As a result, it is not easy to use addresses, such as FEh, that are likely to be included in the forbidden area.
(Beispiel mit 16 Bit)(Example with 16 bits)
Ein Beispiel mit 16 Bit ist in
In diesem Beispiel ist die Zahl der Prüfwerte D, die für eine Kurzschlussfehlererfassung erforderlich sind, log2 16, das heißt 4. Die Zahl der Prüfwerte D, die für eine Fehlererfassung erforderlich sind, ist log2 16 + 1, das heißt 5. Gemäß dem Stand der Technik benötigt ein Prüfen von 16 Bit ein Minimum von 16 Prüfwerten. Gemäß dem vorliegenden Ausführungsbeispiel kann jedoch die Zahl der Prüfwerte D auf etwa 30% reduziert sein.In this example, the number of test values D required for short-circuit fault detection is
(Beispiel mit 32 Bit)(Example with 32 bits)
Ein Beispiel mit 32 Bit ist in
Bei diesem Beispiel ist die Zahl der Prüfwerte D, die für eine Kurzschlussfehlererfassung erforderlich sind, log2 32, das heißt 5. Die Zahl der Prüfwerte D, die für eine Fehlererfassung erforderlich sind, ist log2 32 + 1, das heißt 6. Gemäß dem Stand der Technik benötigt eine Prüfung von 32 Bit ein Minimum von 32 Prüfwerten. Gemäß dem vorliegenden Ausführungsbeispiel kann jedoch die Zahl der Prüfwerte D auf kleiner als 20% reduziert werden.In this example, the number of test values D required for short-circuit fault detection is
Wie im Vorhergehenden beschrieben ist, erhöht sich die Zahl der Prüfwerte im Verhältnis zu der Zahl von Bit, die zu prüfen sind, gemäß dem Stand der Technik. Gemäß dem vorliegenden Ausführungsbeispiel ist jedoch die Zahl der Prüfwerte D eins plus dem logarithmischen Wert der Zahl der Bit, die zu prüfen sind. Als ein Resultat kann die Zahl der Erfassungswerte stärker reduziert werden, sowie sich die Zahl der Bit erhöht. Die Verarbeitungslast der ECU
Gemäß dem Stand der Technik wird basierend auf wiedergewonnen Werten ein Prüfsummenwert berechnet, um eine Verarbeitungslast einer ECU gegenüber einer Erhöhung der Zahl der Prüfwerte zu reduzieren. Es ist daher nicht möglich, einen Fehler zu erfassen, wenn die Prüfwerte, die von unterschiedlichen Adressen wiedergewonnen werden, hinsichtlich der gleichen Bit zueinander umgekehrt sind. Gemäß dem vorliegenden Ausführungsbeispiel kann jedoch diesem Problem mit einer kleineren Zahl von Erfassungswerten und einer reduzierten Verarbeitungslast begegnet werden. Es ist somit nicht notwendig, eine Prüfsummenberechnung zu verwenden, die nicht so zuverlässig ist. Es ist möglich, die wiedergewonnen Werte mit den korrekten Werten direkt zu vergleichen oder durch eine Generatorpolynomgleichung innerhalb eines Bereichs einer tatsächlichen Speicherkapazität eine CRS zu berechnen.According to the prior art, a checksum value is calculated based on retrieved values to reduce a processing load of an ECU against an increase in the number of check values. Therefore, it is not possible to detect an error when the check values retrieved from different addresses are reversed with respect to the same bits. However, according to the present embodiment, this problem can be dealt with with a smaller number of detection values and a reduced processing load. It is thus not necessary to use a checksum computation that is less reliable. It is possible to directly compare the retrieved values with the correct values or to calculate a CRS by a generator polynomial equation within a range of an actual storage capacity.
In einem Fall, dass die ECU
(Beispiel des bitinvertierten Prüfwerts)(Example of bit-inverted check value)
Bei den im Vorhergehenden beschriebenen Beispielen ist die Zahl der Prüfwerte D minimiert. Als weitere Beispiele kann ein anderer Prüfwert der im Vorhergehenden beschriebenen minimalen Zahl von Prüfwerten hinzugefügt sein. Bei dem in
Zwei „0” und „1” sind somit gleichermaßen Bit durch vier Prüfwerte D zugewiesen. Als ein Resultat wird werden die Zahlen der Prüfungen von Fehlern einer fixierten 0 und Fehlern einer fixierten 1 bei jeder Verarbeitung gleich. Die Prüf-Ungenauigkeit wird somit reduziert, und eine Zuverlässigkeit des Prüfbetriebs ist erhöht. In dem Fall, dass ein physischer Betrieb derart durchgeführt wird, dass ein Strom in der Busleitung mit einem Bitwert „1” fließt, und kein Strom in der Busleitung mit einem Bitwert „0” fließt, kann ein Lokalisierungsproblem, wie zum Beispiel einer Wärmeerzeugung in besonderen Busleitungen, durch Ausgleichen einer Last zwischen Busleitungen unterdrückt werden.Two "0" and "1" are thus equally allocated bits by four test values D. As a result, the numbers of checks of errors of a fixed 0 and errors of a fixed 1 become the same every processing. The test inaccuracy is thus reduced, and reliability of the test operation is increased. In the case where a physical operation is performed such that a current flows in the bus line having a bit value "1" and no current flows in the bus line having a bit value "0", a localization problem such as heat generation in particular bus lines are suppressed by balancing a load between bus lines.
Bei dem in
Gemäß diesem Beispiel ist die Zahl der Prüfwerte D in dem Fall 4, dass die Zahl der zu prüfenden Bit 4 ist. Als ein Resultat ist die Zahl der Prüfwerte D gleich derselben im Stand der Technik. Die Zahl der Prüfwerte D ist jedoch in dem Fall, dass die Zahl der zu prüfenden Bit 8 ist, auf sechs reduziert. Die Zahl der Prüfwerte C ist somit auf kleiner als 8 reduziert, was im Stand der Technik erforderlich ist. Selbst wenn mehr Prüfwerte D durch Invertieren jedes Bit hinzugefügt werden, sowie die Zahl der zu prüfenden Bit erhöht wird, kann die Zahl der Prüfwerte D ausreichend reduziert werden, um kleiner als dieselbe im Stand der Technik zu sein.According to this example, the number of check values D in
(Andere Ausführungsbeispiele)Other Embodiments
Bei dem vorliegenden Ausführungsbeispiel wird durch Schreiben des Datenbusprüfwerts Md in den Datenbusprüfbereich
Als ein alternatives Verfahren eines Erfassens eines Fehlers in dem Datenbus
Die elektronische Steuereinheit gemäß dem vorliegenden Ausführungsbeispiel kann ferner bei beispielsweise einer Lenkvorrichtung mit einem variablen Übersetzungsverhältnis (VGRS; VRGS = variable gear ratio steering apparatus), einer aktiven Hinterlenkvorrichtung (ARS; ARS = active rear steering apparatus) oder dergleichen, die anders als die elektrische Servolenkvorrichtung
Die vorliegende Erfindung ist nicht auf die offenbarten Ausführungsbeispiele begrenzt, kann jedoch in unterschiedlichsten Ausführungsbeispielen implementiert sein.The present invention is not limited to the disclosed embodiments, but may be implemented in various embodiments.
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- JP 2008-210245 A [0002] JP 2008-210245A [0002]
Claims (10)
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2010237495A JP5581966B2 (en) | 2010-10-22 | 2010-10-22 | Electronic device and electric power steering device using the same |
JP2010-237495 | 2010-10-22 |
Publications (1)
Publication Number | Publication Date |
---|---|
DE102011054399A1 true DE102011054399A1 (en) | 2012-04-26 |
Family
ID=45923338
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE201110054399 Withdrawn DE102011054399A1 (en) | 2010-10-22 | 2011-10-11 | Electronic control unit for use in electrical servo steering device to support vehicle steering operation, has CPU testing whether bit corresponds to bus lines to be tested and bit of other lines maintain different values from each other |
Country Status (2)
Country | Link |
---|---|
JP (1) | JP5581966B2 (en) |
DE (1) | DE102011054399A1 (en) |
Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2008210245A (en) | 2007-02-27 | 2008-09-11 | Denso Corp | Electronic device |
Family Cites Families (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2583351B2 (en) * | 1990-10-08 | 1997-02-19 | 富士通株式会社 | Bus line test method and apparatus for implementing the method |
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-
2010
- 2010-10-22 JP JP2010237495A patent/JP5581966B2/en not_active Expired - Fee Related
-
2011
- 2011-10-11 DE DE201110054399 patent/DE102011054399A1/en not_active Withdrawn
Patent Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2008210245A (en) | 2007-02-27 | 2008-09-11 | Denso Corp | Electronic device |
Also Published As
Publication number | Publication date |
---|---|
JP5581966B2 (en) | 2014-09-03 |
JP2012089070A (en) | 2012-05-10 |
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Legal Events
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