CN220651247U - 一种在关机状态下删除数据的电路 - Google Patents
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Abstract
本实用新型公开了一种在关机状态下删除数据的电路，涉及电子电路技术领域包括：存储单元，用于存储数据；控制单元，与存储单元连接，用于删除存储单元内存储的数据；晶振单元，与控制单元连接，为控制单元提供时钟信号；电源单元，为所述存储单元、控制单元、晶振单元供电。本实用新型能够在设备关机的状态下对数据进行删除。
Description
技术领域
本实用新型涉及电子电路技术领域，尤其涉及一种在关机状态下删除数据的电路。
背景技术
随科技的发展，已经有大量的各类移动终端进入用户的日常生活，如现如今随处可见的手机、平板等设备。该些设备除了用于用户日常的通讯、信息处理以外，受到其轻便的性能影响，其附加的信息存储功能也日益受到用户们的青睐。也正是因为这个原因，现在的厂家在研发新产品的时候，高性能的存储也是发展的重要方向之一。
在所存储的数据中，包含了很多关键数据，比如用户的私密信息、涉密文件等等。如果在紧急场景下需要对该些数据进行删除，现有的产品需要先进行开机，操作起来较为繁琐。若在低电量的情况下无法开机导致关键数据不能及时删除，则存在关键数据泄露的风险。
因此，如何设计一种能够在设备关机状态下亦能够对数据进行删除的方案是亟待解决的难题之一。
实用新型内容
为了解决背景技术中提到的至少一个技术问题，本实用新型的目的在于提供一种在关机状态下删除数据的电路，能够在设备关机的状态下对数据进行删除。
为实现上述目的，本实用新型提供如下技术方案：
一种在关机状态下删除数据的电路，包括：
存储单元，用于存储数据；
控制单元，与存储单元连接，用于删除存储单元内存储的数据；
晶振单元，与控制单元连接，为控制单元提供时钟信号；
电源单元，为所述存储单元、控制单元、晶振单元供电。
在本实用新型的某些实施例中，所述存储单元包括型号为GD25D10CEIG的存储器U8403，所述存储器U8403的第1引脚、第2引脚、第5引脚、第6引脚作为SPI接口与控制单元连接。
在本实用新型的某些实施例中，所述控制单元包括型号为GD32E230G4U6的芯片U8411，所述芯片U8411的第6引脚连接至外部的删除数据信号，所述芯片U8411的第10引脚、第12引脚、第13引脚、第11引脚作为SPI接口分别与存储器U8403的第1引脚、第2引脚、第5引脚、第6引脚连接。
在本实用新型的某些实施例中，所述晶振单元包括型号为E3SB12.0000F10E11的晶体振荡器Y8401，所述晶体振荡器Y8401的第1引脚、第3引脚分别与芯片U8411的第3引脚、第2引脚连接；晶体振荡器Y8401的第1引脚、第3引脚之间还连接有电阻R8402；晶体振荡器Y8401的第1引脚、第3引脚分别经电容C8411、C8412接地。
在本实用新型的某些实施例中，所述电源单元包括型号为WL2815D33的芯片U8402，所述芯片U8402的第3引脚经电阻R8403连接至电平VBAT，芯片U8402的第1引脚输出电平VDD_MCU_3V3，并经电容C8404接地。
在本实用新型的某些实施例中，还包括电源滤波单元，所述电源滤波单元包括并联的多个滤波电容，所述多个滤波电容的一端与芯片U8411的第5引脚，第17引脚连接，所述多个滤波电容的另一端接地。
在本实用新型的某些实施例中，还包括复位单元，所述复位单元与控制单元连接，实现控制单元的上电复位。
在本实用新型的某些实施例中，所述复位单元包括电阻R8411和电容C8407，电阻R8411的第一端连接至高电平，电阻R8411的第二端与电容C8407的第一端连接至控制单元的复位端，电容C8407的第二端接地。
与现有技术相比，本实用新型的有益效果是：
本实用新型平常处于休眠状态，当控制单元接收到外部的删除数据信号时，立刻唤醒，进入工作状态，删除存储单元中存储的数据；本实用新型可以实现低电量或者设备关机场景下对数据的删除，降低关键数据外泄的风险。
附图说明
图1为本实用新型的整体电路框图。
图2为本实用新型的控制单元及晶振单元的电路图。
图3为本实用新型的电源单元电路图。
图4为本实用新型的复位单元电路图。
图5为本实用新型的存储单元电路图。
具体实施方式
下面对本实用新型实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本实用新型一部分实施例，而不是全部的实施例。基于本实用新型中的实施例，本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例，都属于本实用新型保护的范围。
请参阅图1，本实施例提供一种在关机状态下删除数据的电路，包括：存储单元、控制单元、晶振单元和电源单元。
所述存储单元，用于存储数据。
如图5所示，所述存储单元包括兆易创新旗下的型号为GD25D10CEIG的存储器U8403，所述存储器U8403的第1引脚、第2引脚、第5引脚、第6引脚作为SPI接口与控制单元连接；所述存储器U8403的第3引脚经电阻R8419连接至电源单元的输出端VDD_MCU_3V3；所述存储器U8403的第8引脚连接至电源单元的输出端VDD_MCU_3V3，且经电容C8408接地。
控制单元，与存储单元连接，用于删除存储单元内存储的数据，此外，还可以对所述数据进行读、写操作。
如图2所示，所述控制单元包括兆易创新旗下的型号为GD32E230G4U6的芯片U8411，所述芯片U8411的第6引脚连接至外部的删除数据信号，所述芯片U8411的第10引脚、第12引脚、第13引脚、第11引脚作为SPI接口分别与存储器U8403的第1引脚、第2引脚、第5引脚、第6引脚连接。
所述芯片U8411的第2引脚、第3引脚与晶振单元连接，接收其时钟信号；
所述芯片U8411的第5引脚、第17引脚连接至电源单元的输出端VDD_MCU_3V3。值得一提的是，为了保证接收的电源的稳定性和可靠性，本实施例还包括电源滤波单元，所述电源滤波单元包括并联的多个滤波电容，及图2中并联设置的多个电容C8409、C8403、C8406，该多个滤波电容的一端与芯片U8411的第5引脚，第17引脚连接，另一端接地。
为了应对偶发的电路故障，本实施例还包括复位单元，所述复位单元与控制单元连接，实现控制单元的上电复位。
如图4所示，所述复位单元包括电阻R8411和电容C8407，电阻R8411的第一端连接至高电平，电阻R8411的第二端与电容C8407的第一端连接至控制单元的复位端/MCU_RST_L，电容C8407的第二端接地。
晶振单元，与控制单元连接，为控制单元提供时钟信号。
如图2所示，所述晶振单元包括红星电子旗下的型号为E3SB12.0000F10E11的晶体振荡器Y8401，所述晶体振荡器Y8401的第1引脚、第3引脚分别与芯片U8411的第3引脚、第2引脚连接；晶体振荡器Y8401的第1引脚、第3引脚之间还连接有电阻R8402；晶体振荡器Y8401的第1引脚、第3引脚分别经电容C8411、C8412接地。
电源单元，为所述存储单元、控制单元、晶振单元供电。
如图3所示，所述电源单元包括韦尔半导体旗下的型号为WL2815D33的芯片U8402，所述芯片U8402的第3引脚经电阻R8403连接至电平VBAT（电源供电端），芯片U8402的第1引脚输出电平VDD_MCU_3V3作为电源单元的输出端，并经电容C8404接地。
本电路的工作过程如下：
本电路平常处于睡眠状态，耗电量小余3uA。处于睡眠状态的芯片U8411检测到第6引脚产生的删除数据信号DES_KEY_SW的由高到低的变化后，立刻唤醒进入工作模式，通过SPI接口信号/SPI0_CS、SPI0_CLK、SPI0_MISO、SPI0_MOSI信号对存储器U8403发出删除数据的指令，同时读取关键数据存储器U8403的删除命令状态，确定数据被完全删除。
对于本领域技术人员而言，显然本实用新型不限于上述示范性实施例的细节，而且在不背离本实用新型的精神或基本特征的情况下，能够以其他的具体形式实现本实用新型。因此，无论从哪一点来看，均应将实施例看作是示范性的，而且是非限制性的，本实用新型的范围由所附权利要求而不是上述说明限定，因此旨在将落在权利要求的等同要件的含义和范围内的所有变化囊括在本实用新型内。
Claims (6)
1.一种在关机状态下删除数据的电路，其特征在于，包括：
存储单元，用于存储数据；
控制单元，与存储单元连接，用于删除存储单元内存储的数据；
晶振单元，与控制单元连接，为控制单元提供时钟信号；
电源单元，为所述存储单元、控制单元、晶振单元供电；
所述存储单元包括型号为GD25D10CEIG的存储器U8403，所述存储器U8403的第1引脚、第2引脚、第5引脚、第6引脚作为SPI接口与控制单元连接；
所述控制单元包括型号为GD32E230G4U6的芯片U8411，所述芯片U8411的第6引脚连接至外部的删除数据信号，所述芯片U8411的第10引脚、第12引脚、第13引脚、第11引脚作为SPI接口分别与存储器U8403的第1引脚、第2引脚、第5引脚、第6引脚连接。
2.根据权利要求1所述的一种在关机状态下删除数据的电路，其特征在于，所述晶振单元包括型号为E3SB12.0000F10E11的晶体振荡器Y8401，所述晶体振荡器Y8401的第1引脚、第3引脚分别与芯片U8411的第3引脚、第2引脚连接；晶体振荡器Y8401的第1引脚、第3引脚之间还连接有电阻R8402；晶体振荡器Y8401的第1引脚、第3引脚分别经电容C8411、C8412接地。
3.根据权利要求1所述的一种在关机状态下删除数据的电路，其特征在于，所述电源单元包括型号为WL2815D33的芯片U8402，所述芯片U8402的第3引脚经电阻R8403连接至电平VBAT，芯片U8402的第1引脚输出电平VDD_MCU_3V3，并经电容C8404接地。
4.根据权利要求1所述的一种在关机状态下删除数据的电路，其特征在于，还包括电源滤波单元，所述电源滤波单元包括并联的多个滤波电容，所述多个滤波电容的一端与芯片U8411的第5引脚，第17引脚连接，所述多个滤波电容的另一端接地。
5.根据权利要求1所述的一种在关机状态下删除数据的电路，其特征在于，还包括复位单元，所述复位单元与控制单元连接，实现控制单元的上电复位。
6.根据权利要求5所述的一种在关机状态下删除数据的电路，其特征在于，所述复位单元包括电阻R8411和电容C8407，电阻R8411的第一端连接至高电平，电阻R8411的第二端与电容C8407的第一端连接至控制单元的复位端，电容C8407的第二端接地。
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