CN219761044U - 基于飞腾64核处理器的网络安全设备 - Google Patents
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Abstract
本实用新型涉及一种基于飞腾64核处理器的网络安全设备，包括IO扩展芯片和飞腾64核处理器；飞腾64核处理器的四路PCIE3.0X8信号通过PCIE3.0总线分别连接1个PCIE3.0X8物理扩展插槽，飞腾64核处理器的一路PCIE3.0X1信号通过PCIE3.0总线连接至IO扩展芯片的输入端；IO扩展芯片连接接口组件，接口组件包括SATA3.0接口、mSATA接口、USB2.0接口、miniPCIE接口；其使得四路PCIE3.0X8信号直接引出到相应的PCIE3.0X8物理扩展插槽内，最大限度发挥飞腾64核处理器的处理性能，而且，省去了一片高速桥片，降低了网络安全设备的价格和功耗。
Description
技术领域
本实用新型涉及网络安全设备领域技术，尤其是指一种基于飞腾64核处理器的网络安全设备。
背景技术
网络安全为数据处理系统建立和采用的技术和管理的安全保护，保护计算机硬件、软件和数据不因偶然和恶意的原因遭到破坏、更改和泄露。
由此可以将计算机网络的安全理解为：通过采用各种技术和管理措施，使网络系统正常运行，从而确保网络数据的可用性、完整性和保密性。所以，建立网络安全保护措施的目的是确保经过网络传输和交换的数据不会发生增加、修改、丢失和泄露等。
现有的网络安全设备如图1所述，飞腾64核处理器原来就连接有两路PCIE3.0X8物理扩展插槽11a，其定义为两路原生的PCIE3.0X8物理扩展插槽11a。
由图1可看出，其将飞腾64核处理器的4路PCIE3.0X8信号中的一路PCIE3.0X8信号连接低速桥片继而外扩出SATA3.0接口、USB2.0接口以及管理网口等低速设备，且将飞腾64核处理器的4路PCIE3.0X8信号中的另一路PCIE3.0X8信号连接高速桥片以外扩2路PCIE3.0X8物理扩展插槽11a，这样加上两路原生的PCIE3.0X8物理扩展插槽11a组成4个PCIE3.0X8物理扩展插槽11a引出。
现有的网络安全设备存在以下缺点：
1、浪费了两路完整的PCIE3.0X8信号。
2、高速的PCIE桥片虽然能引出两路PCIE3.0X8物理扩展插槽，但是2路的总带宽不可能大于1路原生的PCIE3.0X8物理扩展插槽，此外桥片一般有70％左右的交换效率，所以高速桥片的两路PCIE实际吞吐量只有原生PCIE3.0X8物理扩展插槽的35％左右。继而因为PCIE吞吐量的瓶颈导致飞腾64核CPU的性能无法完全发挥出来，所以浪费飞腾64处理器的性能。
3、高速桥片的价格昂贵和功耗大。
因此，本实用新型专利申请中，申请人精心研究了一种基于飞腾64核处理器的网络安全设备来解决上述问题。
实用新型内容
本实用新型针对上述现有技术所存在不足，主要目的在于提供一种基于飞腾64核处理器的网络安全设备，其使得飞腾64核处理器的四路PCIE3.0X8信号直接引出到相应的PCIE3.0X8物理扩展插槽内，最大限度发挥飞腾64核处理器的处理性能，而且，省去了一片高速桥片，降低了网络安全设备的价格和功耗。
为实现上述之目的，本实用新型采取如下技术方案：
一种基于飞腾64核处理器的网络安全设备，包括有IO扩展芯片和飞腾64核处理器；
所述飞腾64核处理器的四路PCIE3.0X8信号通过PCIE3.0总线分别连接有1个PCIE3.0X8物理扩展插槽，所述飞腾64核处理器的一路PCIE3.0X1信号通过PCIE3.0总线连接至IO扩展芯片的输入端；
所述IO扩展芯片连接有接口组件，所述接口组件包括有SATA3.0接口、mSATA接口、USB2.0接口、miniPCIE接口。
作为一种优选方案，还包括有网络控制器芯片，所述IO扩展芯片的一路PCIE2.0X2信号通过PCIE2.0总线连接至网络控制器芯片的输入端，所述网络控制器芯片连接有两路网口。
作为一种优选方案，所述IO扩展芯片输出四路SATA3.0信号，其中三路SATA3.0信号通过SATA总线连接至SATA3.0接口，另一路SATA3.0信号通过SATA总线连接至mSATA接口。
作为一种优选方案，所述IO扩展芯片的四路USB2.0信号通过USB2.0总线连接至USB2.0接口。
作为一种优选方案，所述IO扩展芯片的一路PCIE2.0X1信号通过PCIE2.0总线连接至miniPCIE接口。
作为一种优选方案，还包括有TMP芯片和BIOS芯片，所述BIOS芯片通过SPI开关分别连接TMP芯片和飞腾64核处理器，所述TMP芯片分别连接IO扩展芯片和飞腾64核处理器。
本实用新型与现有技术相比具有明显的优点和有益效果，具体而言：其主要是通过IO扩展芯片和飞腾64核处理器的配合且所述飞腾64核处理器的四路PCIE3.0X8信号通过PCIE3.0总线分别连接有1个PCIE3.0X8物理扩展插槽，使得飞腾64核处理器的四路PCIE3.0X8信号直接引出到相应的PCIE3.0X8物理扩展插槽内，最大限度发挥飞腾64核处理器的处理性能，而且，省去了一片高速桥片，降低了网络安全设备的价格和功耗。
附图说明
图1是现有技术的结构示意图；
图2是本实用新型之实施例的结构示意图。
附图标号说明：
10、飞腾64核处理器
11、PCIE3.0X8物理扩展插槽12、DDR4内存插槽
13、液晶屏14、调试串口
15、单片机
20、IO扩展芯片
21、SATA3.0接口22、mSATA接口
23、USB2.0接口24、miniPCIE接口
30、网络控制器芯片
31、网口
41、TMP芯片42、BIOS芯片
43、SPI开关。
具体实施方式
下面结合附图与具体实施方式对本实用新型作进一步描述。
如图2所示，一种基于飞腾64核处理器10的网络安全设备，包括有IO扩展芯片20、飞腾64核处理器10以及网络控制器芯片30。
所述飞腾64核处理器10连接有液晶屏13、调试串口14、单片机15以及8个DDR4内存插槽12，
所述飞腾64核处理器的四路PCIE3.0X8信号通过PCIE3.0总线分别连接有1个PCIE3.0X8物理扩展插槽。在本实施例中，飞腾64核处理器的四路PCIE3.0X8信号直接引出到相应的PCIE3.0X8物理扩展插槽内，用于插入网卡。其最大限度发挥飞腾64核处理器的处理性能。
所述飞腾64核处理器10的一路PCIE3.0X1信号通过PCIE3.0总线连接至IO扩展芯片20的输入端。在本实施例中，飞腾64核处理器10为飞腾FT2000+/64处理器。
所述IO扩展芯片20的一路PCIE2.0X2信号通过PCIE2.0总线连接至网络控制器芯片30的输入端，所述网络控制器芯片30连接有两路网口31。在本实施例中，IO扩展芯片20的型号为兆芯ZX-200，网络控制器芯片30的型号为网迅WX1860A2。
所述IO扩展芯片20连接有接口组件，所述接口组件包括有SATA3.0接口21、mSATA接口22、USB2.0接口23、miniPCIE接口24。
在本实施例中，所述IO扩展芯片20输出四路SATA3.0信号，其中三路SATA3.0信号通过SATA总线连接至SATA3.0接口21，另一路SATA3.0信号通过SATA总线连接至mSATA接口22。
所述IO扩展芯片20的四路USB2.0信号通过USB2.0总线连接至USB2.0接口23。所述IO扩展芯片20的一路PCIE2.0X1信号通过PCIE2.0总线连接至miniPCIE接口24。
还包括有TMP芯片41和BIOS芯片42，所述BIOS芯片42通过SPI开关43分别连接TMP芯片41和飞腾64核处理器10，所述TMP芯片41分别连接IO扩展芯片20和飞腾64核处理器10。在本实施例中，所述BIOS芯片42可以选择国产的GD25LQ128系列芯片。
本实用新型设计要点在于：其主要是通过IO扩展芯片和飞腾64核处理器的配合且所述飞腾64核处理器的四路PCIE3.0X8信号通过PCIE3.0总线分别连接有1个PCIE3.0X8物理扩展插槽，使得飞腾64核处理器的四路PCIE3.0X8信号直接引出到相应的PCIE3.0X8物理扩展插槽内，最大限度发挥飞腾64核处理器的处理性能，而且，省去了一片高速桥片，降低了网络安全设备的价格和功耗。
以上所述，仅是本实用新型较佳实施例而已，并非对本实用新型的技术范围作任何限制，故凡是依据本实用新型的技术实质对以上实施例所作的任何细微修改、等同变化与修饰，均仍属于本实用新型技术方案的范围内。
Claims (6)
1.一种基于飞腾64核处理器的网络安全设备，其特征在于：包括有IO扩展芯片和飞腾64核处理器；
所述飞腾64核处理器的四路PCIE3.0X8信号通过PCIE3.0总线分别连接有1个PCIE3.0X8物理扩展插槽，所述飞腾64核处理器的一路PCIE3.0X1信号通过PCIE3.0总线连接至IO扩展芯片的输入端；
所述IO扩展芯片连接有接口组件，所述接口组件包括有SATA3.0接口、mSATA接口、USB2.0接口、miniPCIE接口。
2.根据权利要求1所述基于飞腾64核处理器的网络安全设备，其特征在于：还包括有网络控制器芯片，所述IO扩展芯片的一路PCIE2.0X2信号通过PCIE2.0总线连接至网络控制器芯片的输入端，所述网络控制器芯片连接有两路网口。
3.根据权利要求1所述基于飞腾64核处理器的网络安全设备，其特征在于：所述IO扩展芯片输出四路SATA3.0信号，其中三路SATA3.0信号通过SATA总线连接至SATA3.0接口，另一路SATA3.0信号通过SATA总线连接至mSATA接口。
4.根据权利要求1所述基于飞腾64核处理器的网络安全设备，其特征在于：所述IO扩展芯片的四路USB2.0信号通过USB2.0总线连接至USB2.0接口。
5.根据权利要求1所述基于飞腾64核处理器的网络安全设备，其特征在于：所述IO扩展芯片的一路PCIE2.0X1信号通过PCIE2.0总线连接至miniPCIE接口。
6.根据权利要求1所述基于飞腾64核处理器的网络安全设备，其特征在于：还包括有TMP芯片和BIOS芯片，所述BIOS芯片通过SPI开关分别连接TMP芯片和飞腾64核处理器，所述TMP芯片分别连接IO扩展芯片和飞腾64核处理器。
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