CN215933159U - 调控电路、时序控制芯片和显示装置 - Google Patents
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Abstract
本实用新型涉及显示技术领域，公开了一种调控电路、时序控制芯片和显示装置，该显示装置包括该时序控制芯片，该时序控制芯片包括该调控电路，该调控电路通过第一晶体管串联时序控制单元的热插拔检测信号输出端与地，第一晶体管的栅极与第一偏置电压源和地耦接，第二晶体管串联在第一晶体管的栅极至第一偏置电压源或地之间，且第二晶体管的栅极与时序控制单元的准备完成指示信号输出端连接。本实用新型根据时序控制单元的准备完成状态控制热插拔检测信号的状态，在时序控制单元准备完成之前控制第一晶体管导通，保障热插拔检测信号为低电平，避免前端系统在时序控制单元配置完成之前向时序控制单元发送数据，改善了开机时的显示异常问题。
Description
技术领域
本实用新型涉及显示技术领域，具体地，涉及调控电路、时序控制芯片和显示装置。
背景技术
在显示装置中，显示面板的画面显示由多种控制电路协同控制，其中，如图1所示，时序控制(Time Control，简称TCON)单元20的热插拔检测(Hot Plug Detection，简称HPD)信号输出端连接至前端系统 10，在热插拔检测信号HPD达到预设值时，前端系统10提供数据信号DATA至时序控制单元20，再由时序控制单元20控制显示。
进一步参照图2，在现有技术中，时序控制单元20在自身的工作电源上电至有效状态后，控制将热插拔检测信号HPD拉低，再至时序控制单元20自身准备完成后，热插拔检测信号HPD通过上拉电阻R0连接供电电压VIN被拉高，其中，供电电压VIN的供电在时序控制单元20 的工作电源上电至有效状态之前，使得在供电电压VIN抬升时刻至时序控制单元20的工作电源上电至有效状态时刻之间的时间内，热插拔检测信号HPD会被供电电压VIN拉高，使前端系统10在此时输出数据信号 DATA至时序控制单元20，但此时的时序控制单元20还未准备完成，未进入正常工作状态，此时接收数据信号DATA的输入可能会造成瞬间画面显示异常(例如黑屏、花屏)的问题。
实用新型内容
鉴于上述问题，本实用新型的目的在于提供一种调控电路、时序控制芯片和显示装置，从而在时序控制单元未准备完成之前保障热插拔检测信号的状态，改善开机瞬间画面显示异常的问题。
根据本实用新型的一方面，提供一种调控电路，用于时序控制单元的热插拔检测信号的时序控制，所述时序控制单元的热插拔检测信号输出端通过上拉电阻器与供电电压接入端连接，所述调控电路包括：
第一晶体管，串联在所述时序控制单元的热插拔检测信号输出端与地之间，所述第一晶体管的栅极耦接至第一偏置电压源的第一偏置电压信号输出端或地；
第二晶体管，串联在所述第一晶体管的栅极至所述第一偏置电压信号输出端或地之间，所述第二晶体管的栅极与所述时序控制单元的准备完成指示信号输出端连接。
可选地，所述第一晶体管和所述第二晶体管均为NMOS管；
所述第二晶体管串联在所述第一晶体管的栅极与地之间。
可选地，所述第一晶体管为PMOS管，所述第二晶体管为NMOS 管；
所述第二晶体管串联在所述第一晶体管的栅极与所述第一偏置电压源的第一偏置电压信号输出端之间；
所述第一晶体管的栅极还通过第二电阻器接地。
可选地，所述第一晶体管为NMOS管，所述第二晶体管为PMOS 管；
所述第二晶体管串联在所述第一晶体管的栅极与所述第一偏置电压源的第一偏置电压信号输出端之间；
所述第一晶体管的栅极还通过第二电阻器接地。
可选地，所述第一晶体管和所述第二晶体管均为PMOS管；
所述第二晶体管串联在所述第一晶体管的栅极与地之间；
所述第一晶体管的栅极通过第一电阻器连接至所述第一偏置电压信号输出端。
可选地，所述第一偏置电压源包括低压差线性稳压器，所述低压差线性稳压器的输出端为所述第一偏置电压信号输出端。
可选地，所述低压差线性稳压器的输入端与系统输入电压接口连接。
可选地，还包括：
脉冲电平转换单元，串联在所述时序控制单元的准备完成指示信号输出端与所述第二晶体管的栅极之间。
根据本实用新型的另一方面，提供一种时序控制芯片，包括时序控制单元和根据本实用新型提供的调控电路，其中，
所述时序控制单元，包括热插拔检测信号输出端和准备完成指示信号输出端，所述热插拔检测信号输出端还通过上拉电阻器连接至供电电压接入端；
根据本实用新型提供的调控电路。
根据本实用新型的再一方面，提供一种显示装置，包括本实用新型提供的时序控制芯片。
本实用新型提供的调控电路通过第一晶体管串联时序控制单元的热插拔检测信号输出端与地，第一晶体管的栅极与第一偏置电压源和地耦接，第二晶体管串联在第一晶体管的栅极至第一偏置电压源或地之间，且第二晶体管的栅极与时序控制单元的准备完成指示信号输出端连接，可根据时序控制单元的准备完成状态控制热插拔检测信号的状态，在时序控制单元准备完成之前控制第一晶体管导通，保障热插拔检测信号为低电平，避免前端系统在时序控制单元配置完成之前向时序控制单元发送数据，改善了开机时的显示异常问题。
本实用新型提供的一种时序控制芯片包括时序控制单元和本实用新型的调控电路，可根据时序控制单元的准备完成状态控制热插拔检测信号的状态，在时序控制单元准备完成之前控制第一晶体管导通，保障热插拔检测信号为低电平，避免前端系统在时序控制单元配置完成之前向时序控制单元发送数据，避免开机时的热插拔检测信号的误触发，改善开机时的显示异常问题。
本实用新型还提供一种显示装置，包括本实用新型的时序控制芯片，其热插拔检测信号在时序控制单元准备完成之前的开机瞬间不会瞬时误触发为高电平，有效降低了开机瞬间的显示异常问题。
附图说明
通过以下参照附图对本实用新型实施例的描述，本实用新型的上述以及其他目的、特征和优点将更为清楚，在附图中：
图1示出了根据现有技术的显示装置的部分结构示意图；
图2示出了根据现有技术的显示装置的部分信号的时序图；
图3示出了根据本实用新型实施例的调控电路的结构示意图；
图4示出了图3所示的调控电路的部分信号的时序图；
图5示出了根据本实用新型另一实施例的调控电路的结构示意图；
图6示出了图5所示的调控电路的部分信号的时序图；
图7示出了根据本实用新型又一实施例的调控电路的结构示意图。
具体实施方式
以下将参照附图更详细地描述本实用新型的各种实施例。在各个附图中，相同的元件采用相同或类似的附图标记来表示。为了清楚起见，附图中的各个部分没有按比例绘制。
下面结合附图和实施例，对本实用新型的具体实施方式作进一步详细描述。
图3示出了根据本实用新型实施例的调控电路的结构示意图。
如图3所示，本实用新型实施例的调控电路30与时序控制单元20 的热插拔检测信号输出端和准备完成指示信号输出端连接，以根据准备完成指示信号GPIO控制热插拔检测信号HPD的状态，在时序控制单元 20准备完成之前，将热插拔检测信号输出端接地，在时序控制单元20 准备完成后，断开热插拔检测信号输出端与地的连接，热插拔检测信号输出端通过上拉电阻器R0连接供电电压接入端，使热插拔检测信号 HPD上拉至供电电压VIN电平。
在本实施例中，准备完成指示信号输出端为通用输入和输出接口，还可接收外部偏置。
在本实施例中，调控电路30包括第一晶体管N1、第二晶体管N2、低压差线性稳压器31和第一电阻器R1。
低压差线性稳压器31的输入端接收系统端输入电压VLED，作为第一偏置电压源，在其输出端提供第一偏置电压信号，控制第一晶体管N1 的栅极偏置。其中，系统端输入电压VLED的电压在供电电压VIN的电压抬升之前抬升。
第一晶体管N1串联在时序控制单元20的热插拔检测信号输出端与地之间，栅极通过第一电阻器R1与低压差线性稳压器31的输出端连接。
第二晶体管N2串联在第一晶体管N1的栅极与地之间，栅极与时序控制单元20的准备完成指示信号输出端连接。
其中，在本实施例中，第一晶体管N1和第二晶体管N2均为NMOS (N-Metal-Oxide-Semiconductor，N型金属-氧化物-半导体)管，便于实现NMOS管的衬底接地的偏置需求，就近选取地，布线方便。
图4示出了图3所示的调控电路的部分信号的时序图。
参照图3和图4，系统开机时，时序控制单元20未准备完成，准备完成指示信号GPIO为低电平，第二晶体管N2关断，系统端输入电压 VLED先于供电电压VIN抬升，通过低压差线性稳压器31提供偏置电压信号至第一晶体管N1的栅极，第一晶体管N1导通，将时序控制单元 20的热插拔检测信号输出端接地，维持热插拔检测信号HPD为低电平。
至时序控制单元20准备完成，准备完成指示信号GPIO翻转为高电平，经过传输延迟时间后，控制第二晶体管N2导通，使第一晶体管N1 的栅极偏置至低电平，控制第一晶体管N1关断，第一晶体管N1关断后，热插拔检测信号HPD经上拉电阻R0被上拉至高电平。
即本实施例的调控电路可在时序控制单元20准备完成之前将热插拔检测信号维持为低电平，在时序控制单元20准备完成之后才控制热插拔检测信号可被上拉至供电电压的高电平，可有效降低开机瞬间的热插拔检测信号HPD被瞬间上拉至高电平的可能，保障热插拔检测信号HPD 的时序的可靠性，降低开机瞬间的画面显示异常的可能。
在一可选实施例中，第一晶体管N1和第二晶体管N2均为PMOS (P-Metal-Oxide-Semiconductor，P型金属-氧化物-半导体)管，其衬底的偏置可由低压差线性稳压器31提供，在准备完成指示信号GIPO为低电平时，第二晶体管N2导通，第一晶体管N1的栅极偏置为低电平，第一晶体管N1导通，热插拔检测信号HPD为低电平；在时序控制单元20 准备完成，准备完成指示信号GPIO为高电平时，第二晶体管N2关断，第一晶体管N1的栅极仅连接低压差线性稳压器31提供的偏置电压信号，第一晶体管N1关断，热插拔检测信号HPD经上拉电阻R0上拉至高电平。
图5示出了根据本实用新型另一实施例的调控电路的结构示意图，图6示出了图5所示的调控电路的部分信号的时序图。其中，本实施例调控电路40与图3所示的调控电路30的主要区别在于：第二晶体管N2 的栅极与时序控制单元20的准备完成指示信号输出端之间还设置有脉冲电平转换单元41，对其它相同的部分在此不再详述。
参照图5和图6，本实施例的调控电路40中，其对应的时序控制单元20提供的准备完成指示信号GPIO为脉冲信号，在时序控制单元20 准备完成时，提供一个脉冲输出，脉冲电平转换单元41在接收该脉冲后，提供高电平的第二偏置电压信号，即控制第二晶体管N2的栅极偏置在时序控制单元20准备完成后翻转为高电平，热插拔检测信号HPD翻转为高电平的时序与第二偏置电压信号MCU同步。
其中，脉冲电平转换单元41例如为微控制单元(Microcontroller Unit， MCU)或触发器，在接收到准备完成指示信号GPIO的有效脉冲后将输出的第二偏置电压信号翻转为高电平，并维持高电平的第二偏置电压信号，维持对第二晶体管N2的偏置，保障第一晶体管N1在时序控制单元 20准备完成后为关断状态。
图7示出了根据本实用新型又一实施例的调控电路的结构示意图。
参照图7，在本实施例的调控电路50中，第一晶体管M1为NMOS 管，第二晶体管M2为PMOS管，第一晶体管M1串联在时序控制单元 20的热插拔检测信号输出端与地之间，第二晶体管M2串联在第一晶体管M1的栅极与低压差线性稳压器31的输出端之间，第二电阻器R2串联在第一晶体管M1的栅极与地之间，第二晶体管M2的栅极接收准备完成指示信号GPIO。
在准备完成指示信号GPIO为低电平时，第二晶体管M2导通，第一晶体管M1的栅极电平为第二电阻器R2的高电势端电平(即低压差线性稳压器31提供的第一偏置电压信号)，第一晶体管M1导通，热插拔检测信号HPD维持为低电势，在准备完成指示信号GPIO为高电平时，第二晶体管M2关断，第一晶体管M1的栅极通过第二电阻器R2接地，第一晶体管M1关断，热插拔检测信号HPD经上拉电阻R0被上拉至供电电压VIN。
在可选实施例中，第一晶体管M1为PMOS管，第二晶体管M2为 NMOS管，其衬底偏置可分别由低压差线性稳压器31和地提供。
本实用新型的调控电路通过第一晶体管串联时序控制单元的热插拔检测信号输出端与地，第一晶体管的栅极与第一偏置电压源和地耦接，第二晶体管串联在第一晶体管的栅极至第一偏置电压源或地之间，且第二晶体管的栅极与时序控制单元的准备完成指示信号输出端连接，可根据时序控制单元的准备完成状态控制热插拔检测信号的状态，在时序控制单元准备完成之前控制第一晶体管导通，保障热插拔检测信号为低电平，避免前端系统在时序控制单元配置完成之前向时序控制单元发送数据，改善了开机时的显示异常问题。
本实用新型还提供一种时序控制芯片，包括时序控制单元和本实用新型的调控电路，可根据时序控制单元的准备完成状态控制热插拔检测信号的状态，在时序控制单元准备完成之前控制第一晶体管导通，保障热插拔检测信号为低电平，避免前端系统在时序控制单元配置完成之前向时序控制单元发送数据，避免开机时的热插拔检测信号的误触发，改善开机时的显示异常问题。
本实用新型还提供一种显示装置，包括本实用新型的时序控制芯片，其热插拔检测信号在时序控制单元准备完成之前的开机瞬间不会瞬时误触发为高电平，有效降低了开机瞬间的显示异常问题。
依照本实用新型的实施例如上文所述，这些实施例并没有详尽叙述所有的细节，也不限制该实用新型仅为所述的具体实施例。显然，根据以上描述，可作很多的修改和变化。本说明书选取并具体描述这些实施例，是为了更好地解释本实用新型的原理和实际应用，从而使所属技术领域技术人员能很好地利用本实用新型以及在本实用新型基础上的修改使用。本实用新型仅受权利要求书及其全部范围和等效物的限制。
Claims (10)
1.一种调控电路，用于时序控制单元的热插拔检测信号的时序控制，所述时序控制单元的热插拔检测信号输出端通过上拉电阻器与供电电压接入端连接，其特征在于，所述调控电路包括：
第一晶体管，串联在所述时序控制单元的热插拔检测信号输出端与地之间，所述第一晶体管的栅极耦接至第一偏置电压源的第一偏置电压信号输出端或地；
第二晶体管，串联在所述第一晶体管的栅极至所述第一偏置电压信号输出端或地之间，所述第二晶体管的栅极与所述时序控制单元的准备完成指示信号输出端连接。
2.根据权利要求1所述的调控电路，其特征在于，
所述第一晶体管和所述第二晶体管均为NMOS管；
所述第二晶体管串联在所述第一晶体管的栅极与地之间。
3.根据权利要求1所述的调控电路，其特征在于，
所述第一晶体管为PMOS管，所述第二晶体管为NMOS管；
所述第二晶体管串联在所述第一晶体管的栅极与所述第一偏置电压源的第一偏置电压信号输出端之间；
所述第一晶体管的栅极还通过第二电阻器接地。
4.根据权利要求1所述的调控电路，其特征在于，
所述第一晶体管为NMOS管，所述第二晶体管为PMOS管；
所述第二晶体管串联在所述第一晶体管的栅极与所述第一偏置电压源的第一偏置电压信号输出端之间；
所述第一晶体管的栅极还通过第二电阻器接地。
5.根据权利要求1所述的调控电路，其特征在于，
所述第一晶体管和所述第二晶体管均为PMOS管；
所述第二晶体管串联在所述第一晶体管的栅极与地之间；
所述第一晶体管的栅极通过第一电阻器连接至所述第一偏置电压信号输出端。
6.根据权利要求1所述的调控电路，其特征在于：
所述第一偏置电压源包括低压差线性稳压器，所述低压差线性稳压器的输出端为所述第一偏置电压信号输出端。
7.根据权利要求6所述的调控电路，其特征在于，
所述低压差线性稳压器的输入端与系统输入电压接口连接。
8.根据权利要求1所述的调控电路，其特征在于，还包括：
脉冲电平转换单元，串联在所述时序控制单元的准备完成指示信号输出端与所述第二晶体管的栅极之间。
9.一种时序控制芯片，其特征在于，包括时序控制单元和根据权利要求1至8任一项所述的调控电路，其中，
所述时序控制单元，包括热插拔检测信号输出端和准备完成指示信号输出端，所述热插拔检测信号输出端还通过上拉电阻器连接至供电电压接入端。
10.一种显示装置，其特征在于，包括根据权利要求9所述的时序控制芯片。
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