CN212724020U - 一种超高频rfid芯片blf时钟的实现装置 - Google Patents
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Abstract
本实用新型提出一种超高频RFID芯片BLF时钟的实现装置，其特征在于包括以下电路：DR寄存器，TRCAL计数器，移位加法运算器，Tpri计数器和CLKBLF产生电路。使用本装置产生的时钟即为满足协议规定的反向链路频率的时钟，可以作为RFID芯片返回数据使用的时钟。使用本装置有效的解决了EPC Class1 Gen2协议中关于BLF计算的难点，可以避免使用硬件除法器，有利于降低成本和控制功耗。
Description
技术领域
本实用新型属于集成电路设计技术领域。具体地说，属于超高频RFID芯片设计技术领域。
背景技术
RFID(Radio Frequency Identification)，即射频识别技术。一套射频识别系统一般由读写器，电子标签和后端数据处理平台三部分组成。目前，射频识别系统已经渗透到日常生活的方方面面，如出入控制、公共交通的票务系统、物流链管理、医疗卫生行业以及零售业等。
根据读写器发送的无线电信号的频率，RFID系统可以划分为低频，高频，超高频以及微波四种。其中基于EPC Class1 Gen2协议的超高频RFID系统的工作频率为860MHz-960MHz，应用在较长的读写距离和较高速读写速度的场景。
EPC Class1 Gen2协议中定义电子标签返回给读卡器的数据速率为反向散射链路频率，即BLF(Back Scattered Frequency)。根据协议规定，标签的BLF和读卡器发送的Query命令有关。读卡器发送的Query命令会给定TRCAL和DR两个参数，DR/TRCAL即为BLF的值。可以看出如果要产生准确的反向散射频率(BLF)的时钟，芯片中需要一个硬件除法器，这将消耗很多硬件资源，对芯片的成本和功耗造成很大的挑战。
发明内容
针对上述技术问题，本实用新型提出一种超高频RFID芯片BLF时钟的实现装置，使用本方法的有益效果是，避免使用硬件除法器的同时，产生出的时钟频率满足协议规定的BLF误差范围。
本实用新型提出的一种超高频RFID芯片BLF时钟的实现装置，包括以下电路：DR寄存器，TRCAL计数器，移位加法运算器，Tpri计数器和CLKBLF产生电路。
所述DR寄存器，其特征在于，所述DR寄存器的输出信号连接至移位加法运算器。DR参数一旦记录，将一直保持，直至接收到新的Query命令。所述DR寄存器的作用是当读卡器发送Query命令时，记录其DR参数的值，为计算BLF做准备。根据EPC Class1 Gen2协议，DR的1和0分别代表BLF计算时64/3或8两个取值。
所述TRCAL计数器，其特征在于，TRCAL计数器的输出信号，连接至移位加法运算器。当读卡器发送Query命令时，记录其TRCAL的长度，当TRCAL结束时，TRCAL计数器停止计数并保留之前的计数值，直至接收到新的Query命令。
所述移位加法运算器，其特征在于，移位加法运算器的输入分别连接至DR寄存器的输出信号和TRCAL计数器的输出信号，所述移位加法运算器的输出信号连接至Tpri计数器。可以根据DR寄存器和TRCAL计数器的输出信号进行移位运算和加法运算，算出Tpri计数器需要计数的目标值。
所述Tpri计数器，其特征在于，Tpri计数器的输入连接移位加法运算器的输出信号，所述Tpri计数器的的输出信号，连接至CLKBLF产生电路。所述Tpri计数器可以根据移位加法运算器的输出信号进行计数操作，移位加法运算器的输出信号为计数的目标值，每当计数达到目标值后，计数清0重新开始计数，并产生输出信号。
所述CLKBLF产生电路，其特征在于，CLKBLF产生电路的输入连接Tpri计数器的输出信号，CLKBLF产生电路的输出即为满足BLF频率要求的CLKBLF。
附图说明
图1为本实用新型提出的一种超高频RFID芯片BLF时钟的实现装置的结构图。
具体实施方式
以下根据附图，具体说明本装置的较佳实施例。
如图1所示，一种超高频RFID芯片BLF时钟的实现装置，包括以下电路：DR寄存器，TRCAL计数器，移位加法运算器，Tpri计数器和CLKBLF产生电路。
所述DR寄存器，其特征在于，所述DR寄存器的输出信号连接至移位加法运算器。DR参数一旦记录，将一直保持，直至接收到新的Query命令。所述DR寄存器的作用是当读卡器发送Query命令时，记录其DR参数的值，为计算BLF做准备。根据EPC Class1 Gen2协议，DR的1和0分别代表BLF计算时64/3或8两个取值。
所述TRCAL计数器，其特征在于，TRCAL计数器的输出信号，连接至移位加法运算器。当读卡器发送Query命令时，记录其TRCAL的长度，当TRCAL结束时，TRCAL计数器停止计数并保留之前的计数值，直至接收到新的Query命令。
所述移位加法运算器，其特征在于，移位加法运算器的输入分别连接至DR寄存器的输出信号和TRCAL计数器的输出信号，所述移位加法运算器的输出信号连接至Tpri计数器。可以根据DR寄存器和TRCAL计数器的输出信号进行移位运算和加法运算，算出Tpri计数器需要计数的目标值。
所述Tpri计数器，其特征在于，Tpri计数器的输入连接移位加法运算器的输出信号，所述Tpri计数器的的输出信号，连接至CLKBLF产生电路。所述Tpri计数器可以根据移位加法运算器的输出信号进行计数操作，移位加法运算器的输出信号为计数的目标值，每当计数达到目标值后，计数清0重新开始计数，并产生输出信号。
所述CLKBLF产生电路，其特征在于，CLKBLF产生电路的输入连接Tpri计数器的输出信号，CLKBLF产生电路的输出即为满足BLF频率要求的CLKBLF。
使用本装置的有益效果是，避免使用硬件除法器的同时，产生出的时钟频率满足协议规定的BLF误差范围。有效的解决了EPC Class1 Gen2协议中关于BLF计算的难点，节省了硬件资源，有利于芯片降低成本和控制功耗。
尽管本实用新型的内容已经通过上述优选实施例作了详细介绍，在本领域技术人员阅读了上述内容后，对于本实用新型的多种修改和替代都将是显而易见的。以上的描述和附图仅仅是实施本实用新型的范例，但应当认识到上述的描述不应被认为是对本实用新型的限制。
Claims (1)
1.一种超高频RFID芯片BLF时钟的实现装置，其特征在于，包含：DR寄存器，TRCAL计数器，移位加法运算器，Tpri计数器和CLKBLF产生电路；所述DR寄存器连接移位加法运算器，其输出信号为寄存的DR参数的值；所述TRCAL计数器连接移位加法运算器，其输出信号为记录的TRCAL的长度；所述移位加法运算器的输入连接DR寄存器的输出信号和TRCAL计数器的输出信号，所述移位加法运算器输出连接Tpri计数器；所述Tpri计数器的输入连接移位加法运算器的输出信号，其输出连接CLKBLF产生电路；所述CLKBLF产生电路的输入连接Tpri计数器的输出信号，其输出即为符合BLF频率的CLKBLF。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| CN202022132492.3U CN212724020U (zh) | 2020-09-25 | 2020-09-25 | 一种超高频rfid芯片blf时钟的实现装置 |
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Publications (1)
| Publication Number | Publication Date |
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| CN212724020U true CN212724020U (zh) | 2021-03-16 |
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ID=74942481
Family Applications (1)
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| CN202022132492.3U Active CN212724020U (zh) | 2020-09-25 | 2020-09-25 | 一种超高频rfid芯片blf时钟的实现装置 |
Country Status (1)
| Country | Link |
|---|---|
| CN (1) | CN212724020U (zh) |
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2020
- 2020-09-25 CN CN202022132492.3U patent/CN212724020U/zh active Active
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