CN211018786U - 基于并联多路的信号检测电路 - Google Patents
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Abstract
本实用新型涉及信号检测电路领域，公开了一种基于并联多路的信号检测电路，包括八路扫描驱动电路、八路电子锁开关反馈电路、分压稳压电路和高低电平开关电路，所述八路扫描驱动电路与每路所述电子锁开关反馈电路连接，所述分压稳压电路与所述电子锁开关反馈电路连接，所述高低电平开关电路与所述分压稳压电路连接；其中一路所述电子锁开关反馈电路包括第一开关和第一二极管，所述第一开关的一端与所述八路扫描驱动电路连接，所述第一开关的另一端与所述第一二极管的阳极连接。实施本实用新型的基于并联多路的信号检测电路，具有以下有益效果：布线简单、方便排查问题、提高机器生产和维护效率、降低成本。
Description
技术领域
本实用新型涉及信号检测电路领域，特别涉及一种基于并联多路的信号检测电路。
背景技术
传统的电子锁开关反馈电路是不带二极管进行反向截止的，每一层都需要一块单独的信号处理板子才能处理锁的信号，由于每一层都要安装一块驱动板，这样就会带来布线复杂，排查问题困难等缺点，严重影响机器生产和维护效率，并且增加许多不必要的成本。
实用新型内容
本实用新型要解决的技术问题在于，针对现有技术的上述缺陷，提供一种布线简单、方便排查问题、提高机器生产和维护效率、降低成本的基于并联多路的信号检测电路。
本实用新型解决其技术问题所采用的技术方案是：构造一种基于并联多路的信号检测电路，包括八路扫描驱动电路、八路电子锁开关反馈电路、分压稳压电路和高低电平开关电路，所述八路扫描驱动电路与每路所述电子锁开关反馈电路连接，所述分压稳压电路与所述电子锁开关反馈电路连接，所述高低电平开关电路与所述分压稳压电路连接；
其中一路所述电子锁开关反馈电路包括第一开关和第一二极管，所述第一开关的一端与所述八路扫描驱动电路连接，所述第一开关的另一端与所述第一二极管的阳极连接。
在本实用新型所述的基于并联多路的信号检测电路中，所述八路扫描驱动电路包括第一电阻、第二电阻、第三电阻、第三电阻、第五电阻、位移缓存器和第一电容，所述第一电阻的一端、所述第二电阻的一端、所述第三电阻的一端、所述第四电阻的一端和所述第五电阻的一端均连接MCU_VCC_3V3端，所述第一电阻的另一端与所述位移缓存器的第十四引脚连接，所述第二电阻的另一端与所述位移缓存器的第十一引脚连接，所述第三电阻的另一端与所述位移缓存器的第十引脚连接，所述第四电阻的另一端与所述位移缓存器的第十二引脚连接，所述第五电阻的另一端与所述位移缓存器的第十三引脚连接，所述位移缓存器的第十五引脚与所述第一开关的一端连接，所述位移缓存器的第十六引脚通过所述第一电容接地。
在本实用新型所述的基于并联多路的信号检测电路中，所述位移缓存器的型号为74HC595D。
在本实用新型所述的基于并联多路的信号检测电路中，所述分压稳压电路包括第六电阻、第七电阻和第二电容，所述第六电阻的一端与所述第一二极管的阴极连接，所述第六电阻的另一端分别与所述第七电阻的一端和第二电容的一端连接，所述第七电阻的另一端和第二电容的另一端均接地。
在本实用新型所述的基于并联多路的信号检测电路中，所述高低电平开关电路包括第一三极管和第八电阻，所述第一三极管的基极分别与所述第六电阻的另一端、所述第七电阻的一端和所述第二电容的一端连接，所述第一三极管的发射极接地，所述第一三极管的集电极分别与所述第八电阻的一端和第一二极管的阴极连接，所述第八电阻的另一端连接FEEDBACK_VCC_3V3端。
在本实用新型所述的基于并联多路的信号检测电路中，所述位移缓存器的第十六引脚连接FEEDBACK_595_VCC_3V3端。
实施本实用新型的基于并联多路的信号检测电路，具有以下有益效果：由于设有八路扫描驱动电路、八路电子锁开关反馈电路、分压稳压电路和高低电平开关电路，电子锁开关反馈电路包括第一开关和第一二极管，电子锁开关反馈电路带二极管进行反向截止，不需要每一层安装驱动板，因此本实用新型布线简单、方便排查问题、提高机器生产和维护效率、降低成本。
附图说明
为了更清楚地说明本实用新型实施例或现有技术中的技术方案，下面将对实施例或现有技术描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本实用新型的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1为本实用新型基于并联多路的信号检测电路一个实施例中的电路原理图。
具体实施方式
下面将结合本实用新型实施例中的附图，对本实用新型实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本实用新型一部分实施例，而不是全部的实施例。基于本实用新型中的实施例，本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例，都属于本实用新型保护的范围。
在本实用新型基于并联多路的信号检测电路实施例中，该基于并联多路的信号检测电路的电路原理图如图1所示。图1中，该基于并联多路的信号检测电路包括八路扫描驱动电路1、八路电子锁开关反馈电路2、分压稳压电路3和高低电平开关电路4，其中，八路扫描驱动电路1与每路电子锁开关反馈电路2 连接，分压稳压电路3与电子锁开关反馈电路2连接，高低电平开关电路4与分压稳压电路3连接。
其中一路电子锁开关反馈电路2包括第一开关S1和第一二极管D1，其中，第一开关S1的一端、与八路扫描驱动电路1连接，第一开关S1的另一端与第一二极管D1的阳极连接。第一开关S1为微动开关。
电子锁开关反馈电路2带二极管进行反向截止，每路电子锁开关反馈电路2 共用一个八路扫描驱动电路1，不需要每一层安装驱动板，因此本实用新型布线简单、方便排查问题、提高机器生产和维护效率、降低成本。
本实施例中，该八路扫描驱动电路1包括第一电阻R1、第二电阻R2、第三电阻R3、第三电阻R4、第五电阻R5、位移缓存器U1和第一电容C1，其中，第一电阻R1的一端、第二电阻R2的一端、第三电阻R3的一端、第四电阻R4 的一端和第五电阻R5的一端均连接MCU_VCC_3V3端，第一电阻R1的另一端与位移缓存器U1的第十四引脚连接，第二电阻R2的另一端与位移缓存器U1 的第十一引脚连接，第三电阻R3的另一端与位移缓存器U1的第十引脚连接，第四电阻R4的另一端与位移缓存器U1的第十二引脚连接，第五电阻R5的另一端与位移缓存器U1的第十三引脚连接，位移缓存器U1的第十五引脚与第一开关S1的一端连接，位移缓存器U1的第十六引脚通过第一电容C1接地，位移缓存器U1的第十六引脚连接FEEDBACK_595_VCC_3V3端。本实施例中，位移缓存器U1的型号为74HC595D。
FEEDBACK_VCC_H1电流经第一开关S1和第一二极管D1为电子锁开关反馈电路2。位移缓存器U1左边是输入控制引脚，控制着位移缓存器U1右侧 QA-QH的三态输出脚，并在位移缓存器U1的第十六引脚输入加了电容稳压，达到多路控制目的，位移缓存器U1的第九引脚可以扩展多路74HC595D位移缓存器。
位移缓存器U1的第十五引脚即FEEDBACK_VCC_H1并联接入八路电子锁开关反馈电路2，即通过给八路并联电路通电，当电子锁是关闭时里面的开关被通路经过二极管后到达下游电路。
本实施例中，该分压稳压电路3包括第六电阻R6、第七电阻R7和第二电容C2，第六电阻R6的一端与第一二极管D1的阴极连接，第六电阻R6的另一端分别与第七电阻R7的一端和第二电容C2的一端连接，第七电阻R7的另一端和第二电容C2的另一端均接地。第七电阻R7为下拉电阻，第七电阻R7保证检测引脚悬空时处于低电平。第六电阻R6、第七电阻R7和第一二极管D1 组成反向干扰截止电路部分。
在电子锁开关反馈电路2提供的反馈状态下即悬空和通电3.3V，通过第六电阻R6降压，第七电阻R7下拉，第二电容C2稳压下，将信号悬空和通路时的信号进行处理输出。
本实施例中，该高低电平开关电路4包括第一三极管Q1和第八电阻R8，第一三极管Q1的基极分别与第六电阻R6的另一端、第七电阻R7的一端和第二电容C2的一端连接，第一三极管Q1的发射极接地，第一三极管Q1的集电极分别与第八电阻R8的一端和第一二极管D1的阴极连接，第八电阻R8的另一端连接FEEDBACK_VCC_3V3端。当输出经过第一三极管Q1时，FEEDBACK_VCC_3V3端通过第八电阻R8直接让MCU_FEEDBACK1检测引脚处于高电平的电流，被第一三极管Q1(NPN型三极管)作为开关作用将VCC 导通至地，使MCU_FEEDBACK1处于低电平，从而达到开关检测作用。
总之，该基于并联多路的信号检测电路为并联多路进行锁闭合状态扫描滤除干扰的信号检测电路，特别是适用并联扫描多路电子锁开关状态，并且当任意一路开关闭合时，位移缓存器U1的引脚接入的常高电压不会流回检测电路中，准确的检测每个锁的状态。本实用新型布线简单、方便排查问题、提高机器生产和维护效率、降低成本。
以上所述仅为本实用新型的较佳实施例而已，并不用以限制本实用新型，凡在本实用新型的精神和原则之内，所作的任何修改、等同替换、改进等，均应包含在本实用新型的保护范围之内。
Claims (6)
1.一种基于并联多路的信号检测电路，其特征在于，包括八路扫描驱动电路、八路电子锁开关反馈电路、分压稳压电路和高低电平开关电路，所述八路扫描驱动电路与每路所述电子锁开关反馈电路连接，所述分压稳压电路与所述电子锁开关反馈电路连接，所述高低电平开关电路与所述分压稳压电路连接；
其中一路所述电子锁开关反馈电路包括第一开关和第一二极管，所述第一开关的一端与所述八路扫描驱动电路连接，所述第一开关的另一端与所述第一二极管的阳极连接。
2.根据权利要求1所述的基于并联多路的信号检测电路，其特征在于，所述八路扫描驱动电路包括第一电阻、第二电阻、第三电阻、第三电阻、第五电阻、位移缓存器和第一电容，所述第一电阻的一端、所述第二电阻的一端、所述第三电阻的一端、第四电阻的一端和所述第五电阻的一端均连接MCU_VCC_3V3端，所述第一电阻的另一端与所述位移缓存器的第十四引脚连接，所述第二电阻的另一端与所述位移缓存器的第十一引脚连接，所述第三电阻的另一端与所述位移缓存器的第十引脚连接，所述第四电阻的另一端与所述位移缓存器的第十二引脚连接，所述第五电阻的另一端与所述位移缓存器的第十三引脚连接，所述位移缓存器的第十五引脚与所述第一开关的一端连接，所述位移缓存器的第十六引脚通过所述第一电容接地。
3.根据权利要求2所述的基于并联多路的信号检测电路，其特征在于，所述位移缓存器的型号为74HC595D。
4.根据权利要求3所述的基于并联多路的信号检测电路，其特征在于，所述分压稳压电路包括第六电阻、第七电阻和第二电容，所述第六电阻的一端与所述第一二极管的阴极连接，所述第六电阻的另一端分别与所述第七电阻的一端和第二电容的一端连接，所述第七电阻的另一端和第二电容的另一端均接地。
5.根据权利要求4所述的基于并联多路的信号检测电路，其特征在于，所述高低电平开关电路包括第一三极管和第八电阻，所述第一三极管的基极分别与所述第六电阻的另一端、所述第七电阻的一端和所述第二电容的一端连接，所述第一三极管的发射极接地，所述第一三极管的集电极分别与所述第八电阻的一端和第一二极管的阴极连接，所述第八电阻的另一端连接FEEDBACK_VCC_3V3端。
6.根据权利要求2至5任意一项所述的基于并联多路的信号检测电路，其特征在于，所述位移缓存器的第十六引脚连接FEEDBACK_595_VCC_3V3端。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
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| CN201922451285.1U CN211018786U (zh) | 2019-12-28 | 2019-12-28 | 基于并联多路的信号检测电路 |
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| Application Number | Priority Date | Filing Date | Title |
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| CN201922451285.1U CN211018786U (zh) | 2019-12-28 | 2019-12-28 | 基于并联多路的信号检测电路 |
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| CN211018786U true CN211018786U (zh) | 2020-07-14 |
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Country Status (1)
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| CN (1) | CN211018786U (zh) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN113054965A (zh) * | 2021-03-11 | 2021-06-29 | 重庆大学 | 一种车辆高低电平有效开关闭合和悬空状态的检测电路 |
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2019
- 2019-12-28 CN CN201922451285.1U patent/CN211018786U/zh active Active
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